JPH0588018U - 出力合成回路 - Google Patents

出力合成回路

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JPH0588018U
JPH0588018U JP2842992U JP2842992U JPH0588018U JP H0588018 U JPH0588018 U JP H0588018U JP 2842992 U JP2842992 U JP 2842992U JP 2842992 U JP2842992 U JP 2842992U JP H0588018 U JPH0588018 U JP H0588018U
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孝行 宇野
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Abstract

(57)【要約】 【目的】この考案の目的は、構成簡易にして相互にアイ
ソレーションをとりつつ、各チャンネルのトランスの二
次巻線に励磁された信号を合成出力することのできる出
力合成回路を提供することにある。 【構成】この考案は、複数のトランスの一次巻線にそれ
ぞれ高周波電力増幅器の出力を印加し、二次巻線を互い
に直列に接続してその両端から前記高周波電力増幅器の
合成出力を得る出力合成回路において、前記複数のトラ
ンスのそれぞれに、その一次巻線、二次巻線の少なくと
もいずれか一方に規定電圧以上の電圧が発生するとき、
放電してその電圧を低下させる放電回路を設けるように
したことを特徴とする。

Description

【考案の詳細な説明】
【0001】
【産業上の利用分野】
この考案は、例えばラジオ送信機に用いられる出力合成回路に関する。
【0002】
【従来の技術】
従来より、ラジオ送信機にあっては、複数チャンネルの放送信号をチャンネル ごとに設けられた高周波電力増幅器(PA)で増幅した後、各増幅信号を合成し て送信出力としている。このような出力合成回路は、一般に図6に示すように構 成されている。
【0003】 図6において、nチャンネルの高周波電力増幅器(PA)11〜1nの出力端 はそれぞれチャンネル毎に設けられたトランス21〜2nの一次巻線の一方端に 接続される。各トランス21〜2nの一次巻線の他方端は、それぞれイコライジ ング用のダミー抵抗31〜3nを介して結合される。各トランス21〜2nの二 次巻線は、一方端が次チャンネル(トランス2nの場合は最初のチャンネル)の トランスの一次巻線の他方端(信号出力端)に接続され、他方端が共通に負荷R L に接続される。
【0004】 すなわち、上記構成の出力合成回路は、各チャンネルの電力増幅器11〜1n の出力をそれぞれトランス21〜2nの一次巻線に印加し、二次巻線に励磁させ て並列に合成出力するようにしたものであり、この際、トランス21〜2nの二 次巻線にそれぞれ隣接チャンネルの一次巻線出力を印加することにより相互のア イソレーションをとるようにしている。
【0005】 ところが、この構成では回路が複雑で、一部のチャンネルの電力増幅器の出力 が停止した場合でもダミー抵抗に電力が消費されるため、電力効率が低下する等 の問題を有している。
【0006】 一方、従来では図7に示すような構成の出力合成回路もよく用いられている。 図7において、nチャンネルの高周波電力増幅器11〜1nはそれぞれチャンネ ル毎に設けられたトランス51〜5nの一次巻線に接続される。各トランス51 〜5nの二次巻線は互いに直列接続され、その両端は合成信号出力端となり、負 荷RL に接続される。
【0007】 すなわち、上記構成の出力合成回路は、各チャンネルのトランス51〜5nの 二次巻線と負荷RL とで閉回路を構成し、各二次巻線に一次側から電力増幅出力 で励起することにより、出力合成を行うようにしたものである。
【0008】 ところが、この構成では相互のアイソレーションがとられていないため、電力 増幅器の故障等によって一部のトランスの一次巻線が開放となった場合に負荷へ の電力が供給されなくなるという問題を有している。
【0009】
【考案が解決しようとする課題】
以上述べたように従来の出力合成回路では、各チャンネルのトランスの二次巻 線に励磁された信号を、相互にアイソレーションをとりつつ合成するには、複雑 な構成を余儀なくされていた。
【0010】 この発明は上記の問題を解決するためになされたもので、構成簡易にして相互 にアイソレーションをとりつつ、各チャンネルのトランスの二次巻線に励磁され た信号を合成出力することのできる出力合成回路を提供することを目的とする。
【0011】
【課題を解決するための手段】
上記目的を達成するためにこの考案は、複数のトランスの一次巻線にそれぞれ 高周波電力増幅器の出力を印加し、二次巻線を互いに直列に接続してその両端か ら前記高周波電力増幅器の合成出力を得る出力合成回路において、前記複数のト ランスのそれぞれに、その一次巻線、二次巻線の少なくともいずれか一方に規定 電圧以上の電圧が発生するとき、放電してその電圧を低下させる放電回路を設け るようにしたことを特徴とする。
【0012】
【作用】
上記構成による出力合成回路では、各トランスの一次巻線、二次巻線のいずれ かに発生する電圧が規定値以上になると、放電回路が放電してその発生電圧を低 下させるので、例えば一部の電力増幅器が故障して対応するトランスの一次巻線 が開放状態となっても、確実に合成出力を負荷に供給することができる。
【0013】
【実施例】
以下、図面を参照してこの考案の実施例を説明する。
【0014】 図1はこの発明に係る第1の実施例の構成を示すもので、nチャンネルの高周 波電力増幅器11〜1nはそれぞれチャンネル毎に設けられたトランス51〜5 nの一次巻線に接続される。各トランス51〜5nの二次巻線は互いに直列接続 され、その両端は合成信号出力端となり、負荷RL に接続される。
【0015】 さらに、上記トランス51〜5nの一次巻線には、それぞれ気体放電素子61 〜6nが並列に接続される。ここに使用する気体放電素子としては、印加電圧が 放電開始電圧を越えるとアーク放電を生じ、両端電圧を低電圧に制限する特性を 持つ。一例としてガスアレスタがよく知られている。
【0016】 すなわち、上記構成の出力合成回路では、各トランス51〜5nの一次巻線に 印加される電圧が気体放電素子61〜6nで規定される電圧値以上になると、キ タイ放電素子がアーク放電により電圧を下げる。この結果、いずれかの電力増幅 器にオープンモードの故障が生じたとしても、他の正常な電力増幅器の出力が故 障した電力増幅器で消費されることはなく、正常な電力増幅器の出力は負荷RL へと出力される。
【0017】 したがって、上記構成による出力合成回路は、各チャンネルのトランス51〜 5nの一次巻線にそれぞれ気体放電素子61〜6nを接続するという簡易な構成 で、相互にアイソレーションをとりつつ、各チャンネルのトランスの二次巻線に 励磁された信号を合成出力することができる。また、イコライジング用ダミー抵 抗を用いていないため、電力効率を向上させることができる。さらに、気体放電 素子はダミー抵抗に比較して小型であることから、製品の縮小化をも実現可能で ある。
【0018】 以下、図2乃至図5にこの発明に係る他の実施例を説明する。但し、図2乃至 図5において、図1と同一部分には同一符号を付して示し、その説明は省略する 。
【0019】 図2はこの発明に係る第2の実施例を示すもので、図1の気体放電素子61〜 6nを各トランス51〜5nの二次巻線に並列接続するようにしたもので、他の 構成は図1と同様である。
【0020】 図3はこの発明に係る第3の実施例を示すもので、各トランス51〜5nに三 次巻線を設け、これらの三次巻線に図1または図2の気体放電素子61〜6nを 並列接続するようにしたもので、他の構成は図1または図2と同様である。
【0021】 図4、図5はそれぞれこの発明に係る第4、第5の実施例を示すもので、それ ぞれ図1、図2に示した気体放電素子61〜6nを放電ギャップ71〜7nで実 現する場合の構成を示している。放電ギャップは上述した気体放電素子と同等の 特性を実現可能である。
【0022】 図2乃至図5に示した第2乃至第5の実施例は、いずれも図1に示した第1の 実施例と同等の効果が得られることはもちろんである。その他、この考案の要旨 を逸脱しない範囲で種々変形しても、同様に実施可能であることはいうまでもな い。
【0023】
【考案の効果】
以上のようにこの考案によれば、構成簡易にして相互にアイソレーションをと りつつ、各チャンネルのトランスの二次巻線に励磁された信号を合成出力するこ とのできる出力合成回路を提供することができる。
【図面の簡単な説明】
【図1】この考案に係る出力合成回路の第1の実施例を
示す回路図。
【図2】この考案に係る第2の実施例の構成を示す回路
図。
【図3】この考案に係る第3の実施例の構成を示す回路
図。
【図4】この考案に係る第4の実施例の構成を示す回路
図。
【図5】この考案に係る第5の実施例の構成を示す回路
図。
【図6】従来の出力合成回路の構成を示す回路図。
【図7】従来の出力合成回路の構成を示す回路図。
【符号の説明】
11〜1n…高周波電力増幅器、21〜2n,3…ダミ
ー抵抗、51〜5n…トランス、61〜6n…気体放電
素子、71〜7n…放電ギャップ、RL …負荷。

Claims (7)

    【実用新案登録請求の範囲】
  1. 【請求項1】 複数のトランスの一次巻線にそれぞれ高
    周波電力増幅器の出力を印加し、二次巻線を互いに直列
    に接続してその両端から前記高周波電力増幅器の合成出
    力を得る出力合成回路において、前記複数のトランスの
    それぞれに、その一次巻線、二次巻線の少なくともいず
    れか一方に規定電圧以上の電圧が発生するとき、放電し
    てその電圧を低下させる放電回路を設けるようにしたこ
    とを特徴とする出力合成回路。
  2. 【請求項2】 前記放電回路は、前記複数のトランスの
    各一次巻線に並列に接続されることを特徴とする請求項
    1記載の出力合成回路。
  3. 【請求項3】 前記放電回路は、前記複数のトランスの
    各二次巻線に並列にに接続されることを特徴とする請求
    項1記載の出力合成回路。
  4. 【請求項4】 前記放電回路は、前記複数のトランスの
    各一次巻線及び二次巻線のそれぞれに並列に接続される
    ことを特徴とする請求項1記載の出力合成回路。
  5. 【請求項5】 前記複数のトランスはそれぞれ三次巻線
    を備え、前記放電回路は、前記複数のトランスの各三次
    巻線に並列に接続されることを特徴とする請求項1記載
    の出力合成回路。
  6. 【請求項6】 前記放電回路は、気体放電素子であるこ
    とを特徴とする請求項1記載の出力合成回路。
  7. 【請求項7】 前記放電回路は、放電ギャップであるこ
    とを特徴とする請求項1記載の出力合成回路。
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JPH083057Y2 JPH083057Y2 (ja) 1996-01-29

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2010141673A (ja) * 2008-12-12 2010-06-24 Renesas Technology Corp 電力増幅回路
JP2013042527A (ja) * 2012-10-10 2013-02-28 Renesas Electronics Corp 電力増幅回路

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