JPH06112587A - 電流分布および光学モ−ドの分離制御可能なvcsel - Google Patents

電流分布および光学モ−ドの分離制御可能なvcsel

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JPH06112587A
JPH06112587A JP5207008A JP20700893A JPH06112587A JP H06112587 A JPH06112587 A JP H06112587A JP 5207008 A JP5207008 A JP 5207008A JP 20700893 A JP20700893 A JP 20700893A JP H06112587 A JPH06112587 A JP H06112587A
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mesa
stack
vertical cavity
parallel mirror
mirror stack
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JP5207008A
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Donald E Ackley
ドナルド・イ−・アックレイ
Chan-Long Shieh
チャン・ロング・シ−
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Motorola Inc
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Abstract

(57)【要約】 (修正有) 【目的】 本発明は電流分布および光学モ−ドを分離制
御可能な新規で改良されたVCSELを提供することを
目的とする。 【構成】 上部ミラ−・スタック12,18上に配置さ
れる材料と共にメサ型領域から形成するためエッチング
される上部ミラ−・スタックを有する基板上に形成され
るVCSEL15であって、その上部ミラ−・スタック
はレ−ザ内において電流分布を制御するため電気的コン
タクト・ウィンドウを限定する光学的に透明な電導性材
料を含み、所定のミラ−反射率特性を与えるように選択
される光学的厚さと共にメサ型領域の表面上に配置され
る材料であって、メサのエッジには依存しない光学モ−
ドを制御する材料を含み、その結果電流と光学モ−ドと
を別々に制御することが可能になる。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は縦型空洞表面放出レ−ザ
(vertical cavity surface
emitting laser:VCSEL)に関し、
特にその縦型空洞表面放出レ−ザを形成する際に電流分
布および光学モ−ドを分離制御する方法および装置に関
する。
【0002】
【従来の技術】従来のエッジ放出半導体レ−ザは、その
高い動作効率,小さなサイズおよび変調能力(modu
lation capabilities)により、光
通信技術の発達において重要な役割を演じている。しか
し、動作特性を向上させる必要性,更なる小型化および
量産する必要性と共に、これらのデバイスは限界に直面
しつつある。
【0003】現在、縦型空洞表面放出レ−ザと呼ばれる
新しい種類のレ−ザ装置が注目を集めている。VCSE
Lデバイスの利点は、そのデバイスがより小型であるこ
と,潜在的に優れた動作特性を有することおよび潜在的
により量産生があることである。これらの利点は、エピ
タキシャル堆積技術における利益から生じるものであ
り、例えば有機金属気相エピタキシ(MOVPE)およ
び分子線エピタキシ(MBE)である。
【0004】しかし、これらの堆積技術の利点をもって
しても、製造段階において、レ−ザの動作モ−ドを制御
することおよびレ−ザ内の電流分布を制御する際に困難
を生じる。一般に、VCSELは基板上に複数の層を堆
積し、その後その層を基板までエッチングすることによ
って形成される。これらの技術については例えば、19
91年6月23日に特許された米国特許5,034,0
92”PlasmaEtching of Semic
onductor Substrates”に開示され
ており、その発明は本発明と同じ譲受人に譲渡され、本
発明においても同様な技術が用いられている。
【0005】VCSELを形成するメサ(mesa)型
エッチング技術は、2つの欠点を有する。そのエッチン
グ工程は表面における結晶にダメ−ジを与え、しきい値
電流を増加させ、信頼性を減少させることとなる。その
メサは、屈折率に大きな不連続性を有するウェ−ブガイ
ドを形成し、その不連続性は小さなサイズのデバイスを
形成することなしに光学モ−ドを制御することを困難に
し、直列抵抗を増加させ、最大の出力パワ−を減少させ
る。これらは一般に、効率的でないおよび安定していな
いデバイスになる。
【0006】
【発明が解決しようとする課題】本発明は、電流分布お
よび光学モ−ドを分離制御可能な新規で改良されたVC
SELを提供することを目的とする。
【0007】本発明は更に、サイズ,効率,パワ−出力
などの特性が最適である、電流分布および光学モ−ドを
分離制御可能な新規で改良されたVCSELを提供する
ことを目的とする。
【0008】
【課題を解決するための手段】上述した課題は以下の方
法によって解決される。電流分布および光学モ−ドを別
々に制御する縦型空洞表面放出レ−ザを形成する方法で
あって、基板を提供する段階と、前記基板上にミラ−の
第1パラレル・スタックを形成する段階と、前記第1パ
ラレル・ミラ−・スタック上にアクティブおよびスペ−
サ層を形成する段階と、前記アクティブおよびスペ−サ
層上に第2パラレル・ミラ−・スタックを形成する段階
と、前記レ−ザの光学モ−ドを制御するため第2パラレ
ル・ミラ−・スタックに対して所定の反射率特性を与え
る光学的厚さを有する材料を前記第2パラレル・ミラ−
・スタック上に堆積する段階から構成されることを特徴
とする縦型空洞表面放出レ−ザを形成する方法である。
【0009】上述した課題はまた以下の縦型空洞表面放
出レ−ザによって解決される。別々に制御される光学モ
−ドを有する縦型空洞表面放出レ−ザであって、基板
と、前記基板上に配置されるミラ−の第1パラレル・ス
タックと、前記第1パラレル・ミラ−・スタック上に配
置されるアクティブおよびスペ−サ層と、前記アクティ
ブおよびスペ−サ層上に配置される第2パラレル・ミラ
−・スタックと、前記第2パラレル・ミラ−・スタック
が所定の反射率特性を有するような光学的厚さを有する
前記第2パラレル・ミラ−・スタック上に配置される材
料から構成される縦型空洞表面放出レ−ザである。
【0010】
【実施例】図1は、VCSELを形成する中間段階にお
ける断面図を示す。そのVCSELは基板10上に形成
され、本実施例ではNド−プ(N型にド−プされた)ひ
化ガリウム(gallium arsenide)であ
る。更に、他の半導体基板を用いることも可能であるこ
とに留意すべきである。
【0011】複数の交互に積み重なることなる層のエピ
タキシャル堆積は、MBE,MOCVD等の当該業界で
周知の方法によって形成される。これらの技術は様々な
材料の比較的薄い層と厚い層のエピタキシャル堆積を可
能にし、その材料は例えばアルミニウム・ひ化ガリウム
(aluminum gallium arsenid
e),ひ化アルミニウム,インジウム燐(indium
phosphide)等である。VCSELデバイス
を形成する際に、エピタキシャル堆積を広く用いて、デ
バイスを形成する異なる材料の複数の層を形成すること
が可能となる。
【0012】低い(<15%)Nド−プ・アルミニウム
・ひ化ガリウム、高い(>80%)のアルミニウム・モ
ル・フラクション(mole fraction)の層
を交互に堆積すると、反射面すなわちミラ−の第1スタ
ック(stack)12を形成する。アルミニウム・ひ
化ガリウムの積み重なる層の厚さは、VCSELが動作
するように設計される波長の約4分の1に設定される。
【0013】一般のアクティブおよびスペ−サ層15は
第1ミラ−・スタック12上にエピタキシャル堆積され
るクラッド(clad)領域を含み、アクティブ(ac
tive)層15の第1主面(major surfa
ce)を形成する。アクティブ領域はクラッド領域上に
エピタキシャル堆積され、第2クラッド領域はエピタキ
シャル堆積され、アクティブおよびスペ−サ層15の第
2主面を形成する。
【0014】反射面すなわちミラ−の第2スタック18
は、アクティブおよびスペ−サ層15の第2クラッド領
域上にエピタキシャル堆積される。第2ミラ−・スタッ
ク18は、第1ミラ−・スタック12で用いられるよう
に、交互に積み重なるモル・フラクションと共にPド−
プ・アルミニウム・ひ化ガリウムの交互に積み重なる層
から構成される。交互に積み重なる最後の層の厚さは、
他の層で用いられているような1波長の4分の1ではな
く、4分の1波長の約整数倍である。一般に、VCSE
Lのしきい電流は、ミラ−・スタック12,18におい
て交互に積み重なる層の数を増加させることによって、
減少させることが可能である。
【0015】第1ミラ−・スタック12,アクティブ層
15および第2ミラ−・スタック18が形成されると、
その構造はパタ−ニングされ、1つ以上の個々のVCS
ELを形成する。本実施例にあっては、そのパタ−ニン
グは以下に述べるようにして行われる。第2ミラ−・ス
タック18の上部表面が、周知の方法の1つによって、
フォトレジスト材料20の層と共に提供される。フォト
レジスト20を露光し、その材料を除去し、トレンチの
配置およびサイズを限定する。そのトレンチは周知の手
段によってミラ−・スタック18をエッチングすること
によって形成される。その手段は例えば、イオン・ミリ
ング(ion milling)または米国特許5,0
34,092に開示されているエッチ工程である。その
米国特許は”Plasma Etching of S
emiconductor Substrates”と
題され、1991年6月23日に特許され、本発明と同
じ譲受人に譲渡されている。一般に、そのトレンチは完
全に周囲に伸び、一般にメサ型領域を限定し、本実施例
では円形の断面を有する。
【0016】VCSELの分野では、ミラ−・スタック
が基板を介して完全にエッチングされてるとき、そのレ
−ザはしばしば「メサ・デバイス」と呼ばれる。またそ
のエッチングがミラ−・スタックの上部を介して部分的
に行われるとき、そのレ−ザはしばしば「リドゥル(r
iddle)・ガイド・デバイス」と呼ばれる。本発明
は、何れのエッチングの種類に対しても行うことが可能
であり、その結果エッチングされた領域はトレンチを通
じて関連し、そのトレンチによって限定された領域はメ
サ型領域と呼ばれる。しかし、部分的にエッチングされ
た、上面放出(top emitting)VCSEL
は、本発明が最も有用なものであるデバイスとなり、以
後の説明で開示されるデバイスは、他のデバイスに適用
することも可能である。
【0017】図2は、上面放出VCSEL25の断面図
である。VCSEL25は基板30上に形成され、基板
30上に形成される低パラレル・ミラ−・スタック32
を含み、パラレル・ミラ−・スタック32上に形成され
るアクティブおよびスペ−サ層35並びにアクティブお
よびスペ−サ層35上に形成される上部パラレル・ミラ
−・スタック38を含む。上部パラレル・ミラ−・スタ
ック38はアクティブおよびスペ−サ層35に対して実
質的に縦にエッチングされ、上部パラレル・ミラ−・ス
タック38の残留部分(remainder)を包囲す
るトレンチ39を形成する。トレンチ39によって限定
される上部パラレル・ミラ−スタック38のその残留部
分は、メサ型領域40となる。
【0018】VCSEL25の動作波長(周波数)は、
その構成要素(材料など),アクティブおよびスペ−サ
層35の大きさ並びにミラ−・スタック32,38によ
って既に決定されたものとなる。さらに、よく知られて
いるように、VCSELは最も低い次数のモ−ドで動作
することが望まれる。そのモ−ド・サイズすなわち最低
次数の動作モ−ドを維持するために用いられる最大堆積
は、ミラ−・スタック32,38の光学特性によって決
定される。メサ型領域40の直径「d」は、一般に高次
の動作モ−ドを含むことなしに最低次数のモ−ドにおけ
る動作を維持する最大の領域である。レ−ザ発振はメサ
型領域40内およびその下でのみ生じるので、トレンチ
(または複数のトレンチ)39をエッチングする構造を
マスクすることは重要なことではない。一般に、トレン
チ39の深さは、アクティブおよびスペ−サ層35とは
接触しないように形成されるので、その信頼性は増進す
る。また、トレンチ39の幅は重要なものではなく、特
定の製品およびその後の製造工程に依存する適切な幅と
なる。
【0019】例えばシリコン窒化物(SiNx)である
誘電体材料のスペ−サ44は、VCSEL25の表面全
体に堆積され、開口はメサ型領域40の上部表面上を通
じてエッチングされ、一般に光放出領域に一致するもの
となり、また光が放出する領域を限定する。透明な金属
コンタクト層46はその放出領域内に堆積され、メサ型
領域40に続き、電気的コンタクト・ウィンドウ(wi
ndow)42を限定し、外部電気コンタクトに対して
十分な表面を提供する。一般に利用される透明な材料
は、インジウム錫酸化物(ITO:indium ti
n oxide),カドミウム錫酸化物などである。必
要であれば、更に従来の金属を層46上に堆積すること
も可能である。電気的コンタクト・ウィンドウ42は、
上部パラレル・ミラ−・スタック38内の電流分布を主
として制御する。
【0020】図2に示されるVCSEL25は、透明な
金属コンタクトおよび注入された電流分布とその光学モ
−ドとを別々に制御するメサ型領域に加えて誘電体電流
閉じ込め(dielectric current c
onfinement)を用いている。本実施例では、
VCSEL25は、第1堆積SiNx層および開口高コ
ンタクト・ウィンドウによって(パラレル・ミラ−・ス
タック32,38並びにアクティブおよびスペ−サ層3
5の基本的な構造から)形成される。透明な金属コンタ
クトITOは、その後堆積され、コンタクト・ウィンド
ウと共に同心円状に(dot concentric)
パタ−ニングされる。そのITO層およびパラレル・ミ
ラ−・スタックはエッチングされ、光学ウェ−ブガイド
構造を形成し、ミラ−・スタックを介して部分的にまた
は全体的にエッチングされる。誘電体材料の第2の層は
その後堆積され、サイドウォ−ルおよびメサ型領域40
以外の領域を被覆し、ITOの第2の層が堆積され、コ
ンタクト層を形成する。VCSEL25はメサ型絶縁エ
ッチおよび背面コンタクト47を形成する段階と共に終
了する。
【0021】VCSEL25の動作モ−ドは図2の楕円
48で示されており、その注入(injection)
電流分布(または閉じ込め)は線49で示されている。
【0022】誘電体層44の用いると、2つの目的に対
して有効である。第1に、動作電流をメサ型領域40の
中心に閉じ込めると、大きなデバイス(≧20ミクロ
ン)において基本となる光学モ−ドと共により効率的な
オ−バ−ラップを可能にする。第2に、透明な金属層ま
たは層46を組み合わせることによって、誘電体層は上
部パラレル・ミラ−・スタック38の反射率に大きく影
響する。例えば、誘電体層44とコンタクト層46との
和である光学的な全体の厚さ「t」は、VCSEL放出
の半波長の整数倍であり、共振器(メサ型アクティブ領
域)の空洞の「Q」は共振器構造そのもののQから不変
であり、本実施例では約350である。しかし、誘電体
層44とコンタクト層46との和である厚さtは4分の
1波長の奇数倍に等しいとき、共振器のQは最大値の2
0%にまで減少する。2つの例の間の厚さの違いは中間
損失の差を与える。したがって、メサ型領域40の上面
上に配置された層は、共振器(ミラ−)の損失に激的に
影響するので、効率的な横型ウェ−ブガイド上のVCS
EL25の構造では非常に影響が大きい。層44,46
の厚さを制御することによって、ミラ−反射率は空間的
に変化し、メサ型領域40の直径「d」に依存せずに光
学モ−ドを制御する。
【0023】材料層の光学的厚さは、その材料の屈折率
倍された実際の厚さに等しい。例えば、ITO材料の屈
折率は約2.0ないし2.2である。したがって、1半
波長の光学的厚さと共にITOの実際の層の厚さは、そ
のデバイスの放出周波数における4分の1波長に等しく
なる。
【0024】図3は、VCSEL25に類似するVCS
ELにおける、ミラ−損失の図形表示または反射率の概
略50を示す。また図4は、図3に対応して配置された
ものであり、図3のVCSELにおける反射率の概略5
0に対する電流閉じ込めを表したものである。反射率の
概略50は、最も外側の線52,53を含み、トレンチ
39に一致し、ミラ−損失は最大になる。各々の線5
2,53の内側端部において、ミラ−損失は急激に降下
し、メサ型領域40の外端部から電気的コンタクト・ウ
ィンドウ42の外側の限界までを示す。本実施例にあっ
ては、誘電体層44と最終的なITO層46との結合さ
れた光学的厚さは、1半波長の整数倍と4分の1波長の
奇数倍との間の変量である。また本実施例では、電気的
コンタクト・ウィンドウ42上の透明な金属コンタクト
46は動作波長の1半波長の整数倍に等しい厚さtを有
する用に構成される。したがって、ミラ−損失は電気的
コンタクト・ウィンドウ42において再び急激に降下
し、電気的コンタクト・ウィンドウ42内の最少ミラ−
損失を示す線59まで降下する。
【0025】この配置は、2つのウェ−ブガイド領域を
有する分離閉じ込めヘテロ構造(SCH)に類似する。
VCSELの反射率の概略50は、層44/46の厚さ
を制御することによって調整し、ミラ−反射率を変化さ
せ、メサ・エッジに依存しない光学モ−ドを制御する。
VCSEL25の反射率を制御することによって、レ−
ザの動作容積は、最低次数の動作モ−ドのモ−ドサイズ
に等しくなり、VCSEL25の出力または放出領域は
最大になる。VCSEL25の放出領域を最大にするこ
とは、その出力パワ−を最大にする。この配置を用いる
ことによって、ゲインの横型オ−バ−ラップ(楕円4
8)および光学モ−ドは最も効率のよい動作で最大にな
り、それは小さな直径のデバイスのしきい値および外部
効率を決定する因子を制御することである。これは、デ
バイス直径dが電流の分離よりも大きく、高次の光学モ
−ドが光学ゲインについてあまりオ−バ−ラップしない
場合に特に正しい。
【0026】図5は、VCSEL25に類似する他のV
CSELに対するミラ−損失または反射率の概略70の
図形表示である。反射率のグラフ70はトレンチ39に
対応する最も外側の線72,73を含み、ミラ−損失は
最大となる。各々の線72,73の内側の端部におい
て、ミラ−損失は急激に降下し、これはメサ型領域40
の始まりを示す。線76,77は、そのミラ−損失の鋭
いたち下がりから、すぐに内部に戻り、これはメサ型領
域40の外側の端部から電気的コンタクト・ウィンドウ
42の外部境界までのミラ−損失を示す。本実施例で
は、誘電体層44と最終的なITO層46との結合され
た光学的厚さは、1半波長の整数倍に等しく、線76,
77で示されるミラ−損失は最少となる。本実施例では
また、金属コンタクト46は、1半波長の整数倍と4分
の1波長の奇数倍との間の変量に等しい厚さtを有する
ように構成される。したがって、ミラ−損失は電気的コ
ンタクト・ウィンドウ42において、最小値より大きい
電気的コンタクト・ウィンドウ42におけるミラ−損失
を示す線79まで急瞬に増加する。
【0027】図3および図5を比較することによって、
図5の実施例におけるメサ型領域の直径dは、図3の実
施例における直径よりも大きいことが理解される。図5
における配置は、安定でない共振器に非常に類似するも
のであり、より高い反射率(低いミラ−損失)のものを
電気的コンタクトウィンドウ42を中心に外側すること
によって、その光学モ−ド(楕円48)はより大きい大
きさまで押し上げられている。層の厚さおよび電流の広
がりを選択することに依存して、高い次数のモ−ドを抑
制しつつハイ・パワ−の動作を行う、大きな基本的光学
モ−ドを有するデバイスを形成することが可能になる。
しかし、この利点はより高いしきい値電流の見返りとし
て得られるものである。
【0028】本発明が教示する様々な方法および装置を
以下にを示す。
【0029】1. 光学モ−ドが制御可能な縦型空洞表
面放出レ−ザを形成する方法であって、基板を提供する
段階と、その基板上にミラ−の第1パラレル・スタック
を形成する段階と、その第1パラレル・ミラ−・スタッ
ク上にアクティブおよびスペ−サ層を形成する段階と、
そのアクティブおよびスペ−サ層上に第2パラレル・ミ
ラ−・スタックを形成する段階と、前記レ−ザの光学モ
−ドを制御するため所定の反射率特性を与える光学的厚
さを有する材料を第2パラレル・ミラ−・スタック(3
8)上に堆積する段階とから構成される方法。
【0030】2. 1.において述べた光学モ−ドが制
御可能な縦型空洞表面放出レ−ザを形成する方法であっ
て、第2ミラ−・スタック上に材料を堆積する段階を含
む電流分布を別々に制御する段階に加えて、電流分布を
制御するために第2ミラ−・スタック上に電気的コンタ
クト・ウィンドウを堆積する段階を含む縦型空洞表面放
出レ−ザを形成する方法。
【0031】3. 電流分布および光学モ−ドを別々に
制御可能な縦型空洞表面放出レ−ザを形成する方法であ
って、基板を提供する段階と、基板上にミラ−の第1パ
ラレル・スタックを形成する段階と、第1パラレル・ミ
ラ−・スタック上にアクティブおよびスペ−サ層を形成
する段階と、アクティブおよびスペ−サ層上に第2パラ
レル・ミラ−・スタックを形成する段階と、メサ型領域
を限定するために第2パラレル・ミラ−・スタックをエ
ッチングする段階と、レ−ザの光学モ−ドを制御するた
め所定の反射率特性をメサ型領域に与える光学的厚さを
有するメサ型領域上に材料を堆積する段階であって、そ
の材料はメサ型領域上に堆積されてそのレ−ザ内で電流
分布を制御するため電気的コンタクト・ウィンドウを限
定する光学的に透明な電導性材料を含む材料を堆積する
段階とから構成される縦型空洞表面放出レ−ザを形成す
る方法。
【0032】4. 上記3.に記載された電流分布およ
び光学モ−ドを別々に制御可能な縦型空洞表面放出レ−
ザを形成する方法であって、材料を堆積する段階は、エ
ッチングする段階の後にメサ型アクティブ領域上に誘電
体材料の層を形成する段階を含む縦型空洞表面放出レ−
ザを形成する方法。
【0033】5. 上記4.に記載された電流分布およ
び光学モ−ドを別々に制御可能な縦型空洞表面放出レ−
ザを形成する方法であって、誘電体材料の層を形成する
段階は窒化シリコンの層を形成する段階を含む縦型空洞
表面放出レ−ザを形成する方法。
【0034】6. 上記3.に記載された電流分布およ
び光学モ−ドを別々に制御可能な縦型空洞表面放出レ−
ザを形成する方法であって、メサ型領域上に光学的に透
明な電導性材料を含む材料を堆積する段階は、光学的に
透明な電導性材料としてカドミウム錫酸化物およびイン
ジウム錫酸化物の1つを堆積する段階を含む縦型空洞表
面放出レ−ザを形成する方法。
【0035】7. 上記3.に記載された電流分布およ
び光学モ−ドを別々に制御可能な縦型空洞放出レ−ザを
形成する方法であって、メサ型領域上に材料を堆積する
段階は電気的コンタクト・ウィンドウ上に堆積する段階
を含み、その材料はレ−ザ放出の1半波長のほぼ整数倍
の光学的厚さを有する縦型空洞表面放出レ−ザを形成す
る方法。
【0036】8. 上記7.に記載された電流分布およ
び光学モ−ドを別々に制御可能な縦型空洞放出レ−ザを
形成する方法であって、メサ型領域上に材料を堆積する
段階は電気的コンタクト・ウィンドウ以外のメサ型領域
の部分上に堆積する段階を更に含み、その材料はレ−ザ
放出の1半波長の整数倍とは異なる光学的厚さを有する
縦型空洞表面放出レ−ザを形成する方法。
【0037】9. 上記4.に記載された電流分布およ
び光学モ−ドを別々に制御可能な縦型空洞放出レ−ザを
形成する方法であって、メサ型領域上に材料を堆積する
段階は電気的コンタクト・ウィンドウ以外のメサ型領域
の部分上に堆積する段階を更に含み、その材料はレ−ザ
放出の1半波長のほぼ整数倍である光学的厚さを有する
縦型空洞表面放出レ−ザを形成する方法。
【0038】10. 上記9.に記載された電流分布お
よび光学モ−ドを別々に制御可能な縦型空洞放出レ−ザ
を形成する方法であって、メサ型領域上に材料を堆積す
る段階は電気的コンタクト・ウィンドウ上に堆積する段
階を含み、その材料はレ−ザ放出の1半波長の整数倍と
は異なる光学的厚さを有する縦型空洞表面放出レ−ザを
形成する方法。
【0039】11. 電流分布および光学モ−ドを別々
に制御可能な縦型空洞放出レ−ザを形成する方法であっ
て、基板を提供する段階と、その基板上にミラ−の第1
パラレル・スタックを形成する段階と、その第1パラレ
ル・ミラ−・スタック上にアクティブおよびスペ−サ層
を形成する段階と、そのアクティブおよびスペ−サ層上
に第2パラレル・ミラ−・スタックを形成する段階と、
レ−ザの光学モ−ドを制御するため縦型空洞表面放出レ
−ザに対して所望の反射率特性を決定して所望の電流分
布を決定する段階と、メサ型領域を限定するため第2パ
ラレル・ミラ−・スタックをエッチングする段階と、そ
のメサ型領域内で流れる電流を閉じ込めるためそのメサ
型領域上に誘電体材料層を堆積する段階と、メサ型領域
において誘電体層を介する開口をエッチングする段階
と、レ−ザにおいて電流分布を所望の電流分布に制御す
るため電気的コンタクト・ウィンドウを限定する光学的
に透明な電導性材料を含む材料をメサ型領域上に堆積す
る段階であって、その誘電体材料および光学的に透明な
電導性材料はそのメサ型領域に対して所望の反射率特性
を与える光学的厚さに堆積される材料を堆積する段階と
から構成される縦型空洞表面放出レ−ザを形成する方
法。
【0040】12. 電流分布および光学モ−ドを別々
に制御可能である縦型空洞表面放出レ−ザであって、基
板と、その基板上に配置されるミラ−の第1パラレル・
スタックと、その第1パラレル・ミラ−・スタック上に
配置されるアクティブおよびスペ−サ層と、そのアクテ
ィブおよびスペ−サ層上に配置される第2パラレル・ミ
ラ−・スタックであって、その第2パラレル・ミラ−・
スタックはメサ型領域を限定するためにエッチングされ
る第2パラレル・ミラ−・スタックと、メサ型領域が所
定の反射率特性であるような光学的厚さを有するメサ型
領域上に配置される材料であって、その材料はメサ型領
域上に配置され、レ−ザ内における電流分布を制御する
ため電気的コンタクト・ウィンドウを限定する光学的に
透明な電導性材料を含むメサ型領域上に配置される材料
とから構成される縦型空洞表面放出レ−ザ。
【0041】13. 上記12.に記載された電流分布
と光学モ−ドとを別々に制御可能な縦型空洞表面放出レ
−ザであって、メサ型領域上に配置される材料はそのメ
サ型アクティブ領域上に配置される誘電体材料層を含む
縦型空洞表面放出レ−ザ。
【0042】14. 上記13.に記載された電流分布
と光学モ−ドとを別々に制御可能な縦型空洞表面放出レ
−ザであって、メサ型領域上に配置される材料はレ−ザ
放出の1半波長の約整数倍の光学的厚さを有する電気的
コンタクト・ウィンドウ上に配置される材料を更に含む
縦型空洞表面放出レ−ザ。
【0043】15. 上記14.に記載された電流分布
と光学モ−ドとを別々に制御可能な縦型空洞表面放出レ
−ザであって、メサ型領域上に配置される材料は電気的
コンタクト・ウィンドウ以外のメサ型領域の部分上に配
置される材料を含み、その材料はレ−ザ放出の1半波長
の整数倍とは異なる光学的厚さを有する縦型空想表面放
出レ−ザ。
【0044】16. 上記13.に記載された電流分布
と光学モ−ドとを別々に制御可能な縦型空洞表面放出レ
−ザであって、メサ型領域上に配置される材料は電気的
コンタクト・ウィンドウ以外のメサ型領域上に配置され
る材料を含み、その材料はレ−ザ放出の1半波長の約整
数倍の光学的厚さを有する縦型空洞表面放出レ−ザ。
【0045】17. 上記16.に記載された電流分布
と光学モ−ドとを別々に制御可能な縦型空洞表面放出レ
−ザであって、メサ型領域上の材料はレ−ザ放出の1半
波長の整数倍とは異なる光学的厚さを有する電気的コン
タクト・ウィンドウ上に配置される材料を更に含む縦型
空洞表面放出レ−ザ。
【0046】18. 上記13.に記載された電流分布
と光学モ−ドとを別々に制御可能な縦型空洞表面放出レ
−ザであって、誘電体材料層は窒化シリコンを含む縦型
空想表面放出レ−ザ。
【0047】19. 上記13.に記載された電流分布
と光学モ−ドとを別々に制御可能な縦型空洞表面放出レ
−ザであって、メサ型領域上の材料は電気的コンタクト
に対して光学的に透明な材料を含む縦型空洞表面放出レ
−ザ。
【0048】20. 上記19.に記載された電流分布
と光学モ−ドとを別々に制御可能な縦型空洞表面放出レ
−ザであって、光学的に透明な材料はインジウム錫酸化
物およびカドミウム錫酸化物の1つを含む縦型空洞表面
放出レ−ザ。
【0049】21. 別々に制御される光学モ−ドを有
する縦型空洞表面放出レ−ザであって、基板と、その基
板上に配置されるミラ−の第1パラレル・スタックと、
その第1パラレル・ミラ−・スタック上に配置されるア
クティブおよびスペ−サ層と、そのアクティブおよびス
ペ−サ層上に配置される第2パラレル・ミラ−・スタッ
クと、その第2パラレル・ミラ−・スタックが所定の反
射率特性であるような光学的厚さを有する第2パラレル
・ミラ−・スタック上に配置される材料とから構成され
る縦型空洞表面放出レ−ザ。
【0050】22. 上記21.に記載された電流分布
と光学モ−ドとを別々に制御可能な縦型空洞表面放出レ
−ザであって、第2パラレル・ミラ−・スタック上に配
置される材料はレ−ザにおいて電流分布を制御するため
に電気的コンタクト・ウィンドウを限定する光学的に透
明な電導性材料を含む縦型空洞表面放出レ−ザ。
【0051】
【発明の効果】以上本発明によれば、電流分布および光
学モ−ドを個々に制御することが可能なVCSELを形
成する方法は開示され、所要の光学モ−ドが決定され、
そのための材料層は所定の光学モ−ドを与える所定の反
射率を与える厚さと共にメサ型領域の表面上に配置され
る。所望の電流配置が決定され、電気的コンタクト・ウ
ィンドウは透明な金属コンタクト層によって決定され、
その層はメサ型領域上に堆積される。電気的コンタクト
・ウィンドウは主にレ−ザ内の電流分布を制御する。メ
サ型領域は絶縁層と共に被覆され、その光学モ−ドと共
に改良されたオ−バ−ラップを与えるため、デバイスの
中心に電流を閉じ込めることに寄与する。
【0052】電流分布および光学モ−ドは別々に制御さ
れ、このことは最終的な所望の製品が比較的簡潔な動作
を行うことを可能にする。さらに、電流分布と光学モ−
ドとを別々に制御しているので、従来は為し得なかった
様々なレ−ザ製品を構成することが可能になる。たとえ
ば、電流および光学モ−ドの良好なオ−バ−ラップによ
る高い効率、あるいは、光学モ−ドおよび電流分布の出
力の可能性によるより大きく高い出力を与えるVCSE
L等である。さらに、光学モ−ドおよび電流分布は、メ
サ型のエッジに依存することなく制御されるので、その
メサをマスクする工程および形成する工程における調整
は非常に簡潔になる。特定の製品では、メサ型領域を形
成するため上部ミラ−・スタックをエッチングすること
なく、光学モ−ドおよび電流分布を前述したように別々
に制御することによって、レ−ザまたはレ−ザ・アレイ
を形成することが実用的になる。
【図面の簡単な説明】
【図1】VCSELを形成する際の中間段階における断
面図である。
【図2】本発明により形成されたVCSELの断面図で
ある。
【図3】図2に類似するVCSELにおけるミラ−損失
または反射率を図形表示した概略図である。
【図4】図3のVCSELの電流分布の概略である。
【図5】図2に類似する他のVCSELにおけるミラ−
損失または反射率を図形表示した概略図である。
【符号の説明】
10 基板 12,18 ミラ−・スタック 15 アクティブ層 20 フォトレジスト層 25 VCSEL 30 基板 32,38 パラレル・ミラ−・スタック 35 スペ−サ層 39 トレンチ 40 メサ型領域 42 コンタクト・ウィンドウ 44 誘電体層 46 コンタクト層 50,70 反射率の概略

Claims (3)

    【特許請求の範囲】
  1. 【請求項1】 光学モ−ドを制御する縦型空洞表面放出
    レ−ザを形成する方法であって、 基板(30)を提供する段階;前記基板(30)上にミ
    ラ−の第1パラレル・スタック(32)を形成する段
    階;前記第1パラレル・ミラ−・スタック(32)上に
    アクティブおよびスペ−サ層(35)を形成する段階;
    前記アクティブおよびスペ−サ層(35)上に第2パラ
    レル・ミラ−・スタック(38)を形成する段階;およ
    び前記レ−ザの光学モ−ドを制御するため所定の反射率
    特性を与える光学的厚さを有する材料(44,46)を
    前記第2パラレル・ミラ−・スタック(38)上に堆積
    する段階;から構成されることを特徴とする縦型空洞表
    面放出レ−ザを形成する方法。
  2. 【請求項2】 別々に制御される電流分布および光学モ
    −ドを有する縦型空洞表面放出レ−ザであって、 基板(30);前記基板(30)上に配置されるミラ−
    の第1パラレル・スタック(32);前記第1パラレル
    ・ミラ−・スタック(32)上に配置されるアクティブ
    およびスペ−サ層(35);前記アクティブおよびスペ
    −サ層上に配置される第2パラレル・ミラ−・スタック
    (38)であって、前記第2パラレル・ミラ−・スタッ
    ク(38)はメサ型領域(40)を限定するためにエッ
    チングされる第2パラレル・ミラ−・スタック(3
    8);および前記メサ型領域(40)が所定の反射率特
    性を有するような光学的厚さを有する前記メサ型領域
    (40)上に配置される材料(44,46)であって、
    前記材料(44,46)は前記レ−ザ内における電流分
    布を制御するため電気的コンタクト・ウィンドウ(4
    2)を限定する光学的に透明な電導性材料(46)を含
    む前記メサ型領域(40)上に配置される材料(44,
    46);から構成されることを特徴とする縦型空洞表面
    放出レ−ザ。
  3. 【請求項3】 別々に制御される光学モ−ドを有する縦
    型空洞表面放出レ−ザであって、 基板(30);前記基板上に配置されるミラ−の第1パ
    ラレル・スタック(32);前記第1パラレル・ミラ−
    ・スタック(32)上に配置されるアクティブおよびス
    ペ−サ層(35);前記アクティブおよびスペ−サ層
    (35)上に配置される第2パラレル・ミラ−・スタッ
    ク(38);および前記第2パラレル・ミラ−・スタッ
    ク(38)が所定の反射率特性を有するような光学的厚
    さを有する前記第2パラレル・ミラ−・スタック(3
    8)上に配置される材料(44,46);から構成され
    ることを特徴とする縦型空洞表面放出レ−ザ。
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