JPH06284716A - 電源制御回路 - Google Patents
電源制御回路Info
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- JPH06284716A JPH06284716A JP9730293A JP9730293A JPH06284716A JP H06284716 A JPH06284716 A JP H06284716A JP 9730293 A JP9730293 A JP 9730293A JP 9730293 A JP9730293 A JP 9730293A JP H06284716 A JPH06284716 A JP H06284716A
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Abstract
(57)【要約】
【目的】二次側電源で動作しているＣＰＵや負荷回路が
誤動作を起こした場合、または、破壊が起った場合に、
回路の発煙・発火等の二次災害を起こす前に電源回路を
確実に停止させ、災害を防ぐこと。 【構成】一次側ＤＣ電源を二次側ＤＣ電源に変換するた
めの電源回路をスイッチング回路とし、このスイッチン
グ回路の制御を、二次側ＤＣ電源で動作し負荷回路を統
括管理及び制御しているＣＰＵ１０に兼任させ、各回路
の制御系を一系統にまとめる方式とした。
誤動作を起こした場合、または、破壊が起った場合に、
回路の発煙・発火等の二次災害を起こす前に電源回路を
確実に停止させ、災害を防ぐこと。 【構成】一次側ＤＣ電源を二次側ＤＣ電源に変換するた
めの電源回路をスイッチング回路とし、このスイッチン
グ回路の制御を、二次側ＤＣ電源で動作し負荷回路を統
括管理及び制御しているＣＰＵ１０に兼任させ、各回路
の制御系を一系統にまとめる方式とした。
Description
【０００１】
【産業上の利用分野】本発明は、一次側ＤＣ電源を制御
し、二次側ＤＣ電源を作る電源制御回路に関する。
し、二次側ＤＣ電源を作る電源制御回路に関する。
【０００２】
【従来の技術】従来、二次側ＤＣ電源で動作し、ＣＰＵ
で制御されている負荷回路と、一次側ＤＣ電源を二次側
ＤＣ電源に変換する電源回路の制御回路とでは全く別の
制御系であり、それぞれ独立して制御されている。従来
では、負荷回路の制御はＣＰＵが行い、電源回路の制御
は電源回路に内蔵されている制御回路が行っている。し
たがって、電源回路に内蔵された制御回路は二次側ＤＣ
電源で動作するＣＰＵや負荷回路の状態がわからず、Ｃ
ＰＵや負荷回路に異常が発生した場合でも電源を供給し
続けてしまい、ＣＰＵや負荷回路及び電源回路の発煙・
発火などの二次災害を招く危険を持っていた。図２はこ
の様な問題に対する従来の対策例であり、図に示すよう
に二次側ＤＣ電源側の回路に安全装置１２を設ける方法
が一般的である。安全装置１２のうち、１２−ａは二次
側ＤＣ電源の電流を監視する電流検出回路を示してい
る。ＣＰＵ１０または負荷回路１４に誤動作が生じ、二
次側ＤＣ電源に異常電流が流れた場合、電流検出回路１
２−ａは、その異常電流を検出し、リセット回路１１が
ＣＰＵ１０に対してハードリセットをかけるようにリセ
ット要求信号を発生する。リセット回路１１は、このリ
セット要求信号を受けるとＣＰＵ１０に対しリセット信
号を送り、ＣＰＵ１０にハードリセットをかける。１２
−ｂはＣＰＵ１０自体の異常を検出するためのウォッチ
ドッグタイマを示しており、通常、ウォッチドッグタイ
マ１２−ｂは、ある決められたサイクル毎にＣＰＵ１０
によってタイマ値をクリアされている。しかし、ＣＰＵ
１０が異常状態となり一定時間ウォッチドッグタイマ１
２−ｂのタイマ値をクリア出来なかった場合、ウォッチ
ドッグタイマ１２−ｂは、リセット回路１１がＣＰＵ１
０に対してハードリセットをかけるようにリセット要求
信号を発生する。この場合もリセット回路１１は、この
リセット要求信号を受けるとＣＰＵ１０に対しリセット
信号を送り、ＣＰＵ１０にハードリセットをかける。つ
まり、ＣＰＵ１０や負荷回路１４が正常動作を行わなく
なったのを安全装置１２が検出した場合に、ＣＰＵ１０
にハードリセットをかけることにより、ＣＰＵ１０及び
負荷回路１４を再起動し異常状態を取り除く方法で対処
している。
で制御されている負荷回路と、一次側ＤＣ電源を二次側
ＤＣ電源に変換する電源回路の制御回路とでは全く別の
制御系であり、それぞれ独立して制御されている。従来
では、負荷回路の制御はＣＰＵが行い、電源回路の制御
は電源回路に内蔵されている制御回路が行っている。し
たがって、電源回路に内蔵された制御回路は二次側ＤＣ
電源で動作するＣＰＵや負荷回路の状態がわからず、Ｃ
ＰＵや負荷回路に異常が発生した場合でも電源を供給し
続けてしまい、ＣＰＵや負荷回路及び電源回路の発煙・
発火などの二次災害を招く危険を持っていた。図２はこ
の様な問題に対する従来の対策例であり、図に示すよう
に二次側ＤＣ電源側の回路に安全装置１２を設ける方法
が一般的である。安全装置１２のうち、１２−ａは二次
側ＤＣ電源の電流を監視する電流検出回路を示してい
る。ＣＰＵ１０または負荷回路１４に誤動作が生じ、二
次側ＤＣ電源に異常電流が流れた場合、電流検出回路１
２−ａは、その異常電流を検出し、リセット回路１１が
ＣＰＵ１０に対してハードリセットをかけるようにリセ
ット要求信号を発生する。リセット回路１１は、このリ
セット要求信号を受けるとＣＰＵ１０に対しリセット信
号を送り、ＣＰＵ１０にハードリセットをかける。１２
−ｂはＣＰＵ１０自体の異常を検出するためのウォッチ
ドッグタイマを示しており、通常、ウォッチドッグタイ
マ１２−ｂは、ある決められたサイクル毎にＣＰＵ１０
によってタイマ値をクリアされている。しかし、ＣＰＵ
１０が異常状態となり一定時間ウォッチドッグタイマ１
２−ｂのタイマ値をクリア出来なかった場合、ウォッチ
ドッグタイマ１２−ｂは、リセット回路１１がＣＰＵ１
０に対してハードリセットをかけるようにリセット要求
信号を発生する。この場合もリセット回路１１は、この
リセット要求信号を受けるとＣＰＵ１０に対しリセット
信号を送り、ＣＰＵ１０にハードリセットをかける。つ
まり、ＣＰＵ１０や負荷回路１４が正常動作を行わなく
なったのを安全装置１２が検出した場合に、ＣＰＵ１０
にハードリセットをかけることにより、ＣＰＵ１０及び
負荷回路１４を再起動し異常状態を取り除く方法で対処
している。
【０００３】
【発明が解決しようとする課題】しかしながら、この様
な従来の方式は、ＣＰＵや負荷回路がともにハード的に
正常であり、またプログラムを記憶しているメモリも正
常である事を前提にしているものである。つまり、ＣＰ
Ｕや負荷回路が正常動作を行わなくなったことを安全装
置が検出した場合、ＣＰＵにハードリセットをかけ、Ｃ
ＰＵのプログラムカウンタを初期値に戻し、プログラム
を再起動し、ＣＰＵ及び負荷回路をイニシャライズさせ
正常状態に戻すという方式をとっている。
な従来の方式は、ＣＰＵや負荷回路がともにハード的に
正常であり、またプログラムを記憶しているメモリも正
常である事を前提にしているものである。つまり、ＣＰ
Ｕや負荷回路が正常動作を行わなくなったことを安全装
置が検出した場合、ＣＰＵにハードリセットをかけ、Ｃ
ＰＵのプログラムカウンタを初期値に戻し、プログラム
を再起動し、ＣＰＵ及び負荷回路をイニシャライズさせ
正常状態に戻すという方式をとっている。
【０００４】ところが、実際にはＣＰＵや負荷回路の異
常動作の原因には回路や素子の破損等のハード的要因が
多く含まれている。例えば、ＣＰＵやプログラムが記憶
されているメモリの強い外来ノイズによるラッチアップ
または破損、及びクロック回路停止によるＣＰＵの動作
停止等がある。この様な場合、安全装置がいくらＣＰＵ
にリセット信号を与えてもＣＰＵや負荷回路はハード的
に動作しないので当然イニシャライズされず、最悪の場
合にはやはり回路の発煙・発火という事態となってしま
う。また、プログラムを記憶してあるメモリの内容が壊
れてしまう場合もある。この場合、ＣＰＵが暴走してし
まうので、安全装置が異常を検出し、ＣＰＵにリセット
信号を与えてイニシャライズを行う。しかし、いくらイ
ニシャライズしても、プログラムに異常があるため、す
ぐにまたＣＰＵが暴走してしまい、この状態を繰り返す
内に、やはり最悪の場合では回路の発煙・発火という事
態となってしまう。
常動作の原因には回路や素子の破損等のハード的要因が
多く含まれている。例えば、ＣＰＵやプログラムが記憶
されているメモリの強い外来ノイズによるラッチアップ
または破損、及びクロック回路停止によるＣＰＵの動作
停止等がある。この様な場合、安全装置がいくらＣＰＵ
にリセット信号を与えてもＣＰＵや負荷回路はハード的
に動作しないので当然イニシャライズされず、最悪の場
合にはやはり回路の発煙・発火という事態となってしま
う。また、プログラムを記憶してあるメモリの内容が壊
れてしまう場合もある。この場合、ＣＰＵが暴走してし
まうので、安全装置が異常を検出し、ＣＰＵにリセット
信号を与えてイニシャライズを行う。しかし、いくらイ
ニシャライズしても、プログラムに異常があるため、す
ぐにまたＣＰＵが暴走してしまい、この状態を繰り返す
内に、やはり最悪の場合では回路の発煙・発火という事
態となってしまう。
【０００５】本発明はこの様な従来の問題点を鑑みてな
されたものであり、ＣＰＵあるいは負荷回路が正常動作
を行えなくなった場合でも安全でかつ確実に対処を行え
る電源制御回路を提供する事を目的とする。
されたものであり、ＣＰＵあるいは負荷回路が正常動作
を行えなくなった場合でも安全でかつ確実に対処を行え
る電源制御回路を提供する事を目的とする。
【０００６】
【課題を解決するための手段】上記目的を達成させるた
めに、本発明では、一次側ＤＣ電源を変換して二次側Ｄ
Ｃ電源を作るＤＣ−ＤＣコンバータと、ＤＣ−ＤＣコン
バータにより作られた二次側ＤＣ電源により動作する負
荷回路と、ＤＣ−ＤＣコンバータにより作られた二次側
ＤＣ電源により動作し、負荷回路を統括管理及び制御す
るＣＰＵと、ＣＰＵや負荷回路の異常動作を検出してＣ
ＰＵにリセットをかける安全装置とにより構成される電
源制御回路において、ＤＣ−ＤＣコンバ−タの制御も前
記ＣＰＵで行い、各回路の制御系を一系統にまとめる方
式とした。またＤＣ−ＤＣコンバータとＣＰＵとの間に
スイッチング回路を接続し、ＣＰＵによるＤＣ−ＤＣコ
ンバータの制御をスイッチング回路を介して行う方式と
した。
めに、本発明では、一次側ＤＣ電源を変換して二次側Ｄ
Ｃ電源を作るＤＣ−ＤＣコンバータと、ＤＣ−ＤＣコン
バータにより作られた二次側ＤＣ電源により動作する負
荷回路と、ＤＣ−ＤＣコンバータにより作られた二次側
ＤＣ電源により動作し、負荷回路を統括管理及び制御す
るＣＰＵと、ＣＰＵや負荷回路の異常動作を検出してＣ
ＰＵにリセットをかける安全装置とにより構成される電
源制御回路において、ＤＣ−ＤＣコンバ−タの制御も前
記ＣＰＵで行い、各回路の制御系を一系統にまとめる方
式とした。またＤＣ−ＤＣコンバータとＣＰＵとの間に
スイッチング回路を接続し、ＣＰＵによるＤＣ−ＤＣコ
ンバータの制御をスイッチング回路を介して行う方式と
した。
【０００７】
【作用】電源回路を上記の本発明の構成とすることによ
り、ＣＰＵ及び負荷回路に万一異常が発生した場合で
も、確実に二次側ＤＣ電源が遮断され回路を停止するこ
とが出来る。なぜなら、例えば、ＣＰＵが暴走したとき
には、安全装置がＣＰＵにハードリセットをかけること
により、ＤＣ−ＤＣコンバータのスイッチング回路に対
するＣＰＵによる制御が停止し、二次側ＤＣ電源を停止
させることが可能となる。また、ＣＰＵやプログラムが
記憶されているメモリが強い外来ノイズによるラッチア
ップまたは破損した場合、及びクロック回路停止等によ
ってＣＰＵの動作が停止した場合であっても、ＤＣ−Ｄ
Ｃコンバータのスイッチング回路に対するＣＰＵによる
制御が停止するため、二次側ＤＣ電源が停止して回路の
発煙・発火という事態を未然に防ぐことが出来る。
り、ＣＰＵ及び負荷回路に万一異常が発生した場合で
も、確実に二次側ＤＣ電源が遮断され回路を停止するこ
とが出来る。なぜなら、例えば、ＣＰＵが暴走したとき
には、安全装置がＣＰＵにハードリセットをかけること
により、ＤＣ−ＤＣコンバータのスイッチング回路に対
するＣＰＵによる制御が停止し、二次側ＤＣ電源を停止
させることが可能となる。また、ＣＰＵやプログラムが
記憶されているメモリが強い外来ノイズによるラッチア
ップまたは破損した場合、及びクロック回路停止等によ
ってＣＰＵの動作が停止した場合であっても、ＤＣ−Ｄ
Ｃコンバータのスイッチング回路に対するＣＰＵによる
制御が停止するため、二次側ＤＣ電源が停止して回路の
発煙・発火という事態を未然に防ぐことが出来る。
【０００８】
【実施例】以下、本発明による実施例を図面を基に説明
する。図１は本発明の一実施例である。１は外部より供
給された一次側ＤＣ電源を、ＣＰＵ１０が動作するに必
要な二次側ＤＣ電源に変換するためのＤＣ−ＤＣコンバ
ータを示している。一次側ＤＣ電源と二次側ＤＣ電源
は、ＤＣ−ＤＣコンバータ１内部の高周波トランス１−
ａの一次側巻線と二次側巻線で絶縁されており、高周波
トランス１−ａの一次側巻線をスイッチングすることに
より、二次側巻線に電力を発生させる仕組みとなってい
る。高周波トランス１−ａの一次側巻線のスイッチング
動作は、二次側ＤＣ電源で動作しているＣＰＵ１０のＰ
ＷＭ出力端子より送られて来るＰＷＭ出力信号によって
制御される。このＰＷＭ出力端子は、高周波トランス１
−ａの一次側巻線（つまり一次側ＤＣ電源）とＣＰＵ１
０（つまり二次側ＤＣ電源）とを絶縁するために、フォ
トカプラ２を介して接続される。これにより一次側ＤＣ
電源と二次側ＤＣ電源とが完全に絶縁されることにな
り、二次側ＤＣ電源側の回路で発生した異常状態が一次
側ＤＣ電源側に対して影響を及ぼすのを防いでいる。こ
のように、高周波トランス１−ａの一次側巻線のスイッ
チング動作を制御するためのスイッチング回路は、ＣＰ
Ｕ１０のＰＷＭ出力端子とフォトカプラ２により成り、
一次側ＤＣ電源側とはフォトカプラ２で絶縁して接続さ
れる。５はスタートアップ用ＤＣ−ＤＣコンバータを示
しており、スタートアップ用ＤＣ−ＤＣコンバータ５
は、ＤＣ−ＤＣコンバータ１作動開始前、つまり二次側
ＤＣ電源が供給される前に一時的に二次側にＤＣ電源を
供給するためのものである。４はスタートアップ時に一
時的にスタートアップ用ＤＣ−ＤＣコンバータ５に一次
側ＤＣ電源を供給するためのスイッチを示している。１
２は安全装置を示しており、安全装置１２は電流検出回
路１２−ａとウォッチドッグタイマ１２−ｂで構成され
る。１１はリセット回路を示しており、リセット回路１
１は、二次側ＤＣ電源を監視し、二次側ＤＣ電源側の回
路が動作可能な電圧になければＣＰＵ１０に対してリセ
ット信号を発生するものである。さらに、リセット回路
１１は、安全装置１２の電流検出回路１２−ａ及び、ウ
ォッチドッグタイマ１２−ｂからリセット要求信号が送
られた場合にもＣＰＵ１０に対してリセット信号を発生
する。１３はＡ／Ｄ変換回路を示しており、Ａ／Ｄ変換
回路１３は、二次側ＤＣ電源の電圧値をデジタル値に変
換するものである。１４はＣＰＵ１０によって制御され
る負荷回路を示している。
する。図１は本発明の一実施例である。１は外部より供
給された一次側ＤＣ電源を、ＣＰＵ１０が動作するに必
要な二次側ＤＣ電源に変換するためのＤＣ−ＤＣコンバ
ータを示している。一次側ＤＣ電源と二次側ＤＣ電源
は、ＤＣ−ＤＣコンバータ１内部の高周波トランス１−
ａの一次側巻線と二次側巻線で絶縁されており、高周波
トランス１−ａの一次側巻線をスイッチングすることに
より、二次側巻線に電力を発生させる仕組みとなってい
る。高周波トランス１−ａの一次側巻線のスイッチング
動作は、二次側ＤＣ電源で動作しているＣＰＵ１０のＰ
ＷＭ出力端子より送られて来るＰＷＭ出力信号によって
制御される。このＰＷＭ出力端子は、高周波トランス１
−ａの一次側巻線（つまり一次側ＤＣ電源）とＣＰＵ１
０（つまり二次側ＤＣ電源）とを絶縁するために、フォ
トカプラ２を介して接続される。これにより一次側ＤＣ
電源と二次側ＤＣ電源とが完全に絶縁されることにな
り、二次側ＤＣ電源側の回路で発生した異常状態が一次
側ＤＣ電源側に対して影響を及ぼすのを防いでいる。こ
のように、高周波トランス１−ａの一次側巻線のスイッ
チング動作を制御するためのスイッチング回路は、ＣＰ
Ｕ１０のＰＷＭ出力端子とフォトカプラ２により成り、
一次側ＤＣ電源側とはフォトカプラ２で絶縁して接続さ
れる。５はスタートアップ用ＤＣ−ＤＣコンバータを示
しており、スタートアップ用ＤＣ−ＤＣコンバータ５
は、ＤＣ−ＤＣコンバータ１作動開始前、つまり二次側
ＤＣ電源が供給される前に一時的に二次側にＤＣ電源を
供給するためのものである。４はスタートアップ時に一
時的にスタートアップ用ＤＣ−ＤＣコンバータ５に一次
側ＤＣ電源を供給するためのスイッチを示している。１
２は安全装置を示しており、安全装置１２は電流検出回
路１２−ａとウォッチドッグタイマ１２−ｂで構成され
る。１１はリセット回路を示しており、リセット回路１
１は、二次側ＤＣ電源を監視し、二次側ＤＣ電源側の回
路が動作可能な電圧になければＣＰＵ１０に対してリセ
ット信号を発生するものである。さらに、リセット回路
１１は、安全装置１２の電流検出回路１２−ａ及び、ウ
ォッチドッグタイマ１２−ｂからリセット要求信号が送
られた場合にもＣＰＵ１０に対してリセット信号を発生
する。１３はＡ／Ｄ変換回路を示しており、Ａ／Ｄ変換
回路１３は、二次側ＤＣ電源の電圧値をデジタル値に変
換するものである。１４はＣＰＵ１０によって制御され
る負荷回路を示している。
【０００９】以上が本実施例の主な構成であり、これを
基に詳細な動作説明を行う。まず、スイッチ４を押すこ
とによりスタートアップ用ＤＣ−ＤＣコンバータ５の一
次側入力部にＤＣ電源が供給され、二次側ＤＣ電源側の
回路にＤＣ電源が供給される。この時リセット回路１１
は、ＣＰＵ１０に対してリセット信号を送り、二次側Ｄ
Ｃ電源が規定許容範囲の電圧まで上昇し、その後ＣＰＵ
１０がハード的イニシャライズを完了するのに必要な時
間を待った後にＣＰＵ１０に対するリセット信号を解除
する。これによりＣＰＵ１０は、動作を開始し、安全装
置１２及び負荷回路１４のイニシャライズを行い、ま
た、フォトカプラ２に対して規定のＰＷＭ信号を送信す
る。このＰＷＭ信号は、フォトカプラ２を通して接続さ
れているＤＣ−ＤＣコンバータ１の制御端子に送られ
る。ＰＷＭ信号がＤＣ−ＤＣコンバータ１の制御端子に
送られると、ＤＣ−ＤＣコンバータ１が可動を始める。
つまり、ＤＣ−ＤＣコンバータ１内の高周波トランス１
−ａの一次側がスイッチングされ二次側に電力が発生す
るわけである。
基に詳細な動作説明を行う。まず、スイッチ４を押すこ
とによりスタートアップ用ＤＣ−ＤＣコンバータ５の一
次側入力部にＤＣ電源が供給され、二次側ＤＣ電源側の
回路にＤＣ電源が供給される。この時リセット回路１１
は、ＣＰＵ１０に対してリセット信号を送り、二次側Ｄ
Ｃ電源が規定許容範囲の電圧まで上昇し、その後ＣＰＵ
１０がハード的イニシャライズを完了するのに必要な時
間を待った後にＣＰＵ１０に対するリセット信号を解除
する。これによりＣＰＵ１０は、動作を開始し、安全装
置１２及び負荷回路１４のイニシャライズを行い、ま
た、フォトカプラ２に対して規定のＰＷＭ信号を送信す
る。このＰＷＭ信号は、フォトカプラ２を通して接続さ
れているＤＣ−ＤＣコンバータ１の制御端子に送られ
る。ＰＷＭ信号がＤＣ−ＤＣコンバータ１の制御端子に
送られると、ＤＣ−ＤＣコンバータ１が可動を始める。
つまり、ＤＣ−ＤＣコンバータ１内の高周波トランス１
−ａの一次側がスイッチングされ二次側に電力が発生す
るわけである。
【００１０】次に、Ａ／Ｄ変換回路１３によりデジタル
値に変換されたＤＣ−ＤＣコンバータ１の出力電圧値、
つまり二次側ＤＣ電源の電圧値をＣＰＵ１０が読み取
り、二次側ＤＣ電源の電圧値が規定範囲内にない場合、
ＣＰＵ１０は、ＰＷＭ信号のデューティーを変化させて
電圧値を調節する。例えば、Ａ／Ｄ変換回路１３により
読み出された二次側ＤＣ電源の電圧値が規定範囲内の目
標値より低い場合、ＣＰＵ１０は、ＰＷＭ信号のデュー
ティーを大きくし、ＤＣ−ＤＣコンバータ１内の高周波
トランス１−ａのＯＮ時間を多くすることにより二次側
ＤＣ電源の電圧値を高める。一方、二次側ＤＣ電源の電
圧値が規定範囲内の目標値より大きい場合、ＣＰＵ１０
は、ＰＷＭ信号のデューティーを小さくし、ＤＣ−ＤＣ
コンバータ１内の高周波トランス１−ａのＯＮ時間を少
なくする事により二次側ＤＣ電源の電圧値を抑えるよう
調整することが出来る。また、ＤＣ−ＤＣコンバータ１
の出力電圧がスタートアップ用ＤＣ−ＤＣコンバータ５
の出力電圧より高くなり、電流が逆流して各コンバータ
内部の素子の破壊を防ぐ目的で、スタートアップ用ＤＣ
−ＤＣコンバータ５の出力側には逆流防止用ダイオード
８が設けられている。このため、スタートアップ用ＤＣ
−ＤＣコンバータ５からの出力電圧は目標値より僅かに
低くなっている。それ故、ＤＣ−ＤＣコンバータ１から
出力される二次側ＤＣ電源の電圧値が目標値まで上昇し
ているかどうか読み取れる訳である。ＣＰＵ１０が自分
自身で二次側ＤＣ電源を管理しているために、これ以後
スイッチ４を離しても二次側ＤＣ電源で動作する回路は
動作し続ける。
値に変換されたＤＣ−ＤＣコンバータ１の出力電圧値、
つまり二次側ＤＣ電源の電圧値をＣＰＵ１０が読み取
り、二次側ＤＣ電源の電圧値が規定範囲内にない場合、
ＣＰＵ１０は、ＰＷＭ信号のデューティーを変化させて
電圧値を調節する。例えば、Ａ／Ｄ変換回路１３により
読み出された二次側ＤＣ電源の電圧値が規定範囲内の目
標値より低い場合、ＣＰＵ１０は、ＰＷＭ信号のデュー
ティーを大きくし、ＤＣ−ＤＣコンバータ１内の高周波
トランス１−ａのＯＮ時間を多くすることにより二次側
ＤＣ電源の電圧値を高める。一方、二次側ＤＣ電源の電
圧値が規定範囲内の目標値より大きい場合、ＣＰＵ１０
は、ＰＷＭ信号のデューティーを小さくし、ＤＣ−ＤＣ
コンバータ１内の高周波トランス１−ａのＯＮ時間を少
なくする事により二次側ＤＣ電源の電圧値を抑えるよう
調整することが出来る。また、ＤＣ−ＤＣコンバータ１
の出力電圧がスタートアップ用ＤＣ−ＤＣコンバータ５
の出力電圧より高くなり、電流が逆流して各コンバータ
内部の素子の破壊を防ぐ目的で、スタートアップ用ＤＣ
−ＤＣコンバータ５の出力側には逆流防止用ダイオード
８が設けられている。このため、スタートアップ用ＤＣ
−ＤＣコンバータ５からの出力電圧は目標値より僅かに
低くなっている。それ故、ＤＣ−ＤＣコンバータ１から
出力される二次側ＤＣ電源の電圧値が目標値まで上昇し
ているかどうか読み取れる訳である。ＣＰＵ１０が自分
自身で二次側ＤＣ電源を管理しているために、これ以後
スイッチ４を離しても二次側ＤＣ電源で動作する回路は
動作し続ける。
【００１１】いま、この電源が安定した状態でＣＰＵ１
０または負荷回路１４に異常が発生し、二次側ＤＣ電源
に異常電流が流れると、安全装置１２内の電流検出回路
１２−ａがリセット回路１１にリセット要求信号を送
り、リセット回路１１はＣＰＵ１０にハードリセットを
かけ、ＣＰＵ１０はＰＷＭ信号を停止させる。結果とし
て、ＤＣ−ＤＣコンバータ１は停止し、確実に二次側Ｄ
Ｃ電源の供給を停止することが出来る。一方、ＣＰＵ１
０が暴走した場合には安全装置１２内のウォッチドッグ
タイマ１２−ｂがリセット回路１１にリセット要求信号
を送り、リセット回路１１はＣＰＵ１０にハードリセッ
トをかけ、ＣＰＵ１０はＰＷＭ信号を停止させる。結果
として、ＤＣ−ＤＣコンバータ１は停止し、確実に二次
側ＤＣ電源の供給を停止することが出来る。また、ＣＰ
Ｕ１０の暴走時に二次側ＤＣ電源の電圧値が一時的に二
次側ＤＣ電源の電圧の規定値から外れた場合にも、二次
側ＤＣ電源の電圧値を管理しているリセット回路１１が
ＣＰＵ１０にハードリセットをかけることにより、上記
と同様に、確実に二次側ＤＣ電源の供給を停止すること
が出来る。また、強い外来ノイズ等によるＣＰＵやプロ
グラムが記憶されているメモリのラッチアップまたは破
損、及びクロック回路停止等によってＣＰＵの動作が停
止した場合でもＰＷＭ信号が停止するため、電源回路の
スイッチング回路部への制御が停止し、二次側ＤＣ電源
の供給が停止する。電流ヒューズ３は、ＣＰＵ１０が暴
走または機能停止し、ＰＷＭ信号が停止してしまった場
合であってＤＣ−ＤＣコンバータ１内のトランジスタが
ＯＮとなったまま停止してしまった場合、またはＤＣ−
ＤＣコンバータ１内のトランジスタが破損し常にＯＮ状
態となってしまった場合の保護用としての役割をもつ。
０または負荷回路１４に異常が発生し、二次側ＤＣ電源
に異常電流が流れると、安全装置１２内の電流検出回路
１２−ａがリセット回路１１にリセット要求信号を送
り、リセット回路１１はＣＰＵ１０にハードリセットを
かけ、ＣＰＵ１０はＰＷＭ信号を停止させる。結果とし
て、ＤＣ−ＤＣコンバータ１は停止し、確実に二次側Ｄ
Ｃ電源の供給を停止することが出来る。一方、ＣＰＵ１
０が暴走した場合には安全装置１２内のウォッチドッグ
タイマ１２−ｂがリセット回路１１にリセット要求信号
を送り、リセット回路１１はＣＰＵ１０にハードリセッ
トをかけ、ＣＰＵ１０はＰＷＭ信号を停止させる。結果
として、ＤＣ−ＤＣコンバータ１は停止し、確実に二次
側ＤＣ電源の供給を停止することが出来る。また、ＣＰ
Ｕ１０の暴走時に二次側ＤＣ電源の電圧値が一時的に二
次側ＤＣ電源の電圧の規定値から外れた場合にも、二次
側ＤＣ電源の電圧値を管理しているリセット回路１１が
ＣＰＵ１０にハードリセットをかけることにより、上記
と同様に、確実に二次側ＤＣ電源の供給を停止すること
が出来る。また、強い外来ノイズ等によるＣＰＵやプロ
グラムが記憶されているメモリのラッチアップまたは破
損、及びクロック回路停止等によってＣＰＵの動作が停
止した場合でもＰＷＭ信号が停止するため、電源回路の
スイッチング回路部への制御が停止し、二次側ＤＣ電源
の供給が停止する。電流ヒューズ３は、ＣＰＵ１０が暴
走または機能停止し、ＰＷＭ信号が停止してしまった場
合であってＤＣ−ＤＣコンバータ１内のトランジスタが
ＯＮとなったまま停止してしまった場合、またはＤＣ−
ＤＣコンバータ１内のトランジスタが破損し常にＯＮ状
態となってしまった場合の保護用としての役割をもつ。
【００１２】
【発明の効果】以上説明してきたように、本発明による
電源制御回路は、ＣＰＵや負荷回路の誤動作あるいは破
壊が発生すると、ＣＰＵで制御されているフォトカプラ
やＤＣ−ＤＣコンバータの高周波トランス等で構成され
るスイッチング回路が瞬時に停止するため、二次側ＤＣ
電源の供給が停止し、結果として回路の発煙や発火とい
った最悪の惨事を防止することが出来る。したがって、
極めて安全性が高く、信頼性の高い電源制御回路を供給
することが可能となる。
電源制御回路は、ＣＰＵや負荷回路の誤動作あるいは破
壊が発生すると、ＣＰＵで制御されているフォトカプラ
やＤＣ−ＤＣコンバータの高周波トランス等で構成され
るスイッチング回路が瞬時に停止するため、二次側ＤＣ
電源の供給が停止し、結果として回路の発煙や発火とい
った最悪の惨事を防止することが出来る。したがって、
極めて安全性が高く、信頼性の高い電源制御回路を供給
することが可能となる。
【図１】本発明の一実施例を示すブロック図である。
【図２】従来技術を示すブロック図である。
１ ＤＣ−ＤＣコンバータ １−ａ 高周波トランス ２ フォトカプラ ３ 電流ヒューズ ４ スイッチ ５ スタートアップ用ＤＣ−ＤＣコンバータ ８ 逆流防止用ダイオード １０ ＣＰＵ １１ リセット回路 １２ 安全装置 １２−ａ 電流検出回路 １２−ｂ ウォッチドッグタイマ １３ Ａ／Ｄ変換回路 １４ 負荷回路
Claims (2)
- 【請求項１】 一次側ＤＣ電源を変換して二次側ＤＣ電
源を作るＤＣ−ＤＣコンバータと、ＤＣ−ＤＣコンバー
タにより作られた二次側ＤＣ電源により動作する負荷回
路と、ＤＣ−ＤＣコンバータにより作られた二次側ＤＣ
電源により動作し、負荷回路を統括管理及び制御するＣ
ＰＵと、ＣＰＵや負荷回路の異常動作を検出してＣＰＵ
にリセットをかける安全装置とにより構成される電源制
御回路において、ＤＣ−ＤＣコンバ−タの制御も前記Ｃ
ＰＵで行うことを特徴とする電源制御回路。 - 【請求項２】 ＤＣ−ＤＣコンバータとＣＰＵとの間に
スイッチング回路を接続し、ＣＰＵによるＤＣ−ＤＣコ
ンバータの制御をスイッチング回路を介して行うことを
特徴とする請求項１に記載の電源制御回路
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9730293A JPH06284716A (ja) | 1993-03-31 | 1993-03-31 | 電源制御回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9730293A JPH06284716A (ja) | 1993-03-31 | 1993-03-31 | 電源制御回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH06284716A true JPH06284716A (ja) | 1994-10-07 |
Family
ID=14188699
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP9730293A Pending JPH06284716A (ja) | 1993-03-31 | 1993-03-31 | 電源制御回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH06284716A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2008187772A (ja) * | 2007-01-26 | 2008-08-14 | Fujitsu Ltd | 電源装置および通信機器 |
| JP2010178620A (ja) * | 2002-11-14 | 2010-08-12 | Exar Corp | 監視タイマを有するスイッチングパワーコンバータコントローラ |
-
1993
- 1993-03-31 JP JP9730293A patent/JPH06284716A/ja active Pending
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2010178620A (ja) * | 2002-11-14 | 2010-08-12 | Exar Corp | 監視タイマを有するスイッチングパワーコンバータコントローラ |
| JP2010178621A (ja) * | 2002-11-14 | 2010-08-12 | Exar Corp | 監視タイマを有するスイッチングパワーコンバータコントローラ |
| JP2008187772A (ja) * | 2007-01-26 | 2008-08-14 | Fujitsu Ltd | 電源装置および通信機器 |
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