JPH0630000A - 通信ラインの２重化制御方式 - Google Patents
通信ラインの２重化制御方式Info
- Publication number
- JPH0630000A JPH0630000A JP4178682A JP17868292A JPH0630000A JP H0630000 A JPH0630000 A JP H0630000A JP 4178682 A JP4178682 A JP 4178682A JP 17868292 A JP17868292 A JP 17868292A JP H0630000 A JPH0630000 A JP H0630000A
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Abstract
(57)【要約】
【目的】２重化された通信ラインの何れが使用可能であ
るかの管理を、アプリケーションに負担させることがな
いようにする。 【構成】２重化された通信ライン１，２に複数の制御装
置１０，２０，３０，…４０が接続された通信システム
において、制御装置のそれぞれは、各通信ライン１，２
に対応する２組の通信アドレス（論理アドレス１，物理
アドレス１、及び論理アドレス２，物理アドレス２）を
一元化した論理アドレスと物理アドレスとの間の変換表
を備え、制御装置Ａから制御装置Ｂへ送信を行なう際
に、変換表を参照して、制御装置Ａの論理アドレス１と
制御装置Ｂの論理アドレス１と制御装置Ａの物理アドレ
ス２と制御装置Ｂの物理アドレス２を組み合わせて送信
データを構成する。
るかの管理を、アプリケーションに負担させることがな
いようにする。 【構成】２重化された通信ライン１，２に複数の制御装
置１０，２０，３０，…４０が接続された通信システム
において、制御装置のそれぞれは、各通信ライン１，２
に対応する２組の通信アドレス（論理アドレス１，物理
アドレス１、及び論理アドレス２，物理アドレス２）を
一元化した論理アドレスと物理アドレスとの間の変換表
を備え、制御装置Ａから制御装置Ｂへ送信を行なう際
に、変換表を参照して、制御装置Ａの論理アドレス１と
制御装置Ｂの論理アドレス１と制御装置Ａの物理アドレ
ス２と制御装置Ｂの物理アドレス２を組み合わせて送信
データを構成する。
Description
【０００１】
【産業上の利用分野】本発明は、冷熱プラントやボイラ
の制御装置等に適用可能な、２重化された通信ラインに
よって接続された制御装置間の２重化制御方式に関す
る。
の制御装置等に適用可能な、２重化された通信ラインに
よって接続された制御装置間の２重化制御方式に関す
る。
【０００２】
【従来の技術】図３は従来の２重化された通信ラインを
持つ通信システムの例を示している。通信ライン２，３
には、それぞれ複数のノード、図３ではノードＡ１０，
Ｂ２０，Ｃ３０，Ｄ４０が接続されており、これらは制
御装置として見なすことができる。
持つ通信システムの例を示している。通信ライン２，３
には、それぞれ複数のノード、図３ではノードＡ１０，
Ｂ２０，Ｃ３０，Ｄ４０が接続されており、これらは制
御装置として見なすことができる。
【０００３】各ノードが２系統の通信ライン１，２で接
続されているのは、通信ラインの一方が故障、あるいは
ノードＡ１０，Ｂ２０，Ｃ３０，Ｄ４０に設けられた通
信制御回路１３，１４，２３，２４，３３，３４，４
３，４４（後述する）の何れかが故障した場合にも、正
常な通信ライン、通信制御回路を確保し、通信が可能な
状態を維持するためである。
続されているのは、通信ラインの一方が故障、あるいは
ノードＡ１０，Ｂ２０，Ｃ３０，Ｄ４０に設けられた通
信制御回路１３，１４，２３，２４，３３，３４，４
３，４４（後述する）の何れかが故障した場合にも、正
常な通信ライン、通信制御回路を確保し、通信が可能な
状態を維持するためである。
【０００４】図３中に示すノードＡ１０は、システムバ
ス１１、ＣＰＵ１２、通信制御回路１３，１４、及びメ
モリ１５によって構成されている。システムバス１１
は、ＣＰＵ１２、メモリ１５、通信制御回路１３，１４
とを相互に接続する。ＣＰＵ１２は、制御装置の中枢で
あり、通信制御回路１３等の制御、メモリ１５等の制
御、制御装置に与えられた処理等を実行する。通信制御
回路１３は通信ライン１と接続され、通信制御回路１４
は通信ライン２と接続されている。メモリ１５には、図
４に示すような、論理アドレスと物理アドレスとの間の
変換表が、通信ライン１用、通信ライン２用のそれぞれ
について記憶されている。
ス１１、ＣＰＵ１２、通信制御回路１３，１４、及びメ
モリ１５によって構成されている。システムバス１１
は、ＣＰＵ１２、メモリ１５、通信制御回路１３，１４
とを相互に接続する。ＣＰＵ１２は、制御装置の中枢で
あり、通信制御回路１３等の制御、メモリ１５等の制
御、制御装置に与えられた処理等を実行する。通信制御
回路１３は通信ライン１と接続され、通信制御回路１４
は通信ライン２と接続されている。メモリ１５には、図
４に示すような、論理アドレスと物理アドレスとの間の
変換表が、通信ライン１用、通信ライン２用のそれぞれ
について記憶されている。
【０００５】なお、ノードＢ２０、ノードＣ３０、ノー
ドＤ４０の構成は、ノードＡ１０と同一の形態なので説
明を省略する。
ドＤ４０の構成は、ノードＡ１０と同一の形態なので説
明を省略する。
【０００６】次に、ノード間の通信の方式について説明
するために、論理アドレスと物理アドレスについて説明
をする。論理アドレスは、制御装置（ノード）内で実行
される応用プログラム（アプリケーション１００）が使
用するアドレスで、各ノード番号、通信ライン番号の組
み合わせで表現される。
するために、論理アドレスと物理アドレスについて説明
をする。論理アドレスは、制御装置（ノード）内で実行
される応用プログラム（アプリケーション１００）が使
用するアドレスで、各ノード番号、通信ライン番号の組
み合わせで表現される。
【０００７】例えば、ノードＡ１０をノード番号hostid
=1、使用する通信ラインが通信ライン１で通信ライン番
号netid=1 とすると、ノードＡの論理アドレスは、（ne
tid,hostid）＝（１，１）となる。ノードＡが通信ライ
ン２を使用すると（netid,hostid）＝（２，１) が論理
アドレスとなる。従って、通信ラインが２重化されてい
ると各ノードは２つの論理アドレスを持つことになる。
=1、使用する通信ラインが通信ライン１で通信ライン番
号netid=1 とすると、ノードＡの論理アドレスは、（ne
tid,hostid）＝（１，１）となる。ノードＡが通信ライ
ン２を使用すると（netid,hostid）＝（２，１) が論理
アドレスとなる。従って、通信ラインが２重化されてい
ると各ノードは２つの論理アドレスを持つことになる。
【０００８】ノードＡ１０からノードＣ３０へ通信ライ
ン１を使用して通信するのであれば、論理アドレス
（１，１）から（１，３）への通信となる。
ン１を使用して通信するのであれば、論理アドレス
（１，１）から（１，３）への通信となる。
【０００９】ノード間で通信するときに用いられるデー
タ構成は、図５のようになる。図５（ａ）は、通信処理
階層を示しており、図５（ｂ）は各階層に対応するデー
タ構成を示している。
タ構成は、図５のようになる。図５（ａ）は、通信処理
階層を示しており、図５（ｂ）は各階層に対応するデー
タ構成を示している。
【００１０】まず、アプリケーション１００（ノードＡ
１０であればＣＰＵ１２とメモリ１５に格納された応用
プログラムによって実現される）が送信したいデータ１
０３と、送信先、送信元の論理アドレス１０６を付加し
て、ネットワーク処理１０１へ処理を渡す。ネットワー
ク処理１０１は、データ１０３と論理アドレスのペアを
つなげたデータ１０４に構成し直し、通信制御回路１
３，３３が認識できる物理アドレスを図４に示す変換表
から求めて、その物理アドレスのペア１０７をハードウ
ェア１０２へ、先のデータ１０４と共に送る。なお、ハ
ードウェア１０２は、図３に示す通信制御回路１３と同
一のものである。
１０であればＣＰＵ１２とメモリ１５に格納された応用
プログラムによって実現される）が送信したいデータ１
０３と、送信先、送信元の論理アドレス１０６を付加し
て、ネットワーク処理１０１へ処理を渡す。ネットワー
ク処理１０１は、データ１０３と論理アドレスのペアを
つなげたデータ１０４に構成し直し、通信制御回路１
３，３３が認識できる物理アドレスを図４に示す変換表
から求めて、その物理アドレスのペア１０７をハードウ
ェア１０２へ、先のデータ１０４と共に送る。なお、ハ
ードウェア１０２は、図３に示す通信制御回路１３と同
一のものである。
【００１１】通信制御回路１０２は、ハードウェアであ
るため、論理アドレスではなく物理アドレスでないと認
識できない。通信制御回路１０２は、パラメータ１０７
とデータ部１０４を組み合わせて通信ライン１に送出す
る。この時、図５中のデータ１０５に示すようにＦＨ
（フレームヘッダ）が付加される。
るため、論理アドレスではなく物理アドレスでないと認
識できない。通信制御回路１０２は、パラメータ１０７
とデータ部１０４を組み合わせて通信ライン１に送出す
る。この時、図５中のデータ１０５に示すようにＦＨ
（フレームヘッダ）が付加される。
【００１２】
【発明が解決しようとする課題】このような従来の構成
の場合では、２重化された通信ラインに接続されたノー
ドＣ３０の通信制御回路３３が故障した時、論理アドレ
ス（１，３）を送信先として使用することができない。
の場合では、２重化された通信ラインに接続されたノー
ドＣ３０の通信制御回路３３が故障した時、論理アドレ
ス（１，３）を送信先として使用することができない。
【００１３】すなわち、通信制御回路３３が故障してい
るときには、ノードＡ１０の論理アドレス（１，１）か
らノードＣ３０の論理アドレス（１，３）へ送信する試
みは失敗する。この場合、ノードＡ１０のアプリケーシ
ョン１００は、ネットワーク処理１０１に送信要求を出
しても、送信できないという報告を受けることになる。
アプリケーション１００は、通信ライン１を使用するこ
とを中止し、通信ライン２を使用して再度送信を試みる
ことになる。つまり、論理アドレス（２，１）から
（２，３）への送信を試みる。
るときには、ノードＡ１０の論理アドレス（１，１）か
らノードＣ３０の論理アドレス（１，３）へ送信する試
みは失敗する。この場合、ノードＡ１０のアプリケーシ
ョン１００は、ネットワーク処理１０１に送信要求を出
しても、送信できないという報告を受けることになる。
アプリケーション１００は、通信ライン１を使用するこ
とを中止し、通信ライン２を使用して再度送信を試みる
ことになる。つまり、論理アドレス（２，１）から
（２，３）への送信を試みる。
【００１４】このように、通信ラインが２重化されてい
る場合に、アプリケーション１００は、何れが使用可能
なのか知る必要があることを示している。アプリケーシ
ョン１００にとって、その様なハードウェア上の詳細を
管理するのはソフトウェア構成上大きな負担となってい
る。
る場合に、アプリケーション１００は、何れが使用可能
なのか知る必要があることを示している。アプリケーシ
ョン１００にとって、その様なハードウェア上の詳細を
管理するのはソフトウェア構成上大きな負担となってい
る。
【００１５】本発明は前記のような点に鑑みてなされた
もので、２重化された通信ラインの何れが使用可能であ
るかの管理を、アプリケーションに負担させることのな
い通信ラインの２重化制御方式を提供することを目的と
する。
もので、２重化された通信ラインの何れが使用可能であ
るかの管理を、アプリケーションに負担させることのな
い通信ラインの２重化制御方式を提供することを目的と
する。
【００１６】
【課題を解決するための手段】本発明は、２重化された
通信ラインに複数の制御装置が接続された通信システム
において、前記制御装置のそれぞれは、各通信ラインに
対応する２組の通信アドレス（論理アドレス１，物理ア
ドレス１、及び論理アドレス２，物理アドレス２）を一
元化した論理アドレスと物理アドレスとの間の変換表を
備え、制御装置Ａから制御装置Ｂへ送信を行なう際に、
前記変換表を参照して、制御装置Ａの論理アドレス１と
制御装置Ｂの論理アドレス１と制御装置Ａの物理アドレ
ス２と制御装置Ｂの物理アドレス２を組み合わせて送信
データを構成することを特徴とする。
通信ラインに複数の制御装置が接続された通信システム
において、前記制御装置のそれぞれは、各通信ラインに
対応する２組の通信アドレス（論理アドレス１，物理ア
ドレス１、及び論理アドレス２，物理アドレス２）を一
元化した論理アドレスと物理アドレスとの間の変換表を
備え、制御装置Ａから制御装置Ｂへ送信を行なう際に、
前記変換表を参照して、制御装置Ａの論理アドレス１と
制御装置Ｂの論理アドレス１と制御装置Ａの物理アドレ
ス２と制御装置Ｂの物理アドレス２を組み合わせて送信
データを構成することを特徴とする。
【００１７】
【作用】このような構成によれば、２重化された各通信
ラインに対応する２組の通信アドレスが一元化されてい
るため、例えば送信先の一方の通信ラインに対応する論
理アドレスが使用できない場合であっても、容易に他方
の通信ラインに対応する通信アドレスを用いて送信デー
タを構成することができる。
ラインに対応する２組の通信アドレスが一元化されてい
るため、例えば送信先の一方の通信ラインに対応する論
理アドレスが使用できない場合であっても、容易に他方
の通信ラインに対応する通信アドレスを用いて送信デー
タを構成することができる。
【００１８】
【実施例】以下、図面を参照して本発明の一実施例を説
明する。図１は同実施例に係わる２重化制御方式を適用
する通信システムの構成の一例を示すブロック図であ
る。図１は、従来の技術の説明に用いた図３と同様に、
２系統の通信ライン１，２に複数のノード、図１ではノ
ードＡ１０，Ｂ２０，Ｃ３０，Ｄ４０（これらは制御装
置として見なすことができる）が接続された構成となっ
ている。
明する。図１は同実施例に係わる２重化制御方式を適用
する通信システムの構成の一例を示すブロック図であ
る。図１は、従来の技術の説明に用いた図３と同様に、
２系統の通信ライン１，２に複数のノード、図１ではノ
ードＡ１０，Ｂ２０，Ｃ３０，Ｄ４０（これらは制御装
置として見なすことができる）が接続された構成となっ
ている。
【００１９】ノードＡ１０は、システムバス１１、ＣＰ
Ｕ１２、通信制御回路１３，１４、メモリ１５、及びメ
モリ１６によって構成されている。システムバス１１
は、ＣＰＵ１２、メモリ１５，１６、通信制御回路１
３，１４とを相互に接続する。ＣＰＵ１２は、制御装置
の中枢であり、通信制御回路１３等の制御、メモリ１
５，１６等の制御、制御装置に与えられた処理等を実行
する。通信制御回路１３は通信ライン１と接続され、通
信制御回路１４は通信ライン２と接続されている。メモ
リ１６には、図２に示すような、論理アドレスと物理ア
ドレスとの間の通信ライン１，２用の修正変換表が記憶
されている。
Ｕ１２、通信制御回路１３，１４、メモリ１５、及びメ
モリ１６によって構成されている。システムバス１１
は、ＣＰＵ１２、メモリ１５，１６、通信制御回路１
３，１４とを相互に接続する。ＣＰＵ１２は、制御装置
の中枢であり、通信制御回路１３等の制御、メモリ１
５，１６等の制御、制御装置に与えられた処理等を実行
する。通信制御回路１３は通信ライン１と接続され、通
信制御回路１４は通信ライン２と接続されている。メモ
リ１６には、図２に示すような、論理アドレスと物理ア
ドレスとの間の通信ライン１，２用の修正変換表が記憶
されている。
【００２０】なお、ノードＢ２０、ノードＣ３０、ノー
ドＤ４０の構成は、ノードＡ１０と同一の形態なので説
明を省略する。
ドＤ４０の構成は、ノードＡ１０と同一の形態なので説
明を省略する。
【００２１】次に、同実施例の作用効果について説明す
る。図１に示すように、本実施例における各制御装置
（ノード）には、図２に示すような修正変換表がメモリ
１６，２６，３６，４６にそれぞれ格納されている。従
来の制御装置における変換表は、通信ライン１用と通信
ライン２用と別々にメモリ５１に格納されているので、
相互の関係がなかったが、本発明では図２に示すように
通信ライン１，２用を１つにして相互に関係をもたせて
いる。これにより、例えばノードＡ１０の論理アドレス
（１，１）（１，２）の何れも、物理アドレス１００
０、あるいは５０００を使用できるようになる。
る。図１に示すように、本実施例における各制御装置
（ノード）には、図２に示すような修正変換表がメモリ
１６，２６，３６，４６にそれぞれ格納されている。従
来の制御装置における変換表は、通信ライン１用と通信
ライン２用と別々にメモリ５１に格納されているので、
相互の関係がなかったが、本発明では図２に示すように
通信ライン１，２用を１つにして相互に関係をもたせて
いる。これにより、例えばノードＡ１０の論理アドレス
（１，１）（１，２）の何れも、物理アドレス１００
０、あるいは５０００を使用できるようになる。
【００２２】つまり、図２に示すような変換表を使用す
れば、ノードＣ３０の論理アドレス（１，３）が故障し
た場合でも、物理アドレスのペアとして送信先２００
０、発信元５０００を使用し、論理アドレスのペア
（１，１）（１，３）を、そのまま使用するものとすれ
ば、通信ライン１が使用出来ないことをアプリケーショ
ン１００に通知しなくても、ネットワーク処理１０１で
通信ライン２を使用することが可能になる。
れば、ノードＣ３０の論理アドレス（１，３）が故障し
た場合でも、物理アドレスのペアとして送信先２００
０、発信元５０００を使用し、論理アドレスのペア
（１，１）（１，３）を、そのまま使用するものとすれ
ば、通信ライン１が使用出来ないことをアプリケーショ
ン１００に通知しなくても、ネットワーク処理１０１で
通信ライン２を使用することが可能になる。
【００２３】従って、アプリケーション１００にとっ
て、通信ラインの２重化というハードウェアに付随する
詳細を管理することから解放されるので処理負担が軽減
される。
て、通信ラインの２重化というハードウェアに付随する
詳細を管理することから解放されるので処理負担が軽減
される。
【００２４】
【発明の効果】以上のように本発明によれば、２重化さ
れた通信ラインを１つにして相互に関係をもたせた論理
アドレスと物理アドレスとの間の変換表をもとに、通信
制御を行なうので、アプリケーションがハードウェアの
詳細を管理する必要がないので、アプリケーションの処
理負担を軽減することが可能となるものである。
れた通信ラインを１つにして相互に関係をもたせた論理
アドレスと物理アドレスとの間の変換表をもとに、通信
制御を行なうので、アプリケーションがハードウェアの
詳細を管理する必要がないので、アプリケーションの処
理負担を軽減することが可能となるものである。
【図１】本発明の一実施例に係わる２重化制御方式を適
用する通信システムの構成の一例を示すブロック図。
用する通信システムの構成の一例を示すブロック図。
【図２】本実施例における修正アドレス変換表の一例を
説明するための図。
説明するための図。
【図３】従来の２重化された通信ラインを持つ通信シス
テムの構成例を示す図。
テムの構成例を示す図。
【図４】従来のアドレス変換表の一例を説明するための
図。
図。
【図５】通信処理階層と各階層におけるデータ構成を説
明するための図。
明するための図。
１，２…通信ライン、１０，２０，３０，４０…ノー
ド、１２，２２，３２，４２…ＣＰＵ、１３，１４，２
３，２４，３３，３４，４３，４４…通信制御回路、１
５，２５，３５，４５，１６，２６，３６，４６…メモ
リ。
ド、１２，２２，３２，４２…ＣＰＵ、１３，１４，２
３，２４，３３，３４，４３，４４…通信制御回路、１
５，２５，３５，４５，１６，２６，３６，４６…メモ
リ。
Claims (1)
- 【請求項１】 ２重化された通信ラインに複数の制御装
置が接続された通信システムにおいて、 前記制御装置のそれぞれは、各通信ラインに対応する２
組の通信アドレス（論理アドレス１，物理アドレス１、
及び論理アドレス２，物理アドレス２）を一元化した論
理アドレスと物理アドレスとの間の変換表を備え、制御
装置Ａから制御装置Ｂへ送信を行なう際に、前記変換表
を参照して、制御装置Ａの論理アドレス１と制御装置Ｂ
の論理アドレス１と制御装置Ａの物理アドレス２と制御
装置Ｂの物理アドレス２を組み合わせて送信データを構
成することを特徴とする通信ラインの２重化制御方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4178682A JPH0630000A (ja) | 1992-07-06 | 1992-07-06 | 通信ラインの２重化制御方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4178682A JPH0630000A (ja) | 1992-07-06 | 1992-07-06 | 通信ラインの２重化制御方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0630000A true JPH0630000A (ja) | 1994-02-04 |
Family
ID=16052714
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4178682A Withdrawn JPH0630000A (ja) | 1992-07-06 | 1992-07-06 | 通信ラインの２重化制御方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0630000A (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5832340A (en) * | 1996-04-09 | 1998-11-03 | Minolta Co., Ltd. | Image forming apparatus |
| US5884122A (en) * | 1996-07-10 | 1999-03-16 | Minolta Co., Ltd. | Image forming apparatus |
| US6085049A (en) * | 1995-08-28 | 2000-07-04 | Minolta Co., Ltd. | Copying apparatus capable of automatically turning off at a predetermined time |
-
1992
- 1992-07-06 JP JP4178682A patent/JPH0630000A/ja not_active Withdrawn
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6085049A (en) * | 1995-08-28 | 2000-07-04 | Minolta Co., Ltd. | Copying apparatus capable of automatically turning off at a predetermined time |
| US5832340A (en) * | 1996-04-09 | 1998-11-03 | Minolta Co., Ltd. | Image forming apparatus |
| US5884122A (en) * | 1996-07-10 | 1999-03-16 | Minolta Co., Ltd. | Image forming apparatus |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A300 | Application deemed to be withdrawn because no request for examination was validly filed |
Free format text: JAPANESE INTERMEDIATE CODE: A300 Effective date: 19991005 |