JPH06311740A - スイッチング電源装置 - Google Patents
スイッチング電源装置Info
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- JPH06311740A JPH06311740A JP9314493A JP9314493A JPH06311740A JP H06311740 A JPH06311740 A JP H06311740A JP 9314493 A JP9314493 A JP 9314493A JP 9314493 A JP9314493 A JP 9314493A JP H06311740 A JPH06311740 A JP H06311740A
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Abstract
(57)【要約】
【目的】 ２次側出力電圧の立ち上がり波形を、２次側
出力電圧の立ち上がり時点の如何にかかわらず所定の鈍
し特性でもって立ち上がらせること。 【構成】 ２次側出力電圧の立ち上がり時に、当該２次
側出力電圧の値が予め定めた電圧に到達したときから所
定の時定数でもってコンデンサ２３に充電する間フォト
カプラの発光素子２４に通電させ、このフォトカプラの
受光素子からスイッチング回路の動作を、２次側出力電
圧を低下させるように制御するシステムを利用して２次
側出力電圧の上昇を抑えることにより、立ち上がり波形
を鈍らせるソフトスタート回路２１を設けた。
出力電圧の立ち上がり時点の如何にかかわらず所定の鈍
し特性でもって立ち上がらせること。 【構成】 ２次側出力電圧の立ち上がり時に、当該２次
側出力電圧の値が予め定めた電圧に到達したときから所
定の時定数でもってコンデンサ２３に充電する間フォト
カプラの発光素子２４に通電させ、このフォトカプラの
受光素子からスイッチング回路の動作を、２次側出力電
圧を低下させるように制御するシステムを利用して２次
側出力電圧の上昇を抑えることにより、立ち上がり波形
を鈍らせるソフトスタート回路２１を設けた。
Description
【０００１】
【産業上の利用分野】この発明は、ソフトスタート回路
を備えたスイッチング電源装置に関する。
を備えたスイッチング電源装置に関する。
【０００２】
【従来の技術】図６は従来のスイッチング電源装置のブ
ロック回路図である。図において、１はトランスで、
Ｐ、Ｄ、Ｓ１、Ｓ２巻線を有する。２はＰ巻線の入力端
子で、商用交流電圧を整流した直流電圧（以下、「入力
電圧」という）Ｖ2が印加される。３は電界効果トラン
ジスタ（以下、「ＭＯＳ・ＦＥＴ」という）で、ソース
にＰ巻線が接続される。４はＭＯＳ・ＦＥＴ３のドレイ
ンに接続された接地抵抗器、５はＭＯＳ・ＦＥＴ２をス
イッチング駆動するドライブ回路、６はドライブ回路５
のスイッチング動作を制御する制御部、７は制御部６に
抵抗器８を介して制御部５に起動電圧（以下、「Ｖ7 」
という）を印加する入力端子、９はＤ巻線に誘起された
電圧を整流するダイオード、１０はその整流電圧を平滑
するコンデンサで、その充電電圧が制御部６に駆動電圧
（以下、「Ｖ10」という）として印加される。１１はフ
ォトカプラを構成する受光素子、１２は受光素子１１を
通して制御器６に流入する電流ｉ11を制限する抵抗器で
ある。
ロック回路図である。図において、１はトランスで、
Ｐ、Ｄ、Ｓ１、Ｓ２巻線を有する。２はＰ巻線の入力端
子で、商用交流電圧を整流した直流電圧（以下、「入力
電圧」という）Ｖ2が印加される。３は電界効果トラン
ジスタ（以下、「ＭＯＳ・ＦＥＴ」という）で、ソース
にＰ巻線が接続される。４はＭＯＳ・ＦＥＴ３のドレイ
ンに接続された接地抵抗器、５はＭＯＳ・ＦＥＴ２をス
イッチング駆動するドライブ回路、６はドライブ回路５
のスイッチング動作を制御する制御部、７は制御部６に
抵抗器８を介して制御部５に起動電圧（以下、「Ｖ7 」
という）を印加する入力端子、９はＤ巻線に誘起された
電圧を整流するダイオード、１０はその整流電圧を平滑
するコンデンサで、その充電電圧が制御部６に駆動電圧
（以下、「Ｖ10」という）として印加される。１１はフ
ォトカプラを構成する受光素子、１２は受光素子１１を
通して制御器６に流入する電流ｉ11を制限する抵抗器で
ある。
【０００３】次に、１３はＳ１巻線にリレー１４を介し
て接続された整流用のダイオード、１５はその整流電圧
を平滑するコンデンサ、１６は平滑された第１の直流電
圧（以下、「Ｖ16」という）の出力端子、１７はＳ２巻
線に接続された整流用のダイオード、１８はその平滑用
のコンデンサ、１９は第２の直流電圧（以下、「Ｖ19」
という）を出力する第２の出力端子、２０はＶ16が設定
値を超えるのを押さえるエラーアンプ、２１はＶ16の立
ち上がり波形を鈍らせる作用を行うソフトスタート回
路、２２、２３はソフトスタート回路２１の時定数を決
定する抵抗器およびコンデンサの直列体、２４はフォト
カプラを構成する発光素子で、Ｖ19は発光素子２４を介
してソフトスタート回路２１に駆動電流ｉ21を給電する
とともに、抵抗器２５を介してエラーアンプ２０にも駆
動電流ｉ20を給電するように構成されている。
て接続された整流用のダイオード、１５はその整流電圧
を平滑するコンデンサ、１６は平滑された第１の直流電
圧（以下、「Ｖ16」という）の出力端子、１７はＳ２巻
線に接続された整流用のダイオード、１８はその平滑用
のコンデンサ、１９は第２の直流電圧（以下、「Ｖ19」
という）を出力する第２の出力端子、２０はＶ16が設定
値を超えるのを押さえるエラーアンプ、２１はＶ16の立
ち上がり波形を鈍らせる作用を行うソフトスタート回
路、２２、２３はソフトスタート回路２１の時定数を決
定する抵抗器およびコンデンサの直列体、２４はフォト
カプラを構成する発光素子で、Ｖ19は発光素子２４を介
してソフトスタート回路２１に駆動電流ｉ21を給電する
とともに、抵抗器２５を介してエラーアンプ２０にも駆
動電流ｉ20を給電するように構成されている。
【０００４】まず、この従来例の動作条件を説明する。
Ｖ16の立ち上がり特性は、自由に立ち上がらせたときの
波形は図７中の特性ａであって、時刻ｔ1に設定値Ｖに
達するものであり、これを時刻ｔ3 で設定値Ｖに達する
ようにソフトスタート回路２１によって鈍らせる。
Ｖ16の立ち上がり特性は、自由に立ち上がらせたときの
波形は図７中の特性ａであって、時刻ｔ1に設定値Ｖに
達するものであり、これを時刻ｔ3 で設定値Ｖに達する
ようにソフトスタート回路２１によって鈍らせる。
【０００５】また、リレー１４は閉じられており、時刻
ｔ0 に入力端子２にＶ2 が印加されて、同時に立ち上が
り始めるものとする。
ｔ0 に入力端子２にＶ2 が印加されて、同時に立ち上が
り始めるものとする。
【０００６】次に制御部６の駆動電圧Ｖ10の立ち上がり
動作について説明する。まず、入力端子７にＶ7 が印加
されるとコンデンサ１０の充電が開始されてコンデンサ
１０の端子電圧（以下「Ｖ10」という）は図８（ａ）中
の０点からａ点に向かって上昇し、制御部６の最低動作
電圧（以下「Ｖ10’」という）を超えると制御部６は動
作可能な状態となる。こののち、時刻ｔ0 で入力端子２
にＶ2 が印加されるとドライブ回路５が制御部６に制御
されてＭＯＳ・ＦＥＴ３をオンにし、Ｐ巻線に電流が流
れ始め、同時に制御部６に駆動電流が流れ始めるので、
ａ点からｂ点に向かってＶ10は下降してゆく。他方、時
刻ｔ0 から巻線Ｄの誘起電圧がダイオード９によって整
流された電圧（図８（ｂ））がコンデンサ１０に印加さ
れた時刻ｔ4 でコンデンサ１０の端子電圧Ｖ10より高く
なる時点Ｃからコンデンサ１０への充電が開始されるの
で、Ｖ10は再び上昇する。この結果Ｖ10は図８（ｃ）に
示すような波形となる。
動作について説明する。まず、入力端子７にＶ7 が印加
されるとコンデンサ１０の充電が開始されてコンデンサ
１０の端子電圧（以下「Ｖ10」という）は図８（ａ）中
の０点からａ点に向かって上昇し、制御部６の最低動作
電圧（以下「Ｖ10’」という）を超えると制御部６は動
作可能な状態となる。こののち、時刻ｔ0 で入力端子２
にＶ2 が印加されるとドライブ回路５が制御部６に制御
されてＭＯＳ・ＦＥＴ３をオンにし、Ｐ巻線に電流が流
れ始め、同時に制御部６に駆動電流が流れ始めるので、
ａ点からｂ点に向かってＶ10は下降してゆく。他方、時
刻ｔ0 から巻線Ｄの誘起電圧がダイオード９によって整
流された電圧（図８（ｂ））がコンデンサ１０に印加さ
れた時刻ｔ4 でコンデンサ１０の端子電圧Ｖ10より高く
なる時点Ｃからコンデンサ１０への充電が開始されるの
で、Ｖ10は再び上昇する。この結果Ｖ10は図８（ｃ）に
示すような波形となる。
【０００７】この場合、Ｃ点におけるＶ10の値ＶC が、
制御部６の最低動作電圧Ｖ10’よりも低くならないよう
にコンデンサ１０の容量等が設定されている。
制御部６の最低動作電圧Ｖ10’よりも低くならないよう
にコンデンサ１０の容量等が設定されている。
【０００８】次に、ソフトスタート回路２１の動作につ
いて説明する。図７において、時刻ｔ0 よりも前に端子
７にＶ7 が印加され、ついて時刻ｔ0 に端子２にＶ2 が
印加されてＶ16およびＶ19が立ち上がり始め、同時に発
光素子２４を通してエラーアンプ２０およびソフトスタ
ート回路２１への駆動電圧が印加されるが、Ｖ16が設定
電圧Ｖ12に到達しない間はエラーアンプ２０には電流ｉ
20は流れないので、コンデンサ２３の充電電流ｉ21だけ
が流れ、時刻ｔ2でＶ19が一定電位になると次第にｉ21
は減少してゆき、時刻ｔ3 で零となる。この結果、Ｖ16
は図７中の特性ｂのように立ち上がり特性の鈍化した波
形となる。
いて説明する。図７において、時刻ｔ0 よりも前に端子
７にＶ7 が印加され、ついて時刻ｔ0 に端子２にＶ2 が
印加されてＶ16およびＶ19が立ち上がり始め、同時に発
光素子２４を通してエラーアンプ２０およびソフトスタ
ート回路２１への駆動電圧が印加されるが、Ｖ16が設定
電圧Ｖ12に到達しない間はエラーアンプ２０には電流ｉ
20は流れないので、コンデンサ２３の充電電流ｉ21だけ
が流れ、時刻ｔ2でＶ19が一定電位になると次第にｉ21
は減少してゆき、時刻ｔ3 で零となる。この結果、Ｖ16
は図７中の特性ｂのように立ち上がり特性の鈍化した波
形となる。
【０００９】次に、エラーアンプ２０の動作について説
明する。エラーアンプ２０は、Ｖ16が設定値Ｖを超えた
ときＶに戻すように、フォトカプラを介して制御部６の
動作を制御している。すなわち、Ｖ16が予め設定された
電圧Ｖよりも高くなったとすると、発光素子２４および
抵抗器２５を介してエラーアンプ２０に駆動電流が流
れ、発光素子２４の発光信号が受光素子１１に受光さ
れ、受光量に対応する信号電流が制御部６に入力され
る。制御部６はこの信号電流を受けると、Ｖ16がＶを超
えたと判断し、ドライブ回路５を介してＰ巻線の電圧変
動が小さくなるようにＭＯＳ・ＦＥＴ３の動作を押さえ
る。この結果、Ｓ１巻線の誘起電圧も下がるので、Ｖ16
はＶに近づくように低下してゆく。
明する。エラーアンプ２０は、Ｖ16が設定値Ｖを超えた
ときＶに戻すように、フォトカプラを介して制御部６の
動作を制御している。すなわち、Ｖ16が予め設定された
電圧Ｖよりも高くなったとすると、発光素子２４および
抵抗器２５を介してエラーアンプ２０に駆動電流が流
れ、発光素子２４の発光信号が受光素子１１に受光さ
れ、受光量に対応する信号電流が制御部６に入力され
る。制御部６はこの信号電流を受けると、Ｖ16がＶを超
えたと判断し、ドライブ回路５を介してＰ巻線の電圧変
動が小さくなるようにＭＯＳ・ＦＥＴ３の動作を押さえ
る。この結果、Ｓ１巻線の誘起電圧も下がるので、Ｖ16
はＶに近づくように低下してゆく。
【００１０】また、逆にＶ16がＶよりも低くなるとエラ
ーアンプ２０が作動しないので、発光素子２４に電流が
流れない。このため受光素子１１はオフの状態であるの
で制御部６には信号電流が入力されない。この場合、制
御部６はＶ16がＶより低いと判断し、Ｐ巻線の電圧変動
が大きくなるようにドライブ回路５を介してＭＯＳ・Ｆ
ＥＴ３を駆動し、この結果Ｖ16がＶに近づくように上昇
してゆく。
ーアンプ２０が作動しないので、発光素子２４に電流が
流れない。このため受光素子１１はオフの状態であるの
で制御部６には信号電流が入力されない。この場合、制
御部６はＶ16がＶより低いと判断し、Ｐ巻線の電圧変動
が大きくなるようにドライブ回路５を介してＭＯＳ・Ｆ
ＥＴ３を駆動し、この結果Ｖ16がＶに近づくように上昇
してゆく。
【００１１】
【発明が解決しようとする課題】しかし、当該電源装置
が図９に示すように、Ｖ16がＶ19の立ち上がり開始時点
ｔ0 よりも遅れた時点ｔ5 でリレー１４がオンとなるも
のである場合には、Ｖ19の立ち上がり開始前にソフトス
タート回路２１の鈍化作用が開始されているため、十分
な抑制効果が得られず、Ｖ16の立ち上がり速度の早い電
源装置では、図９に示すようにｔ5 から短い時間後の時
刻ｔ6 でＶに到達するオーバーシュートぎみの波形とな
り、昇圧トランスを用いて高電圧を発生させる場合には
高いピーク電圧が発生して耐圧特性上の問題が生じるな
どの問題点があった。
が図９に示すように、Ｖ16がＶ19の立ち上がり開始時点
ｔ0 よりも遅れた時点ｔ5 でリレー１４がオンとなるも
のである場合には、Ｖ19の立ち上がり開始前にソフトス
タート回路２１の鈍化作用が開始されているため、十分
な抑制効果が得られず、Ｖ16の立ち上がり速度の早い電
源装置では、図９に示すようにｔ5 から短い時間後の時
刻ｔ6 でＶに到達するオーバーシュートぎみの波形とな
り、昇圧トランスを用いて高電圧を発生させる場合には
高いピーク電圧が発生して耐圧特性上の問題が生じるな
どの問題点があった。
【００１２】この発明は、上記のような問題点の解消を
目的としてなされたもので、第１の出力電圧の立ち上が
り時点がソフトスタート回路の駆動電源の立ち上がり時
点よりも遅い電源装置であっても、第１の出力電圧の立
ち上がりを鈍らせることのできるソフトスタート回路を
備えたスイッチング電源装置を得ることを目的とする。
目的としてなされたもので、第１の出力電圧の立ち上が
り時点がソフトスタート回路の駆動電源の立ち上がり時
点よりも遅い電源装置であっても、第１の出力電圧の立
ち上がりを鈍らせることのできるソフトスタート回路を
備えたスイッチング電源装置を得ることを目的とする。
【００１３】
【課題を解決するための手段】この発明に係るスイッチ
ング電源装置は、トランスの１次側の通電量を制御する
スイッチング回路と、このトランスの２次側に誘起され
る電圧を整流して得られた出力電圧に対応して通電制御
されるフォトカプラの発光素子と、この発光素子に対向
して配置されスイッチング回路を制御するフォトカプラ
の受光素子とを備え、トランスの２次側の出力電圧が設
定値を超えたときにフォトカプラの発光素子に通電し
て、受光素子を介してスイッチング回路を制御し１次側
の通電量を減少させて２次側の出力電圧をを低下させる
と共に、出力電圧が設定値よりも低下したときはスイッ
チング回路を制御して１次側の通電量を増大して２次側
の出力電圧を高めるようにしたスイッチング電源装置に
おいて、出力電圧が予め定めた電圧に到達した時点から
所定の時定数でもってコンデンサが充電されるまでの間
上記フォトカプラの発光素子に通電させるようにしたソ
フトスタート回路を備えたものである。
ング電源装置は、トランスの１次側の通電量を制御する
スイッチング回路と、このトランスの２次側に誘起され
る電圧を整流して得られた出力電圧に対応して通電制御
されるフォトカプラの発光素子と、この発光素子に対向
して配置されスイッチング回路を制御するフォトカプラ
の受光素子とを備え、トランスの２次側の出力電圧が設
定値を超えたときにフォトカプラの発光素子に通電し
て、受光素子を介してスイッチング回路を制御し１次側
の通電量を減少させて２次側の出力電圧をを低下させる
と共に、出力電圧が設定値よりも低下したときはスイッ
チング回路を制御して１次側の通電量を増大して２次側
の出力電圧を高めるようにしたスイッチング電源装置に
おいて、出力電圧が予め定めた電圧に到達した時点から
所定の時定数でもってコンデンサが充電されるまでの間
上記フォトカプラの発光素子に通電させるようにしたソ
フトスタート回路を備えたものである。
【００１４】
【作用】この発明によるソフトスタート回路は、出力電
圧が所定値に到達した時点から出力波形を鈍らせるよう
に作用する。
圧が所定値に到達した時点から出力波形を鈍らせるよう
に作用する。
【００１５】
【実施例】実施例１．図１は発明の実施例１の回路図
で、図６と同一符号はそれぞれ同一部分を示しており、
ソフトスタート回路２１の構成以外の部分は同じであ
り、それぞれ同様に作用する。図１において、２５、２
６は出力端子１６と接地間に直列に接続された分圧用の
抵抗器で、Ｖ16を所定の比率で分圧し、Ｖ16がＶに到達
する前の所定値（以下、「Ｖ0 」という）に達したと
き、ベースが当該抵抗器２５、２６の接続点に、コレク
タが発光素子２４に、エミッタが抵抗器２２を介してコ
ンデンサ２３にそれぞれ接続されているトランジスタ２
７がオン状態になるように抵抗値が設定されている。２
８はダイオードで抵抗器２２とコンデンサ２３の接続点
にアノードが接続され、カソードがトランジスタ２７の
ベースに接続され、コンデンサ２３の電荷を抵抗器２６
を介して放電するとともに、トランジスタ２７を保護す
る作用を行う。
で、図６と同一符号はそれぞれ同一部分を示しており、
ソフトスタート回路２１の構成以外の部分は同じであ
り、それぞれ同様に作用する。図１において、２５、２
６は出力端子１６と接地間に直列に接続された分圧用の
抵抗器で、Ｖ16を所定の比率で分圧し、Ｖ16がＶに到達
する前の所定値（以下、「Ｖ0 」という）に達したと
き、ベースが当該抵抗器２５、２６の接続点に、コレク
タが発光素子２４に、エミッタが抵抗器２２を介してコ
ンデンサ２３にそれぞれ接続されているトランジスタ２
７がオン状態になるように抵抗値が設定されている。２
８はダイオードで抵抗器２２とコンデンサ２３の接続点
にアノードが接続され、カソードがトランジスタ２７の
ベースに接続され、コンデンサ２３の電荷を抵抗器２６
を介して放電するとともに、トランジスタ２７を保護す
る作用を行う。
【００１６】次に、Ｖ16とＶ19が同時に立ち上がる場合
の従来例と異なる部分の動作を図２を用いて説明する。
端子７からＶ7 が印加されてＶ19が立ち上がっても、Ｖ
0 に到達する前はソフトスタート回路２１内のトランジ
スタ２７がオン状態になっていないので、ソフトスター
ト回路２１は作動しない。
の従来例と異なる部分の動作を図２を用いて説明する。
端子７からＶ7 が印加されてＶ19が立ち上がっても、Ｖ
0 に到達する前はソフトスタート回路２１内のトランジ
スタ２７がオン状態になっていないので、ソフトスター
ト回路２１は作動しない。
【００１７】次に、Ｖ16が時刻ｔ7 にＶ0 に達すると、
トランジスタ２７がオン状態になり、Ｖ19から発光素子
２４、トランジスタ２７、抵抗器２２を介してコンデン
サ２３に充電電流ｉ21が流れ始め、Ｖ16が制御部６の駆
動電圧Ｖ10が最低動作電圧ＶC となるＶ1 を超えた時刻
ｔ1 からソフトスタート回路２１の鈍らせ作用が開始さ
れ、以後ｉ21が零となる時刻ｔ3 まで次第に鈍らせ作用
を弱めながら継続する。この結果、Ｖ16の立ち上がり波
形は図２中のＶ16に示すようになる。
トランジスタ２７がオン状態になり、Ｖ19から発光素子
２４、トランジスタ２７、抵抗器２２を介してコンデン
サ２３に充電電流ｉ21が流れ始め、Ｖ16が制御部６の駆
動電圧Ｖ10が最低動作電圧ＶC となるＶ1 を超えた時刻
ｔ1 からソフトスタート回路２１の鈍らせ作用が開始さ
れ、以後ｉ21が零となる時刻ｔ3 まで次第に鈍らせ作用
を弱めながら継続する。この結果、Ｖ16の立ち上がり波
形は図２中のＶ16に示すようになる。
【００１８】図３はＶ16の立ち上がり開始時点ｔ5 が、
Ｖ19の立ち上がり開始時点ｔ0 よりも遅い時刻ｔ5 から
立ち上がる場合の実施例１の波形図である。
Ｖ19の立ち上がり開始時点ｔ0 よりも遅い時刻ｔ5 から
立ち上がる場合の実施例１の波形図である。
【００１９】この場合も、ｉ21の流れ始める時点ｔ8
は、Ｖ16がＶ0 に到達した時点からとなるので、図２の
場合と同様のＶ16の出力波形が得られる。
は、Ｖ16がＶ0 に到達した時点からとなるので、図２の
場合と同様のＶ16の出力波形が得られる。
【００２０】なお、Ｖ16がＶに立ち上がったのちに、リ
レー１４がオフされると、トランジスタ２７はオフとな
り、エミッターベース間に逆電圧ＶEB0 がかかるが、ダ
イオード２８の電圧降下分以上の電圧はかからないので
トランジスタ２７が破壊されることはない。
レー１４がオフされると、トランジスタ２７はオフとな
り、エミッターベース間に逆電圧ＶEB0 がかかるが、ダ
イオード２８の電圧降下分以上の電圧はかからないので
トランジスタ２７が破壊されることはない。
【００２１】また、コンデンサ２３の充電電荷は、ダイ
オード２８および抵抗２６を介して放電されるので、再
びリレー１４をオンしても、ソフトスタート回路２１が
作動して第１の出力電圧の立ち上がり波形を鈍らせる動
作を行う。
オード２８および抵抗２６を介して放電されるので、再
びリレー１４をオンしても、ソフトスタート回路２１が
作動して第１の出力電圧の立ち上がり波形を鈍らせる動
作を行う。
【００２２】実施例２．図４はこの発明の実施例２を示
す回路図で、図１と同一符号はそれぞれ同一または相当
部分を示しており、２９はソフトスタート回路２１を構
成するマイクロコンピュータ、３０は第１の出力端子１
６に接続され、マイクロコンピュータ２９に給電する保
護用の抵抗器で、マイクロコンピュータ２９は抵抗器３
０を介して第１の出力電圧を検知して発光素子２４に流
れる電流量を制御してソフトスタート動作を行うように
構成されている。
す回路図で、図１と同一符号はそれぞれ同一または相当
部分を示しており、２９はソフトスタート回路２１を構
成するマイクロコンピュータ、３０は第１の出力端子１
６に接続され、マイクロコンピュータ２９に給電する保
護用の抵抗器で、マイクロコンピュータ２９は抵抗器３
０を介して第１の出力電圧を検知して発光素子２４に流
れる電流量を制御してソフトスタート動作を行うように
構成されている。
【００２３】図５は実施例２の第１の出力電圧の波形図
で以下、図５を用いて実施例２のマイクロコンピュータ
２９の制御動作を説明する。マイクロコンピュータ２９
には、第１の出力電圧値がＶA ＝Ｖ1 、ＶB 、ＶC……
Ｖn ＝Ｖの各値、に達したときに発光素子２４に通電す
る電流値があらかじめプログラムされており、この通電
量はＶA からＶn に近づくほど、順次減少し、Ｖn ＝Ｖ
になったとき零になるように設定されている。このた
め、Ｖ16がＶAに達する時点ｔA から発光素子２４に電
流が流れ始めてＶ16の立ち上がりが鈍り始め、時点ｔB
で電圧ＶB に達すると少し少ない電流値に切り換えられ
て鈍らせ方を少し少なくし、以下、設定電圧に達するた
びに順次電流値を小さくして鈍らせ方を少なくしてゆ
き、時刻ｔn で設定値Ｖ＝Ｖn に達すると電流値を零に
する。この結果、Ｖ16の立ち上がり波形は図５のように
適切な立ち上がり波形となる。
で以下、図５を用いて実施例２のマイクロコンピュータ
２９の制御動作を説明する。マイクロコンピュータ２９
には、第１の出力電圧値がＶA ＝Ｖ1 、ＶB 、ＶC……
Ｖn ＝Ｖの各値、に達したときに発光素子２４に通電す
る電流値があらかじめプログラムされており、この通電
量はＶA からＶn に近づくほど、順次減少し、Ｖn ＝Ｖ
になったとき零になるように設定されている。このた
め、Ｖ16がＶAに達する時点ｔA から発光素子２４に電
流が流れ始めてＶ16の立ち上がりが鈍り始め、時点ｔB
で電圧ＶB に達すると少し少ない電流値に切り換えられ
て鈍らせ方を少し少なくし、以下、設定電圧に達するた
びに順次電流値を小さくして鈍らせ方を少なくしてゆ
き、時刻ｔn で設定値Ｖ＝Ｖn に達すると電流値を零に
する。この結果、Ｖ16の立ち上がり波形は図５のように
適切な立ち上がり波形となる。
【００２４】
【発明の効果】この発明によれば、立ち上がり波形を鈍
らせようとする出力電圧が所定値に達したときからソフ
トスタート回路の動作を開始させるようにしたので、出
力電圧の立ち上がり開始時点にかかわりなく一定の鈍ら
せ作用を施すことができる。
らせようとする出力電圧が所定値に達したときからソフ
トスタート回路の動作を開始させるようにしたので、出
力電圧の立ち上がり開始時点にかかわりなく一定の鈍ら
せ作用を施すことができる。
【図面の簡単な説明】
【図１】この発明の実施例１の回路図である。
【図２】実施例１の第１の動作例の出力波形図である。
【図３】実施例１の第２の動作例の出力波形図である。
【図４】この発明の実施例２の回路図である。
【図５】実施例２の出力波形図である。
【図６】従来のスイッチング電源装置の回路図である。
【図７】従来例の第１の動作例の出力波形図である。
【図８】従来例の制御部駆動電圧の立ち上がり波形図で
ある。
ある。
【図９】従来例の第２の動作例の出力波形図である。
１ トランス ３ ＭＯＳ・ＦＥＴ ５ ドライブ回路 ６ 制御部 ９ ダイオード １０ コンデンサ １１ フォトカプラの受光素子 １３ ダイオード １４ リレー １５ コンデンサ １７ ダイオード １８ コンデンサ ２０ エラーアンプ ２１ ソフトスタート回路 ２２ 抵抗器 ２３ コンデンサ ２４ フォトカプラの発光素子 ２５ 抵抗器 ２６ 抵抗器 ２７ トランジスタ ２８ ダイオード ２９ マイクロコンピュータ Ｐ １次巻線 Ｓ１ ２次巻線 Ｓ２ ２次巻線 Ｄ ２次巻線
Claims (1)
- 【請求項１】 トランスの１次側の通電量を制御するス
イッチング回路、上記トランスの２次側に誘起される電
圧を整流して得られた出力電圧に対応して通電制御され
るフォトカプラの発光素子、この発光素子に対向して配
置され上記スイッチング回路を制御する上記フォトカプ
ラの受光素子を備え、上記トランスの２次側の出力電圧
が設定値を超えたときに上記フォトカプラの発光素子に
通電して、上記受光素子を介して上記スイッチング回路
を制御し１次側の通電量を減少させて２次側の出力電圧
をを低下させると共に、上記出力電圧が上記設定値より
も低下したときは上記スイッチング回路を制御して１次
側の通電量を増大して２次側の出力電圧を高めるように
したスイッチング電源装置において、上記出力電圧が予
め定めた電圧に到達した時点から所定の時定数でもって
コンデンサが充電されるまでの間上記フォトカプラの発
光素子に通電させるようにしたソフトスタート回路を備
えたことを特徴とするスイッチング電源装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9314493A JPH06311740A (ja) | 1993-04-20 | 1993-04-20 | スイッチング電源装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9314493A JPH06311740A (ja) | 1993-04-20 | 1993-04-20 | スイッチング電源装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH06311740A true JPH06311740A (ja) | 1994-11-04 |
Family
ID=14074343
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP9314493A Pending JPH06311740A (ja) | 1993-04-20 | 1993-04-20 | スイッチング電源装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH06311740A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2006014409A (ja) * | 2004-06-22 | 2006-01-12 | Fuji Xerox Co Ltd | 電源装置 |
| JP2006060978A (ja) * | 2004-08-24 | 2006-03-02 | Renesas Technology Corp | 電源制御用半導体集積回路およびスイッチング電源装置 |
-
1993
- 1993-04-20 JP JP9314493A patent/JPH06311740A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2006014409A (ja) * | 2004-06-22 | 2006-01-12 | Fuji Xerox Co Ltd | 電源装置 |
| JP2006060978A (ja) * | 2004-08-24 | 2006-03-02 | Renesas Technology Corp | 電源制御用半導体集積回路およびスイッチング電源装置 |
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