JPH06338812A - ノイズ除去回路 - Google Patents
ノイズ除去回路Info
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- JPH06338812A JPH06338812A JP12895193A JP12895193A JPH06338812A JP H06338812 A JPH06338812 A JP H06338812A JP 12895193 A JP12895193 A JP 12895193A JP 12895193 A JP12895193 A JP 12895193A JP H06338812 A JPH06338812 A JP H06338812A
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Abstract
(57)【要約】
【目的】 ＦＭチューナＩＣのパルスノイズ検出直前の
レベル保持を正確に行う。 【構成】 差分回路３２は、コンポジット信号５４を遅
延回路３１で遅延した遅延信号５５と反転アンプ３９か
らのパイロットキャンセル信号５６の反転信号との差分
を出力する。この出力５９はＡ／Ｄコンバータ７２を経
てメモリ７１に常時書き込まれる。ノイズ検出回路３４
がコンポジット信号５４中にパルスノイズを検出しない
ときはスイッチ７４は差分回路３２側となっており、差
分回路３２によりコンポジット信号５４からパイロット
信号を除いた信号がそのまま出力される。ノイズ検出回
路３４がパルスノイズを検出すると、単安定マルチバイ
ブレータ３５からのゲート信号３８の立ち上がりでスイ
ッチ７２がＤ／Ａコンバータ７３の側に切り換えられる
とともに、メモリ７１からパルスノイズ検出直前の値が
読み出され、Ｄ／Ａコンバータ７３及びスイッチ７４を
介して出力される。
レベル保持を正確に行う。 【構成】 差分回路３２は、コンポジット信号５４を遅
延回路３１で遅延した遅延信号５５と反転アンプ３９か
らのパイロットキャンセル信号５６の反転信号との差分
を出力する。この出力５９はＡ／Ｄコンバータ７２を経
てメモリ７１に常時書き込まれる。ノイズ検出回路３４
がコンポジット信号５４中にパルスノイズを検出しない
ときはスイッチ７４は差分回路３２側となっており、差
分回路３２によりコンポジット信号５４からパイロット
信号を除いた信号がそのまま出力される。ノイズ検出回
路３４がパルスノイズを検出すると、単安定マルチバイ
ブレータ３５からのゲート信号３８の立ち上がりでスイ
ッチ７２がＤ／Ａコンバータ７３の側に切り換えられる
とともに、メモリ７１からパルスノイズ検出直前の値が
読み出され、Ｄ／Ａコンバータ７３及びスイッチ７４を
介して出力される。
Description
【０００１】
【産業上の利用分野】本発明はＦＭラジオ受信機のパル
スノイズ除去回路に関する。
スノイズ除去回路に関する。
【０００２】
【従来の技術】一般に、ＦＭラジオ受信機ではノイズに
対して各種の対策が講じられ、音質向上が図られてい
る。中でも、車載用のＦＭラジオ受信機では、例えばエ
ンジンより外来するパルス状のイグニッションノイズが
問題となる場合が多く、これを除去するための各種のノ
イズ除去回路が提案され、用いられている。以下、従来
のＦＭ受信機の一般構成とパルスノイズ除去回路につい
て説明する。
対して各種の対策が講じられ、音質向上が図られてい
る。中でも、車載用のＦＭラジオ受信機では、例えばエ
ンジンより外来するパルス状のイグニッションノイズが
問題となる場合が多く、これを除去するための各種のノ
イズ除去回路が提案され、用いられている。以下、従来
のＦＭ受信機の一般構成とパルスノイズ除去回路につい
て説明する。
【０００３】図２は、一般的なＦＭラジオ受信機のチュ
ーナＩＣの概略構成を表したものである。アンテナ１１
で受信したＦＭ波は、ＦＭチューナＩＣ１０に入力さ
れ、まず高周波増幅器（ＲＦ ＡＭＰ）１２で増幅され
たのち、混合器（ＭＩＸ）１４において局部発振器
（Ｌ．ＯＳＣ）１３の出力と混合されて１０．７ＭＨｚ
の中間周波信号（ＩＦ）に変換され、中間周波増幅器
（ＩＦ ＡＭＰ）１５で増幅される。中間周波増幅器１
５の出力は、ＦＭ検波回路（ＦＭ ＤＥＴ）１６で検波
され、この検波出力（コンポジット信号５４）がノイズ
キャンセラ１７に入力される。ノイズキャンセラ１７
は、ＦＭ検波回路１６の検波出力からパルス状のノイズ
を除去してＦＭマルチプレクサ１８に入力する。ＦＭマ
ルチプレクサ１８は、マトリクス方式により、ノイズキ
ャンセラ１７の出力を左チャネル（Ｌ）と右チャネル
（Ｒ）のステレオ信号に分離して出力する。
ーナＩＣの概略構成を表したものである。アンテナ１１
で受信したＦＭ波は、ＦＭチューナＩＣ１０に入力さ
れ、まず高周波増幅器（ＲＦ ＡＭＰ）１２で増幅され
たのち、混合器（ＭＩＸ）１４において局部発振器
（Ｌ．ＯＳＣ）１３の出力と混合されて１０．７ＭＨｚ
の中間周波信号（ＩＦ）に変換され、中間周波増幅器
（ＩＦ ＡＭＰ）１５で増幅される。中間周波増幅器１
５の出力は、ＦＭ検波回路（ＦＭ ＤＥＴ）１６で検波
され、この検波出力（コンポジット信号５４）がノイズ
キャンセラ１７に入力される。ノイズキャンセラ１７
は、ＦＭ検波回路１６の検波出力からパルス状のノイズ
を除去してＦＭマルチプレクサ１８に入力する。ＦＭマ
ルチプレクサ１８は、マトリクス方式により、ノイズキ
ャンセラ１７の出力を左チャネル（Ｌ）と右チャネル
（Ｒ）のステレオ信号に分離して出力する。
【０００４】図５は、図２に示したＦＭ用チューナＩＣ
に用いられていた従来のノイズキャンセラを表したもの
である。このノイズキャンセラ１１７には、前段のＦＭ
検波回路１６からコンポジット信号５４が入力される。
このコンポジット信号５４は、図３に示すように、Ｌチ
ャネル信号とＲチャネル信号との和信号（Ｌ＋Ｒ）と差
信号（Ｌ−Ｒ）、及び１９ＫＨｚのパイロット信号が重
畳されたものである。具体的には、差信号（Ｌ−Ｒ）
は、３８ｋＨｚサブ信号を振幅変調した形で重畳されて
いる。
に用いられていた従来のノイズキャンセラを表したもの
である。このノイズキャンセラ１１７には、前段のＦＭ
検波回路１６からコンポジット信号５４が入力される。
このコンポジット信号５４は、図３に示すように、Ｌチ
ャネル信号とＲチャネル信号との和信号（Ｌ＋Ｒ）と差
信号（Ｌ−Ｒ）、及び１９ＫＨｚのパイロット信号が重
畳されたものである。具体的には、差信号（Ｌ−Ｒ）
は、３８ｋＨｚサブ信号を振幅変調した形で重畳されて
いる。
【０００５】コンポジット信号５４は、ハイパスフィル
タ（ＨＰＦ）３３を介してノイズ検出回路３４に入力さ
れる。ノイズ検出回路３４は、ＨＰＦ３３の出力からパ
ルスノイズを検出すると、ノイズ検出信号を出力し、単
安定マルチバイブレータ３５に供給する。単安定マルチ
バイブレータ３５は、コンデンサ２４と抵抗２５からな
る時定数回路により定まるパルス幅のゲート信号をスイ
ッチ３６に供給する。スイッチ３６は、通常状態でオン
（閉）状態であるが、ゲート信号の入力（“Ｈ”レベ
ル）期間中はオフ（開）状態となり、ゲート信号が
“Ｌ”レベルに戻ると再びオン状態に復帰するようにな
っている。
タ（ＨＰＦ）３３を介してノイズ検出回路３４に入力さ
れる。ノイズ検出回路３４は、ＨＰＦ３３の出力からパ
ルスノイズを検出すると、ノイズ検出信号を出力し、単
安定マルチバイブレータ３５に供給する。単安定マルチ
バイブレータ３５は、コンデンサ２４と抵抗２５からな
る時定数回路により定まるパルス幅のゲート信号をスイ
ッチ３６に供給する。スイッチ３６は、通常状態でオン
（閉）状態であるが、ゲート信号の入力（“Ｈ”レベ
ル）期間中はオフ（開）状態となり、ゲート信号が
“Ｌ”レベルに戻ると再びオン状態に復帰するようにな
っている。
【０００６】一方、コンポジット信号５４は、遅延回路
３１により、ＨＰＦ３３からスイッチ３６までの回路動
作による遅延時間と同じだけ遅延される。遅延回路３１
から出力された遅延信号５５は、（＋）端子と（−）端
子間にコンデンサ３７を接続した差分回路３２の（＋）
端子に入力されるとともに、図２のパイロット信号抽出
回路２１に入力される。ここで、コンデンサ３７は、実
際には２本の外部端子を介してチューナＩＣに外付けさ
れている。パイロット信号抽出回路２１は、遅延信号５
５から１９ＫＨｚのパイロット信号５７を抽出してＰＬ
Ｌ（位相ロックループ）回路２２に供給し、これを基
に、ＰＬＬ回路２２は１９ＫＨｚのパイロットキャンセ
ル信号５６や３８ＫＨｚのステレオ復調用信号５８を生
成し出力する。
３１により、ＨＰＦ３３からスイッチ３６までの回路動
作による遅延時間と同じだけ遅延される。遅延回路３１
から出力された遅延信号５５は、（＋）端子と（−）端
子間にコンデンサ３７を接続した差分回路３２の（＋）
端子に入力されるとともに、図２のパイロット信号抽出
回路２１に入力される。ここで、コンデンサ３７は、実
際には２本の外部端子を介してチューナＩＣに外付けさ
れている。パイロット信号抽出回路２１は、遅延信号５
５から１９ＫＨｚのパイロット信号５７を抽出してＰＬ
Ｌ（位相ロックループ）回路２２に供給し、これを基
に、ＰＬＬ回路２２は１９ＫＨｚのパイロットキャンセ
ル信号５６や３８ＫＨｚのステレオ復調用信号５８を生
成し出力する。
【０００７】ＰＬＬ回路２２からのステレオ復調用信号
５８はＦＭマルチプレクサ１８に供給され、和信号（Ｌ
＋Ｒ）に重畳された差信号（Ｌ−Ｒ）の分離に用いられ
る。そして、分離された和信号（Ｌ＋Ｒ）と差信号（Ｌ
−Ｒ）の和及び差を取ることにより、ステレオ信号Ｌ及
びＲが出力される。
５８はＦＭマルチプレクサ１８に供給され、和信号（Ｌ
＋Ｒ）に重畳された差信号（Ｌ−Ｒ）の分離に用いられ
る。そして、分離された和信号（Ｌ＋Ｒ）と差信号（Ｌ
−Ｒ）の和及び差を取ることにより、ステレオ信号Ｌ及
びＲが出力される。
【０００８】一方、ＰＬＬ回路２２からのパイロットキ
ャンセル信号５６は、図５に示すように、ノイズキャン
セラ１１７のバッファアンプ３９を介してスイッチ３６
の一方の端子に供給される。上述のように、スイッチ３
６はパルスノイズがないときには閉じているため、１９
ＫＨｚのパイロットキャンセル信号５６のコンポジット
信号５４中の１９ｋＨｚステレオパイロット信号と同相
で差分回路３２の（−）端子に与えられる。従って、こ
の場合には、差分回路３２の出力６０は、遅延回路３１
の出力からパイロット信号５７を除いたもの、すなわち
和信号（Ｌ＋Ｒ）と差信号（Ｌ−Ｒ）のみとなる。
ャンセル信号５６は、図５に示すように、ノイズキャン
セラ１１７のバッファアンプ３９を介してスイッチ３６
の一方の端子に供給される。上述のように、スイッチ３
６はパルスノイズがないときには閉じているため、１９
ＫＨｚのパイロットキャンセル信号５６のコンポジット
信号５４中の１９ｋＨｚステレオパイロット信号と同相
で差分回路３２の（−）端子に与えられる。従って、こ
の場合には、差分回路３２の出力６０は、遅延回路３１
の出力からパイロット信号５７を除いたもの、すなわち
和信号（Ｌ＋Ｒ）と差信号（Ｌ−Ｒ）のみとなる。
【０００９】一方、パルスノイズが検出されたときはス
イッチ３６が開き、パイロットキャンセル信号５６は差
分回路３２の（−）端子には入力されない。この場合、
差分回路３２の（−）端子は浮いた状態となるため、差
分回路３２の両端子間に接続されたコンデンサ３７の存
在により、（−）端子の電位は（＋）端子の電位の変位
量と同じだけ変化する。従って、（＋）端子にパルスノ
イズが入力されても、両端子間のレベル差はコンデンサ
３７に蓄積された直流分のみとなり、その出力はパルス
ノイズ検出直前の値ＶK を保持する。従って、遅延回路
３１の出力が例えば図４（ａ）に示す波形であるとし、
スイッチ３６のゲート開の時間をｔg とすると、差分回
路３２の出力６０の波形は図４（ｂ）のようになる。す
なわち、パイロット信号５７とともにパルスノイズ成分
も除去されることとなる。
イッチ３６が開き、パイロットキャンセル信号５６は差
分回路３２の（−）端子には入力されない。この場合、
差分回路３２の（−）端子は浮いた状態となるため、差
分回路３２の両端子間に接続されたコンデンサ３７の存
在により、（−）端子の電位は（＋）端子の電位の変位
量と同じだけ変化する。従って、（＋）端子にパルスノ
イズが入力されても、両端子間のレベル差はコンデンサ
３７に蓄積された直流分のみとなり、その出力はパルス
ノイズ検出直前の値ＶK を保持する。従って、遅延回路
３１の出力が例えば図４（ａ）に示す波形であるとし、
スイッチ３６のゲート開の時間をｔg とすると、差分回
路３２の出力６０の波形は図４（ｂ）のようになる。す
なわち、パイロット信号５７とともにパルスノイズ成分
も除去されることとなる。
【００１０】
【発明が解決しようとする課題】このように、従来のパ
ルスノイズ除去回路では、パルスノイズ検出直前のレベ
ル保持を差分回路３２の両端子間に接続したコンデンサ
３７により行っていたので、保持期間ｔg の間にコンデ
ンサ３７が放電してしまい、レベル保持を正確に行うこ
とができないという問題があった。
ルスノイズ除去回路では、パルスノイズ検出直前のレベ
ル保持を差分回路３２の両端子間に接続したコンデンサ
３７により行っていたので、保持期間ｔg の間にコンデ
ンサ３７が放電してしまい、レベル保持を正確に行うこ
とができないという問題があった。
【００１１】また、上記コンデンサは、チューナＩＣに
外付けされるため、専用の外部端子が２本必要になる。
このため、ＩＣのピン数が増加してＩＣサイズの小型化
が困難であった。また、ＩＣへのコンデンサ外付け工程
が必要なため、製作上のコストアップの要因にもなって
いた。
外付けされるため、専用の外部端子が２本必要になる。
このため、ＩＣのピン数が増加してＩＣサイズの小型化
が困難であった。また、ＩＣへのコンデンサ外付け工程
が必要なため、製作上のコストアップの要因にもなって
いた。
【００１２】この発明は、係る課題を解決するためにな
されたもので、パルスノイズ検出直前のレベル保持を正
確に行うことができるとともに、チューナＩＣに専用の
外部端子を設ける必要のないパルスノイズ除去回路を得
ることを目的とする。
されたもので、パルスノイズ検出直前のレベル保持を正
確に行うことができるとともに、チューナＩＣに専用の
外部端子を設ける必要のないパルスノイズ除去回路を得
ることを目的とする。
【００１３】
【課題を解決するための手段】この発明に係るパルスノ
イズ除去回路は、中間周波信号をＦＭ検波して得られた
コンポジット信号からパイロット信号とパルスノイズと
を除去するノイズ除去回路であって、(i) 前記コンポジ
ット信号を所定時間遅延する遅延回路と、(ii)この遅延
回路の出力とこの出力に含まれるパイロット信号に同期
したパイロットキャンセル信号との差分をとる差分回路
と、(iii) この差分回路の出力を記憶する記憶手段と、
(iv)前記コンポジット信号からパルスノイズを検出する
検出手段と、(v) この検出手段によるパルスノイズ検出
に応答して、前記記憶手段にに記憶されたデータを読み
出す読出手段と、(vi)前記検出手段によるパルスノイズ
検出に応答して、所定の時間だけ前記差分回路の出力か
ら前記読出手段の出力への切換えを行い、前記記憶手段
から読み出された前記差分回路出力値を出力する出力切
換手段と、を有することを特徴とするものである。
イズ除去回路は、中間周波信号をＦＭ検波して得られた
コンポジット信号からパイロット信号とパルスノイズと
を除去するノイズ除去回路であって、(i) 前記コンポジ
ット信号を所定時間遅延する遅延回路と、(ii)この遅延
回路の出力とこの出力に含まれるパイロット信号に同期
したパイロットキャンセル信号との差分をとる差分回路
と、(iii) この差分回路の出力を記憶する記憶手段と、
(iv)前記コンポジット信号からパルスノイズを検出する
検出手段と、(v) この検出手段によるパルスノイズ検出
に応答して、前記記憶手段にに記憶されたデータを読み
出す読出手段と、(vi)前記検出手段によるパルスノイズ
検出に応答して、所定の時間だけ前記差分回路の出力か
ら前記読出手段の出力への切換えを行い、前記記憶手段
から読み出された前記差分回路出力値を出力する出力切
換手段と、を有することを特徴とするものである。
【００１４】
【作用】この発明に係るパルスノイズ除去回路では、差
分回路の出力は、パルスノイズ非検出時にはそのまま出
力されるとともに、記憶手段に常時記憶される一方、パ
ルスノイズが検出されたときには、記憶手段からパルス
ノイズ検出直前の値が読み出されて出力される。
分回路の出力は、パルスノイズ非検出時にはそのまま出
力されるとともに、記憶手段に常時記憶される一方、パ
ルスノイズが検出されたときには、記憶手段からパルス
ノイズ検出直前の値が読み出されて出力される。
【００１５】
【実施例】以下図面に基づき本発明を詳細に説明する。
【００１６】図２は本発明の一実施例におけるノイズ除
去回路を含むチューナＩＣの概略構成を表わしたもので
ある。この図で、従来例（図５）と同一部分には同一の
符号を付し、適宜説明を省略する。
去回路を含むチューナＩＣの概略構成を表わしたもので
ある。この図で、従来例（図５）と同一部分には同一の
符号を付し、適宜説明を省略する。
【００１７】このＦＭチューナＩＣ１０の全体的動作
は、従来例の場合とほぼ同様である。すなわち、アンテ
ナ１１で受信したＦＭ波はまず高周波増幅器１２で増幅
されたのち、混合器１４において局部発振器１３の出力
と混合されて１０．７ＭＨｚの中間周波信号に変換さ
れ、さらに中間周波増幅器１５で増幅される。中間周波
増幅器１５の出力はＦＭ検波回路１６で検波され、この
検波出力がコンポジット信号５４としてノイズキャンセ
ラ１７に入力される。ノイズキャンセラ１７は、ＦＭ検
波回路１６の検波出力からパルスノイズを除去し、さら
にＦＭマルチプレクサ１８は、マトリクス方式により、
左チャネル（Ｌ）と右チャネル（Ｒ）チャネルのステレ
オ信号に分離出力する。
は、従来例の場合とほぼ同様である。すなわち、アンテ
ナ１１で受信したＦＭ波はまず高周波増幅器１２で増幅
されたのち、混合器１４において局部発振器１３の出力
と混合されて１０．７ＭＨｚの中間周波信号に変換さ
れ、さらに中間周波増幅器１５で増幅される。中間周波
増幅器１５の出力はＦＭ検波回路１６で検波され、この
検波出力がコンポジット信号５４としてノイズキャンセ
ラ１７に入力される。ノイズキャンセラ１７は、ＦＭ検
波回路１６の検波出力からパルスノイズを除去し、さら
にＦＭマルチプレクサ１８は、マトリクス方式により、
左チャネル（Ｌ）と右チャネル（Ｒ）チャネルのステレ
オ信号に分離出力する。
【００１８】図１は、図２におけるノイズキャンセラの
構成を詳細に表したものである。前段のＦＭ検波回路１
６（図１）からノイズキャンセラ１７に入力されるコン
ポジット信号５４は、図３に示したように、Ｌ，Ｒチャ
ネルの和信号（Ｌ＋Ｒ）と差信号（Ｌ−Ｒ）、及び１９
ＫＨｚのパイロット信号が重畳されたものであり、従来
例で説明したものと同じである。
構成を詳細に表したものである。前段のＦＭ検波回路１
６（図１）からノイズキャンセラ１７に入力されるコン
ポジット信号５４は、図３に示したように、Ｌ，Ｒチャ
ネルの和信号（Ｌ＋Ｒ）と差信号（Ｌ−Ｒ）、及び１９
ＫＨｚのパイロット信号が重畳されたものであり、従来
例で説明したものと同じである。
【００１９】コンポジット信号５４は、ハイパスフィル
タ（ＨＰＦ）３３を介してノイズ検出回路３４に入力さ
れる。ノイズ検出回路３４は、ハイパスフィルタ３３の
出力からパルスノイズを検出すると、ノイズ検出信号８
１を出力し、単安定マルチバイブレータ３５に供給す
る。単安定マルチバイブレータ３５は、コンデンサ２４
と抵抗２５からなる時定数回路により定まるパルス幅の
ゲート信号３８をメモリ７１のリードイネーブル端子に
供給するとともに、スイッチ７４に供給する。このスイ
ッチ７４は、ノイズパルスの非検出時には差分回路３２
の側に切り換え設定されているが、ゲート信号３８の立
ち上がりと同時にＤ／Ａコンバータ７３の側に切り換え
られ、ゲート信号の入力（“Ｈ”レベル）期間中、この
状態を保持し、ゲート信号が“Ｌ”レベルに戻ると再び
差分回路３２の側に復帰するようになっている。
タ（ＨＰＦ）３３を介してノイズ検出回路３４に入力さ
れる。ノイズ検出回路３４は、ハイパスフィルタ３３の
出力からパルスノイズを検出すると、ノイズ検出信号８
１を出力し、単安定マルチバイブレータ３５に供給す
る。単安定マルチバイブレータ３５は、コンデンサ２４
と抵抗２５からなる時定数回路により定まるパルス幅の
ゲート信号３８をメモリ７１のリードイネーブル端子に
供給するとともに、スイッチ７４に供給する。このスイ
ッチ７４は、ノイズパルスの非検出時には差分回路３２
の側に切り換え設定されているが、ゲート信号３８の立
ち上がりと同時にＤ／Ａコンバータ７３の側に切り換え
られ、ゲート信号の入力（“Ｈ”レベル）期間中、この
状態を保持し、ゲート信号が“Ｌ”レベルに戻ると再び
差分回路３２の側に復帰するようになっている。
【００２０】一方、コンポジット信号５４は、遅延回路
３１により、ＨＰＦ３３からスイッチ７４までの動作回
路による遅延時間と同じだけ遅延された遅延信号５５と
して、差分回路３２の（＋）端子に入力されるととも
に、図２のパイロット信号抽出回路２１に入力される。
パイロット信号抽出回路２１は、遅延信号５５から１９
ＫＨｚのパイロット信号５７を抽出してＰＬＬ回路２２
に供給する。ＰＬＬ回路２２からは、このパイロット信
号５７に同期したパイロットキャンセル信号５６が出力
され、ノイズキャンセラ１７のバッファアンプ３９を介
して差分回路３２の（−）端子に入力される。
３１により、ＨＰＦ３３からスイッチ７４までの動作回
路による遅延時間と同じだけ遅延された遅延信号５５と
して、差分回路３２の（＋）端子に入力されるととも
に、図２のパイロット信号抽出回路２１に入力される。
パイロット信号抽出回路２１は、遅延信号５５から１９
ＫＨｚのパイロット信号５７を抽出してＰＬＬ回路２２
に供給する。ＰＬＬ回路２２からは、このパイロット信
号５７に同期したパイロットキャンセル信号５６が出力
され、ノイズキャンセラ１７のバッファアンプ３９を介
して差分回路３２の（−）端子に入力される。
【００２１】この差分回路３２は、遅延信号５５とパイ
ロットキャンセル信号５６との差分をとってスイッチ７
４に供給するとともに、アナログディジタル（Ａ／Ｄ）
コンバータ７２に入力する。従って、差分回路３２の出
力５９は、遅延回路３１の出力からパイロット信号を除
いたもの、すなわち和信号（Ｌ＋Ｒ）と差信号（Ｌ−
Ｒ）のみとなる。Ａ／Ｄコンバータ７２は、差分回路３
２のアナログ出力５９を常時監視してディジタル値に変
換し、メモリ７１に書き込む。
ロットキャンセル信号５６との差分をとってスイッチ７
４に供給するとともに、アナログディジタル（Ａ／Ｄ）
コンバータ７２に入力する。従って、差分回路３２の出
力５９は、遅延回路３１の出力からパイロット信号を除
いたもの、すなわち和信号（Ｌ＋Ｒ）と差信号（Ｌ−
Ｒ）のみとなる。Ａ／Ｄコンバータ７２は、差分回路３
２のアナログ出力５９を常時監視してディジタル値に変
換し、メモリ７１に書き込む。
【００２２】ノイズ検出回路３４がコンポジット信号中
にパルスノイズを検出しないときには、上記したように
スイッチ７４は差分回路３２の側に切り換えられている
ため、差分回路３２の出力５９はそのまま出力６０とな
る。
にパルスノイズを検出しないときには、上記したように
スイッチ７４は差分回路３２の側に切り換えられている
ため、差分回路３２の出力５９はそのまま出力６０とな
る。
【００２３】一方、ノイズ検出回路３４がパルスノイズ
を検出したときには、単安定マルチバイブレータ３５か
らのゲート信号３８の立ち上がりのタイミングで、スイ
ッチ７２がＤ／Ａコンバータ７３の側に切り換えられる
ととともに、メモリ７１からパルスノイズ検出直前の差
分回路３２の出力５９が読み出され、Ｄ／Ａコンバータ
７３でアナログ値に変換される。このアナログ値は、も
ちろんパルスノイズを含んでおらず、スイッチ７２を介
して出力される。従って、ゲート信号３８の出力期間ｔ
g にわたって、パルスノイズ検出直前の差分回路３２の
出力が保持され、パルスノイズが除去される。しかも、
この場合の出力内容はメモリ７１からの読出値であるた
め、正確に一定値をとり、従来のようなコンデンサの放
電によるレベル低下は生じない。なお、Ｄ／Ａコンバー
タ７３の出力は、パルスノイズを検出したとき以外に発
生するようにしてもよい。その場合、スイッチ７２が差
分回路３２を選択しているので何ら問題はない。
を検出したときには、単安定マルチバイブレータ３５か
らのゲート信号３８の立ち上がりのタイミングで、スイ
ッチ７２がＤ／Ａコンバータ７３の側に切り換えられる
ととともに、メモリ７１からパルスノイズ検出直前の差
分回路３２の出力５９が読み出され、Ｄ／Ａコンバータ
７３でアナログ値に変換される。このアナログ値は、も
ちろんパルスノイズを含んでおらず、スイッチ７２を介
して出力される。従って、ゲート信号３８の出力期間ｔ
g にわたって、パルスノイズ検出直前の差分回路３２の
出力が保持され、パルスノイズが除去される。しかも、
この場合の出力内容はメモリ７１からの読出値であるた
め、正確に一定値をとり、従来のようなコンデンサの放
電によるレベル低下は生じない。なお、Ｄ／Ａコンバー
タ７３の出力は、パルスノイズを検出したとき以外に発
生するようにしてもよい。その場合、スイッチ７２が差
分回路３２を選択しているので何ら問題はない。
【００２４】なお、メモリ７１をいわゆるバイＣＭＯＳ
プロセスを用いて単一のチューナＩＣ内に形成すること
は容易であり、この場合には外付け端子を削減可能とな
るが、このメモリ７１をＩＣ外部に設けることもできる
のはもちろんである。
プロセスを用いて単一のチューナＩＣ内に形成すること
は容易であり、この場合には外付け端子を削減可能とな
るが、このメモリ７１をＩＣ外部に設けることもできる
のはもちろんである。
【００２５】
【発明の効果】以上説明したように、この発明によれ
ば、差分回路の出力を、パルスノイズ非検出時にはその
まま出力するとともに記憶手段に常時記憶しておく一
方、パルスノイズ検出時には、記憶手段からパルスノイ
ズ検出直前の値を読み出して出力することとしたので、
パルスノイズを制限している期間中にわたって、パルス
ノイズ検出直前の値を一定に保持することができる。
ば、差分回路の出力を、パルスノイズ非検出時にはその
まま出力するとともに記憶手段に常時記憶しておく一
方、パルスノイズ検出時には、記憶手段からパルスノイ
ズ検出直前の値を読み出して出力することとしたので、
パルスノイズを制限している期間中にわたって、パルス
ノイズ検出直前の値を一定に保持することができる。
【図１】本発明の一実施例におけるパルスノイズ除去回
路を示すブロック図である。
路を示すブロック図である。
【図２】一般的なＦＭチューナＩＣの概略構成を示す図
である。
である。
【図３】パルスノイズ除去回路に入力されるコンポジッ
ト信号の周波数特性を示す説明図である。
ト信号の周波数特性を示す説明図である。
【図４】パルスノイズ除去回路に入力されるコンポジッ
ト信号と、パルスノイズ除去回路からの出力信号の波形
の一例を示す説明図である。
ト信号と、パルスノイズ除去回路からの出力信号の波形
の一例を示す説明図である。
【図５】従来のパルスノイズ除去回路を示すブロック図
である。
である。
１０ ＦＭチューナＩＣ １１ アンテナ １２ 高周波増幅器 １３ 局部発振器 １４ 混合器 １５ 中間周波増幅器 １６ ＦＭ検波回路 １８ ＦＭマルチプレクサ １７ ノイズキャンセラ ２２ ＰＬＬ回路 ３１ 遅延回路 ３２ 差分回路 ３４ ノイズ検出回路 ３５ 単安定マルチバイブレータ ７１ メモリ ７２ Ａ／Ｄコンバータ ７３ Ｄ／Ａコンバータ ７４ スイッチ
Claims (1)
- 【請求項１】 中間周波信号をＦＭ検波して得られたコ
ンポジット信号からパイロット信号とパルスノイズとを
除去するノイズ除去回路であって、 前記コンポジット信号を所定時間遅延する遅延回路と、 この遅延回路の出力とこの出力に含まれるパイロット信
号に同期したパイロットキャンセル信号との差分をとる
差分回路と、 この差分回路の出力を記憶する記憶手段と、 前記コンポジット信号からパルスノイズを検出する検出
手段と、 この検出手段によるパルスノイズ検出に応答して、前記
記憶手段に記憶されたデータを読み出す読出手段と、 前記検出手段によるパルスノイズ検出に応答して、所定
の時間だけ前記差分回路の出力から前記読出手段の出力
への切換えを行い、前記記憶手段から読み出された前記
差分回路出力値を出力する出力切換手段と、 とを具備することを特徴とするパルスノイズ除去回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12895193A JPH06338812A (ja) | 1993-05-31 | 1993-05-31 | ノイズ除去回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12895193A JPH06338812A (ja) | 1993-05-31 | 1993-05-31 | ノイズ除去回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH06338812A true JPH06338812A (ja) | 1994-12-06 |
Family
ID=14997448
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP12895193A Pending JPH06338812A (ja) | 1993-05-31 | 1993-05-31 | ノイズ除去回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH06338812A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2001186032A (ja) * | 1999-11-16 | 2001-07-06 | Motorola Inc | 無線バックエンド回路 |
-
1993
- 1993-05-31 JP JP12895193A patent/JPH06338812A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2001186032A (ja) * | 1999-11-16 | 2001-07-06 | Motorola Inc | 無線バックエンド回路 |
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