JPH06350509A - 間欠無線受信機 - Google Patents
間欠無線受信機Info
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- JPH06350509A JPH06350509A JP5164177A JP16417793A JPH06350509A JP H06350509 A JPH06350509 A JP H06350509A JP 5164177 A JP5164177 A JP 5164177A JP 16417793 A JP16417793 A JP 16417793A JP H06350509 A JPH06350509 A JP H06350509A
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- JP
- Japan
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- pll circuit
- intermittent
- time
- radio receiver
- pll
- Prior art date
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- Y02—TECHNOLOGIES OR APPLICATIONS FOR MITIGATION OR ADAPTATION AGAINST CLIMATE CHANGE
- Y02D—CLIMATE CHANGE MITIGATION TECHNOLOGIES IN INFORMATION AND COMMUNICATION TECHNOLOGIES [ICT], I.E. INFORMATION AND COMMUNICATION TECHNOLOGIES AIMING AT THE REDUCTION OF THEIR OWN ENERGY USE
- Y02D30/00—Reducing energy consumption in communication networks
- Y02D30/70—Reducing energy consumption in communication networks in wireless communication networks
Landscapes
- Mobile Radio Communication Systems (AREA)
Abstract
(57)【要約】
【目的】 本発明は、ＰＬＬ方式を利用した間欠受信方
法においてバッテリーセービング効率を低下させない間
欠無線受信機を提供することを目的とする。 【構成】 デコーダ部１５は、ＰＬＬ回路３１内の設定
周波数値を制御する制御信号Ｃｌｏｃｋ、Ｄａｔａ、Ｌ
ＥをＰＬＬ回路３１に出力するとともに、ＰＬＬ回路３
１における間欠動作タイミングを制御する制御信号ＰＳ
をＰＬＬ回路３１及びタイマー３３に出力する。また、
デコーダ部１５は、予めデコーダ部１５内に設定されて
いる余裕時間Ｔp0と余裕時間ｔ及びタイマー３３から入
力される測定時間データにより制御信号ＰＳを“Ｈｉ”
にするタイミングを制御し、ＰＬＬ回路３１の動作開始
タイミングを制御する。
法においてバッテリーセービング効率を低下させない間
欠無線受信機を提供することを目的とする。 【構成】 デコーダ部１５は、ＰＬＬ回路３１内の設定
周波数値を制御する制御信号Ｃｌｏｃｋ、Ｄａｔａ、Ｌ
ＥをＰＬＬ回路３１に出力するとともに、ＰＬＬ回路３
１における間欠動作タイミングを制御する制御信号ＰＳ
をＰＬＬ回路３１及びタイマー３３に出力する。また、
デコーダ部１５は、予めデコーダ部１５内に設定されて
いる余裕時間Ｔp0と余裕時間ｔ及びタイマー３３から入
力される測定時間データにより制御信号ＰＳを“Ｈｉ”
にするタイミングを制御し、ＰＬＬ回路３１の動作開始
タイミングを制御する。
Description
【０００１】
【産業上の利用分野】本発明は、間欠無線受信機に係
り、詳細には、ＰＬＬ方式により間欠受信する間欠無線
受信機に関する。
り、詳細には、ＰＬＬ方式により間欠受信する間欠無線
受信機に関する。
【０００２】
【従来の技術】従来のページャー等の間欠無線受信機で
は、ＰＬＬ（Phase Locked Loop ）方式によって受信す
る無線信号の周波数を制御するものがあり、例えば、図
５に示すようなＰＬＬ制御系の回路構成を持つものがあ
る。
は、ＰＬＬ（Phase Locked Loop ）方式によって受信す
る無線信号の周波数を制御するものがあり、例えば、図
５に示すようなＰＬＬ制御系の回路構成を持つものがあ
る。
【０００３】図５において、１はＰＬＬ回路であり、Ｖ
ＣＯ（Voltage Controlled Oscill-ator）回路２からの
周波数出力をｆin端子に入力し、設定した周波数値と比
較した結果に基づいてｏｕｔ端子よりＶＣＯ回路２に対
して制御電圧を出力することにより、一定の周波数信号
を出力するように制御する。また、ＰＬＬ回路１におけ
るＬＤ端子は、ＰＬＬ回路１内に入力されるＶＣＯ周波
数が設定値に達したことを外部に知らせるための端子
（達したとき“Ｈｉ”、達しないとき“Ｌｏｗ”）であ
る。図５において、ＰＬＬ回路１及びＶＣＯ回路２はシ
ンセサイザ３を構成する。
ＣＯ（Voltage Controlled Oscill-ator）回路２からの
周波数出力をｆin端子に入力し、設定した周波数値と比
較した結果に基づいてｏｕｔ端子よりＶＣＯ回路２に対
して制御電圧を出力することにより、一定の周波数信号
を出力するように制御する。また、ＰＬＬ回路１におけ
るＬＤ端子は、ＰＬＬ回路１内に入力されるＶＣＯ周波
数が設定値に達したことを外部に知らせるための端子
（達したとき“Ｈｉ”、達しないとき“Ｌｏｗ”）であ
る。図５において、ＰＬＬ回路１及びＶＣＯ回路２はシ
ンセサイザ３を構成する。
【０００４】４はＰＬＬ回路１の発振周波数を制御する
デコーダ部であり、ＰＬＬ回路１における周波数設定値
を制御する制御信号Ｃｌｏｃｋ、Ｄａｔａ、ＬＥをＰＬ
Ｌ回路１に出力するとともに、ＰＬＬ回路１における間
欠動作タイミングを制御する制御信号ＰＳをＰＬＬ回路
１に出力する。ここでは、制御信号ＰＳが“Ｈｉ”のと
き、ＰＬＬ動作を開始し、“Ｌｏｗ”のとき、ＰＬＬ動
作を停止する。
デコーダ部であり、ＰＬＬ回路１における周波数設定値
を制御する制御信号Ｃｌｏｃｋ、Ｄａｔａ、ＬＥをＰＬ
Ｌ回路１に出力するとともに、ＰＬＬ回路１における間
欠動作タイミングを制御する制御信号ＰＳをＰＬＬ回路
１に出力する。ここでは、制御信号ＰＳが“Ｈｉ”のと
き、ＰＬＬ動作を開始し、“Ｌｏｗ”のとき、ＰＬＬ動
作を停止する。
【０００５】この図５のＰＬＬ制御系における間欠受信
時のＰＬＬ制御のタイミングチャートを図６に示す。
時のＰＬＬ制御のタイミングチャートを図６に示す。
【０００６】図６において、データ（ａ）は、送信機
（局）から連続的に送信されているが、いま、例えば、
図中斜線で示す部分のデータが受信すべきデータだとす
れば、デコーダ４は、ＰＬＬ回路１の立ち上がり時間を
考慮して予め設定した余裕時間Ｔp だけデータを受信す
るタイミングの前に制御信号ＰＳを“Ｈｉ”として、Ｐ
ＬＬ回路１を作動させる（同図（ｂ）参照）。ＰＬＬ回
路１内に入力されるＶＣＯ周波数が設定周波数に達する
までの時間は、同図（ｃ）に示すように、制御信号ＰＳ
が“Ｈｉ”になってからＴo 時間後である。
（局）から連続的に送信されているが、いま、例えば、
図中斜線で示す部分のデータが受信すべきデータだとす
れば、デコーダ４は、ＰＬＬ回路１の立ち上がり時間を
考慮して予め設定した余裕時間Ｔp だけデータを受信す
るタイミングの前に制御信号ＰＳを“Ｈｉ”として、Ｐ
ＬＬ回路１を作動させる（同図（ｂ）参照）。ＰＬＬ回
路１内に入力されるＶＣＯ周波数が設定周波数に達する
までの時間は、同図（ｃ）に示すように、制御信号ＰＳ
が“Ｈｉ”になってからＴo 時間後である。
【０００７】このため、余裕時間Ｔp は、“Ｔp ＞Ｔo
”となるように設定されている。
”となるように設定されている。
【０００８】
【発明が解決しようとする課題】しかしながら、このよ
うな従来のＰＬＬ制御方式を利用して無線信号の受信周
波数を制御する間欠無線受信機にあっては、上記ＰＬＬ
回路１内に入力されるＶＣＯ周波数が設定周波数に達す
るまでの時間Ｔo は、周囲温度、電源電圧の変化により
変化するものであるため、上記余裕時間Ｔp は、考えら
れる使用環境条件内で最大のＴo に対して“Ｔp ＞Ｔo
”となるように設定しなければならず、通常の使用環
境では、本来必要のないほど長い余裕時間Ｔp を設定す
ることになり、そのため、Ｔp −Ｔo ＝ΔＴが大きくな
ってしまい、ページャー等の間欠無線受信機では間欠受
信によるバッテリーセービング効率の低下を招き、電池
寿命が短くなるという問題点があった。
うな従来のＰＬＬ制御方式を利用して無線信号の受信周
波数を制御する間欠無線受信機にあっては、上記ＰＬＬ
回路１内に入力されるＶＣＯ周波数が設定周波数に達す
るまでの時間Ｔo は、周囲温度、電源電圧の変化により
変化するものであるため、上記余裕時間Ｔp は、考えら
れる使用環境条件内で最大のＴo に対して“Ｔp ＞Ｔo
”となるように設定しなければならず、通常の使用環
境では、本来必要のないほど長い余裕時間Ｔp を設定す
ることになり、そのため、Ｔp −Ｔo ＝ΔＴが大きくな
ってしまい、ページャー等の間欠無線受信機では間欠受
信によるバッテリーセービング効率の低下を招き、電池
寿命が短くなるという問題点があった。
【０００９】本発明の課題は、ＰＬＬ方式を利用した間
欠受信方法においてバッテリーセービング効率を低下さ
せないようにすることである。
欠受信方法においてバッテリーセービング効率を低下さ
せないようにすることである。
【００１０】
【課題を解決するための手段】本発明の手段は次の通り
である。
である。
【００１１】本発明は、位相ロックループ回路によって
必要な発振信号を得る間欠無線受信機において、上記位
相ロックループ回路の立ち上がり時間を測定する測定手
段と、この測定手段により測定された立ち上がり時間と
予め設定した余裕時間とを加算した時間だけ受信タイミ
ングよりも早く上記位相ロックループ回路を動作させる
間欠信号を当該位相ロックループ回路に出力する制御手
段と、を具備したことを特徴としている。
必要な発振信号を得る間欠無線受信機において、上記位
相ロックループ回路の立ち上がり時間を測定する測定手
段と、この測定手段により測定された立ち上がり時間と
予め設定した余裕時間とを加算した時間だけ受信タイミ
ングよりも早く上記位相ロックループ回路を動作させる
間欠信号を当該位相ロックループ回路に出力する制御手
段と、を具備したことを特徴としている。
【００１２】
【作用】本発明の手段の作用は次の通りである。
【００１３】本発明によれば、位相ロックループ回路に
よって必要な発振信号を得る間欠無線受信機において、
上記位相ロックループ回路の立ち上がり時間が測定手段
により測定され、制御手段により、この測定手段により
測定された立ち上がり時間と予め設定した余裕時間とを
加算した時間だけ受信タイミングよりも早く上記位相ロ
ックループ回路を動作させる間欠信号が当該位相ロック
ループ回路に出力される。
よって必要な発振信号を得る間欠無線受信機において、
上記位相ロックループ回路の立ち上がり時間が測定手段
により測定され、制御手段により、この測定手段により
測定された立ち上がり時間と予め設定した余裕時間とを
加算した時間だけ受信タイミングよりも早く上記位相ロ
ックループ回路を動作させる間欠信号が当該位相ロック
ループ回路に出力される。
【００１４】したがって、間欠無線受信機における各受
信タイミングの不要動作時間を短縮することができ、間
欠無線受信機のバッテリーセービング効率を高めること
ができる。その結果、ページャー等に利用することによ
りバッテリーの長寿命化を図ることができる。
信タイミングの不要動作時間を短縮することができ、間
欠無線受信機のバッテリーセービング効率を高めること
ができる。その結果、ページャー等に利用することによ
りバッテリーの長寿命化を図ることができる。
【００１５】
【実施例】以下、図１〜図４を参照して実施例を説明す
る。
る。
【００１６】図１〜図４は、本発明の間欠無線受信機を
適用したページャーの一実施例を示す図である。
適用したページャーの一実施例を示す図である。
【００１７】まず、構成を説明する。図１は、ページャ
ーのブロック構成図である。この図において、ページャ
ーは、アンテナ１１、受信部１２、シンセサイザ１３、
復調部１４、デコーダ部１５、ＩＤ−ＲＯＭ１６、報音
部１７、制御部１８、ＲＯＭ１９、ＲＡＭ２０、キー入
力部２１、ＬＣＤドライバ２２及びＬＣＤ２３により構
成される。
ーのブロック構成図である。この図において、ページャ
ーは、アンテナ１１、受信部１２、シンセサイザ１３、
復調部１４、デコーダ部１５、ＩＤ−ＲＯＭ１６、報音
部１７、制御部１８、ＲＯＭ１９、ＲＡＭ２０、キー入
力部２１、ＬＣＤドライバ２２及びＬＣＤ２３により構
成される。
【００１８】アンテナ１１は、図外のページャーサービ
ス会社等から無線で送信される呼出信号を受信して受信
部１２に出力する。受信部１２は、アンテナ１１から入
力される呼出信号を間欠受信し、受信信号を増幅して復
調部１４に出力する。なお、受信信号は、シンセサイザ
１３から入力される発振周波数により周波数ダウンさせ
られる。
ス会社等から無線で送信される呼出信号を受信して受信
部１２に出力する。受信部１２は、アンテナ１１から入
力される呼出信号を間欠受信し、受信信号を増幅して復
調部１４に出力する。なお、受信信号は、シンセサイザ
１３から入力される発振周波数により周波数ダウンさせ
られる。
【００１９】復調部１４は、受信部１３により増幅され
て入力される受信信号を復調してデコーダ部１５に出力
する。
て入力される受信信号を復調してデコーダ部１５に出力
する。
【００２０】シンセサイザ１３は、図２示すように、Ｐ
ＬＬ回路３１、ＶＣＯ回路３２及びタイマー３３とによ
り構成され、デコーダ部１５に接続されている。
ＬＬ回路３１、ＶＣＯ回路３２及びタイマー３３とによ
り構成され、デコーダ部１５に接続されている。
【００２１】デコーダ部１５は、ＰＬＬ回路３１内の設
定周波数値を制御する制御信号Ｃｌｏｃｋ、Ｄａｔａ、
ＬＥをＰＬＬ回路３１に出力するとともに、ＰＬＬ回路
３１における間欠動作タイミングを制御する制御信号Ｐ
ＳをＰＬＬ回路３１及びタイマー３３に出力する。ま
た、デコーダ部１５は、予めデコーダ部１５内に設定さ
れている余裕時間Ｔp0と余裕時間ｔ及びタイマー３３か
ら入力される測定時間データにより制御信号ＰＳを“Ｈ
ｉ”にするタイミングを制御し、ＰＬＬ回路３１の動作
開始タイミングを制御する。
定周波数値を制御する制御信号Ｃｌｏｃｋ、Ｄａｔａ、
ＬＥをＰＬＬ回路３１に出力するとともに、ＰＬＬ回路
３１における間欠動作タイミングを制御する制御信号Ｐ
ＳをＰＬＬ回路３１及びタイマー３３に出力する。ま
た、デコーダ部１５は、予めデコーダ部１５内に設定さ
れている余裕時間Ｔp0と余裕時間ｔ及びタイマー３３か
ら入力される測定時間データにより制御信号ＰＳを“Ｈ
ｉ”にするタイミングを制御し、ＰＬＬ回路３１の動作
開始タイミングを制御する。
【００２２】ＰＬＬ回路３１は、デコーダ部１５から入
力される設定周波数値を制御する制御信号Ｃｌｏｃｋ、
Ｄａｔａ、ＬＥによりＰＬＬ動作が制御されるととも
に、デコーダ部１５から入力される制御信号ＰＳにより
間欠動作タイミングが制御される。ＰＬＬ回路３１は、
デコーダ部１１から入力される制御信号ＰＳが、“Ｈ
ｉ”になるタイミングでＰＬＬ動作を開始し、ＶＣＯ回
路３２からｆin端子に入力される周波数出力と設定され
た周波数値とを比較した結果に基づいてｏｕｔ端子より
ＶＣＯ回路３２に対して制御電圧を出力することによ
り、一定の周波数信号を出力するように制御する。ま
た、ＰＬＬ回路３１は、ＰＬＬ回路３１内のＶＣＯ周波
数が設定値に達したことを示す信号ＬＤをＬＤ端子から
タイマー３３及びデコーダ部１５に出力する。
力される設定周波数値を制御する制御信号Ｃｌｏｃｋ、
Ｄａｔａ、ＬＥによりＰＬＬ動作が制御されるととも
に、デコーダ部１５から入力される制御信号ＰＳにより
間欠動作タイミングが制御される。ＰＬＬ回路３１は、
デコーダ部１１から入力される制御信号ＰＳが、“Ｈ
ｉ”になるタイミングでＰＬＬ動作を開始し、ＶＣＯ回
路３２からｆin端子に入力される周波数出力と設定され
た周波数値とを比較した結果に基づいてｏｕｔ端子より
ＶＣＯ回路３２に対して制御電圧を出力することによ
り、一定の周波数信号を出力するように制御する。ま
た、ＰＬＬ回路３１は、ＰＬＬ回路３１内のＶＣＯ周波
数が設定値に達したことを示す信号ＬＤをＬＤ端子から
タイマー３３及びデコーダ部１５に出力する。
【００２３】ＶＣＯ回路３２は、ＰＬＬ回路３１から入
力される電圧制御信号により設定周波数の発振信号を後
段の処理回路に出力する。
力される電圧制御信号により設定周波数の発振信号を後
段の処理回路に出力する。
【００２４】タイマー３３は、デコーダ部１５から入力
される制御信号ＰＳが“Ｈｉ”になったときからＰＬＬ
回路３１から信号ＬＤが入力されるまでの時間、すなわ
ち、ＰＬＬ動作開始からＶＣＯ周波数が設定値に達する
までの時間を測定し、その測定時間データをデコーダ部
１５に出力する。
される制御信号ＰＳが“Ｈｉ”になったときからＰＬＬ
回路３１から信号ＬＤが入力されるまでの時間、すなわ
ち、ＰＬＬ動作開始からＶＣＯ周波数が設定値に達する
までの時間を測定し、その測定時間データをデコーダ部
１５に出力する。
【００２５】また、図１において、デコーダ部１５は、
復調部１４から入力される呼出信号の呼出番号が自己の
認識番号と一致するか否かを、予め認識番号を登録して
あるＩＤ−ＲＯＭ６を参照して判断し、一致していれば
信号受信を継続し、制御部１８に呼出検出信号を出力す
るとともに、報音部１７に報音信号を出力し、報知音を
出力させて、呼出しのあったことを報知させる。また、
デコーダ部１５は、制御部１８から入力される要求に基
づいて呼出信号とともに受信したメッセージ情報を制御
部１８に出力する。
復調部１４から入力される呼出信号の呼出番号が自己の
認識番号と一致するか否かを、予め認識番号を登録して
あるＩＤ−ＲＯＭ６を参照して判断し、一致していれば
信号受信を継続し、制御部１８に呼出検出信号を出力す
るとともに、報音部１７に報音信号を出力し、報知音を
出力させて、呼出しのあったことを報知させる。また、
デコーダ部１５は、制御部１８から入力される要求に基
づいて呼出信号とともに受信したメッセージ情報を制御
部１８に出力する。
【００２６】ＩＤ−ＲＯＭ１６は、自己の認識番号を登
録するメモリエリアを形成する。
録するメモリエリアを形成する。
【００２７】報音部１７は、アンプやスピーカ等から構
成され、デコーダ部１５から入力される報音信号により
スピーカから呼出があったことを知らせる報知音を出力
する。
成され、デコーダ部１５から入力される報音信号により
スピーカから呼出があったことを知らせる報知音を出力
する。
【００２８】制御部１８は、ＣＰＵやタイマー、キー入
力部２１におけるキー入力操作データを保持する入力レ
ジスタ等から構成され、ＲＯＭ１９に格納された各種制
御プログラムとデコーダ部１５から入力される受信した
メッセージ情報やキー入力情報等を記憶するＲＡＭ２０
が接続される。
力部２１におけるキー入力操作データを保持する入力レ
ジスタ等から構成され、ＲＯＭ１９に格納された各種制
御プログラムとデコーダ部１５から入力される受信した
メッセージ情報やキー入力情報等を記憶するＲＡＭ２０
が接続される。
【００２９】制御部１８は、ＲＯＭ１９に格納されてい
る各種制御プログラムに基づいてデコーダ部１５から入
力されるメッセージ情報、キー入力部２１から入力され
る入力指示信号に応じてページャー内の各部を制御し、
受信処理により受信したメッセージ情報をＲＡＭ２０に
記憶させ、そのメッセージ情報をＲＡＭ２０から読み出
してＬＣＤドライバ２２に出力し、ＬＣＤ１３に表示さ
せる。
る各種制御プログラムに基づいてデコーダ部１５から入
力されるメッセージ情報、キー入力部２１から入力され
る入力指示信号に応じてページャー内の各部を制御し、
受信処理により受信したメッセージ情報をＲＡＭ２０に
記憶させ、そのメッセージ情報をＲＡＭ２０から読み出
してＬＣＤドライバ２２に出力し、ＬＣＤ１３に表示さ
せる。
【００３０】ＲＯＭ（Read Only Memory）１９は、制御
部１８内のＣＰＵが実行する各種制御プログラムを格納
する。
部１８内のＣＰＵが実行する各種制御プログラムを格納
する。
【００３１】ＲＡＭ（Random Accesss Memory ）２０
は、受信メッセージ情報を記憶するメモリエリアを形成
し、制御部１８との間でメッセージ情報を授受する。
は、受信メッセージ情報を記憶するメモリエリアを形成
し、制御部１８との間でメッセージ情報を授受する。
【００３２】キー入力部２１は、テンキーやモードキー
等から構成され、各キーの指示を制御部１８に出力す
る。
等から構成され、各キーの指示を制御部１８に出力す
る。
【００３３】ＬＣＤドライバ２２は、制御部１８から入
力されるメッセージ情報に基づいてそのキーキャラクタ
パターンをＬＣＤ２３に出力して表示する。
力されるメッセージ情報に基づいてそのキーキャラクタ
パターンをＬＣＤ２３に出力して表示する。
【００３４】次に、本実施例の動作を説明する。
【００３５】まず、初期状態における上記間欠無線受信
機１０内の動作を図２に示すタイミングチャートを参照
して説明する。
機１０内の動作を図２に示すタイミングチャートを参照
して説明する。
【００３６】初期状態において、図２（ａ）に斜線で示
すデータを受信する場合、デコーダ部１５では、従来と
同様に最大のＴo に対して“Ｔp0＞Ｔo ”となるように
予めデコーダ部１５内に設定されている余裕時間Ｔp0だ
け受信タイミングよりも早く制御信号ＰＳを“Ｈｉ”と
し（同図（ｂ））、ＰＬＬ回路３１の動作を開始させ
る。このとき、シンセサイザ１３内のタイマー３３で
は、デコーダ部１５から入力される制御信号ＰＳが“Ｈ
ｉ”になると同時に時間測定を開始し、ＰＬＬ回路３１
から入力される信号ＬＤにより時間測定を終了させるこ
とによって、同図（ｃ）に示す時間Ｔo0を測定し、その
測定時間データ（Ｔo0）をデコーダ部１５に出力する。
すデータを受信する場合、デコーダ部１５では、従来と
同様に最大のＴo に対して“Ｔp0＞Ｔo ”となるように
予めデコーダ部１５内に設定されている余裕時間Ｔp0だ
け受信タイミングよりも早く制御信号ＰＳを“Ｈｉ”と
し（同図（ｂ））、ＰＬＬ回路３１の動作を開始させ
る。このとき、シンセサイザ１３内のタイマー３３で
は、デコーダ部１５から入力される制御信号ＰＳが“Ｈ
ｉ”になると同時に時間測定を開始し、ＰＬＬ回路３１
から入力される信号ＬＤにより時間測定を終了させるこ
とによって、同図（ｃ）に示す時間Ｔo0を測定し、その
測定時間データ（Ｔo0）をデコーダ部１５に出力する。
【００３７】次いで、上記図３に示した初期状態から図
４に示す受信ｎタイミング目になると、デコーダ部１５
は、前回の受信タイミングでタイマー３３から入力され
た測定時間データ（Ｔo(n-1)）に予めデコーダ部１５内
に設定されてる余裕時間ｔを加算した時間Ｔp(n)（Ｔo
(n-1)＋ｔ）だけ受信タイミングよりも早く制御信号Ｐ
Ｓを“Ｈｉ”にし（同図（ｂ）参照）、ＰＬＬ回路３１
の動作を開始させる。
４に示す受信ｎタイミング目になると、デコーダ部１５
は、前回の受信タイミングでタイマー３３から入力され
た測定時間データ（Ｔo(n-1)）に予めデコーダ部１５内
に設定されてる余裕時間ｔを加算した時間Ｔp(n)（Ｔo
(n-1)＋ｔ）だけ受信タイミングよりも早く制御信号Ｐ
Ｓを“Ｈｉ”にし（同図（ｂ）参照）、ＰＬＬ回路３１
の動作を開始させる。
【００３８】ＰＬＬ回路３１おける立ち上がり時間Ｔo
の変化要因は、周囲温度や電源電圧の変化によるもので
あるため、２つの連続した受信タイミング間の時間では
立ち上がり時間Ｔo の大きな変化は生じないため、図４
で示した余裕時間ｔは、かなり小さく設定することがで
きる。
の変化要因は、周囲温度や電源電圧の変化によるもので
あるため、２つの連続した受信タイミング間の時間では
立ち上がり時間Ｔo の大きな変化は生じないため、図４
で示した余裕時間ｔは、かなり小さく設定することがで
きる。
【００３９】したがって、一つ前の受信タイミングにお
ける実測したＰＬＬ回路３１の立ち上がり時間Ｔo に基
づいて余裕時間Ｔp を設定しているため、例えば、外部
環境の変化により時間経過とともに立ち上がり時間Ｔo
が増加していくような状況では、各受信タイミング毎に
“Ｔp(n)＞Ｔp(n-1)”となり、すなわち、立ち上がり時
間Ｔo の関係が、“Ｔo(n)＞Ｔo(n-1)”となり、常に、
“Ｔp(n)−Ｔo(n)＝ｔ±α”のみの不要動作時間だけで
ＰＬＬ回路３１を動作させることができる。
ける実測したＰＬＬ回路３１の立ち上がり時間Ｔo に基
づいて余裕時間Ｔp を設定しているため、例えば、外部
環境の変化により時間経過とともに立ち上がり時間Ｔo
が増加していくような状況では、各受信タイミング毎に
“Ｔp(n)＞Ｔp(n-1)”となり、すなわち、立ち上がり時
間Ｔo の関係が、“Ｔo(n)＞Ｔo(n-1)”となり、常に、
“Ｔp(n)−Ｔo(n)＝ｔ±α”のみの不要動作時間だけで
ＰＬＬ回路３１を動作させることができる。
【００４０】その結果、間欠無線受信機における各受信
タイミングの不要動作時間を短縮することができ、バッ
テリーセービング効率を高めることができ、ページャー
等に内蔵されるバッテリーの長寿命化を図ることができ
る。
タイミングの不要動作時間を短縮することができ、バッ
テリーセービング効率を高めることができ、ページャー
等に内蔵されるバッテリーの長寿命化を図ることができ
る。
【００４１】
【発明の効果】本発明によれば、間欠無線受信機におけ
る各受信タイミングの不要動作時間を短縮することがで
き、間欠無線受信機のバッテリーセービング効率を高め
ることができる。その結果、ページャー等に利用するこ
とによりバッテリーの長寿命化を図ることができる。
る各受信タイミングの不要動作時間を短縮することがで
き、間欠無線受信機のバッテリーセービング効率を高め
ることができる。その結果、ページャー等に利用するこ
とによりバッテリーの長寿命化を図ることができる。
【図１】本発明の間欠無線受信機を適用したページャー
のブロック構成図。
のブロック構成図。
【図２】図１のシンセサイザのブロック構成図。
【図３】初期状態における図１の間欠無線受信機内の各
部信号のタイミングチャート。
部信号のタイミングチャート。
【図４】初期状態後のにおける図１の間欠無線受信機内
の各部信号のタイミングチャート。
の各部信号のタイミングチャート。
【図５】従来の間欠無線受信機の要部ブロック構成図。
【図６】図４の間欠無線受信機内の各部信号のタイミン
グチャート。
グチャート。
１１ アンテナ １２ 受信部 １３ シンセサイザ １４ 復調部 １５ デコーダ部 １６ ＩＤ−ＲＯＭ １７ 報音部 １８ 制御部 １９ ＲＯＭ ２０ ＲＡＭ ２１ キー入力部 ２２ ＬＣＤドライバ ２３ ＬＣＤ ３１ ＰＬＬ回路 ３２ ＶＣＯ回路 ３３ タイマー
Claims (1)
- 【請求項１】 位相ロックループ回路によって必要な発
振周波数信号を得る間欠無線受信機において、 上記位相ロックループ回路の立ち上がり時間を測定する
測定手段と、 この測定手段により測定された立ち上がり時間と予め設
定した余裕時間とを加算した時間だけ受信タイミングよ
りも早く上記位相ロックループ回路を動作させる間欠信
号を当該位相ロックループ回路に出力する制御手段と、 を具備したことを特徴とする間欠無線受信機。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5164177A JPH06350509A (ja) | 1993-06-07 | 1993-06-07 | 間欠無線受信機 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5164177A JPH06350509A (ja) | 1993-06-07 | 1993-06-07 | 間欠無線受信機 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH06350509A true JPH06350509A (ja) | 1994-12-22 |
Family
ID=15788187
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5164177A Pending JPH06350509A (ja) | 1993-06-07 | 1993-06-07 | 間欠無線受信機 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH06350509A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5778311A (en) * | 1995-06-30 | 1998-07-07 | Matsushita Electric Industrial Co., Ltd. | Intermittent operation receiver with variable pre-heat time for its phase-locked circuit |
| JP2009532999A (ja) * | 2006-04-04 | 2009-09-10 | クゥアルコム・インコーポレイテッド | 通信デバイスにおけるウェイクアップ時間を設定するための装置および方法 |
-
1993
- 1993-06-07 JP JP5164177A patent/JPH06350509A/ja active Pending
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5778311A (en) * | 1995-06-30 | 1998-07-07 | Matsushita Electric Industrial Co., Ltd. | Intermittent operation receiver with variable pre-heat time for its phase-locked circuit |
| JP2009532999A (ja) * | 2006-04-04 | 2009-09-10 | クゥアルコム・インコーポレイテッド | 通信デバイスにおけるウェイクアップ時間を設定するための装置および方法 |
| US8041972B2 (en) | 2006-04-04 | 2011-10-18 | Qualcomm Incorporated | Apparatus and method for setting wakeup times in a communication device based on estimated lock on time of frequency synthesizer |
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