JPH065982B2 - Switchgear - Google Patents
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- JPH065982B2 JPH065982B2 JP59094493A JP9449384A JPH065982B2 JP H065982 B2 JPH065982 B2 JP H065982B2 JP 59094493 A JP59094493 A JP 59094493A JP 9449384 A JP9449384 A JP 9449384A JP H065982 B2 JPH065982 B2 JP H065982B2
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- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
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- H03K17/13—Modifications for switching at zero crossing
- H03K17/136—Modifications for switching at zero crossing in thyristor switches
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- H—ELECTRICITY
- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
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- H02H9/00—Emergency protective circuit arrangements for limiting excess current or voltage without disconnection
- H02H9/001—Emergency protective circuit arrangements for limiting excess current or voltage without disconnection limiting speed of change of electric quantities, e.g. soft switching on or off
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- Driving Mechanisms And Operating Circuits Of Arc-Extinguishing High-Tension Switches (AREA)
Description
【発明の詳細な説明】 〔発明の技術分野〕 この発明は開閉装置、特に交流負荷に対する交流電流を
半導体スイッチを用いて断続制御する開閉装置に関する
ものである。Description: TECHNICAL FIELD The present invention relates to a switchgear, and more particularly to a switchgear for intermittently controlling an alternating current with respect to an alternating current load using a semiconductor switch.
第1図は、例えば雑誌「電気計算」(昭和44年10月
号)のP258の第11図に記載されている、機械的開
閉器を用いた従来の無効電力制御用のコンデンサ開閉装
置の回路図であり、図において、1は交流電源母線、2
a〜2cは開閉器、3a〜3cはそれぞれ開閉器2a〜
2cを介して前記交流電源母線1に接続した交流負荷と
してのコンデンサである。FIG. 1 is a circuit diagram of a conventional capacitor switchgear for reactive power control using a mechanical switch, for example, as shown in FIG. 11 of P258 of the magazine “Electrical Computing” (October 1969 issue). In the figure, 1 is an AC power supply bus bar, 2
a to 2c are switches, 3a to 3c are switches 2a to
A capacitor as an AC load connected to the AC power source bus 1 via 2c.
次に動作について説明する。第1図において交流電源母
線1の力率が低下してくると、開閉器2a〜2cを順次
にONにして、力率の程度に応じてコンデンサ3a〜3
cを投入する。この場合、開閉器2a〜2cの投入位相
によつては定格電流の6〜10倍の突入電流が流れるた
め、交流電源母線1の電圧が大きく歪み同一母線に接続
されている他の機器(例えばサイリスタ変換装置等)に
悪影響を及ぼす。従つて、コンデンサの単位バンク容量
をあまり大きくすることができず、その結果、コンデン
サバンク数が増加するため、配置スペースが大きくな
り、価格も高くなるという問題があつた。又、開閉頻度
が多い場合は、コンデンサ開閉時の過渡現象のため開閉
器2a〜2cやコンデンサ3a〜3cの寿命低下を生じ
るという問題があつた。Next, the operation will be described. In FIG. 1, when the power factor of the AC power bus 1 decreases, the switches 2a to 2c are sequentially turned on, and the capacitors 3a to 3 are turned on according to the degree of the power factor.
Input c. In this case, since a rush current of 6 to 10 times the rated current flows depending on the closing phase of the switches 2a to 2c, the voltage of the AC power bus 1 is largely distorted and other devices connected to the same bus (for example, Thyristor converter, etc.) is adversely affected. Therefore, the unit bank capacity of the capacitor cannot be increased so much, and as a result, the number of capacitor banks increases, resulting in a large arrangement space and a high price. Further, when the switching frequency is high, there is a problem that the life of the switches 2a to 2c and the capacitors 3a to 3c is shortened due to a transient phenomenon when the capacitors are opened and closed.
このため、開閉頻度の多い用途には第2図に示すよう
に、前記第1図の開閉器3a〜3cの代りにサイリスタ
の逆並列回路で構成されたサイリスタスイツチ4a〜4
cを用いて、コンデンサ3a〜3cの回路を開閉するコ
ンデンサ開閉装置(例えば特公昭50−40218号公
報に開示されている)が適用されている。For this reason, as shown in FIG. 2, for applications with a high switching frequency, instead of the switches 3a to 3c shown in FIG. 1, thyristor switches 4a to 4 composed of antiparallel circuits of thyristors are used.
A capacitor switching device (for example, disclosed in Japanese Patent Publication No. 50-40218) that opens and closes the circuits of the capacitors 3a to 3c by using c is applied.
第3図は前記第2図のサイリスタスイツチ4を用いて、
コンデンサ3を開閉する場合の基本回路図を示してい
る。FIG. 3 uses the thyristor switch 4 shown in FIG.
The basic circuit diagram when opening and closing the capacitor 3 is shown.
次に上記基本回路の動作を第4図の波形図について説明
する。第4図は時刻t1以前、サイリスタスイツチはO
FFになつている状態を示しており、第4図(b)に示す
ようにサイリスタスイツチ4には第4図(a)に示す交流
電源電圧に等しい電圧Eが印加されている。Next, the operation of the basic circuit will be described with reference to the waveform chart of FIG. FIG. 4 shows that the thyristor switch is O before time t 1 .
The state of being in the FF state is shown. As shown in FIG. 4 (b), the voltage E equal to the AC power supply voltage shown in FIG. 4 (a) is applied to the thyristor switch 4.
負荷のコンデンサ3を投入する場合は投入時の投入電流
を緩和するため、サイリスタスイツチ4はその両端電圧
が0になる時に同期してONにするように、不図示の制
御回路から出力された制御信号によつて制御される。即
ち第4図においては、時刻t1にサイリスタスイツチ4
はONになる。この場合、コンデンサには第4図(c)に
示す電流が流れる。When the load capacitor 3 is turned on, the thyristor switch 4 is turned on in synchronism when the voltage across the thyristor switch 4 becomes 0 in order to reduce the input current at the time of turning on the control output from a control circuit (not shown). It is controlled by a signal. That is, in FIG. 4, at time t 1 , the thyristor switch 4
Turns on. In this case, the current shown in FIG. 4 (c) flows through the capacitor.
次にサイリスタスイツチ4をOFFにする場合に該サイ
リスタへのゲート点弧信号をOFFにすれば良く、第4
図(c)に示すように時刻t2において、コンデンサ電流
が0になつた時点でサイリスタスイツチはOFFにな
る。この時刻t2は電源電圧Eのピーク位相に一致して
おり、従つてコンデンサ3は時刻t2において電源電圧
のピーク値E迄充電されている。Next, when the thyristor switch 4 is turned off, the gate ignition signal to the thyristor may be turned off.
As shown in FIG. 6C, at time t 2 , the thyristor switch is turned off when the capacitor current reaches 0. This time t 2 coincides with the peak phase of the power supply voltage E, and accordingly, the capacitor 3 is charged to the peak value E of the power supply voltage at time t 2 .
上記のように時刻t2でサイリスタスイツチがOFFに
なると、コンデンサ3には電圧Eが充電されたままにな
つているため、コンデンサ電圧Eに交流電圧源1の電圧
が重畳され、第4図(b)の時刻t2以降に示すようにサ
イリスタスイツチ2には2Eの電圧が印加されることに
なる。このため、サイリスタ素子としては少なくとも2
E〜3Eの耐圧が必要となる。When the thyristor switch is turned off at time t 2 as described above, the voltage E of the AC voltage source 1 is superimposed on the capacitor voltage E because the voltage E remains charged in the capacitor 3, and the voltage of the AC voltage source 1 is superimposed on the capacitor voltage E, as shown in FIG. A voltage of 2E is applied to the thyristor switch 2 as shown after time t 2 in b). Therefore, as a thyristor element, at least 2
A breakdown voltage of E to 3E is required.
一方、コンデンサ3を投入している期間はサイリスタス
イツチ4がONになりつぱなしであり、サイリスタ4の
順電圧降下による電気損失が大きく効率の低下を招くと
共に大きな冷却装置を必要とし、装置が高価となる。On the other hand, the thyristor switch 4 is kept ON during the period in which the capacitor 3 is turned on, which causes a large electric loss due to the forward voltage drop of the thyristor 4, resulting in a reduction in efficiency and a large cooling device, which makes the device expensive. Becomes
従来のコンデンサ開閉装置は以上のように構成されてい
るので、第1図の機械的開閉器の場合には、開閉頻度の
多い所には使用できず、又、コンデンサ投入時の突入電
流による電源電圧歪の関係からコンデンサバンクの単位
容量を大きくできないという欠点があつた。又、第2図
のサイリスタスイツチを用いた場合には、サイリスタの
順電圧降下により電気損失が大きくなると共にコンデン
サバンク毎にサイリスタスイツチが必要であるため装置
が高価であるという欠点があつた。Since the conventional capacitor switchgear is configured as described above, the mechanical switch of FIG. 1 cannot be used in places with frequent switching, and the power supply due to the inrush current when the capacitor is turned on is used. Due to voltage distortion, the unit capacity of the capacitor bank cannot be increased. Further, when the thyristor switch shown in FIG. 2 is used, there is a drawback that the forward voltage drop of the thyristor causes a large electric loss and a thyristor switch is required for each capacitor bank, which makes the device expensive.
この発明は上記のような従来のものの欠点を除去するた
めになされたもので、コンデンサをサイリスタスイツチ
で電源に投入した後は開閉器でサイリスタスイツチをバ
イパスするようにし、更に複数バンクのコンデンサに対
して1つのサイリスタスイツチで対応できるようにする
ことにより、電気損失の少い小形かつ安価なコンデンサ
開閉装置を提供するものである。また、前記サイリスタ
スイツチに並列に非線形抵抗素子を接続することによ
り、過電圧を抑制することのできるコンデンサ開閉装置
を提供するものである。The present invention has been made to eliminate the above-mentioned drawbacks of the conventional ones.After the capacitor is turned on by the thyristor switch, the thyristor switch is bypassed by a switch, and further By providing a single thyristor switch, it is possible to provide a compact and inexpensive capacitor switchgear with little electric loss. The present invention also provides a capacitor switching device capable of suppressing overvoltage by connecting a non-linear resistance element in parallel with the thyristor switch.
以下、この発明の第1実施例を前記第1図と同一部分に
同一符号を付した第5図について説明する。第5図にお
いて、5は複数のコンデンサバンク3a〜3cに対し共
通に使用するサイリスタスイツチ、6a〜6cはサイリ
スタスイツチ4の負荷側端と各コンデンサ3a〜3cの
電源側端との間に設けたサイリスタスイツチ切替え用の
開閉器である。A first embodiment of the present invention will be described below with reference to FIG. 5 in which the same parts as those in FIG. In FIG. 5, 5 is a thyristor switch commonly used for a plurality of capacitor banks 3a to 3c, and 6a to 6c are provided between the load side end of the thyristor switch 4 and the power source side ends of the capacitors 3a to 3c. This is a switch for switching the thyristor switch.
この発明の第1実施例は上記の構成からなるもので、以
下、その動作を第7図の波形図について説明する。第5
図においてコンデンサバンク3a〜3cが電源1から切
離されている状態では、開閉器2a〜2c及び6a〜6
cは全てOFFになつており、又、サイリスタスイツチ
5もOFFになつている。The first embodiment of the present invention has the above-mentioned configuration, and its operation will be described below with reference to the waveform chart of FIG. Fifth
In the figure, when the capacitor banks 3a to 3c are disconnected from the power source 1, the switches 2a to 2c and 6a to 6 are shown.
All c are turned off, and the thyristor switch 5 is also turned off.
コンデンサバンク3aを交流電圧線1に投入する場合
は、まず第7図(b)に示すようにサイリスタスチツチ5
をOFFにしたままで時刻t1に開閉器6aをONにす
る。この場合、第7図(d)に示すようにサイリスタスチ
ツチ5には電源電圧Eに等しい電圧が印加され、更に時
刻t2において、サイリスタスイツチに印加される電圧
が0になつた時に、不図示の制御回路から出力された制
御信号によつてサイリスタスイツチ5をONにし、コン
デンサバンク3aを突入電流なしに交流電圧線1に投入
する。コンデンサバンク3aが投入されると、第7図
(e)に示すように、開閉器2aを時刻t3においてONに
し、第7図(f)に示すようにサイリスタスイツチ5に流
れている電流を開閉器2aに転流させる。その後サイリ
スタスイツチ5をOFFにし更に開閉器6aを時刻t4に
OFFにする。When inserting the capacitor bank 3a into the AC voltage line 1, first, as shown in FIG.
With the switch off, the switch 6a is turned on at time t 1 . In this case, when the voltage equal to the supply voltage E in the thyristor steel Tutsi 5 as shown in FIG. 7 (d) is applied, in yet time t 2, the voltage applied to the thyristor Sui Tutsi it has decreased to 0, not The thyristor switch 5 is turned on by the control signal output from the illustrated control circuit, and the capacitor bank 3a is turned on to the AC voltage line 1 without inrush current. When the capacitor bank 3a is turned on, FIG.
(e), the ON the switch 2a at time t 3, commutated the current flowing through the thyristor Sui Tutsi 5 as shown in FIG. 7 (f) to switch 2a. Thereafter the thyristor Sui Tutsi 5 to OFF further to OFF switch 6a at time t 4.
次にコンデンサバンク3bを投入する場合は、コンデン
サバンク3aを投入する場合と同様にサイリスタスイツ
チ5をOFFにしたまま開閉器6bをONにした後、サ
イリスタスイツチ5に印加される電圧が0になつた時点
でサイリスタスイツチ5をONにして、コンデンサバン
ク3bを突入電流なしに交流電圧線1に投入する。コン
デンサバンク3bが投入されると開閉器2bをONに
し、サイリスタスイツチ5に流れている電流を開閉器2
bに転流させる。その後サイリスタスイツチ5をOFF
にし、更に開閉器6bをOFFにする。Next, when the capacitor bank 3b is turned on, the voltage applied to the thyristor switch 5 becomes 0 after the switch 6b is turned on while the thyristor switch 5 is turned off in the same manner as when the capacitor bank 3a is turned on. At that time, the thyristor switch 5 is turned on, and the capacitor bank 3b is connected to the AC voltage line 1 without an inrush current. When the capacitor bank 3b is turned on, the switch 2b is turned on, and the current flowing in the thyristor switch 5 is switched on.
Commute to b. Then turn off thyristor switch 5.
Then, the switch 6b is turned off.
コンデンサバンク3cを投入する場合も上記と同様の順
序でコンデンサバンクをサイリスタスイツチ5により投
入することができる。When the capacitor bank 3c is turned on, the capacitor bank can be turned on by the thyristor switch 5 in the same order as above.
このように、コンデンサ投入後はサイリスタスイツチ5
を介して行うことにより、突入電流を防止できると共に
投入御は開閉器2a〜2c側に電流を流すようにするた
め、サイリスタスイツチの定格としては短時間定格で良
く又、電気損失も少ない。In this way, after turning on the capacitor, the thyristor switch 5
The thyristor switch may be rated for a short time and electrical loss is small because the inrush current can be prevented and the closing control allows the current to flow to the switches 2a to 2c.
次にコンデンサバンク3cを開放する場合の動作につい
て以下に説明する。Next, the operation when opening the capacitor bank 3c will be described below.
第8図(b)において、時刻t1に開閉器6cをONにす
ると共にサイリスタスイツチ5をONにする。その後第
8図(e)に示すように開閉器2cを時刻t2でOFFに
して、第8図(c)及び(f)に示すように開閉器2cに流れ
ていた電流をサイリスタスイツチ5へ転流させる。その
後サイリスタスイツチ5のゲート信号をOFFにする
と、第8図(c)に示すようにサイリスタスイツチ5は該
サイリスタスイツチに流れる電流が0になつた時刻t3
でOFFになつて、回路電流を阻止する。この時、コン
デンサ3cには電源電圧のピーク値E迄充電されている
ため、サイリスタスイツチ5には2Eの電圧が印加され
る。その後開閉器6cを時刻t4でOFFにして、コンデ
ンサンバンク3cを交流電圧線1から完全に切離す。In Figure 8 (b), to ON thyristor Sui Tutsi 5 while the turns ON switch 6c at time t 1. To OFF in the subsequent switch 2c time t 2 as shown in FIG. 8 (e), Figure 8 (c) and the current flowing in the switch 2c as shown in the the thyristor Sui Tutsi 5 (f) Commute. After that, when the gate signal of the thyristor switch 5 is turned off, as shown in FIG. 8 (c), the thyristor switch 5 becomes t 3 when the current flowing through the thyristor switch becomes zero.
Turns off to block the circuit current. At this time, since the capacitor 3c is charged to the peak value E of the power supply voltage, the voltage of 2E is applied to the thyristor switch 5. Then OFF the switch 6c at time t 4, completely disconnect the capacitor down bank 3c from AC voltage line 1.
次に、コンデンサバンク3bを開放する場合も上記コン
デンサバンク3cを開放する場合と同様に、まず、開閉
器6bをONにすると共にサイリスタスイツチ5をON
にする。その後開閉器2bをOFFにして、開閉器2b
に流れていた電流をサイリスタスイツチ5へ転流させ
る。この後サイリスタスイツチ5のゲート信号をOFF
にすると、サイリスタスイツチ5は該サイリスタスイツ
チに流れる電流が0になつた時にOFFとなり、回路電
流を阻止する。その後、開閉器6bをOFFにしてコン
デンサバンク3bを交流電圧線1から完全に切離す。Next, when opening the capacitor bank 3b, first, similarly to when opening the capacitor bank 3c, first, the switch 6b is turned on and the thyristor switch 5 is turned on.
To After that, switch 2b is turned off and switch 2b
The current flowing in the thyristor is commutated to the thyristor switch 5. After that, turn off the gate signal of thyristor switch 5.
In this case, the thyristor switch 5 is turned off when the current flowing through the thyristor switch reaches 0, blocking the circuit current. After that, the switch 6b is turned off to completely disconnect the capacitor bank 3b from the AC voltage line 1.
コンデンサバンク3aを交流電圧線1から開放する場合
も上記と同様である。The same applies when the capacitor bank 3a is opened from the AC voltage line 1.
以上に説明したように、コンデンサバンク3a〜3cを
開閉する場合は、常にサイリスタスイツチ5を用いて無
接点開閉を行い、開閉時は突入電流等の過渡現象なしに
行うことができるので、コンデンサ投入時、交流電圧線
1(電源側)に電圧歪を生じない。又、コンデンサ投入
時にコンデンサへの突入電流がないので、開閉頻度が多
くてもコンデンサの寿命劣化は生じない。更に、開閉器
2a〜2c及び6a〜6cを開閉する際は、電流が0又
は他に電流をバイパスできる回路がある状態で開閉され
るので、開閉器の寿命劣化は生じないという効果が得ら
れる。また開閉器は電流開閉能力を必要としないので、
断路器でも使用可能である。As described above, when the capacitor banks 3a to 3c are opened and closed, the thyristor switch 5 is always used for contactless opening and closing, and the opening and closing can be performed without a transient phenomenon such as inrush current. At this time, no voltage distortion occurs on the AC voltage line 1 (power supply side). Further, since there is no rush current into the capacitor when the capacitor is turned on, the life of the capacitor does not deteriorate even if the switching frequency is high. Furthermore, when the switches 2a to 2c and 6a to 6c are opened and closed, since the current is 0 or there is a circuit that can bypass the current, there is an effect that the life of the switches does not deteriorate. . Also, since the switch does not require current switching capability,
It can also be used as a disconnector.
第6図は前記第5図と同一部分に同一符号を付したこの
発明の第2実施例を示す回路図である。第6図におい
て、7はサイリスタスイツチ5に並列に接続した非線形
抵抗である。FIG. 6 is a circuit diagram showing a second embodiment of the present invention in which the same parts as those in FIG. In FIG. 6, reference numeral 7 is a non-linear resistor connected in parallel to the thyristor switch 5.
第6図におけるコンデンサバンク3a〜3cの投入動作
は第5図の場合と全く同一である。ただし、コンデンサ
3a〜3cを開放する場合、第5図の実施例ではサイリ
スタスイツチ5が第8図の時刻t3でOFFになつた直
後には、コンデンサ3a〜3cは電源電圧のピーク値E
迄充電されているため、サイリスタスイツチ5には、第
8図(d)に点線で示されるように2Eの電圧が印加され
るため、サイリスタスイツチ5の耐圧は少なくとも2E
が必要であつた。The operation of closing the capacitor banks 3a to 3c in FIG. 6 is exactly the same as that in FIG. However, in order to free the capacitor 3 a to 3 c, in the immediately after thyristor Sui Tutsi 5 has decreased to OFF at time t 3 of Figure 8 the embodiment of FIG. 5, the peak value of the capacitor 3 a to 3 c is a power supply voltage E
Since the thyristor switch 5 is charged up to this point, a voltage of 2E is applied to the thyristor switch 5 as shown by the dotted line in FIG.
Was necessary.
しかるに、第6図の第2実施例ではサイリスタスイツチ
5と並列に非線形抵抗7を接続してあるので、第9図
(d)の実線で示すようにサイリスタスイツチ5のOFF
後の印加電圧は、非線形抵抗7よりほぼ電源電圧E程度
の大きさの波高値に制限される。However, since the non-linear resistor 7 is connected in parallel with the thyristor switch 5 in the second embodiment shown in FIG.
As shown by the solid line in (d), the thyristor switch 5 is turned off.
The applied voltage thereafter is limited to a peak value of about the power supply voltage E by the nonlinear resistance 7.
非線形抵抗7には、常時は電圧が印加されておらず、サ
イリスタスイツチ5がON又はOFFになつた時のわず
かの期間だけ印加されるだけであるため、抵抗内部の消
費エネルギーは小さく、従つて、サイリスタスイツチ5
に印加される電圧を短時間の期間ほぼE程度に制限する
ことが可能である。No voltage is applied to the non-linear resistance 7 at all times, and it is applied only for a short period of time when the thyristor switch 5 is turned on or off. Therefore, the energy consumption inside the resistance is small, and , Thyristor switch 5
It is possible to limit the voltage applied to V to about E for a short period of time.
このように、非線形抵抗7をサイリスタスイツチ5と並
列に接続することにより、サイリスタスイツチ5に印加
される電圧を制限することができるもので、前記第1実
施例に比べ、更に、安価な開閉装置を提供することがで
きる。By connecting the non-linear resistor 7 in parallel with the thyristor switch 5 in this way, the voltage applied to the thyristor switch 5 can be limited, and the switchgear is more inexpensive than the first embodiment. Can be provided.
なお、上記実施例ではコンデンサバンクの開閉の場合に
ついて示したが、負荷はコンデンサのみにかかわらず交
流負荷なら何でもよい。又上記実施例は開閉器としてし
や断器の場合について示したが、断路器や開閉器であつ
てもよい。更に、上記実施例ではサイリスタの逆並列回
路で構成されるサイリスタスイツチの場合について示し
たが、GTOサイリスタやその他の半導体スイツチ素子
でもよく、これら、いずれの場合も上記実施例と同様の
効果を奏する。In the above embodiment, the case of opening and closing the capacitor bank is shown, but the load may be any AC load regardless of the capacitor. Further, although the above-mentioned embodiment shows the case of a switch or a switch, it may be a switch or a switch. Further, in the above embodiment, the case of the thyristor switch constituted by the antiparallel circuit of the thyristor is shown, but a GTO thyristor or other semiconductor switch element may be used, and in any of these cases, the same effect as the above embodiment can be obtained. .
〔発明の効果〕 以上のように、この発明によれば、複数のコンデンサバ
ンクの開閉器と並列に、各コンデンサバンクに対し共通
1台のサイリスタスイツチとサイリスタスイツチ切替え
用の開閉器を接続し、コンデンサバンクの開閉は全てサ
イリスタスイツチを用いて無接点により行うように構成
したので、コンデンサ投入時の電源電圧の歪を解消でき
ると共に開閉頻度が多い場合もコンデンサや開閉器の寿
命に影響を与えず、通電中の電気損失の少ない開閉装置
が安価に得られる効果がある。又、上記サイリスタスイ
ツチと並列に非線形抵抗素子を設けてあるので、サイリ
スタスイツチがオフしたときには、コンデンサバンクの
充電電圧が上記非線形抵抗素子を通じて急速に放電す
る。その結果、サイリスタスイツチに対する過電圧印加
を抑制するという効果も得られる。[Effects of the Invention] As described above, according to the present invention, a single thyristor switch and a switch for switching thyristor switches are connected in common to each capacitor bank in parallel with the switches of the plurality of capacitor banks. Since all capacitor banks are opened and closed without contact using a thyristor switch, distortion of the power supply voltage when the capacitors are turned on can be eliminated and the life of the capacitors and switches will not be affected even if the frequency of opening and closing is high. Therefore, there is an effect that a switchgear with little electric loss during energization can be obtained at low cost. Further, since the nonlinear resistance element is provided in parallel with the thyristor switch, when the thyristor switch is turned off, the charging voltage of the capacitor bank is rapidly discharged through the nonlinear resistance element. As a result, the effect of suppressing the overvoltage application to the thyristor switch can be obtained.
第1図は従来の機械的開閉器を用いたコンデンサ開閉装
置を示す回路図、第2図は従来の各コンデンサバンク毎
にサイリスタスイツチを用いたコンデンサ開閉装置を示
す回路図、第3図はサイリスタスイツチによるコンデン
サ開閉装置の基本動作を示す回路図、第4図は第3図の
回路各部の動作波形を示す波形図、第5図はこの発明の
開閉装置の第1実施例を示す回路図、第6図はこの発明
の開閉装置の第2実施例を示す回路図、第7図は第5図
に示す第1実施例のコンデンサ投入時の動作を示す波形
図、第8図は第5図に示す第1実施例のコンデンサ開放
時の動作を示す波形図、第9図は第6図に示す第2実施
例のコンデンサ開放時の動作を示す波形図である。 1…交流電源母線、2,2a〜2c…開閉器、3,3a
〜3c…コンデンサバンク、4,4a〜4c…サイリス
タスイツチ、5…サイリスタスイツチ、6a〜6c…サ
イリスタスイツチ切替え用開閉器、7…非線形抵抗。 なお、図中、同一符号は同一、又は相当部分を示す。1 is a circuit diagram showing a conventional capacitor switchgear using a mechanical switch, FIG. 2 is a circuit diagram showing a conventional capacitor switchgear using a thyristor switch for each capacitor bank, and FIG. 3 is a thyristor. FIG. 4 is a circuit diagram showing the basic operation of a capacitor switchgear by a switch, FIG. 4 is a waveform diagram showing the operation waveforms of each part of the circuit of FIG. 3, and FIG. FIG. 6 is a circuit diagram showing a second embodiment of the switchgear according to the present invention, FIG. 7 is a waveform diagram showing the operation of the first embodiment shown in FIG. 5 when the capacitor is turned on, and FIG. FIG. 9 is a waveform diagram showing the operation when the capacitor is opened in the first embodiment shown in FIG. 9, and FIG. 9 is a waveform diagram showing the operation when the capacitor is opened in the second embodiment shown in FIG. 1 ... AC power bus, 2, 2a-2c ... Switch, 3, 3a
3c ... a capacitor bank, 4,4a-4c ... thyristor switch, 5 ... thyristor switch, 6a-6c ... thyristor switch switching switch, 7 ... non-linear resistance. In the drawings, the same reference numerals indicate the same or corresponding parts.
Claims (1)
い交流電圧位相に同期して閉成される半導体スイッチ
と、複数の負荷の前記交流電源母線に対する接続路に夫
々直列に接続され該負荷を該交流電源母線に投入する場
合は、前記半導体スイッチを閉成して該半導体スイッチ
を通じて前記負荷に通電後に閉成され、前記負荷を交流
電源母線から切離す場合は前記半導体スイッチの閉成と
共に開成する第1の開閉器と、前記半導体スイッチの負
荷側と前記負荷の電源側との間に夫々接続され該負荷を
前記交流電源母線に投入する場合に、予じめ閉成されて
おり、前記半導体スイッチおよび前記第1の開閉器が閉
成し引続く該半導体スイッチの開成後に開成され、前記
負荷を交流電源母線から切離す場合は前記第1の開閉器
の開成後に前記半導体スイッチを介して流れる負荷電流
を該半導体スイッチの開成により阻止した後に開成する
第2の開閉器と前記半導体スイッチがオフしたとき前記
負荷の充電電荷を放電するように該半導体スイッチに並
列に接続した非線形抵抗素子とを備えた開閉装置。1. A semiconductor switch, which is connected to an AC power supply bus and is closed in synchronization with an AC voltage phase in which no inrush current flows, and a load connected in series to a connection path of a plurality of loads to the AC power supply bus. Is applied to the AC power supply busbar, the semiconductor switch is closed and the load is turned on through the semiconductor switch, and when the load is disconnected from the AC power supply busbar, the semiconductor switch is closed. When the first switch to be opened and the load side of the semiconductor switch and the power source side of the load are respectively connected and the load is applied to the AC power source bus, the switch is preliminarily closed. The semiconductor switch and the first switch are closed and subsequently opened after the semiconductor switch is opened. When disconnecting the load from the AC power bus, the semiconductor switch is opened after the first switch is opened. A second switch which is opened after the load current flowing through the switch is blocked by the opening of the semiconductor switch and is connected in parallel to the semiconductor switch so as to discharge the charge of the load when the semiconductor switch is turned off. A switchgear having a non-linear resistance element.
Priority Applications (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59094493A JPH065982B2 (en) | 1984-05-14 | 1984-05-14 | Switchgear |
| DE8585105609T DE3584734D1 (en) | 1984-05-11 | 1985-05-08 | SWITCHGEAR. |
| EP19850105609 EP0161628B1 (en) | 1984-05-11 | 1985-05-08 | Switchgear |
| US06/732,720 US4695741A (en) | 1984-05-11 | 1985-05-10 | Switchgear |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59094493A JPH065982B2 (en) | 1984-05-14 | 1984-05-14 | Switchgear |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS60239120A JPS60239120A (en) | 1985-11-28 |
| JPH065982B2 true JPH065982B2 (en) | 1994-01-19 |
Family
ID=14111820
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59094493A Expired - Fee Related JPH065982B2 (en) | 1984-05-11 | 1984-05-14 | Switchgear |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH065982B2 (en) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US11018666B1 (en) * | 2020-02-20 | 2021-05-25 | Abb Schweiz Ag | Thyristor current interrupter and auxiliary quasi-resonant turn-off unit |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS56103719A (en) * | 1980-01-22 | 1981-08-19 | Toshiba Corp | Controller for applied phase of invalid power supply device |
-
1984
- 1984-05-14 JP JP59094493A patent/JPH065982B2/en not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPS60239120A (en) | 1985-11-28 |
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