JPH0667189B2 - スイツチングレギユレ−タ - Google Patents
スイツチングレギユレ−タInfo
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- JPH0667189B2 JPH0667189B2 JP4385987A JP4385987A JPH0667189B2 JP H0667189 B2 JPH0667189 B2 JP H0667189B2 JP 4385987 A JP4385987 A JP 4385987A JP 4385987 A JP4385987 A JP 4385987A JP H0667189 B2 JPH0667189 B2 JP H0667189B2
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- 238000004804 winding Methods 0.000 claims description 29
- 239000003990 capacitor Substances 0.000 description 6
- 238000009499 grossing Methods 0.000 description 6
- 238000010586 diagram Methods 0.000 description 4
- 238000009825 accumulation Methods 0.000 description 1
- 230000000295 complement effect Effects 0.000 description 1
- 238000004904 shortening Methods 0.000 description 1
- 230000000087 stabilizing effect Effects 0.000 description 1
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- Dc-Dc Converters (AREA)
Description
【発明の詳細な説明】 技術分野 本発明はスイッチングレギュレータに関し、特に多出力
巻線を有するトランスを使用して安定化された多出力直
流電圧を得るようにしたスイッチングレギュレータに関
する。
巻線を有するトランスを使用して安定化された多出力直
流電圧を得るようにしたスイッチングレギュレータに関
する。
従来技術 従来のこの種の多出力スイッチングレギュレータは第３
図に示すような構成のものがある。図において、非安定
化直流入力電圧の両端に多出力巻線を有するトランス２
の一時巻線Ｎ１と主スイッチングトランジスタ１とが互
いに直列に接続されている。この主スイッチングトラン
ジスタ１の導通角を制御回路ｂの制御出力によりコント
ロールすることによって、トランス２の一次巻線Ｎ１の
電圧をオンオフし、二次巻線Ｎ２及びＮ３へ夫々このオ
ンオフ電圧を伝達するようになっている。
図に示すような構成のものがある。図において、非安定
化直流入力電圧の両端に多出力巻線を有するトランス２
の一時巻線Ｎ１と主スイッチングトランジスタ１とが互
いに直列に接続されている。この主スイッチングトラン
ジスタ１の導通角を制御回路ｂの制御出力によりコント
ロールすることによって、トランス２の一次巻線Ｎ１の
電圧をオンオフし、二次巻線Ｎ２及びＮ３へ夫々このオ
ンオフ電圧を伝達するようになっている。
トランス２の二次巻線Ｎ２からの出力はダイオード３に
より整流され、平滑回路ａを介して平滑された後主直流
出力Ｖ01となる。この主直流出力Ｖ01は制御回路ｂへ供
給されており、この主直流出力電圧Ｖ01のレベルに応じ
て主スイッチングトランジスタ１の導通角が制御される
様にフィードバックループが形成されている。これによ
り、主直流出力Ｖ01の安定化を図っているのである。
より整流され、平滑回路ａを介して平滑された後主直流
出力Ｖ01となる。この主直流出力Ｖ01は制御回路ｂへ供
給されており、この主直流出力電圧Ｖ01のレベルに応じ
て主スイッチングトランジスタ１の導通角が制御される
様にフィードバックループが形成されている。これによ
り、主直流出力Ｖ01の安定化を図っているのである。
一方、トランス２の二次巻線Ｎ３からの出力はダイオー
ド４により整流されており、副スイッチングトランジス
タ５の導通角の制御によってダイオード４による整流出
力のパルス幅が制御される。このパルス幅が制御された
出力は、ダイオード９，チョークコイル１０及びコンデ
ンサ１１からなる平滑回路にて平滑化されて副直流出力
Ｖ02となる。
ド４により整流されており、副スイッチングトランジス
タ５の導通角の制御によってダイオード４による整流出
力のパルス幅が制御される。このパルス幅が制御された
出力は、ダイオード９，チョークコイル１０及びコンデ
ンサ１１からなる平滑回路にて平滑化されて副直流出力
Ｖ02となる。
この副直流出力Ｖ02を入力とする制御回路ｃが設けられ
ており、この制御回路ｃは入力された副直流出力Ｖ02の
レベルに応じて制御信号を生成する。この制御信号によ
り制御トランジスタ２０がオンオフ制御され、この制御
トランジスタ２０のコレクタに設けられているパルスト
ランス１９を介して副スイッチングトランジスタ５のオ
ンオフが制御されるようになっている。尚、抵抗８及び
１８はトランジスタ２０及び５の各ベース電流供給用で
あり、これ等トランジスタ２０及び５の電源は補助電源
Ｖccにより与えられるようになっている。
ており、この制御回路ｃは入力された副直流出力Ｖ02の
レベルに応じて制御信号を生成する。この制御信号によ
り制御トランジスタ２０がオンオフ制御され、この制御
トランジスタ２０のコレクタに設けられているパルスト
ランス１９を介して副スイッチングトランジスタ５のオ
ンオフが制御されるようになっている。尚、抵抗８及び
１８はトランジスタ２０及び５の各ベース電流供給用で
あり、これ等トランジスタ２０及び５の電源は補助電源
Ｖccにより与えられるようになっている。
かかる従来の回路構成においては、副直流出力Ｖ02を制
御する副スイッチングトランジスタ５を駆動するため
に、パルストランス１９を使用しており、コスト的にも
また構造的にも得策ではない。また、副スイッチングト
ランジスタ５の駆動エネルギに補助の独立した直流電源
Ｖccを使用しているので、補助電源回路も高価となると
いう欠点がある。
御する副スイッチングトランジスタ５を駆動するため
に、パルストランス１９を使用しており、コスト的にも
また構造的にも得策ではない。また、副スイッチングト
ランジスタ５の駆動エネルギに補助の独立した直流電源
Ｖccを使用しているので、補助電源回路も高価となると
いう欠点がある。
発明の目的 そこで、本発明は上記の如き従来のものの欠点を解決す
べくなされたものであって、その目的とするところは、
高価なパルストランスを用いることなくまた高価な補助
電源を用いることのない多出力スイッチングレギュレー
タを提供することにある。
べくなされたものであって、その目的とするところは、
高価なパルストランスを用いることなくまた高価な補助
電源を用いることのない多出力スイッチングレギュレー
タを提供することにある。
発明の構成 本発明によれば、主スイッチングトランジスタと、この
主スイッチングトランジスタに直列に接続された一次巻
線の他に第１及び第２の二次巻線を有するトランスと、
このトランスの第１の二次巻線からの出力により得られ
る主直流電圧に応じて前記主スイッチングトランジスタ
の導通角を制御して前記主直流電圧を一定に維持する第
１の制御手段と、前記トランスの第２の二次巻線の整流
出力の導通角を制御するための副スイッチングトランジ
スタと、前記副スイッチングトランジスタの出力により
得られる副直流電圧に応じて前記副スイッチングトラン
ジスタの導通角を制御する第２の制御回路とを有するス
イッチングレギュレータであって、前記第２の制御手段
は、前記副スイッチングトランジスタのベース電流をオ
ンオフ制御すべくこの副スイッチングトランジスタのベ
ース・エミッタ間に接続される制御トランジスタと、こ
の制御トランジスタのオンオフを前記副直流電圧に応じ
て制御する制御回路とを有し、前記副スイッチングトラ
ンジスタのベース電流を前記主直流電圧により供給する
ようにしたことを特徴とするスイッチングレギュレータ
が得られる。
主スイッチングトランジスタに直列に接続された一次巻
線の他に第１及び第２の二次巻線を有するトランスと、
このトランスの第１の二次巻線からの出力により得られ
る主直流電圧に応じて前記主スイッチングトランジスタ
の導通角を制御して前記主直流電圧を一定に維持する第
１の制御手段と、前記トランスの第２の二次巻線の整流
出力の導通角を制御するための副スイッチングトランジ
スタと、前記副スイッチングトランジスタの出力により
得られる副直流電圧に応じて前記副スイッチングトラン
ジスタの導通角を制御する第２の制御回路とを有するス
イッチングレギュレータであって、前記第２の制御手段
は、前記副スイッチングトランジスタのベース電流をオ
ンオフ制御すべくこの副スイッチングトランジスタのベ
ース・エミッタ間に接続される制御トランジスタと、こ
の制御トランジスタのオンオフを前記副直流電圧に応じ
て制御する制御回路とを有し、前記副スイッチングトラ
ンジスタのベース電流を前記主直流電圧により供給する
ようにしたことを特徴とするスイッチングレギュレータ
が得られる。
実施例 以下、図面を用いて本発明の実施例を説明する。
第１図は本発明の実施例の回路図であり、第３図と同等
部分は同一符号により示している。図において、トラン
ジスタ１は主制御用であり、トランス２は一次巻線Ｎ
１、二次巻線N2,N3を備えている。ダイオード３，４は
それぞれ各二次巻線N2,N3からの電力パルスを整流する
ためのものであり、平滑回路ａは二次巻線Ｎ２からの電
力パルスを直流化するためのものである。制御回路ｂは
第１の直流出力Ｖ01を検出しこれに応じてトランジスタ
１の導通角を制御し直流出力Ｖ01を一定に保つためのも
のである。
部分は同一符号により示している。図において、トラン
ジスタ１は主制御用であり、トランス２は一次巻線Ｎ
１、二次巻線N2,N3を備えている。ダイオード３，４は
それぞれ各二次巻線N2,N3からの電力パルスを整流する
ためのものであり、平滑回路ａは二次巻線Ｎ２からの電
力パルスを直流化するためのものである。制御回路ｂは
第１の直流出力Ｖ01を検出しこれに応じてトランジスタ
１の導通角を制御し直流出力Ｖ01を一定に保つためのも
のである。
トランジスタ５は二次巻線Ｎ３からの電力パルスを導通
または非導通とさせる副スイッチングトランジスタで、
トランジスタ６はトランジスタ５をオンオフさせるため
の相補的制御用トランジスタである。制御回路ｃは第２
の直流出力Ｖ02を検出して二次巻線Ｎ３からの電力パル
スの導通角を制御する。ダイオード９，チョークコイル
１０，コンデンサ１１は二次巻線Ｎ３からのトランジス
タ５を通して得られた電力パルスを整流平滑して直流化
するために設けられている。尚、抵抗７，８はそれぞれ
トランジスタ５，６のベースに電流を供給するためのも
のである。
または非導通とさせる副スイッチングトランジスタで、
トランジスタ６はトランジスタ５をオンオフさせるため
の相補的制御用トランジスタである。制御回路ｃは第２
の直流出力Ｖ02を検出して二次巻線Ｎ３からの電力パル
スの導通角を制御する。ダイオード９，チョークコイル
１０，コンデンサ１１は二次巻線Ｎ３からのトランジス
タ５を通して得られた電力パルスを整流平滑して直流化
するために設けられている。尚、抵抗７，８はそれぞれ
トランジスタ５，６のベースに電流を供給するためのも
のである。
次に、第１図の回路の動作について説明する。制御回路
ｂは出力Ｖ01を検出し、この出力電圧Ｖ01に応じてトラ
ンジスタ５のベースを駆動するパルスの導通角を変化さ
せ、二次巻線Ｎ２に現われる電力パルスの幅を変化させ
る。結局、こうして得られたパルスをダイオード３，平
滑回路ａで整流平滑して得られる直流出力Ｖ02を一定に
保つことになる。つまり、出力電圧Ｖ01が基準より高く
なれば、トランジスタ５の駆動パルス幅を狭くしてＶ01
の電圧を減らし、出力電圧Ｖ01が基準より低くなればこ
れと逆の動作をする。
ｂは出力Ｖ01を検出し、この出力電圧Ｖ01に応じてトラ
ンジスタ５のベースを駆動するパルスの導通角を変化さ
せ、二次巻線Ｎ２に現われる電力パルスの幅を変化させ
る。結局、こうして得られたパルスをダイオード３，平
滑回路ａで整流平滑して得られる直流出力Ｖ02を一定に
保つことになる。つまり、出力電圧Ｖ01が基準より高く
なれば、トランジスタ５の駆動パルス幅を狭くしてＶ01
の電圧を減らし、出力電圧Ｖ01が基準より低くなればこ
れと逆の動作をする。
ここで、巻線Ｎ３には巻線Ｎ２と全く同様のパルス幅の
電力パルスが現われる。巻線Ｎ３の巻数を適当に選択し
ても、巻線Ｎ３からの電力パルスを整流平滑するだけで
は直流出力Ｖ02に一定の安定化された出力を得ることは
できない。これは直流出力V01,V02の負荷及び各回路素
子の電圧ドロップのバラツキによる。従って、巻線Ｎ３
の電力パルス電圧を大きめになるようにし、トランジス
タ５で導通角を制御して直流出力Ｖ02を一定にする。
電力パルスが現われる。巻線Ｎ３の巻数を適当に選択し
ても、巻線Ｎ３からの電力パルスを整流平滑するだけで
は直流出力Ｖ02に一定の安定化された出力を得ることは
できない。これは直流出力V01,V02の負荷及び各回路素
子の電圧ドロップのバラツキによる。従って、巻線Ｎ３
の電力パルス電圧を大きめになるようにし、トランジス
タ５で導通角を制御して直流出力Ｖ02を一定にする。
制御回路ｃは直流出力Ｖ02を検出しこの電圧が基準より
高ければ巻線Ｎ３からの電力パルス幅の導通角が大きく
なるように動作し、基準より低ければこの逆の動作をす
る。
高ければ巻線Ｎ３からの電力パルス幅の導通角が大きく
なるように動作し、基準より低ければこの逆の動作をす
る。
いま、ダイオード４のカソードに正の電力パルスが現わ
れている期間のみを考えてみよう。この時、制御回路ｃ
の出力がハイレベルであるとトランジスタ６はオンし、
出力Ｖ01から抵抗７を通してトランジスタ５のベースに
は電流が流れないためトランジスタ５はオフされ電力パ
ルスは阻止され出力側には現われない。制御回路の出力
がロウレベルであるとトランジスタ６はオフし、出力Ｖ
01から抵抗７を通してトランジスタ５のベースに電流が
流れトランジスタ５はオンし電力パルスは出力側に現わ
れる。こうして制御回路ｃの出力パルスの幅を電力パル
スに同期させて制御すれば直流出力Ｖ02を制御できる。
制御された電力パルスはダイオード９，チョークコイル
１０，コンデンサ１１によって整流平滑化され直流出力
Ｖ02となる。
れている期間のみを考えてみよう。この時、制御回路ｃ
の出力がハイレベルであるとトランジスタ６はオンし、
出力Ｖ01から抵抗７を通してトランジスタ５のベースに
は電流が流れないためトランジスタ５はオフされ電力パ
ルスは阻止され出力側には現われない。制御回路の出力
がロウレベルであるとトランジスタ６はオフし、出力Ｖ
01から抵抗７を通してトランジスタ５のベースに電流が
流れトランジスタ５はオンし電力パルスは出力側に現わ
れる。こうして制御回路ｃの出力パルスの幅を電力パル
スに同期させて制御すれば直流出力Ｖ02を制御できる。
制御された電力パルスはダイオード９，チョークコイル
１０，コンデンサ１１によって整流平滑化され直流出力
Ｖ02となる。
ここで、トランジスタ５のベース駆動電流は直流出力Ｖ
01から供給されており、また、抵抗８を流れる電流はト
ランジスタ６のベース電流のみであり、よって一般に非
常に少なくて済む。
01から供給されており、また、抵抗８を流れる電流はト
ランジスタ６のベース電流のみであり、よって一般に非
常に少なくて済む。
第２図は本発明の他の実施例を示す回路図であり、第１
図と同等部分は同一符号により示す。本実施例では、第
１の直流出力Ｖ01が負出力、第２の直流出力が正出力で
あり、第１図の実施例とは逆になっている。そのため
に、トランジスタ５がＮＰＮからＰＮＰになっているこ
と、トランジスタ６のベースに定電圧ダイオード１６，
コンデンサ１７が付加されていること以外は全く第１図
の例と同様である。
図と同等部分は同一符号により示す。本実施例では、第
１の直流出力Ｖ01が負出力、第２の直流出力が正出力で
あり、第１図の実施例とは逆になっている。そのため
に、トランジスタ５がＮＰＮからＰＮＰになっているこ
と、トランジスタ６のベースに定電圧ダイオード１６，
コンデンサ１７が付加されていること以外は全く第１図
の例と同様である。
定電圧ダイオード１６は制御回路ｃの出力がロウレベル
時にトランジスタ６がオンしないようレベルシフトする
ためのものである。コンデンサ１７はトランジスタ６の
オフ時にこのトランジスタのベース蓄積時間を短くする
ためのスピードアップコンデンサである。動作は第１図
と同様であるので割愛する。
時にトランジスタ６がオンしないようレベルシフトする
ためのものである。コンデンサ１７はトランジスタ６の
オフ時にこのトランジスタのベース蓄積時間を短くする
ためのスピードアップコンデンサである。動作は第１図
と同様であるので割愛する。
このように、副直流出力Ｖ02を安定化せしめるための副
スイッチングトランジスタ５のベース駆動電源を主直流
出力Ｖ01から供給し、この副スイッチングトランジスタ
５のベース・エミッタ間に制御用トランジスタ６を接続
し、このトランジスタ６のオンオフを副直流出力Ｖ02に
応じて制御するようにしているので、副スイッチングト
ランジスタ５のオンオフのためのパルストランスやベー
ス駆動用電源が不要となるものである。
スイッチングトランジスタ５のベース駆動電源を主直流
出力Ｖ01から供給し、この副スイッチングトランジスタ
５のベース・エミッタ間に制御用トランジスタ６を接続
し、このトランジスタ６のオンオフを副直流出力Ｖ02に
応じて制御するようにしているので、副スイッチングト
ランジスタ５のオンオフのためのパルストランスやベー
ス駆動用電源が不要となるものである。
発明の効果 叙上の如く、本発明によれば、副直流出力の制御のため
のスイッチングトランジスタのオンオフ制御を、副直流
出力に応じてオンオフ制御される制御トランジスタによ
り直接行うようにすると共に、当該スイッチングトラン
ジスタのベース駆動電流を主直流電源により供給するよ
う構成したので、パルストランスを用いる必要もなく、
また補助電源の消費電力も少ないとう効果がある。
のスイッチングトランジスタのオンオフ制御を、副直流
出力に応じてオンオフ制御される制御トランジスタによ
り直接行うようにすると共に、当該スイッチングトラン
ジスタのベース駆動電流を主直流電源により供給するよ
う構成したので、パルストランスを用いる必要もなく、
また補助電源の消費電力も少ないとう効果がある。
第１図及び第２図は本発明の実施例を夫々示す回路図、
第３図は従来のスイッチング回路の例を示す図である。 主要部分の符号の説明 １……主スイッチングトランジスタ ２……トランス ５……副スイッチングトランジスタ ６……制御トランジスタ
第３図は従来のスイッチング回路の例を示す図である。 主要部分の符号の説明 １……主スイッチングトランジスタ ２……トランス ５……副スイッチングトランジスタ ６……制御トランジスタ
Claims (1)
- 【請求項１】主スイッチングトランジスタと、この主ス
イッチングトランジスタに直列に接続された一次巻線の
他に第１及び第２の二次巻線を有するトランスと、この
トランスの第１の二次巻線からの出力により得られる主
直流電圧に応じて前記主スイッチングトランジスタの導
通角を制御して前記主直流電圧を一定に維持する第１の
制御手段と、前記トランスの第２の二次巻線の整流出力
の導通角を制御するための副スイッチングトランジスタ
と、前記副スイッチングトランジスタの出力により得ら
れる副直流電圧に応じて前記副スイッチングトランジス
タの導通角を制御する第２の制御回路とを有するスイッ
チングレギュレータであって、前記第２の制御手段は、
前記副スイッチングトランジスタのベース電流をオンオ
フ制御すべくこの副スイッチングトランジスタのベース
・エミッタ間に接続される制御トランジスタと、この制
御トランジスタのオンオフを前記副直流電圧に応じて制
御する制御回路とを有し、前記副スイッチングトランジ
スタのベース電流を前記主直流電圧により供給するよう
にしたことを特徴とするスイッチングレギュレータ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4385987A JPH0667189B2 (ja) | 1987-02-26 | 1987-02-26 | スイツチングレギユレ−タ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4385987A JPH0667189B2 (ja) | 1987-02-26 | 1987-02-26 | スイツチングレギユレ−タ |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS63209470A JPS63209470A (ja) | 1988-08-31 |
| JPH0667189B2 true JPH0667189B2 (ja) | 1994-08-24 |
Family
ID=12675426
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4385987A Expired - Fee Related JPH0667189B2 (ja) | 1987-02-26 | 1987-02-26 | スイツチングレギユレ−タ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0667189B2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2559682Y2 (ja) * | 1990-10-17 | 1998-01-19 | 富士電機 株式会社 | 多出力スイッチングレギュレータ |
-
1987
- 1987-02-26 JP JP4385987A patent/JPH0667189B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPS63209470A (ja) | 1988-08-31 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |