JPH07177136A - データ信号多重伝送装置用フレーム同期方式 - Google Patents
データ信号多重伝送装置用フレーム同期方式Info
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- JPH07177136A JPH07177136A JP5321612A JP32161293A JPH07177136A JP H07177136 A JPH07177136 A JP H07177136A JP 5321612 A JP5321612 A JP 5321612A JP 32161293 A JP32161293 A JP 32161293A JP H07177136 A JPH07177136 A JP H07177136A
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- frame synchronization
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- 230000005540 biological transmission Effects 0.000 claims abstract description 65
- 238000001514 detection method Methods 0.000 claims abstract description 39
- 125000004122 cyclic group Chemical group 0.000 claims description 9
- 238000000034 method Methods 0.000 claims description 9
- 238000012217 deletion Methods 0.000 claims 1
- 230000037430 deletion Effects 0.000 claims 1
- 230000008054 signal transmission Effects 0.000 abstract description 11
- 238000000926 separation method Methods 0.000 description 7
- 238000003780 insertion Methods 0.000 description 4
- 230000037431 insertion Effects 0.000 description 4
- 238000010586 diagram Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 1
- 230000001360 synchronised effect Effects 0.000 description 1
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- Detection And Prevention Of Errors In Transmission (AREA)
- Time-Division Multiplex Systems (AREA)
- Synchronisation In Digital Transmission Systems (AREA)
Abstract
(57)【要約】
【目的】チャネル毎にＣＲＣチェックビットを有する複
数のデータ信号を時分割多重し伝送する場合、多重信号
にフレーム同期パターンを新たに付加することなく、対
向側へフレーム同期情報およびチャネル識別情報の伝達
を可能とする。 【構成】複数のチャネル信号送信回路２０−１〜２０−
ｎの内、例えば１つのチャネル信号送信回路２０−１だ
け他チャネルと異なる生成多項式を用いてＣＲＣチェッ
クビットを計算し送信信号に付加する。多重化回路３０
は全チャネルの送信信号を時分割多重し多重化信号３０
１を生成し伝送路３に出力する。多重化信号３０１を受
信する多重化信号受信回路２のフレーム検出回路４０で
は、チャネル信号送信回路２０−１と同じ生成多項式を
用いてＣＲＣ演算を任意のフレーム位相で行い、演算結
果が多重信号の中のビットパターンと一致するようなフ
レーム位相となるまで演算する位相を変えフレーム同期
位相を検出し分離回路５０でフレーム同期位相に従って
分離したデータを送出する。
数のデータ信号を時分割多重し伝送する場合、多重信号
にフレーム同期パターンを新たに付加することなく、対
向側へフレーム同期情報およびチャネル識別情報の伝達
を可能とする。 【構成】複数のチャネル信号送信回路２０−１〜２０−
ｎの内、例えば１つのチャネル信号送信回路２０−１だ
け他チャネルと異なる生成多項式を用いてＣＲＣチェッ
クビットを計算し送信信号に付加する。多重化回路３０
は全チャネルの送信信号を時分割多重し多重化信号３０
１を生成し伝送路３に出力する。多重化信号３０１を受
信する多重化信号受信回路２のフレーム検出回路４０で
は、チャネル信号送信回路２０−１と同じ生成多項式を
用いてＣＲＣ演算を任意のフレーム位相で行い、演算結
果が多重信号の中のビットパターンと一致するようなフ
レーム位相となるまで演算する位相を変えフレーム同期
位相を検出し分離回路５０でフレーム同期位相に従って
分離したデータを送出する。
Description
【０００１】
【産業上の利用分野】本発明はデータ信号多重伝送装置
用フレーム同期方式に関し、特にチャネル毎にサイクリ
ック・リダンダンシー・チェック（Ｃｙｃｌｉｃ Ｒｅ
ｄｕｎｄａｎｃｙ Ｃｈｅｃｋ，以下ＣＲＣと略称す
る）ビットを有する複数のデータ信号を伝送路を介して
送信側から受信側へ多重伝送する場合のフレーム同期を
確保するデータ信号多重伝送装置用フレーム同期方式に
関する。
用フレーム同期方式に関し、特にチャネル毎にサイクリ
ック・リダンダンシー・チェック（Ｃｙｃｌｉｃ Ｒｅ
ｄｕｎｄａｎｃｙ Ｃｈｅｃｋ，以下ＣＲＣと略称す
る）ビットを有する複数のデータ信号を伝送路を介して
送信側から受信側へ多重伝送する場合のフレーム同期を
確保するデータ信号多重伝送装置用フレーム同期方式に
関する。
【０００２】
【従来の技術】従来、この種のデータ信号多重伝送装置
用フレーム同期方式では、フレーム同期を確立するため
にデータ信号とは別にフレーム同期情報を表現するフレ
ーム同期パターンを多重信号の中に付加し伝送してい
た。ゆえに、送信側ではフレーム同期パターンの生成お
よび付加回路を必要とし、受信側ではフレーム同期パタ
ーン検出回路を必要としていた。また、別のデータ信号
多重伝送装置用フレーム同期方式では、フレーム同期パ
ターンを付加しない代りにフレーム同期を確立するため
に受信側でＣＲＣ演算を行い、多重化信号に含まれてい
るＣＲＣチェックビットを検出していた。ゆえに、この
方式では任意のフレーム位相の判別しか出来ないため、
データ信号の中にチャネル識別情報を別に付加してい
た。
用フレーム同期方式では、フレーム同期を確立するため
にデータ信号とは別にフレーム同期情報を表現するフレ
ーム同期パターンを多重信号の中に付加し伝送してい
た。ゆえに、送信側ではフレーム同期パターンの生成お
よび付加回路を必要とし、受信側ではフレーム同期パタ
ーン検出回路を必要としていた。また、別のデータ信号
多重伝送装置用フレーム同期方式では、フレーム同期パ
ターンを付加しない代りにフレーム同期を確立するため
に受信側でＣＲＣ演算を行い、多重化信号に含まれてい
るＣＲＣチェックビットを検出していた。ゆえに、この
方式では任意のフレーム位相の判別しか出来ないため、
データ信号の中にチャネル識別情報を別に付加してい
た。
【０００３】
【発明が解決しようとする課題】この従来のデータ信号
多重伝送装置用フレーム同期方式では、フレーム同期パ
ターンを付加する方式の場合、フレーム同期情報である
フレーム同期パターンをデータ多重信号に付加するため
伝送路容量の全てをデータ信号の伝送のために使用出来
ないうえフレーム同期パターンを検出するための検出回
路を配設しなくてはならず、回路規模が大きくなるとい
う問題点がある。また、多重化信号にフレーム同期パタ
ーンを付加しない場合においても、各チャネルが同じ生
成多項式を用いたＣＲＣチェックビットを有するので多
重信号中でのチャネル個別の位置の識別が出来ず、チャ
ネル識別情報を別途追加するため伝送路容量の全てをデ
ータ伝送に使用出来ないという問題点があった。
多重伝送装置用フレーム同期方式では、フレーム同期パ
ターンを付加する方式の場合、フレーム同期情報である
フレーム同期パターンをデータ多重信号に付加するため
伝送路容量の全てをデータ信号の伝送のために使用出来
ないうえフレーム同期パターンを検出するための検出回
路を配設しなくてはならず、回路規模が大きくなるとい
う問題点がある。また、多重化信号にフレーム同期パタ
ーンを付加しない場合においても、各チャネルが同じ生
成多項式を用いたＣＲＣチェックビットを有するので多
重信号中でのチャネル個別の位置の識別が出来ず、チャ
ネル識別情報を別途追加するため伝送路容量の全てをデ
ータ伝送に使用出来ないという問題点があった。
【０００４】本発明は上述した問題点を解決し、多重信
号中にフレーム同期パターンを新たに付加することなく
伝送路容量の全てをデータ伝送に使用出来るデータ信号
多重伝送装置用フレーム同期方式を提供することにあ
る。
号中にフレーム同期パターンを新たに付加することなく
伝送路容量の全てをデータ伝送に使用出来るデータ信号
多重伝送装置用フレーム同期方式を提供することにあ
る。
【０００５】
【課題を解決するための手段】本発明の方式は、外部か
ら入力したデータ信号に対してサイクリック・リダンダ
ンシー・チェック演算による誤り検出符号を付加してｎ
チャネルの送信信号として出力するチャネル送信信号発
生手段と、前記チャネル送信信号発生手段によるｎチャ
ネルの送信信号を入力しこれを時分割多重した多重化信
号として出力する多重化手段と、前記多重化手段から前
記多重化信号を伝送路を介して受けそのフレーム位相と
チャネル位相とを検出して各チャネル毎に分離する分離
手段と、前記分離手段によるチャネル受信信号を入力し
その誤り検出と誤り検出符号の削除とを行ってデータ信
号を外部へ出力するチャネル受信信号発生手段とを有す
るデータ信号多重伝送装置に用いるフレーム同期方式に
おいて、前記チャネル送信信号発生手段の含む複数チャ
ネルのうち１チャネルだけ他のチャネルとは異なる生成
多項式を用いてサイクリック・リダンダンシー・チェッ
ク演算を行って得られる演算結果を誤り検出符号として
前記データ信号に付加しチャネル送信信号として送出す
るチャネル送信信号発生手段と、前記多重化手段から出
力される多重化信号を前記伝送路を介して受けこの多重
化信号に対して前記１チャネルだけで使用している生成
多項式によりサイクリック・リダンダンシー・チェック
演算を行いその演算結果と一致するようなチャネル位相
を検出するフレーム同期検出手段とを有する。
ら入力したデータ信号に対してサイクリック・リダンダ
ンシー・チェック演算による誤り検出符号を付加してｎ
チャネルの送信信号として出力するチャネル送信信号発
生手段と、前記チャネル送信信号発生手段によるｎチャ
ネルの送信信号を入力しこれを時分割多重した多重化信
号として出力する多重化手段と、前記多重化手段から前
記多重化信号を伝送路を介して受けそのフレーム位相と
チャネル位相とを検出して各チャネル毎に分離する分離
手段と、前記分離手段によるチャネル受信信号を入力し
その誤り検出と誤り検出符号の削除とを行ってデータ信
号を外部へ出力するチャネル受信信号発生手段とを有す
るデータ信号多重伝送装置に用いるフレーム同期方式に
おいて、前記チャネル送信信号発生手段の含む複数チャ
ネルのうち１チャネルだけ他のチャネルとは異なる生成
多項式を用いてサイクリック・リダンダンシー・チェッ
ク演算を行って得られる演算結果を誤り検出符号として
前記データ信号に付加しチャネル送信信号として送出す
るチャネル送信信号発生手段と、前記多重化手段から出
力される多重化信号を前記伝送路を介して受けこの多重
化信号に対して前記１チャネルだけで使用している生成
多項式によりサイクリック・リダンダンシー・チェック
演算を行いその演算結果と一致するようなチャネル位相
を検出するフレーム同期検出手段とを有する。
【０００６】また本発明の方式は、前記チャネル送信信
号発生手段の含む複数チャンネルのうち１チャネルだけ
他のチャネルとは異る生成多項式を用いてサイクリック
・レダンダンシー・チェック演算を行い誤り検出符号を
付加するチャネルをデータ信号多重伝送におけるフレー
ム先頭チャネルとする構成を有する。
号発生手段の含む複数チャンネルのうち１チャネルだけ
他のチャネルとは異る生成多項式を用いてサイクリック
・レダンダンシー・チェック演算を行い誤り検出符号を
付加するチャネルをデータ信号多重伝送におけるフレー
ム先頭チャネルとする構成を有する。
【０００７】
【実施例】次に、本実施例について図面を参照して説明
する。図１は本発明の一実施例の構成図である。本実施
例は送信側としての多重化信号送信回路１と、受信側と
しての多重化信号受信回路２とを備え、図１にはなお送
信側と受信側とを接続する伝送路３を併記して示す。
する。図１は本発明の一実施例の構成図である。本実施
例は送信側としての多重化信号送信回路１と、受信側と
しての多重化信号受信回路２とを備え、図１にはなお送
信側と受信側とを接続する伝送路３を併記して示す。
【０００８】多重化信号送信回路１は、ｎチャンネルご
との送信信号を生成するｎ個のチャンネル信号送信回路
２０−１，２０−２，…，２０−ｎと、これらｎ個のチ
ャンネル信号送信回路と接続し各チャネル送信信号を時
分割多重化した多重化信号３０１を生成する多重化回路
３０とを有する。チャネル信号送信回路２０−１〜２０
−ｎは、チャネルごとのデータ信号を入力しこのデータ
信号に対しＣＲＣ演算を行うＣＲＣ演算回路２１−１〜
２１−ｎと、その演算結果を誤り検出符号として送信デ
ータに付加するＣＲＣコード挿入回路２２−１〜２２−
ｎとを有する。
との送信信号を生成するｎ個のチャンネル信号送信回路
２０−１，２０−２，…，２０−ｎと、これらｎ個のチ
ャンネル信号送信回路と接続し各チャネル送信信号を時
分割多重化した多重化信号３０１を生成する多重化回路
３０とを有する。チャネル信号送信回路２０−１〜２０
−ｎは、チャネルごとのデータ信号を入力しこのデータ
信号に対しＣＲＣ演算を行うＣＲＣ演算回路２１−１〜
２１−ｎと、その演算結果を誤り検出符号として送信デ
ータに付加するＣＲＣコード挿入回路２２−１〜２２−
ｎとを有する。
【０００９】多重化信号受信回路２は、伝送路３を介し
て入力した多重化信号３０１を対象としてフレーム先頭
チャネルの誤り検出符号を検出するＣＲＣコード検出回
路４１と、ＣＲＣコード検出回路６１から出力される検
出信号４１１を入力してフレーム同期信号４２１とチャ
ネル識別信号４２２を発生するフレーム同期カウンタ回
路４２とを有するフレーム検出回路４０と、フレーム検
出回路４０からのチャネル識別信号４２２に従って受信
した多重化信号をチャネル毎のチャネル受信信号に分離
／分配する分離回路５０と、分離されたチャネル受信信
号を入力してＣＲＣ演算を行い送信側で付加された誤り
検出符号７１１−１〜７１１−ｎを検出するＣＲＣ演算
回路７１−１，７１−２，…，７１−ｎと、誤り検出符
号に７１１−１〜７１１−ｎにもとづいてチャネルフレ
ーム同期をとりチャネル受信信号の中に含まれる誤り検
出符号を除去するＣＲＣコード分離回路７２−１，７２
−２，…，７２−ｎとを有するｎチャンネルのチャネル
信号受信回路６０−１，６０−２，…，６０−ｎとを有
する。
て入力した多重化信号３０１を対象としてフレーム先頭
チャネルの誤り検出符号を検出するＣＲＣコード検出回
路４１と、ＣＲＣコード検出回路６１から出力される検
出信号４１１を入力してフレーム同期信号４２１とチャ
ネル識別信号４２２を発生するフレーム同期カウンタ回
路４２とを有するフレーム検出回路４０と、フレーム検
出回路４０からのチャネル識別信号４２２に従って受信
した多重化信号をチャネル毎のチャネル受信信号に分離
／分配する分離回路５０と、分離されたチャネル受信信
号を入力してＣＲＣ演算を行い送信側で付加された誤り
検出符号７１１−１〜７１１−ｎを検出するＣＲＣ演算
回路７１−１，７１−２，…，７１−ｎと、誤り検出符
号に７１１−１〜７１１−ｎにもとづいてチャネルフレ
ーム同期をとりチャネル受信信号の中に含まれる誤り検
出符号を除去するＣＲＣコード分離回路７２−１，７２
−２，…，７２−ｎとを有するｎチャンネルのチャネル
信号受信回路６０−１，６０−２，…，６０−ｎとを有
する。
【００１０】次に、図１の実施例の動作を図２を参照し
ながら説明する。図２は、図１の各部動作を説明するタ
イムチャート図である。
ながら説明する。図２は、図１の各部動作を説明するタ
イムチャート図である。
【００１１】送信側である多重化信号回路１の複数ｎ個
のチャネル信号送信回路２０−１〜２０−ｎのうち、一
つのチャネルだけ他のチャネルとは異なる生成多項式を
用いてＣＲＣ演算を行ってそのチャネルの送信誤り検出
符号とし、この異なる生成多項式を用いたチャネルをフ
レーム先頭チャネルとする。この処理を例えば図１のチ
ャネル信号送信回路２０−１で行うものとし、ＣＲＣ演
算回路２１−１で生成された誤り検出符号２１１−１は
ＣＲＣコード挿入回路２２−１で送信データの中に挿入
されＣＨ（チャネル）１送信信号１１−１となる。これ
を図２のＣＨ１送信信号１１−１で示す。挿入された誤
り検出符号はＣＨ１送信信号１１−１の中のＣ１で示
す。その他のチャネルは、チャネル信号送信回路２０−
２〜２０−ｎで同一の生成多項式を用いてそれぞれのＣ
ＲＣ演算がＣＲＣ演算回路２１−２〜２１−ｎで行われ
生成された誤り検出符号がＣＲＣコード挿入回路２２−
２〜２２−ｎで送信データの中に挿入され図２に示すＣ
Ｈ２送信信号１１−２〜１１−ｎとなり挿入された誤り
検出符号はそれぞれの送信信号の中のＣ２とＣｎで示
す。尚、誤り検出符号が送信データに挿入されるチャネ
ルフレーム周期は図２でも分かるようにチャンネル相互
間でフレーム同期している必要はなく非同期で良い。各
チャネルのチャネル送信信号は多重化回路３０に入力さ
れ時分割多重されて図２の多重化信号３０１となる。各
チャネルの誤り検出符号Ｃ１，Ｃ２，Ｃｎの多重化され
た様子は、同じく図２の多重化信号３０１の中のＣ１，
Ｃ２，Ｃｎで示す。
のチャネル信号送信回路２０−１〜２０−ｎのうち、一
つのチャネルだけ他のチャネルとは異なる生成多項式を
用いてＣＲＣ演算を行ってそのチャネルの送信誤り検出
符号とし、この異なる生成多項式を用いたチャネルをフ
レーム先頭チャネルとする。この処理を例えば図１のチ
ャネル信号送信回路２０−１で行うものとし、ＣＲＣ演
算回路２１−１で生成された誤り検出符号２１１−１は
ＣＲＣコード挿入回路２２−１で送信データの中に挿入
されＣＨ（チャネル）１送信信号１１−１となる。これ
を図２のＣＨ１送信信号１１−１で示す。挿入された誤
り検出符号はＣＨ１送信信号１１−１の中のＣ１で示
す。その他のチャネルは、チャネル信号送信回路２０−
２〜２０−ｎで同一の生成多項式を用いてそれぞれのＣ
ＲＣ演算がＣＲＣ演算回路２１−２〜２１−ｎで行われ
生成された誤り検出符号がＣＲＣコード挿入回路２２−
２〜２２−ｎで送信データの中に挿入され図２に示すＣ
Ｈ２送信信号１１−２〜１１−ｎとなり挿入された誤り
検出符号はそれぞれの送信信号の中のＣ２とＣｎで示
す。尚、誤り検出符号が送信データに挿入されるチャネ
ルフレーム周期は図２でも分かるようにチャンネル相互
間でフレーム同期している必要はなく非同期で良い。各
チャネルのチャネル送信信号は多重化回路３０に入力さ
れ時分割多重されて図２の多重化信号３０１となる。各
チャネルの誤り検出符号Ｃ１，Ｃ２，Ｃｎの多重化され
た様子は、同じく図２の多重化信号３０１の中のＣ１，
Ｃ２，Ｃｎで示す。
【００１２】受信側の多重化信号受信回路２では、フレ
ーム検出回路４０のＣＲＣコード検出回路４１において
一つのチャネルだけで使用している生成多項式を用いて
受信した多重化信号３０１に対し任意のフレーム位相で
ＣＲＣ演算を行い多重化信号中に含まれている誤り検出
符号の検出を行う。検出は、最初、任意のフレーム位相
から行い、誤り検出符号が挿入されている周期であるチ
ャネルフレーム周期単位でＣＲＣ演算を行い、その結果
が受信信号の中のビットパターンと一致すればフレーム
位相を検出したと見なす。もし、受信信号の中に一致す
るビットパターンが検出されない場合は、フレーム位相
不検出と見なしてフレーム位相をずらして改めて同様の
ＣＲＣ演算およびビットパターンの一致検出を行う。こ
の処理をビットパターン一致が検出されるまで繰り返
す。受信多重化信号の中にＣＲＣ演算結果と一致するビ
ットパターンを検出した時、ＣＲＣコード検出回路４１
からフレーム同期カウンタ回路４２へ検出信号４１１が
出力される。これにより、フレーム同期カウンタ回路４
２はリセットされ、受信多重化信号３０１のフレーム位
相と同期した状態になる。さらに、フレーム同期カウン
タ回路４２においてチャネル識別信号４２２を生成しこ
れを分離回路５０へ出力する。
ーム検出回路４０のＣＲＣコード検出回路４１において
一つのチャネルだけで使用している生成多項式を用いて
受信した多重化信号３０１に対し任意のフレーム位相で
ＣＲＣ演算を行い多重化信号中に含まれている誤り検出
符号の検出を行う。検出は、最初、任意のフレーム位相
から行い、誤り検出符号が挿入されている周期であるチ
ャネルフレーム周期単位でＣＲＣ演算を行い、その結果
が受信信号の中のビットパターンと一致すればフレーム
位相を検出したと見なす。もし、受信信号の中に一致す
るビットパターンが検出されない場合は、フレーム位相
不検出と見なしてフレーム位相をずらして改めて同様の
ＣＲＣ演算およびビットパターンの一致検出を行う。こ
の処理をビットパターン一致が検出されるまで繰り返
す。受信多重化信号の中にＣＲＣ演算結果と一致するビ
ットパターンを検出した時、ＣＲＣコード検出回路４１
からフレーム同期カウンタ回路４２へ検出信号４１１が
出力される。これにより、フレーム同期カウンタ回路４
２はリセットされ、受信多重化信号３０１のフレーム位
相と同期した状態になる。さらに、フレーム同期カウン
タ回路４２においてチャネル識別信号４２２を生成しこ
れを分離回路５０へ出力する。
【００１３】分離回路５０は、受信した多重化信号３０
１をフレーム同期カウンタ回路４２から受け取ったチャ
ネル識別信号４２２に従ってチャネル毎に分離し、各チ
ャネルに対応するチャネル信号受信回路６０−１，６０
−２，…，６０−ｎへ分配する。チャネル信号受信回路
６０−１，６０−２，…，６０−ｎのＣＲＣ演算回路７
１−１，７１−２，…，７１−ｎでは、分離回路５０か
ら受け取ったチャネル受信信号に対しそれぞれの生成多
項式を用いてＣＲＣ演算を行いその演算結果とチャネル
受信信号の中のビットパターンとが一致する位相を検出
する。ＣＲＣ演算結果とチャネル受信信号とが一致した
時がチャネルフレーム位相同期状態である。ゆえに、こ
の一致検出信号に合わせてＣＲＣコード分離回路７２−
１，７２−２，…，７２−ｎにおいてチャネル受信信号
から誤り検出符号を分離・除去しチャネルデータのみを
外部へ出力する。
１をフレーム同期カウンタ回路４２から受け取ったチャ
ネル識別信号４２２に従ってチャネル毎に分離し、各チ
ャネルに対応するチャネル信号受信回路６０−１，６０
−２，…，６０−ｎへ分配する。チャネル信号受信回路
６０−１，６０−２，…，６０−ｎのＣＲＣ演算回路７
１−１，７１−２，…，７１−ｎでは、分離回路５０か
ら受け取ったチャネル受信信号に対しそれぞれの生成多
項式を用いてＣＲＣ演算を行いその演算結果とチャネル
受信信号の中のビットパターンとが一致する位相を検出
する。ＣＲＣ演算結果とチャネル受信信号とが一致した
時がチャネルフレーム位相同期状態である。ゆえに、こ
の一致検出信号に合わせてＣＲＣコード分離回路７２−
１，７２−２，…，７２−ｎにおいてチャネル受信信号
から誤り検出符号を分離・除去しチャネルデータのみを
外部へ出力する。
【００１４】
【発明の効果】以上説明したように本発明は、データ信
号多重伝送装置用フレーム同期方式において、多重化す
るＣＲＣチェックビットを有する複数のデータ信号の
内、一つのチャネルだけ他のチャネルとは異なる生成多
項式を用いたＣＲＣチェックビットを付加し受信側でこ
のＣＲＣチェックビットを検出することにより、フレー
ム同期パターンの付加／検出回路が不要となり、かつチ
ャネル識別情報を別途追加する必要が無く、伝送路容量
の全てをデータ信号の伝送のために使用できる効果を有
する。
号多重伝送装置用フレーム同期方式において、多重化す
るＣＲＣチェックビットを有する複数のデータ信号の
内、一つのチャネルだけ他のチャネルとは異なる生成多
項式を用いたＣＲＣチェックビットを付加し受信側でこ
のＣＲＣチェックビットを検出することにより、フレー
ム同期パターンの付加／検出回路が不要となり、かつチ
ャネル識別情報を別途追加する必要が無く、伝送路容量
の全てをデータ信号の伝送のために使用できる効果を有
する。
【図１】本発明の一実施例の構成図である。
【図２】図１の各部動作を示すタイミングチャート図で
ある。
ある。
１ 多重化信号回路 ２ 多重化信号受信回路 ３ 伝送路 ２０−１〜２０−ｎ チャネル信号送信回路 ２１−１〜２１−ｎ ＣＲＣ演算回路 ２２−１〜２２−ｎ ＣＲＣコード挿入回路 ３０ 多重化回路 ４０ フレーム検出回路 ４１ ＣＲＣコード検出回路 ４２ フレーム同期カウンタ回路 ５０ 分離回路 ６０−１〜６０−ｎ チャネル信号受信回路 ７１−１〜７１−ｎ ＣＲＣ演算回路 ７２−１〜７２−ｎ ＣＲＣコード分離回路
Claims (2)
- 【請求項１】 外部から入力したデータ信号に対してサ
イクリック・リダンダンシー・チェック演算による誤り
検出符号を付加してｎチャネルの送信信号として出力す
るチャネル送信信号発生手段と、前記チャネル送信信号
発生手段によるｎチャネルの送信信号を入力しこれを時
分割多重した多重化信号として出力する多重化手段と、
前記多重化手段から前記多重化信号を受けそのフレーム
位相とチャネル位相とを検出して各チャネル毎に分離す
る分離手段と、前記分離手段によるチャネル受信信号を
入力しその誤り検出と誤り検出符号の削除とを行ってデ
ータ信号を外部へ出力するチャネル受信信号発生手段と
を有するデータ信号多重伝送装置に用いるフレーム同期
方式において、前記チャネル送信信号発生手段の含む複
数チャネルのうち１チャネルだけ他のチャネルとは異な
る生成多項式を用いてサイクリック・リダンダンシー・
チェック演算を行って得られる演算結果を誤り検出符号
として前記データ信号に付加しチャネル送信信号として
送出するチャネル送信信号発生手段と、前記多重化手段
から出力される多重化信号を前記伝送路を介して受けこ
の多重化信号に対して前記１チャネルだけで使用してい
る生成多項式によりサイクリック・リダンダンシー・チ
ェック演算を行いその演算結果と一致するようなチャネ
ル位相を検出するフレーム同期検出手段とを有すること
を特徴とするデータ信号多重伝送装置用フレーム同期方
式。 - 【請求項２】 前記チャネル送信信号発生手段の含む複
数チャンネルのうち１チャネルだけ他のチャネルとは異
る生成多項式を用いてサイクリック・レダンダンシー・
チェック演算を行い誤り検出符号を付加するチャネルを
データ信号多重伝送におけるフレーム先頭チャネルとす
ることを特徴とする請求項１記載のデータ信号多重伝送
装置用フレーム同期方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5321612A JP2704106B2 (ja) | 1993-12-21 | 1993-12-21 | データ信号多重伝送装置用フレーム同期方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5321612A JP2704106B2 (ja) | 1993-12-21 | 1993-12-21 | データ信号多重伝送装置用フレーム同期方式 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH07177136A true JPH07177136A (ja) | 1995-07-14 |
| JP2704106B2 JP2704106B2 (ja) | 1998-01-26 |
Family
ID=18134473
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5321612A Expired - Lifetime JP2704106B2 (ja) | 1993-12-21 | 1993-12-21 | データ信号多重伝送装置用フレーム同期方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2704106B2 (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5901160A (en) * | 1996-02-27 | 1999-05-04 | Oki Electric Industry Co., Ltd. | Decoder with an error control adaptively applied on the basis of the estimated position of a slot in a frame |
| JP2003503946A (ja) * | 1999-07-02 | 2003-01-28 | エリクソン インコーポレイテッド | 通信システムにおける柔軟なエラープロテクション方法 |
| JP2005208902A (ja) * | 2004-01-22 | 2005-08-04 | Fujitsu Ltd | データ保証制御装置 |
Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS58220545A (ja) * | 1982-06-16 | 1983-12-22 | Hitachi Ltd | デイジタル伝送方式 |
| JPS58220546A (ja) * | 1982-06-16 | 1983-12-22 | Hitachi Ltd | デイジタルデ−タ伝送方式 |
| JPS63278436A (ja) * | 1987-05-11 | 1988-11-16 | Nec Corp | マルチフレ−ム同期方式 |
-
1993
- 1993-12-21 JP JP5321612A patent/JP2704106B2/ja not_active Expired - Lifetime
Patent Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS58220545A (ja) * | 1982-06-16 | 1983-12-22 | Hitachi Ltd | デイジタル伝送方式 |
| JPS58220546A (ja) * | 1982-06-16 | 1983-12-22 | Hitachi Ltd | デイジタルデ−タ伝送方式 |
| JPS63278436A (ja) * | 1987-05-11 | 1988-11-16 | Nec Corp | マルチフレ−ム同期方式 |
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| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
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| JP2003503946A (ja) * | 1999-07-02 | 2003-01-28 | エリクソン インコーポレイテッド | 通信システムにおける柔軟なエラープロテクション方法 |
| JP2005208902A (ja) * | 2004-01-22 | 2005-08-04 | Fujitsu Ltd | データ保証制御装置 |
Also Published As
| Publication number | Publication date |
|---|---|
| JP2704106B2 (ja) | 1998-01-26 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 19970909 |