JPH07184376A - インバータ装置 - Google Patents
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- JPH07184376A JPH07184376A JP5347423A JP34742393A JPH07184376A JP H07184376 A JPH07184376 A JP H07184376A JP 5347423 A JP5347423 A JP 5347423A JP 34742393 A JP34742393 A JP 34742393A JP H07184376 A JPH07184376 A JP H07184376A
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- 239000004065 semiconductor Substances 0.000 claims description 18
- 239000000872 buffer Substances 0.000 abstract description 13
- 238000007599 discharging Methods 0.000 abstract description 7
- 238000010586 diagram Methods 0.000 description 8
- 230000003321 amplification Effects 0.000 description 2
- 230000007423 decrease Effects 0.000 description 2
- 238000003199 nucleic acid amplification method Methods 0.000 description 2
- 238000004904 shortening Methods 0.000 description 2
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- 238000001816 cooling Methods 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 230000010354 integration Effects 0.000 description 1
- 230000001052 transient effect Effects 0.000 description 1
- 230000007704 transition Effects 0.000 description 1
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- Inverter Devices (AREA)
Abstract
(57)【要約】
【目的】 スイッチング時間を最小としスイッチング損
失を低減する。 【構成】 インバータ出力電流信号が減少して電圧が低
下し比較基準電圧ｖaより低くなると、コンパレータ１
６ａが作動し、バッファ１４と１４ａでスイッチ素子２
ａを駆動する。ゲートの充放電電流はゲート抵抗１５と
１５ａを通る。ゲート抵抗１５と１５ａは並列接続さ
れ、見かけ上ゲート抵抗を小さくしたことになり、スイ
ッチ素子２ａ入力容量の充放電時間が短くなってスイッ
チング時間が短縮される。さらに、比較基準電圧ｖb...
より低くなるコンパレータ１６ｂ・・・が順に作動し、
スイッチ素子２ａのスイッチング時間が短縮され、スイ
ッチング損失を一層低減できる。サージ電圧に関しては
スイッチング時間が短縮されるが、スイッチング時のイ
ンバータ出力電流信号も減少しているので、サージ電圧
は略同じレベルに保たれる。
失を低減する。 【構成】 インバータ出力電流信号が減少して電圧が低
下し比較基準電圧ｖaより低くなると、コンパレータ１
６ａが作動し、バッファ１４と１４ａでスイッチ素子２
ａを駆動する。ゲートの充放電電流はゲート抵抗１５と
１５ａを通る。ゲート抵抗１５と１５ａは並列接続さ
れ、見かけ上ゲート抵抗を小さくしたことになり、スイ
ッチ素子２ａ入力容量の充放電時間が短くなってスイッ
チング時間が短縮される。さらに、比較基準電圧ｖb...
より低くなるコンパレータ１６ｂ・・・が順に作動し、
スイッチ素子２ａのスイッチング時間が短縮され、スイ
ッチング損失を一層低減できる。サージ電圧に関しては
スイッチング時間が短縮されるが、スイッチング時のイ
ンバータ出力電流信号も減少しているので、サージ電圧
は略同じレベルに保たれる。
Description
【０００１】
【産業上の利用分野】本発明は、ゲート駆動回路にイン
バータ出力電流信号情報を与え、該ゲート駆動回路の出
力インピーダンスがインバータ出力電流信号に基づいて
決定されるように構成して、ＭＯＳ入力型半導体スイッ
チ素子のスイッチング時間を制御するようにしたインバ
ータ装置に関する。
バータ出力電流信号情報を与え、該ゲート駆動回路の出
力インピーダンスがインバータ出力電流信号に基づいて
決定されるように構成して、ＭＯＳ入力型半導体スイッ
チ素子のスイッチング時間を制御するようにしたインバ
ータ装置に関する。
【０００２】
【従来の技術】図１は従来のインバータ装置によるモー
タ駆動のシステム図である。直流電源１は、それぞれＭ
ＯＳ入力型半導体スイッチ素子（以下単にスイッチ素子
という）２ａ〜２ｃ及び３ａ〜３ｃに接続されている。
スイッチ素子２ａ〜２ｃ及び３ａ〜３ｃの通電状態をそ
れぞれ切換え制御することにより、直流電源１から３相
モータ４への電流路が切換えられている。また、スイッ
チ素子２ａ〜２ｃ及び３ａ〜３ｃの電流の入力端子と出
力端子には、それぞれ並列にダイオード５ａ〜５ｃ及び
６ａ〜６ｃが逆方向接続されている。
タ駆動のシステム図である。直流電源１は、それぞれＭ
ＯＳ入力型半導体スイッチ素子（以下単にスイッチ素子
という）２ａ〜２ｃ及び３ａ〜３ｃに接続されている。
スイッチ素子２ａ〜２ｃ及び３ａ〜３ｃの通電状態をそ
れぞれ切換え制御することにより、直流電源１から３相
モータ４への電流路が切換えられている。また、スイッ
チ素子２ａ〜２ｃ及び３ａ〜３ｃの電流の入力端子と出
力端子には、それぞれ並列にダイオード５ａ〜５ｃ及び
６ａ〜６ｃが逆方向接続されている。
【０００３】電流センサ７ａ，７ｂは、それぞれＵ相、
Ｗ相のインバータ出力電流を検出して、電流信号増幅回
路８に送信している。そして、電流信号増幅回路８はコ
ントローラ９に電流信号を送信している。コントローラ
９は、電流センサ７ａ，７ｂのインバータ出力電流信号
及びアクセルセンサ１０のアクセル信号に基づいて、３
相モータ４が所定のトルクを出力するように、ゲート駆
動回路１１ａ〜１１ｆを駆動する。そして、ゲート駆動
回路１１ａ〜１１ｆは、コントローラ９からの駆動信号
をトリガーにして、それぞれのスイッチ素子２ａ〜２ｃ
及び３ａ〜３ｃを駆動する。
Ｗ相のインバータ出力電流を検出して、電流信号増幅回
路８に送信している。そして、電流信号増幅回路８はコ
ントローラ９に電流信号を送信している。コントローラ
９は、電流センサ７ａ，７ｂのインバータ出力電流信号
及びアクセルセンサ１０のアクセル信号に基づいて、３
相モータ４が所定のトルクを出力するように、ゲート駆
動回路１１ａ〜１１ｆを駆動する。そして、ゲート駆動
回路１１ａ〜１１ｆは、コントローラ９からの駆動信号
をトリガーにして、それぞれのスイッチ素子２ａ〜２ｃ
及び３ａ〜３ｃを駆動する。
【０００４】図２は上記ゲート駆動回路１１ａ〜１１ｆ
の詳細を示したものである。バッファ１２はコントロー
ラ９からの駆動信号でフォトカプラ１３を駆動し、フォ
トカプラ１３はバッファ１４を駆動する。そして、バッ
ファ１４はゲート抵抗１５を通じて、それぞれのスイッ
チ素子２ａ〜２ｃ及び３ａ〜３ｃのゲート容量に対し充
放電する。
の詳細を示したものである。バッファ１２はコントロー
ラ９からの駆動信号でフォトカプラ１３を駆動し、フォ
トカプラ１３はバッファ１４を駆動する。そして、バッ
ファ１４はゲート抵抗１５を通じて、それぞれのスイッ
チ素子２ａ〜２ｃ及び３ａ〜３ｃのゲート容量に対し充
放電する。
【０００５】上記構成の従来のインバータ装置では、ス
イッチ素子を駆動する場合にゲート駆動回路のゲート抵
抗の抵抗値を大きくしてスイッチング時間を長くし、こ
れによりスイッチングサージ電圧（以下サージ電圧とい
う）を抑制していた。これはサージ電圧が大きすぎ許容
範囲を超えると、スイッチ素子が過電圧破壊するためで
ある。スイッチング時間は、図３（ａ）に示すスイッチ
素子のターンオン時間及びターンオフ時間であり、特に
このターンオフ時間がサージ電圧に関与する（図３
（ｂ）参照）。サージ電圧△Ｖは、式△Ｖ＝−Ｌ・ｄＩ
／ｄｔ（Ｌ・・・配線インダクタンス、Ｉ・・・スイッ
チ素子の電流）で示されるように、原理的にスイッチン
グ時間（ターンオフ時間）が短いとサージ電圧が大きく
なることが分かる。一方、スイッチ素子のスイッチング
時間は、入力容量の充放電時間により決定されるため、
上記したようにゲート駆動回路のゲート抵抗の抵抗値を
大きくし、スイッチング時間を長くして過電圧破壊を防
止している。
イッチ素子を駆動する場合にゲート駆動回路のゲート抵
抗の抵抗値を大きくしてスイッチング時間を長くし、こ
れによりスイッチングサージ電圧（以下サージ電圧とい
う）を抑制していた。これはサージ電圧が大きすぎ許容
範囲を超えると、スイッチ素子が過電圧破壊するためで
ある。スイッチング時間は、図３（ａ）に示すスイッチ
素子のターンオン時間及びターンオフ時間であり、特に
このターンオフ時間がサージ電圧に関与する（図３
（ｂ）参照）。サージ電圧△Ｖは、式△Ｖ＝−Ｌ・ｄＩ
／ｄｔ（Ｌ・・・配線インダクタンス、Ｉ・・・スイッ
チ素子の電流）で示されるように、原理的にスイッチン
グ時間（ターンオフ時間）が短いとサージ電圧が大きく
なることが分かる。一方、スイッチ素子のスイッチング
時間は、入力容量の充放電時間により決定されるため、
上記したようにゲート駆動回路のゲート抵抗の抵抗値を
大きくし、スイッチング時間を長くして過電圧破壊を防
止している。
【０００６】しかし、上記のようにスイッチング時間を
長くすると、スイッチング損失が増加する。スイッチン
グ損失とは、スイッチ素子がオンからオフ、若しくはオ
フからオンに遷移する過渡領域での損失であり、インバ
ータの損失の大半を占める。スイッチング損失Ｐは以下
の式により算出される。
長くすると、スイッチング損失が増加する。スイッチン
グ損失とは、スイッチ素子がオンからオフ、若しくはオ
フからオンに遷移する過渡領域での損失であり、インバ
ータの損失の大半を占める。スイッチング損失Ｐは以下
の式により算出される。
【０００７】
【数１】 ここで積分区間Ｔ１〜Ｔ２は、前記図３（ｂ）に示すス
イッチング時間（ターンオフ時間）である。
イッチング時間（ターンオフ時間）である。
【０００８】
【発明が解決しようとする課題】しかしながら、上記し
た従来のインバータ装置では、スイッチ素子の入力容量
を充電する回路の出力インピーダンスが固定されている
ため、スイッチ素子に流れる電流が最大値となる場合を
考慮してスイッチング時間を設定しなければならない。
このため、最大値以下の電流が流れるときスイッチング
時間を短くして、スイッチング損失を低減することがで
きないという問題点がある。本発明は、サージ電圧がイ
ンバータ出力電流と比例関係にあることに着目してなさ
れたもので、スイッチ素子に流れる電流に応じて、入力
容量を充電する回路の出力インピーダンスを制御するこ
とにより、スイッチング時間を最小としスイッチング損
失を低減することができるインバータ装置を提供するこ
とを目的とするものである。
た従来のインバータ装置では、スイッチ素子の入力容量
を充電する回路の出力インピーダンスが固定されている
ため、スイッチ素子に流れる電流が最大値となる場合を
考慮してスイッチング時間を設定しなければならない。
このため、最大値以下の電流が流れるときスイッチング
時間を短くして、スイッチング損失を低減することがで
きないという問題点がある。本発明は、サージ電圧がイ
ンバータ出力電流と比例関係にあることに着目してなさ
れたもので、スイッチ素子に流れる電流に応じて、入力
容量を充電する回路の出力インピーダンスを制御するこ
とにより、スイッチング時間を最小としスイッチング損
失を低減することができるインバータ装置を提供するこ
とを目的とするものである。
【０００９】
【課題を解決するための手段】上記の目的を達成するた
めの請求項１記載の本発明のインバータ装置は、直流電
源と、該直流電源に直列接続されたスイッチ素子で構成
された電力変換器と、前記スイッチ素子の直列接続点を
それぞれ出力端子としたインバータ装置において、イン
バータ出力電流若しくは前記スイッチ素子に流れる電流
に応じて、直接前記スイッチ素子のスイッチング時間を
制御可能にしたことを特徴とする。
めの請求項１記載の本発明のインバータ装置は、直流電
源と、該直流電源に直列接続されたスイッチ素子で構成
された電力変換器と、前記スイッチ素子の直列接続点を
それぞれ出力端子としたインバータ装置において、イン
バータ出力電流若しくは前記スイッチ素子に流れる電流
に応じて、直接前記スイッチ素子のスイッチング時間を
制御可能にしたことを特徴とする。
【００１０】上記目的を達成するための請求項２記載の
本発明は、請求項１において、スイッチ素子のスイッチ
ング時間を連続的に制御可能にしたことを特徴とする。
本発明は、請求項１において、スイッチ素子のスイッチ
ング時間を連続的に制御可能にしたことを特徴とする。
【００１１】また、上記の目的を達成するための請求項
３記載の本発明のインバータ装置は、直流電源と、該直
流電源に直列接続されたスイッチ素子で構成された電力
変換器と、前記スイッチ素子の直列接続点をそれぞれ出
力端子としたインバータ装置において、インバータ出力
電流若しくは前記ＭＯＳ入力型半導体スイッチ素子に流
れる電流に応じて行う該ＭＯＳ入力型半導体スイッチ素
子のスイッチング時間の制御を、ゲート抵抗を並列に接
続したゲート駆動回路でゲート容量の充放電経路を切換
えることにより行うことを特徴とする。
３記載の本発明のインバータ装置は、直流電源と、該直
流電源に直列接続されたスイッチ素子で構成された電力
変換器と、前記スイッチ素子の直列接続点をそれぞれ出
力端子としたインバータ装置において、インバータ出力
電流若しくは前記ＭＯＳ入力型半導体スイッチ素子に流
れる電流に応じて行う該ＭＯＳ入力型半導体スイッチ素
子のスイッチング時間の制御を、ゲート抵抗を並列に接
続したゲート駆動回路でゲート容量の充放電経路を切換
えることにより行うことを特徴とする。
【００１２】さらに、上記の目的を達成するための請求
項４記載の本発明のインバータ装置は、直流電源と、該
直流電源に直列接続されたスイッチ素子で構成された電
力変換器と、前記スイッチ素子の直列接続点をそれぞれ
出力端子としたインバータ装置において、インバータ出
力電流若しくは前記スイッチ素子に流れる電流の振幅情
報をゲート駆動回路に送信し、該ゲート駆動回路の出力
インピーダンスが前記ゲート駆動回路に送信された電流
信号情報に基づいて決定されるように構成して、前記ス
イッチ素子のスイッチング時間を制御可能にしたことを
特徴とする。
項４記載の本発明のインバータ装置は、直流電源と、該
直流電源に直列接続されたスイッチ素子で構成された電
力変換器と、前記スイッチ素子の直列接続点をそれぞれ
出力端子としたインバータ装置において、インバータ出
力電流若しくは前記スイッチ素子に流れる電流の振幅情
報をゲート駆動回路に送信し、該ゲート駆動回路の出力
インピーダンスが前記ゲート駆動回路に送信された電流
信号情報に基づいて決定されるように構成して、前記ス
イッチ素子のスイッチング時間を制御可能にしたことを
特徴とする。
【００１３】
【作用及び発明の効果】上記構成の本発明のインバータ
装置は、インバータ出力電流若しくは前記スイッチ素子
に流れる電流に応じて、直接前記スイッチ素子のスイッ
チング時間を制御することができる。また、請求項３若
しくは請求項４の発明は、ゲート駆動回路の出力インピ
ーダンスを、インバータ出力電流若しくは前記スイッチ
素子に流れる電流に基づいて制御する。従って、スイッ
チ素子がサージ電圧によって過電圧破壊を生じない範囲
で、スイッチ素子のスイッチング時間を短縮でき、スイ
ッチング損失を低減できる。特に電気自動車用インバー
タ装置において、スイッチング損失の低減は走行距離の
延長、インバータ冷却装置の負荷を低減してコストダウ
ンが可能になるとともに、信頼性の向上を図ることがで
きる等の優れた効果をもたらすことができる。
装置は、インバータ出力電流若しくは前記スイッチ素子
に流れる電流に応じて、直接前記スイッチ素子のスイッ
チング時間を制御することができる。また、請求項３若
しくは請求項４の発明は、ゲート駆動回路の出力インピ
ーダンスを、インバータ出力電流若しくは前記スイッチ
素子に流れる電流に基づいて制御する。従って、スイッ
チ素子がサージ電圧によって過電圧破壊を生じない範囲
で、スイッチ素子のスイッチング時間を短縮でき、スイ
ッチング損失を低減できる。特に電気自動車用インバー
タ装置において、スイッチング損失の低減は走行距離の
延長、インバータ冷却装置の負荷を低減してコストダウ
ンが可能になるとともに、信頼性の向上を図ることがで
きる等の優れた効果をもたらすことができる。
【００１４】
（第１実施例）本発明の第１実施例を添付図面に基づい
て説明する。図４は本発明のインバータ装置によるモー
タ駆動のシステム図である。前記図１に示す従来のもの
とは、電流信号増幅回路８から電流信号をコントローラ
９のみならず、直接ゲート駆動回路２１ａ〜２１ｆにも
送信するようにした点で相違する。本発明のインバータ
装置のゲート駆動回路２１ａ〜２１ｆはそれぞれ同一の
構成であるため、スイッチ素子２ａを駆動するゲート駆
動回路２１ａの詳細を図５に示す。
て説明する。図４は本発明のインバータ装置によるモー
タ駆動のシステム図である。前記図１に示す従来のもの
とは、電流信号増幅回路８から電流信号をコントローラ
９のみならず、直接ゲート駆動回路２１ａ〜２１ｆにも
送信するようにした点で相違する。本発明のインバータ
装置のゲート駆動回路２１ａ〜２１ｆはそれぞれ同一の
構成であるため、スイッチ素子２ａを駆動するゲート駆
動回路２１ａの詳細を図５に示す。
【００１５】ゲート駆動回路２１ａは従来のものと同
様、電流信号増幅回路８→コントローラ９→バッファ１
２→フォトカプラ１３→バッファ１４→ゲート抵抗１５
→スイッチ素子２ａの順で駆動信号を送信して、ゲート
容量を充放電する充放電経路２２と、電流信号増幅回路
８とスイッチ素子２ａとの間を、それぞれコンパレータ
１６ａ〜１６ｎ→バッファ１２ａ〜１２ｎ→フォトカプ
ラ１３ａ〜１３ｎ→ＡＮＤ回路１７ａ〜１７ｎ→バッフ
ァ１４ａ〜１４ｎ→ゲート抵抗１５ａ〜１５ｎの順で接
続するとともに、各経路を並列に接続してなり、前記接
続の順に駆動信号を送信してゲート容量を充放電する充
放電経路２２ａ〜２２ｎとから構成されている。そし
て、各コンパレータ１６ａ〜１６ｎには、充放電経路２
２ａ〜２２ｎの添字ａ〜ｎの順で電圧を低くした比較基
準電圧ｖa〜ｖnが設定されている。また、充放電経路２
２のフォトカプラ１３の出力は、各充放電経路２２ａ〜
２２ｎのＡＮＤ回路１７ａ〜１７ｎに入力されている。
様、電流信号増幅回路８→コントローラ９→バッファ１
２→フォトカプラ１３→バッファ１４→ゲート抵抗１５
→スイッチ素子２ａの順で駆動信号を送信して、ゲート
容量を充放電する充放電経路２２と、電流信号増幅回路
８とスイッチ素子２ａとの間を、それぞれコンパレータ
１６ａ〜１６ｎ→バッファ１２ａ〜１２ｎ→フォトカプ
ラ１３ａ〜１３ｎ→ＡＮＤ回路１７ａ〜１７ｎ→バッフ
ァ１４ａ〜１４ｎ→ゲート抵抗１５ａ〜１５ｎの順で接
続するとともに、各経路を並列に接続してなり、前記接
続の順に駆動信号を送信してゲート容量を充放電する充
放電経路２２ａ〜２２ｎとから構成されている。そし
て、各コンパレータ１６ａ〜１６ｎには、充放電経路２
２ａ〜２２ｎの添字ａ〜ｎの順で電圧を低くした比較基
準電圧ｖa〜ｖnが設定されている。また、充放電経路２
２のフォトカプラ１３の出力は、各充放電経路２２ａ〜
２２ｎのＡＮＤ回路１７ａ〜１７ｎに入力されている。
【００１６】上記構成のゲート駆動回路２１ａの作動を
以下に説明する。電流信号増幅回路８からインバータ出
力電流信号が、各充放電経路２２ａ〜２２ｎのコンパレ
ータ１６ａ〜１６ｎに直接入力される。各コンパレータ
１６ａ〜１６ｎでは、それぞれ設定された比較基準電圧
ｖa〜ｖnと比較する。インバータ出力電流信号の電圧
が、各比較基準電圧ｖa〜ｖnより大きい場合は、各フォ
トカプラ１３ａ〜１３ｎは駆動されない。このため、コ
ントローラ９から駆動信号が入力された場合は、充放電
経路２２のみが成立し、バッファ１４によりスイッチ素
子２ａが駆動される。このとき、ゲートの充放電電流は
ゲート抵抗１５を通る。
以下に説明する。電流信号増幅回路８からインバータ出
力電流信号が、各充放電経路２２ａ〜２２ｎのコンパレ
ータ１６ａ〜１６ｎに直接入力される。各コンパレータ
１６ａ〜１６ｎでは、それぞれ設定された比較基準電圧
ｖa〜ｖnと比較する。インバータ出力電流信号の電圧
が、各比較基準電圧ｖa〜ｖnより大きい場合は、各フォ
トカプラ１３ａ〜１３ｎは駆動されない。このため、コ
ントローラ９から駆動信号が入力された場合は、充放電
経路２２のみが成立し、バッファ１４によりスイッチ素
子２ａが駆動される。このとき、ゲートの充放電電流は
ゲート抵抗１５を通る。
【００１７】ところが、インバータ出力電流信号が減少
して電圧が低下し比較基準電圧ｖaより低くなると、コ
ンパレータ１６ａが作動して充放電経路２２ａも成立
し、バッファ１４と１４ａでスイッチ素子２ａを駆動す
る。このとき、ゲートの充放電電流はゲート抵抗１５と
１５ａを通る。この場合、ゲート抵抗１５と１５ａは並
列接続されたことになり、見かけ上ゲート抵抗を小さく
したことになる。ゲート抵抗が小さくなると、スイッチ
素子２ａ入力容量の充放電時間が短くなってスイッチン
グ時間が短縮される。スイッチング時間が短くなれば、
スイッチング損失を低減できる。この場合、サージ電圧
に関してはスイッチング時間が短縮されるが、スイッチ
ング時のインバータ出力電流信号も減少しているので、
サージ電圧は略同じレベルに保たれる。
して電圧が低下し比較基準電圧ｖaより低くなると、コ
ンパレータ１６ａが作動して充放電経路２２ａも成立
し、バッファ１４と１４ａでスイッチ素子２ａを駆動す
る。このとき、ゲートの充放電電流はゲート抵抗１５と
１５ａを通る。この場合、ゲート抵抗１５と１５ａは並
列接続されたことになり、見かけ上ゲート抵抗を小さく
したことになる。ゲート抵抗が小さくなると、スイッチ
素子２ａ入力容量の充放電時間が短くなってスイッチン
グ時間が短縮される。スイッチング時間が短くなれば、
スイッチング損失を低減できる。この場合、サージ電圧
に関してはスイッチング時間が短縮されるが、スイッチ
ング時のインバータ出力電流信号も減少しているので、
サージ電圧は略同じレベルに保たれる。
【００１８】さらに、インバータ出力電流信号が減少し
て電圧が低下していくと、比較基準電圧ｖb...ｖnより
低くなるコンパレータ１６ｂ・・・１６ｎが順に作動し
て充放電経路２２ｂ・・・２２ｎが成立し、見かけ上の
ゲート抵抗が小さくなるため、スイッチ素子２ａのスイ
ッチング時間が短縮され、スイッチング損失を一層低減
できる。この場合もサージ電圧は、スイッチング時のイ
ンバータ出力電流信号が減少されることにより、略同じ
レベルに保たれる。尚、ゲート駆動回路２１ｂ〜２１ｆ
の作動も上記と同様である。
て電圧が低下していくと、比較基準電圧ｖb...ｖnより
低くなるコンパレータ１６ｂ・・・１６ｎが順に作動し
て充放電経路２２ｂ・・・２２ｎが成立し、見かけ上の
ゲート抵抗が小さくなるため、スイッチ素子２ａのスイ
ッチング時間が短縮され、スイッチング損失を一層低減
できる。この場合もサージ電圧は、スイッチング時のイ
ンバータ出力電流信号が減少されることにより、略同じ
レベルに保たれる。尚、ゲート駆動回路２１ｂ〜２１ｆ
の作動も上記と同様である。
【００１９】図６は、駆動信号の充放電経路２２と充放
電経路２２ａ〜２２ｃから構成したゲート駆動回路のタ
イミングチャートである。図６（Ａ）（以下図６を省略
する）は、インバータ出力電流信号と三角波との比較に
よりＰＷＭ波形を生成して、コントローラ９から出力さ
れる駆動信号を示す。（Ｂ）はインバータ出力電流信号
と比較基準電圧ｖa〜ｖcの比較を示したものである。
（Ｃ）はコンパレータ１６ａ〜１６ｃの作動を示したも
のである。また、（Ｄ）は充放電経路２２と充放電経路
２２ａ〜２２ｃの作動状態を示したものである。
電経路２２ａ〜２２ｃから構成したゲート駆動回路のタ
イミングチャートである。図６（Ａ）（以下図６を省略
する）は、インバータ出力電流信号と三角波との比較に
よりＰＷＭ波形を生成して、コントローラ９から出力さ
れる駆動信号を示す。（Ｂ）はインバータ出力電流信号
と比較基準電圧ｖa〜ｖcの比較を示したものである。
（Ｃ）はコンパレータ１６ａ〜１６ｃの作動を示したも
のである。また、（Ｄ）は充放電経路２２と充放電経路
２２ａ〜２２ｃの作動状態を示したものである。
【００２０】図７は、スイッチ素子２ａ〜２ｃ及び３ａ
〜３ｃのオン・オフ状態における本実施例と従来例の場
合のサージ電圧レベルを比較したものである。従来例の
場合は、サージ電圧レベルは上記図６で示したインバー
タ出力電流信号の絶対値に略比例した大きさとなる。従
って、許容レベルとの間に余裕がありスイッチング時間
の短縮の余地がある。これに対して、本実施例の場合は
上記したように、インバータ出力電流信号の大きさに応
じてスイッチング時間の短縮を図り、サージ電圧レベル
が略一定となるように制御するもので、スイッチング時
間の最適化によりスイッチング損失を低減できる。
〜３ｃのオン・オフ状態における本実施例と従来例の場
合のサージ電圧レベルを比較したものである。従来例の
場合は、サージ電圧レベルは上記図６で示したインバー
タ出力電流信号の絶対値に略比例した大きさとなる。従
って、許容レベルとの間に余裕がありスイッチング時間
の短縮の余地がある。これに対して、本実施例の場合は
上記したように、インバータ出力電流信号の大きさに応
じてスイッチング時間の短縮を図り、サージ電圧レベル
が略一定となるように制御するもので、スイッチング時
間の最適化によりスイッチング損失を低減できる。
【００２１】（第２実施例）図８に第２実施例に係るゲ
ート駆動回路を示す。ゲート駆動回路３１は、各スイッ
チ素子２ａ〜２ｃ，３ａ〜３ｃに設けられ、それぞれ電
流信号増幅回路８→コントローラ９→バッファ１２→フ
ォトカプラ１３→バッファ１４→電流源３２→スイッチ
素子２ａ〜２ｃ，３ａ〜３ｃの順で接続する。そして、
コントローラ９が電流源３２にオン・オフ信号（スイッ
チ素子のオン・オフ信号）を与える。電流信号増幅回路
８から出力されるインバータ出力電流信号により、電流
源３２の出力電流値を決定される。すなわち、電流源３
２の出力インピーダンスは、インバータ出力電流信号に
より決定され、インバータ出力電流が最大のとき、スイ
ッチ素子のゲート容量をゆっくり充電するように、ま
た、インバータ出力電流が小さくなるに連れて、ゲート
容量を素早く充電するようにして、サージ電圧の許容レ
ベルを超えないようにする。従って、スイッチング時間
が短縮され、スイッチング損失を低減できる。
ート駆動回路を示す。ゲート駆動回路３１は、各スイッ
チ素子２ａ〜２ｃ，３ａ〜３ｃに設けられ、それぞれ電
流信号増幅回路８→コントローラ９→バッファ１２→フ
ォトカプラ１３→バッファ１４→電流源３２→スイッチ
素子２ａ〜２ｃ，３ａ〜３ｃの順で接続する。そして、
コントローラ９が電流源３２にオン・オフ信号（スイッ
チ素子のオン・オフ信号）を与える。電流信号増幅回路
８から出力されるインバータ出力電流信号により、電流
源３２の出力電流値を決定される。すなわち、電流源３
２の出力インピーダンスは、インバータ出力電流信号に
より決定され、インバータ出力電流が最大のとき、スイ
ッチ素子のゲート容量をゆっくり充電するように、ま
た、インバータ出力電流が小さくなるに連れて、ゲート
容量を素早く充電するようにして、サージ電圧の許容レ
ベルを超えないようにする。従って、スイッチング時間
が短縮され、スイッチング損失を低減できる。
【００２２】図９は、第２実施例の場合のインバータ出
力電流信号と出力インピーダンスとの関係を示し、併せ
て前記図５に示した第１実施例のゲート駆動回路の場合
の出力インピーダンスを示したものである。また、図１
０は同じくインバータ出力電流信号とサージ電圧レベル
との関係を示したもので、インバータ出力電流信号の周
波数は、数百Ｈｚであり、キャリア周波数（ＰＷＭ波形
を生成する三角波の周波数）は数十ｋＨｚでかなり周波
数が高いので、第１実施例の場合でもサージ電圧レベル
は、図示するように許容レベル以下となる期間が長く、
さらなるスイッチング時間の短縮化の余地がある。
力電流信号と出力インピーダンスとの関係を示し、併せ
て前記図５に示した第１実施例のゲート駆動回路の場合
の出力インピーダンスを示したものである。また、図１
０は同じくインバータ出力電流信号とサージ電圧レベル
との関係を示したもので、インバータ出力電流信号の周
波数は、数百Ｈｚであり、キャリア周波数（ＰＷＭ波形
を生成する三角波の周波数）は数十ｋＨｚでかなり周波
数が高いので、第１実施例の場合でもサージ電圧レベル
は、図示するように許容レベル以下となる期間が長く、
さらなるスイッチング時間の短縮化の余地がある。
【００２３】本実施例のゲート駆動回路３１は、電流源
３２にアナログの電流信号を送信して、スイッチング時
間を連続的に制御するもので、充放電経路を複数形成す
る必要がないから低コストとすることができる。
３２にアナログの電流信号を送信して、スイッチング時
間を連続的に制御するもので、充放電経路を複数形成す
る必要がないから低コストとすることができる。
【図１】従来のインバータ装置によるモータ駆動のシス
テム図である。
テム図である。
【図２】従来のインバータ装置のゲート駆動回路図であ
る。
る。
【図３】スイッチング時間及びサージ電圧の説明図であ
る。
る。
【図４】第１実施例のインバータ装置によるモータ駆動
のシステム図である。
のシステム図である。
【図５】第１実施例のインバータ装置のゲート駆動回路
図である。
図である。
【図６】ゲート駆動回路のタイミングチャートである。
【図７】従来例と本発明のサージ電圧を比較したタイミ
ングチャートである。
ングチャートである。
【図８】第２実施例のゲート駆動回路の回路図である。
【図９】第２実施例におけるインバータ出力電流信号と
出力インピーダンスの関係を示したタイミングチャート
である。
出力インピーダンスの関係を示したタイミングチャート
である。
【図１０】第２実施例におけるインバータ出力電流信号
とサージ電圧レベルの関係を示したタイミングチャート
である。
とサージ電圧レベルの関係を示したタイミングチャート
である。
１ 直流電源 ２ａ〜２ｃ，３ａ〜３ｃ ＭＯＳ入力型半導体スイッチ
素子 ４ ３相モータ ８ 電流信号増幅回路 ９ コントローラ １２ａ〜１２ｎ，１４ａ〜１４ｎ バッファ １３ａ〜１３ｎ フォトカプラ １５，１５ａ〜１５ｎ ゲート抵抗 １６ａ〜１６ｎ コンパレータ １７ａ〜１７ｎ ＡＮＤ回路 ２２，２２ａ〜２２ｎ 充放電経路 ２１ａ〜２１ｆ ゲート駆動回路 ３２ 電流源
素子 ４ ３相モータ ８ 電流信号増幅回路 ９ コントローラ １２ａ〜１２ｎ，１４ａ〜１４ｎ バッファ １３ａ〜１３ｎ フォトカプラ １５，１５ａ〜１５ｎ ゲート抵抗 １６ａ〜１６ｎ コンパレータ １７ａ〜１７ｎ ＡＮＤ回路 ２２，２２ａ〜２２ｎ 充放電経路 ２１ａ〜２１ｆ ゲート駆動回路 ３２ 電流源
Claims (4)
- 【請求項１】 直流電源と、該直流電源に直列接続され
たＭＯＳ入力型半導体スイッチ素子で構成された電力変
換器と、前記ＭＯＳ入力型半導体スイッチ素子の直列接
続点をそれぞれ出力端子としたインバータ装置におい
て、 インバータ出力電流若しくは前記ＭＯＳ入力型半導体ス
イッチ素子に流れる電流に応じて、前記ＭＯＳ入力型半
導体スイッチ素子のスイッチング時間を直接制御可能に
したことを特徴とするインバータ装置。 - 【請求項２】 ＭＯＳ入力型半導体スイッチ素子のスイ
ッチング時間を連続的に制御可能にしたことを特徴とす
る請求項１記載のインバータ装置。 - 【請求項３】 直流電源と、該直流電源に直列接続され
たＭＯＳ入力型半導体スイッチ素子で構成された電力変
換器と、前記ＭＯＳ入力型半導体スイッチ素子の直列接
続点をそれぞれ出力端子としたインバータ装置におい
て、 インバータ出力電流若しくは前記ＭＯＳ入力型半導体ス
イッチ素子に流れる電流に応じて行う該ＭＯＳ入力型半
導体スイッチ素子のスイッチング時間の制御を、ゲート
抵抗を並列に接続したゲート駆動回路でゲート容量の充
放電経路を切換えることにより行うことを特徴とするイ
ンバータ装置。 - 【請求項４】 直流電源と、該直流電源に直列接続され
たＭＯＳ入力型半導体スイッチ素子で構成された電力変
換器と、前記ＭＯＳ入力型半導体スイッチ素子の直列接
続点をそれぞれ出力端子としたインバータ装置におい
て、 インバータ出力電流若しくは前記ＭＯＳ入力型半導体ス
イッチ素子に流れる電流の振幅情報をゲート駆動回路に
送信し、該ゲート駆動回路の出力インピーダンスが前記
ゲート駆動回路に送信された電流信号情報に基づいて決
定されるように構成して、前記ＭＯＳ入力型半導体スイ
ッチ素子のスイッチング時間を制御可能にしたことを特
徴とするインバータ装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP34742393A JP3445649B2 (ja) | 1993-12-24 | 1993-12-24 | インバータ装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP34742393A JP3445649B2 (ja) | 1993-12-24 | 1993-12-24 | インバータ装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH07184376A true JPH07184376A (ja) | 1995-07-21 |
| JP3445649B2 JP3445649B2 (ja) | 2003-09-08 |
Family
ID=18390131
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP34742393A Expired - Fee Related JP3445649B2 (ja) | 1993-12-24 | 1993-12-24 | インバータ装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3445649B2 (ja) |
Cited By (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2002153043A (ja) * | 2000-11-14 | 2002-05-24 | Fuji Electric Co Ltd | 電圧駆動型半導体素子のゲート駆動装置 |
| JP2004312817A (ja) * | 2003-04-03 | 2004-11-04 | Mitsubishi Electric Corp | 電力変換装置およびその電力変換装置を備える電力変換システム装置 |
| JP2005130668A (ja) * | 2003-10-27 | 2005-05-19 | Densei Lambda Kk | スイッチング電源装置 |
| JP2016127686A (ja) * | 2014-12-26 | 2016-07-11 | 日産自動車株式会社 | スイッチング装置 |
| WO2021177098A1 (ja) * | 2020-03-03 | 2021-09-10 | 株式会社デンソー | ゲート駆動装置 |
| WO2021177099A1 (ja) * | 2020-03-03 | 2021-09-10 | 株式会社デンソー | ゲート駆動装置 |
-
1993
- 1993-12-24 JP JP34742393A patent/JP3445649B2/ja not_active Expired - Fee Related
Cited By (8)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2002153043A (ja) * | 2000-11-14 | 2002-05-24 | Fuji Electric Co Ltd | 電圧駆動型半導体素子のゲート駆動装置 |
| JP2004312817A (ja) * | 2003-04-03 | 2004-11-04 | Mitsubishi Electric Corp | 電力変換装置およびその電力変換装置を備える電力変換システム装置 |
| JP2005130668A (ja) * | 2003-10-27 | 2005-05-19 | Densei Lambda Kk | スイッチング電源装置 |
| JP2016127686A (ja) * | 2014-12-26 | 2016-07-11 | 日産自動車株式会社 | スイッチング装置 |
| WO2021177098A1 (ja) * | 2020-03-03 | 2021-09-10 | 株式会社デンソー | ゲート駆動装置 |
| WO2021177099A1 (ja) * | 2020-03-03 | 2021-09-10 | 株式会社デンソー | ゲート駆動装置 |
| JP2021141662A (ja) * | 2020-03-03 | 2021-09-16 | 株式会社デンソー | ゲート駆動装置 |
| JP2021141661A (ja) * | 2020-03-03 | 2021-09-16 | 株式会社デンソー | ゲート駆動装置 |
Also Published As
| Publication number | Publication date |
|---|---|
| JP3445649B2 (ja) | 2003-09-08 |
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