JPH07249955A - 低歪可変アッテネータ - Google Patents
低歪可変アッテネータInfo
- Publication number
- JPH07249955A JPH07249955A JP6039738A JP3973894A JPH07249955A JP H07249955 A JPH07249955 A JP H07249955A JP 6039738 A JP6039738 A JP 6039738A JP 3973894 A JP3973894 A JP 3973894A JP H07249955 A JPH07249955 A JP H07249955A
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- JP
- Japan
- Prior art keywords
- pin diode
- diode attenuator
- attenuator
- unbalanced
- balanced circuit
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- Pending
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Abstract
(57)【要約】
【目的】 二次歪を大幅に低減して減衰量の調整が可能
な低歪可変アッテネータの提供。 【構成】 第１の不平衡・平衡回路１と、第１の不平衡
・平衡回路１の一方の出力端子に入力端子が接続された
第１のピンダイオードアッテネータ２と、第１の不平衡
・平衡回路１の他方の出力端子に入力端子が接続された
第２のピンダイオードアッテネータ３と、第１のピンダ
イオードアッテネータ２の出力端子が一方の入力端子に
接続され、第２のピンダイオードアッテネータ３の出力
端子が他方の入力端子に接続された第２の不平衡・平衡
回路４とを備えている。
な低歪可変アッテネータの提供。 【構成】 第１の不平衡・平衡回路１と、第１の不平衡
・平衡回路１の一方の出力端子に入力端子が接続された
第１のピンダイオードアッテネータ２と、第１の不平衡
・平衡回路１の他方の出力端子に入力端子が接続された
第２のピンダイオードアッテネータ３と、第１のピンダ
イオードアッテネータ２の出力端子が一方の入力端子に
接続され、第２のピンダイオードアッテネータ３の出力
端子が他方の入力端子に接続された第２の不平衡・平衡
回路４とを備えている。
Description
【０００１】
【産業上の利用分野】本発明は、二次歪を大幅に低減し
て減衰可変動作を行う低歪可変アッテネータに関する。
て減衰可変動作を行う低歪可変アッテネータに関する。
【０００２】
【従来の技術】例えばカーラジオや衛星放送の受信機の
ように、常に受信電界が変動する場合には、ＡＧＣ（自
動利得制御回路）が使用され、このＡＧＣには可変アッ
テネータが使用されている。図２は従来の可変アッテネ
ータの構成を示す回路図であり、同図に示す可変アッテ
ネータはπ型のピンダイオードアッテネータと呼ばれて
いる。同図において、コンデンサ５，６，７は直流カッ
ト用のコンデンサで、コンデンサ８は交流的に接地をす
るためのコンデンサである。このような構成のπ型のピ
ンダイオードアッテネータでは、バイアス電圧Ｖｂｉａ
ｓをかけた状態で、制御電圧Ｖｃｏｎｔを変化させる
と、ピンダイオード１３、抵抗１０を流れる電流が変化
し、ピンダイオード１３の微分抵抗が変わりそのインピ
ーダンスが変化する。この場合、ピンダイオード１３の
インピーダンスが大きくなるほど、通過損失が増加す
る。また、抵抗１０に流れる電流が変化すると、ピンダ
イオード１３と抵抗１０の接続点の電位が変化し、抵抗
９、ピンダイオード１２，１４に流れる電流が変化し、
ピンダイオード１２，１４のインピーダンスが変化す
る。このためにピンダイオード１２，１４のインピーダ
ンスの変化によって入出力インピーダンスの整合を取る
ことができる。
ように、常に受信電界が変動する場合には、ＡＧＣ（自
動利得制御回路）が使用され、このＡＧＣには可変アッ
テネータが使用されている。図２は従来の可変アッテネ
ータの構成を示す回路図であり、同図に示す可変アッテ
ネータはπ型のピンダイオードアッテネータと呼ばれて
いる。同図において、コンデンサ５，６，７は直流カッ
ト用のコンデンサで、コンデンサ８は交流的に接地をす
るためのコンデンサである。このような構成のπ型のピ
ンダイオードアッテネータでは、バイアス電圧Ｖｂｉａ
ｓをかけた状態で、制御電圧Ｖｃｏｎｔを変化させる
と、ピンダイオード１３、抵抗１０を流れる電流が変化
し、ピンダイオード１３の微分抵抗が変わりそのインピ
ーダンスが変化する。この場合、ピンダイオード１３の
インピーダンスが大きくなるほど、通過損失が増加す
る。また、抵抗１０に流れる電流が変化すると、ピンダ
イオード１３と抵抗１０の接続点の電位が変化し、抵抗
９、ピンダイオード１２，１４に流れる電流が変化し、
ピンダイオード１２，１４のインピーダンスが変化す
る。このためにピンダイオード１２，１４のインピーダ
ンスの変化によって入出力インピーダンスの整合を取る
ことができる。
【０００３】このようにして、図２に示す従来のπ型の
ピンダイオードアッテネータによると、入出力のインピ
ーダンスの整合を取りつつ減衰量を調整することができ
る。
ピンダイオードアッテネータによると、入出力のインピ
ーダンスの整合を取りつつ減衰量を調整することができ
る。
【０００４】
【発明が解決しようとする課題】ところが前述の従来の
π型のピンダイオードアッテネータでは、通過損失を変
化させるピンダイオード１３のＶ−Ｉ特性の非線形特性
に基づいて、二次歪が発生するので、所定量以下の回路
歪が要求される場合には使用することができない。
π型のピンダイオードアッテネータでは、通過損失を変
化させるピンダイオード１３のＶ−Ｉ特性の非線形特性
に基づいて、二次歪が発生するので、所定量以下の回路
歪が要求される場合には使用することができない。
【０００５】本発明は、前述したような従来のπ型のピ
ンダイオードアッテネータの出力特性に基づいてなされ
たものであり、その目的は、二次歪を大幅に低減して減
衰量の調整が可能な低歪可変アッテネータを提供するこ
とにある。
ンダイオードアッテネータの出力特性に基づいてなされ
たものであり、その目的は、二次歪を大幅に低減して減
衰量の調整が可能な低歪可変アッテネータを提供するこ
とにある。
【０００６】
【課題を解決するための手段】前記目的を達成するため
に、本発明は、第１の不平衡・平衡回路と、該第１の不
平衡・平衡回路の一方の出力端子に入力端子が接続され
た第１のピンダイオードアッテネータと、前記第１の不
平衡・平衡回路の他方の出力端子に入力端子が接続され
た第２のピンダイオードアッテネータと、前記第１のピ
ンダイオードアッテネータの出力端子が一方の入力端子
に接続され、前記第２のピンダイオードアッテネータの
出力端子が他方の入力端子に接続された第２の不平衡・
平衡回路とを有することを特徴とするものである。
に、本発明は、第１の不平衡・平衡回路と、該第１の不
平衡・平衡回路の一方の出力端子に入力端子が接続され
た第１のピンダイオードアッテネータと、前記第１の不
平衡・平衡回路の他方の出力端子に入力端子が接続され
た第２のピンダイオードアッテネータと、前記第１のピ
ンダイオードアッテネータの出力端子が一方の入力端子
に接続され、前記第２のピンダイオードアッテネータの
出力端子が他方の入力端子に接続された第２の不平衡・
平衡回路とを有することを特徴とするものである。
【０００７】
【作用】この構成によると、第１の不平衡・平衡回路に
信号が入力すると、第２のピンダイオードアッテネータ
側の平衡出力がアース側に設定される場合、第１のピン
ダイオードアッテネータ側の平衡出力には入力と同相の
出力が得られ、第１のピンダイオードアッテネータ側の
平衡出力がアース側に設定される場合、第２のピンダイ
オードアッテネータ側の平衡出力には入力と逆相の出力
が得られる。従って、第１のピンダイオードアッテネー
タには、入力される信号と同相の信号が入力され、第２
のピンダイオードアッテネータには、入力される信号と
逆相の信号が入力され、第１のピンダイオードアッテネ
ータと第２のピンダイオードアッテネータとからは、入
力信号は互いに逆相で出力され二次歪は同相で出力され
る。そして、第２の不平衡・平衡回路によって、第１の
ピンダイオードアッテネータの出力信号と第２のピンダ
イオードアッテネータの出力信号とが不平衡出力され、
第１のピンダイオードアッテネータ及び第２のピンダイ
オードアッテネータで発生した二次歪は、互いに相殺低
減されるので、出力信号の歪成分を大幅に低減した状態
で減衰量が調整される。
信号が入力すると、第２のピンダイオードアッテネータ
側の平衡出力がアース側に設定される場合、第１のピン
ダイオードアッテネータ側の平衡出力には入力と同相の
出力が得られ、第１のピンダイオードアッテネータ側の
平衡出力がアース側に設定される場合、第２のピンダイ
オードアッテネータ側の平衡出力には入力と逆相の出力
が得られる。従って、第１のピンダイオードアッテネー
タには、入力される信号と同相の信号が入力され、第２
のピンダイオードアッテネータには、入力される信号と
逆相の信号が入力され、第１のピンダイオードアッテネ
ータと第２のピンダイオードアッテネータとからは、入
力信号は互いに逆相で出力され二次歪は同相で出力され
る。そして、第２の不平衡・平衡回路によって、第１の
ピンダイオードアッテネータの出力信号と第２のピンダ
イオードアッテネータの出力信号とが不平衡出力され、
第１のピンダイオードアッテネータ及び第２のピンダイ
オードアッテネータで発生した二次歪は、互いに相殺低
減されるので、出力信号の歪成分を大幅に低減した状態
で減衰量が調整される。
【０００８】
【実施例】本発明の一実施例を図１を参照して説明す
る。図１は本実施例の構成を示す回路図である。
る。図１は本実施例の構成を示す回路図である。
【０００９】同図に示すように、トランスを使用した第
１の不平衡・平衡回路１の一次巻線１ａの一端はアース
され、二次巻線１ｂの一端には第１のピンダイオードア
ッテネータ２の入力端子が接続され、他端には第２のピ
ンダイオードアッテネータ３の入力端子が接続されてい
る。そして、トランスを使用した第２の不平衡・平衡回
路４の一次巻線４ａの両端に、第１のピンダイオードア
ッテネータ２の出力端子と、第２のピンダイオードアッ
テネータ３の出力端子とがそれぞれ接続され、第２の不
平衡・平衡回路４の二次巻線４ｂの一端がアースされて
いる。ここで、第１のピンダイオードアッテネータ２及
び第２のピンダイオードアッテネータ３としては、すで
に図２を参照して説明したπ型のピンダイオードアッテ
ネータが使用され、両ピンダイオードアッテネータは、
同一の動作条件で駆動されるようにしてある。
１の不平衡・平衡回路１の一次巻線１ａの一端はアース
され、二次巻線１ｂの一端には第１のピンダイオードア
ッテネータ２の入力端子が接続され、他端には第２のピ
ンダイオードアッテネータ３の入力端子が接続されてい
る。そして、トランスを使用した第２の不平衡・平衡回
路４の一次巻線４ａの両端に、第１のピンダイオードア
ッテネータ２の出力端子と、第２のピンダイオードアッ
テネータ３の出力端子とがそれぞれ接続され、第２の不
平衡・平衡回路４の二次巻線４ｂの一端がアースされて
いる。ここで、第１のピンダイオードアッテネータ２及
び第２のピンダイオードアッテネータ３としては、すで
に図２を参照して説明したπ型のピンダイオードアッテ
ネータが使用され、両ピンダイオードアッテネータは、
同一の動作条件で駆動されるようにしてある。
【００１０】第１の不平衡・平衡回路１は、その一次巻
線１ａに不平衡型で入力された入力信号を平衡型に変換
し、平衡型で第１のピンダイオードアッテネータ２と、
第２のピンダイオードアッテネータ３とを駆動し、第２
の不平衡・平衡回路４によって、不平衡型で信号を出力
することにより、第１のピンダイオードアッテネータ２
及び第２のピンダイオードアッテネータ３で発生する二
次歪を相殺低減する機能を有している。
線１ａに不平衡型で入力された入力信号を平衡型に変換
し、平衡型で第１のピンダイオードアッテネータ２と、
第２のピンダイオードアッテネータ３とを駆動し、第２
の不平衡・平衡回路４によって、不平衡型で信号を出力
することにより、第１のピンダイオードアッテネータ２
及び第２のピンダイオードアッテネータ３で発生する二
次歪を相殺低減する機能を有している。
【００１１】次に、このような構成の本実施例の動作を
説明する。本実施例において信号が入力されると、入力
信号は第１の不平衡・平衡回路１によって平衡型に変換
される。第１の不平衡・平衡回路１では、第２のピンダ
イオードアッテネータ３側の平衡出力がアースに設定さ
れる場合には、第１のピンダイオードアッテネータ２側
の平衡出力には、入力信号と同相の信号が現われる。ま
た、第１のピンダイオードアッテネータ２側の平衡出力
がアースに設定される場合には、第２のピンダイオード
アッテネータ３側の平衡出力には、入力信号と逆相の信
号が現われる。
説明する。本実施例において信号が入力されると、入力
信号は第１の不平衡・平衡回路１によって平衡型に変換
される。第１の不平衡・平衡回路１では、第２のピンダ
イオードアッテネータ３側の平衡出力がアースに設定さ
れる場合には、第１のピンダイオードアッテネータ２側
の平衡出力には、入力信号と同相の信号が現われる。ま
た、第１のピンダイオードアッテネータ２側の平衡出力
がアースに設定される場合には、第２のピンダイオード
アッテネータ３側の平衡出力には、入力信号と逆相の信
号が現われる。
【００１２】このために、第１のピンダイオードアッテ
ネータ２には入力信号と同相の信号が入力され、第２の
ピンダイオードアッテネータ３には入力信号と逆相の信
号が入力される。この場合、第１のピンダイオードアッ
テネータ２と第２のピンダイオードアッテネータ３との
出力端子には、所定の減衰を受けた入力信号が、それぞ
れ逆相で出力され、同時に各ピンダイオードアッテネー
タで発生する二次歪は同相で出力される。このようにし
て、所定の減衰を受けた第１のピンダイオードアッテネ
ータ２の出力信号及び第２のピンダイオードアッテネー
タ３の出力信号と、第１のピンダイオードアッテネータ
２の二次歪及び第２のピンダイオードアッテネータ３の
二次歪とは、第２の不平衡・平衡回路４によって不平衡
型に変換される。この場合、第２の不平衡・平衡回路４
では、第１のピンダイオードアッテネータ２と第２のピ
ンダイオードアッテネータ３からの二つの平衡入力の電
位差を不平衡出力するので、第２の不平衡・平衡回路４
の出力信号では、第１のピンダイオードアッテネータ２
及び第２のピンダイオードアッテネータ３で発生した二
次歪は、互いに相殺されて歪成分が大幅に低減された状
態で信号の減衰の調整が行われる。
ネータ２には入力信号と同相の信号が入力され、第２の
ピンダイオードアッテネータ３には入力信号と逆相の信
号が入力される。この場合、第１のピンダイオードアッ
テネータ２と第２のピンダイオードアッテネータ３との
出力端子には、所定の減衰を受けた入力信号が、それぞ
れ逆相で出力され、同時に各ピンダイオードアッテネー
タで発生する二次歪は同相で出力される。このようにし
て、所定の減衰を受けた第１のピンダイオードアッテネ
ータ２の出力信号及び第２のピンダイオードアッテネー
タ３の出力信号と、第１のピンダイオードアッテネータ
２の二次歪及び第２のピンダイオードアッテネータ３の
二次歪とは、第２の不平衡・平衡回路４によって不平衡
型に変換される。この場合、第２の不平衡・平衡回路４
では、第１のピンダイオードアッテネータ２と第２のピ
ンダイオードアッテネータ３からの二つの平衡入力の電
位差を不平衡出力するので、第２の不平衡・平衡回路４
の出力信号では、第１のピンダイオードアッテネータ２
及び第２のピンダイオードアッテネータ３で発生した二
次歪は、互いに相殺されて歪成分が大幅に低減された状
態で信号の減衰の調整が行われる。
【００１３】このように本実施例によると、第１の不平
衡・平衡回路１によって第１のピンダイオードアッテネ
ータ２には、入力信号と同相の信号が入力され、第２の
ピンダイオードアッテネータ３には、入力信号と逆相の
信号が入力され、第２の不平衡・平衡回路４によって、
第１のピンダイオードアッテネータ２及び第２のピンダ
イオードアッテネータ３で発生した二次歪は、互いに相
殺された状態で、第２の不平衡・平衡回路４から所定の
減衰を受けた出力信号が出力される。このために、本実
施例によると、第１のピンダイオードアッテネータ２及
び第２のピンダイオードアッテネータ３での歪を大幅に
低減して、高精度の減衰量の調整が可能になる。
衡・平衡回路１によって第１のピンダイオードアッテネ
ータ２には、入力信号と同相の信号が入力され、第２の
ピンダイオードアッテネータ３には、入力信号と逆相の
信号が入力され、第２の不平衡・平衡回路４によって、
第１のピンダイオードアッテネータ２及び第２のピンダ
イオードアッテネータ３で発生した二次歪は、互いに相
殺された状態で、第２の不平衡・平衡回路４から所定の
減衰を受けた出力信号が出力される。このために、本実
施例によると、第１のピンダイオードアッテネータ２及
び第２のピンダイオードアッテネータ３での歪を大幅に
低減して、高精度の減衰量の調整が可能になる。
【００１４】
【発明の効果】本発明によると、第１の不平衡・平衡回
路によって第１のピンダイオードアッテネータには、入
力される信号と同相の信号が入力され、第２のピンダイ
オードアッテネータには、入力される信号と逆相の信号
が入力され、第２の不平衡・平衡回路によって、第１の
ピンダイオードアッテネータ及び第２のピンダイオード
アッテネータで発生した二次歪は、互いに相殺されるの
で、歪を大幅に低減した状態で減衰量を高精度で調整す
ることが可能になる。
路によって第１のピンダイオードアッテネータには、入
力される信号と同相の信号が入力され、第２のピンダイ
オードアッテネータには、入力される信号と逆相の信号
が入力され、第２の不平衡・平衡回路によって、第１の
ピンダイオードアッテネータ及び第２のピンダイオード
アッテネータで発生した二次歪は、互いに相殺されるの
で、歪を大幅に低減した状態で減衰量を高精度で調整す
ることが可能になる。
■
【図１】本発明の一実施例の構成を示す回路図
【図２】従来の可変アッテネータの構成を示す回路図
１ 第１の不平衡・平衡回路 ２ 第１のピンダイオードアッテネータ ３ 第２のピンダイオードアッテネータ ４ 第２の不平衡・平衡回路
Claims (2)
- 【請求項１】 第１の不平衡・平衡回路と、該第１の不
平衡・平衡回路の一方の出力端子に入力端子が接続され
た第１のピンダイオードアッテネータと、前記第１の不
平衡・平衡回路の他方の出力端子に入力端子が接続され
た第２のピンダイオードアッテネータと、前記第１のピ
ンダイオードアッテネータの出力端子が一方の入力端子
に接続され、前記第２のピンダイオードアッテネータの
出力端子が他方の入力端子に接続された第２の不平衡・
平衡回路とを有することを特徴とする低歪可変アッテネ
ータ。 - 【請求項２】 前記第１のピンダイオードアッテネータ
及び前記第２のピンダイオードアッテネータが、π型の
ピンダイオードアッテネータであることを特徴とする請
求項１記載の低歪可変アッテネータ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6039738A JPH07249955A (ja) | 1994-03-10 | 1994-03-10 | 低歪可変アッテネータ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6039738A JPH07249955A (ja) | 1994-03-10 | 1994-03-10 | 低歪可変アッテネータ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH07249955A true JPH07249955A (ja) | 1995-09-26 |
Family
ID=12561314
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP6039738A Pending JPH07249955A (ja) | 1994-03-10 | 1994-03-10 | 低歪可変アッテネータ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH07249955A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6870854B1 (en) | 1996-06-21 | 2005-03-22 | Hitachi, Ltd. | Packet switching device and cell transfer method |
-
1994
- 1994-03-10 JP JP6039738A patent/JPH07249955A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6870854B1 (en) | 1996-06-21 | 2005-03-22 | Hitachi, Ltd. | Packet switching device and cell transfer method |
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