JPH0744141A - 映像信号変換装置 - Google Patents
映像信号変換装置Info
- Publication number
- JPH0744141A JPH0744141A JP5188085A JP18808593A JPH0744141A JP H0744141 A JPH0744141 A JP H0744141A JP 5188085 A JP5188085 A JP 5188085A JP 18808593 A JP18808593 A JP 18808593A JP H0744141 A JPH0744141 A JP H0744141A
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- JP
- Japan
- Prior art keywords
- video signal
- signal
- horizontal synchronizing
- digital
- personal computer
- Prior art date
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- Pending
Links
- 238000006243 chemical reaction Methods 0.000 claims abstract description 21
- 238000005070 sampling Methods 0.000 claims abstract description 7
- 238000010586 diagram Methods 0.000 description 6
Landscapes
- Controls And Circuits For Display Device (AREA)
- Television Systems (AREA)
Abstract
(57)【要約】
【目的】 本発明の目的は、パソコンからの水平同期信
号に基づいて映像信号変換装置で作成されるＡＤ変換用
のサンプリングクロックを安定させること。 【構成】 映像信号変換装置はパソコンＰからの アナ
ログのＲＧＢ信号が入力される映像信号入力部と、デジ
タルの水平同期信号が入力される水平同期信号入力部と
を備える。この水平同期信号入力部は、オペアンプＯＰ
及びこのオペアンプＯＰの入力に接続されたフォトカプ
ラＰＨからなり前記パソコンＰのデジタルグランドと映
像信号変換装置のアナロググランドとは絶縁される。
号に基づいて映像信号変換装置で作成されるＡＤ変換用
のサンプリングクロックを安定させること。 【構成】 映像信号変換装置はパソコンＰからの アナ
ログのＲＧＢ信号が入力される映像信号入力部と、デジ
タルの水平同期信号が入力される水平同期信号入力部と
を備える。この水平同期信号入力部は、オペアンプＯＰ
及びこのオペアンプＯＰの入力に接続されたフォトカプ
ラＰＨからなり前記パソコンＰのデジタルグランドと映
像信号変換装置のアナロググランドとは絶縁される。
Description
【０００１】
【産業上の利用分野】本発明はパソコン（パーソナルコ
ンピュータ）等のコンピュータからの映像信号をＮＴＳ
Ｃ方式の映像信号等に変換する映像信号変換装置に関す
る。
ンピュータ）等のコンピュータからの映像信号をＮＴＳ
Ｃ方式の映像信号等に変換する映像信号変換装置に関す
る。
【０００２】
【従来の技術】従来、コンピュータからの映像信号をＮ
ＴＳＣモニタに表示するための映像信号変換装置は例え
ば特開昭６３−８２１８０号公報に記載されている。
ＴＳＣモニタに表示するための映像信号変換装置は例え
ば特開昭６３−８２１８０号公報に記載されている。
【０００３】この種、映像信号変換装置は例えば、図２
に示す構成となっている。即ち、パソコンＰからの画素
数１２８０×９６０のＲ、Ｇ、Ｂ信号はＡＤ変換部１で
ＡＤ変換された後、データが縮小処理部２で水平及び垂
直方向に１／２に間引かれＮＴＳＣの画素数６４０×４
８０に縮小される。このデータは映像信号変換用のフレ
ームメモリ３に書き込まれる。このフレームメモリ３か
ら読み出されたデータはＤＡ変換部４でＤＡ変換された
後、エンコーダ５でＮＴＳＣ信号にエンコードされる。
そして、前記ＡＤ変換部１、縮小処理部２及びフレーム
メモリ３の書き込みはパソコンの水平同期信号に基づい
て書き込み制御信号発生部６で作成された３３ＭＨｚの
クロックが使用される。一方、前記フレームメモリ３の
読み出しクロック及びＤＡ変換部４のクロックは読み出
し制御信号発生部７で作成される。
に示す構成となっている。即ち、パソコンＰからの画素
数１２８０×９６０のＲ、Ｇ、Ｂ信号はＡＤ変換部１で
ＡＤ変換された後、データが縮小処理部２で水平及び垂
直方向に１／２に間引かれＮＴＳＣの画素数６４０×４
８０に縮小される。このデータは映像信号変換用のフレ
ームメモリ３に書き込まれる。このフレームメモリ３か
ら読み出されたデータはＤＡ変換部４でＤＡ変換された
後、エンコーダ５でＮＴＳＣ信号にエンコードされる。
そして、前記ＡＤ変換部１、縮小処理部２及びフレーム
メモリ３の書き込みはパソコンの水平同期信号に基づい
て書き込み制御信号発生部６で作成された３３ＭＨｚの
クロックが使用される。一方、前記フレームメモリ３の
読み出しクロック及びＤＡ変換部４のクロックは読み出
し制御信号発生部７で作成される。
【０００４】一方、上記映像信号変換装置の水平同期信
号入力部は図３に示す様にパソコンＰの水平同期信号が
入力されるオペアンプＯＰのグランドＧにパソコンＰの
グランドが接続されている。
号入力部は図３に示す様にパソコンＰの水平同期信号が
入力されるオペアンプＯＰのグランドＧにパソコンＰの
グランドが接続されている。
【０００５】
【発明が解決しようとする課題】ところで、映像信号変
換装置の入力部のグランドＧはアナロググランドであ
る。一方、パソコンＰの同期信号のグランドはデジタル
グランドである。このため、図４に示すごとく、デジタ
ルグランドのノイズが水平同期信号に混入してしまうこ
とがある。そして、この水平同期信号の立ち下がりが鈍
っている場合には図示の如く立ち下がり部分にノイズが
混入してしまい、このタイミングが不安定となり、この
タイミングを使用してＡＤ変換のサンプリングクロック
を作成するとクロックが不安定となる欠点があった。
換装置の入力部のグランドＧはアナロググランドであ
る。一方、パソコンＰの同期信号のグランドはデジタル
グランドである。このため、図４に示すごとく、デジタ
ルグランドのノイズが水平同期信号に混入してしまうこ
とがある。そして、この水平同期信号の立ち下がりが鈍
っている場合には図示の如く立ち下がり部分にノイズが
混入してしまい、このタイミングが不安定となり、この
タイミングを使用してＡＤ変換のサンプリングクロック
を作成するとクロックが不安定となる欠点があった。
【０００６】本発明は上記欠点を解消した映像信号変換
装置を提供するものである。
装置を提供するものである。
【０００７】
【課題を解決するための手段】本発明は、第１の規格の
アナログ映像信号及びデジタル同期信号を発生する機器
が接続され、前記アナログ映像信号が入力される映像信
号入力部と、前記デジタル同期信号が入力される同期信
号入力部と、このデジタル同期信号に基づいて作成され
るサンプリングクロックにより前記アナログ映像信号を
ＡＤ変換するＡＤ変換部と、このＡＤ変換出力を第２の
規格の映像信号に変換する映像信号変換部とを備える映
像信号変換装置において、前記同期信号入力部にフォト
カプラを配置し、前記デジタル同期信号をこのフォトカ
プラを介して入力してなる映像信号変換装置である。
アナログ映像信号及びデジタル同期信号を発生する機器
が接続され、前記アナログ映像信号が入力される映像信
号入力部と、前記デジタル同期信号が入力される同期信
号入力部と、このデジタル同期信号に基づいて作成され
るサンプリングクロックにより前記アナログ映像信号を
ＡＤ変換するＡＤ変換部と、このＡＤ変換出力を第２の
規格の映像信号に変換する映像信号変換部とを備える映
像信号変換装置において、前記同期信号入力部にフォト
カプラを配置し、前記デジタル同期信号をこのフォトカ
プラを介して入力してなる映像信号変換装置である。
【０００８】
【作用】上記手段により、機器と映像信号変換装置間の
グランドは絶縁されるためデジタルグランドのノイズが
水平同期信号に混入することがない。
グランドは絶縁されるためデジタルグランドのノイズが
水平同期信号に混入することがない。
【０００９】
【実施例】以下、図面に従って本発明の一実施例を説明
する。図１は本実施例装置における水平同期信号入力部
の回路図を示し、デジタルの水平同期信号が入力される
水平同期信号入力部は、オペアンプＯＰ及びこのオペア
ンプＯＰの入力に接続されたフォトカプラＰＨからな
り、前記パソコンＰのデジタルグランドと映像信号変換
装置のアナロググランドとは絶縁される。
する。図１は本実施例装置における水平同期信号入力部
の回路図を示し、デジタルの水平同期信号が入力される
水平同期信号入力部は、オペアンプＯＰ及びこのオペア
ンプＯＰの入力に接続されたフォトカプラＰＨからな
り、前記パソコンＰのデジタルグランドと映像信号変換
装置のアナロググランドとは絶縁される。
【００１０】そして、パソコンＰからの水平同期信号は
フォトカプラＰＨを介して入力され、この水平同期信号
に基づいてＡＤ変換用のサンプリングクロックが作成さ
れるが、水平同期信号にノイズが混入することがないた
め水平同期信号から作成されるＡＤ変換用のサンプリン
グクロックを安定させることができる。
フォトカプラＰＨを介して入力され、この水平同期信号
に基づいてＡＤ変換用のサンプリングクロックが作成さ
れるが、水平同期信号にノイズが混入することがないた
め水平同期信号から作成されるＡＤ変換用のサンプリン
グクロックを安定させることができる。
【００１１】
【発明の効果】上述の如く本発明によればパソコンと映
像信号変換装置間のグランドは絶縁されるためデジタル
グランドのノイズが水平同期信号に混入することがな
く、水平同期信号から作成されるＡＤ変換用のサンプリ
ングクロックを安定させることができる。
像信号変換装置間のグランドは絶縁されるためデジタル
グランドのノイズが水平同期信号に混入することがな
く、水平同期信号から作成されるＡＤ変換用のサンプリ
ングクロックを安定させることができる。
【図１】本発明の一実施例における水平同期信号入力部
の回路図である。
の回路図である。
【図２】従来例における映像信号変換装置の概略ブロッ
ク図である。
ク図である。
【図３】従来例における水平同期信号入力部の回路図で
ある。
ある。
【図４】従来例における水平同期信号の波形図を示す図
である。
である。
Ｐ パソコン １ ＡＤ変換器 ６ 書き込み制御信号発生部 ＰＨ フォトカプラ ＯＰ オペアンプ
───────────────────────────────────────────────────── フロントページの続き (72)発明者 塚畝 勲 大阪府守口市京阪本通２丁目18番地 三洋 電機株式会社内
Claims (1)
- 【請求項１】 第１の規格のアナログ映像信号及びデジ
タル同期信号を発生する機器が接続され、前記アナログ
映像信号が入力される映像信号入力部と、前記デジタル
同期信号が入力される同期信号入力部と、このデジタル
同期信号に基づいて作成されるサンプリングクロックに
より前記アナログ映像信号をＡＤ変換するＡＤ変換部
と、このＡＤ変換出力を第２の規格の映像信号に変換す
る映像信号変換部とを備える映像信号変換装置におい
て、 前記同期信号入力部にフォトカプラを配置し、前記デジ
タル同期信号をこのフォトカプラを介して入力してなる
映像信号変換装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5188085A JPH0744141A (ja) | 1993-07-29 | 1993-07-29 | 映像信号変換装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5188085A JPH0744141A (ja) | 1993-07-29 | 1993-07-29 | 映像信号変換装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0744141A true JPH0744141A (ja) | 1995-02-14 |
Family
ID=16217444
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5188085A Pending JPH0744141A (ja) | 1993-07-29 | 1993-07-29 | 映像信号変換装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0744141A (ja) |
-
1993
- 1993-07-29 JP JP5188085A patent/JPH0744141A/ja active Pending
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