JPH07502152A - ユーザによるプログラムが可能な分散処理型モジューラ電気通信システム - Google Patents

Abstract

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Description

【発明の詳細な説明】

発明の名称 ユーザによるプログラムが可能な分散処理型モジューラ電気通信システム 発明の背景 発明の分野 本発明は、ディジタル電気通信システム、特に各種の電気通信装置の間で音声お よびデータを接続させるための時分割多重交換システムに関するものである。 舅１」Ｕ１生脱朋− コンピュータおよびデータ処理技術と電気通信網とが統合化され、その結果電話 局からコール・プロセッサに至るまでの交換技術の発展がもたらされ、ライン、 中継幹線、衛星リンクなどの各種のリンクにわたるいろいろな電気通信装置の間 で音声通信およびデータ通信を取り扱うことが可能となってきた。このような技 術発展は、電話局における電話交換サービスや構内交換機（ＰＢＸ）などのカス タマ−あるいは市内交換サービスを提供する電気通信システムに対する需要を創 り出した。さらに。 呼びの転送や、音声メールなどの拡張されたサービスが可能な電気通信網に対す る需要が創設されるようになった。 これらの需要を満たすためには、電気通信システムは、理想的には通信網の大き さを拡張する配列が可能であることが必要である。さらに、システムは、チャネ ル当たりの帯域幅や異なる通信プロトコールを用いている装置など、いろいろな チャネル特性や制約に適合して必要なサービスを提供するように動作が可能であ る必要がある。 また、ユーザが、利用可能なボート数を選択的に増加あるいは減少するためにシ ステム構成を変更または制御したり、あるいは、選択された電気通信装置に用い るように交換機を構成したり、あるいは、システムのハードウェアおよびソフト ウェアの構成要素の本質的な変更を行うことなしに加入者に対して選択されたサ ービスを提供することを可能とする何らかの手段を提供できることが望ましい。 いろいろな電気通信装置による音声およびデータの伝送を行うための分散処理方 式の電気通信システムが開発されている。しかし、これらのシステムでは、一般 に。 いろいろな電気通信サービスを提供するには、互いに整合する装置を用いる必要 がある。従って、これらのシステムは完全に統合化された電気通信システムとは なっていない。さらに、既存の電気通信システムに関する欠点は、システムのハ ードウェアおよびソフトウェア構成要素のモジュール化が十分になされていない ために、システムがサポートする加入者サービスやボート数を変更しようとする と大きな経済的負担かがかってしまうことである。 光１」旧

【打 本発明の電気通信システムは、少なくとも１つの中央処理装置Ｉ　（ＣＰＵ）基 板を有し、これによって多くの周辺基板に対するマスター制御を行って、最終ユ ーザに提供し得るサービスを完全に統合化するシステム構成となっている。また 、周辺基板としては、音声信号処理のためのアナログ基板および中継基板、デー タおよびディジタイズされた音声信号を処理するためのディジタル基板。 システムにデータの記憶と検索能力とを付与するための記憶装置モジュール基板 、システムを自由にプログラム制御することを可能とするディジタル信号処理基 板とがある。これらの周辺基板は汎用性を有するような装置構成として、システ ムの統合化を可能としている。 システムのハードウェアは、ソフトウェア構成と共に動作し、これによって、シ ステムと事実上すべての電気装置との間での汎用的なインターフェースが可能と なされる。このソフトウェアは、一般に１階層的なプログラム制御構成を有して おり、第１の低レベル制御は、基板構成要素のためのデバイス・ドライバーによ ってなされる。第２の中間レベル層のプログラム・コードには、ＣＰＵ基板を制 御し、また周辺基板との通信を制御して。 いろいろなシステム動作および基板動作を実行するための各種のマネージャ・サ ブルーチンが含まれている。また、この中間レベルプログラム制御は、システム の各ボートに関するデータ、さらに一般にはシステムのハードウェアの構成に関 するデータから成るデータベースを生成するためにも用いられる。また、独特の 高レベルコードが提供されるので、これを用いてシステム・ユーザは高レベル言 語プログラムモジュールを作成して、アプリケーションに汎用的に用いるように することが可能である。この高レベル言語プログラム・モジュールは中間レベル コードによって翻訳されて実行されるので、プログラマは、電気通信装置間の互 換性を意識することなしに、これらの電気通信装置を本発明によるシステムに結 合することが可能である。 凰１立蓬ｌ皇五豆 本発明のこれらのおよびその他の特徴と利点は、以下の詳細な説明を次の添付図 面と併せて読むことによってさらに容易に理解できるであろう、すなわち：図１ は、典型的な電気通信環境において用いられるように構成された、本発明による 電気通信システムを示した概略図である７ 図２は、図１の電気通信システムのキャビネット内のラック構成を示したもので ある； 図３は、図１の電気通信システムのラックを構成しているＣＰＵ基板およびいく つかの周辺基板について示した概略図である： 図４は、図３のＣＰＵ基板に用いることが可能な典型的なバックプレーンの接続 について示した概略図である図５は、本発明のバックプレーンに用いられる電源 の接続について示した概略図である； 図６は１図３の各周辺基板に用いることが可能な典型的なバックプレーンの接続 について示した概略図である図７は、図３のＣＰＵ基板に関連する各種のハード ウェアおよびソフトウェア構成要素について示した概略図である； 図８は１本発明に基づいて構成されたＣＰＵ基板を示すブロック図である； 図９は１本発明による独特の高レベル言語をＣＰＵ基板を制御するためのプログ ラム・コードに翻訳するシーケンス動作を表したフローチャートである；図１０ は、本発明に基づいて構成されたアナログ基板を示すブロック図である； 図１１は１周辺基板の初期化動作のシーケンスを表すブローチヤードである： 図１２は、周辺基板マイクロコントローラのパケット処理動作シーケンスを表し たフローチャートである；図１３は、本発明に基づいて構成された中継基板につ いて示したブロック図である； 図１４は１本発明に基づいて構成されたディジタル基板について示したブロック 図である； 図１５は１本発明に基づいて構成された記憶装置モジュール基板について示した ブロック図である；図１６は、図１５の記憶装置モジュール基板の制御動作シー ケンスを表したフローチャートである；図１７は、本発明に基づいて構成された カッド・ディジタル信号処理アレイ基板を示すブロック図である；図１８は、制 御パケットのフォーマットについて示したものである； 図１９は、システム・コマンドを記憶するためのメモリ空間について示したもの である； 図２０は、ＣＰＵ基板を用いてパケット処理を行う動作シーケンスを表したフロ ーチャートである；図２１は、本発明に基づいて構成されたディジタル電話を示 す概略図である：また 図２２は、本発明の２つのキャビネットを相互接続するためのスイッチ基板を示 す概略図である。 適な　の　な説ｌ： 以下の参照図面において、同様の参照符号は同様の構成要素を表す１図１は、各 種のアナログおよびディジタル電気通信装置が接続されている電気通信システム を示したものである０本発明の電気通信システム１０は、汎用的なものであって １例えば電話回線１２．中継幹１１４、ディジタル・ライン１６．構内交換機１ ８．および電話局２０へのインターフェースとして動作させることができ、交換 機、キーテレホンシステムとしての動作。 およびモデム２４やファクシミリ通信２６などの電気通信応用をサポートするこ とができる。さらに汎用電気通信システム１０は、コンピュータデータベース２ ８、音声およびデータ端末３０、ディジタル通信網３２を含むいろいろなディジ タル装置にも結合することが可能である。以下に詳細に説明するように、汎用電 気通信システム１０は、モジュール化されたハードウェアおよびソフトウェア構 成要素からなり、これらの構成要素は任意の数のボートあるいはディジタル音声 チャネルのサポートを行い、また、上記の電気通信装置をこれらのボートを介し て選択的に接続し、あるいは切り離して、いろいろなサービス、例えば、完全な キーテレホンシステム、小型や中型や大型の構内交換機（ＰＢＸ）、電話局交換 機、メツセージ記憶装置、電子メールやファクシミリ・メールや音声・映像メー ルの転送とリファイル、モデムおよびファックス・アレイ、テレショッピング、 データ処理、テレバンキングなどの提供を行う配置とすることが可能である０本 発明のモジュール方式のハードウェアおよびソフトウェア構成要素を用いると、 分散処理制御およびオーブン・アーキテクチャ設計による異なった通信プロトコ ールを有する異なった電気通信システム動作のインターフェースの提供が可能で ある。 本発明の電気通信システム１０について以下のようなアウトラインに従って説明 する： 工、システムの動作の概要 Ｉ　１．ＣＰＵ基板ハードウェア Ｉ　Ｉ　１．ＣＰＵ基板基板ソフトウ ェア像レベルドライバ Ｂ、中レベルコード Ｃ０高レベルコード ＩＶ、アナログ基板 ■、中継基板 Ｖｌ、ディジタル基板 ＶＩ　１．記憶装置モジュール基板 ＶＩ　Ｉ　１．カッドＤＳＰ基板 ＩＸ、システム・コマンド Ｘ、システム動作 Ｘｌ、ディジタル電話 ＸＩ　１．スイッチ基板 ■、システムの　へ１！ 図２は、電気通信システム１ｏのモジュール式ハードウェア構成要素を示したも のである。電気通信システム１０は、それぞれが少なくとも１つの周辺基板（図 示せず）を有する複数のラック４２、あるいは個々の電気通信ユニットによって 構成することができる。キャビネット４３の中にいくつかのラックを配置するこ とができる。 ソフトウェアおよびハードウェア構成要素をモジュール式とすることによって、 比較的簡単に、電気通信ユニット４２をシステムに追加したり、従ってまた。ボ ートの数を増加することが可能となる。電気通信ユニットが同一のキャビネット 内あるいは異なるキャビネットの他のユニットと通信を行ってデータ・パケット を処理する仕方について図２２を参照しながら以下に説明する６図３を参照する 。各電気通信ユニット４２は、好適には、上記のどのようなサービスおよびシス テムをもサポートすることが可能な汎用電気通信ユニット（ＧＴＵ）として構成 される。言い換えれば、電気通信システム１０は、ただ１つのＧＴＵ４２によっ て構成することも可能である。ＧＴＵは、いくつかの電子回路基板を有すが、こ れらの電子回路基板のそれぞれについて以下に説明を行う、ＧＴＵ４２は、アナ ログ電話ラインの信号処理を行うための８線アナログ基板４４、ＧＴＵ４２を幹 線ラインに接続するための４線幹線基板４６．および例えばコンピュータあるい はデータ端末からＧＴＵ４２に伝送されるデータの処理を行うための８線デイジ タル基板４８を有している。またさらに、ＧＴＵ４２にデータの記憶および検索 処理を行うための記憶装置モジュール基板５０と、カッド・ディジタル信号処理 （ＤＳＰ）アレイ基板５２とを備えさせて音声メールなどの電気通信サービスを 提供するようにすることも可能である。以後、上記の電子回路基板４５−５２を 、まとめて周辺基板５４と呼ぶことにする０周辺基板５４は、バックプレーン・ バス５５によって相互結線され、中央処理装置（ＣＰ　Ｕ）基板５６によって制 御される。ＣＰＵ基板５６は、カッドＤＳＰアレイ基板５２と類似の機能を有す る内部ディジタル信号処理装置ｆ（ＤＳＰ）（後に図７と関連して説明を行う） を有している。ＧＴＵ４２は、上記の基板をいろいろな数だけ組み合わせて構成 することが可能である。例えば、ＣＰＵ基板５６．８線デイジタル基板４８．４ 線幹線基板４６．および記憶装置モジュール基板５０のみでＧＴＵ４２を構成す ることもできる。これらのいろいろな種類の周辺基板５４をＧＴＵ４２に備える ようにすることによって１本発明による完全に統合化されたシステムの、まるで 異なるいろいろな最終ユーザに対して、ＧＴＵがいろいろな電気通信サービスの 提供を行うことが可能となる。 さらに図３を参照する０図３に示すように、バックプレーン・バス５５は電気通 信システム１０のいろいろなＣＰＵ基板５６とそれぞれのＧＴＵの周辺基板５４ との間を相互配線するように構成されている。バックプレーン・バス５５は容易 に基板間の接続を行えるように設計されており、従って、システムの拡張を容易 に行うことが可能である。 図４は、単一のＣＰＵ基板５６に用いることが可能なバックプレーンの接続を表 したものである。ＣＰＵ基板５６は、一般に、５６ピン・エツジ・コネクタ５８ を有しており、これが５種類の信号を伝送するバックプレーン・ラインに結合さ れる。第１の種類の信号としては。 シリアル通信バス５７によって伝送される信号がある。 シリアル通信バス５７は、６つの双方向パルス符号変調（ＰＣＭ）ハイウェイを 有している。各ハイウェイは、好適には２．０４８Ｍビット／秒の総合データ転 送速度を有し、各チャネルがそれぞれ６４にビット／秒の容量を有する３２の時 分割多重（ＴＤＭ）チャネルに分割されている。各ＧＴｔＪは、好適には、６ｘ ３２すなわち１９２ボートを有し、各ボートは、他のボートの動作を中断させる ことなくＰＣＭハイウェイにアクセスすることができるようになされている。双 方向２６Ｍハイウェイは、後に図７を参照しながら説明するＣＰＵ基板５６上に 設けられているタイムスロット交換（ＴＳＩ）スイッチと関連した名前が付けら れている０例えば、エツジ・コネクタ５８の入出カラインは、そのラインがスイ ッチのラインＭに対応するＰＣＭハイウェイへの入力ラインであるのか、あるい はスイッチのラインＮに対応するＰＣＭハイウェイからの出力ラインであるのか に応じて。 それぞれＢ−５ＴＩ（ラインＭ）またはＢ−８ＴＯ（ラインＮ）と名付けられて いる。また、第７番目の双方向ＰＣＭハイウェイ５９が内部システム通信専用と して備えられており、好適には国際標準化機構（ＩＳＯ）の制定による高レベル データリンク制御（ＨＤＬＣ）プロトコールを用いて、ＣＰＵ基板５６と周辺基 板５４との間の主従関係が構成される。ＰＣＭハイウェイ５７の制御ラインは、 ２．０４８ＭＨｚのクロック信号ラインｃ２．４．０９６ＭＨｚのクロック信号 ラインｃ４＼、８ｋ）（２のフレーム同期ラインＦＯ＼およびＦｓ、ＨＤＵＣ制 御ラインう　Ｃ３ＴおよびＢ　ＣＳＴとがらなっている。 第２の種類の信号は、１を源供給ライン６２である９バツテリ・バックアップが 必要とされる場合には、典型的には電源供給構成に公称Ｖｂａｔ信号（すなわち 、−２８Ｖｄｃから一６０Ｖｄｃ）を供給するためのオフライン電源を含めるよ うにすることも可能である。電源は１組のバッテリを浮動充電するように構成す ることが可能である。また、一連のＤＣ／ＤＣコンバータへの入力信号を供給す るようにもできる。これらのＤＣ／ＤＣコンバータによって＋５Ｖｄ　ｃ、−５ Ｖｄ　ｃ、＋１２Ｖｄｃ。 −１２Ｖｃｊ　ｃの電源が供給される。また、Ｖｂａｔ信号は、９０　Ｖ　ｒ　 ｍ　ｓ、２０Ｈｚのアナログ電話呼び出し音出力信号を供給するための呼び出し 音発生器の電源六方信号としても用いられる。電源に故障が発生したときには、 オフライン電源出方がゼロとなり、バッテリ出方のスイッチが投入されて、バッ テリがらＶ　ｂ　ａ　を信号が供給される。その他の電源もＶ　ｂ　ａ　ｔを電 源として用いているので正常に動作する。システムＣＰＵ基板は、電源故障信号 を受け取ると、省電力動作に切り換えるようにすることができる。 低価格システムでは、呼び出し音発生器を除いたすべての電源をオフラインで動 作するように構成することも可能である。典型的な構成として１例えば、リニア 電源を用いてＶｂａｔ信号を供給するようにできる。カッド出力スイッチを用い て、５Ｖｄｃ、−５Ｖｄｃ、＋１２Ｖｄｃ、−１２Ｖ　ｄ　ｃの各電源を供給す るようにできる。 呼び出し音発生器は、システムの要求に応じてオフラインで、またはＶｂａｔ信 号によって動作するようにできる。構成をこのようにすることによって、典型的 なシステムの電源の価格を１桁はど低減することが可能である６また、図５に示 したように、呼び出し音発生器制御ラインＣＲＧ２、ゼロ交差同期信号ＣＲＧ１ 、およびバッテリ・バックアップ・ラインＶＢＵＵＩおよびＶＢＢＵ２が備えら れている。 本発明の電気通信システム１０は、低電力消費であることを特徴とするものであ り、これによって、既存の電気通信システムと比較しているいろな利点が得られ る。 例えば、システム１０は低い動作温度で動作可能であり、そのため信頼性が増大 する。また、低電力しか必要とせず、バッテリ・バックアップのための費用が安 価ですむ。 電力消費量の低減は以下のようにして達成されている。 すなわち、、ＣＭＯ３回路の広範囲にわたる使用、使用部品数の低減（回路のＶ ＬＳＩ化と、その他の回路設計技術とによる）、また、最も重要な要因である、 ラフ１〜ウエアによる大電力消費部品の電力制御とによって実現されている。例 えば、アナログ基板４４では、電力制御は、Ｃ０ＤＥＣ１ＳＬＩＣ、マイクロコ ントローラを含む１７から２０の集積回路装置によってなされる。これによって 、ライン当たりの電力消費が９０％節減される。 この電力低減は、２つの段階で実現される。第１の段階は１通常の動作において 、非認可ラインに対して電力を供給しないようにすることである。第２の段階は 、電源が故障した非常時において、システムＣＰＵ基板から個々の基板あるいは ラインに対して休止モードとなるように命令を発し、周期的に全電力モードでの 動作の再認可点検動作を行う。その他のシステム基板も同様な電力低減動作を実 行する。このようなレベルのソフトウェア制御が、従来は不可能であったような バッテリ・バックアップを経済的にシステム中に実現することが可能となるにれ によって、加入者の状況が悪状況となった場合でも。 停止させずに連続的な動作を維持することが可能である。 図４に示したように、第３の種類の信号は、エツジ・コネクタ５８への５つの入 力ライン、Ｂ　ＳＡＯがらＢ５Ａ４まで（これらの六方ラインをまとめてスロッ ト・アドレス・ライン６３と称する）の固定論理レベルに対応するものである。 ２５すなわち３２の論理レベルの組合せによって、ラック４２内のＣＰＵおよび 周辺基板のアドレス信号を一意的に定めることができる。従って。 各基板は、５つのスロット・アドレス・ライン６３からその対応するスロット・ アドレス番号を読み出して、その基板の仮想アドレスと結びついた物理的なアド レスを得ることができる６ラツクの各周辺基板のこのスロット・アドレスは初期 化あるいはシステムの立ち上げの際に基板間の通信が可能となるように対応する ＣＰＵ基板に一般には備えられる。ＣＰＵ基板は、周辺基板のスロット・アドレ スと記憶しているシステム構成データと比較することによって周辺基板の存在の 確認が可能である。 第４の種類の信号は、ＴＴＬレベルのシリアル・リンク信号であり、ＨＤＬＣチ ャネル５９が機能不全となった際に内部バックアップ通信のためにＣＰＵ基板５ ６がＲ５２３２リンクを通して行う外部通信、あるいは、ＣＰＵ基板マイクロコ ンピュータが許可した場合に行うシリアル・ボートを介したソフトウェア・プロ グラムのダウンロードに用いられるものである。このシリアル・ラインは、シリ アル送信ラインＢ　Ｔｘｄ、シリアル受信ラインＢ　Ｒｘｄ、およびシリアル読 み出しラインＢ−３ｒｄｙとで構成されている。Ｒ３−２３２レベル・ドライバ が、各ラックのバックプレーンに備えられており、これによってＯｖおよび５ｖ の信号が、例えば、−９と９ｖの信号の変換される。これらのドライバをＣＰＵ 基板ソフトウェアで制御することにより、いくつかのラックが共通のＲ３−２３ ２リンクを共有使用するようにすることが可能である。最後に、第５の種類の信 号は、エツジ・コネクタの未使用ライン、すなわち、ＲＥＳＩ、ＲＥＳ２．ＲＥ Ｓ３と印されたライン対応するものであり、これらのラインは、将来の使用のた めに予約されているものである。 さらに図４を参照する６シリアル電気通信バス信号６Ｏおよび６１を伝送するエ ツジ・コネクタ・ラインが、ＰＣＭ終端回路（すなわち、抵抗回路）６４および ６５にそれぞれ接続されている。バックプレーンの抵抗回路６４および６５によ って、実質上一定の終端インピーダンスがＰＣＭデータハイウェイ（Ｂ　５Ｔｉ ｘおよびＢＳＴｏｘ）−制御ハイウェイ（Ｂ　Ｃ５ＴｉおよびＢＣ５Ｔｏ）、お よびクロック信号（ＦＯ，Ｆｓ、Ｃ２゜Ｃ４、Ｃ８）に対して提供され、これに よって、オーバシュート、リンギング、パルス歪み、電気磁気的干渉が低減され る。また、トライステート論理ラインが未定義の論理レベルにドリフトしてしま うのが防がれる。 図６は１周辺基板５４に用いることが可能なバックプレーン接続のいくつかにつ いて示したものである。物理的なバックプレーン接続は、一般に、５６ピンのエ ツジ・コネクタ６６によってなされる０図示されているように。 エツジ・コネクタは、入力シリアル通信ビンとしての入力ピン６７、他の基板に 信号を伝送する出力シリアル通信ライン用の出力ピン６８、およびスロット・ア ドレス・ライン、ＰＣＭハイウェイ制御ライン、電源ラインのためのピンからな っている。 ＣＰＵ基板および周辺基板それぞれに関連するエツジ・コネクタ５８および６６ は、好適には、バックプレーン（図示せず）上に１インチ間隔で配置される。ま た、バックプレーン上の各エツジ・コネクタの間には電源デカップリング・キャ パシタが設けられる。各周辺基板のエツジ・コネクタとＣＰＵ基板のエツジ・コ ネクタとのピンの割り当ては実質的には同じとなる０周辺基板あるいはＣＰＵ基 板に関する各エツジ・コネクタの５つのスロット・アドレス・ピンは、２進数的 に増加するように接続され、各基板の基板アドレスが互いに重複しないようにさ れる。 以上に述べたように、汎用的なバックプレーン接続を用いることにより、また、 ＰＣＭハイウェイによる基板間通信を行うことによって、ＣＰＵ基板あるいは周 辺基板の電気通信システムｌＯへの統合化が簡単に実現される。さらに、基板間 通信方式を用いることによって、プロセッサ特有のＣＰＵ基板および周辺基板を 用いる必要性がなくなる。単にその通信パスに用いられるコマンド・プロトコル を固守しさえすれば、任意のプロセッサ手段によって制御される任意の機能を有 するどのような種類の基板をもシステムに組み込むことが可能である。従って、 その基板のソフトウェア、ファームウェア、およびハードウェアは、システムの 残余の部分にとっては透過的となる。ＣＰＵ基板マイクロプロセッサに対する高 レベルの独立性を有するプラットフォームのコード技術の使用と結びついた通信 リンクには正しく組み込みさえすればシステムのＣＰＵ機能を実現するどのよう な種類のプロセッサでも用いることが可能である。後にさらに詳細に説明するよ うに、基板間通信は好適にはコマンド主導でなされる。すなわち、各ラックのＣ ＰＵ基板は、多数の周辺基板すなわちスレーブ基板に対してマスター制御を行う 。バックプレーン・バスは、そのための汎用のデータラインおよび制御ラインと して構成されている。 従って、バックプレーンの接続を変更することなしにこれらのマスター基板およ びスレーブ基板のソフトウェア制御プログラムだけを変更することで、ＣＰＵ基 板と周辺基板の動作および性能をアップグレードすることが可能である。従って 、本発明のバックプレーンは、一般に主中央処理装置ユニットで駆動される多く の既存のバックプレーンと比較して優れたものである。これらの既存のプロセッ サ駆動型のバックプレーンは、データラインとアドレス・ラインを用いて一般に 周辺基板、ハードディスク、およびメモリを相互接続するものである。従って１ 本発明の場合と異なり、これらの既存システムの何か１つ、例えば周辺装置を変 更しようとすると、一般にシステムのハードウェアとプログラム制御とを実質的 に変更する必要が生じる。 すでに述べたように、各ラックのＣＰＵ基板５６および周辺基板５４は、マスタ ー／スレーブ環境を構成するためのプログラム・コードを有しており、ＣＰＵ基 板によって周辺基板に対するマスター制御が行われる。インバウンド・コマンド （周辺基板からＣＰＵ基板に対して送られるコマンド）およびアウトバウンド・ コマンド（ＣＰＵ基板から周辺基板に対して送られるコマンド）は専用のＨＤＬ Ｃプロトコール符号化ＰＣＮハイウェイ５９を介して伝送される。アウトバウン ド・コマンドは、例えば、周辺基板に対し、その周辺基板に接続されている電気 通信装置へのダイアルトーンを送るように命令するコマンドや、あるいは周辺基 板に対して状態情報を伝送するように要求するコマンドを備える。インバウンド ・コマンドは１例えば、リング・トリップ、フックフラッシュ、あるいはダイア ルされた数字の検出などライン状態を示すコマンド、および、データをＰＣＭハ イウェイを介して指定された受信端末への接続要求コマンドとからなっている。 インバウンド・コマンドおよびアウトバウンド・コマンドの中のいくつかについ ては、後に表２から表５を参照しながらさらに詳細に説明する。ＣＰＵ基板およ び周辺基板は、それぞれコマンド信号を専用チャネル５９を介して送受信するた めのＨＤＬＣインターフェースすなわちプロトコーラを有している。ＨＤＬＣプ ロトコーラは、機能的には、オンボード・マイクロコントローラがパケットの処 理を行う準備ができるまで受信したあるいはほぼ送信が完了したパケットを記憶 しておくためのバッファに類似している。しかし、本発明の電気通信システム１ ０は、一般にはパケットの処理をリアルタイムで行うように設計されており、従 って多数のパケットを各基板に記憶する必要がなくなっている。 ＣＰＵ基板は、いくつかの層からなるプログラム制御を有しており、これらがシ ステムのハードウェアと協同して動作することによって、本発明のいろいろな利 点が得られる８例えば、いくつかの層のソフトウェアは各周辺装置に関連する制 御データをカプセル化し、これによって、高レベルの呼び出し処理ソフトウェア プログラムに従って動作して周辺装置からのパケットを処理しているＣＰＵ基板 マイクロコントローラにとってはシステムのいろいろな装置が実事上同じに見え るようにする。システムをこのようにすることによってユーザが得ることができ る利点は、もしこのようにしなければ、周辺装置が整合しないような場合であっ ても、システムには周辺装置が同じようなものに見えるということである。ＣＰ Ｕ基板５６に関連する異なるレベルのソフトウェアの相互作用について、図７を 参照しながら説明する０図７は。 ＣＰＵ基板ソフトウェアの構成要素といくつかのシステムハードウェア構成要素 との概略説明図である６図７には、システムハードウェア構成要素としているい ろな周辺装置基板５４、ＰＣＭハイウェイ５７および５９、Ｒ８２３２リンク５ ３．ＣＰＵ基板ＨＤＬＣプロトコーラ６９、タイムスロット交換（ＴＳＩ）スイ ッチ７０．Ｒ３−２３２リンクへのインターフェース回路７］１．およびディジ タル信号プロセッサ（ＤＳＰ）７２が示されている。 図７を参照する。第１の、かつ最も低レベルのＣＰＵ基板ソフトウェアとしては 次のものがある。すなわち、ＨＤＬＣプロトコーラ６９．Ｒ３２３２リンクへの インターフェース回路７１、ＴＳＩスイッチ７０．およびＤＳＰ７２を制御する ための低レベルドライバ７３である。 ＴＳＩスイッチによって、データが１つのボート（すなわちＰＣＭハイウェイ上 の１つのチャネル）から他のボートへ転送される。ＤＳＰ７２は、通信トーンを 発生したり、ＤＴＭＦ復号やエコー消去などのいろいろな用途に用いることがで きる。またＣ、ＰＵ基板は、中間レベルのプログラム・コードを有し、これによ って、ＨＤＬＣプロトコーラ６９を介しての周辺基板あるいは低レベルドライバ ７３に従うＣＰＵ基板マイクロコントローラの間でそれぞれにパケットを送受信 する主ソフトウェア送信スタック７４と主ソフオウェア受信スタック７５とをＣ ＰＵ基板上に実現する。ＣＰＵ基板上のマイクロコントローラがパケットの処理 を行う準備が整うと、マイクロコントローラは、１つのパケットを受信スタック ７５から取り出して、そのパケット内の送信しようとしているコマンド・バイト を調べる。そのコマンド・バイトが示すコマンドに基づいて、マイクロコンピュ ータは、マネージャと呼ばれるいくつかあるサブルーチンの中の少なくとも１つ を呼び出す、マネージャは、一般にＣＰＵ基板マイクロコンピュータを制御して 、音声およびトーン・メツセージの処理、ＴＳＩスイッチ動作、ＤＴＭＦダイア ルおよび復調処理などの、システムの機能の実行と、また、ＣＰＵ基板と周辺基 板のＴＳＩスイッチ動作とを行うために備えられるものである。こうして、パケ ットがある１つの周辺基板から受信されると、ＣＰＵ基板マイクロコンピュータ は、そのパケット内のスロット・アドレス・バイトを調べて、どの周辺基板から そのパケットが発せられたものであるかを判定し、その周辺基板に関する処理を 行うのに適切なＣＰＵ基板制御マネージャを呼び出す１例えば、もし、パケット を発した基板がアナログ基板であれば、ＣＰＵ基板マイクロコンピュータは、ア ナログ基板用マネージャ・サブルーチンを呼び出し、このマネージャ・サブルー チンによって、マイクロコンピュータはＧＯＤＥＣからの読み出し実行をマイク ロコンピュータに要求しているアナログ基板に対するパケット送信の制御を行う 。マネージャは、ある程度。 装置に依存させてその装置特有のものとすることが可能であり、マネージャ・サ ブルーチンが、ＣＰＵ基板マイクロコンピュータを制御して適切に書式化された データ（すなわち、その受信周辺基板が採用しているデータ・レートおよび通信 プロトコールに従って書式化されたデータ）を、コマンド・パケットに指定され ている目的ボートに対して送信するようにすることが可能である。従って、シス テム・ユーザは、周辺基板５４に接続されたいろいろな電気通信装置から伝送さ れてくるデータおよび音声のプロトコールの非類似性を意識することなくマネー ジャを使用することが可能である。また、中間レベルコードは、ＣＰＵ基板マイ クロコンピュータによるアクセスおよび変更の可能な各ボートに対してＣＰｔＪ 基板のメモリ空間の書式化を行うことに用いられる。このメモリ空間は、全体を −まとめにしてボートデータベース７７と呼ばわる。このボートデータベースは 、ＣＰＵ基板マイクロコンピュータがパケットの処理を行う際、ＣＰＵ基板マイ クロコンピュータがこれにアクセスし、例えばそのパケットのコマンド・バイト の要求している通信サービスにそのボートの利用が可能か否かの判定を行う等に 用いることが可能になっている０通信サービスの利用可能性についてのこのよう な判定は、ボートデータベース上に存在する特定のボートに対する加入者情報の 調査によって可能である。また１例えばＣＰＵ基板に結合された周辺基板の数や 形式と、それらの動作状態に関するデータを含むシステム構成データファイルな どのデータを記憶するために、システムデータベース７８が中間レベルコードを 用いて構築される。さらに、中間レベルコードは＋　ＣＰＵ基板マイクロコンピ ュータが高レベル言語プログラムを呼び出してパケットの処理を行うときにマネ ージャ・サブルーチンが使用するグローバル・コマンド・バッファ（ＧＣＢ）を ＣＰＵ基板メモリ内に形成するのにも用いられる。マネージャ・サブルーチンは ＣＰＵ基板のマイクロコンピュータを制御して受信パケットのコマンド・バイト を解析し、そのパケットがマイクロコンピュータによる高レベル言語プログラム ・モジュールに従った処理を要求しているかどうかを判定する。 以下にさらに詳細に説明するように１本発明の独特の特徴は、高レベル言！！） 　ｒ置ＥｃＯＭＪを用いることにあり、この言語を用いて例えば、システムの管 理者がデータ・パケットを処理するためのサブルーチンを作成することが可能で ある。この高レベル言語を用いてサブルーチンを書くことによって、個々のシス テムの加入者が必要とする独特のサービスを提供できるようにハードウェア構成 を適合させることが可能である。中間レベルコードは、ＣＰＵ基板マイクロコン ピュータが理解可能なコンピュータ言語に高レベル・コード・プログラムを変換 するために用いるインタープリタ−・プログラム・モジュールを有している。こ のインタープリタ−・プログラム・モジュールは、一般にＣＰｔＪ基板の制御プ ログラムメモリ空間７９内に記憶される。 高レベル言語は、一般に用いられるシステムのユーザがデバイス・プロセッサ８ １と呼ばれるＣＰＵ基板マイクロコントローラを制御するためのソフトウェアプ ログラムの作成に用いられる１例えば、ＣＰＵ基板はそれぞれのマネージャ・サ ブルーチンにアクセスし、デバイスプロセッサの制御のもとにシステムデータベ ース７８内の特定のシステムデータを変更してアナログあるいはディジタル電話 、中継ライン、あるいは直接の内部ダイアリング回路など、特定の装置との間で 送受信されるパケットの処理を行う。これらのプログラムが、特定タイプの通信 装置特有のものであるのに対し、ユーザはシステムハードウェアについての特性 （いろいろなシステム構成要素のそれぞれのデータ・レートや通信プロトコール など）に関する知識に持っている必要はない、その理由はマネージャ・サブルー チンがこれらの固有の特性をユーザから遮蔽してくれるからである。さらに、こ の高レベル言語を用いることによってユーザはデバイス・プロセッサ・サブルー チンによって呼び出されるコール・プロセッサ８３と呼ばれる単一のプログラム モジュールを書くことができ、これによって電話会議などの基本的なシステム機 能を実現できる。コール・プロセッサ８３は。 その基本システム機能の実行においてＣＰＵ基板マイクロコンピュータを制御す る際に、特定のマネージャおよびデバイス・プロセッサを呼び出すことが可能な 汎用プログラムとして書かれる。コール・プロセッサ・サブルーチンのいくつか の例と、２つのデバイス・プロセッサ・サブルーチンとを付録ＡからＣに示す。 さらに図７を参照する。管理端末８５がＣＰＵ基板５６に結合され、通信システ ムのマルチタスク機能が利用可能になっている。システムＣＰＵから１つあるい はそれ以上の管理端末への通信リンクが備えられている・このリンクは、Ｒ３− ２３２インターフエース、端末アダプター、あるいはその他の回路接続手段を用 いて実現することが可能である。この管理端末は、システムユーザにいろいろな サービスを提供するが、それらには課金情報１通話量解析、最小価格となる入出 力接続経路、構成データ制御、稼働監視、デバイスまたはコールプロセッサの変 更、およびデータベースへのアクセスなどがある。 この管理端末インターフェースは、簡単な端末から、並列ネットワーク内のマル チタスク・オペレーティング・システム（ｔなわち、ｐｏｓ、ＵＮＩＸ、Ｘ−Ｗ ＩＮＤＯＷＳ、ＤＯ８上のＷＩＮＤＯＷＳ、Ｏ５／２など）の下でのコンピュー タ作動に至るまで、いろいろな形態範囲に拡がっている。この環境としては典型 的にはＤＯ８上（７）ＭＳ−ＷＩＮＤＯＷＳ’ｔ’あろう、Ｓ：（７１ＭＳ−Ｗ ＩＮＤＯＷＳを用いると、ユーザはシステムのマルチタスク機能を実現するのに 好適なグラフィックおよびマルチタスク環境を得ることができる。端末は、上に 掲げたような指定された各機能のそれぞれのために別々のウィンドーを有するよ うにし、これらが同時に動作するようにして、必要に応じてこれらの動作をユー ザが見れるようにできる。このようにすることによって、ユーザは、システムの 機能に容易にアクセスすることが可能となり、従来は不可能であったようなシス テム変更を容易に行うことが可能となる。また、管理端末８５は、管理を司るユ ーザがボート・データベース７７およびシステム・データベース７８を変更する ことができるようにプログラムすることが可能であり、これによって比較的簡単 にいろいろなデバイス・プロセッサおよびコール・プロセッサを作成して周辺基 板を付加したり、あるいは取り除いて。 システムの最終ユーザに提供するサービスを変更可能にすることができる。 」ニエ、ＣＰＵ基」【か二二号二ｒ王二４ＣＰＵ基板５６（図３）がＧＴＵ４２ の中の周辺基板５４を制御する方法について図８を参照しながら以下に説明する 。ＣＰＵ基板５６は、ＰＣＭハイウェイ５９を介して周辺基板５４から受信した データ・パケットの処理を行って、交換、テレショッピング、メツセージ記憶・ 転送などの通信サービスの提供を行う、これらのデータ・パケットの処理を行う ために、ＣＰＴＪ基板５６は、好適には、ＰＣと互換性のあるプロセッサである 日本のＮＥＣによって製造されている直接メモリアクセスが可能なＶ４０マイク ロプロセッサなどの汎用マイクロコンピュータ８０を有している。マイクロコン ピュータ８０は。 一般に３つのレベルのプログラム・コードに基づいて動作する。マイクロコンピ ュータ８０は、ファームウェアを記憶するためのリード・オンリー・メモリ（Ｒ ＯＭ）８２を有している。ファームウェアは、第１のレベルのプログラム・コー ドであり、ディジタル基板４８、中継基板４６．アナログ基板４４などの周辺基 板５４それぞれのを制御用に、また、これらの基板間の通信用に有用である。第 ２のレベルのプログラム・コードは、マイクロコンピュータ８０に結合されたデ ィジタル信号処理（ＤＳＰ）回路７２のためのものである。ＤＳＰソフトウェア は、一般にＲＯＭ８２に記憶されており、システムの立ち上げの際にダウンロー ドされる。ＤＳＰソフトウェアは、再構築のために再度ダウンロードすることも 可能である。ＤＳＰソフトウェアによって、ＧＴＵ４２は１−−ン発生、ＤＴＭ Ｆ復調、および音声会議などの基本的な通信機能を得ることができる。また、ス タティック・ランダム・アクセス・メモリ（ＳＲＡＭ）８６を用いたＤＳＰコー ドのためのスクラッチ・パッド・メモリを備えるようにすることも可能である。 ＣＰＵ基板５Ｇの主ソフトウェアはＣＰＵ基板上の消去可能プログラムＲＯＭ　 （ＥＰＲＯＭ）８８に記憶されている。主ソフトウェアは１例えば、ＣＰＵ基板 ５６を初期化し５周辺基板５４間（従って、電話やデータ端末などの端末装置間 の）電話交換サービスを提供して、基板５４．５６間の通信を可能とし、また、 いろいろなハウスキーピング機能を実行するのに有用なものである。 主ソフトウェアは、電気的に消去可能な／プログラム可能なＲＯＭ　（ＥＥＰＲ ＯＭ）９０に記憶されいる構成データと、ＥＰＲＯＭ８８のプログラム・メモリ の一部に記憶されているデータとを用いて動作し、上記の基本的な通信機能を実 行する。構成データは、一般に、各スロットに関するデータ（すなわち、いろい ろな種類の周辺基板の存在に関するデータ）と、各ボートに関するデータ、例え ばそのボートに接続されている通信装置の種類などのデータ、そのボートに関連 するリストされたディレクトリ数（ＬＤＮ）のデータ、そのボートのシステムの 制約（すなわち、ボートのＰＣＭチャネルへのアクセス能力に関する制約）に関 するデータ、および加入者の制約すなわち、サービスの種類（すなわち、長距離 電話および呼び出し待機サービスなどへのアクセス）などとを備える。 マイクロコンピュータ８０は、タイム・スロット交換（ＴＳＩ）スイッチ７Ｑに 接続されており、またソフトウェアを用いて、スイッチ９８とＨＤＬＣチャネル 、すなわち専用ＰＣＭハイウェイを作動させて、パケットを周辺基板５４から受 信して記憶し、制御データを含むパケットを専用ＨＤＬＣチャネルに適切なりロ ックサイクルで返送する。ＴＳＩスイッチ７０およびＨＤＬＣインターフェース ６９の主フレーム・クロックは好適には４゜０９６ＭＨｚであり、また、フレー ム同期レートは８ｋＨｚである。 さらに図８を参照する。マイクロコンピュータ８０に関連するメモリは、好適に は、構成可能メモリである汎用メモリモジュール（ＧＥＭＭ）９２を用いて構成 されていて欲しいが、このモジュール９２はシステムの要求に応じてＲＯＭ、Ｓ ＲＡＭ、疑似スタティックＲＡＭなどのいろいろなメモリタイプを受け入れての プログラムが可能なように配置可能メモリの物理空間構成になっている。またマ イクロコンピュータ８０は、高レベルデータリンク制＃（ＨＤＬＣ）インターフ ェース回路６９、およびＲ３−２３２４１１！インタ一フエース回路７１に結合 され、これによって図４と関連して説明したシリアル通信バス５７とＲ５−２３ ２リンクとを介してＧＴＵ４２の他の周辺基板との接続がなされる。 Ｉ　Ｉ　１．ＣＰＵ基　ソフトウェア ＣＰＵ基板ソフトウェアは、多層階層アーキテクチャを用いて書かれるが、好適 には、Ｔｕｒｂｏ−ＣとＴｕｒｂｏ−アセンブラによるコンピュータ・プログラ ミング言語を用いて書かれた低レベルドライバ、Ｔｕｒｂ。 −ＣとＴｕｒｂｏ−Ｃ＋＋コンピュータ・プログラミング言語を用いて書かれた 中間レベルのデータ処理コード、および本発明の特徴の１つである独自のコンピ ュータプログラミング言語によって書かれた高レベルコードを含む３層のソフト ウェア階層からなっていて欲しい、ＣＰＵ基板ソフトウェアは、一般に、電気通 信システム１０の各周辺基板Ｓ４およびその他のＣＰＴＪ基板に備えられている マイクロコンピュータによって容易にマルチタスク処理が可能な分散処理制御シ ステムを構成できるような設計になっている。 Ａ、−レベルドライバ 第１の階層は、基板と基板間の通信、オン・ボード・ハードウェア通信、および タイミング処理のためのソフトウェアモジュールである低レベルドライバからな っている。ＣＰＵソフトウェア低レベルドライバにより、ＣＰＵ基板ソフトウェ アのハードウェア特有部分が構成される、低レベルドライバは２個々のハードウ ェア装置のレジスタに対する書き込みおよび読み出しの処理シーケンスの実行に よりこれらの装置とのインターフェースを実現する。 高レベルコードと低レベルドライバとのインターフェース用ソフトウェア構成は 、送信呼び出し、すなわちｔＸ［コマンドパケット］と受信呼び出し、すなわち ｒｘ［コマンドパケット］からなる２つの関数呼び出しからなっている。コマン ドパケットは、−ａに、スロット・アドレス・バイト、ポート・アドレス・バイ ト、コマンド・バイト、およびオペランド・バイトからなっており、これについ ては後に図１８を参照しながらさらに詳細に説明する。好適にはこれらの関数呼 び出しは、ＣＰＵ基板５６がコマンドを周辺基板に送った、また周辺基板からの 応答を受信したりするのに用いるのと同じソフトウェア関数が用いられて欲しい 。 マイクロコンピュータ８０は、高レベル・プログラム・コードの制御のもとに送 信関数を用いてアウトバウンド・コマンドを発生する。このアウトバウンド・コ マンドは低レベル・コード・ドライバによってそのアウトバウンド・コマンドが ＣＰＵ基板装置に対するものなのか、または周辺基板に対するものなのかの判定 処理を行っている。もしそのコマンドがＣＰＵ基板装置に対するものである場合 には、その装置はその装置に対する低レベル・コード・プログラムの制御の下で コマンドを実行し、また応答をＣＰＵ基板５６の受信スタック７５（図７）に収 納する。もし、コマンド・パケットが周辺基板に対するものである場合には、マ イクロコンピュータ８ｏは。 パケットを送信スタック７４に収納し、ＣＰＵ基板ＨＤＬＣプロトコーラ６９に よって送信する１周辺基板がらの応答は、オン・ボード部品と同様に、受信スタ ック７５に収納される。応答は、高レベル・コード・プログラム・モジュールに よってアクセスされ、受信呼び出し関数を用いて受信スタック７５がら読み出す ことが可能である。 低レベルドライバは１割り込みサービスルーチン（工ＳＲ）を有しており、好適 には、これらの割り込みサービスルーチンは、Ｔｕｒｂｏ−Ｃによって書がれた 後にＴ　ｕ　ｒ　ｂ　ｏ−アセンブラによって実行速度をより速くするように書 き直されている１割り込みサービスルーチンは１例えば、ある１つの基板に対し て多数のタスクが検出されたときに優先順位を付けるのに有用である。ドライバ がＣＰＵ基板ソフトウェアとの他の相互作用を必要とすることなしに予め定義さ れているタスクを実行するように書かれているので、ある種の低レベルドライバ は中間レベルおよび高レベルコードがらは独立に動作する。その他の低レベルド ライバは、高レベルプログラムがアクセスできないようなプログラム・コードの 呼び出しをタスクが必要としているために、より高レベルのためのタスクの実行 用に書がれている。低レベルドライバの例としてはポート・タイマ・ドライバが あり、これはリアルタイム・クロック・チップ（図示せず）によって発生する】 ２秒間のハードウェア割り込みを用いるものである。その他のＩＳＲは、マイク ロコンピュータ８０の中の割り込みタイマ装置によってなされる１０ミリ秒のハ ードウェア割り込みを用いる。低レベルドライバは。 例えばＣＰＵ基板ＴＳＩスイッチ７０．ＣＰＵ基板の出力ラインに接続されてい る状態ＬＥＤ、およびシステムのタイミング制御を司るリアルタイム・クロック 回路（図示せず）の制御を行うように構成され得る。また。 低レベルドライバは、ＤＳＰによって生成されるトーンのタイミングおよびスイ ッチングと共にＤＳＰ７２のリセットおよびプログラムダウンロードの制御を行 うように構成され得る。さらに、低レベルドライバは）（ＤＬＣ割り込みサービ スルーチンを実行して会議などの通信サービスを提供するように構成され得る。 好適には、マイクロコンピュータ８０はタイマカウンタ（図示せず）を有してい て欲しく、その出力はマイクロコンピュータの割り込みラインに接続されている 。このカウンタは、リアルタイム・クロック回路および１０ミリ秒割り込みサー ビスルーチン（ＩＳＲ）によって作動され、マイクロコンピュータのメモリに記 憶されて割り込みラインにおよそ１０ミリ秒ごとのトリガをかける。 マイクロコンピュータ８０は、トーン制御用の低レベルドライバに応じて動作し 、ＤＳＰ７２によって発生されるトーンのタイミングとＤＳＰ７２の出力チャネ ルへのスイッチングとを行う６マイクロコンピユータ８ｏは、高レベルソフ１〜 ウェアルーチンの制御のもとにトーン・オン（ＳＴＮ）コマンドをＤＳＰ７２に 送信してトーン・パターンのリクエストを行うことができる。ＳＴＮコマンドパ ケットは、一般にＤＳＰ７２を制御してトーン・パターンをＰＣＭハイウェイ５ ７のいずれがの出力チャネルに供給するのに用いられる０例えばトーン・パター ンの発生は、トーンをポートにスイッチングし、その後無音状態を経過させてが ら、さらに次のトーンをそのポートにスッチングすることによって行い得る。マ イクロコンピュータ８ｏは、ＤＳＰ７２を制御し、このトーンスイッチング処理 を選択された回数だけ反復させることができる。このトーン反復回数、トーンの タイミング。 およびトーンとトーンとの間の無音状態の長さはコマンド・パケット内で指定で きる。 マイクロコンピュータ８ｏは、好適には、いろいろなトーンをＤＳＰ７２で発生 させるために複数のトーンデータベースを有する。例えば、３つのＤＳＰチャネ ルがそれぞれにダイアルトーン、サービス終了トーン、およびリング・バックを 供給するように備えられ得る。マイクロコンピュータは、これらのトーンデータ ベースの中から１つを選択してコマンドパケットの上記パラメータの初期化を行 う。こうして、１０ミリ秒ＩＳＲの間にマイクロコンピュータ８０によってトー ンＩＳＲが呼び出されると、トーンＩＳＲはマイクロコンピュータ８ｏを動作さ せてトーンＩＳＰに入った回数（１０ミリ秒ごとに入る）をカウントし、カウン ト数をトーンデータベースに記憶されている値と比較する。この比較結果により 、選択されたトーン・パターン・シーケンスの中でいっ新たなトーンあるいは無 音状態へのスイッチングをマイクロコンピュータ８０が行うべきか、あるいはシ ーケンスを停止すべきかが決定される。トーン・パターンは、高レベルドライバ が受信呼び出し関数を使用してトーン・オフ（ＳＴＦ）コマンドを低レベルドラ イバに送り、トーンを発生しているＤＳＰチャネルから他のチャネルにボートを スイッチしたときに終了する。ＳＴＮおよび無声状態へのターン・オン（ＳＴＳ ）コマンドによって、ＰＣＭハイウェイと呼び出し関数のコマンドパケットに指 定されているチャネルへのトーン発生の終了と、無声状態への切り替えとがそれ ぞれ行われる。 トーン制御低レベルドライバと類似の低レベルドライバを用いて、ＤＴＭＦトー ンの中継ラインへの送信が行われる。ＤＴＭＦトーンのマイクロコンピュータ８ ０によるリクエストは、ＤＴＭＦＦ−−ン（ＳＤＴ）コマンドをそのマイクロコ ンピュータ８０と関連するＤＴＭＦ−ＦＩＦＯに送信することによって行われる 。ＳＤＴコマンドはＤＳＰ７２を動作させてＰＣＭハイウェイと、キーバッド敷 用のＳＤＴコマンドパケットに指定されているチャネルと、やはりコマンドパケ ットに指定されている出カポ−１〜との上にＤ　Ｔ　Ｍ　Ｆ　）−−ンを発生さ せる。マイクロコンピュータ８０によってＤ　Ｔ　Ｍ　Ｆ　−Ｉ　Ｓ　Ｒの呼び 出しが行われる際、１０ミリ秒ＩＳＲのカウンタ・ルーチンによってＤＴＭＦ− ＩＳＲが１０回ごと、すなわち１００ミリ秒ごとに呼び出される。マイクロコン ピュータは、次のコマンドをＤＴＭＦ−Ｆ　Ｉ　ＦＯから読み出してキーバッド 数をそのコマンドから得て、そのキーバンド数をＤＳＰ７２に送る６ついで、マ イクロコンピュータ８０は、ＤＳＰのＤＴＭＦ出力チャネルを指定されたボート にスイッチする。ＤＳＰ７２のＤＴＭＦ発生器は、リクエストされたＤＴＭＦ　 ）−−ンを発生し、このトーンをＤＴＭＦ出力チャネルに送る。１００ミリ秒後 に次にＤＴＭＦ−ＩＳＲに入ったときに、マイクロコンピュータ８０は、ボート を無声状態にスイッチする。さらに１００ミリ秒後に次のＤＴＭＦ−ＩＳＲに入 ると、マイクロコンピュータ８０はＤＴＭＦ−Ｆ　Ｉ　ＦＯを調べて次のコマン ドに対して処理を反復実行すべきかを判断する。 また、マイクロコンピュータ８０のメモリには電話会議を実現するための低レベ ルドライバが設けられている。 マイクロコンピュータのメモリは、８つもの多くのボート、すなわち、６４にビ ット／秒の音声チャネルに対する接続決定用のデータを記憶するための会議デー タベースを有している。ＤＳＰ７２は、好適には電話会議のための４つの入力チ ャネルと４つの出力チャネルを有している。本発明においては、ＣＰＵ基板５０ は、好適には。 会議機能を利用している最初の３ユーザのそれぞれが、すべての８ユーザに対し て話すことができ、また他の２ユーザの話を聞くことができるようになされてい る。その他の５ユーザは、一般には１話している最初の３ユーザの話を単に聞く ことができるだけである。音声信号エネルギレベルが大きな上位の３ボートが８ つの中の最初の３者として会議データベースに保持される。特定のボートに関す るデータと音声信号エネルギレベルデータとがそのボートに対応するＰＣＭハイ ウェイおよびタイムスロットに連らなる会議データベースの割り当てられた８つ の位置のどれか１つに記憶される。あらたなボートが会議データベースに加えら れると、マイクロコンピュータ８０はそのボートを会議データベースの中の利用 可能な位置に割り当てる。 会議データベースの最初の３つの位置のボートの出力は、それぞれマイクロコン ピュータ８０によってＤＳＰ７２の最初の３つの入力チャネルにスイッチ接続さ れる。 会議データベースの残りの５つの位置のボートの出力は。 以下に説明するように、第４のＤＳＰ入カ入子チャネル互にスイッチ接続される 。ＤＳＰは会議データベースの第２および第３の位置にボートを加えて、第１の ＤＳＰ出力チャネルの信号をスイッチ接続するように動作させることが可能であ る。さらに、ＤＳＰは、会議データベースの第１および第２の位置および第１お よび第３の位置にボートを加えて、信号をＤＳＰの第２および第３の出力チャネ ルに対してそれぞれスイッチ接続するようにもできる。ＤＳＰは、ボートを会議 データベースの最初の３つの位置に加えて、結合された信号をＤＳＰの第４の出 力チャネルに対してスイッチ接続する。 １０ミリ秒おきのＩＳＲの生起によってマイクロコンピュータ８０が呼び出す会 議ＩＳＲの実行中に、ＤＳＰ７２は、第４のＤＳＰ入カ入子チャネルイッチ接続 されたボートのエネルギ値をマイクロコンピュータ８ｏに供給する。会議ｊＳＲ は、８つの会議データベース位置に割り当てられたボートを交互に第４のＤＳＰ 入方子方チャネル続する６８つの会議Ｉ　ＳＲが終了すると、各位置に割り当て られたすべてのボートに対す音声エネルギがマイクロコンピュータ８０に与えら れる６もし、第４がら第８までのデータベース位置のどれが１つに割り当てられ たボートが第１、第２、あるいは第３のデータベース位置に割り当てられている ボートよりも大きなエネルギを有している場合には、マイクロコンピュータ８０ は、そのボート位置の割り当てを第１、第２．第３の位置に割り当てられたボー トの中の最小のエネルギを有するボート位置に切り換える。次に、新たな会議デ ータベース位置に対応するように、ボート接続がＤＳＰによって切り換えられる 。 会議を行っている話者の数が８よりも少ない場合には、エネルギが占有されてい る位置のみを調査する以外は同じ方式が用いられる。もし、会議を行っている話 者の数が３以下である場合には、エネルギの比較は実行されない、会議は１０ミ リ秒おきのＩＳＲによってなされるので、マイクロコンピュータは１０ミリ秒Ｉ ＳＲを交互に用いて２つの会議のサポートを行うように動作可能である。高レベ ルコードにおいて生起し、低レベルコードを呼び出して会議を開始する３つのコ マンドパケット・がある。ボート追加（ＳＣＡ）コマンドは、指定されたＰｃＭ ハイウェイチャネルからのボートを指定されたハイウェイチャネルに追加する。 ＳＣＡコマンドパケットのオペランドには、２つの会議のうちのどちらへボート を追加するのかを指定するための少なくとも１ビツトが含まれている。１ボート 切り離しく５ＣＤ）コマンドは第１または第２の会議から１つのボートを切り離 すためのものであり、また全ポート切り離しく５ＣＸ）コマンドは指定された会 議からすべてのボートを切り離すためのものである。 ＨＤＬＣ割り込みサービスルーチン（ＩＳＲ）、あるいはＨＤ　Ｌ　Ｃ低レベル ドライバがＣＰＵ基板５０と周辺基板５４との間の通信を制御するために設けら れている。 マイクロコンピュータは１０ミリ秒ごとにＩＳＲを実行するたびにＨＤＬＣ−Ｉ ＳＲを呼び出す、ＨＤＬＣインターフェース６９は、ＨＤＬＣ−ＩＳＲの制御の もとにＨＤ　Ｌ　Ｃインターフェース６９の状態レジスタを調べる。 もし、エラーが検出された場合には、ＨＤ　Ｌ　Ｃインターフェース６９はリセ ットされる。もしＨＤＬＣインターフェースが受信パケットを有している場合に は、エラー検出がなければ、ＨＤＬＣインターフェース６９はそのパケットをＨ ＤＬＣ受信バッファから入力してマイクロコンピュータ８０の受信スタック７５ に収納する。ＨＤＬＣインターフェース６９が、受信パケット上にエラーを検出 した場合には、ＨＤ　Ｌ　Ｃインターフェ・−スはそのパケットを切り捨て、そ のエラーパケットを送信した周辺基板に対して否定応答（ＮＡＫ）コマンドを送 信する。 もし、ＨＤ　Ｌ　Ｃインターフェース６９がパケット受信しておらず、マイクロ コンピュータ８０が応答待ちの状態にある場合には、タイムアウト・コマンドが ＨＤ　Ｌ　Ｃ−ＩＳＲに従って受信ＦＩＦＯ７５に置かれる。もし、ＨＤＬＣイ ンターフェースから周辺基板５４に送信された最後のコマンドが従属動作問い合 わせ（ＳＡＩ）コマンドであった場合には、ＨＤＬＣインターフェースは、ＨＤ ＬＣ−ＩＳＲの制御のもとに送信スタック７４から次のコマンドパケットを取り 出してＨＤＬＣ送信バッファに置く。さもなければ、ＨＤＬＣインターフェース は、一般に、構成ファイルの基板の循環リスト上の次の周辺基板５４に対してＳ ＡＩコマンドを送信して連続的に各周辺基板の状態を調べ、マイクロコンピュー タ８０から送られる次のコマンドを受信する。 タイム・スロット・交換スイッチ７０を動作させるための低レベルドライバが設 けられている。マイクロコンピュータ８０は、スイッチ接続（ＳにＮ）コマンド を用いて任意の入力ボート（すなわち、ＰＣＭハイウェイ５７の中の１つのチャ ネル）を任意の出力ボート１こ接続するように制御することが可能である。また 、スイッチ読み出しく５ＲＤ）コマンドをマイクロコンピュータ８０から受信し たときにスイッチを作動させ、受信ＰＣＭハイウェイ・チャネル・データを記憶 するためのスイッチ関連のメモリレジスタからディジタルデータを読み出し、Ｐ ＣＭハイウェイ・チャネルデータを受信スタック７５中に収納することができる 。また、スイッチは、スイッチ書き込み（ＳＷＲ）コマンドに従ってデータをチ ャネルデータレジスタから指定された出力ボートに対して書き込むことができる 。また、マイクロコンピュータはスイッチに対して出力チャネル・スイッチ・リ セット（ＳＲ３）コマンドを発して、指定されたチャネルを高インピーダンス状 態とすることができる。さらに、スイッチ無音状態（ＳＴＳ）コマンド、および スイッチリセント・初期化（Ｓ　Ｉ　Ｎ）コマンドをスイッチ７０に送って・そ れぞれのコマンドによって指定されたボートを無音状態とすること、および、ス イッチをリセットして初期化することができる。専用Ｐ　ＣＭハイウェイ５９の ３２チヤネルに対してスイッチは独立に書き込みが可能である。 従って、専用ＰＣＭハイウェイは、最初のチャネルの最初のビットに１１１１１ を書き込み、そのチャネルの他のビットにはＩＩ　ＯＩＩを書き込み、またその 他の残りの３１チヤネルにも同様にすることによって、ＤＳＰ７２に対するフレ ーム同期をとるのに有用である。 マイクロコンピュータ８０に関連するリアルタイム・クロック（図示せず）を制 御するための低レベルドライバが設けられており、これによって、システムタイ ムが提供される。リアルタイム・クロックはマイクロコンピュータ８０に対する １秒間ハードウェア割り込みを発するために初期化されるが、このマイクロコン ピュータ８０はソフトウェア・ボート・タイマの制御を行うのに用いることが可 能であり、ソフトウェア・ボート・タイマは、マイクロコンピュータメモリ中に 配置されてそれぞ゛　れ１９２の利用可能ボートの対応する１つに関連している ６先に述べたように、ボートの１９２という数は、単に例示的なものであり、シ ステム１ｏは任意の数のボートをサポートすることが可能である。 ボートタイマは、ボートタイマ初期化（ＰＴＩ）コマンドパケット中に指定され たボートアドレスに対応するボートタイマに対してポートタイマ初期化（ＰＴＩ ）コマンドパケットを送ることによりマイクロコンピュータ８０によってセット される。タイマは、ＰＴＩコマンドパケットに指定されたタイムアウトの値にセ ットされる。 ０よりも大きな値にセットされたボートタイマの値は。 各１秒割り込みの実行中において、１ずつ減少していく。 ボートタイマの値が０から１へ遷移すると、そのボートに関連するデータが受信 スタック７５に置かれる。ポートタイマは、タイムアウトとなる前であっても、 タイムアウトの値がＯであるＰＴＩコマンドによって任意の時刻において止める ことができる。高レベルソフトウェアに従ってマイクロコンピュータによってリ アルタイム・クロック・チップ制御用に送信可能な他のコマンドパケットとして は、リアルタイム・クロックの日付と時間の設定を行うためのリアルタイム・ク ロック・セット（ＲＴＳ）コマンドと、リアルタイム・クロックの日付と時間を 読み出して受信スタック７５に置くためのリアルタイム・クロック・読み出しく ＲＴＲ）コマンドと、チップ上のリアルタイムを初期化するためのリアルタイム ・クロック初期化（ＲＴＩ）コマンドと、チップ上のリアルタイムを、最も近い 正分に合わせるためのリアルタイム・クロック調節（ＲＴＡ）コマンドとがある 。 ＤＳＰ７２のためのソフトウェアは、ＣＰＵ基板５０のＲＯＭに記憶される。初 期化において、ＤＳＰのリセットが行われ、また、ＤＳＰソフトウェアがＲＯＭ からダウンロードされる。このリセットは、ＤＳＰのリセット回路に接続されて いるマイクロコンピュータ８０内のラッチされた出力ポートをストローブさせる ことによって行われる。ＣＰＵ基板低レベルソフトウェアは、マイクロコンピュ ータ８０を制御して、ＲＯＭの最初の２バイ１へからＤＳＰプログラムのサイズ を読み出す。次いで。 マイクロコンピュータは、ＲＯＭからプログラムを読み出し、これを一度に３バ イトずつＤＳＰホストボートに送る。高レベルコードは、ＤＳＰリセットコマン ドパケットあるいはダウンロード（ＤＲ５）コマンドパケットをＤＳＰに送るこ とによって、いつでもＤＳＰプログラムのリセットとダウンロードとを行うこと ができる。 ３つの状態ＬＥＤがマイクロコンピュータ８０の３つのラッチ出力ラインに接続 されており、高レベルソフトウェアの制御のもとにＬＥＤコマンドパケットがマ イクロコンピュータから送られると＋　ＬＥＤのための低レベルソフトウェアト ライバは、マイクロコンピュータを制御して信号を適当なラインに供給してＬＥ Ｄの制御を行ら基板に送受信すべきＮＡＫパケットの数を判定するために高レベ ルソフトウェアが発生するＮＡＫ送信（ＮＴＸ）コマンド、およびＮＡＫ受信（ ＮＲＸ）コマンドがある。 Ｂ、中間レベルコード 第２の階層のＣＰＵ基板ソフトウェア、すなわち、中間レベルコードは１本発明 の高レベル言語と低レベルドライバとの間の仲介を行う関数である。中間レベル コードには、データ、サブルーチン、ソフトウェア・マネージャ、およびインタ ープリタ・プログラム・モジュールが含まれるが、これらのそれぞれについて、 以下に説明する。 中間レベルコードに含まれるデータには、特徴プログラミングなどの各ポートの プログラム可能な加入者データ、ポートに割り当てられたディレクトリ数（ＬＤ Ｎ）のリストなどの固定加入者データ、および状態データ（すなわち、ホールド あるいはオンフックなどのライン状態）があり、これらのデータはシステム状態 およびシステム構成に関する他のデータと同様に、マイクロコンピュータ８０に よってそれぞれの用途に応して変更することが可能である。好適には、Ｔｕｒｂ ｏ　Ｃ＋十を用いて通信システム１０の各ポートに対応するデータがカプセル化 される。従って、各ポートにはＣＰＵ基板メモリ空間が割り当てられ、実行時に おいて、上記のグリティカルシステムデータを含むオブジェクトデータコードが ここに記憶される。オブジェクトデータコードに関連するデータは、好適には、 オブジェクトデータコード内の小さなサブルーチンであるボート自身のオブジェ クトボートコードによってのみ変更が可能である。 また、中間レベルコードは好適にはＴｕｒｂｏＣによって書かれ、高レベル言語 によって必要に応じて呼び出されるサブルーチンを含む。これらのルーチンは、 あらかじめ定められた特有の関数を有しており、その中に計算解析、あるいは大 規模データ処理を含ませることができる６例えば、呼び出されたときに、動的に 割り当てられたＣＰＵ基板５６のマイクロコンピュータ８０の先入れ先出しくＦ 　Ｉ　ＦＯ）記憶装置にパケットを配置するようなマクロ・サブルーチンを書く ことができる。具体的にどのパケットがそこに配置されるかは、リクエストされ ているマクロとこれをリクエストしているポートとに依存する。ＦＩＦＯに配置 されるパケットは、一般に予測されるような種類のものである０例えば、誰かが ある番号をコールしたとき、システムがそのコールを転送するように構成するこ とができる。このタスクを実現する１つの方法は、新たに番号をＣＰＵ基板上の ＦＩＦＯにマクロとして配置することである。この番号はあたかも電話から直接 に来たものであるかのように見える。このとき、既存の番号は消去され、マグロ は番号を収集している高レベルコード、すなわち、後に説明するコールプロセッ サなどの一部を新しい番号に置き換える０次に。 主ソフトウェアプログラムの制御のもとに新しい番号のダイアルが再開される。 マグロは、ユーザが高レベル言語でプログラムを行うのを助けるツールである。 マクロを用いることによって、いろいろな状況に対してより容易に対応できるよ うになる。好適には、２０のマクロＦＩＦＯがＣＰＵ基板のメモリに割り当てら れる。このＦＩＦＯの数、従ってそのサイズも容易に変えることが可能である。 あるポートがマクロパケットを受信すると、そのときに１つのＦＩＦＯがそのポ ートに対して割り当てられる。そのＦＩＦＯが空になると、そのＦＩＦＯはその ポートへの割り当てがはずされて他のポートに自由に用いることが可能となる。 マクロＦＩＦＯはＣＰＵ基板の主ＦＩＦＯよりも高い優先順位を有している。従 って、マスター制御プログラムは、マイクロコントローラを制御してマクロＦＩ ＦＯの読み出しを最初に行い、これが空となってから後に。 主ＦＩＦＯからの読み出しを行う。 中間レベルコードで書かれたマネージャは、特定のＣＰＵ基板あるいは周辺基板 機能、またはシステム機能を制御するためのさらに大きなサブルーチンである０ 例えば、システム１０の周辺基板５４に結合されたアナログおよびディジタル通 信装置が用いるいろいろな通信プロトコールは、一般にこれらの各周辺基板用に 書かれたマネージャによって処理され、プロトコールが異なってもその相違が本 発明に用いられる高レベル言語プログラムモジュールに対して遮蔽される。各マ ネージャは、基板が所定の動作をするように、あるいはシステムが完全な動作を するように、どのような種類のデータがＣＰＵ基板あるいは周辺基板、またはシ ステムに送られようとしているのか、また、どのように、また、いつ、そのデー タを送るべきであるかをマネージャが知ることができるように本質的に書かれる 。ＣＰＵ基板ソフトウェアは。 周辺基板あるいはその他のＣＰＵ基板から受信したデータ・パケットを解析して 、どのソフトウェアマネージャがそのパケットを処理するのに適当であるかを決 定するように書かれる０次いで１選択されたマネージャは、システムデータを変 更してからそのパケットを棄却するか。 または、単にそのパケットを棄却するか、または、データの変更を行ってから後 にそのパケットを高レベルソフトウェアコードに送って処理を行うようにするが 、または、データを変更を加えずに高レベルコードプログラムモジュールに引き 渡す、このようにして、マネージャによって、基板あるいはシステムにそれらの 基板あるいはシステム特有の機能や特性を持たせながら、高レベルコードによる 均一なインターフェースを提供することができる。また、マネージャは以下に説 明するように、高レベル言語モジュールからも呼び出すことが可能である。 中間レベルコードのもう１つの重要な形態としてインタプリタがあり、これは高 レベルコードモジュールから翻訳されたデータコードを実行するプログラムであ る。 このデータコードは、主ＣＰＵソフト・ウェアすなわち低レベルドライバ、およ び中間レベルコードのデータとサブルーチンとマネージャとが用いることができ る。このインタプリタを本発明独自の高レベル言語とともにインプリメントする ことによって、電気通信システム１ｏのユーザは、プロセッサコードを書くこと によって、事実上ユーザが望む通りに電気通信システム１ｏを構成して用いるこ とができる。図９を参照しながらこのインタプリタについて以下に説明する。市 販品として入手可能な。 ＰＣ互換翻訳プログラムを用いて、言語”置ＥＣ０Ｍ　”によるプログラムの英 数字構文をインタプリタによって実行可能なデータコードに変換することが可能 である。翻訳の後に、データフードファイルは、ＣＰＵ基板メモリ中にダウンロ ードすることができる。また、データフードのダウンロードを行う際に、翻訳ソ フトウェアはインクルートファイル（以下に説明する）を用いるようにすること もできる。 Ｃ０高レベルコード 第３のレベルのＣＰＵ基板ソフトウェアは１本発明独自の高レベルコードである 。この高レベル言語は、３つの一般的なコマンド、即ち、動作コマンド、および ２種類のファイルからなっており、以下では、これらをプロセッサと呼ぶことに する。先に述べたように、ＣＰＵ基板は、制御プログラムメモリ７９中に高レベ ルコードプログラムラインをマイクロコンピュータ８０が理解できるコマンドに 翻訳するためのインタプリタプログラムモジュールを有している。 第１の種類のプロセッサは、コールプロセッサと呼ばれるものである。好適には 、コールプロセッサは、電気通信システム１０に１つだけ備えられる。他の種類 のプロセッサは、ディバイスプロセッサと呼ばれるものである。システム１０に はインタプリタが翻訳するように書かれた数だけの多くのデバイスプロセッサを 所持させることができる。コールプロセッサはシステム１ｏの中で最も高レベル のソフトウェアである。コールプロセッサおよびデバイスプロセッサのどちらも それぞれのマネージャをアクセスすることが可能であり、また特定のデーを変更 することができる。また、コールプロセッサは、デバイスプロセッサの中のプロ グラムモジュールを呼び出すことも可能である。デバイスプロセッサは他のデバ イスプロセッサのプログラムモジュールを呼び出すことが可能ではあるが、コー ルプロセッサの場合と比べると限定されている。デバイスプロセッサは、電気通 信周辺装Ｗ（すなわち、アナログ電話、ディジタル電話、中継ラインなど）の処 理を行うように書がれる。コールプロセッサは、アナログ電話、ディジタル電話 、ｌ５ＤＮ電話、端末、自動オペレータを含むいろいろな周辺装置がらのコール をＣＰＵ基板が事実上同じように処理することができるように、すべての装置に 対する共通モジュールとして書かれる。ＣＰＵ基板は、そのソフトウェア。 特に、コールプロセッサによって、これらの各周辺装置に対して呼び出し信号発 生、呼びの接続、呼びの保留。 電話会議などのシステム動作を実行することができる。 装置が異なると異なるやり方で処理する必要があるため、コールプロセッサは、 デバイスプロセッサのモジュールの呼び出しを行う０例えば、アナログ電話の番 号の捕集は、ディジタル電話の場合とは異なった捕集の仕方をする。また、これ らは、中継ラインの番号捕集とも異なっている。デバイスプロセッサは、マネー ジャとともにこれらの動作上の相違をコールプロセッサから遮蔽する。 理想的には、これによって、より簡単に異なる装置をシステムに追加することが 可能となり、各装置の特性の特有性がコールプロセッサに対して緩和される。 先に述べたように、この高レベル言語は、一般に以下の３つの動作コマンドを有 している。すなわち、″Ｘ′コマンド、ＰＩＱＩ！コマンド、および”Ｃ”コマ ンドである。付録１．Ｂ、およびＣに示されているソフトウェアプログラムは、 高レベル言語によって書かれたプログラムの例である。”Ｘ”コマンド、すなわ ち送信コマンドが発せられると、マネージャは１通常、データ・パケットの周辺 基板への送信と、それ自身のデータの整合を含む処理を開始する。また、ｎ　Ｘ 　ｌ＋コマンドには、各ボートのオブジェクトデータベースへのアクセスが含ま れている。これが可能であるのは、オブジェクトデータベースの配列にはそれ自 身のマネージャが備えられているためである。それぞれの種類の物理的基板（主 ＣＰＵを除く）は、好適にはそれ自身のマネージャを有している。′Ｘ”コマン ドがアクセス可能なシステム機能用の多くのマネージャが存在する。 もう１つのコマンドである”Ｑ　Ｉ＋すなわち質問コマンドは、高レベルコード の意思決定コマンドである。これは、マイクロコンピュータ８０に関連するグロ ーバル・コマンド・バッファ（図示せず）の特定のバイトのテストを行い、その 内容に応じて、高レベル言語の新しい位置ヘジャンプする。このコマンドによっ てグローバル・コマンド・バッファの内容が変更されることはないので、連続し ていくつかの″Ｑ′″コマンドを同じデータに対しで実行することが可能である 。 第３の動作コマンドは、′ｆＣ”すなわち”コマンドがコマンドであり、おそら く、最も複雑なコマンドである。 このコマンドは、高レベルコードで書かれたプロセッサが無条件に新しい位置に ジャンプして、コールプロセッサからデバイスプロセッサ内のモジュールを呼び 出し、Ｔｕｒｂｏ−Ｃで書かれたあらかじめ定義されたサブルーチンを呼び出し て、ウェイト・ステートメントを指定するか、あるいは呼び出したモジュールか ら呼び出し元のプロセッサに戻る。 高レベル言語の一般的なコマンドとしてＩＮＣＬＵＤＥステートメント、ＤＥＦ ＩＭＥステートメント、およびＥＮＴＲＹステートメントの３つがある。ＩＮＣ ＬＵＤＥステートメントは、一般に、プロセッサファイルあるいはプログラムモ ジュールの最初の部分に置かれる。 マイクロコンピュータ８０が、中間レベルのインタプリタプログラムに基づいて 動作するとき、ＩＮＣＬＵＤＥステートメントによって、高レベル言語プロセッ サファイルから主ＣＰＵソフトウェアが用いることが可能なファイルへの翻訳に 用いるための定義ファイルの名前がマイクロコンピュータに提供される。マイク ロコンピュータ８０は、プロセッサコードで指定された定義ファイルをスキャン してデータ変換情報を探す、ＤＥＦＩＭＥステートメントは、マイクロコンピュ ータがインタプリタプログラムを実行しているとき、リセット状態の後にマイク ロコンピュータがジャンプすべきコードのライン番号に関する情報と、そのファ イルの最初のライン番号に関する情報とをマイクロコンピュータ８ｏに提供する 。 また、ＥＮＴＲＹコマンドは、特定のプログラムモジュールがどこで開始し、ど こで終了するかに関する情報をマイクロコンピュータ８ｏに提供する。 マイクロコンピュータ８ｏが中間レベルインタプリタプログラムモジュールを実 行して、ユーザが作成したプログラムを翻訳する方法について、図９を参照しな がら説明する６本発明によれば、ユーザは、独特の高レベル言語を用いてプログ ラム・コードのファイルであるコールプロセッサ、およびいろいろなデバイスプ ロセッサを作成することができる。好適には、電気通信システム１０の少なくと もＧＴＵの１つがキーバッドを具備したユーザ端末（図示せず）に結合されてい るか、あるいは、ソフトウェアダウンロードプログラムを具備しており、これに よってユーザがディジタルデータ（すなわち、プログラム・コード）を大刀して そのＧＴＵに関連するＣＰＵ基板に転送することが可能なようになされている。 ユーザ端末は、ＣＰＵ基板出方コマンド、問い合わせ、あるいは命令を表示する ためのＣＲＴ表示装置を有するようにできる。 ブロック１００に示すように、一般に、ユーザプログラムは翻訳すべきプログラ ム・コードのソースファイル、出力ファイル、およびデバッグ用出力ファイルの 各ファイルの名前に関するデータをマイクロコンピュータ８゜に提供する。ブロ ック１０２に示すように、マイクロコンピュータ８０は、これらのファイルのオ ープンを、そのプログラム・コード中にＩＮＣＬＵＤＥステートメントによって 指定されているすべての定義ファイルに沿って行う。 図９をさらに参照する。マイクロコンピュータ８ｏは。 ブロック１０４に示すように、ソースファイルの１ラインずつの読み出しを開始 する。もし、ラインがＥＮＤステートメントを含んでいれば１判定ブロック１０ ６の肯定分岐およびブロック１０８に示すように、マイクロコンピュータ８０は オープンされているファイルのクローズを開始する。ブロック１１０に示うよう に、マイクロコンピュータ８０は、主ＣＰＵソフトウェアが利用可能なコードに ソースファイルの内容をうまく翻訳する範囲に関連する統計量を提供するように プログラムされ得る。 もし、判定ブロック１０６の質問に対する答が否定的である場合には、マイクロ コンピュータ８ｏは、ブロック１１２に示すように、定義ファイルを探索して、 そのラインの要素に対応する符号化文字を探すことによって。 そのラインのすべての要素の翻訳を行う。マイクロコンピュータ８ｏは、それぞ れブロック１１４および１０４に示すように、ソースファイルの次のラインのコ ードの読み出しを行う前に、翻訳したコードを指定された出方ファイルに記憶す る。ＥＮＤステートメントを含むラインに達するまで、マイクロコンピュータ８ ｏは連続してソースファイルコードを１ラインずつ読み出して翻訳する。 インタプリタプログラムは、一般に、いくつかのデータファイルを生成する０例 えば、第１のファイルは、工Ｎ　ＣＬ　Ｕ　Ｄ　Ｅステートメントの必要とする 定義ファイルで指定のバイトへ変換後のソースコードを含む、マイクロコンピュ ータ８０によって生成される。第２のファイル、すなわちジャンプファイルは、 マイクロコンピュータによってインタプリタコードに従って生成されるが。 インタプリタコードはモジュールからライン番号への変換のための参照用テーブ ルを含んでいる。このテーブルを用いることにより、マイクロコンピュータは、 ソースコードによって呼び出されたプログラムモジュールにすばやく正確にアク セスすることが可能である。 付録１　Ｂ、およびＣを参照する。これらは、それぞれ、コールプロセッサ、ア ナログデバイスプロセッサ。 および中継デバイスプロセッサの高レベル言語プロセッサファイルについて示し たものである。各プロセッサファイルは、ファイルに最初に、コマンド定義ファ イル。 およびパラメータ定義ファイルの名前を指定する２つのＩ　ＮＣＬＵＤＥステー トメントを含んでいる。コマンド定義ファイル、およびパラメータ定義ファイル については、それぞれ、付録りおよびＥに示しである。 コマンド定義ファイルは、高レベルコードで書かれたいくつかのマネージャのそ れぞれのインバウンドおよびアウトバウンドコマンドを翻訳するためのデータ変 換情報を含んでおり、これらのマネージャとしては、ＤＢＡＳＥマネージャ、タ イマカウンタマネージャ、トーン生成マネージャ、記憶装置マネージャ、テキス トメツセージマネージャ、ＤＴＭＦデコーダマネージャ、トーンデコーダマネー ジャ、ＤＴＭＦアイアルマネージャ、スイッチマネージャ、会議マネージャ、ア ナログ基本サービスマネージャ、中継幹線基本サービスマネージャ、およびエラ ー状態に関するその他のコマンドがある。パラメータ定義ファイルは、マネージ ャコマンドと共に高レベルプログラムにコード化されたいろいろなデータ値に関 するデータ変換情報を含んでいる。例えば、パラメータファイルは、捕集ビット （あるポートが端末からの入力データを探していることを示すビット）などの特 別なシステム状態情報を提供する情報ビットおよびバイトの定義、およびタイプ ・バイト（どのような種類の周辺装置がそのバイトを含むパケットと関連してい るかを示すバイト）を定義する。また、パラメータファイルは、ダイアルされた あるいは転送された電話番号に関するダイアル番号配列などの、配列の定義も行 う。 付録ＡからＣの高レベル言語プロセッサファイルをさらに参照しながら高レベル コマンドの構文について説明する。先に述べたように、コマンドには３種類ある 。７ＣＯＭＭＡＮＤ’″を表すｊＩ　Ｃｊｌによって始まるプログラムラインは 、以下ｔ；示すようないろいろな機能を果たす。 ＩＩ　ＣＩ＋コマンドには、一般に、他の位置へのジャンプ、パケット・受信待 機、あるいは、Ｔｕｒｂｏ　Ｃ＋＋コードのサブルーチン実行が含まれる。”Ｘ ”で始まるプログラムラインすなわち１′送信コマンド”は、そのコマンドおよ び括弧中に指定されたパラメータとに従ってマネージャをアクセスするのに用い られる。”Ｑ　Ｐ＋で始まるプログラムライン、すなわち”質問″′コマンドは 、グローバル・コマンド・バッファのデータをテスト比較し。 比較結果に基づいてプロセッサの新しい位置にジャンプするのに用いられる。 Ｃコマンドは、一般に、　Ｃ［動作＝位置、方法、制御ボートコ　の形式を有す る。動作フィールドは、一般に、Ｗ、Ｊ、Ｓの３つのタイプのうちのいずれかで ある。 Ｗすなわち、′待機″コマンドは、インタプリタに指定されたポートの処理を停 止して、このポートへのパケットが受信されるまで待機するように命令するもの である。 マネージャがパケットを受信し、翻訳のためのグローバル・コマンド・バッファ のセットアツプを行うとこのポートの処理の実行が再開される。翻訳はこの位置 から再開される。制御中のポートへのエントリあるいはメソッドはこの場合許さ れない。Ｊコマンドすなわち″ジャンプ”コマンドは、プログラムポインタを新 しい位置に移動させて、翻訳を再開するようにインタプリタに命じるものである 。Ｓコマンド、すなわち、サブルーチンコマンドは、特別に書かれたサブルーチ ンをここで実行し、終了したら、次のラインから再開するようにインタプリタに 命令するものである。これらのサブルーチンは、本発明の高レベル言語すなわち 置ＥＣ０Ｍによってプログラムすることができないタスクを実行するのに必要な ものである。これらのタスクとしては１例えば、大量のデータ処理や、複雑な意 思決定のタスクなどがある。 位置フィールドは、その前のフィールドの”動作”に依存する。Ｗ動作の場合に は１位置フィールドは、同一プロセッサ内の位置を表す英数値からなる。この英 数値には、ＬＡＳＴ　（最後）、あるいはＮＥＸＴ　（次）が含まれる。これら は、それぞれ、直前および次の位置を指定する１ライン移動ステートメントであ る１位置フィールドに用いることが可能な他の値としてＣ０ＮＴＩＮＵＥ（続行 ）があり、これはデバイスプロセッサにおいてだけ許される。このコマンドは、 コールプロセッサによって呼び出された他のデバイスプロセッサへリターンさせ るためのものである。Ｗ動作は他のプロセッサへのジャンプを行うのに用いるこ とができる。制御中ポートあるいはメソッドのエントリはここでは許されない、 Ｊ動作には２つのフォーマットがある。第１のフォーマットは、現在のプロセッ サの新しい位置への無条件直接ジャンプを含むものである。（これは、Ｗ動作で も同様である）また、マイクロコンピュータ８０の制御を、あるプロセッサから 他のデバイスプロセッサまたは呼び出し元のコールプロセッサにリターンさせる ためのＣ０ＮＴｒＮＵＥ　（続行）位置を指定することも可能である。ここでも 、制御中ボートあるいはメソッドのエントリは許されない、第２のフォーマット は、他のプロセッサへのジャンプを含むものである。これは、他のプロセッサへ の単なるジャンプである。この場合には、制御中ボートおよびメソッドのエント リが必要である。制御中ポートとは、モジュール位置決めあるいは位置決めが実 行されているポートのことである。終了すると（すなわち、ｃＯＮＴＩＮＵＥ　 （続行）に達すると）、プログラム制御は、制御中の元のポートに関する次のラ インに戻る。メソッドは、具体的にどのような制御条件のときにこのジャンプが 起こるかをインタプリタに知らせるために必要なものである。これには、３つの 条件がある０例えば、サブルーチン動作の場合では１位置パラメータはサブルー チン名である。メソッドおよび制御中ボートは、サブルーチンに引き渡されたパ ラメータである。サブルーチンは、パラメータをグローバル・コマンド・バッフ ァ内に残して、独自の高レベル言語”置ＥＣ０Ｍ”の使用に供するようにすこと も可能である。 Ｘコマンドは、一般に、Ｘ［マネージャ、コマンド＼データ１．データ２．デー タ３．・・・］　の形式を有する。マネージャフィールドは、単にコマンドおよ びデータによって呼び出されるマネージャを示すものである。 好適には、これが置ＥＣ０Ｍ言語からマネージャを呼び出す唯一の方法とされる 。コマンドフィールドは。 マネージャにおいて呼び出される具体的なコマンドである。コマンド名は１通常 は１頭文字が用いられる。各マネージャは、それに固有のコマンドを有しており 、いくつかのコマンドは共通である１頭文字によるコマンドの記述例は、付録り に示しである。これに続く、データエントリの数は、そのコマンドが何を必要と するかに依存する。データフィールドは、マネージャに供給されるパラメータで ある。これらは、付録Ｅに示すように、ハードコード数あるいはパラメータで構 成するようにできる。 いくつかのパラメータは、マネージャに単に数値だけが供給されるだけのもので ある。一方、インタプリタにグローバル・コマンド・バッファ中の指定されたポ ートに特別なデータを配置するように知らせるパラメータもある。この特別なデ ータの例はパラメータ”ＰＯＲＴ”（ポート）である、ＰＯＲＴ　（ポートパラ メータ）は、インタプリタに現在処理されているポートの番号を指定された位置 に配置するように命じるものであり、単なる数値ではない。 Ｑコマンドは、一般に、Ｑ［どのパラメータ／値？＝位置？］の形式を有してい る。″どのパラメータ”はテストすべきグローバル・コマンド・バッファ（ＧＣ Ｂ）の位置である。ＣあるいはＰＯはバッファの最初のバイトを表す。Ｐｌは、 第２のバイト製表し、以下Ｐ１３まで同様である。あるいは定義された任意の最 大パラメータまで同様である６値フイールドは、指定された位置のＧＣＨの内容 を比較するのに用いられるパラメータである。このフィールドには、すべての数 値、いくつかのパラメータ、およびすべてのコマンドが許される。値フィールド にＥＬＳＥを用いることによって、もし、他に整合する値がない場合には、位置 フィールドに指定されたパラメータをカウントするように示すことも可能である 。 整合している場合、あるいはＥＬＳＥが選択された場合。 これに対応する位置は、現在のプロセッサ内のプログラムが移動すべきジャンプ 先位置である。位置フィールドは、対応する値？が真である場合に移動すべき現 在のプロセッサ内のジャンプ先位置である。各Ｑコマンドのそれぞれに対して５ つの″値？＝位置？”の組み合わせがあり得る。１つのＱコマンドに対する選択 が十分でない場合には、ＥＬＳＥをＮＥＸＴと同じになるように設定し、さらに 他のＱコマンドを用いてＧＣＢの同じ位置をテストするようにすることも可能で ある。 ■、アナログ基尋 電気通信システム１０に関連する各アナログ基板４４（図３）は、複数の音声チ ャネルを処理するための回路によって構成されている。例えば、アナログ基板は 、基板に結合された各電話ラインに対して、オン／オフフック検出、フックフラ ッシュ検出、リングリレイ作動および停止、リングトリップ検出、番号捕集、グ ラウンド・キー検出、ラインパワーアップおよびパワー・ダウン、およびＰＣＭ タイムスロット選択の中の任意のライン処理を実行することができる。 図１０を参照する。アナログ基板４４は、オンボード・プロセッサ１４８を有し ており、これに好適なものとしてはインテル８０Ｃ５２マイクロコントローラが ある。 マイクロコントローラ１４８は、基本的なマイクロコントローラ機能の制御を行 うためのマイクロコントローラ・ファームウェアがマスクされている８にバイト のリード・オンリー・メモリ（ＲＯＭ）１４９と、２５６バイトのデータメモリ からなるランダム・アクセス・メモリ（ＲＡＭ）１５０を有している。マイクロ コントローラ１４８は、８つのアナログライン・インターフェース１５２−１５ ９、ＨＤＬＣプロトコーラ１６０．および２つのプログラマブル論理デバイス（ ＰＬＤ）１６２および１６４を含むいくつかの周辺装置に結合されている。アナ ログ基板の基本的な機能はＰＣＭチャネル選択、スロット・アドレスの読み出し 、初期化、ＨＤＬＣ通信、保守。 およびエラー検出である。これらの基板機能、および上記のライン機能は、マイ クロコントローラ１４８のＲＡＭ１５０に記憶されるアナログ基板ファームウェ アによって実現される。アナログ基板ファームウェアは、モジュール形式で書か れる。すなわち、プログラムは単一プログラムとして提供されるのではなく、多 くのより小さなセグメントに分割されている８プログラムモジュールは、具体的 な機能タスクとハードウェアの要求とに基づいて定義される。このプログラム手 法には、いくつかの利点がある。まず、モジュールはより簡単であり、従って、 容易に書くことができ、また、テスト、デバッグが容易にできる。プログラムの 開発は、よく定義された、独立したモジュールに分割して行われ、このようにす ることによって、コーディングの仕事を分散して行うことが可能となる。また、 あるプログラムモジュールは、電気通信システム１０の他の基板に用いることも 可能であり、これによって、開発速度が加速され、またすでにデバッグずみの共 通のモジュールを用いることができるので信頼性も向上する。また、このプログ ラミングの手法を用いると、拡張ビット操作、直接ボートアクセス、およびリア ルタイムに応答する割り込み駆動プログラムなどのインテル８０Ｃ５１マイクロ コントローラの機能をうまく活用することができる。 アナログ基板４４のファームウェアプログラムは、好適には、初期化ルーチン、 デバイスドライバ、フォアグランド主プログラム、および分割駆動バックグラン ドルーチンの４つの主要部分に分割される。実際の処理のほとんどは、いろいろ なバックグランドルーチンによってなされ、これによって決定論的なリアルタイ ム処理が可能となる。 初期化ルーチンはハードウェアリセット（釘なわち、アナログ基板のパワーアッ プあるいはウォッチドッグタイマリセット）や、ファームウェアプログラム内か ら呼び出されたソフトウェアリセットにおいてマイクロコントローラ１４８がリ セットされた後に実行される。この初期化ルーチンは、マイクロコントローラの 動作のセットアツプを行うためのいくつかのルーチンからなっている。マイクロ コントローラ１４８のセットアツプルーチンには、他の初期化ルーチン、後にさ らに説明する割り込み構造セットアツプ、およびシステムメモリ９２（図８）の 内部レジスタへのスタートアップ値のロードの呼び出しが含まれる。また、初期 化ルーチンは、マイクロコントローラ１４８のデータレジスタの値の初期化、ア ナログ基板がシステム通信を行う際の物理アドレスの読み出Ｉハマイクロコント ローラによって制御される周辺装置の初期化、ＣＰＵ基板からの質問に対する開 始準備終了（ＲＴＳ）応答のロード、ＣＰＵ基板からのシステム・コマンドの待 機、を行うためのルーチンをさらに含む、先に議論したように、アナログ基板は ＣＰＵ基板と同じ汎用電気通信ユニットＧＴＵ内のＣＰＵ基板４４からのコマン ドの受信、および１例えば同じキャビネットあるいは異なるキャビネットの別の 異なるＧＴＵ内のＣＰ　Ｕ基板からのコマンドの受信を行えるように構成するこ とが可能である。 図１１を参照する。初期化はブロック１６８に示すように、マイクロコントロー ラのリセットによって開始される。マイクロコントローラのリセットの後、マイ クロコントローラ１４８は、マイクロコントローラが制御を行っている基板の種 類をあらかじめ定められたレジスタから読み出すことによって判定し、ブロック １７０に示すように、それがマウントされている基板のアドレスを読み出すよう にプログラムされている。基板アドレスの読み出しは、単一の工／○ピンから論 理デバイスを介してバックプレーンに配備されている５つの信号ラインＢＳＡＯ からＢ　ＳＡ４に多重伝送することによって行われる。 ブロック１７２に示すように、マイクロコントローラ１４８は、各種のマイクロ コントローラ・データレジスタ、アナログラインインターフェース１５２から１ ５９゜ＨＤＬＣプロトコーラ１６０．およびプログラマブル論理デバイス（ＰＬ Ｄ）１６２および１６４を含む周辺装置に関連する構成要素の初期化を行う、各 アナログラインインターフェースは、音声ニーダ／デコーダ（ＣＯＤＥＣ）、加 入者ラインインターフェース回路（Ｓ　Ｌ　Ｉ　Ｃ）、およびライン呼び出し信 号発信、プロテクション、バッテリ供給のための受動デバイスを含んでいる。マ イクロコントローラ１４８は、ソフトウェアによって実現されるリンクを介して ＧＯＤＥＣに対し直接にアクセスする。マイクロコントローラ１４８の５ＬＩＣ へのアクセスはＣ０ＤＥＣ上の拡張Ｉ１０ボートを介して行われる。 また、マイクロコントローラ１４８は、Ｃ０ＤＥＣのＰＣＭタイムスロット、送 受信ボリューム、コンバンディング方法、およびハイブリッド・バランス・レジ スタの初期化を行う、また、５ＬＩＣに関するライン状態の制御が行われ、フッ クスイッチ状態のモニタが行われる。 ５ＬＩＣはスタンバイ動作とループ検出のために初期化される。また、ＨＤＬＣ プロトコーラ１６０が１９２にビット／秒で動作をするために初期化される。さ らに、ＨＤＬＣプロトコーラの内部タイミング、および受信アドレス認識機能が イネーブルとされる。この受信アドレスはマイクロコント９−ラが決定したスロ ット・アドレスである。２つのプログラマブル論理デバイス１６２および１６４ は信号のバッファリング、多重化、ＰＣＭハイウェイのアクセスのために用いら れる。マイクロコントローラ１４８は、ＰＬＤのうちの１つ１６２を用いて。 バックプレーンの上記スロット・アドレスを読み出す。 また、もう一方のＰＬＤ１６４を用いて適当なＰＣＭ音声ハイウェイが選択され 、また使用されていないすべてのタイムスロットがトライステート状態とされる 。マイクロコントローラ１４８は、ＰＬＤ１６４上の３つのＩ１０ピンを介して 適当なハイウェイを選択し、これをイネーブル状態とする。 周辺装置の初期化に続いて、マイクロコントローラ１４８は、図１６のブロック １７４に示すように、開始準備終了（ＲＴＳ）コマンドをディジタルメモリ（す なわち、内部送信スタック）にロードして、送信可能な体制を整える。さらに、 ブロック１７６および１７８にそれぞれ示すように、マイクロコントローラ１４ ８に接続されているウォッチドッグタイマがリセットされ、ＨＤＬＣプロトコー ラ１６０がイネーブル状態とされる。受信のためのイネーブル化が行われた後、 ＨＤＬＣプロトコーラは、マスタ／スレーブ通信環境におけるＣＰＵ基板５６の スレーブとして動作する。以下にさらに詳細に説明するように、妥当なパケット を受信すると、ＨＤＬＣプロトコーラ１６０は割り込みを生じさせ、マイクロコ ントローラ１４８はこれに対するサービスを行う。 判定ブロック１８０を参照する。ＨＤＬＣ割り込み要求信号をＨＤＬＣプロトコ ーラ１６０から受け取るまでは、マイクロコントローラ１４８は１判定ブロック の否定分岐に示すように、他の処理を行わない、ＨＤＬＣ割り込み要求を生じさ せることができる妥当な割り込み条件は、ＨＤＬＣプロトコーラ１６０が正しい スロット・アドレスのパケットを全て受信されたときに発生する送信パケット受 信端の存在と、システムＣＰＵ基板５６へのパケットの送信が終了したときに発 生するパケット送信端の存在とである。これら２つのうちのいずれかの条件が成 立していない場合には１割り込みエラー状態となり、ＨＤＬＣプロトコーラ１６ ０は再初期化が行われる。 ＨＤＬＣ割り込み要求信号を受信すると、マイクロコントローラ１４８は１図１ ２のブロック１８２に示すように内部送信スタックに記憶されているＲＴＳコマ ンドをＣＰＵ基板マイクロコンピュータ８０に対して送信する。続いて、マイク ロコントローラ１４８は、ブロック１８４に示すように、ＣＰＵ基板マイクロコ ンピュータ８０のＲＯＭに記憶されている初期化データを受信して。 このデータを適当なデータレジスタにロードする。この初期化には１例えば、パ ルスダイアリングのメーク時間およびブレーク時間、最小ハングアップ時間、許 可されたラインのアドレス、およびアナログ基板データ転送に用いようとしてい るＰＣＭハイウェイ５７のタイムスロットの指定を含めることが可能である。マ イクロコントローラ１４８は、判定ブロック１８６の否定分岐に示すように１通 常処理開始（ＢＮＯ）コマンドをＣＰＵ基板マイクロコンピュータ８０から受信 するまでは他の処理を行わない。ＢＮＯコマンドをＣＰＵ基板マイクロコンピュ ータから受信すると、ブロック１８６の肯定分岐およびブロック１８８に示すよ うに、アナログ基板のためのマスター制御プログラムが実行される。 マスター制御プログラムは、一般に、上記の初期化ルーチンとデバイス・ドライ バ・プログラムモジュールの呼び出しを行うフォアグランドプログラムと、必要 時ベースで用いられる割り込み酩動バックグランドルーチンとで構成される。フ ォアグランド、バックグランド、およびデバイスドライバ・ソフトウェア・モジ ュールについて、図１２を参照しながら説明する。 アナログ基板４４のフォアグランドプログラムは、リセットおよび各種初期化ル ーチンの呼出しに応じてマイクロコントローラ１４８を制御するためのマスター 制御プログラムである。図１１に関連してすでに述べたように、マイクロコント ローラ１４８は、アナログ基板の存在と状態との指示用にシステムＣＰＵ基板５ ６に対して開始準備終了（ＲＴＳ）信号を送信し、また、システムＣＰＵ基板か らの如何なる初期化命令をも受け入れる。 通常動作開始コマンドをＣＰＵ基板５６から受信すると、フォアグランドプログ ラムはループに入って、割り込みが起こるまで待機する（図１１のブロック１８ ０）、ＨＤＬＣプロトコーラ１６０による割り込みが開始されると、マイクロコ ントローラ１４８は、図１２のブロック１９２に示すように指定された割り込み 入力を禁止し。 ブロック１９４に示すように、ＨＤＬＣプロトコーラによって生起されたマイク ロコントローラプログラムの割り込みを調べて何らかのパケット動作がＨＤＬＣ プロトコーラ受信スタックあるいはＦＩＦＯに発生しているかどうか判定する。 もし、これらのフラッグのいずれかが有効である場合には、ブロック１９６に示 すように、マイクロコントローラ１４８は、適当なサービスルーチンに分岐して 、デバイスドライバおよびバックグランドルーチンを呼び出し、受信したパケッ トのコマンドバイト３０４（図１８）が指定しているコマンドのサービスを行う 、もし、内部受信スタックに何もパケットが存在しない場合には、または、サー ビスルーチンが終了した場合には、ブロック１９８に示すように、マイクロコン トローラ１４８は、他の基板からのＨＤＬＣ割り込み要求をさらに受信できるよ うに割り込み許可状態とする。 ＨＤＬＣ割り込みが終了すると、マイクロコントローラ１４８は、ブロック２０ ０に示すように割り込み入力を禁止し、また、ブロック２０２に示すように何ら かのパケットが受信ＦＩＦＯに存在しないがどうかの判定を行うことによって、 ＨＤＬＣ受信スタックに受信された何らかのパケット動作が存在しないがどうが を探す作業を主プログラムルーチンの制御のもとに続行する。ブロック２０４に 示すように、もし、パケットがＨＤＬＣプロトコーラ１６０の受信ＦＩＦＯに存 在している場合には、マイクロコントローラ１４８は、受信コマンド・サービス ・ルーチンを呼び出し、受信スタックのボトムをアンロードして、コマンドバイ トを読み取り、適当なルーチンへ分岐してそのコマンドのサービスを行う、この コマンドのサービスがうまく終了した場合には、受信スタックポインタの調整が 行われ、適当なフラッグがセットあるいはりセットされる。もし、コマンドのサ ービスを行うことができない場合（すなわち、送信が要求されていて、送信スタ ックが現在満杯となっている場合）には、受信パケットは、そのまま放置され、 次の割り込みの後にサービスが行われる。受信コマンドルーチンが終了すると、 主プログラムルーチンは、ブロック２０６に示すように休止モードに戻って、マ イクロコントローラ１４８は１次のＨＤＬＣ割り込みが起こるのを待機する（図 １１のブロック１８０）。 マスター制御プログラムのデバイスドライバは転用が可能なコード・ブロックで あり、これを用いることによってアナログ基板４４上の周辺装置、すなわちアナ ログラインインターフェース１５２から１５９のＨＤＬＣプロトコーラ１６０お よびＣ０ＤＥＣ（図示せず）との通信が可能となる。これらのドライバは、コー ドの他の部分において繰り返し呼び出され、こうして、コード領域が最小化され 、また最大の信頼性が得られる。 Ｃ０ＤＥＣレジスタ読み出しおよび書き込みドライバはソフトウェアで形成され た標準的なマイクロコントローラＩ１０ポートを介したシリアル・リンクである 。これらのルーチンを用いることによって、マイクロコントローラのＩ１０ライ ンを切り換えてデータ、信号、クロック信号およびチップ選択信号から構成され る３ワイヤ同期シリアルリンクを形成することにより、ＧＯＤＥＣレジスタのア ドレスおよびラインを選択して、データをこのレジスタから読み出すこと、ある いはレジスタへ書き込むことが可能となる。すべての基板が許可状態にある場合 には、Ｃ０ＤＥＣ読み出しドライバは、主プログラムのアナログラインスキャン ルーチンから１秒間に１６００回呼び出される。Ｃ０ＤＥＣ読み出しドライバは マイクロコントローラを動作させて、各ラインの状態を１秒間に２００回読み出 して、この状態をスキャンルーチンに報告する。Ｃ０ＤＥＣ書き込みルーチンは プログラムが５ＬＣＩあるいはＧＯＤＥＣを制御する必要があるときに（すなわ ち、呼び出し信号の発生、ボリューム制御、などの際に）呼び出される。 ＨＤＬＣプロトコーラ・デバイス・ドライバを用いることによって、マイクロコ ントローラ１４８は、ソフトウェアでメモリアクセスをシミュレートし、マイク ロコントローラＩ１０を介してＨＤＬＣプロトコーラ・マイクロプロセッサ・メ モリ・ボートにアクセスすることが可能となる。これらの読み出しおよび書き込 みルーチンがＨＤＬＣ割り込み駆動バックグランドルーチンによって呼び出され 、、ＨＤＬＣ割り込みとＦＩＦＯ状態と受信ＦＩＦＯとの読み出し、および送信 ＦＩＦＯのロードが行われる。 割り込み駆動バックグラウンド・ルーチンは、プログラムのコード・スペースと 実行時間のほとんどを占める。 これらのルーチンは、２つのソースからの割り込みに応答して、これのサービス を行い、次に、プログラム状態をファオグランド・プログラムに伝えてからプロ グラム制御をリターンさせる。この方法を用いることによって。 リアルタイム制御を維持することができ、ファオグランド・プログラムは必要な ときだけサービスを連続的なポーリングによるオーバーヘッドなしで実行する。 ２つの主な割り込みソースは、５ミリ秒割り込みハードウェアタイマと、ＨＤＬ Ｃプロトコーラ１６０がらの外部割り込み要求である。 ５ミリ秒タイマーは、タイマー・リセット・ルーチンによってサービスされ、オ ーバフローが発生していないかどうかを調べて、タイマー再ロードのときに補正 を行う０次に、このルーチンは、先に述べたアナログ入力ライン・スキャニング ・ルーチンへのコールを開始、現在の各ラインの状態を読み取り、そのラインの 現在の動作に応じてそのラインに対するサービスを行う。このサービスには、呼 び出し信号発生、リング・トリップ、ラインの活性化、待機動作、ラインの使用 禁止、パルスダイヤリング進展、フンクツラッシュ進展、番号間タイミング進展 １番号カウント、オンフックとオフフック遷移がある。 現在のラインの状態は、マイクロコントローラ１４８のそのラインのＣ０ＤＥＣ からの読み取り時に判定される。また、現在どのような動作がなされているかは 動作コードを調べることによって行われる。マイクロコントローラ１４８は、コ ードの適当な部分に分岐し、ライン状態に何らかの変化が発生していないかをチ ェックする。 次いで、最終的なスキャニング分岐がマイクロコントローラ１４８によって実行 され、もし必要であればそのラインに対して適当なアクションが取られる。典型 的なアクションは、リング・トリップ、オンフック、オフフック、ダイヤルされ た番号、フックフラッシュなどをシステムＣＰＵに報告するための内部送信スタ ックへのコマンドのロード、および必要に応じて行う呼び出し信号発生の遅延を 含む、５ミリ秒毎に各ラインがスキャンされ、これによって、パルス・ダイヤル 、リング・トリップ、その他の一定時間に発生する動作が十分な分解能でチェッ クされる。１６種類の呼び出し信号パターン、パルス・ダイヤルのための可変な メーク／ブレーク比率、可変な番号間タイマー間隔、および可変フックフラッシ ュ時間がプログラムによってサポートされる。これらのすべての変数は個々のユ ーザの必要に応じＣＰＵ基板５６上のマイクロコントローラ８０によってセット およびリセットすることが可能である。 ＨＤＬＣ割り込み要求は、マイクロコントローラ１４８の外部割り込みを介して 実行される。ＨＤＬＣサービス・プログラムは、ＨＤＬＣプロトコーラ１６０割 り込み状態レジスターを読み、適当な分岐を行う。有効な割り込み条件は、受信 パケットの終了すなわち正しいスロット・アドレスをもつパケットの全てがＨＤ ＬＣプロトコーラ１６０によって受け取られたとき、および、パケット送信終了 すなわちＣＰＵボード５６へのパケット伝送が終了したときである。これらの２ つの条件のいずれかが成立しない場合には１割り込みエラー状態となり。 ＨＤＬＣプロトコーラ１６０は再初期化される。 送信パケットが終わりに至ると、ルーチンは、分岐してＨＤＬＣ送信機をオフに する。送信チャネルは全てのＸＬ／−フ・ボードの間で共通使用されるので、こ れは可能な限り早く行う必要がある。送信機を使用禁止状態にした後、ルーチン はリターンして受信パケットが終わりに至っていないかどうかをチェックする。 もし、これが妥当な状態であれば、そのパケットのサービスがマイクロコントロ ーラ１４８によって行われる。 受信パケットの終了に対して、ＨＤＬＣサービス・ルーチンは、ＨＤＬＣプロト コーラ・マイクロプロセッサを作動させて、ＨＤＬＣプロトコーラ１６０の受信 ＦＩＦＯのアンロードを開始する。ＨＤＬＣプロトコーラ・マイクロプロセッサ は、アンロードされた各バイトの状態の検証を行う、有効な各パケットは、正し いスロット・アドレスであるかどうかがチェックされる。それがＡＬＬＣＡＬＬ 　（全呼び出し）アドレスである場合には、すなわち、すべての周辺のボードに 対して向けられたメツセージである場合には、サービス・ルーチンは、マイクロ プロセッサを制御してそのメツセージをサービスするコードの特別の部分へ分岐 する。ただし、応答は行わない、第２のバイトには、ライン番号およびコマンド 参照が含まれており、内部受信スタックに記憶される。第３のバイトは、２つの 特別な状態をチェックするためのコマンドであり、スレーブ動作問い合わせ（Ｓ ＡＩ）コマンドと否定応答（ＮＡＫ）コマンドである。ＳＡＩコマンドを用いる ことによって、アナログ基板は送信チャネルにアクセスすることができ、また、 ＮＡＫコマンドは最後に送信されたパケットの再送信を要求するのに用いられる 。これらのいずれかが受信されたとき、もし、何もメツセージが受信スタックに 存在していなければ、プログラムは送信ルーチンに分岐する。ＮＡＫコマンドに 対しては、システムＣＰＵボード５６に最後に送られたコマンドが再送信される 。ＳＡＩコマンドに対しては、次の利用可能な送信コマンドがある場合には、こ れが送信される。 メツセージが特別なものでなければ、メツセージのすべてがマイクロコントロー ラ１４８によってアンロードされて受信スタックに記憶され、フォアグランド・ プログラムによって翻訳が行われる。受信スタックは、３つのＨＤＬＣメツセー ジを保持することができるだけの容量を持っている。新しいメツセージを受信し たときに。 もし、受信スタックが満杯である場合には、マイクロコントローラはＮＡＫコマ ンドを発生して、受信したパケットを破棄する。パケットの記憶が終了すると、 プログラムは送信ルーチンに入る ＨＤＬＣ送信ルーチンは、マイクロコントローラを制御して内部送信コマンド・ スタックをチェックし、ＨＤＬＣプロトコーラ１６０の送信ＦＩＦＯにロードす るコマンドを形成する。マイクロコントローラ１４８のデータ空間は貴重な存在 なので、これらのコマンドは、最終的なフォーマットの形ではスタックされず、 むしろ、送信スタックには、１バイトまたは２バイト・コードを含むようにし、 これを送信ルーチンによって翻訳して過当なコマンドに形成する。例えば、Ｃ０ ＤＥＣレジスタ読み出し動作に対しては、送信コードがスタックから取り出され て翻訳されるが、このとき、特定のＣ０ＤＥＣレジスターの読み出しが行われる ０次いで、スロット・アドレス、ライン・アドレス、コマンド値、レジスター・ アドレスおよびレジスターの値が割り込みサービスの間にＨＤＬＣ送信ルーチン によって形成されてＨＤＬＣプロトコーラにロードされる６次に、ＨＤＬＣ送信 機が使用許可状態にされる。こうして、ＨＤＬＣサービス・ルーチンが終了し、 プログラム制御はフォアグランド・プログラムにリターンする。 さらに２つの割り込みサービス・ルーチンを用いることによって、ゼロ交差スイ ッチングがアナログ・ボード上の呼び出し信号リレーに対して提供される。この 方法を用いることによって、呼び出し信号のオン・オフおよびリングトリップの スイッチ制御を別々に行うことが可能となり、リレーの寿命を著しく伸ばすこと ができる。 また、呼び出し信号のスイッチングによって発生するＥＭｌが低減される。ゼロ 交差同期信号はマイクロコントローラ１４８の外部の割り込みポートに接続され ている呼び出し信号発生器モジュール（図示せず）によって２５ミリ秒毎に発生 される。この割り込みは、マスクされない、高いプライオリティ−を有するよう に設定される。 同期信号を受信するごとに、外部割り込みサービス・ルーチンに入り、２５ミリ 秒が経過したかどうかの判定が行われる０次に、ソフトウェアによって設定可能 な値が。 外部の割り込みボートに関連するタイム・レジスターにロードされ、２５ミリ秒 以内にタイマー割り込みが起こるようにし、もしその必要があれば呼び出し信号 スイッチングを実行するように設定される。タイマー割り込みに入ると、呼び出 し信号スイッチングが要求されているかどうかの判定がなされる。呼び出し信号 スイッチングが要求されている場合には、指示されたラインに対して適当なアク ションがとられる（すなわち呼び出し信号のオン・オフ、あるいはリングトリッ プ）、リングトリップの場合には、ライン状態レジスターの更新が行われ、ＲＴ Ｄ　（リングトリップ受信）コマンドがＣＰＵボード５６に送られる。この方式 を用いると、呼び出し信号のオン・オフ、あるいはリングトリップ条件を別々に タイマー再ロード可能であり、リレーのメークおよびブレーク時間、および信号 特性を変えることによってスイッチ動作制御を最適化することが可能である。 ■、　線ボード 電気通信システム１０の各中継幹線ボード４６は、複数の中継幹線ラインに対す る処理を行うための回路を有している。例えば、中継幹線ボードは、このボード によってインターフェースされる各中継幹線に対して以下に示す任意のライン機 能を実行することが可能である。すなわち、ライン状態制御、ライン占有制御、 呼び出し信号検出、番号のダイヤル、Ｃ０ＤＥＣ制御、中継幹線うイン制御、ラ イン・パワーのアップ／ダウン、およびＰＣＭタイムスロット選択である。８図 １３を参照する。 中継幹線ボードは、オンボードプロセッサを有し、好適にはインテル８０Ｇ５１ マイクロコントローラ２１０が用いられる。マイクロコントローラ２１０は、基 本的なマイクロコントローラ機能を制御するためのマイクロコントローラ・ファ ームウェアがマスクされている４キロバイト・リードオンリー・メモリ（ＲＯＭ ）　２１１　、および１２８バイトランダム・アクセス・メモリ（ＲＡＭ）２１ ２を備えている。マイクロコントローラ２１０は、４つの中継幹線インターフェ ース２１４から２１７、ＨＤＬＣプロトコーラ２１８、および２つのプログラマ ブル論理デバイス（ＰＬＤｓ）２２０および２２２を含むいくつかの周辺の装置 に接続されている。中継幹線ボード４６の基本的機能は、ＰＣおよびチャネルの 選択、スロット・アドレスの読み取り、初期化、ＨＤＬＣ通信。 メンテナンスおよびエラー検出である。これらのボード機能および先に述べたラ イン機能は、マイクロコントローラ２１０のＲＡＭ２１２の中に記憶された中継 幹線ボード・ファームウェアによって実現される。中継幹線ボードファームウェ アは、アナログ・ボード・ファームウェアと関連して説明した理由により、モジ ュール方式によって書かわる。 中継幹線ボード・ファームウェア・プログラムは、好適には、初期化ルーチン、 デバイス・ドライバー、フォアグランド主プログラム、割り込み駆動バックグラ ウンド・ルーチンの４つの主要部分に分割される。実際の処理の大多数は１種々 のバックグラウンド・ルーチンによって行われ、これによって、決定論的なリア ルタイム動作が提供される。 中継幹線ボード４６に対する初期化ルーチンは、アナログ・ボード４４のものと 類似のものであるので、図１１に示したフロチャートを参照しながら中継幹線ボ ード初期化ルーチンについて説明する。アナログ・ボードの場合と同様に、中継 幹線ボードの初期化ルーチンは、ブロック１６８に示すように、ハードウェア・ リセット（すなわち、中継幹線ボード・パワーアップ、またはウォッチドッグ・ タイマー・リセット）中か、あるいは。 ファームウェア・プログラム内から呼び出されたソフトウェアのリセット中のマ イクロコントローラ２１０のリセット終了後に実行される。マイクロコントロー ラのリセットに続いて、マイクロコントローラ２１０は、ブロック１７０に示す ように、制御対象ボードの種類を判定し、またマイクロコントローラ２１０がマ ウントされているボードのアドレスを読み取るようにプログラムされている。 図１１のブロック１７２に示すように、マイクロコントローラ２１０は、周辺装 置に関連する構成要素、すなわち、種々のマイクロコントローラ・データ・レジ スター、中継幹線インターフェース２１４〜２１７．ＨＤＬＣプロトコーラ２１ ８．およびＰＬＤ２２０および２２２の初期化を行う、各中継幹線インターフェ ースは、音声Ｃ０ＤＥＣ５中継幹線インターフエース・ハイブリッド回路、アド レス可能なラッチ、およびライン占有（すなわち、グラウンド開始、またはルー プ開始）に必要な受動デバイスから成る。マイクロコントローラ２１０は。 ソフトウェアで実現されるシリアル・リンクを介して直ド出力信号は、Ｃ０ＤＥ Ｃ上の拡張Ｉ１０ポートを介してマイクロコントローラ２１０に供給される。ま た、マイクロコントローラ２１０のアドレス可能なラッチへのアクセスは、１つ のデータ・ラインと３つのアドレス・ラインを介して行われる。中継幹線ハイブ リッド回路入力信号は、ラッチＩ１０を介して制御される。マイクロコントロー ラ２１０は、Ｃ０ＤＥＣＰＣＭタイムスロット、受信および送信ボリューム、コ ンバンディング方法、ハイブリッド・バランス・レジスターの初期化を行う、中 継幹線ハイブリッド回路のループ占有リレー、グラウンド開始リレー、状態ＬＥ Ｄ、およびリング・グラウンド制御が初期化される。ＨＤＬＣプロトコーラ２１ ８が、１９２キロビット／秒で作動するように初期化され、また、内部タイミン グおよび受信アドレス認識機能がイネーブル状態とされる。この受信アドレスは マイクロコントローラが決定したスロット・アドレスである。 ２つのＰＬＤ２２０および２２２は、信号のバッファ。 マルチプレックス、ＰＣＭハイウェーへのアクセスのために用いられる。マイク ロコントローラ２１０は、複数のＰＬＤの中の１つ２２０を用いてバックプレー ン・ラインＢ　５ＡＯ−ＢＳＡ４の上記のスロット・アドレスを読み取る。また 、他のＰＬＤ２２２を用いて適当なＰＣＭ音声ハイウェイが選択され、また使用 されていないすべてのタイムスロットがトライステート状態にされる。 マイクロコントローラ２１０は、ＰＬＤ２２２上の３つのＩ１０ピンを介して適 当なハイウェイを選択し、これをイネーブル状態とする。 周辺装置の初期化に続いて、マイクロコントローラ２１０は、図１１のブロック １７４に示すように、開始準備終了（ＲＴＳ）コマンドをディジタルメモリ（す なわち、内部送信スタック）にロードして、送信可能な体制を整える６さらに、 ボックス１７６および１７８にそれぞれ示すように、マイクロコントローラ２１ ０に接続されているウォッチドッグタイマがリセットされ、ＨＤＬＣプロトコー ラ２１８がイネーブル状態とされる。受信のためのイネーブル化が行われた後、 ＨＤＬＣプロトコーラ２１８は、マスタ／スレーブ通信環境におけるＣＰＵ基板 ５６のマイクロコンピュータ８０のスレーブとして動作する６以下にさらに詳細 に説明するように、妥当なパケットを受信すると、ＨＤＬＣプロトコーラ２１８ は割り込みを生起させ、マイクロコントローラ１４８はこれに対するサービスを 行う。 判定ブロック１８０を参照する。ＨＤＬＣ割り込み要求信号をＨＤＬＣプロトコ ーラ２１８から受け取るまでは、マイクロコントローラ２１０は１判定ブロック の否定分岐に示すように、他の処理を行わない、ＨＤＬＣ割り込み要求を生起さ せることができる妥当な割り込み条件は、アナログ基板に対するものと同様であ る。すなわち、ＨＤＬＣプロトコーラ２１８が受信した送信パケットが終りに至 った場合と、システムＣＰＵ基板５６へのパケットの送信が終了して送信パケッ トが終わりに至った場合である。これら２つのうちのいずれかの条件が成立して いない場合には、割り込みエラー状態となり、　Ｉ（ＤＬＣプロトコーラ２１８ の再初期化が行われる。 ＨＤＬＣ割り込み要求信号を受信すると、マイクロコントローラ２１０は、ブロ ック１８２に示すように、内部送信スタックに記憶されているＲＴＳコマンドを ＣＰＵ基板マイクロコンピュータ８０に対して送信する。続いで、マイクロコン トローラ２１０は、ブロック１８４に示すように、ＣＰＵ基板マイクロコンピュ ータ８０のＲＯＭに記憶されている初期化データを受信して、このデータを適当 なデータレジスタにロードする。この初期化データには、例えば、許可されたラ インのアドレス。 および中継基板データ転送に用いようとしているＰＣＭハイウェイ５７のタイム スロットの指定を含めることが可能である。マイクロコントローラ２１０は、判 定ブロック１８６の否定分岐に示すように、通常処理開始（ＢＮｏ）コマンドを ＣＰ　ｔＪ基板マイクロコンピュータ８゜から受信するまでは他の処理を行わな い。ＢＮ○コマンドをＣＰＵ基板マイクロコンピュータ８ｏがら受信した後、ブ ロック１８６の肯定分岐およびブロック１８８に示すように、中継基板４６のた めのマスター制御プログラムの実行が行われる。 マスター制御プログラムは、一般に、上記の初期化ルーチンとデバイス・ドライ バ・プログラムモジュールの呼び出しを行うフォアグランドプログラムと、必要 時ベースで用いられる割り込み駆動バックグランドルーチンとで構成される。フ ァオグラン阻バックグランド、およびデバイスドライバ・ソフトウェア・モジュ ールは。 アナログ基板における場合と同様なやり方で呼び出されるけれども１図１２を参 照してこれらについて以下に説明する。 中継基板４６のフォアグランドプログラムは、マイクロコントローラ１４８を制 御してリセットおよび各種初期化ルーチンの呼び出しを行うためのマスター制御 プログラムである。図１１に関連してすでに述べたように、マイクロコントロー ラ２１０は、システムＣＰＵ基板５６に対してＲＴＳ信号を送信して中継基板の 存在と状態とを知らせ、また、マイクロコントローラ８ｏがら、何らかの初期化 命令があった場合にはこれを受け入れる。 通常動作開始コマンドをＣＰＵ基板５６から受信すると。 フォアグランドプログラムはループに入り、割り込みが起こるまで待機する（図 １１のブロック１８０）。ＨＤＬＣプロトコーラ２１８による割り込みが開始さ れると、マイクロコントローラ２１０は、図１２のブロック１９２に示すように 指定された割り込み入力を禁止し、ブロック１９４に示すように、何らかのパケ ット動作がＨＤＬＣプロトコーラ受信スタックあるいはＦＩＦＯに発生している かどうかを、そこに記憶されている動作フラッグを調べることによって判定する 。もし、これらのフラッグのいずれかが有効である場合には、ブロック１９６に 示すように、マイクロコントローラ２１０は、適当なサービスルーチンに分岐し て、デバイスドライバおよびバックグランドルーチンを呼び出し、受信したパケ ットのコマンドバイトが指定しているコマンドのサービスを行う。内部受信スタ ックに何もパケットが存在しない場合、または、サービスルーチンが終了した場 合には、ブロック１９８に示すように、マイクロコントローラ２１０は、他の基 板からのＨＤＬＣ割り込み要求をさらに受信できるように割り込みを許可状態と する。 ＨＤ　Ｌ　Ｃ割り込みが終了すると、マイクロコントローラ２１０は、ブロック ２００に示すように割り込み入力を禁止し、また、ブロック２０２に示すように 何らかのパケットが受信ＦＩＦ○に存在しないかどうかの判定を行うことによっ て、ＨＤ　Ｌ　Ｃ受信スタックに受信された何らかのパケット動作が存在しない かどうかを探す作業を主プログラムルーチンの制御のもとに続行する。ブロック ２０４に示すように、もし、パケットがＨＤ　Ｌ　Ｃプロトコーラ２１８の受信 ＦＩＦＯに存在している場合には、マイクロコントローラ２１０は、受信コマン ド・サービス・ルーチンを再度呼び出し、受信スタックのボトムをアンロードし て、コマンドバイトを読み取り、適当なルーチンへ分岐してそのコマンドのサー ビスを行う。 このコマンドのサービスがうまく終了した場合には、受信スタックポインタの調 整が行われ、適当なフラッグがセットあるいはリセットされる。もし、コマンド のサービスを行うことができない場合（すなわち、送信が要求されていて、送信 スタックが現在満杯となっている場合）には、受信パケットは、そのまま放置さ れ２次の割り込みの後にサービスが行われる６受信コマンドルーチンが　、終了 すると、主プログラムは、ブロック２０６に示すように休止モードに戻り、マイ クロコントローラ２１０は、次のＨＤＬＣ割り込みが起こるのを待機する（図１ −１のブロック１８０）。 アナログ基板４４におけるのと同様に、中継基板４６の場合でも、マスター制御 プログラムは転用が可能なコード・ブロックからなるデバイスドライバで構成さ れ。 これにより、中継基板の周辺装置、すなわちＨＤＬＣプロトコーラ、およびアド レス可能なラッチとＣ０ＤＥＣ）との通信が可能となる。これらのドライバは、 コードの他の部分において繰り返し呼び出され、こうして、コード領域が最小化 され、また最大の信頼性が得られる。 Ｃ０ＤＥＣレジスタ読み出しおよび書き込みドライバはソフトウェアによって形 成された標準的なマイクロコントローラＩ１０ボートを介したシリアル・リンク である。これらのルーチンを用いることによって、マイクロコントローラのＩ１ ０ラインを切り換えてデータ、信号。 クロック信号およびチップ選択信号から構成される３ワイヤ同期シリアルリンク を形成することにより、ＧＯＤＥＣレジスタのアドレスおよびラインを選択して 、データをこのレジスタから読み出すこと、およびこのレジスタヘデータを書き 込むことが可能となる。すべての基板が許可状態にある場合には、Ｃ０ＤＥＣ読 み出しドライバは、主プログラムの中継基板スキャニングルーチンから１秒間に ８００回呼び出される。Ｃ０ＤＥＣ読み出しドライバはマイクロコントローラを 制御して、各ラインの状態を１秒間に２００回読み出して、この状態をスキャニ ングルーチンに報告する。Ｃ０ＤＥＣ書き込みルーチンはプログラムがＣ０ＤＥ Ｃを制御する必要があるときに（すなわち、ボリューム制御、タイムスロット選 択などの際に）呼び出される。 ラッチ読み取りおよび書き込みドライバーは、ｍ−のデータ・ラインを介して増 加的にアドレス指定すること１３よってランチの出力レジスタにアクセスし、出 力を中継ハイブリッド制御入力に転送する。 ＨＤ　Ｌ　Ｃプロトコーラ・デバイス・ドライバはメモリアクセスをソフトウェ アでシミュレートし、出力信号をマイクロコントローラ２１０に送信、ある（洩 （家、マイクロコントローラ２１０からの入力信号を受信する。これらの、読み 出しおよび書き込みルーチンはＨＤＬＣ割り込み駆動バックグラウンドルーチン によって呼び出されて、ＨＤＬＣ割り込みおよびＦＩＦＯ状態、および受信Ｆ　 ’Ｉ　Ｆ　Ｏを読み取るため、また送信ＦＩＦＯをロードするために用いられる 。 割り込み駆動バンクグラウンド・ルーチンは、プログラムのコード・スペースと 実行時間のほとんどを占める。 これらのルーチンは、２つのソースからの割り込みに応答して、これのサービス を行い、次に、プログラム状態をファオグランド・プログラムに伝えてからプロ グラム制御をリターンさせる。この方法を用いることによって。 リアルタイム制御を維持することができ、ファオグランド・プログラムは、連続 的なポーリングによるオーノベーヘッドなしに、必要なときだけサービスを実行 することができる。２つの主な割り込みソースは、５ミリ秒割り込みハードウェ アタイマと、）（ＤＬＣプロトコーラカ翫らの外部割り込み要求である。 ５ミリ秒タイマーは、タイマー・リセット・ルーチンによってサービスされ、オ ーバフローが発生してり）な１）かどうかを調べて、タイマー再ロードのときに 補正を行う。次に、このルーチンは、先に述べた一定時間ごとに中継ライン・ス キャニング・ルーチンへのコールを開始し、現在の各ラインの状態を読み取って 、そのラインの現在の動作に応じてそのラインに対するサービスを行う。 このサービスには、ラインの占有と解放、呼び出し信号の監視、ダイヤリング、 および呼びの接続がある。 現在のラインの状態は、そのラインのＣ０ＤＥＣからの読み取りによって判定さ れる。また、現在どのような動作がなされているかは、そのラインに対する動作 コードを調べることによって行われる。マイクロコントローラ２１０は、コード の適当な部分に分岐し、ライン状態に何らかの変化が発生していないかをチェッ クする。次いで、最終的なスキャニング分岐がマイクロコントローラ２１０によ って実行され、もし必要があればそのラインに対して適当なアクションが取られ る。典型的なアクションは、呼び出し信号動作、ＣＯライン占有、ＣＯライン解 放、およびパルスダイアリングの終了を報告するための内部送信スタックへのコ マンドのロードである。 ５ミリ秒毎に各ラインがスキャンされ、これしこよって。 パルス・ダイヤル、呼び出し信号のカウント、その他の一定時間に発生する動作 を十分な分解能で実行することができる。グラウンド占有およびループ占有、ノ （ルス・ダイアルのための可変メーク／ブレーク比率、可変な番号間タイマー間 隔、および可変フックフラッシュ時開力１プログラムによってサポートされる。 これらの変数４１個々のユーザの必要に応じＣＰＵ基板５６上のマイクロコンピ ュータ８ｏによってセットおよびリセットすることが可能である。 ＨＤＬＣ割り込み要求は、マイクロコントローラ２１０の外部割り込みを介して 実行される。ＨＤＬＣサービス・プログラムは、ＨＤＬＣプロトコーラ割り込み 状態レジスターを読んで適当な分岐を行う、有効な割り込み条件は、受信パケッ トの終了すなわち正しいスロット・アドレスをもつパケットの全てがＨＤＬＣに よって受け取られたとき、および、パケット送信終了すなわちＣＰＵボード５６ へのパケット伝送が終了したときである。 これらの２つの条件のいずれかが成立しない場合には、割り込みエラー状態とな り、ＨＤＬＣプロトコーラ２１８デバイスは再初期化される。 送信パケットが終わりに至ると、ＨＤＬＣサービスルーチンは１分岐してＨＤＬ Ｃ送信機をオフにする。送信チャネルは全てのスレーブ・ボードの間で共通使用 されるので、これは可能な限り早く行う必要がある。送信機を使用禁止状態にし た後、ルーチンはリターンされて受信パケットが終わりに至っていないかどうか のチェックが行われる。もし、これが妥当な状態であれば、そのサービスが行わ れる。 受信パケットが終わりに達すると、ＨＤＬＣサービス・ルーチンは、ＨＤＬＣプ ロトコーラ２１８の受信ＦＩＦＯのアンロードを開始する。ＨＤＬＣプロトコー ラ・プロセッサは、アンロードされた各バイトの状態の検証を行う。有効な各パ ケットは、最小３データ・バイト長に対するチェックが行われる。第１のバイト は、スロット・アドレスが正しいかどうかのチェックである。もし、それがＡＬ ＬＣＡＬＬ　（全呼び出し）アドレスである場合には、（すなわち、すべての周 辺ボードに対して向けられたメツセージである場合には）、ＨＤＬＣサービス・ ルーチンは、メツセージをサービスするコードの特別の部分へプロセッサを分岐 させる働きをするが、応答は行わない、第２のバイトには、そのコマンドが参照 するライン番号が含まれており、内部受信スタックに記憶される。第３のバイト は、２つの特別な状態をチェックするためのコマンド、即ち、スレーブ動作問い 合わせ（ＳＡ工）コマンドと否定応答（ＮＡＫ）コマンドとを含んでいる。ＳＡ Ｉコマンドは、単に、中継基板が送信チャネルにアクセスすることを許可するコ マンドであり、また、ＮＡＫコマンドは最後に送信されたパケットの再送信を要 求するのに用いられるコマンドである。これらのいずれかが受信されたとき、も し、何もメツセージが受信スタックに存在していなければ、プログラムは送信ル ーチンに分岐する。ＮＡＫコマンドに対しては、システムＣＰＵボード５６に最 後に送られたコマンドが再送信される。ＳＡＩコマンドに対しては、次の利用可 能な送信コマンドがある場合には、これが送信される。 メツセージが特別なものでなければ、そのメツセージは全体がアンロードされ、 フォアグランド・プログラムによって解釈を行うために受信スタックに記憶され る。 フォアグラウンド・プログラムに通知するためにフラグが送られる。受信スタッ クは、３つのＨＤ　Ｌ　Ｃメツセージを保持することができるだけの容量を持っ ている。新メツセージ受信時に受信スタックが満杯である場合には。 マイクロコントローラ２１０はＮＡＫコマンドを発して、受信パケットを破棄す る。パケット記憶が完了すると、プログラムは送信ルーチンに入る ＨＤＬＣ送信ルーチンは、マイクロコントローラ２１０を制御して内部送信コマ ンド・スタックをチェックし、ＨＤＬＣプロトコーラ２１８の送信ＦＩＦｏにロ ードするためのコマンドを形成する。マイクロコントローラ２１０のデータ空間 は貴重な存在なので、これらのコマンドは、最終的なフォーマットの形ではスタ ックされない。 むしろ、送信スタックには、１バイトまたは２バイト・コードを含ませるように し、これを送信ルーチンが翻訳して適当なコマンドに形成する１例えば、Ｃ０Ｄ ＥＣレジスタ読み出し動作に対しては、送信コードがスタックから取り出されて 翻訳されるが、このとき、指定されたＣ０ＤＥＣレジスターの読み出しが行われ る。次いで、スロット・アドレス、ライン・アドレス、コマンド値、レジスター ・アドレスおよびレジスターの値が割り込みサービスの間にＨＤＬＣ送信ルーチ ンによって形成されてＨＤ　Ｌ　Ｃプロトコーラ２１８にロードされる６次に、 ＨＤＬＣ送信機がイネーブルされる。こうして、ＨＤＬＣサービス・ルーチンが 終了するとプログラム制御はフォアグランド・プログラムにリターンする。 Ｖｌ、ディジタル基板 電気通信システム１ｏの各ディシル基板４８（図３）は、複数のディジタル・ラ インに対する処理を行うための回路を有している。例えば、ディジタル基板は、 この基板繋がる各ディジタル・ラインに対して以下の任意のライン機能、すなわ ち、加入者ネットワーク・インターフェース回路（Ｓ　Ｎ　Ｉ　Ｃ）制御、ディ ジタル基板に接続されたディジタル電話とＣＰＵ基板５６との間の５ＮＩＣを介 したメツセージ送信、あるいはメンテナンス端末通信信号の処理を実行すること が可能である。 図１４を参照する。ディジタル基板４８は、オンボード基板プロセッサ２２６． すなわちアナログ基板に関連して先に説明したインテル８０Ｃ５２マイクロコン トローラを有する。マイクロコントローラ２２６は、８つの５ＮＩＣ２３２−２ ３９，ＣＰＵ基板５６との通信のためのＨＤ　Ｌ　Ｃプロトコーラ２４０、タイ ムスロット交換（ＴＳＩ）スイッチ２４１、およびプログラマブル論理デバイス （ＰＬＤ）２４２を含むいくつかの周辺装置に接続されている。ディジタル基板 の基本的な機能は、スイッチ制御、スロット・アドレス読み取り、初期化、ＨＤ ＬＣ通信、メンテナンス、およびエラー検出である。 基板のこれらの機能、および上記のディジタル基板のライン機能は、マイクロコ ントローラ２２６のＲＡＭ２３０に記憶されているファームウェアによって実現 される。 ディジタル基板ファームウェアは、アナログ基板および中継基板のファームウェ アにおける場合と同じように、すでに説明した理由により、モジュール方式で書 がれる。 アナログ基板および中継基板と同様に、ディジタル基板ファームウェア・プログ ラムは、好適には、初期化ルーチン、デバイス・ドライバー、フォアグランド主 プログラム、割り込み駆動バックグラウンド・ルーチンの４つの主要部分に分割 される。 ディジタル基板４８に対する初期化ルーチンは、アナログ基板および中継基板の ものと類似のものであるので、図１１を参照しながらこれについて説明を行う。 ディジタル基板の初期化ルーチンは１図１１のブロック１６８に示すように、例 えばハードウェア・リセット（すなわち、ディジタル基板パワーアップ、または ウォッチドッグ・タイマー・リセット）中とが、あるいは、ソフトウェアリセッ ト中とかにファームウェア・プログラム内から呼ばれるマイクロコントローラの リセットによって開始される。マイクロコントローラのリセットに続いて、マイ クロコントローラ２２６は、ブロック１７０に示すように、それが制御するボー ドの種類を判定し、またそれがマウントされているボードのアドレスを読み取る ようにプログラムされている６基板アドレスの読み取りは、単一のＩ１０ピンを 多重使用し、論理デバイスを介してバックプレーンに配備された５つの信号ライ ンＢＳＡＯ−ＢＳＡ４　（図６）を読み取ることによって行われる。 ブロック１７２に示すように、マイクロコントローラ２２６は１周辺装置に関連 する構成要素、すなわち、種々のマイクロコントローラ・データ・レジスター、 ５ＮＩＣ２３２−２３９、ＨＤＬＣプロトコーラ２４０．ＴＳエスイッチ２４１ ．およびＰＬＤ２４２の初期化を行う、各ディジタル・ライン・インターフェー スは、Ｓ−バス・トランシーバとラインのインターフェースおよび保護のために 必要な受動部品とを備える。マイクロコントローラ２．２６は、マイクロコント ローラＩ１０．ｔｅ−トを介してシュミュレートされたマイクロプロセッサ・メ モリ・ボートを介して直接トランシーバへのアクセスを行う、マイクロコントロ ーラ２２６は、Ｓ−バスの状態と各トランシーバに関連するＨ　Ｄ　Ｌ　Ｃリン クを初期化し、Ｂ、Ｃ，およびＤのＰＣＭチャネルに対するチャネル割り当ての セットアツプを行う、１Ｂ”チャネルは６４にビット／秒のチャネルであり１例 えば、ディジタル基板とディジタル電話との間での音声およびデータの伝送に用 いられるものである。”Ｃ”チャネルは、８にバイ８フ秒のチャネルであり、例 えば、マイクロコントローラ２２６とＳ−バス・トランシーバとの間の信号伝送 に用いられる。ＩＩ　Ｄ　Ｉ＋チャネルは、１６にビット／秒のチャネルで、例 えば、ディジタル電話とディジタル基板との間のフレーム信号およびクロック信 号の伝送に用いられる。ＴＳＩスイッチ２４１は、ディジタル基板用のＰＣＭハ イウェイを選択し、Ｂ−チャネルのデータをＳ−バス・インターフェースから、 この選択されたＰＣＭハイウェイ５７上に転送するのに用いられる。マイクロコ ントローラ２２６によるスイッチ２４１のアクセスは、ＨＤＬＣプロトコーラ２ ４０およびＳ−バス・トランシーバに用いられているメモリ・ボートと同様な機 能を有するＩ１０シミュレート・メモリ・ボートを介して行われる。スイッチ２ ４１は、初期化手続き中に、ＣＰＵ基板５６上のマイクロコントローラ８０が指 定するハイウェイ上の１６の連続したチャネルにＢ−チャネルのデータを配置す るために初期化される。その他のすべてのチャネルおよびハイウェイは高インピ ーダンス状態になされる。ＨＤＬＣプロトコーラ２４０は、１９２キロビット／ 秒で作動するように初期化され、内部タイミングおよび受信アドレスの認識機能 はイネーブル状態にされる。 この受信アドレスはマイクロコントローラ２２６が決定したスロット・アドレス である。ＰＬＤ２４２は、信号のバッファと多重化のために用いられる。例えば 、マイクロコントローラ２２６は、ＰＬＤ２４２を用いてディジタル基板４８の スロット・アドレス用バックプレーンを読み出す。 周辺装置の初期化に続いて、マイクロコントローラ２２６は１図１１のブロック １７４に示すように、開始準備終了（ＲＴＳ）コマンドをＨＤ　Ｌ　Ｃプロトコ ーラの内部送信スタックにロードして、送信可能体制を整える。 さらに、ボックス１７６および１７８にそれぞれ示すように、マイクロコントロ ーラ２２６に接続されているウォッチドッグタイマがリセットされ、ＨＤＬＣプ ロトコーラ２４０がイネーブル状態にされる。受信のためのイネーブル化が行わ れた後、ＨＤＬＣプロトコーラ２４０は、マスタ／スレーブ通信環境においてＣ ＰＵ基板５６に対するスレーブとして動作する。以下にさらに詳細に説明するよ うに、妥当なパケットを受信すると、ＨＤＬＣプロトコーラ２４０は割り込みを 生起させ、これに対するサービスがマイクロコントローラ２２６によって行われ る。 図１１の判定ブロック１８０を参照する。ＨＤＬＣ割り込み要求信号がＨＤＬＣ プロトコーラ２４０から供給されるまで、マイクロコントローラ２２６は、判定 ブロック１８０の否定分岐に示すように、他の処理を行わない、ＨＤＬＣ割り込 み要求を生起させることができる妥当な割り込み条件は、アナログ基板に対する ものと同様である。すなわち、ＨＤＬＣプロトコーラ２４０が受信した送信パケ ットの終端の存在か、あるいは、システムＣＰＵ基板５６へのパケットの送信が 終了時の送信パケットの終端の存在かである。これら２つのいずれの条件も成立 していない場合には、割り込みエラー状態となり、ＨＤＬＣプロトコーラ２４０ の再初期化が行われる。 ＨＤＬＣ割り込み要求信号を受信すると、マイクロコントローラ２２６は１図１ １のブロック１８２に示すように、ＨＤＬＣ内部送信スタックに記憶されている ＲＴＳコマンドをＣＰＵ基板マイクロコンピュータ８ｏに対して送信する。続い で、マイクロコントローラ２２６は。 ブロック１８４に示すように、ＣＰＵ基板マイクロコンピュータ８０のＲＯＭに 記憶されている初期化データを受信して、このデータを適当なデータレジスタに ロードする。この初期化データには１例えば、許可されたラインのアドレス、お よびディジタル基板データの転送に用いようとしているＰＣＭハイウェイ５７の タイムスロット指定を含めることが可能である。マイクロコントローラ２２６は 、判定ブロック１８６の否定分岐に示すように１通常処理開始（ＢＮＯ）コマン ドをＣＰＵ基板マイクロコンピュータ８０から受信するまでは他の処理を行わな い、ＢＮＯコマンドをＣＰＵ基板マイクロコンピュータ８０から受信した後は、 ブロック１８６の肯定分岐およびブロック１８８に示すように、ディジタル基板 のためのマスター制御プログラムが実行される。 マスター制御プログラムは、一般に、上記の初期化ルーチンとデバイス・ドライ バ・プログラムモジュールの呼び出しを行うフォアグランドプログラムと、必要 時ベースで用いられる割り込み駆動バックグランドルーチンとを備える。フォア グランド、バックグランド、およびデバイスドライバ・ソフトウェア・モジュー ルについて。 図１２を参照しながら以下に説明する。 ディジタル基板４８のフォアグランドプログラムは。 マイクロコントローラを制御してリセットおよび各種初期化ルーチンの呼び出し を行うためのマスター制御プログラムである０図１１に関連してすでに述べたよ うに。 マイクロコントローラ２２６は、システムＣＰＵ基板５６に対してＲＴＳ信号を 送信してディジタル基板の存在と状態とを知らせ、また、ＣＰＵ基板５６上のマ イクロコントローラ８０からの如何なる初期化命令をも受け入れる０通常動作開 始（ＢＮｏ）コマンドをＣＰＵ基板５６から受信すると、ディジタル基板４８の フォアグランドプログラムはループに入り、割り込みが起こるまで待機する（図 １１のブロック１８０）、ＨＤＬＣプロトコーラ２１８による割り込みが開始さ れると、マイクロコントローラ２２６は１図１２のブロック１９２に示すように 指定された割り込み入力を禁止し、ブロック１９４に示すように、記憶されてい る動作フラグを調査して何らかのパケット動作がＨＤＬＣプロトコーラ受信スタ ックあるいはＦＩＦＯに発生しているかどうか判定する。 もし、これらのフラグのいずれかが有効である場合には、ブロック１９６に示す ように、マイクロコントローラ２２６は、適当なサービスルーチンに分岐してデ バイスドライバおよびバックグランドルーチンを呼び出し、受信したパケットの コマンドバイトが指定するコマンドのサービスを行う。内部受信スタックに何も パケットが存在しない場合、または、サービスルーチンが終了した場合には、ブ ロック１９８に示すように、マイクロコントローラ２２６は、他の基板がらの以 後のＨＤ　Ｌ　Ｃ割り込み要求を受信すようにその割り込み入力をイネーブル状 態にする。 ＨＤＬＣ割り込みが終了すると、メインプログラムに従うマイクロコントローラ ２２６は、ブロック２００に示すように、割り込み入力を禁止することによって 、また、ブロック２０２に示すように何らかの有効パケットが受信ＦＩＦＯに存 在するかの判定を行うことによって。 ＨＤＬＣ受信スタック内の何らかのパケット動作の存在を探索し続ける。ブロッ ク２０４に示すように、もし、パケットがＨＤＬＣプロトコーラの受信ＦＩＦＯ に存在する場合には、マイクロコントローラ２２６は、受信コマンド・サービス ・ルーチンを再度呼び出し、受信スタックのボトムをアンロードして、コマンド バイトを読み取り、適当なルーチンへ分岐してそのコマンドのサービスを行う、 このコマンドのサービスがうまく終了した場合には、受信スタックポインタの調 整が行われ、適当なフラッグがセットあるいはリセットされる。もし、コマンド のサービスを行うことができない場合（すなわち。 送信が要求されていて、送信スタックが現在満杯となっている場合）には、受信 パケットは、そのまま放置され、次の割り込みの後にサービスが行われる。受信 コマンドルーチンが終了すると、主プログラムルーチンは、ブロック２０６に示 すように休止モードに戻り、マイクロコントローラは１次のＨＤ　Ｌ　Ｃ割り込 み信号を待機する（図１１のブロック１８０）。 マスター制御プログラムのデバイス・ドライバは転用が可能なコード・ブロック からなっており、これを用いることによって、マイクロコントローラ２２６は、 ディジタル基板の周辺装置（すなわちＨＤＬＣプロトコーラ２４０、ＴＳＩスイ ッチ、および５ＮＩＣ２１３−２３９のＳ−バス・インターフェース）と通信を 行うことが可能である。これらのドライバは、コードの他の部分において繰り返 し呼び出され、こうして、コード空間が最小化され、また最大の信頼性が得られ る。これらのデバイス・ドライバは、メモリ・アクセスがマイクロコントローラ Ｔ／○を介してシミュレートされるという点ではすべての構成部品に対して同様 なものである。ＨＤＬＣプロトコーラ・デバイス・ドライバは、マイクロコント ローラが、メモリ・アクセス・ソフトウェアをシミュレートするマイクロプロセ ッサＩ１０を介してＨＤＬＣプロトコーラ２４０に関連するマイクロプロセッサ ・メモリ・ポートにアクセスすることを可能にする。このメモリ・アクセスは、 読み取りと書き込み動作用の別々のルーチン内でシミュレートされる。これらの 読み取りおよび書き込みルーチンは、ＨＤＬＣ割り込みおよびＦＩＦＯの状態と 受信ＦＩＦ○とを読み取って送信ＦＩＦＯにロードするためのＨＤＬＣサービス ・ルーチンによって呼び出される。ＴＳＩスイッチ２４１および５ＮＩＣ２３２ −２３９のためのデバイス・ドライバは、ＨＤＬＣプロトコーラ２４０用のドラ イバと同様のものである。 ディジタル基板４８の主要な機能は、システムＣＰＵ基板５６とそのディジタル 基板に接続されたディジタル電話との間でメツセージの送信を行うことであるか ら。 主処理ルーチンの範囲はやや限定されたものである。バックグラウンドの処理時 間の大部分が、ディジタル電話の問い合わせとＨＤＬＣのロードおよびアンロー ドとに費やされる。 割り込み駆動バックグラウンド・ルーチンは、ディジタル基板ファームウェア・ プログラムのコード・スペースとその実行時間の主要部分を占める。これらのル ーチンは、３つのソースからの割り込みに応答して、これのサービスを行い、次 に、プログラム状態をファオグランド・プログラムに伝えてからプログラム制御 をリターンさせる。従って、この方法を用いることによって、リアルタイム制御 を維持することができ、ファオグランド・プログラムは、連続的なポーリングの オーバーヘッドなしに、必要なときだけサービスを実行する。３つの主な割り込 みソースは、５ミリ秒割り込みハードウェアタイマ、ＨＤＬＣプロトコーラ２４ ０からの外部割り込み要求、および５ＮＩＣ２３２−２３９からの外部割り込み である。 ５ミリ秒タイマーは、タイマー・リセット・ルーチンによってサービスされ、オ ーバフローが発生していないかどうかを調べて、タイマー再ロードのときに補正 を行う０次に、このルーチンは、先に述べた一定時間ごとにディジタル・ライン ・スキャニング・ルーチンへのコールを開始し、現在の各ラインの状態を読み取 って、そのラインの現在の動作に応じてそのラインに対するサービスを行う、こ のサービスには、ラインの活性化と非活性化、ディジタル電話へのコマンドの送 信、メツセージ送信のためのディジタル電話への問い合わせがある。 ５ＮＩＣ２３２−２３９からのＨＤ　Ｌ　Ｃ割り込みはマイクロコントローラ２ ２６の外部割り込みによって実行される１次に、マイクロコントローラ２２６は 、妥当な送信状態を有するラインのスキャンを行う、もし、ＨＤＬＣプロトコー ラＦＩＦＯバッファにメツセージがあれば、マイクロコントローラ２２６はこの メツセージをアンロードして、このメツセージが妥当かどうかをチェックして、 これをＣＰＵ基板５６に転送する。 ＨＤ　Ｌ　Ｃ割り込み要求は、マイクロコントローラの外部割り込みを介して実 行される。ＨＤＬＣサービス・プログラムは、ＨＤＬＣプロトコーラの割り込み 状態レジスターを読み、適当な分岐を行う、有効な割り込み条件は、受信パケッ トの終了すなわち正しいスロット・アドレスをもつパケットの全てがＨＤＬＣプ ロトコーラによって受け取られたとき、あるいは、パケット送信終了すなわち、 ＣＰＵボード５６へのパケット伝送が終了したときである、これらの２つの条件 のいずれかが成立しない場合には、マイクロコントローラ２２６から割り込みエ ラー状態が発せられ、）（ＤＬＣプロトコーラ２４０の再初期化が行われる。 送信パケットが終わりに至ると、ルーチンは、分岐してＨＤＬＣ送信機をオフに する。送信チャネルは全てのスレーブ・ボードの間で共通使用されるので、これ は可能な限り早く行う必要がある。送信機を使用禁止状態にした後、サービス・ ルーチンはマイクロコントローラ２２６を制御して、受信パケットが終わりに至 っていないかどうかのチェックを行う、もし、これが妥当な状態であれば、マイ クロコントローラ２２６はそのパケットに対するサービスを行う。 受信パケットが終わりに至ると、ＨＤＬＣサービス・ルーチンは、ＨＤＬＣプロ トコーラ・プロセッサを作動させて、ＨＤＬＣプロトコーラの受信ＦＩＦＯのア ンロードを開始する。プロトコーラ・プロセッサは、アンロードされた各バイト の状態の検証を行う。有効な各パケットは、正しいスロット・アドレスであるか どうかをチェックされる。それがＡＬＬＣＡＬＬ（全呼び出し）アドレスである 場合には、（すなわち、すべての周辺ボードに対して向けられたメツセージであ る場合には）、サービス・ルーチンは、プロトコーラ・プロセッサを制御してそ のメツセージをサービスするコードの特別の部分へ分岐するが、応答は行わない 。第２のバイトには、コマンドが参照するライン番号が含まれており、内部受信 スタックに記憶される。第３のバイトは、２つの特別な状態をチェックするため のコマンドであり、スレーブ動作問い合わせ（ＳＡＩ）コマンドと否定応答（Ｎ ＡＫ）コマンドである。ＳＡＩコマンドを用いることによって。 ディジタル基板は送信チャネルにアクセスすることができ、また、ＮＡＫコマン ドは最後に送信されたパケットの再送信を要求するのに用いられる。これらのい ずれがが受信されたとき、もし、何もメツセージが受信スタックに存在していな ければ、プログラムは送信ルーチンに分岐する。ＮＡＫコマンドに対しては、シ ステムＣＰｔＪボード５６に最後に送られたコマンドが再送信される。 ＳＡＩコマンドに対しては、次の利用可能な送信コマンドがある場合に、これが 送信される。 メツセージが特別なものでなければ、そのメツセージのすべてがマイクロコント ローラ２２６によってアンロードされて受信スタックに記憶され、フォアグラン ド・プログラムによって翻訳が行われる。また、フォアグラウンド・プログラム に知らせるためのフラッグのセットが行われる。受信スタックは、３つのＨＤＬ Ｃメツセージを保持することができるだけの容量を持っている。新しいメツセー ジを受信したときに、もし、受信スタックが満杯である場合には、マイクロコン トローラ２２６はＮ　Ａ、　Ｋコマンドを発生して、受信したパケットを破棄す る。パケットの記憶が終了すると、プログラムは送信ルーチンに入る。 ＨＤＬＣ送信ルーチンは、マイクロコントローラ２２６を制御してＨＤＬＣプロ トコーラ２４０の内部送信コマンド・スタックをチェックし、そのスタックから 次の可能なコマンドを取り出してシステムＣＰＵ基板５６に転送する。記憶空間 を最小に抑えるために１割り込みサービスにおいて、スロット・アドレスおよび ライン・アドレスがＨＤ　Ｌ　Ｃ送信ルーチンによって足し合わされ、これが、 ＨＤＬＣプロトコーラ２４０にロードされる。 次に、マイクロコントローラは、ＨＤＬＣ送信機を使用許可状態にする。こうし て、ＨＤＬＣサービス・ルーチンが終了し、プログラム制御がフォアグランド・ プログラムに戻される。 ＶＩ　１．記　モジュール基 各記憶モジュール（ＳＭ）基板５０（図３）は１、例えば、音声メール・メツセ ージ、データ、およびシステム・メツセージを記憶するための不揮発性記憶装置 媒体を電気通信システム１０に提供するための回路がら構成される。図１５を参 照する。３Ｍ基板５ｏは、ＮＥＣのＶ２Ｏなどのオンボードマイクロコンピュー タ２４６を有している。マイクロコンピュータ２４６は、ＣＰＵ基板５６から受 信したコマンドに応じて、基板機能の制御を行う、マイクロコンピュータ２４６ は、一般に、ＩＢＭ−ＰＣソフトウェアと準互換性を有し、市販品として入手可 能なＸＴ　ＢｒＯ３および５Ｃ３Ｉ　ＢＩＯＳソフトウェアプログラムを２４５ にバイトのＲＯＭに搭載している、マイクロコンピュータ２４６は、好適には一 ソフトウェアバッファ、データ構造、記憶モジュール・プログラム・コードを有 し、３つの１２８にバイトＲＡＭに記憶される。さらに、マイクロコンピュータ ２４６は、マイクロコンピュータ・メモリおよびＩ１０装置のアドレスのデコー ディングを行うためのハードウェアを具備している。 さらに、図１５を参照する。ＳＭ基板５ｏは、スロット・アドレス・ボーｈ２４ ８（すなわち、プログラマブル論理デバイス（ＰＬＤ））を有しており、これに よって、記憶モジュール基板がバックプレーンからそのラック位置を読み取るこ とができるようになされている。５Ｃ３Ｉコントローラ２５０（すなわち、デバ イスＡＭＤ５３Ｃ８０）が３Ｍ基板に具備されており、ハードディスク２５２と マイクロコンピュータ２４６との間のインターフェースとして動作する。これは 、５Ｃ８Ｉ　ＢＩＯ５のソフトウェアによって制御され、これによって。 記憶モジュール基板がディスク・オペレーティング・システム（ＤＯ３）のファ ンクション・コールを介してファイルにアクセスすることが可能になされている 。ハードディスク２５２は、好適には、４０Ｍバイトの容量を有する。データは ディスク２５２にＤＯＳファイルΦ形で記憶される。メツセージおよびデータフ ァイルの記憶に加えて、ハードディスク２５２は、さらにＤＯＳプログラム、お よび記憶モジュール・プログラムの記憶にも用いられる。ディスク２５２は、５ Ｃ８Ｉコントローラ２５０によって制御される。バックプレーン上の制御ＰＣＭ ハイウェイ５９へのアクセスは、ＨＤＬＣプロトコール・コントローラ２５４を 介して行われる。この装置は、受信あるいは送信を行うコマンド・パケットをバ ッファする機能を有する。また、エラー検出機能と、その受信アドレス・レジス タに指定されているアドレスと整合しないインバウンド・パケットを拒否する機 能も有している。ＨＤＬＣプロトコーラ２５４は、割り込みラインを駆動するこ とによって有効なパケットの受信を指示することが可能である。 図１５に示すように、データ・インターフェース装置２５６（すなわち、パラレ ル・アクセス・デバイスへのＳＴ−バス）がマイクロコンピュータ２４６とバッ クプレーンＰＣＭハイウェイ５７との間のインターフェースとして具備されてい る。また、これは、信号をＰＣＭ選択装置（後に説明する）に発して、記憶モジ ュールのデータ転送に用いられていないチャネルから記憶モジュール基板を切断 する。データ・インターフェース装置！２５６は、２つの出力ＰＣＭハイウェイ ＰＣＭｏｌおよびＰＣＭｏ２と１つの入力Ｐ　ＣＭ　ハイウェイＰＣＭ１ｌとを 有している。各ＰＣＭハイウェイのＳＴ−バス・インターフェースへの各タイム スロット、およびＳＴ−バス・インターフェースからの各タイムスロットは、特 別なレジスタ・アドレスにマツプされる。ＰＣＭハイウェイ５７のチャネルへの アクセスは、データ・インターフェース装置２５６の入出力ＰＣＭハイウェイ用 の適当なレジスタから読み取りあるいはこれに書き込みを行うことによってマイ クロコンピュータ２４６へのアクセスが可能である。 ８Ｍ基板５０は、好適には、バックプレーン上の６つのＰＣＭデータ／音声ハイ ウェイ５７の中の２つにのみアクセスして、データの転送処理を行う。好適には 、これらのハイウェイの中のどれか１つの上にある６チヤネルのみが同時に使用 される。マルチプレクサ２５９と２つのデマルチプレクサ２６０および２６１を 有するＰＣＭ選択装置２５８が具備されており、これによって、選択されたバッ クプレーンＰＣＭ５７とデータ・インターフェース族！２５６との間の接続が行 われ、また記憶モジュール基板が使用していないチャネル（タイムスロット）の 記憶モジュール基板５０からの出力がトライステート状態になされる。選択され たバックプレーン人力ＰＣＭハイウェイは、データ・インターフェース装置２５ ６の入力ＰＣＭハイウェイＣＰＭｉｌにマルチプレクサ２５９を介して接続され る。選択されたバックプレーン出力Ｐ　ＣＭハイウェイはデータ・インターフェ ース装置２５６の第１の出力ＰＣＭハイウェイＰＣＭｏｌにデマルチプレクサ２ ６０およびトライステートバッファ２６２を介して接続される。マルチプレクサ およびデマルチプレクサはマイクロコンピュータ２４６によって制御される。ト ライステートバッフ７２６２は、データ・インターフェース装置２５６の第２の 出力ＰＣＭハイウェイＰＣＭｏ２によって制御される。このハイウェイは、トラ イステートバッファ２６２の制御端子にデマルチプレクサ２６１を介して接続さ れる。バックプレーンにアクセスして所望のチャネルを出力ＰＣＭハイウェイ上 に形成するために、データ・インターフェース装置ｔ！２５６からの第２のＰＣ ＭハイウェイＰ　ＣＭ　ｏ　２のチャネル上への出力信号として上位バイトが提 供される。同様に低位バイトは、データ・インターフェース装置から第２のＰＣ Ｍハイウェイ上の他のチャネルへ提供される。選択されたバックプレーン出力Ｐ ＣＭハイウェイのトライステートバッファの制御ラインは、使用可能にしようと するタイムスロットに対しては、高レベルになされ、その他は低レベルになされ る。 ８Ｍ基板５０のソフトウェアは、初期化ルーチンと。 フォアグラウンド主プログラムと、８Ｍ基板上のハードディスクとＣＰＵ基板５ ６上のＤＳＰ７２との間のデータ記憶および検索処理用コマンド実行のためのバ ックグラウンド割り込み駆動ルーチンＩＳＲとを備える。フォアグラウンド・ル ーチンは、ＤＳＰ装Ｗ７２（図７）から専用ＨＤＬＣＰＣＭハイウェイ５９上に 受信したコマンドを実行するためのコマンド・ディスパッチャ・ルーチンとデー タ通信分岐ルーチンとを備える。一般に。 ３Ｍ基板のソフトウェア制御は、ＴｕｒｂｏＣ＋やディスク・オペレーティング システム（ＤＯ８）やＲＯＭに搭載のＢＩＯＳソフトウェアなどの高レベル言語 で書かれた５Ｍ基板用に開発されたプログラムによって提供される。先に述べた ように、ＤＯ５、およびＲＯＭに搭載のＢＩＯＳとしては、好適には、市販品と して入手可能なソフトウェア・プログラムが用いられる。ディスク・アクセスお よびその他のいくつかの低レベル処理は、ＤＯ８への送受信ファンクション・コ ール、ＲＯＭ搭載ＸＴ　ＢＩＯＳ、およびＲＯＭ搭載５Ｃ３Ｉ　ＢＩＯＳによっ て実行される。高レベル制御は９本発明による高レベル言語”置ＥＣ０Ｍ″によ って書かれたプログラムによってなされる。また、ＨＤＬＣプロトコーラ２５４ およびデータ・インターフェース装置２５６に関するハードウェア固有の処理も 高レベルプログラム・コードによってなされる。 初期化処理は、ＸＴ　ＢＩＯＳ、５ＣＳＩ　ＢＩＯＳ、およびＤＯ５が協調動作 してＰＣｌ、Ｔ互換プラットフォームを提供する標準的なＰＣのブート手続きと 本質的に同じである。記憶モジュールがいったん”ブート”されると、ディスク ２５２に記憶されている記憶モジュール基板の主ソフトウェア・プログラムはデ ィスクのルート・ディレクトリのＡＵＴＯＥＸＥＣ，ＢＡＴファイルから実施に 移される。記憶モジュール・プログラムは、ルーチンの初期化を開始し、これに よって、マイクロコンピュータ２４６が作動されて、スロット・アドレスをラッ クから読み出し、そのデータ構造が初期化される。 また、マイクロコンピュータは、データ・インターフェース装置！２５６とＨＤ ＬＣプｏｌ−＝１−ラ２５４（７）初期化を行う、ＨＤＬＣプロトコーラ２５４ は、アドレス検出モード（後に説明する）で動作するために、また、妥当なアド レスを有するパケットを受信したときにマイクロコンピュータ２４６への割り込 みが行わせるために初期化される。データ・インターフェース装置２５６は、３ ２チヤネル・モード（ＣＥＰＴと互換）で動作するために、また、状態変化（ト グル）が適当なチャネルのビット上で起こったときにマイクロコンピュータ２４ ６への割り込みが行わせる（後に説明する）ために初期化される。また、データ ・インターフェース装置は、上記のようにタイム・スロット（チャネル）がデー タ転送に用いられる間、第２のデータ・インターフェース装置の出力が高レベル となるように、初期化が行われる。初期化が終了すると、マイクロコンピュータ ２４６は、それに関連する送信ＦＩＦＯに開始準備終了（ＲＴＳ）コマンドをロ ードし、基板から最初の問い合わせがあったときにこれを送る。 ＣＰＵ基板５６からのコマンド、およびＣＰＵ基板に宛てられた応答とデータは 、専用ＨＤＬＣチャネル５９を介して伝送される。コマンドはＣＰＵ基板に関し て説明したのと実質的に類似の方法で形成され、パケット化される６しかし、割 り込みがトリガーされる方法はＣＰＵ基板の場合とは異なっている。５Ｍ基板は 、好適には、スレーブ基板として実現され、従って、５Ｍ基板から通信を開始す ることはない。ＨＤＬＣプロトコーラ２５４は、）ＩＤＬＣ受信アドレス・レジ スタの上位７ピツトと同一のパケット内スロット・アドレス上位７ピツトを有す る妥当なパケットを受信するたびにハードウェア割り込みをトリガーする。この レジスタは、基板のスロット・アドレスに初期化されている。ＨＤＬＣプロトコ ーラ２５４は、パケットを読み取り、ＣＰＵ基板に関して説明したのと同様に、 エラーチェックを行う。もし、エラーが存在する場合には、マイクロコンピュー タ２４６は、否定応答（ＮＡＫ）コマンドをＣＰＵ基板５６に送る。 エラーが存在しなければ、マイクロコンピュータ２４６は、ＨＤ　Ｌ　Ｃプロト コーラ２５４を制御して、受信したパケットをマイクロコンピュータに関連する ソフトウェア受（Ｍ　Ｆ　Ｉ　Ｆ　Ｏに配置する。次に、マイクロコンピュータ は、ソフトウェア送信ＦＩＦＯを調べて送るべきコマンドがないかどうかをチェ ックする。もし、送るべきコマンドが存在する場合には、そのコマンドをＨＤＬ Ｃ送信バッファにロードし、ＨＤＬＣ送信機をイネーブル状態とする。もし、送 るべきコマンドが存在しない場合には、マイクロコンピュータ２４６は、肯定応 答を（ＰＡＫ）コマンドをＣＰＵ基板に送ってパケット受信を通知する。コマン ド送信が完了した時＋　ＨＤＬＣプロトコーラ２５４はハードウェア割り込みの トリガをかける。ＨＤＬＣＩＳＲはＨＤＬＣプロトコーラ２５４を制御して、Ｈ ＤＬＣ送信機を使用禁止状態とし、バス５９上の通信チャネルを他の基板が自由 に使えるように開放する。 データ通信ＩＳＲは、データ・インターフェース装置２５６との間のデータ・パ ケットの送受信を行う。この割り込みは、データ・インターフェース装置２５６ からの割り込みに応じて行われるものである。以下にさらに詳細に説明するよう に、指定されたチャネルのデータ・ビットがトグルされると、この割り込みトリ ガーががけられる。ＣＰＵ基板５６上のＤＳＰ７２は、新たなパケットを転送あ るいは受信するｌｓ＃が整った時、データ・ビットをトグルさせ、かくして、上 記の割り込みのトリガーがかけられる。 記憶モジュール基板のフォアグラウンド・ソフトウェアは、２つのコマンド処理 ルーチンからなる連続ループにおいて動作する６そのうちの１つは、コマンド・ ディスパッチャであり、もう１つは、データ通信分岐である。 データ通信分岐は、ＤＳＰ７２と記憶モジュール・ハードディスクとの間のデー タ転送に係わるもので、以下にさらに詳細に説明を行う。 コマンド・ディスパッチャは、フォアグラウンド・プログラムにおいて動作する 。これは、ＣＰＵ基板５６から受信したコマンドを実行するものである。このコ マンドは、一般に、ファイルに関する処理に関するものである。コマンド・ディ スパッチャは、ＨＤＬＣプロトコーラ自身ＦＩＦＯからコマンドを得、ＣＰＵ基 板５６に宛てるデータをＨＤＬＣプロトコーラ送信ＦＩＦＯ中に配置する。ＨＤ ＬＣＩＳＲは、ＨＤＬＣプロトコーラの受信および送信ＦＩＦＯとＣＰＵ基板と の間の転送処理を行う、コマンド・ディスパッチャがファイル処理に関するコマ ンドを受信すると、マイクロコンピュータ２４６がＴｕｒｂｏ　ＣのＤＯＳの手 続きへのファンクション・コール（これについては、ＣＰＵ基板の低レベルドラ イバに関連して先に述べた）に基づいて動作して、このコマンドが実行される。 次いで、マイクロコンピュータ２４６は、ＨＤＬＣプロトコーラの送信ＦＩＦＯ を介してコマンドの状態をＣＰＵ基板にリターンする。 データのハードディスク記憶装置への転送は、データ・インターフェース装置２ ５６を介して実行される６６つのタイム・スロットすなわちチャネルが、ＤＳＰ ７２（図７）から記憶モジュールへのデータ転送にＰＣＭハイウェイ上で用いら れ、また、５つのタイム・スロットが記憶モジュール基板からＤＳＰ７２へのデ ータ転送に用いられる。６つのチャネルのビットがトグル（すなわち、状態が１ からＯへ変化するか、あるいは０から１へ変化）すると、データ・インターフェ ース装置からハードウェア割り込みのトリガーがかけられる。 データの転送処理は、フォアグラウンドおよびバックグラウンドの両方のルーチ ンによって制御される。フォアグラウンド・ルーチンでディスクへのデータ転送 およびファイルアクセスに対するハンドシェーキングが行われ、一方、実際のＤ ＳＰ７２と記憶モジュール基板５０との間のデータ・バイトの転送はパックグラ ウンド・ルーチンで行われる。２つのＩＳＲ，すなわち、データ送信ＩＳＲとデ ータ受信ＩＳＲがデータ転送処理に用いられる。どちらのＩＳＲを用いるかの選 択は、所望の転送方向がどちらであるのかによる０例えば、データ送信ＩＳＲは 、コマンドをＤＳＰ７２から３Ｍ基板に送信するときにフォアグラウンド・プロ グラムによって呼び出される。データ受信ＩＳＲは、５Ｍ基板５０がＤＳＰ７２ に対してデータを転送するときに実行される。フォアグラウンド・ルーチンは２ つのＩＳＲを１つの割り込みラインだけで使用可能にするために、データ・イン ターフェース装置の割り当てられた割り込みベクトルを所望のＩＳＲを指し示す ように変更する。 データ転送は、ＤＳＰ７２によって開始される。記憶モジュール基板のマイクロ コンピュータ２４６は、第５番目のチャネルに対して転送コマンドを受信したか どうかポーリングする（問い合わせる）。転送開始コマンドには、送信準備（Ｐ ＴＸ）コマンドと、受信準備（ＰＲＸ）コマンドの２つがある。送信準備コマン ドが第５番目のチャネルに検出されると、３Ｍ基板のマイクロコンピュータは、 第１．第２．および第３のチャネルから論理ファイル番号（以下に説明）と所望 のバッファサイズを読み取る。次に、バッファをハードディスク上の論理ファイ ルで満たす。もし、このバッファを読み取っているときに、ファイルの終端に達 した場合には、この情報は、バッファに読み込まれたバイト数とともに出力ＰＣ Ｍハイウェイの第１、第２．および第３のチャネルに送られる。次に、記憶モジ ュール基板のマイクロコンピュータは、データ・インターフェース装置の割り込 みラインに割り当てられている割り込みベクトルをデータ受信ＩＳＲを指し示す ようにセットして１割り込みが可能なようにする。マイクロコンピュータ２４６ は、送信要求（ＲＤＹＴＸ）コマンドを第５番目のチャネルに送る。 受信Ｉ！！備（ＰＲＸ）コマンドが第５番目のチャ゛ネルに検出された場合には 、３Ｍ基板のマイクロコンピュータは、第１、第２、および第３のチャネルから 受信しようとしているファイルのサイズと論理ファイル番号とを読み取る０次い で、データ・インターフェース装置２５６に割り当てられた割り込みベクトルを データ受信ＩＳＲを指し示すようにセットし、割り込みを可能な状態とする。 次に、記憶モジュール基板のマイクロコンピュータは。 受信要求（ＲＤＹＲＸ）コマンドを第５番目のチャネルに送る。ＲＤＹＲＸ、Ｐ ＲＸ、ＲＤＴＸ、およびＰＴＸコマンドについては、これらの定義を、５Ｍ基板 ５０への接続に用いるその他のコマンドとともに付録Ｆに表として示しである。 記憶モジュール基板５ｏがデータ転送モードにあるとき、マイクロコンピュータ ２４６は、第５番目のチャネルにＤＳＰからの送信終了（ＤＯＮＥＴＸ）コマン ドが送られたかどうかポーリングする。このポーリングは。 ソフトウェア・ループ・タイマ内で行われる。ポーリングタイム中、記憶モジュ ール基板のマイクロコンピュータ２４６は、自由に割り込みを受け付けることが できる。 データの転送方向に応じて、ＩＳＲはデータをバッファからデータ・インターフ ェース装置１２５６のチャネル１−４へ向けて転送するか、あるいは、データ・ インターフェース装置２５６のチャネル１−４からデータを取得してこれをバッ ファ内に配置する。ＩＳＲ内のカウンタによって、バッファへのポインタがイン クリメントされ、これによって、連続的にバッファへデータを出し入れすること が可能となる。ＤＳＰ７２がデータを送っているとき、ＤＳＰ７２は新たなデー タをチャネル１−４に配置するたびに第６番目のチャネルをトグルさせる。記憶 モジュールがデータを送っているとき、ＤＳＰ７２は。 第６番目のチャネルをトグルさせて、次のフレームにおいて妥当なデータがチャ ネル１−４上に配置されるようにする。１つのフレームは、ＰＣＭハイウェイの ３２のタイム・スロットを伝送するのに必要な時間である１２５マイクロ秒の間 だけ有効である。 バッファ転送が完了したものとＤＳＰ７２が判断したり、あるいは、他の何らか の理由で中断を要求したりするときには、ＤＳＰ７２は、送信終了コマンドをチ ャネル５に送る。もし、タイマの終了までに送信終了コマンドが受信されなかっ た場合には、記憶モジュール基板のマイクロコンピュータは１通常送信手続きを 行うべきものと仮定する２通常送信手続きは、２つの要因、すなわち、送信方向 、および送信されたバッファがファイル中の最終のものであるかどうかに依存す る。もし、記憶モジュール基板が何らかのファイルを受信中である場合。 受信されたバッファはディスクに書き込まれる。どちらの場合においても、もし バッファがファイルの最後であった場合には、ファイル・ポインタがディスク上 のそのファイルの最初を指し示すようにセットされ、必要ならば直ちに再生ある いは再記録が可能なようになされる。 すべての場合において、データ・インターフェース装置２５６からのハードウェ ア割り込みはマスクされる。すなわち、不許可状態とされる。 ５Ｍ基板５０のメールボックス応用における機能について説明する前に、記憶モ ジュール基板メモリのメールボックスの構成について説明しよう。メールボック スは、一般に、特定のシステムユーザに対してメツセージを記憶するためにメモ リ区間の割り当てを行うことである。 システム・ファイルは、これをオープンしたときに直ちにデータ転送動作をする ことが可能なハードディスク・ドライブ内のファイルである。論理番号は、シス テムファイルがオープンされたときに、５Ｍ基板のマイクロコンピュータから与 えられる、５Ｍ基板５０に関するシステム・コマンド番号である。この番号は、 ＣＰＵ基板のマイクロコンピュータ８０あるいはＤＳＰ７２がオープンされてい るシステムファイルあるいはメールボックスを参照するのに用いる。Ｍ大、８つ のメールボックスと１６のシステムファイルを一度にオープンすることが可能で ある。 メールボックスは、各ポート番号とタイプに対して割り当てられる。どのポート 番号も好適には各タイプについて１つずつ１合計で２６もの多くのメールボック スを有することができる。各メールボックスは、２５６もの多くのメツセージを 有することができる。各メールボックスは、メールボックスに記憶されているメ ツセージ数、メールボックスに記憶可能な最大メツセージ数、各メツセージの日 付と時刻、各メツセージのバイト長に関する記録を保持する。新たなメールボッ クスの作成は、一般に初めてオープンされる前に、５Ｍ基板がメールボックス作 成（ＣＲＭ）コマンドを受信して作成する。メールボックスをオープンするとき 、記録の方向を指定する必要がある。記録のためにオープンされたメールボック スに対して送られたメツセージは、そのメールボックスをクローズして再生用に 再オープンすることなしに、そのまま再生可能である。メールボックスが記録の ためにオープンされたときには、メツセージ・ポインタは変化しない。メツセー ジの消去と再生の便のために、さらに、新たにメツセージが記録されるとポイン タはこれを指し示すようにされる、メールボックスが記録のためにオープンされ ている間、多数回の記録と再生を行うことが可能にすることもできるが、好適に は、メールボックスが記録のためにオープンされる度に、１つの新たなメツセー ジを記録するのが望ましい。この新たなメツセージはメールボックスをクローズ する前に消去しない限り、メールボックスに保存される。再生のためにメールボ ックスがオープンされた場合には、メツセージ・ポインタによって指し示されて いるメツセージに対してだけ、ＳＭ理がなされる。再生のためにオープンされた メールボックスに対しては、新たなメツセージを送ったりあるいは記録したりす ることはできない８ 各システム・ファイルにはタイプと番号とが割り当てられるが、これらは、コマ ンドを送ってシステム・ファイル（Ｏ３Ｆ）を作成する際に５Ｍ基板に送られる ポート番号によって指定される。２５６のポート番号と、２６の可能な種類とで 合計最大６６５６のシステム・ファイルを作成することが可能である。システム ・ファイルがオープンされると、そのシステム・ファイルはＣＰＵ基板５６から の指定をさらに必要とすることなしに再生あるいは記録がなされる。 コマンド・ディスパッチャ・プログラム・モジュールおよびデータ通信分岐プロ グラム・モジュールについて。 図１６の記憶モジュール土手続きのフロー・チャートを参照しながら説明する。 ブロック２６４に示すようにデータ・ボートと割り込みサービス・ルーチンの初 期化を行った後、マイクロコンピュータ２４６は、ブロック２６６に示すように ＨＤＬＣプロトコーラ受信ＦＩＦＯを調べて新しいコマンドが存在しないかどう かのチェックを行う。受信ＦＩＦＯに新しいコマンドが存在している場合には、 マイクロコンピュータ２４６は、そのコマンドを実行するためのサブルーチンを 呼び出し、状態情報とデータとをＣＰＵ基板に対してリターンする。ブロック２ ６８．２６９，２７０、および２７１に示すように、マイクロコンピュータ２４ ６は、サブルーチンの制御のもとにメールボックス用メモリ空間の生成、データ のメモリ空間からの削除、メールボックスのオープンとクローズ、メールボック スからのメツセージの選択、メールボックスからのメツセージの削除をそれぞれ 行うことが可能である。ブロック２７２に示すように、メールボックスをオープ ンあるいはクローズさせるサブルーチンを呼び出した後に、マイクロコンピュー タ２４６はメールボックス・データをＨＤＬＣプロトコーラ送信ＦＩＦＯに配置 する。ユーザがメツセージをメールボックスから選択すると、マイクロコンピュ ータはブロック２７３に示すようにそのメツセージ長さと生起時刻とに関連する データをＨＤＬＣプロトコーラ２５４の送信ＦＩＦＯに配置する。メツセージが メールボックスから削除されると、マイクロコンピュータ２４６はブロック２７ ４に示すように次のメツセージに関する情報をＨＤＬＣプロトコーラ送信ＦＩＦ Ｏに配置してＣＰＵ基板５６へ送信する。また、ブロック２７５に示すように、 マイクロコンピュータ２４６はコマンド状態データをＨＤＬＣプロトコーラ送信 ＦＩＦＯに配置する。また、ブロック２７５に示すように、マイクロコンピュー タ２４６は、コマンド状態データをＨＤＬＣプロトコーラ送信Ｆ　Ｉ　Ｆｏ中に 配置する。 判定ブロック２７６に示すように、マイクロコンピュータは、ＨＤＬＣコマンド 処理の終了後、データ・インターフェース装置２５６の妥当なチャネル上にＣＰ Ｕ基板のＤＳＰ７２からの新たなデータ通信コマンドが存在しないかどうかをチ ェックする０判定ブロック２７６の否定分岐に示すように、ＤＳＰからの新たな コマンドが受信されていない場合には、マイクロコンピュータ２４６は、続けて ＨＤＬ（？、プロトコーラ受信ＦＩＦＯを調べてＣＰＵからの新たなコマンドが 受信されていないかどうかをチェックする。ブロック２７８に示すように、ＣＰ Ｕ基板のＤＳＰ７２からのコマンドが受信されている場合には、マイクロコンピ ュータは、主プログラムの制御のもとに全ての必要なファイルをオーブンあるい はクローズして、ファイル・ポインタをこれに対応するようにセットする。さら に、マイクロコンピュータは、妥当な割り込みベクトルを所望のデータ転送を行 う妥当なｌ５Ｒｋこ向けるようセットする。続けて、フォアグラウンド・プログ ラムの制御のもとにあるマイクロコンピュータは、ＣＰＵ基板５６からの新たな コマンドが）（ＤＬＣプロトコーラ受信ＦＩＦＯに存在しないかどうかチェック する。 ｖ工１．カッドＤＳＰ基 電気通信システム１０の各カッドＤＳＰアレイ基板５２（図３）は、電気通信シ ステム１０が提供する多くのサービスを独立に行うようにプログラムされ得るい くつかのディジタル信号プロセッサ（ＤＳＰ）を備える。これらのサービスの数 と範囲は、そのシステムが実行する具体的なアプリケーションに依存する０例え ば、システムが″ファックス・リファイラ”として用いられている場合には、Ｄ ＳＰ基板をグループＩ　Ｉ−ＩＶソファシミリ送受信のサービスをサポートする ようにプログラムすることができる。もう１つの例として、もし、システムが” ファックス応答″ユニットとして用いられる場合には、システムはファックス・ ファイルからのテキストファイルの生成などのサービスを提供できる。その他の サービスとしては以下のような例が含まれる。すなわち。 トーンの周波数や振幅やオン／オフ・デユーティ・サイクルをユーザが完全に制 御するミュージック・トーンを含む全ての適用可能な電気通信トーンのトーン発 生、検出されるべき周波数をユーザが制御しているＤＴＭＦデコーディングおよ びダイアリング、電話会議、ロータリ番号あるいはＤＴＭＦ番号検出用のダイア ル・パルス・デコーディング、モデムのサポート、音声圧縮、ビデオデータおよ びファクシミリ、音声やデータや画像ファイルの記録と検索、エコー消去、パケ ット交換およびプロトコール変換、テキスト・スピーチ変換、音声認識などであ る。 図１７を参照する。カッドＤＳＰアレイ基板５２は、２８１乃至２８４の４つの ＤＳＰおよびこれらに対応する２８５乃至２８８のスタティックＲＡＭに接続さ れた、例えばインテル８０Ｇ５１などのマイクロコントローラのようなマイクロ コントローラ２８０を備える。また、ＤＳＰからのデータを選択されたＰＣＭの データ／音声ハイウェイ上へデータ設定を行うためにタイム・スロット交換（Ｔ ＳＩ’）スイッチ２９０が具備される。ＴＳＩスイッチ１９０は、Ｉ１０シミュ レート・メモリ・ポートを介してマイクロコンピュータ２８０によってアクセス される。また、ＨＤＬＣプロトコーラ２９２がマイクロコントローラと専用ＰＣ Ｍハイウェイ５９との間のインターフェースとして基板５２に具備される。オプ シミンとして、ＤＳＰにダイナミックＲＡＭ　（ＤＲＡＭ）２９４乃至２９７を 接続することも可能である。従ってＤＲＡＭは破線で示しである。ＤＲＡＭは一 般にマイクロコントローラを具備している６従って、ＤＳＰはＤＲＡＭのアドレ ス・ラインをマルチプレックスすることができ、これによってＤＳＰ基板とＤＲ ＡＭとの間のインターフェース・ネットワークの必要性がなくなる。 カッドＤＳＰアレイ基板５２上のＤＳＰは、パワーアップ初期化中に、あるいは 、システムの通常動作中の任意の時点で特定のタスクを実行するようにプログラ ムすることができる。この特徴によって、要求があり次第、システム資源を用い ることが可能となる。例えば、スクール・レジストレーションなどの特定のアプ リケーションにおいて多数のモデムが必要とされる場合に、システムは他の通信 サービスを一時的に停止してモデムのサービスを動的に提供することが可能であ る。さらに、ＤＳＰ２８１乃至２８４がＤＲＡＭ２９４乃至２９７と共に用いる られるときには、メツセージを記憶モジュール（ＳＭ）基板５０に送信する前の メツセージ・バッファとして動作させることが可能である０例えば、電話からの メツセージは、一般にアナログ基板に伝送され、アナログ基板はデータをＣＰＵ 基板のＴＳ”エスイッチ７０を介してＤＳＰに送る。ＤＳＰは、８Ｍ基板５０が このデータ処理を行うことができるようになるまで、このデータをＤＲＡＭに供 給する。 ＤＳＰが好適には基本通信ルーチンを具備し、これによってＤＳＰが記憶モジュ ール基板５０からファイルをダウンロードして、これらのファイルを基本プログ ラムとして実行できるようにするという点を除いては、カッドＤＳＰ基板５２の 初期化はディジタル基板４８の場合とと同様にして初期化される。従って、ＤＳ Ｐ２８１乃至２８４は固定的なプログラムではなく、フレキシブルなプログラム によって制御される。このプログラム制御上での融通性によって、ＤＳＰによる サービスの変更はシステム・ハードウェアの変更ではなく、８Ｍ基板５゜のハー ドディスクに記憶されているソフトウェアの変更によって実現可能であるという 利点が得られる。ＤＳＰがロードされた後のマイクロコントローラ２８０の機能 は、一般にカッドＤＳＰアレイ基板５２上のＤＳＰに対してポーリングを行うこ とであり、それらのコマンドをＣＰｔＪ基板５６に伝送することである。また、 マイクロコントローラ２８０は、コマンドをＣＰＵ基板５６がら受信し、これを そのコマンドがアドレス指定しているＤｓｐに対して伝送する。 一般に、ＣＰＵ基板５６とカッドＤＳＰアレイ基板５２上のマイクロコントロー ラ２８０との間で交換されるコマンドは、ディジタル基板４８によって用いられ るコマンドと類似のものである。例えば、マイクロコントローラ２８０を作動さ せて基板のスロット・アドレスを読み取り、そしてＤＳＰへコマンドを送信した り、あるいはＤＳＰからコマンドを受信したりするコマンドが用意サレテいる。 さらに、ＤＳＰをリセットさせるコマンド。 ＨＤＬＣ通信の制御コマンド、および、ｃＰυ基板がらＤＳＰにソフトウェアを ダウンロードするコマンドが用意されている。マイクロコントローラ２８０とＤ ＳＰ２８１乃至２８４との間で交換されるコマンドのいくつかを、表１に示す。 Ｌ　ＤＳＰコマンド・コード ＨＥＸコード　略記　名前 ７　ＳＴＡ　状態 ８　’　ＲＦＣ記録 ９　ＳＰＲ再生／記録　停止 Ａ　ＰＬＡ　再生 Ｄ　ＤＥＬ　消去 Ｅ　ＤＢＵ　ＤＩＲバックアップ Ｆ　ＤＲＤ　ＤＩＲ読み取り １０　ＦＢＵ　ＦＡＴバックアップ １１　ＦＲＤ　ＦＡＴ読み取り １８　ＬＨＤ　ハードドライブファイルをＲＯＭにロード １９　ＷＨＤ　ＤＲＡＭファイルをハードドライブに書き込み 本発明に従えば、２９１乃至２９４のＤＲＡＭは８Ｍ基板５０に音声メソセージ を転送する前に音声メツセージを一時的に記憶するバッファとして機能させ得る 。例えば、音声メツセージあるいはアナログ・ラインを、ＬＮＩＣあるいはアナ ログ基板４４を用いてディジタル信号に変換し、ＰＣＭハイウェイ５７を介して ＣＰＵ基板５６に送信することが可能である。すると、ＣＰＵ基板５６は音声メ ソセージをＣＰＵ基板５６またはカッドＤＳＰアレイ基板５２のＤＳＰにスイッ チ接続する。ＤＳＰは、８Ｍ基板５０へのデータの転送を開始するのに十分な量 のデータが得られるまで、メツセージをＤＲＡＭに記憶することができる。同様 に、８Ｍ基板は、アナログ、ディジタル、または、中継基板への送信を開始する のに十分な量のデータ（すなわち、８０００サンプル／秒の音声）が得られるま で、音声メツセージをＤＳＰを介してＤＲＡＭに送るようにすることができる。 表１を参照する。一般には状態（ＳＴＡ）コマンドは、接続されているＤＲＡＭ のサイズ判定のためにカッドＤＳＰアレイ５２のＤＳＰに送信される。それに従 って、ＤＳＰは、例えばＤＲＡＭのサイズは５１２にバイトであるとか、２Ｍバ イトであるとか、あるいはＤＲＡＭは利用不可であるとかを示す応答コマンドを ＣＰＵ基板５６上のマイクロコンピュータ８０に送る。記録（ＲＦＣ）、再生／ 記録　停止（ＳＰＲ）、再生（ＰＬＡ）、および消去（ＤＥＬ）のコマンドは、 マイクロコンピュータ８０からカッドＤＳＰアレイ基板５２に送信され、例えば アドレス指定されたＤＳＰまたは８Ｍ基板５０のハードディスク対応のＤＲＡＭ のファイルに音声メツセージを記録したり、指定されたチャネルの音声メツセー ジを再生したり、あるいはファイルをＤＲＡＭから消去したりするのに用いられ る。 さらに表１を参照する。ＤＩＲバックアップ（ＤＢＵ）コマンドおよびＦＡＴバ ックアップ（ＦＢＵ）コマンドは、一般に、マイクロコンピュータからＤＳＰ基 板５２に送信され、それぞれディレクトリ・ファイルすなわち８Ｍ基板５０に関 連するＤＯＳディレクト・ファイルの内容を第２のバックアップ・ファイルにコ ピーしたり、ＤＳＰに関連するファイル割り当てテーブル（ＦＡＴ）を第２のバ ックアップ・ファイルコピーしたりするのに用いられる。ＤＳＰは一般にそのフ ァイルの使用に供するためのバッファを有している。ＦＡＴファイルは、どのバ ッファがどのファイルに属するのかを示すデータを所持している。さらに、ＤＩ Ｒ読み取り（ＤＲＤ）コマンドおよびＦ、ＡＴ読み取り（ＦＲＤ）コマンドは、 マイクロコンピュータ８０からＤＳＰに送ることができ、それぞれ５Ｍ基板ディ レクトリあるいはＤＳＰ　ＦＡＴファイルの読み取りを行うのに用いられる。ハ ードディスクのＤＲＡＭへのロード（ＬＨＤ）コマンド、およびＤＲＡＭファイ ルのハードドライブへの書き込み（ＷＨＤ）コマンドはマイクロコンピュータ８ ０からＤＳＰに送られ、ＤＳＰと８Ｍ基板５０との間での読み取りおよび書き込 みを実行するのに用いられる。 ＩＸ、システム・コマンド システム・コマンドのフォーマットを図１８に示す。 一般にコマンドは専用ＰＣＭハイウェイ５９によりデータのパケットに内包され て送られる。１つのコマンド・パケットは、最小の場合で３バイトデータ、最大 の場合で１９バイトからなる。一般にコマンド・パケットはそのパケットの最初 に２つのアドレス・バイトを有している。第１のアドレス・バイト３００は、ス ロット・アドレスであり、このコマンドを含むパケットが指定されたスロット・ アドレスを有する基板によって受信されたときに、このスロット・アドレスはＨ ＤＬＣプロトコーラによってそのコマンドから分離される。スロット・アドレス は、基板リセット初期化のときに基板のＨＤＬＣブＯトコーラにロードされる。 第２のバイト３０２はラインあるいはポートのアドレスである。第３のバイト３ ０４は、コマンドの演算コードである。残りのバイト３０６からＩＩ　Ｑ　ＩＩ はオペランドである。コマンド・パケットに対する応答のフォーマットも同様な ものである。応答パケットは一般にスロット・アドレス・バイトおよび応答を発 した基板に対応するボート・アドレス・バイト、および、コマンドの演算コード とオペランド・バイトを備える。 さらに図１８を参照する。コマンドおよびパケットの第２のアドレス・バイト３ ０２は一般にコマンド・フィールド３０４およびデータ・フィールド３０６のデ ータを含む残りのコマンド信号とともに指定されたそれぞれのラインに転送され る。パケットのサイズあるいはビット数に関連するデータ・フィールド３０８が 用意される。 サイズ・フィールド３０８は、一般に、ＨＤＬＣＰＣＭハイウェイ５９を通して 送信されるのではなく、ＨＤＬＣプロトコーラのＣＰＵ低レベル・ソフトウェア ・ドライバからのパケット・データとともに供給されるものであり、パケット処 理中にＣＰＵ基板に送信され、あるいはＣＰＵ基板によって受信されようとして いるバイト数を数え上げる。サイズ・バイト３０８は、ＣＰＵ基板のＨＤＬＣプ ロトコーラから周辺基板に送信される前に低レベルドライバによってパケットか ら切り離される。 図１９に示すように、２５６のアウトバウンド・コマンドすなわちシステムＣＰ Ｕ８０から周辺基板に対して送信されるコマンドと、また、およそ２５６のイン バウンド・コマンド（すなわち、周辺基板からシステムＣＰＵ基板５６に向けて 送られるコマンド）とがある、これらのコマンドはＥＰＲＯＭ８８　（図８）に 記憶されるが。 好適には、いろいろな周辺機能ごとに割り当てられたメモリのブロックに記憶さ れる０図１９に示したメモリのブロックはアウトバウンド・コマンドとインバウ ンド。 コマンドの両方に対応するものである１例えば、メモリ・ブロック３１０は、ア ナログ基板４４および中継基板４６（図３）用のインバウンド・コマンドあるい はアウトバウンド・コマンドを含むことができる。メモリ・ブロック３１２，３ １４．３２２は、それぞれ、ディジタル基板４８、ＤＳＰ基板５２、および記憶 モジュール基板５０用のインバウンド・コマンドあるいはアウトバウンド・コマ ンドのために設けられる。メモリ・ブロック３２４はすべての周辺基板に共通な コマンドからなり、また、メモリ・ブロック３１８および３２９は将来の用途の ために予約されている。 表２および表３は、それぞれ、いくつかの共通コマンドのリストであり、その種 類に関係なく任意の周辺基板にアウトバウンド・コマンドおよびインバウンド・ コマンドとして送信され得る。 表２　アウトバウンド　通コマンド・コードＨＥＸＩ−ド　！ｌｌ　％　各−■ Ｑ　Ｑ　Ｎ　Ｕ　Ｌ　Ｌ ｏｌ　ＳＡＩ　スレーブ動作 ０２　ＮＡＫ　否定応答 ０３　ＢＮｏ　通常動作開始 ０４　ＴＤＵ　時刻７日付更新 ０５　ＥＰＤ　緊急パワー・ダウン 表２　アウトバウンド　゛コマンド・コ−１ｉ（続き）ＨＥＸコード　整量　名 　前 ０６　ＲＭＲマイクロコントローラ・ レジスタ読み取り ０７　ＷＭＲマイクロコントローラ・ レジスタ書き込み ０８　ＳＣＨＰＣＭチャネル選択 ０９　ＲＷＴ　ウォッチドッグ・タイマのリセット ＯＡ　ＶＥＲバージョン番号 ○Ｂ　ＲＢＤ　基板をリセット 紅　インバウンド　゛コマンド°コードＨＥＸコード　整量　査−肛 ＱＱ　ＮＵＬＬ ０１　ＰＡＫ　肯定応答 ０２　ＮＡＫ　否定応答 ０３　ＲＴＳ　開始準備終了 ０４　ＭＲＤ　マイクロコントローラ・レジスタ・データ ０５　ＶＥＲバージョン番号 ０６　ＣＥＲコマンド・エラー スレーブ動作問い合わせ（ＳＡＩ）コマンドはＣＰＵ基板５６上のマイクロコン ピュータ８０が、周辺基板とのスレーブ・マイクロコントローラのＨＤＬＣバス ５６へのアクセスを許可するのに用いられる。否定応答（ＮＡＫ）コマンドは、 マイクロコントローラ８ｏが受け取ったパケットが不良であることを周辺基板に 知らせるために送られるものである１通常動作開始（ＢＮｏ）コマンドは、パワ ー・アップ・リセットあるいはその他のリセット状態の後に、マイクロコンピュ ータ８ｏがら周辺基板のマイクロコントローラに通常動作を開始するように命じ るために送られるものである。ＳＡＩコマンドは。 ＨＤＬＣがそれを受信している周辺基板に対してアクセスするのを許可するため に、マイクロコンピュータ８゜から周期的に送られる。ＳＡＩコマンドは一般に 受信基板部分に対して何のアクションをも要求せず、単にその基板がＨＤＬＣリ ンク５９への送信を行うのを許可するだけである。ＮＡＫコマンドは、ＣＰＵ基 板５６で受信した最後のパケットが異常であり、従って送信周辺基板から再送信 される必要があることを知らせるものである。 マイクロコンピュータ８０がＮＡＫコマンドを送信するのは典型的には以下のよ うな場合である、すなわち、フレーム制御同期（ＦＣ３）ビットが不良なパケッ トがＨＤＬＣインターフェース９４（図７）からアンロードされたとき、無効な パケットすなわち不当なフォーマットを有するパケットが受信されたとき、ある いは、ＨＤＬＣインターフェースのレシーバが満杯である場合である。 ＢＮＯコマンドは、一般に周辺基板の初期化処理の最後の部分においてマイクロ コンピュータ８ｏがら送信される。ＢＮＯコマンドは、受信周辺基板がライン・ スキャニング、ＨＤＬＣアクセス、あるいは休止モード中の処理を含む通常動作 の活性化を行う。 さらに、アウトバウンド共通コマンドとして以下のようなものがる。すなわち、 適用可能周辺装置上のリアルタイム・クロック更新用のマイクロコンピュータ８ ｏがら１分ごとに送信される一斉通信信号である時刻／日付更新（ＴＤＵ）コマ ンド、およびシステム電力を保持しバッテリによるバックアップ動作中のシステ ム動作時間の延長を図るために電力損傷発生状況中パワー・ダウン・モードに入 るようにマイクロコンピュータ８ｏがら個々の基板および周辺装置に通知するた めに送られる緊急パワーダウン（ＥＰＤ）コマンドである。マイクロコントロー ラ・レジスタ読み取り（ＲＭＲ）コマンド、およびマイクロコントローラ・レジ スタ書き込み（ＷＭＲ）コマンドは、マイクロコンピュータ８０が周辺基板のマ イクロコントローラからの読み取りあるいはこれへの書き込みを行うのを可能と するのに用いられる。ＰＣＭチャネルｉ択（ＳＣＨ）コマンドは、マイクロコン トローラ８０によって用いられ１周辺基板にどのＰＣＭハイウェイをそのＢチャ ネル情報のために選択すべきかを指示する。ウォッチドッグ・タイマ・リセット （ＲＷＴ）コマンドは、マイクロコンピュータ８ｏが、パケット中のコマンド・ バイトの次の４データ・バイトによって指定される周辺基板に対し、そのウォッ チドッグ・タイマをリセッ１〜するように命じるために用いられる。バージョン 番号（ＶＥＲ）コマンドは１周辺基板に質問を行い、その基板のバージョン番号 と種別番号を取得するのに用いられる。基板リセット（ＲＢＤ）コマンドはマイ クロコンピュータ８０が周辺基板にソフトウェア・リセットを行うように命じる のに用いられる。ＴＤＵコマンドは。 す尺での周辺基板に対して送られるグローバルなコマンドであるが、しかし、一 般的には中継基板、アナログ基板、および内部直通ダイアリング（Ｄ　Ｉ　Ｄ） 基板はこのコマンドを無視する６周辺基板は、ＴＤＵコマンドに対しては応答を 送信しない。ＦＤＰコマンドは、すべての基板あるいはいくつかの指定された個 々のラインをパワー・ダウンするのに用いることができる。ＲＭＲコマンドは、 一般に、指定されたレジスタの内容には影響を与えない、ＷＭＲコマンドは、指 定されたメモリ；レジスタへの無条件書き込みを行うものであり、周辺基板の応 答を必要としない。ＶＥＲコマンドに関しては、基板のバージョン番号によって その基板のＲＯＭに記憶されている基板の種類とハードウェア／ソフトウェアの バージョンが鑑定される。例えば、アナログ基板は、内部直通ダイアリング（Ｄ ＩＤ）基板、あるいはループ開始（ＬＳ）あるいはグラウンド開始（ＧＳ）動作 用に構成された基板などのいくつがあるバージョンの１つとして実現される。そ の他の周辺基板もいろいろなバージョンで実現することが可能である。初期化に おいて、各周辺基板はＶＥＲコマンドに応答してバージョンと基板の種類に関す るデータをＣＰＵ基板に送り、マイクロコンピュータ８０は構成ファイルから読 み取ったデータで確認を行う６アウトバウンドＶＥＲコマンドに対する周辺基板 の応答は、要求されたデータを伴ったインバウンドＶＥＲコマンド（以下で説明 ）である。 インバウンド・コマンドの例の１つとして、肯定応答（ＰＡＫ）コマンドがあり 、これは、スレーブ動作問い合わせを含んでいるパケットを除いて、受信された すべての妥当なパケットに応答して周辺基板から送られるもので、有効なパケッ トが受信されたことを知らせ、ハンドシェーキングを履行するために用いられる 。さらに、否定応答（ＮＡＫ）コマンドは、不良パケット（すなわち不良ＦＣＳ ビットあるいは不当なフォーマットを有するパケット）が受信されたことを知ら せるために周辺基板からマイクロコンピュータ８ｏに対して送られる。開始準備 終了（ＲＴＳ）コマンドは、周辺基板からマイクロコンピュータ８０に対して送 られ、その基板がリセット初期化を終了し、システムによる初期化の準備が整っ たことを知らせるためのものである。マイクロコントローラ・レジスタ・データ （ＲＭＤ）コマンドは、マイクロコンピュータ８０から送られたマイクロコント ローラ・レジスタ・データ読み取りコマンドに対する周辺基板のデータ応答を含 んでいる。バージョン番号（ＶＥＲ）コマンドは、マイクロコンピュータ８０か らのバージョン番号の問い合わせに対する周辺基板の応答である。コマンド・エ ラー（ＣＥＲ）コマンドは、マイクロコンピュータ８０から受信したコマンドが 不当であったときに送られる。ＰＡＫコマンドは、一般に、ＣＰＵ基板から最後 に受信したコマンドが受け入れ可能なものであったことを示すためのもので、こ れに対して何等のメツセージも送る必要はない、ＮＡＫコマンドは上記のアウト バウンドＮＡＫコマンドと類似のものであり、一般に、不良なＦＣＳビットを有 するパケットがその基板上のＨＤＬＣプロトコーラのレシーバからアンロードさ れたとき、または、不適当にフォーマットされたかあるいは不当なパケットが受 信されたとき、または、１（ＤＬＣレシーノくが満杯でありメツセージの再送が 必要なときに送られる。 ＮＡＫコマンドに対して予想される応答は、ＮＡＫコマンドを受信した基板が最 後に送ったコマンドの再送信である。ＣＥＲコマンドあるいはメソセージは、送 信を行う周辺基板が不当なコマンドを受信したときにＣＰＵ基板に対して送られ るもので、すなわち、その受信したコマンドが妥当なＦＣＳビットと妥当なスロ ット・アドレスとを有しているものの１、例えば、ポート・アドレス、コマンド 値、データ値、あるいはデータ長が不当であるときに送られる。ＣＥＲコマンド は、一般に、ボート・アドレスおよび受信された不当なコマンドの値とともに返 送される。 表４および表５は、グローバルなコマンドではなく。 特定の周辺機能に関して用いられるいくつかのインバウンドおよびアウトバウン ド・コマンドを示したものである。 １０　ＲＣＲＣ０ＤＥＣレジスタ読み取り１１　ＷＣＲＣ０ＤＥＣレジスタ書き 込み１２　ＲＰＨ電話呼び出し信号発信 １４　ＷＴＣ中継制御書き込み １５　ＤＤＧ　番号をダイアル １６　ＳＺＴ　中継ライン占有 １７　ＲＬＴ　中堅ライン解放 １８　ＣＮＴ　中継ライン接続 １９　ＨＫＦ　フック・フラッシュ ２０　ＣＤＤ　文字表示日付 ２１　ＩＫＣ不当なキー・クローズ ２２　ＲＰＨ電話呼び出し信号発信 ２３　ＣＤＤ　ＬＥＤ表示日付 ２４　ＳＹＮ　同期確認 ２７　ＤＤＩ　ＤＴＭＦダイアル ３１　ＩＫＣ不当なキー・クローズ ３２　ＤＤＲデータ・レジスタ表示 ３５　ＲＤＰ　Ｄ−電話呼び出し信号発信３６　ＳＤＴ　ＤＴＭＦ送信 ３９　ＭＯＰ　アウトバウンド・パケットの３Ａ　ＬＤＣＬＥＤ表示制御 １０　ＣＲＤ　Ｃ０ＤＥＣレジスタ・データ１１　０ＨＨオン・フック １２　０ＦＨオフ・フック １３　ＨＫＦ　フック・フラッシュ １４　ＤＧＣ番号捕集 １５　ＲＴＤ　リング・トリップ検出 １６　ＧＫＤ　グラウンド・キー検出 １７　ＤＧＥ　番号エラー １８　ＤＩＰ　取扱中番号 ＩＡ　ＴＬＳ　中継ライン状態 ＩＢ　ＴＳＤ　中継ライン占有検出 ＩＣＤＢＥ　番号バッファ空き ２０　ＫＣＤ　キー・クローズ検出 ２１　ＯＮＨオン・フック ２２　０ＦＨオフ・フック ２３　ＲＴＤ　リング・トリップ検出 ２４　３ＮＵ　同期確認 ２５　ＳＮＵ　シーケンス番号更新 表４を参照する。Ｃ０ＤＥＣレジスタ読み取り（ＲＣＲ）コマンドは、マイクロ コンピュータ８０から送られ、指定されたアナログ基板あるい中継基板のマイク ロコントローラに選択されたＣ０ＤＥＣレジスタからの読み取り動作を実行する ように指示するのに用いられる。Ｃ０ＤＥＣ書き込み（ＷＣＲ）コマンドは、マ イクロコンピュータ８０から送信され、指定されたアナログ基板あるい中継基板 のマイクロコントローラに選択されたＧＯＤＥＣレジスタへの書き込み動作を実 行するように指示するのに用いられるゆＲＣＲコマンドと異なり、ＷＣＲコマン ドは、対象のＣ０ＤＥＣのパワー・アップ／パワー・ダウンの状態に影響を及ぼ す、さらに、書き込み動作は選択されたＣ０ＤＥＣレジスタの内容を変化させる が。 しかし、アナログ基板あるいは中継基板のマイクロコントローラの状態レジスタ には影響を与えない。電話呼び出し信号発信（ＲＰＨ）コマンドは、マイクロコ ンピュータ８０から送信され、アナログ基板または中継基板のマイクロコントロ ーラに指定されたラインに指定された呼び出し信号パターンの呼び出し信号を発 信するように指示するのに用いられる６ さらに表４を参照する。中継制御書き込み（ｗ’ｒｃ）コマンドは１選択された 中継基板に選択されたラインの中継インターフェース制御ラッチに直接書き込み を行うように指示するためのものである。一般にデータはライン・スキャニング ・プログラム・データを更新することなしに直ちに書き込まれる。中継ライン占 有（ＳＺＴ）コマンドは、指定された中継基板に対して、中継基板のマイクロコ ントローラのＬＳＧＳレジスタに示された中継ラインの種類（すなわちループ開 始、あるいはグラウンド開始）に応じて、選択された中継ラインの占有を試みる ように指示するものである。もし、選択されたラインがすでに占有されている場 合には、中継基板はＣＥＲコマンドで応答する０選択されたラインが呼び出し信 号の発信を始めると、指定された中継基板は中継ライン占有検出（ＴＳＤ）コマ ンド（以下に説明）を送信して、電話局の呼び出し信号をＬＳラインに検出した ことを示す１選択されたラインが指定された中継基板によって占有されると、中 継ライン状態（Ｔ　Ｌ　Ｓ　）コマンド（以下に説明）が送られて占有が成功し たことが示される。ＬＳ中継ラインに対しては、本当にＰＢＸが占有を開始した かどうかを検証するためにダイアル・トーン検出あるいはカット・スルーが要求 される。ＧＳラインに対しては、ハンドシェーキング・シーケンスが正しく終了 した後にＴＬＳコマンドが送られる。中堅ライン解放（ＲＬＴ）コマンドは、マ イクロコンピュータ８０から選択された中継基板に対して指示された中継ライン を解放する。 すなわちハング・アップするように指示するために送られる。このコマンドによ って、指定された基板はループを開放させ１通常のバイアス電圧に戻る。Ｃ０Ｄ ＥＣは。 不活性化されて、待機状態となされる。中継ライン接続（ＣＮＴ）コマンドは、 マイクロコンピュータ８０から指定された中継基板に対して送られ１選択された ラインの音声を接続し、Ｃ０ＤＥＣを活性化するように指示する。ＣＮＴコマン ドは、一般に、ＣＯ占有に応答して。 すなわち、中継基板からのＴＳＤコマンドに応答して送られるか、あるいは、Ｐ ＢＸ占有接続を完了するために。 すなわち、中継基板からのＴＬＳコマンドに応答して送られるものである。Ｃ０ ＤＥＣがすでに動作状態となっている場合には、このコマンドは無視される。そ のラインが占有されていないか、あるいは呼び出し信号が発信されていない場合 には、ＣＥＲコマンドはリターンされる。ＣＯ占有に対しては＋　ＣＮＴコマン ドは、中継基板に対してループを形成して音声ラインを接続する（すなわち、Ｃ ０ＤＥＣをイネーブルとする）ように指示する。 ＰＢＸ占有に対しては、ＣＮＴコマンドは、中継基板に対して音声ラインを接続 するように指示する。ＬＳラインにおいては、ＣＮＴコマンドによって、カット ・スルーあるいはダイアル・トーンのトーン・デコーダ検出が行われ、接続の検 証がなされる。ＧＳラインの場合では、接続の検証は、ＴＬＳがＣＰＵ基板に送 られる以前に中継基板によってすでに行われている。フック・フラッシュ（ＨＦ Ｋ）コマンドは、中継基板に対してフック・フラッシュを選択されたラインに送 るように指示する。フック・フラッシュ時間は、中継基板のマイクロコントロー ラのデータＲＡＭに記憶されている変数によって決定され、これは、ＣＰＵ基板 メモリに記憶されている値を用いて変更することが可能である。ＨＫＦコマンド は、ラインがアクティブとなっているときだけ有効である。 もしラインがアクティブでなければ、ＣＥＲコマンドがＣＰＵ基板に対して送ら れる。 表５を参照する。Ｃ０ＤＥＣレジスタ・データ（ＣＲＤ）コマンドは、ＲＣＲコ マンドに応答して、アナログ基板または中継基板のマイクロコントローラからＣ ＰＵ基板に対して送られるものであるにの応答には、ＲＣＲコマンドによって要 求されたデータと問い合わせを受けたアドレス・バイトが含まれる。オン・フッ ク（ＯＮＨ）コマンドは、マイクロコンピュータ８０に対して指定されたアナロ グ・ラインが現在オン・フックとなっていることを示すためのものである。ＯＮ Ｈコマンドは。 ラインがオフ・フック状態からオン・フック状態になったときにおよそ１．３秒 間送られる。オフ・フック（ＯＦｌ　コマンドは、アナログ基板のマイクロコン トローラからマイクロコンピュータ８０に対して指定されたラインが現在オフ・ フック状態であることを示すために送られる。フック・フラッシュ（ＨＫＦ）コ マンドは、一般に、アナログ基板からＣＰＵ基板に対して、特定のラインのフッ ク・フラッシュが終了したことを示すために送られる。番号捕集（ＤＧＣ）コマ ンドは、一般に、アナログ基板から送信され、選択されたラインに対して捕集さ れた１つの番号を含んでいる。それぞれの基板は。 ３つまでの番号をバッファすることが可能である。番号の数が３を越えた場合に は１番号エラー（ＤＧＥ）が検出されて、これがＣ，ＰＵ基板に送られる。リン グ・トリップ検出（ＲＴＤ）コマンドは、アナログ基板から送られ、選択された ラインのリング・トリップが実行が終了したこと、５ＬＩＣがアクティブ状態と なっていること、およびＧＯＤＥＣに電力増幅器がパワー・ダウンしていること を示すためのものである。ＲＴＤが選択されたラインに対して送られた後にリン グ・オフ・コマンドが受信されると、そのラインは非活性化される。グラウンド ・キー検出（ＧＫＤ）コマンドは１周辺基板から送信され。 選択されたアナログ・ライン上にグラウンド・キー動作が検出されたことを示す ためのものである。番号エラー（ＤＧＥ）コマンドは、不当な番号パターンがア ナログ基板に検出されたことをＣＰＵ基板に伝えるためのものである。例えば、 ＤＧＥ信号は、不当なメーク／ブレーク比率が検出された場合、番号間の最小間 隔を満たしていない場合１番号カウンタのカウントが１１を越えている場合、あ るいは番号捕集バッファがオーバフローを起こした場合にＣＰＵ基板に対して送 信される。ＤＧＥコマンドに対する一般的な応答は話中音である。さらに表５を 参照する。中継ライン状態（ＴＬＳ）コマンドは。 ＣＰＵ基板に対して選択された中継インターフェースの現在の状態を伝えるため のものである。ＴＬＳコマンドは、一般に、ＳＺＴコマンドに応答して中継ライ ンを更新し、占有状態を示すために送られる。ＴＬＳコマンドは、ＧＯが指定さ れたラインへの呼び出し信号を停止したとき、あるいはｃｏがラインを解放した とき、あるいはラインがオーブン状態あるいは、逆電流が存在しているときにＣ ＰｔＪ基板に対して送られる。 Ｘ、システム　作 図２０のフロー・チャートを参照する。ブロック３２８および３３０に示すよう に、中間レベルのソフトウェアはＣＰＵ基板のマイクロコンピュータ８０を制御 して、ＣＰＵ基板に接続された周辺基板を初期化し、構成ファイルをロードする 。ＣＰＵ基板が動作しているとき、マイクロコンピュータ８０は、ブロック３３ ４に示すように、ＨＤ　Ｌ　Ｃプロトコーラの受信ＦＩＦＯチェックを行ってコ マンド・パケットが受信されているかどうかの判定を行う、主ＦＩＦＯ（すなわ ち、ＣＰＵ基板の送信および受信Ｆ　Ｉ　ＦＯ）は、低レベルＣＰＵソフトウェ アに従ってコマンド・パケットの送受信を行うが、一般に、この動作は、パケッ トがＨＤ　Ｌ　Ｃ符号化ＰＣＭハイウェイ５９に到着次第パケットを受信ＦＩＦ Ｏに配置するようになされる。中間レベルＣＰＵ基板ソフトウェアは、中間レベ ル・プログラムによって指定されたときにＦＩＦＯのパケットの処理を行う、パ ケット処理を行うために、中間レベル・コードはマイクロコンピュータ８０を制 御して、コマンド・バイトの読み取りをまず最初に行う、もし、そのコマンド・ バイトが指定しているコマンドが低レベルあるいは中間レベルのコマンドである 場合には、そのパケットはそのコマンドに従って処理が行われる１判定ブロック ３３４の否定分岐に示すように、さらに続けてマイクロコンピュータは受信され たパケットを探す、もし、コマンドが特別な低レベルあるいは中間レベルのコマ ンドでなければ、中間レベル・コードは。 マイクロコンピュータ８０を制御して、コマンド中のスロット・アドレス・バイ トを読み取り、また、そのスロット・アドレスに対応する適当な構成データを読 み出す。 このスロット・アドレスによって、マイクロコンピュータ８０は中間レベル・コ ードに従って、ブロック３３８に示すように、どのマネージャが受信したパケッ トを処理するために呼び出されようとしているのかを判定する。 もし、スロット・アドレスがシステムの１つのラック当たりに許される最大スロ ット数よりも大きい場合には。 マイクロコンピュータ８０は、そのパケットを解析して例えばパケットがＤＳＰ 装置からのものであるのかどうか判定する。スロット・アドレスが判定され、ま た、マイクロコンピュータ８０によってパケットがどこから来たものであるかが 判定されると、マイクロコンピュータ８０は、そのコマンド・バイトに基づいて どのマネージャを呼び出すべきかを知ることができる。 判定ブロック３４０に示すように、パケットの受信に応じてマネージャが呼び出 される前に、グローバル・コマンド・バッファ（ＧＣＢ）の第１の位置がＩＮＣ ＯＭＩＮＧ（インカミング）と呼ばれるあらかじめ定められた値にセットされる 。これは、呼び出されたマネージャに対して、高レベル言語プログラムからのＧ ＣＢデータではなく入力されたパケットを処理するのだと知らせるものである。 次いで、マネージャは高レベル言語プログラムが処理することが可能なようにデ ータをＧＣＢにセットアツプすることによってパケットの処理を行う。このとき に、インタープリタ−が処理を開始すべきポート番号がＧＣＢの第２の位置にセ ットされる。もし、マネージャがＧＣＢの第１の位置にゼロを配置している場合 には、ブロック３４０の否定分岐に示すようにインタープリタ−を呼び出すこと なしに、マネージャはパケット処理を行う。パケットがインタープリタ−による 処理を必要とする場合には、対応する高レベル・コードの処理はそのコード中に Ｃ［Ｗ＝？？？］コマンドが現れるまで行われる。待機コマンドは、マイクロコ ンピュータ８０が入力されるＦＩＦＯチェックを再び行うことができるように制 御を解放する。 Ｘ工、ディジタル電工 ディジタル電話（Ｄ−電話）３５４は、ディジタル電話特有のサービスを提供す るだけでなく、従来のアナログ電話と同様の多くのサービスを提供する遠隔周辺 装置である。さらに１本発明のディジタル電話は、オペレータ・コンソール機能 などの、アナログ電話あるいは多くの既存のディジタル電話の設計にはない優れ たその他の特徴を有する。図２１に示されているように、ディジタル電話はマイ クロコントローラ３５６すなわちインテルのマイクロプロセッサ８０Ｃ５１を有 する。ＨＤＬＣプＯト：］−ラ３５８は、−１ｒ−ボード３６ｏ、ＬＥＤアレイ ３６２、Ｌ　ＣＤ　、３６４　、加入者ネットワーク・インターフェース回路（ ＳＮＩＣ）３６６、電話Ｃ０ＤＥＣ３６８、端末アダプタ・インターフェース３ ７０、スタティックＲＡＭ　（ＳＲＡＭ）３７２．およびプログラマブルＩ１０ 装置３７４（７）制御を行う。Ｃ０ＤＥＣ３６８は、トーン発生器、送受話器、 およびスピーカホーン・インターフェースを備える。マイクロコントローラ３５ ６は。 Ｃ０ＤＥＣとともに呼び出し信号の発信、トランスデユーサ作動、音量、ＤＴＭ Ｆ発生、ボート制御を行う、ＳＲＡＭ３７２は、マイクロコントローラ３５６の ための２にバイトの記憶装置として働く。 ディジタル電話３５４の音声処理は、アナログ方式の電話における場合と同様の ものであり、単一のキーを閉じることでスピーカホーンの機能を利用することが 可能にされている。キーボード３６０上に転送、保留、会議、メツセージ、およ びメモリ・アクセスのための専用キーが設けられている。また、高速ダイアルの ためのキーがパンク状にキーボード上に設けられている。キーはユーザによって その他の専用機能のためにプログラムすることが可能である。好適には、６つの キーが直通ライン・アクセスのために専用に割り当てられる。また、標準的な１ ２のキーを有するキー電話方式の電話キー・パッドが具備されている。 プログラマブルＩ１０装置３７４は、マイクロコントローラ３５６がキーボード ・スキャニングおよびＬＥＤ駆動のためにアクセスすることが可能な２４の入出 カラインを有している。これらの２つの動作は好適には同じＩ１０ラインを用い て行われ、マイクロコントローラ３５６によってソフトウェア的なマルチプレッ クスが行われる。トランジスタ・ドライバはソフトウェアによって履行されるパ ルス駆動方式で１２８個までのＬＣＤ３６４を駆動する。ラインは、キーボード の１２８個のキーをスキャンするために交互に用いられる。マイクロコントロー ラ３５６はソフトウェアによってスキャニング、チャツタリング防止、キー確認 の制御を行い、すべての応用に対応できる融通性を備えている。ＬＣＤ３６４は 。 Ｉ１０パラレル・ポートを介して制御される。これは。 好適には、２ライン×２０文字の表示装置である。マイクロコントローラ３５６ は、システムからの表示情報をバッファして、この情報をＬＣＤ３６４に供給す る。ＬＣＤの情報は一般に、ダイアルされた番号、呼び出し者の番号、電話の種 類、ヘルプ画面、メツセージ情報、および日付と時刻とを備える。ＬＥＤ表示装 置は、ユーザに対してライン状態（すなわちラインに呼び出し信号が発信されて いるかどうか、アクティブであるかどうか。 あるいは保留されているかどうかなど）と、動作態様に関するデータとを提供す る。 ５ＮＩＣ３６６はディジタル電話３５４とラックのＣＰＵ基板５６との間の物理 的な接続を提供するものである。この接続は、好適には、ｌｋｍまでの２点間接 続を行うことが可能な４線ｌ５ＤＮに準じたＳ−バス・インターフェースである 。システムのハードウェアは、ｌ５ＤＮ互換装置としてのディジタル電話を実現 するためのソフトウェアの変更が可能なように設計されている。Ｓ−バス・イン ターフェースは、２つの６４にバイト７秒のＢ−チャネルおよび１つの１６にビ ット／秒のＤ−チャネルの送信に供することができる。好適には、１つのＢ−チ ャネルが音声のために用いられ、一方、その他のＢ−チャネルはデータのために 用いられる。Ｄ−チャネルはディジタル電話をディジタル基板にインターフェー スさせるためのフレーミング、クロッキング、およびリンク動作情報を備える。 端末アダプタ（ＴＡ）インターフェース３７０はＣＣＩＴＴ−Ｖ標準あるいはＣ ＣＩＴＴ−Ｘ標準の端末シリアルポートとシステムへのＳ−バス・インターフェ ースとの間の完全な端末インターフェースとして動作可能であり１例えば、Ｖ、 ２４．Ｘ、２１、Ｘ、２０端末のサポートができるようになっている。また、シ ステム・インターフェースは、Ｖ、１ｌＯ１Ｖ、１１０内蔵ＨＤＬＣ１あるいは Ｖ、１２０フレーム・フォーマットをサポートすることもでき、また、限定され たチャネルに対して５６にビット／秒のレートの出力信号を発生することが可能 である。マイクロコントローラ３５６は、動作パラメータをセット・アップして データの流れをモニタし、これを用いて呼びを制御することが可能である。Ｖ、 　１２０フオーマツトに対しては、マイクロコントローラ３５６は、データの流 れをリアルタイムで処理して、Ｂ　−チャネル上に送るために用いられる。Ｆｏ ｒＶ、ＩＴＡインターフェース３７０によってデータは端末ボートから■ＳＤＮ のＢ−チャネルに変換される。この変換は、いろいろなフォーマットのサポート が可能である。また、ＴＡは、データ接続のための呼びのセントアップと破棄処 理を実行する。本発明のＴＡインターフェースは、好適には、直接にディジタル 電話に集積されている。端末への物理的な接続は、好適には、適当なインターフ ェース電圧を提供するＲ５−２３２レベルのインターフェース装置が用いられる 。 ＴＡインターフェース３７０の基本的な機能は、レートの適合である。これは、 いろいろなデータ・レートおよびフォーマットを端末インターフェースで処理し て、これらをシステム・インターフェースにおいてＢ−チャネルに変換すること からなっている。この変換は、ビットの適合、ストップ・キャラクタの挿入と除 去、非同期式から同期式への変換とフレーミングを含み得る。ＴＡインターフェ ース３７０と端末との間のデータ・レートは、同期式にも非同期式にもでき、３ ００ビット／秒から６３にビット／秒の範囲のレートを用いることが可能である 。ＴＡインターフェース３７０は、データ・ストリームに埋め込んだ接続制御キ ャラクタを有するようにできる。サポートされる端末インターフェースの種類と しては、■、２４、Ｘ、２０およびＸ、２１が含まれる。 ＴＡインターフェース３７０はサポートされる任意の種類の処理が可能なように プログラムされる。 ＴＡインターフェース３７０はディジタル電話と端末自身の両方における呼びの セットアツプと破棄とのサポートを行う。呼びの接続情報は、ディジタル電話か らシステムへＳ−バス・インターフェースのＤ−チャネルを介して送られる。 本発明のディジタル電話は、高品質ディジタル通信の設計が用いられ、私設通信 システムでは一般的には利用不可能なサービスがユーザに提供される。すでに述 べたように、ディジタル電話は、オペレータ・コンソールとキー電話の両方の機 能を有し、鮮明で高信頼性のディジタル通信を用いてシステム１０の他の装置と の通信を行う。１線２重送電供給がなされるので、ＡＣ接続あるいはバッテリ接 続の必要はない。オン・ボード・マイクロプロセッサ３５６によってディジタル 電話は自由にダウンロードできる機能が提供され、従って、システム構成を変更 することが可能である。 ＸＩ　１．スイッチ先板 すでに述べたように１本発明の電気通信システム１０は、一般にＰＢＸとして動 作する。システム１０は、好適には、基板、ラック、およびキャビネットの３つ の階層レベルのハードウェアで構成される。すでに述べたように１個々の基板は 、ラック中に挿入され、各ラックは好適には１９２ボートをサポートする。キャ ビネットは好適には８つまでのラックを含む、全システムは１例えば、１つのラ ックからなる１つのキャビネット、あるいは各キャビネットが８つのラックを有 する２つのキャビネットで構成することができる。各ラックは、ＣＰＵ基板を具 備し、これによってそのラック内のすべての基板の制御が行われる。ＣＰＵ基板 はそのラック内の基板とＨＤ　Ｌ　ＣＰ　ＣＭハイウェイ５９を介して通信する 。もし、システムにさらに他のラックが存在する場合には、各ラックに少なくと も１つのスイッチ基板が備えられている必要がある。システムが２つのキャビネ ットを有している場合には、各ラックは２つのスイッチ基板を具備している必要 がある。スイッチ基板は、異なるラックのＣＰＵ基板間の通信の媒介を行う。 図２２に示すように、スイッチ基板３７８あるいは２つのキャビネットシステム のスイッチ基板対は、一般に、３つの主要な機能を実行する。第１に、スイッチ 基板３７８は、１つのラックの任意のボートからのディジタル信号（音声あるい はデータ）を他のラックの任意のボートに接続する。第２に、スイッチ基板は、 ラックの間の制御用通信の媒介を行う、第３に、スイッチ基板は、システムのす べてのディジタル構成要素に同期信号を提供する。 スイッチ基板は、１つのラックの任意のボートからのディジタル信号を他のラッ クの任意のボートに、好適には６つのディジタル時間／空間クロスポイント・ス イッチからなるスイッチ・アレイ３８０を用いて接続する。 アレイのスイッチ入力はキャビネット内の他のラックの出力（ボートに関し７て の）ＰＣＭハイウェイにマルチワイヤ・ケーブル３８１を介して物理的に接続さ れている。 アレイ３８０のスイッチの出力は、スイッチ基板のラックの入力（ボートに関し ての）入力ＰＣＭハイウェイに接続されている。このようにすることによって、 任意のラックからの任意のＰＣＭハイウェイ上の任意のタイム・スロットをその スイッチ基板のラック内の任意のＰＣＭハイウェイ上の任意のタイム・スロット に接続することが可能となる。タイム・スロットとＰＣＭハイウェイの組み合わ せに割り当てられたボートはこのようにしてラック間の音声通信あるいはデータ 通信のために接続される。別々のキャビネットの２つのラック間の通信に対して は、ラック内の第２の（すなわちスレーブの）スイッチ基板が用いられる。この スレーブ・スイッチ基板は他のキャビネットのすにでのラックのＰ、ＣＭハイウ ェイに接続される。スレーブ・スイッチ基板と他のキャビネット内のラックとの 物理的な接続は、マスター・スイッチ基板と同じキャビネット内のラックとの物 理的接続と本質的に同じである。好適にはスレーブ・スイッチ基板はアークネッ ト・ネットワーク３８２を介してマスター（すなわち第１の）スイッチ基板によ って制御される。 ラック間の制御通信は、スイッチ基板のＶ４０ベースのオン・ボード・マイクロ コンピュータ３８４およびＨＤＬＣ符号化ＰＣＭハイウェイ５９を介してのラッ クのＣＰＵ基板５６と通信するＨＤＬＣプロトコーラ３８６によって、またＡＲ ＣＮＥＴ　（アークネット）ネットワーク３８２を介しての他のスイッチ基板（ すなわち、複数のラックシステムのスイッチ基板）によって行われる。 オフ・ボードのボートへの接続が必要とされる場合には、ＣＰＵ基板５６はその ボートのスイッチ基板３７８に対しての状態のリクエストを行う。そのとき、ボ ートを参照するのにボートのＬＤＮ　（システムの各ボートに割り当てられた論 理番号）が用いられる。ラックのスイッチ基板が最初に行う動作は、ネットワー ク上のその他のすべてのスイッチ基板に対してＬＤＮの状態をリクエストするメ ツセージを一斉送信することである。ＬＤＮが存在するランク内の目標となって いるスイッチ基板は、ＬＤＮをそのＣＰＵ基板から取得する０次に、ＬＤＮの状 態、Ｌ　Ｄ　ＮのＰＣＭおよびチャネル番号、および、ラックのアドレスを生起 元のスイッチ基板に対してネットワークを介して送信する。生起元のスイッチ基 板は状態データをそのＣＰＵ基板に転送する。生起元のＣＰＵ基板がそのボート の接続を望む場合には、ＣＰＵ基板は、そのスイッチ基板に対してそのＬＤＮを 目標のラック内のＬＤＮに接続するようにコマンドを送る。生起元スイッチ基板 は、目標ラック内のＬＤＨに対して受信したＰＣＭハイウェイおよびチャネルの データをそのデータベースから探索する。生起元スイッチ基板は適当なスイッチ 接続を行い、次いでネットワークを介して目標のスイッチ基板に対して適切な接 続を行うようにとのメツセージを送信する。目標スイッチ基板は、そのデータベ ースの情報に基づいて接続を行い、そのＣＰＵ基板に接続されたことを知らせる 。ＬＤＮ参照ボートの切り離しも同様のプロセスで行われる。 システムのディジタル構成要素の同期は、オン・ボード発振器とデバイダとの組 み合わせ３８８を用いてとられる。トライ・ステート・バッファを用いることに よって、システムの任意のラックから同期信号が供給できるようになっている。 通常は、同期信号は第１のキャビネットの第１のラックから供給されるが、どの スイッチ基板も同期信号をすべてのシステムに対して供給できる能力を有してい る。スイッチ基板のマイクロコントローラは、同期信号の欠落を検出した場合に は、どの程度の時間待ってからシステムに対して信号を供給すべきがをシステム 内のその位置に基づいたタイミング・アルゴリズムを用いて決定する。 以上の詳細説明は、本発明のいろいろな好適な実施例を例示的に示したものであ る。これらに対して多くの変形と変更が、添付の請求範囲に定義された発明の範 囲を逸脱することなしに可能であることは明白であろう。 ＣＡＬＬＰＲＯＣ，０２７ｋＰＰＥＮＤＸＸ　ＡＭＯＤＵＬＥ＜ＣｊＬＬ工、− ＰＲＯｃＥ５ＳＯＲ＞　４ｋ　ＣＡＬＬＰＲＯＣ，０２７噛ｆｆτＲＹ（ＳＴ入 ＲＴ＞ （ＪＡ：　Ｘ［ＤＢＡＳＥ、ＳτＢＴ＼Ｐｏｒｔ、Ｃｏ１１＊ｃセＬｎｇ−ｂｉ ｔ、ＯＮＩ　会ＢＥＧＩＮ工ＮＧ會Ｘ［ＤＢＡＳＥ、５ＴＢＹＸＰｏｒｅ、Ｄｉ ｇｉｔｊａｉｎｔｅｒ、０３　壷ＳＥＴ　Ｃ０ｕｌＣＴＸＮＧ　ＢＩＴ　ＡＮＤ 　ＤＩＧＩＴ　■ Ｃ

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Claims (46)

【特許請求の範囲】
1. １．制御信号のための第１のラインと、音声およびデータのための第２のライン とを備えるディジタル通信リンクと、 該ディジタル通信リンクと少なくとも１つの加入者電気通信ユニットとに接続さ れて該加入者電気通信ユニットによって発生される出力信号を処理する第１のプ ロセッサを有する加入者インターフェース回路と、前記ディジタル電気通信リン クおよび前記加入者インターフェース回路に接続されて第２のプロセッサと第１ のメモリ回路と該メモリ回路に記憶されたプログラム・コードとを有する、また 該プログラム・コードに基づく前記加入者インターフェース回路制御用のマスタ ー制御信号を生成しかつ前記第１のラインを介して該マスタ制御信号を送信する 動作の可能な中央処理回路と、を備える電気通信システムにおいて、 前記加入者インターフェース回路が前記マスター制御信号に応答するコマンド信 号を生成し、前記第１のラインを介して前記中央処理回路に該コマンド信号を送 信する動作を可能にされてなる電気通信システム。
2. ２．請求項１において、前記第１のラインがパルス符号変調ハイウエイとして配 列されてなる電気通信システム。
3. ３．請求項１において、前記第１のラインが高レベル・データ・リンク制御プロ トコールに基づく前記マスター制御信号と前記コマンド信号とを送信する配列と されてなる電気通信システム。
4. ４．請求項１において、前記第２のラインがパルス符号変調ハイウェイとして配 列されてなる電気通信システム。
5. ５．請求項４において、前記第２のラインが６４ｋバイト／秒の複数のチャネル を備えてなる電気通信システム。
6. ６．請求項１において、前記加入者インターフェース回路が該インターフェース 回路に関連するポートを有し、前記第２のラインが多数の該ポートに対応する多 数のチャネルを備え、前記第２のプロセッサがデータおよび音声送信のために対 応チャネルベアクセスするための前記ポートの各々を用意する動作を可能にされ てなる電気通信システム。
7. ７．請求項１において、前記加入者インターフェース回路が、前記中央処理回路 を少なくとも１つのアナログ電話ラインに接続するように配列されてなる電気通 信システム。
8. ８．請求項１において、前記加入者インターフェース回路が、前記中央処理回路 を少なくとも１つのディジタル通信ラインに接続する配列にされてなる電気通信 システム。
9. ９．請求項１において、前記加入者インターフェース回路が、前記中央処理回路 を少なくとも１つの中継ラインに接続する配列にされてなる電気通信システム。
10. １０．請求項１において、前記加入者インターフェース回路が、第２のメモリ回 路と、前記マスター制御信号に従って該第２のメモリ回路と共にデータの記憶お よび検素処理を実行する第３のプロセッサを備える、データ記憶回路として配列 されてなる電気通信システム。
11. １１．前記ディジタル通信リンクに接続された第２の加入者インターフェース回 路をさらに備え、該第２の加入者インターフェース回路がディジタル信号処理用 に配列されて前記第２のメモリ回路に記憶されているソフトウェア命令にアクセ スする第４のプロセッサを備え前記マスター制御信号に従って複数の電気通信サ ービスを提供する該ソフトウエア命令を実行してなる請求項１に記載した電気通 信システム。
12. １２．前記ディジタル通信リンクに接続された第２の加入者インターフェース回 路をさらに備え、該第２の加入者インターフェース回路が前記第２のメモリ回路 への記憶および該メモリ回路からの検素処理動作を可能にされてなる請求項１０ に記載した電気通信システム。
13. １３．請求項１において、前記中央処理回路が、複数の電気通信機能を実行する ディジタル信号プロセッサと、前記第２のラインヘおよび該第２のラインから音 声およびデータを転送するスイッチ回路と、前記第１のラインを介しての前記マ スター制御信号の送信および前記コマンド信号の受信を実行する制御インターフ ェース回路とをさらに備えてなる電気通信システム。
14. １４．請求項１３において、前記プログラム・コードが、前記スイッチ回路を作 動させる前記第２のプロセッサを制御する第１のプログラム制御モジュールと、 前記ディジタル信号プロセッサと、前記制御インターフェス回路とを備えてなる 電気通信システム。
15. １５．請求項１４において、前記プログラム・コードが、前記マスター制御信号 記憶用の先入れ先出しメモリ・バッファを前記第１のメモリ回路内に創設する前 記第１のプログラム制御モジュールと協働する第２のプログラム制御モジュール と、前記コマンド信号を記憶する先入れ先出しメモリ・バッファとを備えてなる 電気通信システム。
16. １６．請求項１において、前記加入者インターフェース回路が、該回路に関係す るポートを有し、前記第１のメモリ回路が該ポートの各々に対応するポート・デ ータを記憶するデータベースを備えてなる電気通信システム。
17. １７．請求項１６において、前記各ポートに対するのポート・データが、該ポー トを用いる加入者に提供される電気通信サービスに関係するデータと、該ポート に割り当てられた表記載のディレクトリ番号と、該ポートに対応する前記加入者 電気通信ユニットを前記加入者インターフェース回路に接続するラインの状態条 件とを備えてなる電気通信システム。
18. １８．請求項１５において、前記第２のプログラム制御モジュールが、該モジュ ールに接続されている加入者電気通信ユニットの種類に従って前記加入者インタ ーフェース回路を動作させるマスター制御信号の生成を制御するマネージャ・サ ブルーチンを備えてなる電気通信システム。
19. １９．請求項１５において、前記第２のプログラム制御モジュールが、音声メッ セージの生成、トーン・メッセージの生成、およびデュアル・トーン多重周波数 信号のデコーディングを含む複数のシステム電気通信機能の少なくとも１つを実 行するためのマスター制御信号の生成を制御するマネージャ・サブルーチンを備 えてなる電気通信システム。
20. ２０．選択された加入者電気通信ユニットと協働して選択された電気通信サービ スを実行する前記中央処理回路を形成するためのソフトウェア・モジュールをシ ステム・ユーザが創成するのを可能ならしめる電気通信プログラミング言語およ び該電気通信プログラミング言語のコンパイラをさらに備えてなる請求項１に記 載した電気通信システム。
21. ２１．請求項２０において、前記プログラム・コードが、前記第２のプロセッサ を用いる前記コンパイラを実行させる少なくとも１つのプログラム・コード・モ ジュールを備えてなる電気通信システム。
22. ２２．請求項２１において、前記プログラム・コードが、該プログラム・コード に接続された加入者電気通信ユニットの種類に従って前記加入者インターフェー ス回路を動作させるマスター制御信号の生成を制御する少なくとも１つのマネー ジャ・サブルーチンを備えてなる電気通信システム。
23. ２３．請求項２２において、前記第２のプロセッサが、前記電気通信プログラミ ング言語を用いて作成され前記マネージャ・サブルーチン実行用の少なくとも１ つの命令を備えるソフトウェア命令に従って前記加入者インターフェース回路を 制御する動作を可能とされてなる電気通信システム。
24. ２４．請求項２３において、前記マネージャ・サブルーチンが該マネージャ・サ ブルーチンに接続された前記加入者電気通信ユニットのデータ通信特性に従って 前記加入者インターフェース回路を動作させる前記第２のプロセッサ制御用のソ フトウェア命令を備え、前記電気通信プログラミング言語を用いて作成された該 ソフトウェア命令が、該データ通信特性に実質的に依存せずに前記第２のプロセ ッサの制御動作を可能にされてなる電気通信システム。
25. ２５．ディジタル通信リンクと、 該ディジタル通信リンクに接続されたスイッチング回路と、 複数の異なる種類の加入者電気通信ユニットの少なくとも１つと接続するインタ ーフェース回路を有する前記ディジタル通信リンクに後続された周辺処理回路と 、該周辺処理回路と前記ディジタル通信リンクと前記スイッチング回路とを制御 して複数のシステム機能の中の少なくとも１つを実行するために前記ディジタル 通信リンクに接続された中央処理回路と、 を備える前記複数の異なる種類の加入者電気通信ユニットに接続された電気通信 システムにおいて、前記周辺処理回路が、前記加入者電気通信ユニットとの間で 信号を送受信するために前記インターブェース回路を動作させるプログラム・コ ードを備え、前記中央処理回路が、前記周辺処理回路の動作および前記複数のシ ステム機能の実行を制御する第１の複数のプログラム・コード・モジュールと、 前記加入者電気通信ユニットに対するサービスを行う前記第１の複数のプログラ ム・コード・モジュールの中から選択されたプログラム・コード・モジュールの 呼び出し動作の可能な第２の複数のプログラム制御モジュールとを備えてなる電 気通信システム。
26. ２６．電気通信プログラミング言語と該電気通信プログラミング言語のコンパイ ラとをさらに備え、前記中央処理回路が、前記第２の複数のプログラム・コード ・モジュールの少なくとも１つを生成するために該電気通信プログラミング言語 を用いてシステム・ユーザの書いたプログラム・コードをコンパイルする前記コ ンパイラを備えてなる電気通信システム。
27. ２７．請求項２６において、前記電気通信プログラミング言語が、前記の第２の 複数のプログラム・コード・モジュールの中の１つに従う動作から該プログラム ・コード・モジュールの別の１つの動作に切り替えたり、前記加入者電気通信ユ ニットの他の１つからデータを受信したり、前記中央処理両路で使用するために 作成されている選択されたサブルーチンを実行したりする複数の処理機能の少な くとも１つを実行することを前記中央処理回路に命令するコマンドを備えてなる 電気通信システム。
28. ２８．請求項２６において、前記電気通信プログラミング言語が、前記第１の複 数のプログラム・コード・モジュールの中の指定された１つに従って動作するこ とを前記中央処理回路に命令するコマンドを備えてなる電気近信システム。
29. ２９．請求項２６において、前記電気通信プログラミング言語が、指定されたデ ータを比較すること、および該比較結果に従って前記プログラム・コード内の指 定された点でコマンド制御下の動作に切り換えることを前記中央処理回路に命令 するコマンドを備えてなる電気通信システム。
30. ３０．マスター制御信号の生成動作の可能な中央処理回路と、 少なくとも１つの加入者電気通信ユニットと、前記中央処理回路および前記加入 者電気通信回路ユニットに接続され、前記のマスター制御信号を受信したり前記 マスター制御信号に従って前記加入者電気通信ユニットへ送信されるおよび前記 加入者通信ユニットから受信される音声信号とデータ信号とを処理したり前記中 央処理回路への送信用に前記マスター制御信号に応答してコマンド信号を生成し たりする動作の可能な周辺処理回路と、 音声およびデータ伝送用の汎用データラインと前記マスター制御信号および前記 コマンド信号伝送用の汎用制御ラインとを備える前記中央処理回路および前記周 辺処理回路を接続するためのバックプレーンと、を備える電気近信システム。
31. ３１．請求項３０において、前記制御ラインがコマンド・プロトコールを備え、 前記中央処理回路および前記周辺処理回路が該コマンド・プロトコールに従って 前記マスター信号および記コマンド信号をそれぞれに生成するプログラムを作成 可能にされてなる電気通信システム。
32. ３２．請求項３０において、前記バックプレーンが、一意的識別コードを有する 前記中央処理回路および前記周辺処理回路を用意する配列の可能なアドレス・ラ インをさらに備えてなる電気通信システム。
33. ３３．前記中央処理回路に結合され、課金処理やトラフィック解析や前記プログ ラム・コードの修正や呼び出し経路解析を備える複数の管理サービスの中の少な くとも１つを実行する処理の可能な管理処理回路をさらに備えてなる請求項１に 記載した電気通信システム。
34. ３４．請求項３３において、前記の管理処理回路がマルチタスク・オペレーティ ング・システムを包含してなる電気通信システム。
35. ３５．請求項３３において、前記管理処理回路が、前記中央処理回路を使用する 選択された加入者サービスの提供をユーザによりプログラム可能にされてなる電 気通信システム。
36. ３６．前記ディジタル通信リンクを介しての前記中央処理回路への接続用ディジ タル・インターフェースと、少なくとも１つのデータ端末への選択的な接続用端 末アダプタとを包含するディジタル電話をさらに備えてなる請求項１に記載した 電気通信システム。
37. ３７．前記ディジタル電話を前記中央処理回路に接続するためのインターフェー スと、 前記ディジタル電話を用いる電話の呼び処理用の電話処理回路と、 複数のキーを有し、該キーに接続される複数のラインを有して該キーからの入力 信号を求める該複数ラインのスキャンおよび該キーへの出力信号の提供をプログ ラム可能にされている前記電話処理回路に接続されたキーパッドと、 呼び情報およびラインの状態に関連するデータの提供をプログラム可能にしてあ る前記電話処理回路に接続された表示装置と、 トーン発生とトーン制御を含む複数の電話機能の中の少なくとも１つを実行する ため前記電話処理回路に接続されたコーディングおよびデコーデイング回路と、 を備えるディジタル電話をさらに備えてなる請求項１に記載した電気通信システ ム。
38. ３８．請求項３７において、前記インターフェースが音声伝送用の少なくとも１ つのチャネルとデータ伝送用の少なくとも１つのチャネルと、前記ディジタル電 話の前記加入者インターフェース回路への接続用の制御チャネルとを備えてなる 電気通信システム。
39. ３９．少なくとも１つの端末を前記ディジタル電話に接続するための端末アダプ タをさらに備えてなる請求項３７に記載した電気通信システム。
40. ４０．請求項３９において、前記端末アダプタが、上記端末から受信したチータ を前記データ・チャネルを介して伝送するためにあらかじめ定められているデー タ・レートとフォーマットに変換するデータ・コンバータを備えてなる電気通信 システム。
41. ４１．請求項４０において、前記端末アダプタが、呼びのセットアップと呼びの 破棄と動作パラメータのセットアップとデータ流れモニタと呼び制御とを備える 複数の端末機能の中の少なくとも１つの実行動作を可能にされてなる電気通信シ ステム。
42. ４２．アナログ・ライン、ディジタル・ライン、中継ラインそれそれとインター フェースをとる形態にされているいろいろな種類の周辺処理回路を種々な種類の 加入者電気通信ユニットに接続するステップと、前記複数の周辺処理回路をお互 い同志および該周辺処理回路を制御する中央処理回路に接続するステップと、前 記のいろいろな種類の周辺処理回路で用いられる、いろいろなデータ・タイプ、 データ・レート、伝送標準、および伝送パラメータの供給を包含する複数の機能 を実行するための複数のマネージャ・サブルーチンを備えるプログラム・コード と共に前記中央処理回路を準備するステップと、 前記加入者電気通信ユニットからの前記音声およびディジタル信号を受信するた めに前記複数の周辺処理回路を動作させるステップと、 前記の複数の周辺処理回路の各々から前記いろいろな種類の前記周辺処理回路の １つを示すデータを備えた第１の制御信号を送信するステップと、 前記周辺処理回路の種類に応じた実行をするための少なくとも１つの前記マネー ジャ・サブルーチンを選択するために前記中央処理回路を使用して前記第１の制 御信号を処理するステップと、 前記選択された１つの前記マネージャ・サブルーチンに従って前記音声およびデ ィジタル信号を処理するコマンドを包含する第２の制御信号を前記中央処理回路 を使って生成して前記複数の周辺処理回路に送信するステップと、 を含んでいる前記種々な種類の加入者電気通信ユニットからの音声およびディジ タル信号の処理方法。
43. ４３．電気近信プログラミング言語を用いて作成されたプログラム・コードを前 記中央処理回路が読み取り得るプログラムされたコードに変換するステップをさ らに包含してなる請求項４２に記載した方法。
44. ４４．前記のいろいろな種類の加入者電気通信ユニットのそれぞれに対応し、前 記加入者電気通信ユニットの種類に従って音声およびディジタル信号を処理する ためにマネージャ・サブルーチンの選択において前記中央処理回路を制御する、 前記電気通信プログラミング言語を使った処理サブルーチンを作成するステップ をさらに包含する請求項４３に記載した方法。
45. ４５．前記のいろいろな種類の周辺処理回路の１つに従って前記中央処理回路を 使った音声およびディジタル信号の処理をするために前記マネジャ・サブルーチ ンが前記のいろいろな種類の周辺処理回路の間に存在する相違点を蔽い隠す動作 対象のデバイス・プロセッサ・サブルーチンの少なくとも１つを前記電気通信プ ログラミング言語を使って作成するステップを更に包含する請求項４３に記載し た方法。
46. ４６．音声メール、会議、高速ダイアリング、呼びの転送、および基本的な呼び の処理を包含する複数の電気通信機能を前記中央処理回路で実行するために少な くとも１つのコール・プロセッサ・サブルーチンを前記電気通信プログラミング 言語を使って作成するステップをさらに包含する請求項４３に記載した方法。