JPH0766193A - 半導体装置における酸化膜の形成方法 - Google Patents
半導体装置における酸化膜の形成方法Info
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- JPH0766193A JPH0766193A JP20965693A JP20965693A JPH0766193A JP H0766193 A JPH0766193 A JP H0766193A JP 20965693 A JP20965693 A JP 20965693A JP 20965693 A JP20965693 A JP 20965693A JP H0766193 A JPH0766193 A JP H0766193A
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Abstract
(57)【要約】 (修正有)
【目的】半導体装置における酸化膜の形成方法に関し、
面荒れのない均一な薄い酸化膜を形成すること。 【構成】半導体層の表面に予め第一の酸化膜11を形成
した後に、酸化炉内の減圧雰囲気下で熱酸化により前記
半導体層の上に第二の酸化膜12を形成することを含
む。
面荒れのない均一な薄い酸化膜を形成すること。 【構成】半導体層の表面に予め第一の酸化膜11を形成
した後に、酸化炉内の減圧雰囲気下で熱酸化により前記
半導体層の上に第二の酸化膜12を形成することを含
む。
Description
【0001】
【産業上の利用分野】本発明は、半導体装置における酸
化膜の形成方法に関し、より詳しくは、MOSFETの
ゲート絶縁膜などに用いられる薄い酸化膜の形成方法に
関する。
化膜の形成方法に関し、より詳しくは、MOSFETの
ゲート絶縁膜などに用いられる薄い酸化膜の形成方法に
関する。
【0002】
【従来の技術】半導体集積回路に使用されるMOSFE
Tは、集積度の向上につれてますます微細化されてい
る。そのMOSFETのゲート絶縁膜についてはより一
層の薄膜化が求められているが、閾値電圧を一定にして
ゲート絶縁膜の絶縁破壊耐圧性を向上するためには、そ
の薄い絶縁膜を均一な厚さにすることが重要である。
Tは、集積度の向上につれてますます微細化されてい
る。そのMOSFETのゲート絶縁膜についてはより一
層の薄膜化が求められているが、閾値電圧を一定にして
ゲート絶縁膜の絶縁破壊耐圧性を向上するためには、そ
の薄い絶縁膜を均一な厚さにすることが重要である。
【0003】ゲート絶縁膜に使用される酸化膜の形成方
法としては、窒素、アルゴン等の不活性ガスにより希釈
された酸素を酸化炉内に導入して常圧の下で半導体層の
表面を分圧酸化する方法、或いは、酸化炉内の高温雰囲
気中に酸素ガスを流して減圧下で半導体層表面を減圧酸
化する方法がある。
法としては、窒素、アルゴン等の不活性ガスにより希釈
された酸素を酸化炉内に導入して常圧の下で半導体層の
表面を分圧酸化する方法、或いは、酸化炉内の高温雰囲
気中に酸素ガスを流して減圧下で半導体層表面を減圧酸
化する方法がある。
【0004】
【発明が解決しようとする課題】しかし、分圧酸化によ
れば、常圧酸化炉内ではウェハの出し入れ時に外気を巻
き込み、しかも、酸素ガスの拡散の均一性が低下するの
で、酸化膜厚が不均一になるという欠点がある。また、
減圧酸化によれば、半導体層が高温の真空に曝されるの
でその表面に荒れが生じ、その結果、キャリアの移動度
が低下したり、リーク電流が大きくなるなどの問題が発
生する。
れば、常圧酸化炉内ではウェハの出し入れ時に外気を巻
き込み、しかも、酸素ガスの拡散の均一性が低下するの
で、酸化膜厚が不均一になるという欠点がある。また、
減圧酸化によれば、半導体層が高温の真空に曝されるの
でその表面に荒れが生じ、その結果、キャリアの移動度
が低下したり、リーク電流が大きくなるなどの問題が発
生する。
【0005】本発明はこのような問題に鑑みてなされた
ものであって、面荒れのない均一な薄い酸化膜を形成す
ることができる半導体装置における酸化膜の形成方法を
提供することを目的とする。
ものであって、面荒れのない均一な薄い酸化膜を形成す
ることができる半導体装置における酸化膜の形成方法を
提供することを目的とする。
【0006】
【課題を解決するための手段】上記した課題は、図1〜
5に例示するように、半導体層の表面に予め第一の酸化
膜11を形成した後に、酸化炉1内の減圧雰囲気下で熱酸
化によって前記半導体層の上に第二の酸化膜12を形成す
ることを特徴とする半導体装置における酸化膜の形成方
法により達成する。
5に例示するように、半導体層の表面に予め第一の酸化
膜11を形成した後に、酸化炉1内の減圧雰囲気下で熱酸
化によって前記半導体層の上に第二の酸化膜12を形成す
ることを特徴とする半導体装置における酸化膜の形成方
法により達成する。
【0007】または、前記酸化炉1は縦型であって、前
記第一の酸化膜11は、前記酸化炉1内の下部の第一の減
圧雰囲気下で形成され、かつ、前記第二の酸化膜12は、
ヒータ2により囲まれた前記酸化炉1内上部の第二の減
圧雰囲気下で形成されていることを特徴とする半導体装
置における酸化膜の形成方法により達成する。または、
前記第一の酸化膜11を形成する前記第一の減圧雰囲気
は、前記ヒータ2よりも低温で前記半導体層を加熱する
副ヒータ9により加熱されることを特徴とする半導体装
置における酸化膜の形成方法により達成する。
記第一の酸化膜11は、前記酸化炉1内の下部の第一の減
圧雰囲気下で形成され、かつ、前記第二の酸化膜12は、
ヒータ2により囲まれた前記酸化炉1内上部の第二の減
圧雰囲気下で形成されていることを特徴とする半導体装
置における酸化膜の形成方法により達成する。または、
前記第一の酸化膜11を形成する前記第一の減圧雰囲気
は、前記ヒータ2よりも低温で前記半導体層を加熱する
副ヒータ9により加熱されることを特徴とする半導体装
置における酸化膜の形成方法により達成する。
【0008】または、前記第二の減圧雰囲気は、前記第
一の減圧雰囲気よりも圧力が大きいことを特徴とする半
導体装置における酸化膜の形成方法により達成する。ま
たは、前記第一の酸化膜11は、前記半導体層の硝酸洗浄
によるか、又は、化学的気相成長により形成されること
を特徴とする半導体装置における酸化膜の形成方法によ
り達成する。
一の減圧雰囲気よりも圧力が大きいことを特徴とする半
導体装置における酸化膜の形成方法により達成する。ま
たは、前記第一の酸化膜11は、前記半導体層の硝酸洗浄
によるか、又は、化学的気相成長により形成されること
を特徴とする半導体装置における酸化膜の形成方法によ
り達成する。
【0009】
【作 用】以上述べたように本発明によれば、半導体層
の本酸化膜の前に極薄い酸化膜を形成している。従っ
て、高温、減圧下で半導体層を酸化する際に、その表面
から半導体原子が蒸発することは抑制され、半導体層と
その上の酸化膜との界面の面荒れは防止される。
の本酸化膜の前に極薄い酸化膜を形成している。従っ
て、高温、減圧下で半導体層を酸化する際に、その表面
から半導体原子が蒸発することは抑制され、半導体層と
その上の酸化膜との界面の面荒れは防止される。
【0010】また、本酸化は、減圧雰囲気で行っている
ので、酸化炉での平均自由工程が常圧下よりも大きくな
り、酸素ガスの拡散が均一になって酸化が均一に行え
る。
ので、酸化炉での平均自由工程が常圧下よりも大きくな
り、酸素ガスの拡散が均一になって酸化が均一に行え
る。
【0011】
【実施例】そこで、以下に本発明の実施例を図面に基づ
いて説明する。 (a)本発明の第1実施例の説明 図1〜図5は、本発明に使用する酸化処理装置の一例を
示す断面図である。図1〜図5において符号1は、石英
よりなる縦型の酸化炉を有する酸化処理装置で、その上
部の外周には抵抗加熱、ランプ加熱等によるヒータ2が
配置され、その上部の内部空間は均熱帯となっている。
また、その下部の内部空間は、ウェハキャリア3とその
下のバッファ板4を収納するスペースとなっている。バ
ッファ板4は、酸化炉1の下部への熱伝導を遮蔽すると
ともに、酸化炉1内の均熱性を向上するために設けられ
ている。
いて説明する。 (a)本発明の第1実施例の説明 図1〜図5は、本発明に使用する酸化処理装置の一例を
示す断面図である。図1〜図5において符号1は、石英
よりなる縦型の酸化炉を有する酸化処理装置で、その上
部の外周には抵抗加熱、ランプ加熱等によるヒータ2が
配置され、その上部の内部空間は均熱帯となっている。
また、その下部の内部空間は、ウェハキャリア3とその
下のバッファ板4を収納するスペースとなっている。バ
ッファ板4は、酸化炉1の下部への熱伝導を遮蔽すると
ともに、酸化炉1内の均熱性を向上するために設けられ
ている。
【0012】また、酸化炉1の側部には、ゲートバルブ
6を介してウェハ搬送室5が接続され、ここにウェハ1
0を通すことにより、ウェハ10をウェハキャリア3に
取り付けたり外部に取り出すように構成されている。さ
らに、酸化炉1の別の側部には、炉内のガスを排気する
排気管7が接続され、また、酸化炉1の天部には、ガス
導入管8が接続されている。
6を介してウェハ搬送室5が接続され、ここにウェハ1
0を通すことにより、ウェハ10をウェハキャリア3に
取り付けたり外部に取り出すように構成されている。さ
らに、酸化炉1の別の側部には、炉内のガスを排気する
排気管7が接続され、また、酸化炉1の天部には、ガス
導入管8が接続されている。
【0013】なお、図においてウェハキャリア3は、ウ
ェハ10を1枚だけ載置するような構造になっている
が、例えば7mm間隔をおいてウェハ10を10枚まで重
ねて搭載できるような構造のものであってよく、搭載枚
数は特に限定されるものではない。次に、このような酸
化処理装置を用いてウェハ10の表面に酸化膜を形成す
る工程を説明する。
ェハ10を1枚だけ載置するような構造になっている
が、例えば7mm間隔をおいてウェハ10を10枚まで重
ねて搭載できるような構造のものであってよく、搭載枚
数は特に限定されるものではない。次に、このような酸
化処理装置を用いてウェハ10の表面に酸化膜を形成す
る工程を説明する。
【0014】まず、酸化炉1内を1×10-6Torrに減圧
するとともに、炉内上部の雰囲気をヒータ2によって1
000℃に加熱する。次に、図1に示すように、ゲート
バルブ6を開き、1×10-6Torrに減圧されたウェハ搬
送室5を通して8インチのシリコンウェハ10を不図示
のウェハキャリア3に載置する。複数枚のシリコンウェ
ハ10を搭載できるウェハキャリアを使用する場合に
は、そのウェハキャリアを上方にスライドさせながら上
から順にシリコンウェハを1枚ずつ搭載する。
するとともに、炉内上部の雰囲気をヒータ2によって1
000℃に加熱する。次に、図1に示すように、ゲート
バルブ6を開き、1×10-6Torrに減圧されたウェハ搬
送室5を通して8インチのシリコンウェハ10を不図示
のウェハキャリア3に載置する。複数枚のシリコンウェ
ハ10を搭載できるウェハキャリアを使用する場合に
は、そのウェハキャリアを上方にスライドさせながら上
から順にシリコンウェハを1枚ずつ搭載する。
【0015】なお、酸化炉1内の圧力は1×10-6Torr
と低いが、ゲートバルブ6近傍の酸化炉1内の温度は、
シリコンウェハ10の表面荒れを生じさせるまでの高さ
となっていない。このようにシリコンウェハ10を収納
してから、ゲートバルブ6を閉めた後に、図2に示すよ
うに、ヒータ2に囲まれた均熱帯までウェハキャリア3
を上昇させる。この上昇の過程において、酸化炉1のガ
ス導入管8から酸素ガスを供給し、かつ、内部圧力を1
Torrまで上昇させる。この場合、酸素分圧が高いので、
シリコンウェハ10の表面荒れが防止される。
と低いが、ゲートバルブ6近傍の酸化炉1内の温度は、
シリコンウェハ10の表面荒れを生じさせるまでの高さ
となっていない。このようにシリコンウェハ10を収納
してから、ゲートバルブ6を閉めた後に、図2に示すよ
うに、ヒータ2に囲まれた均熱帯までウェハキャリア3
を上昇させる。この上昇の過程において、酸化炉1のガ
ス導入管8から酸素ガスを供給し、かつ、内部圧力を1
Torrまで上昇させる。この場合、酸素分圧が高いので、
シリコンウェハ10の表面荒れが防止される。
【0016】このような状態に置かれたシリコンウェハ
10は、酸化炉1の上部の均熱帯に到達するまでに酸素
により僅かに酸化され、その表面には厚さ1〜2nmの予
備的な酸化膜11が形成される。そして、図3に示すよ
うに、上部の均熱帯にシリコンウェハ10が到達した時
点で、酸素ガスの供給量を増やして酸化炉1の内部圧力
を1〜100Torrの範囲内、例えば6.3Torrに設定
し、この状態を70分間保持してシリコンウェハ10の
表面を本酸化し、シリコンウェハ10表面に酸化膜12
を形成し、酸化膜総厚を5nmとする。
10は、酸化炉1の上部の均熱帯に到達するまでに酸素
により僅かに酸化され、その表面には厚さ1〜2nmの予
備的な酸化膜11が形成される。そして、図3に示すよ
うに、上部の均熱帯にシリコンウェハ10が到達した時
点で、酸素ガスの供給量を増やして酸化炉1の内部圧力
を1〜100Torrの範囲内、例えば6.3Torrに設定
し、この状態を70分間保持してシリコンウェハ10の
表面を本酸化し、シリコンウェハ10表面に酸化膜12
を形成し、酸化膜総厚を5nmとする。
【0017】次に、酸素ガス導入量を減らして内部圧力
を1Torrにし、図4に示すように、ウェハキャリア3を
酸化炉1の下部に戻す。ついで、酸素の供給を止め、図
5に示すように、酸化炉1内の圧力を1×10-6Torrま
で低減した後に、ゲートバルブ6を開いてウェハキャリ
ア3からシリコンウェハ10をウェハ搬送室5に取り出
し、再びゲートバルブ6を閉め、そして、シリコンウェ
ハ10を外部に取り出すことになる。
を1Torrにし、図4に示すように、ウェハキャリア3を
酸化炉1の下部に戻す。ついで、酸素の供給を止め、図
5に示すように、酸化炉1内の圧力を1×10-6Torrま
で低減した後に、ゲートバルブ6を開いてウェハキャリ
ア3からシリコンウェハ10をウェハ搬送室5に取り出
し、再びゲートバルブ6を閉め、そして、シリコンウェ
ハ10を外部に取り出すことになる。
【0018】以上のような条件によれば、シリコンウェ
ハ10の表面には厚さ5nmの酸化膜が均一に形成され
る。その酸化膜の膜厚の均一性を調べるたところ、図6
のような結果が得られ、シリコンウェハ10の中央から
周辺にかけて一様の膜厚となっていることがわかる。ま
た、縦方向の7cmの間に10枚のウェハを収納する不図
示のウェハキャリアを用いた場合の各シリコンウェハの
酸化膜厚の分布を調べたところ、図7のような結果が得
られた。これによれば、ウェハキャリアの下方部分に置
かれるシリコンウェハ表面の酸化膜厚は薄くなるが、そ
の差は5%内におさまっているので、半導体装置の形成
のためには特に問題にならない。
ハ10の表面には厚さ5nmの酸化膜が均一に形成され
る。その酸化膜の膜厚の均一性を調べるたところ、図6
のような結果が得られ、シリコンウェハ10の中央から
周辺にかけて一様の膜厚となっていることがわかる。ま
た、縦方向の7cmの間に10枚のウェハを収納する不図
示のウェハキャリアを用いた場合の各シリコンウェハの
酸化膜厚の分布を調べたところ、図7のような結果が得
られた。これによれば、ウェハキャリアの下方部分に置
かれるシリコンウェハ表面の酸化膜厚は薄くなるが、そ
の差は5%内におさまっているので、半導体装置の形成
のためには特に問題にならない。
【0019】以上のように、本酸化を行う前に極薄い予
備酸化膜を形成しているので、シリコンウェハ10の表
面に荒れがないことがわかった。これは、高温下に置か
れたシリコンウェハ10の表面からのシリコンの昇華が
予備酸化膜11によって防止されるからと考えられる。
1000℃程度の高温かつ高真空の状態に予備酸化膜の
ないシリコンウェハを置くと、その表面のシリコンは約
1×10-10atmの蒸気圧で昇華する。その雰囲気中に微
量な酸素が含まれる場合には、シリコンの表面が酸化さ
れる一方、シリコンと酸素が結合してSiO 、SiO2のガス
となって蒸発する。このために、シリコンウェハの表面
とその上に形成される酸化膜との界面には面荒れが生じ
る。
備酸化膜を形成しているので、シリコンウェハ10の表
面に荒れがないことがわかった。これは、高温下に置か
れたシリコンウェハ10の表面からのシリコンの昇華が
予備酸化膜11によって防止されるからと考えられる。
1000℃程度の高温かつ高真空の状態に予備酸化膜の
ないシリコンウェハを置くと、その表面のシリコンは約
1×10-10atmの蒸気圧で昇華する。その雰囲気中に微
量な酸素が含まれる場合には、シリコンの表面が酸化さ
れる一方、シリコンと酸素が結合してSiO 、SiO2のガス
となって蒸発する。このために、シリコンウェハの表面
とその上に形成される酸化膜との界面には面荒れが生じ
る。
【0020】これに対して本実施例のように、本酸化前
に、低温の雰囲気でシリコンウェハ10表面に極薄い予
備酸化膜11を形成しておくと、この予備酸化膜11が
保護膜になるので、数分間の温度上昇時にもシリコン昇
華による荒れや、温度上昇時の不安定な状態で生じるム
ラのある酸化膜の形成が極力抑えられる。また、本酸化
の際には、常圧としないで減圧雰囲気としているので、
ガス分子の平均自由工程が増し、酸素ガス濃度が均一に
なるまでの時間が短縮され、酸素ガスが速やかに均一拡
散する。例えば1000℃、1atm における空気の平均
自由工程は2.8×10-7mであるが、酸素ガス1Torr
では、2.3×10-4mにまで延びる。
に、低温の雰囲気でシリコンウェハ10表面に極薄い予
備酸化膜11を形成しておくと、この予備酸化膜11が
保護膜になるので、数分間の温度上昇時にもシリコン昇
華による荒れや、温度上昇時の不安定な状態で生じるム
ラのある酸化膜の形成が極力抑えられる。また、本酸化
の際には、常圧としないで減圧雰囲気としているので、
ガス分子の平均自由工程が増し、酸素ガス濃度が均一に
なるまでの時間が短縮され、酸素ガスが速やかに均一拡
散する。例えば1000℃、1atm における空気の平均
自由工程は2.8×10-7mであるが、酸素ガス1Torr
では、2.3×10-4mにまで延びる。
【0021】さらに、減圧雰囲気の下で、酸化炉1にお
いてシリコンウェハ10の出し入れを行っているので、
外気の巻き込みが生じることもなく、シリコンウェハ1
0表面には均一な厚さの酸化膜11,12が得られる。
なお、酸化膜形成後に酸素分圧を1×10-6Torr程度の
低い状態にすると、蒸気圧は低いものの酸化膜表面から
SiO 、SiO2ガスが蒸発して荒れの原因となるので、シリ
コンウェハ10を酸化炉1の下部に移動するまでは適度
な酸素分圧の雰囲気とする。
いてシリコンウェハ10の出し入れを行っているので、
外気の巻き込みが生じることもなく、シリコンウェハ1
0表面には均一な厚さの酸化膜11,12が得られる。
なお、酸化膜形成後に酸素分圧を1×10-6Torr程度の
低い状態にすると、蒸気圧は低いものの酸化膜表面から
SiO 、SiO2ガスが蒸発して荒れの原因となるので、シリ
コンウェハ10を酸化炉1の下部に移動するまでは適度
な酸素分圧の雰囲気とする。
【0022】本実施例では、シリコンウェハ10の表面
を酸化する場合について説明しているが、非晶質、多結
晶のシリコン層、その他の半導体層の表面を酸化する場
合にも同様に適用できる(以下の実施例でも同様であ
る)。 (b)本発明の第2実施例の説明 上記した実施例では、シリコンウェハ10を酸化炉1内
で加熱領域まで上昇させながらその表面を予備酸化して
いるが、予備酸化方法はこれに限られない。例えば図8
に示すように、シリコンウェハ10をウェハキャリア3
に搭載し、ゲートバルブ6を閉じた直後に、ガス導入管
8から酸素を導入し、その炉内部の圧力を1〜5Torrに
設定し、加熱されたその酸素ガスをシリコンウェハ10
の表面に供給して予備酸化を行ってもよい。
を酸化する場合について説明しているが、非晶質、多結
晶のシリコン層、その他の半導体層の表面を酸化する場
合にも同様に適用できる(以下の実施例でも同様であ
る)。 (b)本発明の第2実施例の説明 上記した実施例では、シリコンウェハ10を酸化炉1内
で加熱領域まで上昇させながらその表面を予備酸化して
いるが、予備酸化方法はこれに限られない。例えば図8
に示すように、シリコンウェハ10をウェハキャリア3
に搭載し、ゲートバルブ6を閉じた直後に、ガス導入管
8から酸素を導入し、その炉内部の圧力を1〜5Torrに
設定し、加熱されたその酸素ガスをシリコンウェハ10
の表面に供給して予備酸化を行ってもよい。
【0023】この場合、図9に示すように、ヒータ2の
下部に副ヒータ9を設けて、800℃程度の温度で予備
酸化するようにしてもよい。その副ヒータ9は、図10
に示すように赤外線(IR)ランプヒータ9Aとして、
熱の制御性を向上させることもできる。さらに、副ヒー
タとして図11に示すように、高周波コイル9Bを設け
ることにより、高周波加熱雰囲気中で予備加熱を行って
も同様な結果が得られる。 (c)本発明のその他の実施例の説明 上記した実施例では、予備酸化と本酸化の工程を同一の
酸化炉1で行うようにしているが、70℃の温度で加熱
された硝酸溶液によりシリコンウェハ10を洗浄するこ
とにより、その表面に予備酸化膜を形成するようにして
もよい。
下部に副ヒータ9を設けて、800℃程度の温度で予備
酸化するようにしてもよい。その副ヒータ9は、図10
に示すように赤外線(IR)ランプヒータ9Aとして、
熱の制御性を向上させることもできる。さらに、副ヒー
タとして図11に示すように、高周波コイル9Bを設け
ることにより、高周波加熱雰囲気中で予備加熱を行って
も同様な結果が得られる。 (c)本発明のその他の実施例の説明 上記した実施例では、予備酸化と本酸化の工程を同一の
酸化炉1で行うようにしているが、70℃の温度で加熱
された硝酸溶液によりシリコンウェハ10を洗浄するこ
とにより、その表面に予備酸化膜を形成するようにして
もよい。
【0024】また、図12に示すように、ロボット13
が設置された搬送室5を介して酸化炉1とCVD炉14
とを隣接し、CVD法により予備酸化を行った後に、減
圧された搬送室5を通してシリコンウェハ10を酸化炉
1に移動するようにしてもよく、CVD法によれば加熱
によるシリコンウェハ10の面荒れが生じることはな
い。なお、図12において符号15は、搬送室5の一部
に接続されたロード/アンロードロック室を示してい
る。
が設置された搬送室5を介して酸化炉1とCVD炉14
とを隣接し、CVD法により予備酸化を行った後に、減
圧された搬送室5を通してシリコンウェハ10を酸化炉
1に移動するようにしてもよく、CVD法によれば加熱
によるシリコンウェハ10の面荒れが生じることはな
い。なお、図12において符号15は、搬送室5の一部
に接続されたロード/アンロードロック室を示してい
る。
【0025】
【発明の効果】以上述べたように本発明によれば、半導
体層の本酸化膜形成の前に極薄い酸化膜を形成している
ので、高温、減圧下で半導体層を酸化する際に、その表
面から半導体原子が蒸発することが抑制され、半導体層
とその上の酸化膜との界面の面荒れを防止できる。ま
た、本酸化は、減圧雰囲気で行っているので、酸化炉で
の平均自由工程が常圧下よりも大きくなり、酸素ガスの
拡散が均一になって酸化を均一に行うことができる。
体層の本酸化膜形成の前に極薄い酸化膜を形成している
ので、高温、減圧下で半導体層を酸化する際に、その表
面から半導体原子が蒸発することが抑制され、半導体層
とその上の酸化膜との界面の面荒れを防止できる。ま
た、本酸化は、減圧雰囲気で行っているので、酸化炉で
の平均自由工程が常圧下よりも大きくなり、酸素ガスの
拡散が均一になって酸化を均一に行うことができる。
【図1】本発明の第1実施例に係る酸化工程を示す断面
図である(その1)。
図である(その1)。
【図2】本発明の第1実施例に係る酸化工程を示す断面
図である(その2)。
図である(その2)。
【図3】本発明の第1実施例に係る酸化工程を示す断面
図である(その3)。
図である(その3)。
【図4】本発明の第1実施例に係る酸化工程を示す断面
図である(その4)。
図である(その4)。
【図5】本発明の第1実施例に係る酸化工程を示す断面
図である(その5)。
図である(その5)。
【図6】本発明の第1実施例により形成された酸化膜の
膜厚の分布図である。
膜厚の分布図である。
【図7】本発明の第1実施例により同時に複数膜のウェ
ハの表面に形成された各酸化膜の膜厚の分布図である。
ハの表面に形成された各酸化膜の膜厚の分布図である。
【図8】本発明の第2実施例の予備酸化膜の形成方法を
示す第1の断面図である。
示す第1の断面図である。
【図9】本発明の第2実施例の予備酸化膜の形成方法を
示す第2の断面図である。
示す第2の断面図である。
【図10】本発明の第2実施例の予備酸化膜の形成方法
を示す第3の断面図である。
を示す第3の断面図である。
【図11】本発明の第2実施例の予備酸化膜の形成方法
を示す第4の断面図である。
を示す第4の断面図である。
【図12】本発明の第3実施例の酸化方法を実施する装
置の概要構成を示す平面構成図である。
置の概要構成を示す平面構成図である。
1 酸化炉 2 ヒータ 3 ウェハキャリア 4 バッファー板 5 ウェハ搬送室 6 ゲートバルブ 7 排気管 8 ガス導入管 9 副ヒータ 9A 赤外線ランプ 9B 高周波コイル 10 シリコンウェハ(半導体層) 11 酸化膜(第一の酸化膜) 12 酸化膜(第二の酸化膜) 13 ロボット 14 CVD炉 15 ロード/アンロードロック室
Claims (5)
- 【請求項1】半導体層の表面に予め第一の酸化膜(11)
を形成した後に、酸化炉(1)内の減圧雰囲気下で熱酸
化によって前記半導体層の上に第二の酸化膜(12)を形
成することを特徴とする半導体装置における酸化膜の形
成方法。 - 【請求項2】前記酸化炉(1)は縦型であって、前記第
一の酸化膜(11)は、前記酸化炉(1)内の下部の第一
の減圧雰囲気下で形成され、かつ、前記第二の酸化膜
(12)は、ヒータ(2)により囲まれた前記酸化炉
(1)内上部の第二の減圧雰囲気下で形成されているこ
とを特徴とする請求項1記載の半導体装置における酸化
膜の形成方法。 - 【請求項3】前記第一の酸化膜(11)を形成する前記第
一の減圧雰囲気は、前記ヒータ(2)よりも低温で前記
半導体層を加熱する副ヒータ(9)により加熱されるこ
とを特徴とする請求項2記載の半導体装置における酸化
膜の形成方法。 - 【請求項4】前記第二の減圧雰囲気は、前記第一の減圧
雰囲気よりも圧力が大きいことを特徴とする請求項2記
載の半導体装置における酸化膜の形成方法。 - 【請求項5】前記第一の酸化膜(11)は、前記半導体層
の硝酸洗浄によるか、又は、化学的気相成長により形成
されることを特徴とする請求項1記載の半導体装置にお
ける酸化膜の形成方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP20965693A JPH0766193A (ja) | 1993-08-24 | 1993-08-24 | 半導体装置における酸化膜の形成方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP20965693A JPH0766193A (ja) | 1993-08-24 | 1993-08-24 | 半導体装置における酸化膜の形成方法 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0766193A true JPH0766193A (ja) | 1995-03-10 |
Family
ID=16576425
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP20965693A Withdrawn JPH0766193A (ja) | 1993-08-24 | 1993-08-24 | 半導体装置における酸化膜の形成方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0766193A (ja) |
Cited By (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6291365B1 (en) | 1999-02-10 | 2001-09-18 | Nec Corporation | Method for manufacturing thin gate silicon oxide layer |
| US6537927B1 (en) * | 1998-11-04 | 2003-03-25 | Hynix Semiconductor, Inc. | Apparatus and method for heat-treating semiconductor substrate |
| JP2004111737A (ja) * | 2002-09-19 | 2004-04-08 | Fasl Japan Ltd | 半導体装置の製造方法 |
| JP2016216297A (ja) * | 2015-05-19 | 2016-12-22 | セイコーエプソン株式会社 | 炭化ケイ素基板および炭化ケイ素基板の製造方法 |
| WO2020059133A1 (ja) * | 2018-09-21 | 2020-03-26 | 株式会社Kokusai Electric | 半導体装置の製造方法、基板処理装置及び記録媒体 |
-
1993
- 1993-08-24 JP JP20965693A patent/JPH0766193A/ja not_active Withdrawn
Cited By (8)
| Publication number | Priority date | Publication date | Assignee | Title |
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| KR20210042979A (ko) * | 2018-09-21 | 2021-04-20 | 가부시키가이샤 코쿠사이 엘렉트릭 | 반도체 장치의 제조 방법, 기판 처리 장치 및 기록 매체 |
| JPWO2020059133A1 (ja) * | 2018-09-21 | 2021-08-30 | 株式会社Kokusai Electric | 半導体装置の製造方法、基板処理装置及びプログラム |
| US12211689B2 (en) | 2018-09-21 | 2025-01-28 | Kokusai Electric Corporation | Method of manufacturing semiconductor device capable of controlling film thickness distribution |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
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