JPH077002A - 半導体ウェーハから副産物を除去する処理方法 - Google Patents

半導体ウェーハから副産物を除去する処理方法

Info

Publication number
JPH077002A
JPH077002A JP5254654A JP25465493A JPH077002A JP H077002 A JPH077002 A JP H077002A JP 5254654 A JP5254654 A JP 5254654A JP 25465493 A JP25465493 A JP 25465493A JP H077002 A JPH077002 A JP H077002A
Authority
JP
Japan
Prior art keywords
wafer
water
etching
resist
processing method
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP5254654A
Other languages
English (en)
Inventor
J Syverson Daniel
ジェイ.サイバーソン ダニエル
Brynne K Bohannon
ケイ.ボハノン ブライン
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Texas Instruments Inc
Tel Manufacturing and Engineering of America Inc
Original Assignee
FSI International Inc
Texas Instruments Inc
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by FSI International Inc, Texas Instruments Inc filed Critical FSI International Inc
Publication of JPH077002A publication Critical patent/JPH077002A/ja
Pending legal-status Critical Current

Links

Classifications

    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10PGENERIC PROCESSES OR APPARATUS FOR THE MANUFACTURE OR TREATMENT OF DEVICES COVERED BY CLASS H10
    • H10P95/00Generic processes or apparatus for manufacture or treatments not covered by the other groups of this subclass
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10PGENERIC PROCESSES OR APPARATUS FOR THE MANUFACTURE OR TREATMENT OF DEVICES COVERED BY CLASS H10
    • H10P70/00Cleaning of wafers, substrates or parts of devices
    • H10P70/20Cleaning during device manufacture
    • H10P70/27Cleaning during device manufacture during, before or after processing of conductive materials, e.g. polysilicon or amorphous silicon layers
    • H10P70/273Cleaning during device manufacture during, before or after processing of conductive materials, e.g. polysilicon or amorphous silicon layers the processing being a delineation of conductive layers, e.g. by RIE
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10PGENERIC PROCESSES OR APPARATUS FOR THE MANUFACTURE OR TREATMENT OF DEVICES COVERED BY CLASS H10
    • H10P50/00Etching of wafers, substrates or parts of devices
    • H10P50/20Dry etching; Plasma etching; Reactive-ion etching
    • H10P50/28Dry etching; Plasma etching; Reactive-ion etching of insulating materials
    • H10P50/286Dry etching; Plasma etching; Reactive-ion etching of insulating materials of organic materials
    • H10P50/287Dry etching; Plasma etching; Reactive-ion etching of insulating materials of organic materials by chemical means
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10PGENERIC PROCESSES OR APPARATUS FOR THE MANUFACTURE OR TREATMENT OF DEVICES COVERED BY CLASS H10
    • H10P50/00Etching of wafers, substrates or parts of devices
    • H10P50/71Etching of wafers, substrates or parts of devices using masks for conductive or resistive materials

Landscapes

  • Drying Of Semiconductors (AREA)
  • Photosensitive Polymer And Photoresist Processing (AREA)
  • Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)
  • Exposure Of Semiconductors, Excluding Electron Or Ion Beam Exposure (AREA)

Abstract

(57)【要約】 【目的】 半導体基板上のデバイスからその製造中に有
用金属を取り去ることなく側壁ポリマーのような副産物
を除去する処理方法を提供する。 【構成】 例えば、拡散エンハンストシリレート化レジ
ストプロセスに従い半導体ウェーハ1上にデバイスを製
造中、そのエッチング最終ステップ後に、ウェーハ1を
収容しているチェンバに無水HF蒸気を導入し、次いで
(ここにxは実数)ガスを導入し、エッチング
結果の非水溶性副産物6、2を反応により水溶性化し、
その後に水すすぎしてこの副産物だけを除去する。デバ
イスの金属M2は変化しない。無水HFは水性HFを蒸
発して作られ、Nは窒素を水に通過させて得ら
れ、気相処理であるのでウェーハ気相クリーナ内でプロ
グラム制御可能である。DMDの有害側壁ポリマー除去
にも極めて有効である。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は、半導体基板上にデバイ
スを製造する技術、特に、超大規模集積回路(以下、U
LSIと称する)製造において側壁ポリマーのような副
産物を除去するプロセスに関する。
【0002】
【従来の技術】半導体ウェーハ上に製造されるデバイス
の密度は、16メガビット(MB)のダイナミックアク
セスメモリ(以下、DRAMと称する)に現在採用され
ているULSIと共にここ数年にわたり着実に向上して
いる。この傾向に伴い、特徴寸法は縮小しており(現在
0.5μm以下)かつプロセス技術に対する要求は増大
している。このような小さな特徴をパターン化するため
に、従来のリソグラフィ手順は、拡散エンハンストシリ
レート化レジスト(diffusion en−han
ced silylated resist;DESI
RETMと略称される)に基づく新しい手順に取って代
わられつつある。1ラインかつ深紫外放射露出を使用す
る、種々のレジスト内のサブハーフミクロン特徴の生産
における拡散エンハンストシリレート化プロセスの成功
についての多数の報告は、このプロセスが明るい未来を
有する徴候を示している。画像転写ステップまでの分解
能及びスループットの率は、従来のポジティブレジスト
のそれを超え、かつトポグラフィが重要関連事項である
場合は明らかに後者より高い。拡散エンハンストシリレ
ート化レジストプロセスの場合は、製造中のデバイスの
垂直壁上の側壁ポリマー(SWPとも称する)のような
エッチング副産物が多量に生じる結果、従来の方法に比
べて、そのレジストを除去するのが幾分困難である。こ
れらの副産物は、一般にポリマーと称され、一般に金属
分子と二酸化シリコン(SiO)分子を含む。例え
ば、その分子は、そのホトレジストからの炭素、金属層
及び二酸化シリコンからの金属を含むことがある。更
に、データの示す所によれば、側壁ポリマーはケイ酸ア
ルミニウム及び極く少量の過フッ化炭化水素を含んでい
る。過フッ化炭化水素は不燃性であり、かつそれゆえ、
金属エッチングでの現場酸素送入灰化順序中には除かれ
ない。したがって、このホトレジストからの副産物内の
高炭素含有量のために、灰化は有効でないことを証明し
ている。レジストを除去することに関する困難性は、こ
れがサブハーフミクロン級特徴の発生に厳しい障害であ
ることを証明している。先行技術においては、溶剤/超
音波攪拌が側壁ポリマーを除去するのに使用されてい
る。例えば、製造中のデバイスをエタノールアミン溶液
に浸け、続いてオブショナルに(超音波の出力を調整す
る能力がある)ネイ(Ney)超音波装置を使用してこ
れを超音波攪拌することが過去に使用されている。しか
しながら、これらの技術は、アルミニウムのような金属
をその最小特徴から取り去る傾向があるので、使用不能
であることを証明している。更に、これらの技術は、デ
バイス側壁上及びデバイス表面上に可なりの量の残留物
質を残す傾向がある。いままでの所、拡散エンハンスト
シリレート化レジストプロセスから結果する側壁ポリマ
ーを除去すると云う問題を解決する有効な手段は、間に
合っていない。
【0003】
【発明が解決しようとする課題】本発明の目的は、半導
体基板上のデバイスから、金属を取り去ることなく、側
壁ポリマーのような副産物を除去するプロセスを提供す
ることにある。
【0004】
【課題を解決するための手段】本発明は、半導体ウェー
ハ上にデバイスを製造中、そのエッチング最終ステップ
後に、このウェーハを収容しているチェンバに無水HF
蒸気を導入し、次いでN(ここにxは実数)ガス
を導入し、エッチング結果の副産物を反応により水溶性
化し、その後に水すすぎしてこの副産物だけを除去す
る。なお、水性HFを蒸発して無水HFを作り、窒素を
水に通過させてNを得る。
【0005】
【実施例】次に本発明を図1から図8を参照して説明す
る。これらの図のうち図1から図5は、拡散エンハンス
トシリレート化レジストプロセスに従って製造中の半導
体ウェーハの横断面をステップ順に示し、参照符号は次
の図に持ち送りされる。
【0006】その製造順序において、最近、DRAMの
ような特殊のデバイスは、所望の回路機能を達成するた
めに電気的に相互接続される必要がある。この相互接続
の1つの重要な態様は、金属層M2として従来から知ら
れる、このデバイスの製造における第1相互接続レベル
及び最終レベルに関連する。図1の断面図に示されたM
2方式は、従来は、二酸化シリコン層とこれに続く金属
層M2を含み、金属層M2は、一般に、チンタン−タン
グステン(TiW)層、その上のタングステン(W)、
その上のアルミニウム合金を含み、後者は1%のシリコ
ンと0.5%の銅を含む。図1から図5を参照すると、
これらの図は拡散エンハンストシリレート化レジストプ
ロセスに従って製造中の半導体ウェーハ1の断面図を示
し、これらの図を参照すると、このプロセスは、次のと
おりである。ノボラック基材レジン層のようなポジティ
ブレジスト層2は、従来のようにスピンコートされ、か
つこれに続くマスク4、レジスト層2を通しての露出後
に、現像に先立ちヘキサメチルジシラジン蒸気(以下、
HMDSと称する)で処理される。シリレート化(si
lylation)反応は、この露出レジストの表面を
変態させ、酸素プラズマによるトライエッチングに付さ
れ難い領域6を生じる。このことが、このレジストの正
常な現像行動を反転させて、ネカティブ画像を発生させ
る。非露出(したがって反転しなかった)レジストをド
ライエッチングすることの主要な利点は、これが好まし
くないスェリングを妨げ、かつウェットエッチング現像
にしばしば伴う分解能の付随的な損失を妨げると云うこ
とである。図3に示されたように、酸素プラズマエッチ
ングは、非露出レジストをエッチング除去する。そのパ
ターンをこの金属に転写するために、このウェーハを異
方性反応イオンエッチング(RIEとも称する)で以て
エッチングする。使用される化学作用は、アルミニウム
合金をエッチングするCl/BCl、これに続いて
W及びTiWをエッチングするSF/Arである。図
4に示されているように、実質的垂直壁で以て構成され
る微細ライン幾何学配置が得られる。エッチングにおけ
る最終ステップは、現場灰化であって、これは侵食を演
じる塩素含有化合物を酸化することによって侵食を抑制
しかつバルクレジストマスクとして機能する領域6を除
去する。このエッチングは、二酸化シリコン層に対して
20:1より大きい選択性を有する。このエッチング
は、このプロセス中に不揮発性側壁ポリマーがエッチン
グされつつある表面に堆積してその下のこの表面を反応
ガスによるエッチングから保護する。残りのレジスト及
び側壁ポリマーのストリッピングは、このレベルに対す
るプロセスの流れにおける最終ステップである。本発明
のプロセスは、気相プロセスであって、無水HF及びN
を含み、ここに、xは実数であり(Nは窒
素を水に通すことによって得られる)、プロセスの対称
のウェーハを収容するチャンバ内に導入され、これらは
反応して水溶性のエッチング副産物を作る。これらの副
産物が水溶性の性質を獲得した後、水をこのウェーハに
掛けてこの副産物をすすぎ流す。注目するのは、水性H
Fを無水HFで置換できること、すなわち、水性HFか
ら蒸気HFを作り、かつこれを上述のNと反応さ
せると云うことである。気相処理は、これが水性相又は
液相処理のように金属を腐食しないと云うことにおい
て、利点及び他の型式の処理を提供する。実験データの
示す所では、本発明に従う処理の後その金属上の面積抵
抗は変化せず、これによって処理中の反応は金属に無害
である。更に、処理の結果からの二酸化シリコン層へ損
傷を、蒸気を調整することを通して制御することかでき
る。本発明のプロセスは、ウェーハ気相クリーナを使用
して完成され得る。ウェーハ気相クリーナは、ウェーハ
から酸化物を除去する機械である。ウェーハ気相クリー
ナには、アドバンテージ(Advantage)、エク
ィノックス(Equinox)、及びエックスキャリバ
ー(Excaliber)各機械、並びに、DNSによ
る蒸気HFツール、VPC−811−Aがある。いまま
での所、上に論じた型式の副産物を除去するためにウェ
ーハ気相クリーナが使用されたことはない。本発明のプ
ロセスが持たらすコスト低減は、現行の溶剤処理方法が
ウェーハ当たり約1.50ドルであるのに比べてウエー
ハ当たり約0.03セントであると現在の所期待されて
いる。加えて、本発明に関連する安全上の利点は、付随
的には希釈することのできない溶剤の場合に比べて、事
実上排気物処分を伴わないと云うことである。
【0007】本発明の好適実施例を示すプロセスの流れ
を、下に掲げる。
【0008】エックスキャリバー機械のような、ウェー
ハ気相クリーナ内において、拡散エンハンストシリレー
ト化レジストプロセスに従い処理されたウェーハは、密
閉エッチングチャンバ内でエッチングされ、次いで、こ
のチャンバが垂直に移動させてことによってすすぎ位置
へ転送され、このウェーハ気相クリーナのすすぎ空洞に
露出される。エッチング位置及びすすぎ位置に対する2
つの分離したプロセスは、次のとおりである:
【0009】エツチング位置 ステップ0 ウェーハをチャンバ内に挿入した後に、
チャンバを30(l/min)の流量の窒素で5秒間洗
浄する。 ステップ1 プロセス窒素流量を5秒間12(l/m
in)に安定化しかつチャンバ圧力を6.47kPaに
制御する。 ステップ2 水坦持窒素を2(l/min)の流量で
10秒間添加する。これによって、水の薄層をウェーハ
表面上に凝縮させる。 ステップ3 無水HFを180cc/minの流量で
他のガスに添加する。窒素流量を担体ガスに対して16
(l/min)及び水蒸気に対して10(l/min)
へそれぞれ変化させる。総エッチング時間は5秒。この
ステップ中、酸化物が除去され、ウェーハ表面上に不揮
発性材料を残す。 ステップ4 15秒間チャンバを高速窒素22(l/
min)と水蒸気10(l/min)で洗浄して、反応
を停止させかつチャンバの反応物質を洗浄する。 ステップ5、6 エッチング位置からすすぎ位置への
遷移ステップ。
【0010】すすぎ位置 ステップ0 位置を安定化する1秒間。 ステップ1 10秒間、100rpmのスピン速度で
ウェーハを脱イオン水ですすぐ。水溶性金属フッ化物が
このステップで除去される。 ステップ2 ドライスピン速度に上昇する前に、水す
すぎを断続してウェーハ上の水を除去する。プロセス時
間は約1分。 ステップ3 3,000rpmに上昇してウェーハを
乾燥しかつ窒素ガス流量を30(l/min)に増大す
る。ウェーハは15秒内に乾燥させる。
【0011】エックスキャリバー機械を使用するプロセ
スプログラムの1例を下に掲げる。注意するのは、これ
らのエツチング及びすすぎブロセス処方は例に過ぎず、
これと同じ処方を使用しなくてもいろいろと最適なプロ
セス処方があると云うことである。
【0012】
【表1】
【0013】上に説明されたプロセスを使用することの
できる1つの応用は、変形性ミラー(以下、DMDと称
する)に関連する。図6は、DMDが形成される積層8
の断面図である。この積層は、バルク半導体層9、CM
OSアドレス指定回路機構10、ホトレジト層12、金
属層14を含む。図7を参照すると、この図は部分的に
形成されたDMDデバイスの横断面図を示しており、周
知のDMD形成技術に従って、図6に示された金属層1
4をエッチングした結果、ヒンジ16がミラー18に接
続されて形成される。ヒンジ16は金属柱20に接続さ
れ、これらの金属柱は、CMOSアドレス指定回路機構
10(破線によって示されている)のレベルまで下へ延
びるバイアを通して、形成される。参照符号21は、こ
れらのDMDデバイスの製造中に生じた側壁ポリマーを
指示する。ホトレジスト層12をエッチング除去した
後、側壁ボリマーを21は更に大きくなって存在するこ
とさえある。この側壁ポリマーは、DMD機能性にとっ
て次のような点において特に厄介な問題を持たらす、す
なわち、これらの側壁ポリマーはホトレジスト層12を
除去した後CMOSアドレス指定回路機構10と接触す
るようにこれがミラー18の(そのページ内への又は外
への)スイベル動作に干渉することがある。図8を参照
すると、この図は、本発明のプロセスに従い完成された
DMDデバイスの断面図を示しており、図7のホトレジ
ズト層12を除去した後、本発明の側壁ポリマー除去プ
ロセスを使用して側壁ポリマーを除去し、これによって
DMDデバイスの生産歩留りを極めて向上する。
【0014】本発明は、その好適実施例及びその或る代
替実施例を参照してここに詳細に説明されたが、云うま
でもなくこの説明は例によっている過ぎず、限定的な意
味に解釈するべきではない。本発明は、拡散エンハンス
トシリレート化レジストプロセスを参照して幾つかの態
様において説明されたが、云うまでもはく、本発明をど
んなホトレジストプロセスにも使用できる。更に、云う
までもなく、本発明の実施例の細部における変更、及び
本発明の追加の実施例が、この説明を参照した通常の技
術の習熟者にとって明白であり、及び作成可能である。
全てのこのような変更及び追加実施例は、上に掲げた本
発明の精神と範囲内にあると考える。
【0015】以上の説明に関し更に以下の項を開示す
る。
【0016】(1) 半導体ウェーハから副産物を除去
する処理方法であって、前記半導体ウェーハ上に非水溶
性副産物を含む前記半導体ウェーハを収容するチャンバ
内にHFを導入するステップと、前記チャンバ内にxが
実数であるNを導入するステップと、前記HFを
導入するステップと、前記Nを導入するステップ
とを実施した後に、前記ウェーハから溶解性副産物を除
去するステップとを含む処理方法。
【0017】(2) 第1項記載の処理方法において、
前記HFは無水である、処理方法。
【0018】(3) 第1項記載の処理方法において、
前記Nは窒素を水の上に通過させることによって
形成される、処理方法。
【0019】(4) 第1項記載の処理方法において、
前記HFは水性HFから作られた蒸気HFである、処理
方法。
【0020】(5) 第1項記載の処理方法であって、
ウェーハ気相クリーナ内において実行される処理方法。
【0021】(6) 変形性ミラーデバイスの柱から側
壁ポリマーを除去する処理方法であって、前記デバイス
上に非水溶性副産物を含む前記デバイスを収容するチャ
ンバ内にHFを導入するステップと、前記チャンバ内に
xが実数であるNを導入するステップと、前記H
Fを導入するステップと、前記Nを導入するステ
ップとを実施した後に、前記デバイスから溶解性副産物
を除去するステップとを含む処理方法。
【0022】(7) 第6項記載の処理方法であって、
ウェーハ気相クリーナ内において実行される処理方法。
【0023】(8) 金属選択的にポリマーを除去する
処理方法であって、ULSI製造に特に使用されるのに
適した金属が取り去られのを防止する処理方法が開示さ
れる。
【図面の簡単な説明】
【図1】拡散エンハンストシリレート化レジストプロセ
スに従い製造中の半導体ウェーハのHMDSへの露出ス
テップにおける断面図。
【図2】図2のHMDS露出結果のシリレート化後のス
テップにおける半導体ウェーハの断面図。
【図3】拡散エンハンストシリレート化レジストプロセ
スに従い製造中の半導体ウェーハの酸素プラズマエッチ
ングステップ後における断面図。
【図4】拡散エンハンストシリレート化レジストプロセ
スに従い製造中の半導体ウェーハのドライエッチングス
テップ後における断面図。
【図5】図5の半導体ウェーハに本発明により副産物を
除去するプロセスを施した後のウェーハの断面図。
【図6】DMD形成用積層の断面図
【図7】図6の積層中に部分的にDMDを形成したとき
の断面図
【図8】本発明により側壁ポリマーを除去するプロセス
を施された後の完成されたDMDの断面図。
【符号の説明】
1 半導体ウェーハ M2 金属層 2 ホトジスト層 4 マスク 6 (バルクレジストマスクとして機能する)領域 9 DMD用積層 9 半導体層 10 CMOSアドレス指定回路機構 12 ホトレジスト層 14 金属層 16 ヒンジ 18 ミラー 20 金属柱 21 側壁ポリマー
─────────────────────────────────────────────────────
【手続補正書】
【提出日】平成5年10月8日
【手続補正1】
【補正対象書類名】明細書
【補正対象項目名】全文
【補正方法】変更
【補正内容】
【書類名】 明細書
【発明の名称】 半導体ウェーハから副産物を除去する
処理方法
【特許請求の範囲】
【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は、半導体基板上にデバイ
スを製造する技術、特に、超大規模集積回路(以下、U
LSIと称する)製造において側壁ポリマーのような副
産物を除去するプロセスに関する。
【0002】
【従来の技術】半導体ウェーハ上に製造されるデバイス
の密度は、16メガビット(MB)のダイナミックアク
セスメモリ(以下、DRAMと称する)に現在採用され
ているULSIと共にここ数年にわたり着実に向上して
いる。この傾向に伴い、特徴寸法は縮小しており(現在
0.5μm以下)かつプロセス技術に対する要求は増大
している。このような小さな特徴をパターン化するため
に、従来のリソグラフィ手順は、拡散エンハンストシリ
レート化レジスト(diffusion en−han
ced silylated resist;DESI
RETMと略称される)に基づく新しい手順に取って代
わられつつある。1ラインかつ深紫外放射露出を使用す
る、種々のレジスト内のサブハーフミクロン特徴の生産
における拡散エンハンストシリレート化プロセスの成功
についての多数の報告は、このプロセスが明るい未来を
有する徴候を示している。画像転写ステップまでの分解
能及びスループットの率は、従来のポジティブレジスト
のそれを超え、かつトポグラフィが重要関連事項である
場合は明らかに後者より高い。拡散エンハンストシリレ
ート化レジストプロセスの場合は、製造中のデバイスの
垂直壁上の側壁ポリマー(SWPとも称する)のような
エッチング副産物が多量に生じる結果、従来の方法に比
べて、そのレジストを除去するのが幾分困難である。こ
れらの副産物は、一般にポリマーと称され、一般に金属
分子と二酸化シリコン(SiO)分子を含む。例え
ば、その分子は、そのホトレジストからの炭素、金属層
及び二酸化シリコンからの金属を含むことがある。更
に、データの示す所によれば、側壁ポリマーはケイ酸ア
ルミニウム及び極く少量の過フッ化炭化水素を含んでい
る。過フッ化炭化水素は不燃性であり、かつそれゆえ、
金属エッチングでの現場酸素送入灰化順序中には除かれ
ない。したがって、このホトレジストからの副産物内の
高炭素含有量のために、灰化は有効でないことを証明し
ている。レジストを除去することに関する困難性は、こ
れがサブハーフミクロン級特徴の発生に厳しい障害であ
ることを証明している。先行技術においては、溶剤/超
音波撹拌が側壁ポリマーを除去するのに使用されてい
る。例えば、製造中のデバイスをエタノールアミン溶液
に浸け、続いてオプショナルに(超音波の出力を調整す
る能力がある)ネイ(Ney)超音波装置を使用してこ
れを超音波撹拌することが過去に使用されている。しか
しながら、これらの技術は、アルミニウムのような金属
をその最小特徴から取り去る傾向があるので、使用不能
であることを証明している。更に、これらの技術は、デ
バイス側壁上及びデバイス表面上に可なりの量の残留物
質を残す傾向がある。いままでの所、拡散エンハンスト
シリレート化レジストプロセスから結果する側壁ポリマ
ーを除去すると云う問題を解決する有効な手段は、間に
合っていない。
【0003】
【発明が解決しようとする課題】本発明の目的は、半導
体基板上のデバイスから、金属を取り去ることなく、側
壁ポリマーのような副産物を除去するプロセスを提供す
ることにある。
【0004】
【課題を解決するための手段】本発明は、半導体ウェー
ハ上にデバイスを製造中、そのエッチング最終ステップ
後に、このウェーハを収容しているチェンバに無水HF
蒸気を導入し、次いでN(ここにxは実数)ガス
を導入し、エッチング結果の副産物を反応により水溶性
化し、その後に水すすぎしてこの副産物だけを除去す
る。なお、水性HFを蒸発して無水HFを作り、窒素を
水に通過させてNを得る。
【0005】
【実施例】次に本発明を図1から図8を参照して説明す
る。これらの図のうち図1から図5は、拡散エンハンス
トシリレート化レジストプロセスに従って製造中の半導
体ウェーハの横断面をステップ順に示し、参照符号は次
の図に持ち送りされる。
【0006】その製造順序において、最近、DRAMの
ような特殊のデバイスは、所望の回路機能を達成するた
めに電気的に相互接続される必要がある。この相互接続
の1つの重要な態様は、金属層M2として従来から知ら
れる、このデバイスの製造における第1相互接続レベル
及び最終レベルに関連する。図1の断面図に示されたM
2方式は、従来は、二酸化シリコン層とこれに続く金属
層M2を含み、金属層M2は、一般に、チンタン−タン
グステン(TiW)層、その上のタングステン(W)、
その上のアルミニウム合金を含み、後者は1%のシリコ
ンと0.5%の銅を含む。図1から図5を参照すると、
これらの図は拡散エンハンストシリレート化レジストプ
ロセスに従って製造中の半導体ウェーハ1の断面図を示
し、これらの図を参照すると、このプロセスは、次のと
おりである。ノボラック基材レジン層のようなポジティ
ブレジスト層2は、従来のようにスピンコートされ、か
つこれに続くマスク4、レジスト層2を通しての露出後
に、現像に先立ちヘキサメチルジシラジン蒸気(以下、
HMDSと称する)で処理される。シリレート化(si
lylation)反応は、この露出レジストの表面を
変態させ、酸素プラズマによるドライエッチングに付さ
れ難い領域6を生じる。このことが、このレジストの正
常な現像行動を反転させて、ネガティブ画像を発生させ
る。非露出(したがって反転しなかった)レジストをド
ライエッチングすることの主要な利点は、これが好まし
くないスェリングを妨げ、かつウェットエッチング現像
にしばしば伴う分解能の付随的な損失を妨げると云うこ
とである。図3に示されたように、酸素プラズマエッチ
ングは、非露出レジストをエッチング除去する。そのパ
ターンをこの金属に転写するために、このウェーハを異
方性反応イオンエッチング(RIEとも称する)で以て
エッチングする。使用される化学作用は、アルミニウム
合金をエッチングするCl/BCl、これに続いて
W及びTiWをエッチングするSF/Arである。図
4に示されているように、実質的垂直壁で以て構成され
る微細ライン幾何学配置が得られる。エッチングにおけ
る最終ステップは、現場灰化であって、これは侵食を演
じる塩素含有化合物を酸化することによって侵食を抑制
しかつバルクレジストマスクとして機能する領域6を除
去する。このエッチングは、二酸化シリコン層に対して
20:1より大きい選択性を有する。このエッチング
は、このプロセス中に不揮発性側壁ポリマーがエッチン
グされつつある表面に堆積してその下のこの表面を反応
ガスによるエッチングから保護する。残りのレジスト及
び側壁ポリマーのストリッピングは、このレベルに対す
るプロセスの流れにおける最終ステップである。本発明
のプロセスは、気相プロセスであって、無水HF及びN
を含み、ここに、xは実数であり(Nは窒
素を水に通すことによって得られる)、プロセスの対称
のウェーハを収容するチャンバ内に導入され、これらは
反応して水溶性のエッチング副産物を作る。これらの副
産物が水溶性の性質を獲得した後、水をこのウェーハに
掛けてこの副産物をすすぎ流す。注目するのは、水性H
Fを無水HFで置換できること、すなわち、水性HFか
ら蒸気HFを作り、かつこれを上述のNと反応さ
せると云うことである。気相処理は、これが水性相又は
液相処理のように金属を腐食しないと云うことにおい
て、利点及び他の型式の処理を提供する。実験データの
示す所では、本発明に従う処理の後その金属上の面積抵
抗は変化せず、これによって処理中の反応は金属に無害
である。更に、処理の結果からの二酸化シリコン層へ損
傷を、蒸気を調整することを通して制御することができ
る。本発明のプロセスは、ウェーハ気相クリーナを使用
して完成され得る。ウェーハ気相クリーナは、ウェーハ
から酸化物を除去する機械である。ウェーハ気相クリー
ナには、アドバンテージ(Advantage)、エク
イノックス(Equinox)、及びエックスキャリバ
ー(Excaliber)各機械、並びに、DNSによ
る蒸気HFツール、VPC−811−Aがある。いまま
での所、上に論じた型式の副産物を除去するためにウェ
ーハ気相クリーナが使用されたことはない。本発明のプ
ロセスが持たらすコスト低減は、現行の溶剤処理方法が
ウェーハ当たり約1.50ドルであるのに比べてウェー
ハ当たり約0.03セントであると現在の所期待されて
いる。加えて、本発明に関連する安全上の利点は、付随
的には希釈することのできない溶剤の場合に比べて、事
実上排気物処分を伴わないと云うことである。
【0007】本発明の好適実施例を示すプロセスの流れ
を、下に掲げる。
【0008】エックスキャリバー機械のような、ウェー
ハ気相クリーナ内において、拡散エンハンストシリレー
ト化レジストプロセスに従い処理されたウェーハは、密
閉エッチングチャンバ内でエッチングされ、次いで、こ
のチャンバが垂直に移動させてことによってすすぎ位置
へ転送され、このウェーハ気相クリーナのすすぎ空洞に
露出される。エッチング位置及びすすぎ位置に対する2
つの分離したプロセスは、次のとおりである:
【0009】エッチング位置 ステップ0 ウェーハをチャンバ内に挿入した後に、
チャンバを30(l/min)の流量の窒素で5秒間洗
浄する。 ステップ1 プロセス窒素流量を5秒間12(l/m
in)に安定化しかつチャンバ圧力を6.47kPaに
制御する。 ステップ2 水坦持窒素を2(l/min)の流量で
10秒間添加する。これによって、水の薄層をウェーハ
表面上に凝縮させる。 ステップ3 無水HFを180cc/minの流量で
他のガスに添加する。窒素流量を担体ガスに対して16
(l/min)及び水蒸気に対して10(l/min)
へそれぞれ変化させる。総エッチング時間は5秒。この
ステップ中、酸化物が除去され、ウェーハ表面上に不揮
発性材料を残す。 ステップ4 15秒間チャンバを高速窒素22(l/
min)と水蒸気10(l/min)で洗浄して、反応
を停止させかつチャンバの反応物質を洗浄する。 ステップ5、6 エッチング位置からすすぎ位置への
遷移ステップ。
【0010】すすぎ位置 ステップ0 位置を安定化する1秒間。 ステップ1 10秒間、100rpmのスピン速度で
ウェーハを脱イオン水ですすぐ。水溶性金属フッ化物が
このステップで除去される。 ステップ2 ドライスピン速度に上昇する前に、水す
すぎを断続してウェーハ上の水を除去する。プロセス時
間は約1分。 ステップ3 3,000rpmに上昇してウェーハを
乾燥しかつ窒素ガス流量を30(l/min)に増大す
る。ウェーハは15秒内に乾燥させる。
【0011】エックスキャリバー機械を使用するプロセ
スプログラムの1例を下に掲げる。注意するのは、これ
らのエッチング及びすすぎプロセス処方は例に過ぎず、
これと同じ処方を使用しなくてもいろいろと最適なプロ
セス処方があると云うことである。
【0012】
【表1】
【0013】上に説明されたプロセスを使用することの
できる1つの応用は、変形性ミラー(以下、DMDと称
する)に関連する。図6は、DMDが形成される積層8
の断面図である。この積層は、バルク半導体層9、CM
OSアドレス指定回路機構10、ホトレジト層12、金
属層14を含む。図7を参照すると、この図は部分的に
形成されたDMDデバイスの横断面図を示しており、周
知のDMD形成技術に従って、図6に示された金属層1
4をエッチングした結果、ヒンジ16がミラー18に接
続されて形成される。ヒンジ16は金属柱20に接続さ
れ、これらの金属柱は、CMOSアドレス指定回路機構
10(破線によって示されている)のレベルまで下へ延
びるバイアを通して、形成される。参照符号21は、こ
れらのDMDデバイスの製造中に生じた側壁ポリマーを
指示する。ホトレジスト層12をエッチング除去した
後、側壁ポリマーを21は更に大きくなって存在するこ
とさえある。この側壁ポリマーは、DMD機能性にとっ
て次のような点において特に厄介な問題を持たらす、す
なわち、これらの側壁ポリマーはホトレジスト層12を
除去した後CMOSアドレス指定回路機構10と接触す
るようにこれがミラー18の(そのページ内への又は外
への)スイベル動作に干渉することがある。図8を参照
すると、この図は、本発明のプロセスに従い完成された
DMDデバイスの断面図を示しており、図7のホトレジ
ズト層12を除去した後、本発明の側壁ポリマー除去プ
ロセスを使用して側壁ポリマーを除去し、これによって
DMDデバイスの生産歩留りを極めて向上する。
【0014】本発明は、その好適実施例及びその或る代
替実施例を参照してここに詳細に説明されたが、云うま
でもなくこの説明は例によっている過ぎず、限定的な意
味に解釈するべきではない。本発明は、拡散エンハンス
トシリレート化レジストプロセスを参照して幾つかの態
様において説明されたが、云うまでもはく、本発明をど
んなホトレジストプロセスにも使用できる。更に、云う
までもなく、本発明の実施例の細部における変更、及び
本発明の追加の実施例が、この説明を参照した通常の技
術の習熟者にとって明白であり、及ひ作成可能である。
全てのこのような変更及び追加実施例は、上に掲げた本
発明の精神と範囲内にあると考える。
【0015】以上の説明に関し更に以下の項を開示す
る。
【0016】(1) 半導体ウェーハから副産物を除去
する処理方法であって、前記半導体ウェーハ上に非水溶
性副産物を含む前記半導体ウェーハを収容するチャンバ
内にHFを導入するステップと、前記チャンバ内にxが
実数であるNを導入するステップと、前記HFを
導入するステップと、前記Nを導入するステップ
とを実施した後に、前記ウェーハから溶解性副産物を除
去するステップとを含む処理方法。
【0017】(2) 第1項記載の処理方法において、
前記HFは無水である、処理方法。
【0018】(3) 第1項記載の処理方法において、
前記Nは窒素を水の上に通過させることによって
形成される、処理方法。
【0019】(4) 第1項記載の処理方法において、
前記HFは水性HFから作られた蒸気HFである、処理
方法。
【0020】(5) 第1項記載の処理方法であって、
ウェーハ気相クリーナ内において実行される処理方法。
【0021】(6) 変形性ミラーデバイスの柱から側
壁ポリマーを除去する処理方法であって、前記デバイス
上に非水溶性副産物を含む前記デバイスを収容するチャ
ンバ内にHFを導入するステップと、前記チャンバ内に
xが実数であるNを導入するステップと、前記H
Fを導入するステップと、前記Nを導入するステ
ップとを実施した後に、前記デバイスから溶解性副産物
を除去するステップとを含む処理方法。
【0022】(7) 第6項記載の処理方法であって、
ウェーハ気相クリーナ内において実行される処理方法。
【0023】(8) 金属選択的にポリマーを除去する
処理方法であって、ULSI製造に特に使用されるのに
適した金属が取り去られのを防止する処理方法が開示さ
れる。
【図面の簡単な説明】
【図1】拡散エンハンストシリレート化レジストプロセ
スに従い製造中の半導体ウェーハのHMDSへの露出ス
テップにおける断面図。
【図2】図2のHMDS露出結果のシリレート化後のス
テップにおける半導体ウェーハの断面図。
【図3】拡散エンハンストシリレート化レジストプロセ
スに従い製造中の半導体ウェーハの酸素プラズマエッチ
ングステップ後における断面図。
【図4】拡散エンハンストシリレート化レジストプロセ
スに従い製造中の半導体ウェーハのドライエッチングス
テップ後における断面図。
【図5】図5の半導体ウェーハに本発明により副産物を
除去するプロセスを施した後のウエーハの断面図。
【図6】DMD形成用積層の断面図。
【図7】図6の積層中に部分的にDMDを形成したとき
の断面図。
【図8】本発明により側壁ポリマーを除去するプロセス
を施された後の完成されたDMDの断面図。
【符号の説明】 1 半導体ウェーハ M2 金属層 2 ホトジスト層 4 マスク 6 (バルクレジストマスクとして機能する)領域 9 DMD用積層 9 半導体層 10 CMOSアドレス指定回路機構 12 ホトレジスト層 14 金属層 16 ヒンジ 18 ミラー 20 金属柱 21 側壁ポリマー
───────────────────────────────────────────────────── フロントページの続き (51)Int.Cl.6 識別記号 庁内整理番号 FI 技術表示箇所 H01L 21/302 P

Claims (1)

    【特許請求の範囲】
  1. 【請求項1】 半導体ウェーハから副産物を除去する処
    理方法であって、 前記半導体ウェーハ上に非水溶性副産物を含む前記半導
    体ウェーハを収容するチャンバ内にHFを導入するステ
    ップと、 前記チャンバ内にxが実数であるNを導入するス
    テップと、 前記HFを導入するステップと、前記Nを導入す
    るステップとを実施した後に、前記ウェーハから溶解性
    副産物を除去するステップとを含む処理方法。
JP5254654A 1992-09-03 1993-09-03 半導体ウェーハから副産物を除去する処理方法 Pending JPH077002A (ja)

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
US940101 1992-09-03
US07/940,101 US5348619A (en) 1992-09-03 1992-09-03 Metal selective polymer removal

Publications (1)

Publication Number Publication Date
JPH077002A true JPH077002A (ja) 1995-01-10

Family

ID=25474228

Family Applications (1)

Application Number Title Priority Date Filing Date
JP5254654A Pending JPH077002A (ja) 1992-09-03 1993-09-03 半導体ウェーハから副産物を除去する処理方法

Country Status (6)

Country Link
US (2) US5348619A (ja)
EP (1) EP0585936B1 (ja)
JP (1) JPH077002A (ja)
KR (1) KR100270416B1 (ja)
DE (1) DE69334049T2 (ja)
TW (1) TW241387B (ja)

Families Citing this family (81)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6219015B1 (en) 1992-04-28 2001-04-17 The Board Of Directors Of The Leland Stanford, Junior University Method and apparatus for using an array of grating light valves to produce multicolor optical images
US5814156A (en) * 1993-09-08 1998-09-29 Uvtech Systems Inc. Photoreactive surface cleaning
WO1995007152A1 (en) * 1993-09-08 1995-03-16 Uvtech Systems, Inc. Surface processing
KR100336916B1 (ko) * 1994-02-03 2002-12-02 어플라이드 머티어리얼스, 인코포레이티드 반도체기판의스트립핑,패시베이션및부식반응억제방법
US5703728A (en) * 1994-11-02 1997-12-30 Texas Instruments Incorporated Support post architecture for micromechanical devices
US5650881A (en) * 1994-11-02 1997-07-22 Texas Instruments Incorporated Support post architecture for micromechanical devices
US5967156A (en) * 1994-11-07 1999-10-19 Krytek Corporation Processing a surface
US5931721A (en) 1994-11-07 1999-08-03 Sumitomo Heavy Industries, Ltd. Aerosol surface processing
US5841579A (en) 1995-06-07 1998-11-24 Silicon Light Machines Flat diffraction grating light valve
US5693147A (en) * 1995-11-03 1997-12-02 Motorola, Inc. Method for cleaning a process chamber
US5755891A (en) * 1997-01-24 1998-05-26 Taiwan Semiconductor Manufacturing Company Ltd. Method for post-etching of metal patterns
US5882535A (en) * 1997-02-04 1999-03-16 Micron Technology, Inc. Method for forming a hole in a semiconductor device
US5851302A (en) * 1997-02-19 1998-12-22 Vlsi Technology, Inc. Method for dry etching sidewall polymer
US5925577A (en) * 1997-02-19 1999-07-20 Vlsi Technology, Inc. Method for forming via contact hole in a semiconductor device
US5982553A (en) 1997-03-20 1999-11-09 Silicon Light Machines Display device incorporating one-dimensional grating light-valve array
US5780363A (en) * 1997-04-04 1998-07-14 International Business Machines Coporation Etching composition and use thereof
US5858879A (en) * 1997-06-06 1999-01-12 Taiwan Semiconductor Manufacturing Co., Ltd. Method for etching metal lines with enhanced profile control
US6010603A (en) 1997-07-09 2000-01-04 Applied Materials, Inc. Patterned copper etch for micron and submicron features, using enhanced physical bombardment
US6008140A (en) * 1997-08-13 1999-12-28 Applied Materials, Inc. Copper etch using HCI and HBr chemistry
US6107166A (en) * 1997-08-29 2000-08-22 Fsi International, Inc. Vapor phase cleaning of alkali and alkaline earth metals
US5965465A (en) * 1997-09-18 1999-10-12 International Business Machines Corporation Etching of silicon nitride
US6088102A (en) 1997-10-31 2000-07-11 Silicon Light Machines Display apparatus including grating light-valve array and interferometric optical system
US6033996A (en) * 1997-11-13 2000-03-07 International Business Machines Corporation Process for removing etching residues, etching mask and silicon nitride and/or silicon dioxide
US6150282A (en) * 1997-11-13 2000-11-21 International Business Machines Corporation Selective removal of etching residues
US5980770A (en) * 1998-04-16 1999-11-09 Siemens Aktiengesellschaft Removal of post-RIE polymer on Al/Cu metal line
US6849153B2 (en) * 1998-04-16 2005-02-01 Siemens Aktiengesellschaft Removal of post-rie polymer on A1/CU metal line
US6271808B1 (en) 1998-06-05 2001-08-07 Silicon Light Machines Stereo head mounted display using a single display device
TW384508B (en) * 1998-06-09 2000-03-11 Winbond Electronics Corp Cleaning method for polymers
US6101036A (en) 1998-06-23 2000-08-08 Silicon Light Machines Embossed diffraction grating alone and in combination with changeable image display
US6130770A (en) 1998-06-23 2000-10-10 Silicon Light Machines Electron gun activated grating light valve
US6215579B1 (en) 1998-06-24 2001-04-10 Silicon Light Machines Method and apparatus for modulating an incident light beam for forming a two-dimensional image
US6303986B1 (en) 1998-07-29 2001-10-16 Silicon Light Machines Method of and apparatus for sealing an hermetic lid to a semiconductor die
US6872984B1 (en) 1998-07-29 2005-03-29 Silicon Light Machines Corporation Method of sealing a hermetic lid to a semiconductor die at an angle
US6200891B1 (en) 1998-08-13 2001-03-13 International Business Machines Corporation Removal of dielectric oxides
US6117796A (en) * 1998-08-13 2000-09-12 International Business Machines Corporation Removal of silicon oxide
US6174817B1 (en) * 1998-08-26 2001-01-16 Texas Instruments Incorporated Two step oxide removal for memory cells
JP3330554B2 (ja) * 1999-01-27 2002-09-30 松下電器産業株式会社 エッチング方法
US6740247B1 (en) 1999-02-05 2004-05-25 Massachusetts Institute Of Technology HF vapor phase wafer cleaning and oxide etching
US6956878B1 (en) 2000-02-07 2005-10-18 Silicon Light Machines Corporation Method and apparatus for reducing laser speckle using polarization averaging
US6399509B1 (en) 2000-09-18 2002-06-04 Promos Technologies, Inc. Defects reduction for a metal etcher
US6692903B2 (en) 2000-12-13 2004-02-17 Applied Materials, Inc Substrate cleaning apparatus and method
US7177081B2 (en) 2001-03-08 2007-02-13 Silicon Light Machines Corporation High contrast grating light valve type device
US6707591B2 (en) 2001-04-10 2004-03-16 Silicon Light Machines Angled illumination for a single order light modulator based projection system
US6865346B1 (en) 2001-06-05 2005-03-08 Silicon Light Machines Corporation Fiber optic transceiver
US6747781B2 (en) 2001-06-25 2004-06-08 Silicon Light Machines, Inc. Method, apparatus, and diffuser for reducing laser speckle
US6782205B2 (en) 2001-06-25 2004-08-24 Silicon Light Machines Method and apparatus for dynamic equalization in wavelength division multiplexing
US6829092B2 (en) 2001-08-15 2004-12-07 Silicon Light Machines, Inc. Blazed grating light valve
US6930364B2 (en) 2001-09-13 2005-08-16 Silicon Light Machines Corporation Microelectronic mechanical system and methods
US6956995B1 (en) 2001-11-09 2005-10-18 Silicon Light Machines Corporation Optical communication arrangement
US7066284B2 (en) 2001-11-14 2006-06-27 Halliburton Energy Services, Inc. Method and apparatus for a monodiameter wellbore, monodiameter casing, monobore, and/or monowell
US6800238B1 (en) 2002-01-15 2004-10-05 Silicon Light Machines, Inc. Method for domain patterning in low coercive field ferroelectrics
US6767751B2 (en) 2002-05-28 2004-07-27 Silicon Light Machines, Inc. Integrated driver process flow
US6728023B1 (en) 2002-05-28 2004-04-27 Silicon Light Machines Optical device arrays with optimized image resolution
US7054515B1 (en) 2002-05-30 2006-05-30 Silicon Light Machines Corporation Diffractive light modulator-based dynamic equalizer with integrated spectral monitor
US6822797B1 (en) 2002-05-31 2004-11-23 Silicon Light Machines, Inc. Light modulator structure for producing high-contrast operation using zero-order light
US6930051B1 (en) * 2002-06-06 2005-08-16 Sandia Corporation Method to fabricate multi-level silicon-based microstructures via use of an etching delay layer
US6829258B1 (en) 2002-06-26 2004-12-07 Silicon Light Machines, Inc. Rapidly tunable external cavity laser
US6908201B2 (en) 2002-06-28 2005-06-21 Silicon Light Machines Corporation Micro-support structures
US6813059B2 (en) 2002-06-28 2004-11-02 Silicon Light Machines, Inc. Reduced formation of asperities in contact micro-structures
US6714337B1 (en) 2002-06-28 2004-03-30 Silicon Light Machines Method and device for modulating a light beam and having an improved gamma response
US7057795B2 (en) 2002-08-20 2006-06-06 Silicon Light Machines Corporation Micro-structures with individually addressable ribbon pairs
US6801354B1 (en) 2002-08-20 2004-10-05 Silicon Light Machines, Inc. 2-D diffraction grating for substantially eliminating polarization dependent losses
US6712480B1 (en) 2002-09-27 2004-03-30 Silicon Light Machines Controlled curvature of stressed micro-structures
US6928207B1 (en) 2002-12-12 2005-08-09 Silicon Light Machines Corporation Apparatus for selectively blocking WDM channels
US7057819B1 (en) 2002-12-17 2006-06-06 Silicon Light Machines Corporation High contrast tilting ribbon blazed grating
US6987600B1 (en) 2002-12-17 2006-01-17 Silicon Light Machines Corporation Arbitrary phase profile for better equalization in dynamic gain equalizer
US6934070B1 (en) 2002-12-18 2005-08-23 Silicon Light Machines Corporation Chirped optical MEM device
US6927891B1 (en) 2002-12-23 2005-08-09 Silicon Light Machines Corporation Tilt-able grating plane for improved crosstalk in 1×N blaze switches
US7068372B1 (en) 2003-01-28 2006-06-27 Silicon Light Machines Corporation MEMS interferometer-based reconfigurable optical add-and-drop multiplexor
US7286764B1 (en) 2003-02-03 2007-10-23 Silicon Light Machines Corporation Reconfigurable modulator-based optical add-and-drop multiplexer
US6947613B1 (en) 2003-02-11 2005-09-20 Silicon Light Machines Corporation Wavelength selective switch and equalizer
US6922272B1 (en) 2003-02-14 2005-07-26 Silicon Light Machines Corporation Method and apparatus for leveling thermal stress variations in multi-layer MEMS devices
US7391973B1 (en) 2003-02-28 2008-06-24 Silicon Light Machines Corporation Two-stage gain equalizer
US7027202B1 (en) 2003-02-28 2006-04-11 Silicon Light Machines Corp Silicon substrate as a light modulator sacrificial layer
US6922273B1 (en) 2003-02-28 2005-07-26 Silicon Light Machines Corporation PDL mitigation structure for diffractive MEMS and gratings
US6829077B1 (en) 2003-02-28 2004-12-07 Silicon Light Machines, Inc. Diffractive light modulator with dynamically rotatable diffraction plane
US6806997B1 (en) 2003-02-28 2004-10-19 Silicon Light Machines, Inc. Patterned diffractive light modulator ribbon for PDL reduction
US7042611B1 (en) 2003-03-03 2006-05-09 Silicon Light Machines Corporation Pre-deflected bias ribbons
KR100562302B1 (ko) * 2003-12-27 2006-03-22 동부아남반도체 주식회사 멀티 화학액 처리 단계를 이용한 랜덤 폴리머 제거 방법
CN103839770B (zh) * 2012-11-21 2016-08-17 上海华虹宏力半导体制造有限公司 一种同时在深沟槽底部和顶部形成图形的工艺方法
CN113327842A (zh) * 2020-02-28 2021-08-31 长鑫存储技术有限公司 半导体结构及其制备方法

Family Cites Families (17)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS59166675A (ja) * 1983-03-11 1984-09-20 Fujitsu Ltd エツチング装置
US4566935A (en) * 1984-07-31 1986-01-28 Texas Instruments Incorporated Spatial light modulator and method
US4749440A (en) * 1985-08-28 1988-06-07 Fsi Corporation Gaseous process and apparatus for removing films from substrates
JPH0626206B2 (ja) * 1985-08-28 1994-04-06 エフエスアイ コ−ポレイシヨン 基板より気相法で膜除去する方法及び装置
FR2590405B1 (fr) * 1985-11-21 1988-02-05 Pons Michel Procede de gravure de materiaux organiques par plasma
US4711017A (en) * 1986-03-03 1987-12-08 Trw Inc. Formation of buried diffusion devices
US5181985A (en) * 1988-06-01 1993-01-26 Wacker-Chemitronic Gesellschaft Fur Elektronik-Grundstoffe Mbh Process for the wet-chemical surface treatment of semiconductor wafers
EP0369053B1 (de) * 1988-11-17 1994-03-02 International Business Machines Corporation Verfahren zur Herstellung von Masken mit Strukturen im Submikrometerbereich
US5030319A (en) * 1988-12-27 1991-07-09 Kabushiki Kaisha Toshiba Method of oxide etching with condensed plasma reaction product
US5041362A (en) * 1989-07-06 1991-08-20 Texas Instruments Incorporated Dry developable resist etch chemistry
DE68903950T2 (de) * 1989-08-16 1993-07-01 Ibm Verfahren fuer die herstellung ultrafeiner siliziumspitzen fuer afm/stm-profilometrie.
EP0528995B1 (en) * 1990-05-15 1998-07-22 Semitool, Inc. Semiconductor processor apparatus with dynamic wafer vapor treatment and particle volatilization
JPH0422123A (ja) * 1990-05-17 1992-01-27 Sharp Corp シリコン酸化膜のエッチング方法
US5201992A (en) * 1990-07-12 1993-04-13 Bell Communications Research, Inc. Method for making tapered microminiature silicon structures
JP2697952B2 (ja) * 1990-11-15 1998-01-19 シャープ株式会社 半導体装置の製造方法
US5089084A (en) * 1990-12-03 1992-02-18 Micron Technology, Inc. Hydrofluoric acid etcher and cascade rinser
JPH04360530A (ja) * 1991-06-07 1992-12-14 Sony Corp 多層レジスト法の中間層の除去方法

Also Published As

Publication number Publication date
EP0585936B1 (en) 2006-07-26
KR940008000A (ko) 1994-04-28
DE69334049D1 (de) 2006-09-07
KR100270416B1 (ko) 2000-12-01
TW241387B (ja) 1995-02-21
EP0585936A3 (en) 1995-03-29
USRE36006E (en) 1998-12-22
EP0585936A2 (en) 1994-03-09
US5348619A (en) 1994-09-20
DE69334049T2 (de) 2007-02-15

Similar Documents

Publication Publication Date Title
JPH077002A (ja) 半導体ウェーハから副産物を除去する処理方法
JP5404361B2 (ja) 半導体基板の表面処理装置及び方法
US5312717A (en) Residue free vertical pattern transfer with top surface imaging resists
JP5404364B2 (ja) 半導体基板の表面処理装置及び方法
US5660681A (en) Method for removing sidewall protective film
TWI252964B (en) Resist removing composition and resist removing method using the same
CN101676801A (zh) 光刻方法
US6399551B1 (en) Alkanolamine semiconductor process residue removal process
EP0888578B1 (en) Solutions and processes for removal of sidewall residue after dry-etching
JPH11186235A (ja) 半導体装置の製造方法
JPH1098029A (ja) 基板から有機反射防止膜をエッチングする処理法
TWI393997B (zh) 用於蝕刻基板上之低k介電層的方法、半導體裝置以及用於在低k介電層中形成特徵的設備
JP3968535B2 (ja) 半導体素子の製造方法
JP2008177532A (ja) 半導体ウェハーの処理方法
US6713397B2 (en) Manufacturing method of semiconductor device
JP2914443B2 (ja) 半導体素子の配線形成方法
JP3277414B2 (ja) ドライエッチング方法
JP4120714B2 (ja) 半導体素子の製造方法
JP4496631B2 (ja) 電子デバイスの製造方法
US6399509B1 (en) Defects reduction for a metal etcher
TW421825B (en) Method of cleaning after etching of gate in integrated circuit
KR0131719B1 (ko) 반도체소자의 금속배선 제조방법
JP2005114973A (ja) 微細レジストパターンの形成方法
JP2003005388A (ja) 半導体素子の製造方法。
JP2006041364A (ja) 配線の形成方法及び、電子デバイスの製造方法