JPH0782589B2 - 侵入者検出装置 - Google Patents

侵入者検出装置

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JPH0782589B2
JPH0782589B2 JP62190546A JP19054687A JPH0782589B2 JP H0782589 B2 JPH0782589 B2 JP H0782589B2 JP 62190546 A JP62190546 A JP 62190546A JP 19054687 A JP19054687 A JP 19054687A JP H0782589 B2 JPH0782589 B2 JP H0782589B2
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Description

【発明の詳細な説明】 本発明は改良された侵入者検出装置に関し、特に２個の
感知器を有するとともに２個の感知器の内の１つの内部
故障を検出する能力を備えている形の改良された侵入者
検出装置に関する。
組合せ式侵入者検出装置は技術的に周知である。代表的
な組合せは、マイクロ波侵入者検出装置と共に受動赤外
線侵入検出装置を使用するものである。２個の感知器の
出力はアンド（AND）ゲートに供給される。両感知器が
いずれも侵入者の存在を検出するならば、警報が発せら
れる。
各サブシステムが異なる刺激に対して相補う形で応動す
る２個の独立感知サブシステムの電気出力の組合せは、
誤警報の可能性を有意義に減らす。この誤警報の減少
は、これらの組合せ式侵入者検出装置の製造コスト高を
埋めて余りがある。
組合せ式二重感知装置の１つの欠点は、感知器またはサ
ブシステムの１つが正しく作動しない場合に、全システ
ムの完全さが失われることである。これは、そのサブシ
ステムまたは感知器がいったん故障すると（それは開モ
ードでの故障と考えられ、すなわち故障した感知器／サ
ブシステムは侵入者の存在を決して検出しない）、また
全システムは両感知サブシステムの信号の存在に依存す
るので、１個の感知サブシステムの故障は全システムの
故障につながるからである。
感知器またはそのサブシステムには多くの考えられる故
障の原因がある。感知器またはそのサブシステムの１つ
の考えられる故障は電気回路の故障である。感知器故障
の第２の考えられる原因は、感知器が正しく設置されて
いない場合である。侵入者検出装置全体が正しく機能を
果たすためには、両感知サブシステムは同一容積すなわ
ち同一空間場所に向けられなければならない。両感知器
とも同一または近接場所における侵入者の存在を検出し
なければならない。かくて、２個の感知器の検出の区域
または空間には重複がなければならない。２個の感知サ
ブシステムが正しく整列されずかつ同一空間または容積
場所に向られていなければ、重複していない区域には全
装置は警報を発生することはない。これは、侵入者は常
に１個だけの感知サブシステムにしか検出されないから
である。もう１つの故障原因としてはいじり回しによる
もの、つまり、意図的な操作によるものがある。侵入し
ようとする者が１個の感知サブシステムを遮蔽したり作
動しないようにすることにより、その感知サブシステム
の機能が発揮されない場合は、全システムが機能しなく
なる。
従って、二重感知サブシステムの侵入者検出装置では、
いずれもの感知サブシステムのどのような内部の電気的
誤作動をも検出したり、いずれもの感知サブシステムの
どのような物理的な操作をも検出したり、いずれの感知
サブシステムの使用の際の正常な検知領域へのどのよう
な遮蔽をも検出したり、または、各検知サブシステムに
実質的に異なる検知区域を生じさせる不適正な設置を検
出したりすることが強く望まれる。これらの条件はすべ
て、一括して「故障条件」といわれる。
本発明において、侵入者検出装置の改良が開示されてい
る。侵入者検出装置は、２個の各感知器が侵入者の検出
と同時に信号を供給する二重感知器を有する形式の装置
である。二重感知器からの２つの信号を処理して、侵入
者が両感知器によって検出される場合に警報を出す論理
装置がさらに具備されている。本改良は、二重感知器の
１つによって記憶された信号の数を記憶する第１記憶装
置を含む。第２記憶装置は第２感知器によって検出され
た信号の数を記憶する。論理制御装置は第１および第２
記憶装置の出力を受けて、そこに記憶された数を比較
し、この比較に応じて故障信号を出力する。
本発明の実施例を以下、付図について詳しく説明する。
第１図には、本発明の改良された侵入者検出装置のブロ
ック図が示されている。本発明の侵入者検出装置10は、
第１感知器12サブアセンブリおよび第２感知器14サブア
センブリを含んでおり、これらは二重感知器を構成す
る。第１感知器12サブアセンブリの代表的な例としては
受動赤外線検出器がある。第２感知器14サブアセンブリ
の代表的な例としてはマイクロ波検出器がある。第１感
知器12サブシステムおよび第２感知器14サブシステムは
おのおの、同じ空間すなわち空間の容積16内で侵入者を
検出するように向けられる。第１感知器12サブシステム
および第２感知器14サブシステムはおのおの、サブシス
テムが向けられている空間または容積16内で侵入者を検
出すると同時に、それぞれ第１出力信号18および第２出
力信号20を作る。光電感知器およびマイクロ波検出器の
組合せを用いるかかる装置10は、米国特許第3,725,888
号に詳しく記載されている。
第１および第２出力信号18,20はそれぞれ、論理制御器2
2に供給される。論理制御器22は、規定の周期内に、第
１感知器12サブシステムおよび第２感知器14サブシステ
ムの両方によって侵入者が検出される場合に警報器26を
起動する出力信号24を作る。
本発明の改良され侵入者検出装置10では、装置10は論理
装置である故障検出サブシステム30をも含む。故障検出
サブシステム30も、第１および第２出力信号18,20をそ
れぞれ受信する。
第２図には、故障検出サブシステム30のブロック図が示
される。故障検出サブシステム30は、第１および第２出
力信号18,20がそれぞれ供給される入力信号調整器32を
含む。入力信号調整器32は、例えば入力信号を所定の周
期のあいだ保持することによって、入力信号を処理す
る。
入力信号調整器32から高速事象抑制器34に、第１および
第２出力信号18,20が供給される。高速事象抑制器34は
一連の高速パルスの存在を検出する。もしこれが生じる
と、故障検出サブシステム30は所定の期間出力信号18ま
たは20のカウントを停止する。高速事象抑制器34から、
第１および第２出力信号18,20は、それぞれ第１記憶装
置および第２記憶装置である第１および第２カウンタ3
6,38に供給される。第１および第２事象カウンタ36,38
の出力は制御論理40に供給される。制御論理40は、使用
者選択可能装置として働く比選択論理44を通る入力ライ
ン42に沿って使用者選択可能な比率数をも受信する。制
御論理40の出力は２個の感知器サブシステムの内の１つ
にある故障を指示することができる。その故障信号46は
ノア（NOR）ゲート48に供給される。ノア・ゲート48の
他の入力は、いじり回し信号50およびマイクロ波監視信
号52である。さらに、ノア・ゲート48は無能化ライン54
に沿って送られる信号によって無能にされることがあ
る。
ノア・ゲート48の出力は、リレー駆動回路56に供給され
るとともに検出される故障を使用者に告げるLED駆動回
路58に供給される信号である。発振およびクロック発生
器60は、必要なクロック信号を高速事象抑制器34および
LED駆動回路58に供給する。
第３図には、第２図において説明された故障検出サブシ
ステム30のいろいろなブロック構成部品が詳しく示され
ている。第１感知器出力信号18はナンド（NAND）ゲート
62、オア・ゲート64およびインバータ66に供給される。
ナンド・ゲート62の出力は第２アンド・ゲート68に供給
されるが、これは次に８ビット・カウンタである第１カ
ウンタ36に供給される。ナンド・ゲート62は高速事象抑
制器34によっても制御される。一連の高速パルスが抑制
器34によって検出される場合は、ナンド・ゲート62はタ
ーンオフされそれによって第１感知器出力信号18が第１
カウンタ36に達するのが防止される。ゲート64および68
は試験目的で使用される。
マイクロ波検出サブシステム14からの第２出力信号20は
ワン・ショット68、つまり、オア・ゲート68bに供給さ
れるが、これによって信号は最後のマイクロ波パルス後
約3.8秒の間ロー・レベルに保たれる。ワン・ショット6
8の出力は次にノア・ゲート70、アンド・ゲート72およ
び同じく８ビット・カウンタである第２カウンタ38に送
られる。ノア・ゲート70の機能はナンド・ゲート62に似
ている。アンド・ゲート72および73は試験目的にも使用
される。
高速事象抑制器34は一部、長いカウンタ100および二重
カウンタ101を含む。長いカウンタ100は発振およびクロ
ック発生器60からタイミング・パルスを受信する。二重
カウンタ101は第１および第２出力信号18および20を受
信する（それぞれゲート62および70を通ってから）。
長いカウンタ100は１分ごとに二重カウンタ101をリセッ
トする。二重カウンタ101が１分以内の間に８個または
それ以上の信号（第１または第２出力信号18あるいは2
0）を受信する場合は、二重カウンタ101は（１）二重カ
ウンタ101をリセットさせ、（２）ゲート62および70を
８分間ターンオフさせ、そして（３）８分後にゲート62
および70をターンオンさせて正常の作動を再開させる。
複数個のアンド・ゲートと、オア・ゲートと、マルチプ
レクサ86および90を含む比選択論理44に、４個の使用者
選択可能な比信号42が供給されるが、これらはすべて第
３図に示されかつ接続されている通りである。４個の使
用者選択可能な比信号42の内の２個は、第１および第２
カウンタ36および38から適当な最下位ビット（LSB）を
無能にさせて、PIRアンド・ゲート80およびMWアンド・
ゲート82の入力として、（１）０より大、（２）１より
大、（３）３より大、または（４）７より大、の条件を
得るのに使用される。PIRアンド・ゲート80およびMWア
ンド・ゲート82の出力は、４個の使用選択可能な入力ラ
イン42の内の２個によってセットされた数と一致したり
越えるカウンタ36および38によってカウントされた信号
（それぞれ18または20）の数の決定である。
他の２個の使用者選択可能なライン42は、マルチプレク
サ86および90に供給される。マルチプレクサ86および90
はカウンタ36および38から４個のMSBの内の１個の選択
して、それをPIRアンド・ゲート85およびMWアンド・ゲ
ート89に入力として、またゲート88および84にも入力と
して、それぞれ供給する。カウンタ36または38のいずれ
かが２個の使用者選択可能なライン42によって選択され
るMSBの数に達すると、それは92および94で比較事象を
生じさせる。その場合、比較事象を生じさせないカウン
タ36または38のLSBは、その数が他の２個の使用者選択
可能なラインによってセットされた数と一致したり越え
るかどうかを決定するために分析される。
比較事象を生じさせないカウンタのLSBのカウント数が
使用者選択のしきい値と一致したり越える場合は、パル
スが94に現われる。これは「故障でない」ことを示す。
故障でないがパルス94は第１および第２カウンタ36なら
びに38をリセットする。しかし、逆のことが生じたら、
パルスは92に現われる。これは「故障」を示し、すなわ
ち１つの形の感知器の多すぎる信号が他の形の感知器の
信号に比較してカウントされていることを示す。故障パ
ルス92はノア・ゲート48に供給され、これは次にフリッ
プ・フロップ96を起動させる。フリップ・フロップ96の
Ｑ出力はリレー駆動回路56およびLED駆動回路58を駆動
させる。
故障検出サブシステム30の作動において、使用者はまず
比較を生じさせる事象の数および比較のための最小数を
選択する。無防備の段階中、第１および第２感知器12お
よび14は空間16にいる侵入者をカウントする。これらの
カウントは故障検出サブシステム30によって収集され、
第１および第２カウンタ36および38にそれぞれ記憶され
る。第１または第２カウンタ36あるいは38が比較事象の
ために使用者がセットした数に達すると、比較事象を生
じさせないカウンタに記憶されたカウント数は使用者に
よってセットされた最小数に比較される。その数が最小
数より大きければ、「故障でない」。他の場合は、感知
器サブシステムの１つに故障がある。
故障検出サブシステム30の作動は侵入者検出装置10の作
動または作動解除を決して妨げないことを強調しなけれ
ばならない。故障検出サブシステム30が作動している
間、侵入者検出装置10は依然として作動することができ
る。
本発明の改良された侵入者検出装置10には多くの利点が
ある。まず第１に、二重感知器侵入者検出装置の使用に
よって、誤警報は最小に押えられる。さらに故障検出サ
ブシステム30によって、感知器サブシステムの１つの故
障が容易に検出され、そして侵入者検出装置10の故障の
表示が使用者に送られることが分かる。かくて、侵入者
検出装置10はフェイル・セーフと信頼性との両者ですべ
て有利である。
【図面の簡単な説明】
第１図は本発明の改良された侵入者検出装置の接続ブロ
ック図、第２図は本発明の侵入者検出装置の故障検出サ
ブシステムの接続ブロック図、第３図は本発明の故障検
出サブシステムの細部回路図である。 10……侵入者検出装置 12……受動赤外線検出器 14……マイクロ波検出器 16……空間 18,20,24……出力信号 22……論理制御器 26……警報器

Claims (6)

    【特許請求の範囲】
  1. 【請求項１】侵入者の検出に応じて第１出力信号を発生
    させる第１感知器と、侵入者の検出に応じて第２出力信
    号を発生させる第２感知器と、前記第１および前記第２
    出力信号を受信して該信号に応じて警報を発生させる論
    理制御器とを有し、前記第１及び第２感知器の検知領域
    がほぼ同一である二重感知装置形式の侵入者検出装置で
    あって、 前記第１感知器から受信した第１出力信号の数を記憶す
    る第１記憶装置と、 前記第２感知器から受信した第２出力信号の数を記憶す
    る第２記憶装置と、 前記第１記憶装置からの第１出力信号の数と前記第２記
    憶装置からの第２出力信号の数とを比較し、該比較に応
    じて前記検出装置の故障を表わす出力信号を発生させる
    論理装置と、 を有することを特徴とする侵入者検出装置。
  2. 【請求項２】前記論理装置は、さらに、 前記第２記憶装置からの第２出力信号の数を前記第１記
    憶装置からの第１出力信号の数に比較する数を選択する
    使用者選択可能装置、 を有する特許請求の範囲第１項記載の検出装置。
  3. 【請求項３】前記第１感知器は受動赤外線検出器であ
    り、また前記第２感知器はマイクロ波検出器である特許
    請求の範囲第１項記載の検出装置。
  4. 【請求項４】前記第１記憶装置はカウンタである特許請
    求の範囲第１項記載の検出装置。
  5. 【請求項５】前記第２記憶装置はカウンタである特許請
    求の範囲第１項記載の検出装置。
  6. 【請求項６】前記使用者選択可能装置はさらに比較事象
    をもたらすしきい値を選択する装置と、比較事象をもた
    らさなかった前記第１または第２カウンタの出力を使用
    者選択可能な最小値と比較する装置とを有する特許請求
    の範囲第２項記載の検出装置。
JP62190546A 1986-08-05 1987-07-31 侵入者検出装置 Expired - Lifetime JPH0782589B2 (ja)

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
US06/893,399 US4710750A (en) 1986-08-05 1986-08-05 Fault detecting intrusion detection device
US893399 1986-08-05

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Publication Number Publication Date
JPS6345697A JPS6345697A (ja) 1988-02-26
JPH0782589B2 true JPH0782589B2 (ja) 1995-09-06

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ID=25401505

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Application Number Title Priority Date Filing Date
JP62190546A Expired - Lifetime JPH0782589B2 (ja) 1986-08-05 1987-07-31 侵入者検出装置

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US (2) US4710750A (ja)
EP (1) EP0259015B1 (ja)
JP (1) JPH0782589B2 (ja)
AU (1) AU588207B2 (ja)
CA (1) CA1264832A (ja)
DE (1) DE3775305D1 (ja)
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