JPH0799521A - バースト信号検出回路 - Google Patents
バースト信号検出回路Info
- Publication number
- JPH0799521A JPH0799521A JP26313193A JP26313193A JPH0799521A JP H0799521 A JPH0799521 A JP H0799521A JP 26313193 A JP26313193 A JP 26313193A JP 26313193 A JP26313193 A JP 26313193A JP H0799521 A JPH0799521 A JP H0799521A
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- JP
- Japan
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- circuit
- output
- signal
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- burst signal
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- Digital Transmission Methods That Use Modulated Carrier Waves (AREA)
Abstract
(57)【要約】
【目的】 受信変調波の位相情報を用いてバースト信号
を検出する回路を提供することを目的とする。 【構成】 特定パターンをふくむ位相変調信号を入力と
し、その１シンボル時間遅延した信号との差分をＫ回
（Ｋは１以上の自然数）行なうＫ回差分回路（１０−
１，１０−２）と、その出力を１シンボル時間遅延させ
る遅延回路（３０）の出力と、前記Ｋ回差分回路の出力
とを加算する加算回路（４０）と、該加算回路の出力の
絶対値をとる絶対値回路（５０）と、その出力を一定時
間累積加算する累積加算回路（６０）と、該累積加算回
路の出力が、所定の許容値より小さいときにバースト信
号検出信号を出力する比較回路（７０）とを有する。
を検出する回路を提供することを目的とする。 【構成】 特定パターンをふくむ位相変調信号を入力と
し、その１シンボル時間遅延した信号との差分をＫ回
（Ｋは１以上の自然数）行なうＫ回差分回路（１０−
１，１０−２）と、その出力を１シンボル時間遅延させ
る遅延回路（３０）の出力と、前記Ｋ回差分回路の出力
とを加算する加算回路（４０）と、該加算回路の出力の
絶対値をとる絶対値回路（５０）と、その出力を一定時
間累積加算する累積加算回路（６０）と、該累積加算回
路の出力が、所定の許容値より小さいときにバースト信
号検出信号を出力する比較回路（７０）とを有する。
Description
【０００１】
【産業上の利用分野】本発明は、ディジタル無線通信に
おけるバースト信号検出回路に関する。
おけるバースト信号検出回路に関する。
【０００２】
【従来の技術】図４は、従来のバースト信号検出回路を
示す図である。従来のバースト信号の検出は、一般的
に、バンドパスフィルタ等により所望の周波数帯域以外
の雑音が取り除かれた受信波中間周波数（ＩＦ）信号を
入力とする受信電界強度検出器（Ｒｅｃｉｅｖｅｄ Ｓ
ｉｇｎａｌ Ｓｔｒｅｎｇｔｈ Ｉｎｄｉｃａｔｏｒ：
ＲＳＳＩ）８０を用いて行われる。前記受信電界強度検
出器８０は入力信号の電界強度をアナログ信号として出
力する。前記受信電界強度検出器出力を入力とする比較
回路９０ではその大きさがあるスレッショルドと比較さ
れ、その値よりも大きい場合バースト信号を検出したも
のとしてバースト検出信号を出力する。
示す図である。従来のバースト信号の検出は、一般的
に、バンドパスフィルタ等により所望の周波数帯域以外
の雑音が取り除かれた受信波中間周波数（ＩＦ）信号を
入力とする受信電界強度検出器（Ｒｅｃｉｅｖｅｄ Ｓ
ｉｇｎａｌ Ｓｔｒｅｎｇｔｈ Ｉｎｄｉｃａｔｏｒ：
ＲＳＳＩ）８０を用いて行われる。前記受信電界強度検
出器８０は入力信号の電界強度をアナログ信号として出
力する。前記受信電界強度検出器出力を入力とする比較
回路９０ではその大きさがあるスレッショルドと比較さ
れ、その値よりも大きい場合バースト信号を検出したも
のとしてバースト検出信号を出力する。
【０００３】
【発明が解決しようとする課題】従来技術で用いられる
受信電界強度検出器はアナログ素子であり、その他の比
較回路等もアナログ回路あるいはアナログディジタル変
換回路を用いた回路構成となり、小型化、無調整化の点
で不利である。さらに、従来の受信電界強度検出器を用
いた方法は、受信変調波の振幅情報を用いてバースト信
号を検出するため、干渉雑音等の混入信号を誤って検出
する場合がある。さらに、移動体通信用受信機でよく用
いられるリミタ等の振幅情報を欠落させる素子を通過し
た後にこの方法を用いることはできない。
受信電界強度検出器はアナログ素子であり、その他の比
較回路等もアナログ回路あるいはアナログディジタル変
換回路を用いた回路構成となり、小型化、無調整化の点
で不利である。さらに、従来の受信電界強度検出器を用
いた方法は、受信変調波の振幅情報を用いてバースト信
号を検出するため、干渉雑音等の混入信号を誤って検出
する場合がある。さらに、移動体通信用受信機でよく用
いられるリミタ等の振幅情報を欠落させる素子を通過し
た後にこの方法を用いることはできない。
【０００４】本発明は、受信変調波の位相情報を用いて
バースト信号を検出するバースト信号検出回路を提供す
ることを目的とする。
バースト信号を検出するバースト信号検出回路を提供す
ることを目的とする。
【０００５】
【課題を解決するための手段】前記目的を達成するため
の本発明の特徴は、特定パターンをふくむ位相変調信号
を入力とし、その１シンボル時間遅延した信号との差分
をＫ回（Ｋは１以上の自然数）行なうＫ回差分回路と、
その出力を１シンボル時間遅延させる遅延回路の出力
と、前記Ｋ回差分回路の出力とを加算する加算回路と、
該加算回路の出力の絶対値をとる絶対値回路と、その出
力を一定時間累積加算する累積加算回路と、該累積加算
回路の出力が、所定の許容値より小さいときにバースト
信号検出信号を出力する比較回路とを有するバースト信
号検出回路にある。
の本発明の特徴は、特定パターンをふくむ位相変調信号
を入力とし、その１シンボル時間遅延した信号との差分
をＫ回（Ｋは１以上の自然数）行なうＫ回差分回路と、
その出力を１シンボル時間遅延させる遅延回路の出力
と、前記Ｋ回差分回路の出力とを加算する加算回路と、
該加算回路の出力の絶対値をとる絶対値回路と、その出
力を一定時間累積加算する累積加算回路と、該累積加算
回路の出力が、所定の許容値より小さいときにバースト
信号検出信号を出力する比較回路とを有するバースト信
号検出回路にある。
【０００６】
【作用】本発明は、従来のように振幅情報を用いるので
はなく位相情報を用いてバースト検出を行う。そのた
め、移動体通信用受信機でよく用いられるリミタ等の振
幅情報を欠落させる素子を通過した後の信号に対しても
本発明は適用でき、バースト検出回路がベースバンド帯
におけるディジタル回路により簡易に実現可能となる。
また、振幅情報を用いないので、干渉雑音等の混入信号
を誤って検出する確率は少なくなる。
はなく位相情報を用いてバースト検出を行う。そのた
め、移動体通信用受信機でよく用いられるリミタ等の振
幅情報を欠落させる素子を通過した後の信号に対しても
本発明は適用でき、バースト検出回路がベースバンド帯
におけるディジタル回路により簡易に実現可能となる。
また、振幅情報を用いないので、干渉雑音等の混入信号
を誤って検出する確率は少なくなる。
【０００７】
【実施例】図１は、本発明実施例を示す図である。本発
明は受信波位相信号のＫ回差分信号が例えばサイン関数
のように周期信号となる場合に適用できる。ここでは、
バーストフォーマットとして図２に示したものを用い、
また、変調方式としてπ／４−シフトＱＰＳＫ変調方式
が用いられた場合を例にとり説明する。
明は受信波位相信号のＫ回差分信号が例えばサイン関数
のように周期信号となる場合に適用できる。ここでは、
バーストフォーマットとして図２に示したものを用い、
また、変調方式としてπ／４−シフトＱＰＳＫ変調方式
が用いられた場合を例にとり説明する。
【０００８】本発明のバースト信号検出回路には受信変
調波位相信号が入力される。受信変調波位相信号は、例
えば、直交検波回路によりＩチャネルおよびＱチャネル
に分離されたベースバンド信号を位相情報（ａｒｃｔａ
ｎ（Ｉ／Ｑ））が書き込まれたＲＯＭに入力することに
より容易に得られる。前記受信変調波位相信号はＫ回差
分回路（ここではＫ＝２）に入力される。本実施例にお
いて図２に示したバーストフォーマットのプリアンブル
部における受信変調波位相信号が２回差分されて得られ
る信号を図３に示す。差分回数Ｋは、送信プリアンブル
パターンおよび変調方式を考慮し、図３に示すようＫ回
差分信号が周期信号となるように選ばれる。例えば、プ
リアンブルが「１００１」のパターンをふくみ（π／
４）ＱＰＳＫ変調の場合はＫ＝２が適当である。多くの
場合Ｋの値は２又は３以下となる。
調波位相信号が入力される。受信変調波位相信号は、例
えば、直交検波回路によりＩチャネルおよびＱチャネル
に分離されたベースバンド信号を位相情報（ａｒｃｔａ
ｎ（Ｉ／Ｑ））が書き込まれたＲＯＭに入力することに
より容易に得られる。前記受信変調波位相信号はＫ回差
分回路（ここではＫ＝２）に入力される。本実施例にお
いて図２に示したバーストフォーマットのプリアンブル
部における受信変調波位相信号が２回差分されて得られ
る信号を図３に示す。差分回数Ｋは、送信プリアンブル
パターンおよび変調方式を考慮し、図３に示すようＫ回
差分信号が周期信号となるように選ばれる。例えば、プ
リアンブルが「１００１」のパターンをふくみ（π／
４）ＱＰＳＫ変調の場合はＫ＝２が適当である。多くの
場合Ｋの値は２又は３以下となる。
【０００９】つぎに、前記２回差分回路出力は加算回路
４０に入力されるとともに、一方で遅延回路（１シンボ
ル時間遅延）３０に入力される。加算回路４０では、前
記２回差分回路出力と前記遅延回路の出力を加算し（図
３からもわかるように、前記加算回路出力値は雑音の無
い場合ゼロとなる）絶対値回路５０へ入力される。絶対
値回路５０では前記加算値の絶対値がとられ累積加算回
路６０に入力される。前記累積加算回路６０では、ある
一定時間にわたる累積加算値が求められる。前記累積加
算回路出力は比較回路７０に入力されてそれが設定され
た許容値以下であればバースト検出信号を出力する。
４０に入力されるとともに、一方で遅延回路（１シンボ
ル時間遅延）３０に入力される。加算回路４０では、前
記２回差分回路出力と前記遅延回路の出力を加算し（図
３からもわかるように、前記加算回路出力値は雑音の無
い場合ゼロとなる）絶対値回路５０へ入力される。絶対
値回路５０では前記加算値の絶対値がとられ累積加算回
路６０に入力される。前記累積加算回路６０では、ある
一定時間にわたる累積加算値が求められる。前記累積加
算回路出力は比較回路７０に入力されてそれが設定され
た許容値以下であればバースト検出信号を出力する。
【００１０】
【発明の効果】本発明は、従来のように振幅情報を用い
るのではなく位相情報を用いてバースト検出を行う。そ
のため、移動体通信用受信機でよく用いられるリミタ等
の振幅情報を欠落させる素子を通過した後の信号に対し
ても本発明は適用でき、バースト検出回路がベースバン
ド等におけるディジタル回路により簡易に実現可能とな
る。そのため、従来のアナログ回路を用いたバースト信
号検出器に比べ、無調整化、低消費電力化、および小型
化の点で有利である。また、干渉雑音等の混入信号を誤
って検出する確率が減少する。
るのではなく位相情報を用いてバースト検出を行う。そ
のため、移動体通信用受信機でよく用いられるリミタ等
の振幅情報を欠落させる素子を通過した後の信号に対し
ても本発明は適用でき、バースト検出回路がベースバン
ド等におけるディジタル回路により簡易に実現可能とな
る。そのため、従来のアナログ回路を用いたバースト信
号検出器に比べ、無調整化、低消費電力化、および小型
化の点で有利である。また、干渉雑音等の混入信号を誤
って検出する確率が減少する。
【図１】本発明の一実施例を示す図。
【図２】バーストフォーマット例を示す図。
【図３】２回差分信号を示す図。
【図４】従来例の示す図。
１０−１，１０−２ 差分回路 ２０ 減算回路 ３０ 遅延回路（１シンボル時間） ４０ 加算回路 ５０ 絶対値回路 ６０ 累積加算回路 ７０，９０ 比較回路 ８０ 受信電界強度検出器
Claims (1)
- 【請求項１】 特定パターンをふくむ位相変調信号を入
力とし、その１シンボル時間遅延した信号との差分をＫ
回（Ｋは１以上の自然数）行なうＫ回差分回路と、 その出力を１シンボル時間遅延させる遅延回路の出力
と、前記Ｋ回差分回路の出力とを加算する加算回路と、 該加算回路の出力の絶対値をとる絶対値回路と、 その出力を一定時間累積加算する累積加算回路と、 該累積加算回路の出力が、所定の許容値より小さいとき
にバースト信号検出信号を出力する比較回路とを有する
ことを特徴とする、バースト信号検出回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP26313193A JP3223402B2 (ja) | 1993-09-28 | 1993-09-28 | バースト信号検出回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP26313193A JP3223402B2 (ja) | 1993-09-28 | 1993-09-28 | バースト信号検出回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0799521A true JPH0799521A (ja) | 1995-04-11 |
| JP3223402B2 JP3223402B2 (ja) | 2001-10-29 |
Family
ID=17385251
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP26313193A Expired - Lifetime JP3223402B2 (ja) | 1993-09-28 | 1993-09-28 | バースト信号検出回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3223402B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN106353591A (zh) * | 2016-10-21 | 2017-01-25 | 成都前锋电子仪器有限责任公司 | 一种平均突发功率测量电路 |
-
1993
- 1993-09-28 JP JP26313193A patent/JP3223402B2/ja not_active Expired - Lifetime
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN106353591A (zh) * | 2016-10-21 | 2017-01-25 | 成都前锋电子仪器有限责任公司 | 一种平均突发功率测量电路 |
| CN106353591B (zh) * | 2016-10-21 | 2023-05-16 | 成都前锋电子仪器有限责任公司 | 一种平均突发功率测量电路 |
Also Published As
| Publication number | Publication date |
|---|---|
| JP3223402B2 (ja) | 2001-10-29 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20010717 |
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