JPH0817268B2 - プリント配線端子装置 - Google Patents

プリント配線端子装置

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JPH0817268B2
JPH0817268B2 JP59083332A JP8333284A JPH0817268B2 JP H0817268 B2 JPH0817268 B2 JP H0817268B2 JP 59083332 A JP59083332 A JP 59083332A JP 8333284 A JP8333284 A JP 8333284A JP H0817268 B2 JPH0817268 B2 JP H0817268B2
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Description

【発明の詳細な説明】 産業上の利用分野 本発明はプリント配線端子装置に関し、特に放電表示
装置（プラズマデイスプレイパネル）に用いて最適なも
のである。
背景技術とその問題点 文字や映像の表示手段の一つとしてXYマトリツクス型
の放電表示パネルが知られている。Ｘ電極群（情報電
極）は例えばアノードで表示情報に対応した高電圧と低
電圧が与えられる。Ｙ電極群（走査電極）は例えばカソ
ードで線順次で走査（負電圧パルスの印加）が行われ
る。
このような放電表示パネルのアノード駆動回路は、例
えば第１図のようなシリアルの表示データをパラレルデ
ータに変換するシフトレジスタ10A、10B（ドライブ段付
き）を備えている。ところが表パネルの分解能を高める
ために放電電極を高密度にすると、アノード本数が増大
した分だけシフトレジスタの段数が増え、シフトレジス
タの転送スピードが足らなくなる。
そこで第２図のように表示データを２ビツトパラレル
に変換してから並列的な二つのシフトレジスタ10A、10B
に供給することが考えられる。この場合、各シフトレジ
スタ10A、10Bのパラレル出力線を第２図のように交互に
織り込んで表示パネルのアノード電極の引出し品に接続
しなければならない。回路とパネルとの電気接続は一般
に駆動ICをマウントしたフレキシブルプリント基板によ
つて行われるから、第２図のような構成では、フレキシ
ブルプリント基板を両面パターンとするに共にまたスル
ーホールを用いてラインの織り込み部分を作らなければ
ならない。従つて非常にコスト高となる上、信頼性が著
しく低下する。
また第１図のような構成においても、電極が超極細ピ
ツチである場合には、第３図のようにフレキシブルプリ
ント基板の接続端子11のピツチｐもそれに応じて製造限
界まで狭くされる。このためIC10と端子11との間の導体
ライン12を、第３図のように両側部において大きく膨出
させて引き回わさせなければならない。従つてフレキシ
ブルプリント基板のサイズは実際の放電パネルの巾Ｗよ
りもかなり大きいものとなる。
更に、第４図に示すように、アノードドライバとアノ
ード電極との間のライン12には放電負荷抵抗Ｒを挿入す
る必要があるので、抵抗取付部分のパターンピツチを広
げなければならない。従つて放電パネルと同一サイズの
フレキシブルプリント基板にアノード駆動回路をおさめ
ることが困難となる。
発明の目的 本発明は上述の問題を解消するためになされたもので
あつて、印刷配線端子の構造を工夫して、超極細ピツチ
の電極端子に容易に信頼性高く結合することができるよ
うにし、また配線の引き回し面積を低減して高密度実装
が図れるようにすることを目的とする。
発明の概要 本発明は、微細ピッチの列状の端子21A、21Bと回路部
分とをフレキシブルプリント基板上の配線ラインで結合
する端子装置であって、第８図に示すように、上記列状
の端子と一対一に対応した端子接続用導体列23と、上記
端子接続用導体列23の配列とほぼ直交した両側方向に導
体を交互に振分けて端子接続用導体列から導出された配
線ライン710、720とを備えるフレキシブルプリント基板
22を具備し、上記列状の端子21A、21B（第７図）と上記
端子接続用導体列23とを重ね合わせて電気接続すると共
に、上記振分けられた配線ライン710、720の夫々の先に
二群に分けた上記回路部分71、72を結合してあることを
特徴とする。この構成により、低コスト、高信頼性、高
実装密度が図れる。
実施例 以下本発明を実施例に基いて説明する。
第５図は本発明の印刷配線端子装置が適用される放電
表示装置（プラズマ・デイスプレイ・パネルPDP）の略
平面図で、第６図は部分断面図である。この放電パネル
は前面ガラス１、背面ガラス２及びこれらに挾まれ微小
放電空間を隔てたXYマトリツクス形状のアノード電極３
（情報電極）、カソード電極４（走査電極）から成つて
いる。カソード電極４の下には、絶縁層５を介して複数
相（８相）に分離されたトリガー電極６がカソード電極
４に沿つて（平行に）配設されている。
アノード電極３は一本置きに上側及び下側のアノード
駆動回路7A、7Bに結合され、表示データ入力（シリア
ル）に基いて駆動回路7A、7Bのシフトレジスタ（パラレ
ル出力）及びスイツチング出力素子を介して表示情報電
圧がカソードの走査に同期して与えられる。
カソード電極４にはカソード走査回路８によつて上か
ら下に線順次で負電圧が与えられ、選択されたカソード
電極４と高圧が印加されたアノード電極３との間で放電
発光が生じる。
トリガー電極６はトリガー回路９によつて相順次で駆
動され、選択された相のトリガー電極６にはカソード走
査タイミングと合わせて高圧のパルス状トリガー電圧が
与えられる。するとトリガー電極６と対向するカソード
電極４との間で種火放電（誘引放電）が生じ、この放電
による空間イオンによりカソード−アノードの間の放電
開始電圧が引き下げられ、アノード−カソード間の主放
電が誘引される。
第７図は本発明の実施例における第５図のアノード駆
動回路7A、7Bの概要を示す回路図で、点線が表示パネル
20の外形を示している。表示パネル20の上端及び下端に
はアノード電極３に連なる列状の端子21A、21Bが設けら
れている。駆動回路7Aは列状の端子21Aの両側に駆動回
路71、72として分離され、２ビツトパラレルの表示デー
タ１及び２が対応する回路に供給される。また駆動回路
7Bも同様に列状の端子21Bの両側に駆動回路73、74とし
て分離され、２ビツトパラレルの表示データ３、４が供
給される。従つてこの場合には４ビツトパラレルの表示
データが供給される。
各駆動回路71、72（又は73、74）はシフトレジスタと
そのパラレル出力によつて駆動されるドライブトランジ
スタから成り、数個のICでもつて構成されている。そし
て各駆動回路71、72（又は73、74）の各配線ライン71
0、720（又は730、740）は１本ずつ交互に列状の端子21
A（21B）に結合される。従つてこれらの配線ライン71
0、720、730、740のパターンピツチは、パネル20の列状
の端子21A、21Bのピツチの２倍となる。
第８図は第７図の上側の駆動回路7Aの実装態様を示す
斜視図で、駆動回路71、72を構成するIC及び配線ライン
710、720はフレキシブルプリント基板22の一方の面に設
けられている。回路71、72の中間部には、第９図の部分
詳細図に示すような端子接続用導体列23が、第７図のパ
ネル20側の列状の端子21A、21Bと同じピツチで形成さ
れ、各端子接続用導体列23に回路71、72からの配線ライ
ン710、720が交互に結合されている。
更に、各ライン710、720の途中には、第10図の部分詳
細図に示すように、放電負荷抵抗用のランドパターン24
が形成され、ここに第８図に示すようにチツプ抵抗25が
取付けられている。なお抵抗25は印刷抵抗でもよい。配
線ライン710、720のパターンピツチが端子接続用導体列
23の２倍であるから、パターンピツチを広げることなく
抵抗25の取付スペース又は印刷スペースを確保すること
ができる。
第11図は表示パネル20へのフリキシブルプリント基板
22の取付け状態を示す斜視図で、第８図のプリント基板
22は裏返されて、その端子接続用導体列23がパネル20の
列状の端子21A、21Bの各端子と一致した状態で結合され
る。
結合方法は、第12図の部分断面で示すように弾性スペ
ーサ27と圧着バネ部材26とを用いた圧接結合であつてよ
い。
或いは、第13図のようなマイクロソルダリングツール
28を用いた半田ペースト結合方法を用いることもでき
る。
以上のように本発明を用いれば、駆動回路（IC）から
の配線ライン710〜740のパターンピツチが従来の２倍と
なるから、信頼性や歩留が著しく向上する。また第14図
の回路71のIC部分の詳細図に示すように出力ラインを１
つ置きに交互に織り込まなくてよいから、出力ラインを
大きく引き回わさずに直線的に端子接続用導体列23に導
出することができる。従つて非常にコンパクトな高密度
実装が可能となり、フレキシブルプリント基板22の巾サ
イズも表示パネル20の巾以内に納めることができる。
なおフレキシブルプリント基板22は表示パネル20の端
子部分に結合した後は、第12図に示すようにこれを折り
たたむことができるから、駆動回路の実装配置スペース
は非常に小さくなる。この場合、第12図の回路71、72を
構成しているICの取付け位置をずらして回路71、72が上
下に重ならないようにして、より偏平な構造にすること
が可能となる。また第12図において、回路71のICをフレ
キシブルプリント基板22のパターン面の裏面に取付け
て、回路71、72が同じ向きになるようにしてもよい。
第15図は変形例を示す部分平面図であつて、この例で
は駆動回路71、72等のICを通常のガラスエポキシ等のプ
リント基板に取付け、端子接続用導体列23及びそのリー
ド導体23aの一部のみをフレキシブルプリント基板22に
形成している。プリント基板29、30との結合は半田付け
等によるが、パターンピツチが大であるので、その作業
性及び信頼性は良好である。表示パネル20への取付けは
第11図と同様であつて、取付後には第12図と同様にフレ
キシブルプリント基板22が折曲げられ、プリント基板29
と30とが表示パネル20の裏側で重ね合わされる。
発明の効果 本発明は上述のように、結合すべき列状の端子に対応
する端子接続用導体列をフレキシブルプリント基板に形
成し、この導体列に連なる配線ラインを導体列の両側に
交互に振分けて導出するようにしたので、配線ラインの
ピッチが列状端子のピッチの２倍となる。従って、超極
細ピッチの電極端子に容易に且つ高い信頼性で回路部分
を結合することができる。また回路部分との結合部にお
ける配線ラインの引回しが楽になり、よりコンパクトに
実装できる。このためフレキシブルプリント基板が低コ
ストになり、製造時の歩留りの向上も図れる。また配線
ライン中に抵抗等の部品を取付けることも容易になる。
【図面の簡単な説明】
第１図及び第２図は本発明のプリント配線端子装置が適
用される放電表示パネルのアノード駆動回路の回路図、
第３図及び第４図は従来の接続パターンの構造を示す部
分平面図、第５図は本発明が適用される放電表示パネル
の概要を示す略平面図、第６図は第５図の部分断面図、
第７図は本発明のプリント配線端子装置の実施例の回路
構造を示す第５図のアノード駆動回路の回路図、第８図
は本発明の実施例のプリント配線端子装置を示す斜視
図、第９図及び第10図は第８図の配線パターンの詳細を
示す部分平面図、第11図は第８図のフレキシブルプリン
ト基板の実装状態を示す斜視図、第12図及び第13図は電
極端子の結合方法を示す部分断面図、第14図は第８図の
回路部分の詳細を示す部分平面図、第15図は実施例のプ
リント配線端子装置の変形例を示す部分平面図である。 なお図面に用いられた符号において、 ３……アノード電極 ４……カソード電極 ６……トリガー電極 7A,7B……アノード駆動回路 ８……カソード走査回路 ９……トリガー回路 20……表示パネル 21A,21B……列状の端子 22……フレキシブルプリント基板 23……端子接続用導体列 710,720,730,740……配線ライン 71〜74……駆動回路 である。

Claims (1)

    【特許請求の範囲】
  1. 【請求項１】微細ピッチの列状の端子と回路部分とをフ
    レキシブルプリント基板上の配線ラインで結合する端子
    装置であって、 上記列状の端子と一対一に対応した端子接続用導体列
    と、上記端子接続用導体列の配列とほぼ直交した両側方
    向に導体を交互に振分けて各端子接続用導体列から導出
    された配線ラインとを備えるフレキシブルプリント基板
    を具備し、 上記列状の端子と上記端子接続用導体列とを重ね合わせ
    て電気接続すると共に、上記振分けられた配線ラインの
    夫々の先に二群に分けた上記回路部分を結合してあるこ
    とを特徴とするプリント配線端子装置。
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