JPH082722Y2 - Setting circuit - Google Patents

Setting circuit

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JPH082722Y2
JPH082722Y2 JP1989026710U JP2671089U JPH082722Y2 JP H082722 Y2 JPH082722 Y2 JP H082722Y2 JP 1989026710 U JP1989026710 U JP 1989026710U JP 2671089 U JP2671089 U JP 2671089U JP H082722 Y2 JPH082722 Y2 JP H082722Y2
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Description

【考案の詳細な説明】 [産業上の利用分野] この考案は制御回路と被制御回路との間に接続され、
被制御回路の制御の手動/自動切り替えを行う設定回路
に関するものである。
DETAILED DESCRIPTION OF THE INVENTION [Industrial field of application] This invention is connected between a control circuit and a controlled circuit,
The present invention relates to a setting circuit that performs manual / automatic switching of control of a controlled circuit.

[従来の技術] 従来のこの種の回路としては第3図に示すものがあっ
た。第3図は従来の設定回路の構成を示す接続図で、図
においてIN1〜IN4は信号入力端子、OUT1〜OUT4は信号出
力端子、S0は手動/自動切り替えスイッチ、S1〜S4は手
動データ設定スイッチである。
[Prior Art] A conventional circuit of this type is shown in FIG. FIG. 3 is a connection diagram showing the configuration of a conventional setting circuit. In the figure, IN1 to IN4 are signal input terminals, OUT1 to OUT4 are signal output terminals, S0 is a manual / automatic changeover switch, and S1 to S4 are manual data setting switches. Is.

従来の設定回路は以上のように構成され、スイッチS0
が自動制御に切り替えられている場合には、信号入力端
子IN1〜IN4に入力された、例えばマイクロプロセッサ等
の制御回路(図示せず)からの出力信号が、ANDゲート,
ORゲートを介して、信号出力端子OUT1〜OUT4へそのまま
の論理で出力される。
The conventional setting circuit is configured as described above, and the switch S0
Is switched to automatic control, the output signal from a control circuit (not shown) such as a microprocessor input to the signal input terminals IN1 to IN4 is
The signal is output to the signal output terminals OUT1 to OUT4 with the same logic via the OR gate.

次にスイッチS0が手動制御に切り替えられた場合に
は、信号入力端子IN1〜IN4に制御回路からの出力データ
が入力されても、ANDゲートで阻止され、このデータに
替わって手動データ設定スイッチS1〜S4で設定するデー
タが、信号出力端子OUT1〜OUT4へ出力されるようにな
り、手動/自動の切り替えが行われる。
Next, when the switch S0 is switched to the manual control, even if the output data from the control circuit is input to the signal input terminals IN1 to IN4, it is blocked by the AND gate, and the manual data setting switch S1 replaces this data. The data set in ~ S4 will be output to the signal output terminals OUT1 ~ OUT4, and manual / automatic switching will be performed.

[考案が解決しようとする課題] 上記のような従来の設定回路は以上のように構成され
ているので、スイッチを操作して手動制御に切り替えた
場合には、信号出力端子へ出力するデータは全て手動デ
ータ設定スイッチで設定する必要があり、自動制御で設
定されていた変更を必要としないデータまでも手動デー
タ設定スイッチで設定し直さなければならない。そのた
めデータ設定動作が煩雑となり、且つデータ設定のため
に信号出力端子の数だけの手動データ設定スイッチが必
要となる。また従来の回路では手動データ設定スイッチ
で設定したデータを制御側で読み取ることができない等
の問題点があった。
[Problems to be Solved by the Invention] Since the conventional setting circuit as described above is configured as described above, when the switch is operated to switch to the manual control, the data output to the signal output terminal is All must be set with the manual data setting switch, and even data that does not require the change set by the automatic control must be reset with the manual data setting switch. Therefore, the data setting operation becomes complicated, and as many manual data setting switches as the number of signal output terminals are required for data setting. Further, the conventional circuit has a problem that the data set by the manual data setting switch cannot be read by the control side.

この考案はかかる課題を解決するためになされたもの
で、手動制御に切り替えた場合でも自動制御で設定され
たデータをそのまま保持し、変更が必要な場合にだけ手
動により設定値を変更することができ、且つ手動制御で
設定した設定値を制御側から読み取ることができる設定
回路を提供することを目的としている。
The present invention has been made to solve such a problem, and even when the control is switched to the manual control, the data set by the automatic control is retained as it is, and the set value can be manually changed only when the change is necessary. It is an object of the present invention to provide a setting circuit which can be read by a control side and which can be set by manual control.

[課題を解決するための手段] この考案にかかる設定回路は、プリセッタブルカウン
タと信号出力端子からのデータを信号入力端子へ帰還さ
せるための帰還回路とを備えることとした。
[Means for Solving the Problem] The setting circuit according to the present invention is provided with a presettable counter and a feedback circuit for returning the data from the signal output terminal to the signal input terminal.

[作用] ここ考案においては、プリセッタブルカウンタと信号
出力端子からのデータを信号入力端子へ帰還させるため
の帰還回路とを備えることとしたので、手動制御へ切り
替えた場合でも内部メモリに記憶された設定値を基礎と
して変更が必要な場合にだけ手動により設定値を変更す
ることができ、且つ信号入力端子へ帰還させた手動制御
で設定した設定値を制御側で読み取ることが可能とな
る。
[Operation] In the present invention, since the presettable counter and the feedback circuit for returning the data from the signal output terminal to the signal input terminal are provided, it is stored in the internal memory even when switching to the manual control. The set value can be manually changed only when the change is necessary based on the set value, and the set value set by the manual control returned to the signal input terminal can be read by the control side.

[実施例] 以下、この考案の実施例を図面について説明する。第
1図はこの考案の一実施例を示す接続図で、図において
第3図と同一符号は同一又は相当部分を示し、IC1はプ
リセッタブルカウンタ、Rf1〜Rf4は帰還抵抗、D1〜D4は
設定値入力端子、Q1〜Q4は設定値出力端子、PRはプリセ
ット信号入力端子、UPは設定値変更パルス入力端子(増
加)、DNは設定値変更パルス入力端子(減少)である。
[Embodiment] An embodiment of the present invention will be described below with reference to the drawings. FIG. 1 is a connection diagram showing an embodiment of the present invention. In the figure, the same symbols as those in FIG. 3 indicate the same or corresponding parts, IC1 is a presettable counter, Rf1 to Rf4 are feedback resistors, and D1 to D4 are setting. Value input terminals, Q1 to Q4 are set value output terminals, PR is a preset signal input terminal, UP is a set value change pulse input terminal (increase), and DN is a set value change pulse input terminal (decrease).

プリセッタブルカウンタIC1の内部メモリ(図示せ
ず)には、プリセット信号入力端子PRにプリセット信号
が入力された時点の設定値入力端子D1〜D4のデータが書
き込まれるようになっている。従って自動制御から手動
制御に切り替えた時点においては、自動制御側から最後
のプリセット信号が出力された時点でのD1〜D4にある信
号論理が内部メモリに設定され、この信号論理がQ1〜Q4
から出力される。即ち手動制御になるとプリセット信号
は入力されず、D1〜D4の論理が変化してもQ1〜Q4の論理
には影響しない。手動制御でQ1〜Q4の論理を変更するた
めには、設定値変更パルス入力端子UP又はDNから、パル
スを入力し、プリセッタブルカウンタIC1がこの入力パ
ルスをアップカウント又はダウンカウントすることによ
り、順次Q1〜Q4の論理を変化する。即ち設定値変更パル
ス入力端子UP,DNは、これらの端子にパルスを供給し
て、手動制御によるデータの変更を行っており、UPまた
はDNの何れか一方であってもよい。
The data of the set value input terminals D1 to D4 at the time when the preset signal is input to the preset signal input terminal PR is written in the internal memory (not shown) of the presettable counter IC1. Therefore, when the automatic control is switched to the manual control, the signal logic in D1 to D4 at the time when the last preset signal is output from the automatic control side is set in the internal memory, and this signal logic is Q1 to Q4.
Output from That is, in the case of manual control, the preset signal is not input, and even if the logic of D1 to D4 changes, it does not affect the logic of Q1 to Q4. To change the logic of Q1 to Q4 by manual control, input a pulse from the setting value change pulse input terminal UP or DN, and the presettable counter IC1 counts up or down this input pulse, Change the logic of Q1 to Q4. That is, the set value change pulse input terminals UP and DN supply pulses to these terminals to change data by manual control, and may be either UP or DN.

帰還抵抗Rf1〜Rf4は、この回路が手動制御側に設定さ
れている場合、OUT1〜OUT4に出力される出力データをIN
1〜IN4の制御側(図示せず)に帰還させる帰還回路を構
成しており、制御側から手動設定出力データを読み取る
ことができるようにしている。
The feedback resistors Rf1 to Rf4 input the output data output to OUT1 to OUT4 when this circuit is set to the manual control side.
A feedback circuit that feeds back to the control side (not shown) of 1 to IN4 is configured, and the manually set output data can be read from the control side.

第2図は第1図に示す設定回路を高周波整合回路に応
用する場合を示す接続図で、図において第1図と同一符
号は同一部分を示し、S10は手動/自動切り替えスイッ
チ、S11は手動データ設定スイッチ、IC2は制御回路であ
るマイクロプロセッサ、P1〜P4は入出力端子、PRCはプ
リセット信号出力端子、IC3は設定信号電流増幅IC、K1
〜K4は整合回路コンデンサ切り替えリレー、C1〜C4は整
合用コンデンサ、L1は整合用インダクタである。
FIG. 2 is a connection diagram showing a case where the setting circuit shown in FIG. 1 is applied to a high-frequency matching circuit. In the figure, the same symbols as those in FIG. 1 indicate the same parts, S10 is a manual / automatic changeover switch, and S11 is a manual switch. Data setting switch, IC2 is a control circuit microprocessor, P1 to P4 are input / output terminals, PRC is a preset signal output terminal, IC3 is a setting signal current amplification IC, K1
~ K4 is a matching circuit capacitor switching relay, C1 to C4 are matching capacitors, and L1 is a matching inductor.

次に動作について説明する。手動/自動切り替えスイ
ッチS10がプリセット信号出力端子PRCに接続されている
場合、回路は自動制御を行っており、整合回路コンデン
サ切り替えリレーK1〜K4はマイクロプロセッサIC2の入
出力端子P1〜P4から出力されるデータによって制御され
ている。
Next, the operation will be described. If the manual / automatic switch S10 is connected to the preset signal output terminal PRC, the circuit is performing automatic control, and the matching circuit capacitor switching relays K1 to K4 are output from the input / output terminals P1 to P4 of the microprocessor IC2. Controlled by the data.

ここで整合用コンデンサC1〜C4を調整した場合、手動
/自動切り替えスイッチS10を切り替えてプリセット信
号が入力されないようにして回路を手動制御側に切り替
える。この切り替えを行った場合、最後にプリセット信
号が出力された時点での設定値入力端子D1〜D4へ供給さ
れていたデータが、プリセッタブルカウンタIC1の内部
メモリへ書き込まれたままの状態となる。そしてこれ以
降に設定値出力端子Q1〜Q4から出力されるデータは、マ
イクロプロセッサIC2からの出力データには係わりな
く、内部メモリに書き込まれたデータが出力されるよう
になる。そして手動データ設定スイッチS11を設定値変
更パルス入力端子のUP側あるいはDN側へ接続し、プリセ
ッタブルカウンタIC1へパルスを供給して内部メモリの
内容を書き替え、Q1〜Q4の論理を変更して整合用コンデ
ンサC1〜C4の定数を手動制御により変化させる。
When the matching capacitors C1 to C4 are adjusted here, the circuit is switched to the manual control side by switching the manual / automatic switch S10 so that the preset signal is not input. When this switching is performed, the data supplied to the set value input terminals D1 to D4 at the time when the preset signal was last output remains in the state of being written in the internal memory of the presettable counter IC1. Then, after that, the data output from the set value output terminals Q1 to Q4 is the data written in the internal memory regardless of the output data from the microprocessor IC2. Then, connect the manual data setting switch S11 to the UP side or DN side of the set value change pulse input terminal, supply a pulse to the presettable counter IC1 to rewrite the contents of the internal memory, and change the logic of Q1 to Q4. The constants of the matching capacitors C1 to C4 are changed by manual control.

またマイクロプロセッサIC2の入出力端子P1〜P4を入
力状態に切り替えることで、マイクロプロセッサIC2か
らはデータが出力されなくなり、設定値出力端子Q1〜Q4
から出力されたデータが、帰還抵抗Rf1〜Rf4を介して設
定出力端子D1〜D4に帰還し、このデータを入出力端子P1
〜P4を介してマイクロプロセッサIC2で読み取ることが
できる。
Also, by switching the input / output terminals P1 to P4 of the microprocessor IC2 to the input state, no data is output from the microprocessor IC2, and the set value output terminals Q1 to Q4
The data output from is fed back to the setting output terminals D1 to D4 via the feedback resistors Rf1 to Rf4, and this data is input / output terminal P1.
It can be read by the microprocessor IC2 via ~ P4.

[考案の効果] この考案は以上説明したように、プリセッタブルカウ
ンタと信号出力端子からのデータを信号入力端子へ帰還
させるための帰還回路とを備えることとしたので、手動
制御へ切り替えた場合でも内部メモリに記憶された設定
値を基礎として変更が必要な場合にだけ手動により容易
に設定値を変更することが可能となり、手動によるデー
タ設定動作を簡略化することができ、データ設定のため
の手動データ設定スイッチの数を削減することができ
る。また手動制御で設定した設定値を制御側から読み取
ることができる等の効果がある。
[Effect of the Invention] As described above, the present invention is provided with the presettable counter and the feedback circuit for returning the data from the signal output terminal to the signal input terminal. Therefore, even when switching to the manual control. Only when it is necessary to change the setting value based on the setting value stored in the internal memory, it is possible to easily change the setting value manually, and the manual data setting operation can be simplified. The number of manual data setting switches can be reduced. Further, there is an effect that the set value set by the manual control can be read from the control side.

【図面の簡単な説明】[Brief description of drawings]

第1図はこの考案の一実施例を示す接続図、第2図はこ
の考案を高周波整合回路に応用する場合の接続図、第3
図は従来の回路を示す接続図。 IC1はプリセッタブルカウンタ、Rf1〜Rf4は帰還抵抗、D
1〜D4は設定値入力端子、Q1〜Q4は設定値出力端子、PR
はプリセット信号入力端子、UPは設定値変更パルス入力
端子(増加)、DNは設定値変更パルス入力端子(減
少)、S10は手動/自動切り替えスイッチ、S11は手動デ
ータ設定スイッチ、IC2はマイクロプロセッサ、P1〜P4
は入出力端子、IC3は設定信号電流増幅IC、K1〜K4は整
合回路コンデンサ切り替えリレー、C1〜C4は整合用コン
デンサ、L1は整合用インダクタ。 なお、各図中同一符号は同一又は相当部分を示すものと
する。
FIG. 1 is a connection diagram showing an embodiment of the present invention, FIG. 2 is a connection diagram when the present invention is applied to a high frequency matching circuit, and FIG.
The figure is a connection diagram showing a conventional circuit. IC1 is a presettable counter, Rf1 to Rf4 are feedback resistors, D
1 to D4 are set value input terminals, Q1 to Q4 are set value output terminals, PR
Is a preset signal input terminal, UP is a set value change pulse input terminal (increase), DN is a set value change pulse input terminal (decrease), S10 is a manual / automatic switch, S11 is a manual data setting switch, IC2 is a microprocessor, P1-P4
Is an input / output terminal, IC3 is a setting signal current amplification IC, K1 to K4 are matching circuit capacitor switching relays, C1 to C4 are matching capacitors, and L1 is a matching inductor. The same reference numerals in the drawings indicate the same or corresponding parts.

Claims (1)

【実用新案登録請求の範囲】[Scope of utility model registration request] 【請求項1】制御回路から出力する2値信号の各ビット
の論理に対応して被制御回路のそれぞれ対応するスイッ
チのオンオフを制御する場合の上記制御回路と被制御回
路との間に接続され、被制御回路の手動/自動切り替え
を行う設定回路において、 上記制御回路から送られてくる設定値を入力する設定値
入力端子と、この設定値入力端子の信号をカウンタとし
て構成された内部メモリに書き込むタイミングを与える
プリセット信号を入力するプリセット信号入力端子と、
上記内部メモリにより構成されたカウンタにより計数さ
れるパルスを入力する設定値変更パルス入力端子と、上
記メモリに記憶された設定値を出力する設定値出力端子
とを有するプリセッタブルカウンタと、 上記プリセッタブルカウンタの上記プリセット信号入力
端子を上記制御回路のプリセット信号出力端子に接続す
るか開放するかの切換を行う手動/自動切り替えスイッ
チと、 上記プリセッタブルカウンタの上記設定値変更パルス入
力端子にパルス信号を入力する手動データ設定スイッチ
と、 上記プリセッタブルカウンタの各設定値出力端子とそれ
ぞれ対応する設定値入力端子の間に接続する高抵抗値の
抵抗とを備え、 上記被制御回路を自動制御する場合には、上記プリセッ
タブルカウンタの上記プリセット信号入力端子を上記手
動/自動切り替えスイッチを介して上記制御回路のプリ
セット信号出力端子に接続し、上記設定値入力端子に送
られてきた上記制御回路からの設定値をプリセット信号
毎に上記メモリに記憶して上記設定値出力端子へ出力
し、上記被制御回路を手動制御する場合には上記手動/
自動切り替えスイッチにより上記プリセット信号入力端
子を開放し、上記内部メモリに記憶されている設定値を
変更する場合は上記手動データ設定スイッチにより上記
設定値変更パルス入力端子からパルスを入力して設定値
を変更して上記設定値出力端子へ出力し、これらの設定
値出力端子の出力を必要な場合に上記高抵抗値の抵抗を
介し上記制御回路で読み取らせることを特徴とする設定
回路。
1. A control circuit is connected between the control circuit and the controlled circuit in the case of controlling ON / OFF of respective switches of the controlled circuit corresponding to the logic of each bit of the binary signal output from the control circuit. In a setting circuit that performs manual / automatic switching of a controlled circuit, a set value input terminal for inputting a set value sent from the control circuit and an internal memory configured as a counter for the signal of the set value input terminal A preset signal input terminal for inputting a preset signal that gives writing timing,
A presettable counter having a set value changing pulse input terminal for inputting a pulse counted by a counter composed of the internal memory, and a set value output terminal for outputting a set value stored in the memory, and the presettable counter. A pulse signal is input to the manual / automatic changeover switch that switches whether to connect the preset signal input terminal of the counter to the preset signal output terminal of the control circuit or to open it, and to the set value changing pulse input terminal of the presettable counter. A manual data setting switch for inputting and a high resistance resistor connected between each set value output terminal of the presettable counter and the corresponding set value input terminal are provided to automatically control the controlled circuit. Connect the preset signal input terminal of the presettable counter to the manual / Connected to the preset signal output terminal of the control circuit via the automatic changeover switch, store the set value from the control circuit sent to the set value input terminal in the memory for each preset signal and output the set value. When outputting to the terminal and manually controlling the controlled circuit,
When changing the set value stored in the internal memory by opening the preset signal input terminal with the automatic changeover switch, input a pulse from the set value change pulse input terminal with the manual data setting switch to change the set value. A setting circuit, which is changed and output to the set value output terminals, and the outputs of these set value output terminals are read by the control circuit via the high resistance resistance when necessary.
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JPS5977502A (en) * 1982-10-27 1984-05-04 Hitachi Ltd Automatic/manual switching circuit
JPS6086601A (en) * 1983-10-18 1985-05-16 Mitsubishi Electric Corp Follower circuit

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