JPH0879705A - オーディオ／ビデオ／データをシステム・バスを介して転送する方法および装置 - Google Patents

オーディオ／ビデオ／データをシステム・バスを介して転送する方法および装置

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JPH0879705A
JPH0879705A JP7212245A JP21224595A JPH0879705A JP H0879705 A JPH0879705 A JP H0879705A JP 7212245 A JP7212245 A JP 7212245A JP 21224595 A JP21224595 A JP 21224595A JP H0879705 A JPH0879705 A JP H0879705A
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Abstract

(57)【要約】 【課題】 圧縮形式で得られるオーディオ、ビデオおよ
びデータの信号を、バスにより相互接続するシステムに
おいて、ジッタがない状態で信号を送信できるようにす
る。 【解決手段】 バス・インターフェースを各信号処理装
置に配設し、このインターフェースは、チャネルの１つ
に送信される制御信号に応答して、各インターフェース
を制御するデコーダを有する。データは、スーパーパケ
ット構造でチャネル中を送信される。バスに供給される
信号を発生する処理装置、たとえばＭＰＥＧトランスポ
ート・パケットを供給する受信機等はこのようなスーパ
ーパケットを形成する装置を有する。各スーパーパケッ
トは、トランスポート・パケットと、トランスポート・
パケットの生起タイミングに関連するタイムスタンプと
を少なくとも含んでいる。トランスポート・パケットと
タイムスタンプとは、各スーパーパケット内の予め定め
られた位置に位置する。

Description

【発明の詳細な説明】
【０００１】
【発明の属する技術分野】本発明は、デジタル信号を処
理する、オーディオ、ビデオ、およびデータの処理装置
を結合するためのバス・インターフェースの方法／装置
に関するものである。
【０００２】なお、本明細書の記述は本件出願の優先権
の基礎たる米国特許出願第０８／２９２，９０８号（１
９９４年８月１９日出願）の明細書の記載に基づくもの
であって、当該米国特許出願の番号を参照することによ
って当該米国特許出願の明細書の記載内容が本明細書の
一部分を構成するものとする。
【０００３】
【従来の技術】オーディオ／ビデオ電子技術において、
種々な消費者用の電子処理装置をバス構成上で相互接続
し、ある１つの装置で得られた信号をバスに接続された
他の装置で利用できるようにすることは知られている。
たとえば、テレビジョン受像機から得られたオーディオ
／ビデオ信号をビデオ・カセット・レコーダに供給して
録画し、あるいはテレビジョン受像機からのオーディオ
信号をコンポーネント・ステレオ・システムに供給して
再生を行う等である。この種のオーディオ／ビデオ相互
接続システムの例は、米国特許第４，５７５，７５９
号、第４，５８１，６６４号、第４，６４７，９７３号
および第４，５８１，６４５号に見いだせる。
【０００４】これらアナログ・バス・システムで分配さ
れる信号は、比較的自己充足的である。すなわち、これ
ら信号は、バスに接続されているそれぞれの装置におい
てそれぞれの信号を解読するのに必要な、タイミング情
報のすべてを含んでいる。
【０００５】現在、多数の圧縮されたオーディオおよび
ビデオ送信装置がある。たとえば、地上の高品位テレビ
放送として提案されているグランド・アライアンスＨＤ
ＴＶシステム(Grand Alliance HDTV system)や、衛星を
介して圧縮ＮＴＳＣ信号を現在放送しているＤｉｒｅｃ
ＴＶシステム(DirecTV system)がある。双方のシステム
は、トランスポート・パケットにプログラム材料をいれ
て、放送している。そして、異なるプログラムおよび／
またはプログラム構成要素（コンポーネント）に対する
パケットを、共通の周波数帯に時分割多重して送信して
いる。それぞれのパケットは、送信前および受信後に、
雑音検出／訂正符号化を受けており、その後に、トラン
スポート・パケットは受信機中で再構成される。他方、
圧縮された信号に対する記録装置（たとえば、ＶＣＲや
ビデオ・ディスク）やオーサリング装置(authoring app
aratus) （たとえば、カメラやカムコーダ(camcorder))
は、同一パケット・フォーマットにおいて圧縮信号を処
理することができるが、それら圧縮信号は同一雑音処理
を必要としないでよい。その結果、処理コンポーネント
間の信号の伝達はパケット形式で非常に好都合に行われ
る。
【０００６】
【発明が解決しようとする課題】圧縮された信号を処理
コンポーネント間で通信する場合に、処理コンポーネン
トの１つが記録装置であるときに特に問題が生じる。そ
の問題は、圧縮されたデータのトランスポート・パケッ
トの多くが、同期のための指標を何も含んでいないこと
である。それに加えて、トランスポート・パケットは一
様なレートで到達したり、発生したりしないでもよい。
たとえば、記録装置では、再生スピードを変化させるこ
とができるようにするために、比較的正確なタイミング
が必要である。すなわち、記録装置が種々の再生機能を
含んでいる場合は、圧縮データを記録媒体上に正確に位
置づけすることが必要である。
【０００７】
【課題が解決するための手段】本発明は、バスを介して
相互接続されているオーディオ、ビデオおよびデータ処
理コンポーネントに対してデータを圧縮された形式で供
給することを指向する。ソース・データは、たとえばＭ
ＰＥＧ２ビデオ標準のシステム・レベルのトランスポー
ト・パケットのような、トランスポート・バケットに生
じる。タイムスタンプは、それぞれのソース・トランス
ポート・パケットが生じたときに発生する。スーパーパ
ケットは、タイムスタンプおよび関連するトランスポー
ト・パケットとから構成されており、および処理コンポ
ーネント間に分配するためにバスに供給される。処理コ
ンポーネントの各々で、受信したスーパーパケットにお
けるタイムスタンプは取り出され、スーパーパケットに
おいて運ばれるトランスポート・パケットの処理のため
の同期クロックの発生に用いられる。トランスポート・
パケットおよびタイムスタンプは各スーパーパケットの
予め定められた位置に配置される。
【０００８】
【発明の実施の形態】本発明の実施の形態を図面を参照
して説明する。
【０００９】図１を参照するに、図１には、ＡＮＤバス
により相互接続されたＡＶＤバス・インターフェース１
０００，１００１，１００２，…の縦続接続を示してい
る。各インターフェース１０００，１００１，１００
２，…は双方向で、信号を装置コンポーネントに供給し
たり、装置コンポーネントから信号を受信したりするこ
とができるように条件づけされ得る。インターフェース
１０００，１００１，１００２，…は、これら双方を同
時に行うことはできない。１つのセッションに対して、
一方を行うかまたは他のことを行うように条件付けられ
ている。各インターフェース１０００，１００１，１０
０２，…は、バスにより供給される信号でコンポーネン
ト装置を駆動する出力バッファＯＢを有する。各インタ
ーフェース１０００，１００１，１００２，…は、コン
ポーネント装置により供給される信号でバスを駆動する
入力バッファＩＢを有する。入力バッファおよび出力バ
ッファの双方を、主制御装置（マスタ・コントローラ）
で制御されるスイッチを介してバスに選択的に結合す
る。このように、信号をバスに供給し、信号をバスから
受信する方向を、高度の柔軟性をもって決定することが
できる。
【００１０】各インターフェース１０００，１００１，
１００２，…は、ＡＶＤバスへの双方の接続点におい
て、信号をＡＶＤバスからインターフェース１０００，
１００１，１００２，…に結合する半二重送受信器ＤＴ
を設けてもよい。ＡＶＤバスは一対の制御線を有してお
り、この制御線上で主制御装置からのシリアル制御信号
を通信している。この制御信号は、アドレスを含んで、
インターフェース１０００，１００１，１００２，…の
各々を選択的に制御できるようにしてもよい。
【００１１】インターフェース１０００，１００１，１
００２，…のスイッチ装置の例を、図２に示す。図２に
おいて、ＡＶＤバスは３対の信号線、すなわち６本の導
線で構成されているものとする。すべての信号線対は、
ビット・シリアルに信号を運んでいる。２本の導線（制
御線対）には、制御信号を送ることが任されている。各
デコーダ１００は、一意的なアドレスを付与されてお
り、異なった制御信号を各インターフェースに供給する
ことができる。特定のインターフェースに向けられた制
御信号に応答して、デコーダ１００は各デマルチプレク
サ０１，０２，０３および０４にステアリング信号を出
力する。制御信号は、次のことを決定する。すなわち、
出力バッファＯＢに導線されている出力ポートＯＵＴに
各バス導線のうちのいずれを結合するか；入力バッファ
ＩＢに結合されている入力ポートＩＮに各バス導線のう
ちのいずれを結合するか；および、いずれの導線が右と
左の入力／出力ポート間で、インターフェースを乗り継
ぐのかである。デージィ・チェーン接続を選択的に切断
するデマルチプレクサ０１，０２，０３および０４を含
めることにより、切断点の片側の装置が、同じ導線の切
断点の他の側の装置コンポーネント間の通信とは独立に
通信することができる。この結果、非常に多数の独自の
通信が、バス構成中の比較的少数の導線を用いて、実施
することができる。
【００１２】（制御線対を除いて）バス導線は、各デマ
ルチプレクサ０１および０２により、インターフェース
・ノードＯＵＴに選択的に結合される。（制御線対を除
いて）バス導線は、各デマルチプレクサ０３および０４
により、インターフェース・ノードＩＮに選択的に結合
される。インターフェースの右からまたは左からのすべ
ての導線は、ノードＯＵＴまたはノードＩＮに結合する
はできるが、同時にノードＯＵＴとＩＮの両方には結合
できない。あるいはまた、導線のうち選択された各々の
みを実際にＯＵＴまたはＩＮのノードに結合し、残余の
導線は適切に終端するようにしてもよい。デジタル設計
分野の当業者には、３つのデマルチプレクサにより、多
数の相互接続の組合せが可能であることは理解できるで
あろう。しかしながら、制御線対は、ビット・シリアル
にデータを通信しているので、制御ワード長は、デコー
ダの設計によってのみ制限される。従って、制御ワード
長が８ビットに制限されている場合、選択され得る可能
な相互接続の組合せの数は、２５６である。２５６の組
合せは、図示した４つよりもっと本数の多い導線のスイ
ッチングをできるようにする。デコーダ１００は、メモ
リ・アドレス・ポートに供給される異なる制御信号に対
して、複数の制御機能をプログラムした読み出し専用メ
モリで構成することができる。
【００１３】ＡＶＤバス・システムの重要な特徴は、デ
ータすなわち信号のフォーマットである。この例では、
通信されるべき信号は、ＭＰＥＧ２ビデオ標準のシステ
ム・レイヤまたはグランド・アライアンス信号フォーマ
ットのトランスポート・レイヤで定義されている、トラ
ンスポート・パケットの形式で供給されることを前提と
している。ＡＤＶバス上での送信において、トランスポ
ート・パケットは、本発明においてスーパーパケットと
名付けられているもう一つのパケット内にパッケージさ
れる。スーパーパケットの内容には、タイムスタンプ、
トランスポート・パケットおよび再生速度コード（ｐｌ
ａｙｂａｃｋ ｒａｔｅ ｃｏｄｅ）が含まれている。
タイムスタンプはタイミング・コードで、トランスポー
ト・パケットの受信の瞬間に取られたクロック・カウン
タのサンプルである。再生速度コードは、記録装置で使
用されるコードで、特定の記録された信号が再生される
べき速度を定めている。再生速度は、記録速度に対して
相対的にコード化されている。再生速度コードは、ＡＶ
Ｄバスに接続されている装置のうちで記録装置以外の装
置では読みとられない。
【００１４】再生速度コードの目的は、比較的速いビッ
ト速度で記録を行い、かつ通常のビット速度で再生を行
うことができるようにすることである。この特徴は、高
速の複写、およびたとえばあるビデオ・ダイヤル・トー
ン・システム(Video Dial Tone System)で考えられてい
るような高速バースト中のビデオ信号の受信をできるよ
うにすることである。後者の応用においては、映画全体
を超高速のビット速度で数分内に送信し、および記録
し、その後通常の速度で再生することが期待されてい
る。
【００１５】図３は、ＡＶＤバス上で転送される信号を
図示したものである。フレーム・クロックは導線の１つ
に供給されて、ＡＶＤバスの他の導線上にスーパーパケ
ットが生じたことを示す。フレーム・クロックが高い状
態のとき、スーパーパケットは高い状態内においてフレ
ームされており、かつ高い状態と一致している。フレー
ム・クロックの高い状態、すなわちアクティブ間隔はす
べてのパケットに対して一定であり、この例では、１９
１バイト（１バイトは８ビット）の持続期間と等しい。
これら１９１バイトは、２０ビットのタイムスタンプ、
４ビットの再生速度コード、１８８バイトのトランスポ
ート・バケットに分けられる。トランスポート・パケッ
トが１８８バイトより少ない場合は、スーパーパケット
のトランスポート・パケット部分の先頭部分にロードさ
れる。好ましいデータの順序は、タイムスタンプ、再生
速度コード、そしてそれからトランスポート・パケット
であるが、他の構成も可能である。フレーム・クロック
のアクティブ部分は一定期間であるが、アクティブでな
い部分は可変であることに注意されたい。このことは、
スーパーパケットの形成に大きな柔軟性を与えている。
【００１６】再生速度コードは、好都合であるが、必須
のものではない。他方、タイムスタンプは、スイッチド
・バス構造(switched bus structure)において、各装置
コンポーネントにおけるトランスポート・パケットの受
信時に、ジッタ（ゆらぎ）が導入される可能性があるた
めに含められている。ジッタは、システムの性能、特に
記録装置の性能に影響を及ぼす。タイムスタンプは記録
装置により使用されて、ソースとなったトランスポート
・パケットの発生タイミングに記録装置を同期させ、こ
れによりタイミング・ジッタを除去する。
【００１７】図４を参照して、スーパーパケットを生成
するひとつの方法を説明する。この例では、ビデオ信号
はカメラ４０から供給されている。この信号はＭＰＥＧ
エンコーダ４１により圧縮され、トランスポート・プロ
セッサ４２によりトランスポート・パケットにパッケー
ジされる。ＭＰＥＧエンコーダ４１は、システム・クロ
ック４５およびモジュロＭカウンタ４３と協働して、圧
縮されたビデオ信号中にタイムスタンプの表示を設け
る。および、トランスポート・プロセッサ４２もまた、
モジュロＭカウンタ４３と協働して、トランスポート・
パケットの各々にプログラム・クロック・レファレンス
を設ける。トランスポート・プロセッサ４２はビデオ信
号のビット直列のトランスポート・バケットを１個の出
力ポートに供給しており、そして、それと並列に、順次
の出力トランスポート・パケットの開始を示すタイミン
グ信号を供給している。
【００１８】順次のトランスポート・パケットは、補償
用の遅延要素５０で遅延され、それからフォーマット化
装置４７に供給される。各新しいトランスポート・パケ
ットの開始時に、モジュロＭカウンタのカウントは、ラ
ッチ４４に取り込まれ、ラッチ４４の出力はフォーマッ
ト化装置４７に結合される。その上、再生速度制御コー
ドＰＢは、システム・コントローラ４６からフォーマッ
ト化装置４７に供給される。この例では、カメラは、リ
アルタイムで、かつ通常の速度で動作するものとし、従
って再生速度コードは、記録速度と同じ再生速度を反映
している。カメラ動作の速度はユーザ入力４８により制
御される。このユーザ入力は、多数の可変コーディング
および圧縮パラメータを定義している。
【００１９】トランスポート・プロセッサ４２から供給
されるタイミング信号が、新しいトランスポート・パケ
ットの発生を示している時、コントローラ４６はフォー
マット化装置４７に条件づけを行って、まず、直列形式
でタイムスタンプ（すなわち、ラッチ４４にラッチされ
ているカウント）を出力し、次に直列形式で再生速度コ
ードを出力し、および最後に直列形式で遅延されたトラ
ンスポート・パケットを出力して、スーパーパケットを
形成する。遅延要素５０においてトランスポート・パケ
ットが受けた遅延は、タイムスタンプと再生速度コード
を読み出すのに必要な時間に等しい。
【００２０】スーパーパケットは、インターフェースの
制御線対の導線上に存在する制御信号の制御の下で、イ
ンターフェース４９の導線の所望の１つに供給される。
それに加えて、コントローラは、フレーム・クロック信
号を発生する。このフレーム・クロック信号はスーパー
フレームと一致しており、インターフェース４９内のＡ
ＶＤバスの第２の導線に供給される。
【００２１】このコントローラ４６が全システムのコン
トローラである場合は、制御線対に供給される制御信号
を発生し、信号がどこに送られるかの選択は、ユーザ入
力４８の制御の下で行われる。そうではない場合は、コ
ントローラ４６とインターフェースとのやりとりは、こ
の例ではフレーム・クロックの発生のみである。
【００２２】図５は、第２のスーパーパケット発生器の
第２実施例を示す。図５において、図４と同じ符号を付
与している要素は、同様のものであり、同じような機能
を実行する。送信されたトランスポート・パケットは、
モデムで受信され、パケット・ソース５１のリード・ソ
ロモン・デコーダで誤り訂正される。パケット・ソース
は、各トランスポート・パケットの生起と同時にパルス
Ｐを出力してそれら存在を示す。パルスＰおよびトラン
スポート・パケットを逆トランスポート・プロセッサ５
３に供給する。この実施例では、パケット・ソースに供
給される信号は、異なるプログラムおよび異なるプログ
ラム・コンポーネントに適した時分割多重のパケットを
含んでいることを前提としている。各パケットは、プロ
グラム識別子ＰＩＤを含んでおり、これにより、各パケ
ットを各プログラムやプログラム・コンポーネントに関
連づける。トランスポート・プロセッサは所望のプログ
ラムと関連するパケットのみを選択するように条件づけ
られている。これらパケットのペイロードを、ダイレク
ト・メモリ・アクセスＤＭＡを介して、バッファ・メモ
リ５４に供給する。各プログラム・コンポーネントのペ
イロードをバッファ・メモリ５４の特定のエリアに供給
する。各プログラム・コンポーネントのプロセッサ、す
なわちオーディオ・プロセッサ５５，ビデオ・プロセッ
サ５６，補助プロセッサ５７およびスマート・カード５
８がコンポーネント信号データを要求するときに、それ
らプロセッサはプロセッサ５３からも同じコンポーネン
ト信号データを要求する。プロセッサ５３は、ＤＭＡ構
成を介して適切なペイロードを読みとる。
【００２３】トランスポート・パケットの各々は、プロ
グラム・クロック・レファレンスＰＣＲを含んでおり、
それによりトランスポート・パケットの生成をエンコー
ダのシステム・クロックに正確に関連づける。逆トラン
スポート・プロセッサ５３は、これらのＰＣＲを抽出
し、そしてそれらＰＣＲをシステム・クロック発生器５
２に供給する。ＰＣＲを使用して、クロック発生器５２
はシステム・クロックを発生する。そのシステム・クロ
ックの周波数は、エンコーダのシステム・クロックにロ
ックしている。システム・クロックは逆トランスポート
・プロセッサ５３およびパケット・ソース５１で用いら
れ、これにより、トランスポート・パケットは最初の生
成と相対的に同期している。システム・クロックの発生
は、図６に関連して、下記に記載されるクロックの同期
化と同様である。
【００２４】システム・クロックはモジュロＭカウンタ
４３でカウントされ、そして、パルスＰが生起したとき
に、すなわち新規のトランスポート・パケットの開始が
パケット・ソースにより出力されたときにカウンタによ
り提示されたカウント値が、パルスＰに応答してラッチ
５０中に取り込まれる。さらに加えて、関連するトラン
スポート・パケットは補償用遅延要素５０に供給され
る。要素５０からの遅延されたトランスポート・パケッ
ト、ラッチ４４からのタイムスタンプ（カウント値）お
よびコントローラ４６０からの再生速度コードは、スー
パーパケット・フォーマット化装置４７の各入力ポート
に供給される。
【００２５】コントローラ４６０は、ユーザ入力４８の
制御の下で、逆トランスポート・プロセッサと交信し
て、どのプログラム・トランスポート・パケットをスー
パーパケットにパッケージするかを指定する。各トラン
スポート・パケットの生起時に、受信したトランスポー
ト・パケットが所望のものであるときにはいつでも、逆
トランスポート・プロセッサよりパルスをコントローラ
４６０にパルスを供給する。このパルスに応答して、コ
ントローラ４６０は、フォーマット化装置を条件づけし
て、現在のタイムスタンプ、ＰＢおよびトランスポート
・パケットで、スーパーパケットを形成するようにす
る。この例では、遅延要素５０は、最初の２つのスーパ
ーパケットのデータ要素の形成時間だけではなく、逆プ
ロセッサが、パケットが所望のパケットのうちのひとつ
であることを確認するのに必要な時間をも含むものとす
る。
【００２６】前述の例において、タイムスタンプは、ト
ランスポート・パケットの生起時に発生する。あるいは
また、タイムスタンプは、スーパーパケットの発生のタ
イミングに関連して発生してもよい。すなわち、タイム
スタンプが、スーパーパケットが出力される瞬時を定義
してもよいし、あるいはスーパーパケットの合成が開始
される瞬間を定義してもよい。これらの瞬間において、
タイムスタンプは、一般にフレーム・クロックの立ち上
がり端縁に関連しているが、この遷移のタイミングを定
義はしていない。タイムスタンプは特定のトランスポー
ト・パケットに依然として関連している。それは、スー
パーパケットは各トランスポート・パケットを運ぶため
に発生されているからである。
【００２７】フレーム・クロックは固定された周波数の
信号ではない。すなわち、フレーム・クロックの非アク
ティブ部分は可変である。タイム・クロックを固定され
た周波数のクロックとしないことによって、スーパーパ
ケットは、トランスポート・パケットが利用可能である
ときは何時でも形成されるようにすることが特に望まし
い。固定された周波数のフレーム・クロックは望ましく
ない。その理由は、フレーム・クロックのアクティブ部
分の開始後に生起したトランスポート・パケットに対す
るスーパーパケットの形成が、フレーム・クロックの次
のサイクルまで強制的に遅延させられるからである。タ
イムスタンプがスーパーパケットまたはフレーム・クロ
ックの形成に関連しているものとすると、図４および図
５のラッチ４４は、フォーマット化装置４７、あるいは
コントローラ４６または４６０のいずれかによりカウン
ト値を取り込むように条件づけることができる。
【００２８】図６は、記録装置中において用いられて、
タイムスタンプを同期に用いる装置の例を示している。
ＡＶＤバス・インターフェースの１本の導線からのスー
パーパケットを信号ソータ２０２の入力ポートの１つに
結合し、ＡＶＤバス・インターフェースの他方の導線上
のフレーム・クロックを信号ソータ２０２の第２の入力
ポートに結合する。エッジ検出器３１は、フレーム・ク
ロックのアクティブな期間の開始を規定するフレーム・
クロック信号の遷移を検出し、およびこの検出に応答し
て、システム・クロック発生器２０８中のカウンタ３６
に表示されているカウントを、ラッチ３５中に取り込
む。カウンタ３６は、電圧制御発振器３７からのパルス
をカウントする。この電圧制御発振器３７は、スーパー
パケットのタイムスタンプを発生するのに用いられる周
波数に近い自走周波数を有する。
【００２９】ラッチ３５にカウント値を取り込むのと同
時に、エッジ検出器３１はデマルチプレクサ・コントロ
ーラ３３に警告を与えて、デマルチプレクサ３２を制御
する一連の制御信号を供給してスーパーパケットのコン
ポーネントを分離する。スーパーパケット中に含まれる
タイムスタンプは、クロック・コントローラ３９によっ
てアクセスされるメモリ３４中に格納される。記録装置
が取り扱うように配置されている形式の信号に依存し
て、デマルチプレクサ３２は種々のフォーマットで信号
を供給するように設計することができる。すなわち、デ
マルチプレクサ３２はスーパーパケットをそっくり供給
することができる。あるいはまた、デマルチプレクサを
適切に構成して、再生速度コードＰＢを記録装置コント
ローラ回路２９によりアクセスされる１つのポートに供
給し、およびトランスポート・パケットを記録回路２８
によりアクセスされる他のポートに供給するようにして
もよい。
【００３０】クロック・コントローラ３９は、ラッチ３
５にラッチされた順次の値およびメモリ３４に格納され
た順次のタイムスタンプの値を格納する装置を有する。
順次のタイムスタンプの値をＴＳn およびＴＳn-1 とす
る。ラッチ３５に格納されている対応する順次のカウン
ト値をＬＣＲn およびＬＣＲn-1 とする。クロック・コ
ントローラ３９はＴＳおよびＬＣＲの順次の値を読みと
り、かつ差に比例する誤差信号Ｅを形成する。
【００３１】
【数１】
【００３２】誤差信号Ｅは電圧制御発振器３７に制御信
号として供給され、この発振器３７がタイムスタンプを
発生したシステム・クロックと等しい周波数を発生する
ようにする。このようにして、システム・クロック発生
器２０８の電圧制御発振器３７からスーパーパケット中
のタイムスタンプと同期のとれたシステム・クロックが
取り出される。クロック・コントローラ３９により発生
した誤差信号はパルス幅変調信号の形式とすることがで
き、ローパス・フィルタ３８をアナログ部品で実施する
ことにより、この誤差信号をアナログの誤差信号とする
ことができる。
【００３３】このシステムの制約は、システムの両側に
あるカウンタが同じ周波数かその偶数倍数をカウントし
ていることである。これには、電圧制御発振器３７の定
格周波数がエンコーダにおけるシステム・クロックの周
波数にかなり近いことが必要である。
【００３４】図５に示した回路により発生したトランス
ポート・パケットの生起は、たとえば、エンコーダのク
ロックとＰＣＲを介して同期している、システム・クロ
ックと同期していることに留意されたい。これらトラン
スポート・パケットの生起は、受信機の同期クロックと
協働しててタイムスタンプされ、そして、各トランスポ
ート・パケットはタイムスタンプを付された後にＡＶＤ
バスに供給される。ＡＶＤバスの記録装置インターフェ
ースにおいて、トランスポート・パケットを用いた記録
装置は、タイムスタンプを用いて、トランスポート・パ
ケットおよび受信機のシステムクロックと同期している
記録装置のシステム・クロックを発生させる。従って、
記録装置で用いられる信号パケットは、実質的にジッタ
無しとなる。
【図面の簡単な説明】
【図１】多数のバス／装置間インターフェースを含む、
本発明を実施するデージーチェーン接続のバス・ハード
ウェアのブロック図である。
【図２】バス・インターフェースの１つの一部分のブロ
ック図である。
【図３】バス・スーパー・パケット波形的および絵画的
表示図である。
【図４】スーパーパケットを形成するための装置のブロ
ック図である。
【図５】スーパーパケットを形成するための装置のブロ
ック図である。
【図６】各スーパーパケットに含まれているタイムスタ
ンプを用いて、インターフェースに結合されている装置
を同期させるクロック発生装置のブロック図である。
【符号の説明】
ＯＢ 出力バッファ ＩＢ 入力バッファ ＤＴ 半二重送受信器 ０１，０２，０３，０４ デマルチプレクサ ＩＮ 入力ポート（インターフェース・ノード） ＯＵＴ 出力ポート（インターフェース・ノード） ２８ 記録回路 ２９ 記録装置コントローラ ３１ フレーム・クロック・エッジ検出器 ３２ デマルチプレクサ ３３ デマルチプレクサ・コントローラ ３４ メモリ ３５ ラッチ ３６ カウンタ ３７ 電圧制御発振器 ３８ ローパス・フィルタ ３９ クロック・コントローラ ４０ カメラ ４１ ＭＰＥＧエンコーダ ４２ トランスポート・プロセッサ ４３ モジュロＭカウンタ ４４ ラッチ ４５ システム・クロック発生器 ４６ システム・コントローラ ４７ フォーマット化装置 ４８ ユーザ入力 ４９ インターフェース ５０ 遅延要素 ５１ パケット・ソース ５２ クロック発生器 ５３ 逆トランスポート・プロセッサ ５４ バッファ・メモリ ５５ オーディオ・プロセッサ ５６ ビデオ・プロセッサ ５７ 補助プロセッサ ５８ スマート・カード １００ デコーダ ２０２ 信号ソータ ２０８ システム・クロック発生器 ４６０ コントローラ １０００，１００１，１００２ インターフェース
───────────────────────────────────────────────────── フロントページの続き (72)発明者 マイケル スコット ディース アメリカ合衆国 インディアナ州 ザイア ンスヴィル インディアン パイプ レー ン 1103 (72)発明者 チャールズ ベイリ ニール アメリカ合衆国 インディアナ州 ザイア ンスヴィル カムデン ドライブ 295

Claims (8)

    【特許請求の範囲】
  1. 【請求項１】 圧縮された信号をオーディオ・ビデオ・
    システムのコンポーネント間で通信し、その圧縮された
    信号をトランスポート・パケットにおいてソースとな
    し、そのようにソースを与えられたトランスポート・パ
    ケットを受信するコンポーネントが、システム・クロッ
    クを有する方法において、 前記システム・クロックのパルスを計数してカウント値
    を発生するステップと、 ソースを与えられたトランスポート・パケットの生起に
    関連する予め定めた瞬時に現在のカウント値を取り込む
    ステップと、 その取り込んだカウント値および対応するトランスポー
    ト・パケットを含むビット・シリアルのスーパーパケッ
    トを形成するステップと、 そのスーパーパケットを前記コンポーネントへバスを介
    して転送するステップとを具えたことを特徴とする方
    法。
  2. 【請求項２】 記録コンポーネントで使用する再生速度
    コードを提供し、該再生速度コードは、記録すべき信号
    の受信の速度に関係する比およびこのような信号を再生
    するときの速度を定義しているステップと、 前記スーパーパケットに前記再生速度コードを含むステ
    ップとをさらに具えたことを特徴とする請求項１記載の
    方法。
  3. 【請求項３】 前記スーパーパケットを形成するステッ
    プは、前記カウント値と、前記再生速度コードと、前記
    トランスポート・パケットとをこの順序で組合せるステ
    ップを有することを特徴とする請求項２記載の方法。
  4. 【請求項４】 各スーパーパケット持続期間と一致した
    アクティブ状態と、スーパーパケットの不存在期間にお
    ける非アクティブ状態とを有するフレーム・クロック信
    号を発生し、かつアクティブ状態の持続期間は一定であ
    るが、非アクティブ状態の持続期間は可変であるステッ
    プと、 前記フレーム・クロック信号を前記スーパーパケットと
    並列に前記バス上を転送し、前記各コンポーネントのそ
    れぞれで前記スーパーパケットの受信を識別するのに使
    用するステップとをさらに具えたことを特徴する請求項
    １記載の方法。
  5. 【請求項５】 前記バスを各前記コンポーネントに選択
    的に結合するインターフェースを備え、および前記イン
    ターフェースを制御する制御信号を前記バスに供給する
    ことを特徴とする請求項４記載の方法。
  6. 【請求項６】 コンポーネント装置間でトランスポート
    ・パケット中に生起する圧縮データを通信する装置にお
    いて、 前記トランスポート・パケットのソースと、 前記トランスポート・パケットの各々に関連するタイム
    スタンプを発生する手段と、 前記タイムスタンプおよび関連するトランスポート・パ
    ケットを含むスーパーパケットを形成し、前記コンポー
    ネント装置を相互接続するバスに前記スーパーパケット
    を供給する手段とを具えたことを特徴とする装置。
  7. 【請求項７】 前記バスはバス・インターフェースと縦
    続結合された導線部分を有し、前記導線部分の各々は複
    数の導線を有し、そのうちの２本は制御信号に割り当て
    られ、前記インターフェースの各々は、 各導線部分に接続される第１および第２の入力／出力ポ
    ートと、 コンポーネントを前記バスに結合する第３の入力／出力
    ポートと、 前記制御信号に応答して、前記第１または第２の入力／
    出力ポートに結合されている前記導線部分の前記導線の
    各々を前記第３の入力／出力ポートの導線に選択的に接
    続するマルチプレクス手段と、 制御信号に応答して、前記第１の入力／出力ポートに結
    合されている前記導線部分の前記導線の各々を前記第２
    の入力／出力ポートの導線に選択的に接続するスイッチ
    手段と、 前記制御信号を供給する制御手段とを具えたことを特徴
    とする請求項６記載の装置。
  8. 【請求項８】 前記バスに結合され、前記スーパーパケ
    ットの持続期間と一致したアクティブ状態と、前記スー
    パーパケットの不存在期間における非アクティブ状態と
    を有し、前記アクティブ状態の持続期間は一定である
    が、前記非アクティブ状態の持続期間は可変であるフレ
    ーム・クロックを発生する手段をさらに具えたことを特
    徴とする請求項７記載の装置。
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