JPH0879960A - ディジタル保護リレーにおけるサンプリング不良検出装置 - Google Patents
ディジタル保護リレーにおけるサンプリング不良検出装置Info
- Publication number
- JPH0879960A JPH0879960A JP6210173A JP21017394A JPH0879960A JP H0879960 A JPH0879960 A JP H0879960A JP 6210173 A JP6210173 A JP 6210173A JP 21017394 A JP21017394 A JP 21017394A JP H0879960 A JPH0879960 A JP H0879960A
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- JP
- Japan
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- sampling
- signal
- protective relay
- relay
- digital protective
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- 238000005070 sampling Methods 0.000 title claims abstract description 42
- 230000001681 protective effect Effects 0.000 title abstract 3
- 238000001514 detection method Methods 0.000 claims description 5
- 230000007257 malfunction Effects 0.000 abstract description 6
- 238000011156 evaluation Methods 0.000 abstract 1
- 238000010586 diagram Methods 0.000 description 3
- 238000006243 chemical reaction Methods 0.000 description 2
- 230000002950 deficient Effects 0.000 description 1
- 238000012986 modification Methods 0.000 description 1
- 230000004048 modification Effects 0.000 description 1
Landscapes
- Testing Electric Properties And Detecting Electric Faults (AREA)
- Emergency Protection Circuit Devices (AREA)
- Analogue/Digital Conversion (AREA)
Abstract
(57)【要約】
【目的】アナログ入力信号をサンプリングし、ディジタ
ル変換し、所定のリレー演算をするディジタル保護リレ
ーにおいて、サンプリングパルス間隔が予定されている
値からずれると、交流入力値を正確に評価することがで
きなくなり、誤動作や誤不動作の原因になるので、サン
プリング間隔のずれを検出する。 【構成】ＣＰＵ５は、内蔵の時計回路２を利用してサン
プリング信号のカウントをソフトウェアにより行う。 【効果】タイマー等を追加せず、これにより入力信号を
正しく評価でき、誤動作や誤不動作のないディジタル保
護リレーを実現することができる。
ル変換し、所定のリレー演算をするディジタル保護リレ
ーにおいて、サンプリングパルス間隔が予定されている
値からずれると、交流入力値を正確に評価することがで
きなくなり、誤動作や誤不動作の原因になるので、サン
プリング間隔のずれを検出する。 【構成】ＣＰＵ５は、内蔵の時計回路２を利用してサン
プリング信号のカウントをソフトウェアにより行う。 【効果】タイマー等を追加せず、これにより入力信号を
正しく評価でき、誤動作や誤不動作のないディジタル保
護リレーを実現することができる。
Description
【０００１】
【産業上の利用分野】本発明は、ディジタル保護リレー
においてサンプリング間隔の正常値からのずれを検出す
ることのできるサンプリング不良検出装置に関するもの
である。
においてサンプリング間隔の正常値からのずれを検出す
ることのできるサンプリング不良検出装置に関するもの
である。
【０００２】
【従来の技術】一般的なディジタル保護リレーの構成を
図３に示す。ディジタル保護リレー１１には、電流、電
圧等のアナログ入力値を一定間隔でサンプリングするサ
ンプルホールド回路３が設けられており、このサンプル
ホールド回路３には、サンプルクロック回路８から、例
えば３０°ごとのサンプリングパルスが供給される。Ｃ
ＰＵ５は、このサンプル値に基づいて所定のリレー演算
をし、所定の条件が満たされた場合に信号を出力し補助
リレー９を動作させる。
図３に示す。ディジタル保護リレー１１には、電流、電
圧等のアナログ入力値を一定間隔でサンプリングするサ
ンプルホールド回路３が設けられており、このサンプル
ホールド回路３には、サンプルクロック回路８から、例
えば３０°ごとのサンプリングパルスが供給される。Ｃ
ＰＵ５は、このサンプル値に基づいて所定のリレー演算
をし、所定の条件が満たされた場合に信号を出力し補助
リレー９を動作させる。
【０００３】このサンプリングパルス間隔が、予定され
ている値どおりであれば、リレーはサンプル値に基づい
て正確に動作するが、予定されている値からずれると、
ＣＰＵ５は、交流入力値を正確に評価することができな
くなり、誤動作や誤不動作の原因になる。そこで、サン
プリングパルス間隔を常時監視し、正常値からずれる
と、直ちに警報装置に警報指令を出力したり、しゃ断器
へのトリップ指令をロックする等の対策をする必要があ
るが、このサンプリングパルス間隔の監視のため、サン
プリングパルス間隔を測定できる専用のタイマを設置す
ることが考えられる。このタイマは、あるサンプリング
パルスを受けてから、次のサンプリングパルスを受ける
までの時間を測定するものである。
ている値どおりであれば、リレーはサンプル値に基づい
て正確に動作するが、予定されている値からずれると、
ＣＰＵ５は、交流入力値を正確に評価することができな
くなり、誤動作や誤不動作の原因になる。そこで、サン
プリングパルス間隔を常時監視し、正常値からずれる
と、直ちに警報装置に警報指令を出力したり、しゃ断器
へのトリップ指令をロックする等の対策をする必要があ
るが、このサンプリングパルス間隔の監視のため、サン
プリングパルス間隔を測定できる専用のタイマを設置す
ることが考えられる。このタイマは、あるサンプリング
パルスを受けてから、次のサンプリングパルスを受ける
までの時間を測定するものである。
【０００４】
【発明が解決しようとする課題】ところが前記の構成で
は、専用のタイマが必要となり、リレーの構成が複雑化
する。そこで、本発明の目的は、上述の技術的課題を解
決し、できるだけ現状の設備を利用して簡単にサンプリ
ング間隔を求めることのできるサンプリング不良検出装
置を実現することである。
は、専用のタイマが必要となり、リレーの構成が複雑化
する。そこで、本発明の目的は、上述の技術的課題を解
決し、できるだけ現状の設備を利用して簡単にサンプリ
ング間隔を求めることのできるサンプリング不良検出装
置を実現することである。
【０００５】
【課題を解決するための手段】前記の目的を達成するた
めの請求項１記載のサンプリング不良検出装置は、リレ
ーに備えられている時計からの時刻信号に基づいて一定
時間におけるサンプリング信号のカウントを行い、この
結果からサンプリング間隔のずれを求めるものである。
めの請求項１記載のサンプリング不良検出装置は、リレ
ーに備えられている時計からの時刻信号に基づいて一定
時間におけるサンプリング信号のカウントを行い、この
結果からサンプリング間隔のずれを求めるものである。
【０００６】
【作用】前記の構成によれば、リレーに標準で備えられ
ている時計を利用して、ソフトウェアにより一定時間に
おけるサンプリング信号のカウントを行いサンプリング
間隔のずれを求めることができる。
ている時計を利用して、ソフトウェアにより一定時間に
おけるサンプリング信号のカウントを行いサンプリング
間隔のずれを求めることができる。
【０００７】
【実施例】以下実施例を示す添付図面によって詳細に説
明する。図１は、サンプリング不良検出装置が組み込ま
れたディジタル保護リレー１の内部ブロック図を示す。
ディジタル保護リレー１は、電流、電圧等のアナログ入
力の基本波成分を通過させるフィルタ回路１０、サンプ
リング信号を送出するサンプルクロック回路８、サンプ
ルホールド回路３、アナログ信号をディジタル変換する
Ａ／Ｄ変換回路４、所定のリレー演算を行うＣＰＵ５及
びＣＰＵ５に付属する出力回路６、メモリ回路７、時計
２、並びに補助リレー９を備えている。
明する。図１は、サンプリング不良検出装置が組み込ま
れたディジタル保護リレー１の内部ブロック図を示す。
ディジタル保護リレー１は、電流、電圧等のアナログ入
力の基本波成分を通過させるフィルタ回路１０、サンプ
リング信号を送出するサンプルクロック回路８、サンプ
ルホールド回路３、アナログ信号をディジタル変換する
Ａ／Ｄ変換回路４、所定のリレー演算を行うＣＰＵ５及
びＣＰＵ５に付属する出力回路６、メモリ回路７、時計
２、並びに補助リレー９を備えている。
【０００８】前記サンプルクロック回路８は、本実施例
では、３０°（６０Ｈｚであれば１．３８msec）間隔で
サンプリング信号を送出し、サンプルホールド回路３
は、サンプルクロック回路８からのサンプリング信号に
基づいてサンプリングする。前記ＣＰＵ５は、フローチ
ャート（図２）に従って、１秒の間に何回サンプリング
が行われたかを、カウントする。すなわち、時計２より
受ける時刻信号に基づき、毎分００秒でカウントを開始
し、０１秒でカウントを止める。そして、カウントした
数が一定の範囲であるかどうか判定する（ステップ(4)
）。この一定の範囲は、正常なサンプリングであれば
７２０回なので、例えば７１９−７２１とする。したが
って、一定の範囲から外れて例えば７１８回しかカウン
トしなければ正常でないと分かり、３０．０８°サンプ
リングであり、０．０８°ずれがあることが分かる。
では、３０°（６０Ｈｚであれば１．３８msec）間隔で
サンプリング信号を送出し、サンプルホールド回路３
は、サンプルクロック回路８からのサンプリング信号に
基づいてサンプリングする。前記ＣＰＵ５は、フローチ
ャート（図２）に従って、１秒の間に何回サンプリング
が行われたかを、カウントする。すなわち、時計２より
受ける時刻信号に基づき、毎分００秒でカウントを開始
し、０１秒でカウントを止める。そして、カウントした
数が一定の範囲であるかどうか判定する（ステップ(4)
）。この一定の範囲は、正常なサンプリングであれば
７２０回なので、例えば７１９−７２１とする。したが
って、一定の範囲から外れて例えば７１８回しかカウン
トしなければ正常でないと分かり、３０．０８°サンプ
リングであり、０．０８°ずれがあることが分かる。
【０００９】サンプリング不良と判定されれば（ステッ
プ(5) ）、ＣＰＵ５は、警報指令を出したり、しゃ断器
へのトリップ指令をロックしたりする。以上の処理によ
り、時計２から時刻信号を利用して、サンプリング間隔
が正常であるかどうかを判断することができ、その後の
所定の動作に入ることができる。
プ(5) ）、ＣＰＵ５は、警報指令を出したり、しゃ断器
へのトリップ指令をロックしたりする。以上の処理によ
り、時計２から時刻信号を利用して、サンプリング間隔
が正常であるかどうかを判断することができ、その後の
所定の動作に入ることができる。
【００１０】なお、本発明は前記の実施例に限られるも
のではなく、例えば毎分００秒−０１秒間にカウントを
するのに代えて、他の時刻（例えば毎分５８秒−５９
秒）でカウントしてもよい。カウントする時間は１秒に
限らず、例えば１０秒でもよい。カウントする時間が長
いほどサンプリング間隔を精度よく検出できる。またサ
ンプルクロックは、３０°でなく他の角度ごとでもよい
のは勿論である。その他本発明の要旨を変更しない範囲
で種々の変更を施すことが可能である。
のではなく、例えば毎分００秒−０１秒間にカウントを
するのに代えて、他の時刻（例えば毎分５８秒−５９
秒）でカウントしてもよい。カウントする時間は１秒に
限らず、例えば１０秒でもよい。カウントする時間が長
いほどサンプリング間隔を精度よく検出できる。またサ
ンプルクロックは、３０°でなく他の角度ごとでもよい
のは勿論である。その他本発明の要旨を変更しない範囲
で種々の変更を施すことが可能である。
【００１１】
【発明の効果】以上のように本発明のサンプリング不良
検出装置によれば、現状の設備を利用してサンプリング
間隔のずれをソフトウェアにより検出することができ、
これにより入力信号を正しく評価でき、誤動作や誤不動
作のないディジタル保護リレーを実現することができ
る。
検出装置によれば、現状の設備を利用してサンプリング
間隔のずれをソフトウェアにより検出することができ、
これにより入力信号を正しく評価でき、誤動作や誤不動
作のないディジタル保護リレーを実現することができ
る。
【図１】サンプリング不良検出装置が組み込まれたディ
ジタル保護リレーの内部ブロック図である。
ジタル保護リレーの内部ブロック図である。
【図２】時計からの時刻信号に基づいて一定時間におけ
るサンプリング信号のカウントを行い、この結果からサ
ンプリング間隔のずれを求めるソフトウェア処理を示す
フローチャートである。
るサンプリング信号のカウントを行い、この結果からサ
ンプリング間隔のずれを求めるソフトウェア処理を示す
フローチャートである。
【図３】一般的なディジタル保護リレーの構成を示すブ
ロック図である。
ロック図である。
１ ディジタル保護リレー ２ 時計 ３ サンプルホールド回路 ４ Ａ／Ｄ変換回路 ５ ＣＰＵ ８ サンプルクロック回路
Claims (1)
- 【請求項１】アナログ入力信号をサンプリングするサン
プリング手段と、サンプリング出力値をディジタル変換
するディジタル変換手段と、ディジタル変換手段の出力
信号に基づいて所定のリレー演算をする演算手段と、時
刻信号を出力する時計とを有するディジタル保護リレー
において、 前記演算手段は、前記時計からの時刻信号に基づいて一
定時間におけるサンプリング信号のカウントを行い、こ
の結果によりサンプリング間隔の正常値からのずれを求
めるものであることを特徴とするサンプリング不良検出
装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6210173A JPH0879960A (ja) | 1994-09-02 | 1994-09-02 | ディジタル保護リレーにおけるサンプリング不良検出装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6210173A JPH0879960A (ja) | 1994-09-02 | 1994-09-02 | ディジタル保護リレーにおけるサンプリング不良検出装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0879960A true JPH0879960A (ja) | 1996-03-22 |
Family
ID=16584993
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP6210173A Pending JPH0879960A (ja) | 1994-09-02 | 1994-09-02 | ディジタル保護リレーにおけるサンプリング不良検出装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0879960A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2009095205A (ja) * | 2007-10-12 | 2009-04-30 | Meidensha Corp | サンプリング周波数の監視方式 |
| JP2019070584A (ja) * | 2017-10-10 | 2019-05-09 | 株式会社デンソー | 電子制御装置 |
-
1994
- 1994-09-02 JP JP6210173A patent/JPH0879960A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2009095205A (ja) * | 2007-10-12 | 2009-04-30 | Meidensha Corp | サンプリング周波数の監視方式 |
| JP2019070584A (ja) * | 2017-10-10 | 2019-05-09 | 株式会社デンソー | 電子制御装置 |
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