JPH088420A - Surge protection element - Google Patents

Surge protection element

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JPH088420A
JPH088420A JP13766194A JP13766194A JPH088420A JP H088420 A JPH088420 A JP H088420A JP 13766194 A JP13766194 A JP 13766194A JP 13766194 A JP13766194 A JP 13766194A JP H088420 A JPH088420 A JP H088420A
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秀隆 佐藤
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Abstract

(57)【要約】 【目的】 サージ防護素子に関し、ストライプ状あるい
は櫛形状に微細化したサイリスタ構造において、素子全
体を確実にかつ短時間で動作させることができ、これに
よりサージ電流耐量を向上させ、高い信頼性を得る。 【構成】 第1の導電型の半導体基板の両面に第2の導
電型の拡散ベース層領域を形成し、各拡散ベース層領域
内にそれぞれ第1の導電型の拡散エミッタ層領域を互い
違いに形成し、各拡散エミッタ層領域の上面に抵抗体を
形成し、両面に形成された抵抗体および拡散ベース層領
域にそれぞれ電極を接続して構成する。
(57) [Abstract] [Purpose] Regarding a surge protection element, the entire element can be operated reliably and in a short time in a stripe-shaped or comb-shaped miniaturized thyristor structure, which improves surge current withstand capability. , Get high reliability. A second conductivity type diffusion base layer regions are formed on both surfaces of a first conductivity type semiconductor substrate, and first conductivity type diffusion emitter layer regions are formed alternately in each diffusion base layer region. Then, a resistor is formed on the upper surface of each diffusion emitter layer region, and electrodes are connected to the resistor and the diffusion base layer region formed on both surfaces, respectively.

Description

【発明の詳細な説明】Detailed Description of the Invention

【0001】[0001]

【産業上の利用分野】本発明は、電話回線その他に誘導
された雷等の高圧サージから通信端末あるいは保守作業
者を保護するサージ防護素子に関する。
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a surge protection element for protecting a communication terminal or a maintenance worker from a high voltage surge such as lightning induced on a telephone line or the like.

【0002】[0002]

【従来の技術】pnpn4層構造のサイリスタを利用し
たサージ防護素子は、降伏電圧(ブレークオーバ電圧)
以上の異常電圧が印加されたときに、素子内に低インピ
ーダンス電流通路を形成して順方向阻止状態から導通状
態に変えるサイリスタ動作により、異常電圧に伴う大電
流を吸収して素子の両端電圧を一定電圧値以下にクラン
プし、電気回路系を保護する素子である。
2. Description of the Related Art A surge protection device using a pnpn four-layer thyristor has a breakdown voltage (breakover voltage).
When the above abnormal voltage is applied, a thyristor operation that forms a low impedance current path in the element to change from the forward blocking state to the conducting state is used to absorb the large current associated with the abnormal voltage and reduce the voltage across the element. It is an element that clamps below a certain voltage value to protect the electric circuit system.

【0003】なお、サージ防護素子は、正負のサージに
対して同等の防護機能を果たすために、2つ以上のサイ
リスタを同一基板内で逆並列接続した構造をもつ。たと
えば、図4の等価回路に示すように、浮遊ベース層を共
有した2つのサイリスタ51,52を逆並列接続して構
成される。
The surge protection element has a structure in which two or more thyristors are connected in anti-parallel in the same substrate in order to perform an equivalent protection function against positive and negative surges. For example, as shown in the equivalent circuit of FIG. 4, two thyristors 51 and 52 sharing a floating base layer are connected in antiparallel.

【0004】図5は、従来のサージ防護素子の構造を示
す断面図である。なお、ここでは第1の導電型をp型と
し、第2の導電型をn型とする。図において、p型の半
導体基板1の両面に、n型の拡散ベース層領域2,2′
を形成する。このn型の拡散ベース層領域2,2′内に
p型の拡散エミッタ層領域3,3′を互い違いに形成
し、さらに必要があればオーミック接合形成のために拡
散ベース層領域2,2′の拡散表面濃度より高い濃度の
n型のオーミック領域5,5′を互い違いに形成する。
また、それらの表面にシリコン酸化膜などの保護膜6,
6′を酸化法あるいは堆積法その他の手法により形成
し、n型の拡散ベース層領域2,2′、p型の拡散エミ
ッタ層領域3,3′、n型のオーミック領域5,5′の
位置に窓開けを施し、その窓全面に電極7,7′を形成
する。
FIG. 5 is a sectional view showing the structure of a conventional surge protection element. Note that here, the first conductivity type is p-type and the second conductivity type is n-type. In the figure, n-type diffusion base layer regions 2 and 2'are provided on both sides of a p-type semiconductor substrate 1.
To form. The p-type diffusion emitter layer regions 3 and 3'are alternately formed in the n-type diffusion base layer regions 2 and 2 ', and further, if necessary, for forming an ohmic junction, the diffusion base layer regions 2 and 2'. The n-type ohmic regions 5 and 5'having a concentration higher than the diffusion surface concentration are alternately formed.
Further, a protective film 6, such as a silicon oxide film, is formed on the surface of them.
6'is formed by an oxidation method, a deposition method, or another method, and positions of the n-type diffusion base layer regions 2 and 2 ', the p-type diffusion emitter layer regions 3 and 3', and the n-type ohmic regions 5 and 5 ' A window is opened in the substrate, and electrodes 7 and 7'are formed on the entire surface of the window.

【0005】すなわち、p型の拡散エミッタ層領域3,
n型の拡散ベース層領域2,p型の半導体基板1,n型
の拡散ベース層領域2′によりpnpn構造の順方向サ
イリスタ8が構成される。また、p型の拡散エミッタ層
領域3′,n型の拡散ベース層領域2′,p型の半導体
基板1,n型の拡散ベース層領域2によりpnpn構造
の逆方向サイリスタ9が構成される。
That is, the p-type diffusion emitter layer region 3,
The n-type diffusion base layer region 2, the p-type semiconductor substrate 1, and the n-type diffusion base layer region 2'constitute a forward thyristor 8 having a pnpn structure. Further, the p-type diffusion emitter layer region 3 ', the n-type diffusion base layer region 2', the p-type semiconductor substrate 1, and the n-type diffusion base layer region 2 constitute a reverse thyristor 9 having a pnpn structure.

【0006】ここで、サージ防護素子の機能について説
明する。上面の電極7に正電圧が印加されている場合に
は、n型の拡散ベース層領域2とp型の半導体基板1と
によるpn接合は逆バイアスとなり、印加電圧が接合降
伏電圧を越えるまでは電流は漏れ電流しか流れず、通常
は高インピーダンス状態にある。しかし、接合降伏電圧
を越えるサージが入ると、このpn接合の降伏によって
p型の半導体基板1に電荷が注入される。さて、順方向
サイリスタ8において、p型の半導体基板1はサイリス
タのベース層を構成するので、ここへの電荷注入により
このサイリスタがオン状態となる。すなわち、サージ電
圧の印加によってサイリスタがオン状態となり、低イン
ピーダンスとなってサージ電流を通過させる。このサー
ジによる異常電流通過後の定常状態では、ベース層を構
成するp型の半導体基板1内の電荷再結合による電荷消
滅のために、サイリスタはオン状態を維持できず、オフ
状態に自動復帰する(例えば特開平1−307264号
公報)。
Now, the function of the surge protection element will be described. When a positive voltage is applied to the electrode 7 on the upper surface, the pn junction between the n-type diffusion base layer region 2 and the p-type semiconductor substrate 1 is reversely biased, and the applied voltage exceeds the junction breakdown voltage. Only leakage current flows, and the current is usually in a high impedance state. However, when a surge exceeding the junction breakdown voltage is applied, charges are injected into the p-type semiconductor substrate 1 due to the breakdown of the pn junction. Now, in the forward thyristor 8, the p-type semiconductor substrate 1 constitutes the base layer of the thyristor, so that the charge injection into this turns the thyristor into the ON state. That is, the application of the surge voltage causes the thyristor to be in the ON state, which results in a low impedance and allows the surge current to pass therethrough. In the steady state after the passage of the abnormal current due to this surge, the thyristor cannot maintain the on state and automatically returns to the off state because of the charge disappearance due to the charge recombination in the p-type semiconductor substrate 1 forming the base layer. (For example, JP-A-1-307264).

【0007】一方、構造の対称性から下面の電極7′に
正電圧サージが印加された場合も同様に逆方向サイリス
タ9が動作する。図6は、雷サージ印加時の電圧−電流
特性を示す図である。
On the other hand, due to the symmetry of the structure, the reverse thyristor 9 also operates when a positive voltage surge is applied to the lower electrode 7 '. FIG. 6 is a diagram showing a voltage-current characteristic when a lightning surge is applied.

【0008】図において、横軸は電圧であり、縦軸は電
流である。Vb0はブレークオーバ電圧、IH は保持電
流、VT は雷サージ電流IF におけるオン電圧である。
なお、Vb0′、IH′、VT′、IF′ はそれぞれ逆方向
における値である。
In the figure, the horizontal axis represents voltage and the vertical axis represents current. V b0 is the breakover voltage, I H is the holding current, and V T is the on-voltage at the lightning surge current I F.
V b0 ′, I H ′, V T ′, and IF ′ are values in the opposite directions.

【0009】ここで、雷サージ印加時のサージ防護素子
におけるエネルギー損失Eは、
Here, the energy loss E in the surge protection element when a lightning surge is applied is

【0010】[0010]

【数1】 [Equation 1]

【0011】と表すことができる。なお、これはサージ
防護素子における発熱量Qに等しい。ところで、素子の
破壊は、素子内部における発熱温度に依存する。雷サー
ジは短時間のパルスであるために、雷サージ印加時にお
ける素子内部の発熱が瞬時であるのに対して、その熱が
外部へ伝導する熱時定数は大きい。
It can be expressed as This is equal to the heat generation amount Q of the surge protection element. By the way, the destruction of the element depends on the heat generation temperature inside the element. Since the lightning surge is a short-time pulse, the heat generation inside the element is instantaneous when the lightning surge is applied, whereas the thermal time constant for transmitting the heat to the outside is large.

【0012】図7は、雷サージ印加時の素子内部の温度
分布の時間変化を示す図である。図において、横軸は図
5に示すサージ防護素子のx軸方向の位置を示し、縦軸
は各位置における温度を示す。順方向サイリスタ8が発
熱したときに、逆方向サイリスタ9はそのヒートシンク
として機能する。しかし、素子全体が均一な温度になる
のに時間がかかるので、図7に示すように素子内部にお
ける温度勾配が大きくなる。したがって、サージ防護素
子の熱膨張差による機械的歪の発生は避けがたく、サー
ジ電流の大きさによっては素子の破壊を招くことがあっ
た。すなわち、素子の破壊はその内部における発熱温度
(ピーク温度)に依存しているが、従来構造ではそれ自
体を低減することができないためにサージ電流耐量が小
さくなっていた。
FIG. 7 is a diagram showing the time variation of the temperature distribution inside the element when a lightning surge is applied. In the figure, the horizontal axis represents the position of the surge protection element shown in FIG. 5 in the x-axis direction, and the vertical axis represents the temperature at each position. When the forward thyristor 8 generates heat, the reverse thyristor 9 functions as its heat sink. However, since it takes time for the entire element to reach a uniform temperature, the temperature gradient inside the element becomes large as shown in FIG. Therefore, the occurrence of mechanical strain due to the difference in thermal expansion of the surge protection element is unavoidable, and the element may be destroyed depending on the magnitude of the surge current. That is, the breakdown of the device depends on the heat generation temperature (peak temperature) inside the device, but the conventional structure cannot reduce the device itself, resulting in a small surge current withstand capability.

【0013】特開平5−74321号公報に記載のサー
ジ防護素子は、この問題点を解決するものである。その
断面構造の一例を図8に示す。図8において、図5のサ
ージ防護素子の各部と同一機能を有するものは同一符号
を付す。本素子は、拡散エミッタ層領域3,3′をスト
ライプ状に形成し、同一の電極7,7′に接続される順
方向サイリスタおよび逆方向サイリスタを交互に複数個
並べたことを特徴とする。微細化された順方向サイリス
タ11,12,13は、p型の拡散エミッタ層領域3,
n型の拡散ベース層領域2,p型の半導体基板1,n型
の拡散ベース層領域2′により構成される。また、微細
化された逆方向サイリスタ14,15,16は、p型の
拡散エミッタ層領域3′,n型の拡散ベース層領域
2′,p型の半導体基板1,n型の拡散ベース層領域2
により構成される。
The surge protection element described in Japanese Patent Application Laid-Open No. 5-74321 solves this problem. An example of the cross-sectional structure is shown in FIG. In FIG. 8, components having the same functions as those of the surge protection element of FIG. 5 are designated by the same reference numerals. This device is characterized in that the diffusion emitter layer regions 3 and 3'are formed in a stripe shape and a plurality of forward thyristors and reverse thyristors connected to the same electrode 7, 7'are alternately arranged. The miniaturized forward thyristors 11, 12 and 13 are the p-type diffusion emitter layer regions 3 and 3.
It is composed of an n-type diffusion base layer region 2, a p-type semiconductor substrate 1, and an n-type diffusion base layer region 2 '. Further, the miniaturized reverse direction thyristors 14, 15 and 16 include a p-type diffusion emitter layer region 3 ', an n-type diffusion base layer region 2', a p-type semiconductor substrate 1 and an n-type diffusion base layer region. Two
It is composed of

【0014】このように、微細化された順方向サイリス
タおよび逆方向サイリスタが隣接して配置された構造に
なっているので、例えば電極7に正の雷サージが印加さ
れた場合には、複数の順方向サイリスタ11,12,1
3が発熱し、発熱源が分散される。
As described above, since the miniaturized forward thyristor and reverse thyristor are arranged adjacent to each other, for example, when a positive lightning surge is applied to the electrode 7, a plurality of electrodes are provided. Forward thyristors 11, 12, 1
3 generates heat and the heat sources are dispersed.

【0015】図9は、雷サージ印加時の素子内部の温度
分布の時間変化を示す図である。図において、横軸は図
8に示すサージ防護素子のx軸方向の位置を示し、縦軸
は各位置における温度を示す。微細化された複数の順方
向サイリスタ11,12,13が分散して発熱するため
に、1つの順方向サイリスタ当たりの発熱量(ピーク温
度)は小さくなる。また、隣接する逆方向サイリスタ1
4,15,16はヒートシンクとして吸熱するが、それ
らも微細化されているために熱伝導距離が短く、素早く
素子全体の温度が均一になる。したがって、サージ印加
時に素子内部に発生する温度勾配が緩やかになり、熱膨
張差により発生する機械的歪を小さくすることができ
る。また、ピーク温度も低くなるので、サージ防護素子
の信頼性およびサージ電流耐量を向上させることができ
る。
FIG. 9 is a diagram showing the change over time in the temperature distribution inside the element when a lightning surge is applied. In the figure, the horizontal axis shows the position of the surge protection element shown in FIG. 8 in the x-axis direction, and the vertical axis shows the temperature at each position. Since the plurality of miniaturized forward thyristors 11, 12, 13 disperse and generate heat, the amount of heat generation (peak temperature) per forward thyristor becomes small. In addition, the adjacent reverse thyristor 1
The heat sinks 4, 15 and 16 absorb heat as heat sinks, but since they are also miniaturized, the heat conduction distance is short and the temperature of the entire device becomes uniform quickly. Therefore, the temperature gradient generated inside the element when a surge is applied becomes gentle, and the mechanical strain generated due to the difference in thermal expansion can be reduced. Further, since the peak temperature also becomes low, the reliability of the surge protection element and the surge current withstand capability can be improved.

【0016】[0016]

【発明が解決しようとする課題】しかし、これはサイリ
スタ(11〜16)がすべて同一特性をもった場合であ
り、実際には半導体基板1、拡散ベース層領域2,
2′、拡散エミッタ層領域3,3′の不純物濃度の不均
一性や結晶欠陥その他の原因により、すべて同一特性を
もつように製造することは困難である。一般のサイリス
タは、このような不均一性により最初のスイッチングは
ある1点の微小部分で起こり、隣接領域が順次スイッチ
ングして動作領域が拡大し、全領域がスイッチングする
動作となる。
However, this is the case where all the thyristors (11 to 16) have the same characteristics. In reality, the semiconductor substrate 1, the diffusion base layer region 2,
It is difficult to manufacture all of them to have the same characteristics due to the nonuniformity of the impurity concentration of 2'and the diffusion emitter layer regions 3 and 3 ', crystal defects, and other causes. In a general thyristor, due to such non-uniformity, the first switching occurs in one minute portion, the adjacent regions are sequentially switched, the operation region is expanded, and the entire region is switched.

【0017】図8に示すサージ防護素子においても一般
のサイリスタと同様に、雷サージ印加時には順方向サイ
リスタ11〜13あるいは逆方向サイリスタ14〜16
のうち、最初のスイッチングはある1点の微小部分であ
り、隣接領域が順次スイッチングして動作領域が広がっ
ていく。しかし、エミッタ幅Wがベース層における多数
キャリアの横方向の拡散長dに比べて長い場合は、複数
の同極性サイリスタはそれぞれ独立となるので、個別の
サイリスタを並列接続した場合と同じになる。このよう
な状況から、複数のサイリスタのうちわずか1つのサイ
リスタしか動作しないこともあり、その場合にはそのサ
イリスタに雷サージが集中して流れ、発熱が著しく大き
くなり、サージ電流耐量が低下する問題点があった。
In the surge protection element shown in FIG. 8, as in a general thyristor, the forward thyristors 11 to 13 or the reverse thyristors 14 to 16 are applied when a lightning surge is applied.
Of these, the first switching is a minute portion at a certain point, and adjacent regions are sequentially switched to expand the operation region. However, when the emitter width W is longer than the lateral diffusion length d of majority carriers in the base layer, the plurality of same-polarity thyristors are independent of each other, which is the same as when individual thyristors are connected in parallel. Under such circumstances, only one thyristor out of a plurality of thyristors may operate, and in that case, a thunder surge concentrates and flows into the thyristor, heat generation remarkably increases, and surge current resistance decreases. There was a point.

【0018】特開平6−53487号公報に記載のサー
ジ防護素子は、ストライプ状の拡散エミッタ層領域3,
3′をそれぞれ櫛形状に一体化し、同極性サイリスタの
すべてを確実に動作させるようにしたものである。すな
わち、櫛形構造によって順方向、逆方向それぞれに1つ
のサイリスタとし、一部に雷サージ電流が集中すること
を防ぐものである。しかし、1点の微小部分で起こった
最初のスイッチングからキャリアの拡散により動作領域
が広がっていく構造には変わりない。したがって、櫛形
構造によりいずれ全面がスイッチングするものの、キャ
リアの拡散による動作領域の広がりは時間がかかるの
で、全面がスイッチングするまでに時間がかかる問題点
があった。
The surge protection element described in Japanese Patent Laid-Open No. 6-53487 discloses a stripe-shaped diffusion emitter layer region 3,
3'is integrated into a comb shape so that all the same-polarity thyristors can be operated reliably. That is, the comb structure is used to form one thyristor in each of the forward direction and the reverse direction to prevent the lightning surge current from being concentrated in a part. However, the structure does not change to the structure in which the operating region expands due to carrier diffusion from the first switching that occurs in one minute portion. Therefore, although the entire surface is eventually switched by the comb structure, it takes a long time to spread the operation region due to carrier diffusion, and there is a problem that it takes time to switch the entire surface.

【0019】ところで、複数のトランジスタを並列使用
する時に、図10(1),(2) に示すようにエミッタ・接地
間に抵抗61を接続する回路構成法がある。これは、1
つのトランジスタに電流が集中したときに、その抵抗に
よる電位上昇で他のトランジスタをスイッチングさせて
均等に電流を流し、電流集中を回避する技術である。同
様に複数のサイリスタを並列使用する場合には、図11
(1),(2) に示す等価回路のように、アノードあるいはカ
ソードと接地間に抵抗62を接続することにより電流集
中を避けることができる。しかし、図5あるいは図8に
示すサイリスタは電極7,7′が全面に形成されてお
り、抵抗を外付けできる構造にはなっていなかった。
By the way, there is a circuit configuration method in which a resistor 61 is connected between the emitter and the ground as shown in FIGS. 10 (1) and 10 (2) when a plurality of transistors are used in parallel. This is 1
This is a technique for avoiding current concentration by causing current to flow evenly by switching other transistors by a potential increase due to the resistance when current concentrates on one transistor. Similarly, when using a plurality of thyristors in parallel, FIG.
As in the equivalent circuits shown in (1) and (2), current concentration can be avoided by connecting the resistor 62 between the anode or cathode and the ground. However, in the thyristor shown in FIG. 5 or FIG. 8, the electrodes 7 and 7'are formed on the entire surface, and the structure does not have an external resistor.

【0020】本発明は、ストライプ状あるいは櫛形状に
微細化したサイリスタ構造において、素子全体を確実に
かつ短時間で動作させることができ、これによりサージ
電流耐量を向上させ、高い信頼性を得ることができるサ
ージ防護素子を提供することを目的とする。
According to the present invention, in a thyristor structure miniaturized in a stripe shape or a comb shape, the entire element can be operated reliably and in a short time, thereby improving the surge current withstanding capability and obtaining high reliability. It is an object of the present invention to provide a surge protection element capable of

【0021】[0021]

【課題を解決するための手段】本発明のサージ防護素子
は、第1の導電型の半導体基板の両面に第2の導電型の
拡散ベース層領域を形成し、各拡散ベース層領域内にそ
れぞれ第1の導電型の拡散エミッタ層領域を互い違いに
形成し、各拡散エミッタ層領域の上面に抵抗体を形成
し、両面に形成された抵抗体および拡散ベース層領域に
それぞれ電極を接続して構成する。
In the surge protection element of the present invention, diffusion base layer regions of the second conductivity type are formed on both sides of a semiconductor substrate of the first conductivity type, and the diffusion base layer regions of the second conductivity type are respectively formed. The first conductivity type diffusion emitter layer regions are formed alternately, resistors are formed on the upper surface of each diffusion emitter layer region, and electrodes are connected to the resistors and diffusion base layer regions formed on both surfaces, respectively. To do.

【0022】また、拡散エミッタ層領域が、その面積A
と周辺長Lの比A/Lが小さくなる形状に拡散ベース層
領域内に形成される。また、拡散エミッタ層領域の面積
Aと周辺長Lの比A/Lが小さくなる形状とはストライ
プ状あるいは櫛形状である。
Further, the diffusion emitter layer region has an area A
And a shape in which the ratio A / L of the peripheral length L is reduced is formed in the diffusion base layer region. Further, the shape in which the ratio A / L of the area A of the diffusion emitter layer region and the peripheral length L is small is a stripe shape or a comb shape.

【0023】[0023]

【作用】サージ防護素子がストライプ状の拡散エミッタ
層領域をもっている場合には、各拡散エミッタ層領域に
対応する複数の微細化サイリスタが並列に動作しようと
する。また、サージ防護素子が櫛形状の拡散エミッタ層
領域をもっている場合には、1つのサイリスタとして動
作する。
When the surge protection element has stripe-shaped diffusion emitter layer regions, a plurality of miniaturized thyristors corresponding to the diffusion emitter layer regions try to operate in parallel. When the surge protection element has a comb-shaped diffusion emitter layer region, it operates as one thyristor.

【0024】本発明のサージ防護素子は、拡散エミッタ
層領域と電極との間に抵抗体を設ける。これにより、拡
散エミッタ層領域がストライプ状であれば、1つのサイ
リスタに電流が集中しても抵抗による電位上昇で他のサ
イリスタをスイッチングさせ、各サイリスタを確実に並
列動作させることができる。また、拡散エミッタ層領域
が櫛形状であれば、サイリスタの1点の微小部分からス
イッチングが始まっても、抵抗体の電圧効果作用によっ
て短時間に素子全体に動作領域を広げることができる。
このように、抵抗の働きにより素子全体を確実にかつ短
時間で動作させることができる。
In the surge protection element of the present invention, a resistor is provided between the diffused emitter layer region and the electrode. As a result, if the diffusion emitter layer region has a stripe shape, even if the current is concentrated in one thyristor, another thyristor can be reliably operated in parallel by switching the other thyristors by the potential increase due to the resistance. Further, if the diffused emitter layer region has a comb shape, even if switching is started from one minute portion of the thyristor, the operation region can be spread over the entire element in a short time due to the voltage effect of the resistor.
In this way, the function of the resistor allows the entire element to be operated reliably and in a short time.

【0025】[0025]

【実施例】図1は、本発明のサージ防護素子の第1実施
例の構造を示す図である。なお、(1) は上面図、(2) は
上面図におけるA−A′断面図、(3) は下面図である。
また、ここでは第1の導電型をp型とし、第2の導電型
をn型とする。
1 is a view showing the structure of a first embodiment of a surge protection element of the present invention. Note that (1) is a top view, (2) is a cross-sectional view taken along the line AA 'in the top view, and (3) is a bottom view.
Further, here, the first conductivity type is p-type and the second conductivity type is n-type.

【0026】図において、p型の半導体基板1の両面
に、n型の拡散ベース層領域2,2′を形成する。この
n型の拡散ベース層領域2内にストライプ状のp型の拡
散エミッタ層領域3を形成し、n型の拡散ベース層領域
2′内に拡散エミッタ層領域3と互い違いになるように
ストライプ状のp型の拡散エミッタ層領域3′を形成す
る。この各拡散エミッタ層領域3,3′を覆うように、
抵抗体10,10′として例えばアモルファスシリコン
を形成する。他に、タングステンやモリブデンその他の
金属を用いてもよい。
In the figure, n-type diffusion base layer regions 2 and 2'are formed on both sides of a p-type semiconductor substrate 1. Stripe-shaped p-type diffusion emitter layer regions 3 are formed in the n-type diffusion base layer regions 2 and stripe-shaped so as to alternate with the diffusion emitter layer regions 3 in the n-type diffusion base layer regions 2 '. To form a p-type diffusion emitter layer region 3 '. So as to cover these diffusion emitter layer regions 3, 3 ',
Amorphous silicon, for example, is formed as the resistors 10 and 10 '. Alternatively, tungsten, molybdenum, or another metal may be used.

【0027】また、それらの表面にシリコン酸化膜など
の保護膜6,6′を酸化法あるいは堆積法その他の手法
により形成し、n型の拡散ベース層領域2,2′、抵抗
体10,10′の位置に窓開けを施し、その窓全面に電
極7,7′を形成する。なお、上面図および下面図で
は、保護膜6,6′および電極7,7′は省略されてい
る。
Further, a protective film 6, 6 ', such as a silicon oxide film, is formed on the surface of the n-type diffusion base layer regions 2, 2', resistors 10, 10 'by an oxidation method, a deposition method or another method. A window is opened at the position of ', and electrodes 7, 7'are formed on the entire surface of the window. Note that the protective films 6, 6'and the electrodes 7, 7'are omitted in the top view and the bottom view.

【0028】このようにしてp型の拡散エミッタ層領域
3,n型の拡散ベース層領域2,p型の半導体基板1,
n型の拡散ベース層領域2′によりpnpn構造の順方
向サイリスタが構成される。また、p型の拡散エミッタ
層領域3′,n型の拡散ベース層領域2′,p型の半導
体基板1,n型の拡散ベース層領域2によりpnpn構
造の逆方向サイリスタが構成される。これらの順方向サ
イリスタおよび逆方向サイリスタが交互に配置された構
造になっているので、熱的には特開平5−74321号
公報に記載のサージ防護素子と同等の効果(図9の温度
分布)を得ることができる。
In this way, the p-type diffusion emitter layer region 3, the n-type diffusion base layer region 2, the p-type semiconductor substrate 1,
The n-type diffusion base layer region 2'constitutes a forward thyristor having a pnpn structure. Further, the p-type diffused emitter layer region 3 ', the n-type diffused base layer region 2', the p-type semiconductor substrate 1, and the n-type diffused base layer region 2 form a reverse thyristor having a pnpn structure. Since these forward thyristors and reverse thyristors are alternately arranged, they have the same thermal effect as the surge protection element described in JP-A-5-74321 (temperature distribution in FIG. 9). Can be obtained.

【0029】さらに、それぞれのサイリスタの拡散エミ
ッタ層領域3,3′が、抵抗体10,10′を介して電
極7,7′に接続された構造になっているので、回路的
には図11(2) に示す複数のサイリスタの並列運転構成
と同様になる。すなわち、抵抗体10,10′の働きに
より、一部のサイリスタに電流が集中することを避け、
素子全体を確実かつ短時間で動作させることができる。
Further, since the diffused emitter layer regions 3 and 3'of each thyristor are connected to the electrodes 7 and 7'through the resistors 10 and 10 ', the circuit is shown in FIG. It is similar to the parallel operation configuration of multiple thyristors shown in (2). That is, it is possible to prevent the electric current from concentrating on a part of the thyristors by the action of the resistors 10 and 10 '.
The entire device can be operated reliably and in a short time.

【0030】図2は、拡散エミッタ層領域3,3′の幅
(エミッタ幅)とピーク温度との関係を示す図である。
図において、横軸はエミッタ幅(μm)を示し、縦軸は
ピーク温度を示す。ここに示す例は、雷サージ波形とし
て立ち上がり時間15μ秒,立ち下がり時間 100μ秒で、
600Aを印加した場合における非定常熱解析を行った結
果である。図に示すように、エミッタ幅を 500μm以下
とすることで、ピーク温度を大幅に低減できることがわ
かる。
FIG. 2 is a diagram showing the relationship between the width (emitter width) of the diffused emitter layer regions 3 and 3'and the peak temperature.
In the figure, the horizontal axis represents the emitter width (μm) and the vertical axis represents the peak temperature. The example shown here is a lightning surge waveform with a rise time of 15 μsec and a fall time of 100 μsec.
It is the result of performing the unsteady thermal analysis when 600 A was applied. As shown in the figure, it can be seen that the peak temperature can be significantly reduced by setting the emitter width to 500 μm or less.

【0031】一方、高周波高出力トランジスタにおいて
もエミッタ形状がストライプ状あるいは櫛形状のものが
あるが、これは有効にエミッタを働かせるために、エミ
ッタ面積Aとその周辺長Lとの比A/Lを小さくしたも
のである。この場合のエミッタ幅Wは、多数キャリアの
横方向拡散距離がその目安となり、npn構造の場合の
それはLPB≒(DPBτPB)1/2であり、拡散ベース型シリ
コントランジスタのエミッタ幅はだいたい10μmとな
る。これに比べて、本発明のサージ防護素子に用いられ
るエミッタ幅は、 500μm以下であれば十分にピーク温
度の低減効果がある。
On the other hand, the high-frequency high-power transistor also has a stripe-shaped or comb-shaped emitter, which has a ratio A / L of the emitter area A to its peripheral length L in order to effectively work the emitter. It is a small one. In this case, the emitter width W is determined by the lateral diffusion distance of majority carriers, and in the case of the npn structure, L PB ≈ (D PB τ PB ) 1/2 , and the emitter width of the diffusion base type silicon transistor is It will be about 10 μm. On the other hand, if the emitter width used in the surge protection element of the present invention is 500 μm or less, the peak temperature can be sufficiently reduced.

【0032】図3は、本発明のサージ防護素子の第2実
施例の構造を示す図である。なお、(1) は上面図、(2)
は上面図におけるA−A′断面図、(3) は下面図であ
る。また、ここでは第1の導電型をp型とし、第2の導
電型をn型とする。
FIG. 3 is a diagram showing the structure of a second embodiment of the surge protection element of the present invention. In addition, (1) is a top view, (2)
Is a sectional view taken along the line AA 'in the top view, and (3) is a bottom view. Further, here, the first conductivity type is p-type and the second conductivity type is n-type.

【0033】図において、p型の半導体基板1の両面
に、n型の拡散ベース層領域2,2′を形成する。この
n型の拡散ベース層領域2内に櫛形状のp型の拡散エミ
ッタ層領域3を形成し、n型の拡散ベース層領域2′内
に拡散エミッタ層領域3と点対称になるように櫛形状の
p型の拡散エミッタ層領域3′を形成する。なお、櫛形
状の拡散エミッタ層領域3,3′は、第1実施例のスト
ライプ状の拡散エミッタ層領域3,3′と同様に、その
面積Aと周辺長Lとの比A/Lが小さくなる形状の1例
であり、この形状に限定されるものではない。
In the figure, n-type diffusion base layer regions 2 and 2'are formed on both sides of a p-type semiconductor substrate 1. A comb-shaped p-type diffusion emitter layer region 3 is formed in the n-type diffusion base layer region 2, and a comb-shaped p-type diffusion emitter layer region 3 is formed in the n-type diffusion base layer region 2 ′ so as to be point-symmetric with the diffusion emitter layer region 3. A p-type diffusion emitter layer region 3'having a shape is formed. The comb-shaped diffusion emitter layer regions 3 and 3'have a small ratio A / L between the area A and the peripheral length L, like the stripe-shaped diffusion emitter layer regions 3 and 3'of the first embodiment. However, the present invention is not limited to this shape.

【0034】さらに、n型の拡散ベース層領域2,2′
内で櫛形状の拡散エミッタ層領域3,3′を埋めるよう
に、オーミック接合形成のために拡散ベース層領域2,
2′の拡散表面濃度より高い濃度のn型のオーミック領
域5,5′を点対称に形成する。さらに、各拡散エミッ
タ層領域3,3′を覆うように第1実施例と同様の組成
の抵抗体10,10′を形成する。
Further, the n-type diffusion base layer regions 2, 2 '
In order to fill the comb-shaped diffusion emitter layer regions 3 and 3'within the diffusion base layer region 2 for ohmic contact formation.
The n-type ohmic regions 5 and 5'having a concentration higher than the diffusion surface concentration of 2'are formed point-symmetrically. Further, resistors 10 and 10 'having the same composition as in the first embodiment are formed so as to cover the diffusion emitter layer regions 3 and 3'.

【0035】また、それらの表面にシリコン酸化膜など
の保護膜6,6′を酸化法あるいは堆積法その他の手法
により形成し、抵抗体10,10′、n型のオーミック
領域5,5′の位置に窓開けを施し、その窓全面に電極
7,7′を形成する。なお、上面図および下面図では、
保護膜6,6′および電極7,7′は省略し、拡散層領
域の形状を示している。
Further, a protective film 6, 6 ', such as a silicon oxide film, is formed on their surface by an oxidation method, a deposition method, or another method to form the resistors 10, 10' and the n-type ohmic regions 5, 5 '. A window is opened at the position, and electrodes 7 and 7'are formed on the entire surface of the window. In addition, in the top view and the bottom view,
The protective films 6 and 6'and the electrodes 7 and 7'are omitted and the shape of the diffusion layer region is shown.

【0036】このように、櫛形状のp型の拡散エミッタ
層領域3,n型の拡散ベース層領域2,p型の半導体基
板1,n型の拡散ベース層領域2′によりpnpn構造
の順方向サイリスタが構成される。また、櫛形状のp型
の拡散エミッタ層領域3′,n型の拡散ベース層領域
2′,p型の半導体基板1,n型の拡散ベース層領域2
によりpnpn構造の逆方向サイリスタが構成される。
なお、n型のオーミック領域5,5′を形成することに
より、半導体部分と電極との接触電位差(ショットキー
障壁による損失)を小さくし、サージ電流耐量を向上さ
せることができる。熱的には特開平6−53487号公
報に記載のサージ防護素子と同等の効果を得ることがで
きる。
As described above, the comb-shaped p-type diffusion emitter layer region 3, the n-type diffusion base layer region 2, the p-type semiconductor substrate 1, and the n-type diffusion base layer region 2'provide a forward direction of the pnpn structure. A thyristor is constructed. Also, a comb-shaped p-type diffusion emitter layer region 3 ', an n-type diffusion base layer region 2', a p-type semiconductor substrate 1, and an n-type diffusion base layer region 2 are provided.
A reverse direction thyristor having a pnpn structure is constituted by.
By forming the n-type ohmic regions 5 and 5 ', the difference in contact potential between the semiconductor portion and the electrode (loss due to the Schottky barrier) can be reduced, and the surge current withstand capability can be improved. Thermally, it is possible to obtain the same effect as the surge protection element described in JP-A-6-53487.

【0037】本実施例では、拡散エミッタ層領域3,
3′が櫛形状になっているので、順方向、逆方向それぞ
れに1つのサイリスタとして動作する。ここで、拡散エ
ミッタ層領域3,3′と電極7,7′とを接続する抵抗
体10,10′が有効に働く。すなわち、サイリスタの
スイッチングはある1点の微小部分から始まるが、そこ
に電流集中が起こると抵抗体10,10′の電圧降下に
より不動作部のサイリスタがスイッチングする。したが
って、従来のキャリア拡散によるスイッチ領域の広がり
効果に、さらに電界のドリフトによるスイッチ領域の広
がり効果が加わり、全面がスイッチングする時間を非常
に短くすることができる。
In this embodiment, the diffused emitter layer regions 3,
Since 3'has a comb shape, it operates as one thyristor in each of the forward and reverse directions. Here, the resistors 10, 10 'connecting the diffused emitter layer regions 3, 3'to the electrodes 7, 7'function effectively. That is, switching of the thyristor starts from a minute portion at a certain point, but when current concentration occurs at that point, the thyristor in the non-operating portion switches due to the voltage drop of the resistors 10 and 10 '. Therefore, in addition to the conventional effect of spreading the switch region due to carrier diffusion, the effect of spreading the switch region due to the drift of the electric field is added, and the time for switching the entire surface can be extremely shortened.

【0038】このように、第1実施例では複数のサイリ
スタの並列運転効果により、第2実施例では1つのサイ
リスタのスイッチ領域の高速広がり効果により、素子全
体を確実にかつ短時間で動作させることができる。
As described above, in the first embodiment, the parallel operation effect of a plurality of thyristors and in the second embodiment, the high speed expansion effect of the switch region of one thyristor ensures the operation of the entire element in a short time. You can

【0039】[0039]

【発明の効果】以上説明したように本発明は、素子全体
を確実にかつ短時間で動作させることができるので、素
子内部の温度を速やかに均一にするとともに、ピーク温
度を低減することができる。したがって、時間幅の短く
かつ高電圧のパルスが印加される雷サージや静電気の防
護素子として、またスイッチングノイズその他の吸収素
子としての信頼性を高めることができる。
As described above, according to the present invention, since the entire device can be operated reliably and in a short time, the temperature inside the device can be made uniform quickly and the peak temperature can be reduced. . Therefore, reliability as a lightning surge or static electricity protection element to which a high-voltage pulse with a short time width is applied, and as a switching noise or other absorption element can be improved.

【図面の簡単な説明】[Brief description of drawings]

【図1】本発明のサージ防護素子の第1実施例の構造を
示す図。
FIG. 1 is a diagram showing a structure of a first embodiment of a surge protection element of the present invention.

【図2】エミッタ幅とピーク温度との関係を示す図。FIG. 2 is a diagram showing a relationship between an emitter width and a peak temperature.

【図3】本発明のサージ防護素子の第2実施例の構造を
示す図。
FIG. 3 is a diagram showing the structure of a second embodiment of the surge protection element of the present invention.

【図4】サージ防護素子の等価回路を示す図。FIG. 4 is a diagram showing an equivalent circuit of a surge protection element.

【図5】従来のサージ防護素子の構造を示す断面図。FIG. 5 is a sectional view showing the structure of a conventional surge protection element.

【図6】雷サージ印加時の電圧−電流特性を示す図。FIG. 6 is a diagram showing voltage-current characteristics when a lightning surge is applied.

【図7】雷サージ印加時の素子内部の温度分布の時間変
化を示す図。
FIG. 7 is a diagram showing a time change of temperature distribution inside the element when a lightning surge is applied.

【図8】従来のサージ防護素子(特開平5−74321
号)の構造を示す断面図。
FIG. 8 is a conventional surge protection element (Japanese Patent Application Laid-Open No. 5-74321).
No.) sectional view showing the structure.

【図9】雷サージ印加時の素子内部の温度分布の時間変
化を示す図。
FIG. 9 is a diagram showing a time change of temperature distribution inside the element when a lightning surge is applied.

【図10】従来の複数のトランジスタの並列使用時の回
路構成を示す図。
FIG. 10 is a diagram showing a circuit configuration when a plurality of conventional transistors are used in parallel.

【図11】従来の複数のサイリスタの並列使用時の回路
構成を示す図。
FIG. 11 is a diagram showing a circuit configuration when a plurality of conventional thyristors are used in parallel.

【符号の説明】[Explanation of symbols]

1 p型の半導体基板 2,2′ n型の拡散ベース層領域 3,3′ p型の拡散エミッタ層領域 5,5′ n型のオーミック領域 6,6′ 保護膜 7,7′ 電極 8 順方向サイリスタ 9 逆方向サイリスタ 10 抵抗体 11,12,13 順方向サイリスタ 14,15,16 逆方向サイリスタ 51,52 サイリスタ 61,62 抵抗 1 p-type semiconductor substrate 2, 2'n-type diffusion base layer region 3, 3 'p-type diffusion emitter layer region 5, 5' n-type ohmic region 6, 6 'protective film 7, 7' electrode 8 sequence Directional thyristor 9 Reverse direction thyristor 10 Resistor 11, 12, 13 Forward direction thyristor 14, 15, 16 Reverse direction thyristor 51, 52 Thyristor 61, 62 Resistance

Claims (4)

【特許請求の範囲】[Claims] 【請求項1】 第1の導電型の半導体基板の両面に第2
の導電型の拡散ベース層領域が形成され、 前記各拡散ベース層領域内にそれぞれ第1の導電型の拡
散エミッタ層領域が互い違いに形成され、 前記各拡散エミッタ層領域の上面に抵抗体が形成され、 両面に形成された前記抵抗体および前記拡散ベース層領
域にそれぞれ電極が接続された構成であることを特徴と
するサージ防護素子。
1. A second conductive film is formed on both sides of a semiconductor substrate of a first conductivity type.
Conductive type diffusion base layer regions are formed, first conductive type diffusion emitter layer regions are alternately formed in the diffusion base layer regions, and resistors are formed on the upper surfaces of the diffusion emitter layer regions. The surge protection element is characterized in that electrodes are respectively connected to the resistor and the diffusion base layer region formed on both surfaces.
【請求項2】 請求項1に記載のサージ防護素子におい
て、 拡散エミッタ層領域が、その面積Aと周辺長Lの比A/
Lが小さくなる形状に拡散ベース層領域内に形成された
ことを特徴とするサージ防護素子。
2. The surge protection device according to claim 1, wherein the diffused emitter layer region has a ratio A / A of its area A to a peripheral length L.
A surge protection element characterized in that it is formed in the diffusion base layer region in a shape such that L is small.
【請求項3】 請求項2に記載のサージ防護素子におい
て、 拡散エミッタ層領域がストライプ状に形成されたことを
特徴とするサージ防護素子。
3. The surge protective element according to claim 2, wherein the diffused emitter layer region is formed in a stripe shape.
【請求項4】 請求項2に記載のサージ防護素子におい
て、 拡散エミッタ層領域が櫛形状に形成されたことを特徴と
するサージ防護素子。
4. The surge protection element according to claim 2, wherein the diffused emitter layer region is formed in a comb shape.
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