JPH09166791A - 半導体装置とアクティブマトリクス型液晶表示装置 - Google Patents
半導体装置とアクティブマトリクス型液晶表示装置Info
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- JPH09166791A JPH09166791A JP8294546A JP29454696A JPH09166791A JP H09166791 A JPH09166791 A JP H09166791A JP 8294546 A JP8294546 A JP 8294546A JP 29454696 A JP29454696 A JP 29454696A JP H09166791 A JPH09166791 A JP H09166791A
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Landscapes
- Liquid Crystal (AREA)
- Thin Film Transistor (AREA)
Abstract
(57)【要約】
【目的】 アクティブマトリクス型電気光学装置に用い
る薄膜絶縁ゲート型電解効果トランジスタにおいて、逆
バイアス時のリ−ク電流を減少せしめた半導体装置とそ
の作製方法を提供する。 【構成】 絶縁ゲート型電解効果トランジスタにおい
て、チャネル長をゲート電極のチャネル長方向の長さよ
りも長くすることにより、チャネル領域の両側部にゲー
ト電極による電界の全くかからないあるいはゲート電極
垂直下に比較して非常に弱いオフセット領域を形成する
ことを特徴とする。
る薄膜絶縁ゲート型電解効果トランジスタにおいて、逆
バイアス時のリ−ク電流を減少せしめた半導体装置とそ
の作製方法を提供する。 【構成】 絶縁ゲート型電解効果トランジスタにおい
て、チャネル長をゲート電極のチャネル長方向の長さよ
りも長くすることにより、チャネル領域の両側部にゲー
ト電極による電界の全くかからないあるいはゲート電極
垂直下に比較して非常に弱いオフセット領域を形成する
ことを特徴とする。
Description
【0001】
【産業上の利用分野】本発明は、アクティブマトリクス
型電気光学装置、特にアクティブマトリクス型液晶電気
光学装置等に利用でき、明解なスイッチング特性を有す
る電界効果型トランジスタの構造およびその作製方法を
示すものである。
型電気光学装置、特にアクティブマトリクス型液晶電気
光学装置等に利用でき、明解なスイッチング特性を有す
る電界効果型トランジスタの構造およびその作製方法を
示すものである。
【0002】
【従来の技術】従来のアクティブマトリクス型液晶電気
光学装置に用いる薄膜絶縁ゲート型電界効果トランジス
タは、図2に示すような構造を有している。絶縁基板9
上にブロッキング層8を有し、ソース4、ドレイン5、
およびチャネル領域3を有する半導体層上にゲート絶縁
膜2とゲート電極1を有する。その上に層間絶縁膜12
およびソース電極6、ドレイン電極7を有する。
光学装置に用いる薄膜絶縁ゲート型電界効果トランジス
タは、図2に示すような構造を有している。絶縁基板9
上にブロッキング層8を有し、ソース4、ドレイン5、
およびチャネル領域3を有する半導体層上にゲート絶縁
膜2とゲート電極1を有する。その上に層間絶縁膜12
およびソース電極6、ドレイン電極7を有する。
【0003】この従来の絶縁ゲート型電界効果トランジ
スタの作製手順は、ガラス基板9上にブロッキング層を
SiO2 をターゲットとしてスパッタ法で成膜したのち
に、プラズマCVD法を用いて半導体層を作製し、それ
をパターンニングすることでソース、ドレイン、チャネ
ル領域となる半導体層を形成の後に、スパッタ法を用い
て酸化珪素からなるゲート絶縁膜2を成膜し、その後減
圧CVD法を用いてP(リン)を高濃度ドープしたゲー
ト電極用導電層を成膜の後にパターニングを施してゲー
ト電極1を作製する。その後、ゲート電極をマスクとし
た不純物イオンの注入を行い、ソース5およびドレイン
4を作製し、その後熱処理を行って活性化を行う、とい
うものであった。
スタの作製手順は、ガラス基板9上にブロッキング層を
SiO2 をターゲットとしてスパッタ法で成膜したのち
に、プラズマCVD法を用いて半導体層を作製し、それ
をパターンニングすることでソース、ドレイン、チャネ
ル領域となる半導体層を形成の後に、スパッタ法を用い
て酸化珪素からなるゲート絶縁膜2を成膜し、その後減
圧CVD法を用いてP(リン)を高濃度ドープしたゲー
ト電極用導電層を成膜の後にパターニングを施してゲー
ト電極1を作製する。その後、ゲート電極をマスクとし
た不純物イオンの注入を行い、ソース5およびドレイン
4を作製し、その後熱処理を行って活性化を行う、とい
うものであった。
【0004】この様に作製した絶縁ゲート型電界効果ト
ランジスタは、ゲート電極1のチャネル長方向の長さと
チャネル長10はほぼ等しい。
ランジスタは、ゲート電極1のチャネル長方向の長さと
チャネル長10はほぼ等しい。
【0005】
【発明が解決しようとする課題】この様な構造を有する
絶縁ゲート型電界効果トランジスタの電流電圧特性はn
チャネルの場合図3に示す様に、逆バイアス領域13に
おいて、ソースドレイン間の印加電圧が増加するにつれ
て、リーク電流が増加するという欠点を有していた。
絶縁ゲート型電界効果トランジスタの電流電圧特性はn
チャネルの場合図3に示す様に、逆バイアス領域13に
おいて、ソースドレイン間の印加電圧が増加するにつれ
て、リーク電流が増加するという欠点を有していた。
【0006】この様なリーク電流が増した場合、この素
子をアクティブマトリクス型液晶電気光学装置に用いた
時には、図5(A)に示した様に、書き込み電流30を
通じて液晶29に蓄電された電荷は、非書き込み期間中
に素子のリーク部分を通してリーク電流31が放電され
てしまい、良好なコントラストを得ることができなかっ
た。
子をアクティブマトリクス型液晶電気光学装置に用いた
時には、図5(A)に示した様に、書き込み電流30を
通じて液晶29に蓄電された電荷は、非書き込み期間中
に素子のリーク部分を通してリーク電流31が放電され
てしまい、良好なコントラストを得ることができなかっ
た。
【0007】そのために、このような場合従来例として
図5(B)に示した様に、電荷保持のためのコンデンサ
ー32を設置することが必要になっていた。しかしなが
ら、これらコンデンサーを形成するためには、金属配線
による容量用の電極を必要とするために、開口率を低下
させる要因となっていた。またこれをITOなどの透明
電極にて形成し開口率を向上させる例も報告されている
が、余分なプロセスを必要とするために、歓迎されるも
のではなかった。本発明は以上の様な問題を解決するも
のである。
図5(B)に示した様に、電荷保持のためのコンデンサ
ー32を設置することが必要になっていた。しかしなが
ら、これらコンデンサーを形成するためには、金属配線
による容量用の電極を必要とするために、開口率を低下
させる要因となっていた。またこれをITOなどの透明
電極にて形成し開口率を向上させる例も報告されている
が、余分なプロセスを必要とするために、歓迎されるも
のではなかった。本発明は以上の様な問題を解決するも
のである。
【0008】
【問題を解決するための手段】この問題の一つの解決方
法として、本発明者らは絶縁ゲート型電界効果トランジ
スタにおいて、チャネル長(ソース領域とドレイン領域
の間の距離)をゲート電極のチャネル長方向の長さより
も長くすることにより、チャネル領域のうちのソース領
域またはドレイン領域に接する部分にゲート電極による
電界のかからないまたは非常に弱いオフセット領域を形
成することで、図4に示すような電流電圧特性をとるこ
とを知見した。
法として、本発明者らは絶縁ゲート型電界効果トランジ
スタにおいて、チャネル長(ソース領域とドレイン領域
の間の距離)をゲート電極のチャネル長方向の長さより
も長くすることにより、チャネル領域のうちのソース領
域またはドレイン領域に接する部分にゲート電極による
電界のかからないまたは非常に弱いオフセット領域を形
成することで、図4に示すような電流電圧特性をとるこ
とを知見した。
【0009】本発明の基本的な構成を図1に示す。絶縁
基板25上にブロッキング層24があり、その上に半導
体層としてソース領域20、ドレイン領域21、および
チャネル領域19を設ける。チャネル領域19上にはゲ
ート絶縁膜17とその上に陽極酸化可能な材料を陽極酸
化して絶縁層である酸化物層16を形成したゲート電極
15が形成されている。ソース領域、ドレイン領域にそ
れぞれ接してソース電極22、ドレイン電極23を設け
る。
基板25上にブロッキング層24があり、その上に半導
体層としてソース領域20、ドレイン領域21、および
チャネル領域19を設ける。チャネル領域19上にはゲ
ート絶縁膜17とその上に陽極酸化可能な材料を陽極酸
化して絶縁層である酸化物層16を形成したゲート電極
15が形成されている。ソース領域、ドレイン領域にそ
れぞれ接してソース電極22、ドレイン電極23を設け
る。
【0010】図1に示す様に、ゲート電極15と酸化物
層16となるゲート電極部に陽極酸化が可能な材料を選
び、その表面部分を陽極酸化して酸化物層16を形成す
ることで、イオン打ち込みの領域であるソース領域20
とドレイン領域21の間の距離すなわちチャネル長28
は、実質的なゲート電極15のチャネル長方向の長さよ
りも酸化物層16の厚みの概略2倍程度長くなる。ゲー
ト電極部の材料としては、主としてチタン(Ti)、ア
ルミニウム(Al)、タンタル(Ta)、クロム(C
r)、シリコン(Si)単体、あるいはそれらの合金が
適している。
層16となるゲート電極部に陽極酸化が可能な材料を選
び、その表面部分を陽極酸化して酸化物層16を形成す
ることで、イオン打ち込みの領域であるソース領域20
とドレイン領域21の間の距離すなわちチャネル長28
は、実質的なゲート電極15のチャネル長方向の長さよ
りも酸化物層16の厚みの概略2倍程度長くなる。ゲー
ト電極部の材料としては、主としてチタン(Ti)、ア
ルミニウム(Al)、タンタル(Ta)、クロム(C
r)、シリコン(Si)単体、あるいはそれらの合金が
適している。
【0011】その結果、ゲート電極両側面に形成された
る酸化物層16にゲート絶縁膜17を介して向かい合う
チャネル領域19中の部分26および27には、ゲート
電極による電界が全くかからないあるいはゲート電極の
垂直下の部分と比較して非常に弱くなる。
る酸化物層16にゲート絶縁膜17を介して向かい合う
チャネル領域19中の部分26および27には、ゲート
電極による電界が全くかからないあるいはゲート電極の
垂直下の部分と比較して非常に弱くなる。
【0012】本装置の作製方法は、ソース、ドレイン、
チャネル領域となる半導体層およびゲート絶縁膜層17
を形成後に陽極酸化可能な材料によってゲート電極部を
形成した後に、前記半導体層にp型化またはn型化せし
める不純物イオンを注入してソース領域20およびドレ
イン領域21を形成し、その後ゲート電極部表面部分を
陽極酸化してゲート電極15と酸化物層16を形成し、
熱処理工程等を施す、というものである。
チャネル領域となる半導体層およびゲート絶縁膜層17
を形成後に陽極酸化可能な材料によってゲート電極部を
形成した後に、前記半導体層にp型化またはn型化せし
める不純物イオンを注入してソース領域20およびドレ
イン領域21を形成し、その後ゲート電極部表面部分を
陽極酸化してゲート電極15と酸化物層16を形成し、
熱処理工程等を施す、というものである。
【0013】または、前記半導体層およびゲート絶縁膜
層17を形成後に陽極酸化可能な材料によってゲート電
極部を形成した後に、ゲート電極部表面部分を陽極酸化
してゲート電極15と酸化物層16を形成して、その後
前記半導体層にp型化またはn型化せしめる不純物イオ
ンを注入してソース領域20およびドレイン領域21を
形成してから熱処理工程を施す工程でも良い。
層17を形成後に陽極酸化可能な材料によってゲート電
極部を形成した後に、ゲート電極部表面部分を陽極酸化
してゲート電極15と酸化物層16を形成して、その後
前記半導体層にp型化またはn型化せしめる不純物イオ
ンを注入してソース領域20およびドレイン領域21を
形成してから熱処理工程を施す工程でも良い。
【0014】以上のような工程をとることで、チャネル
長がゲート電極のチャネル長方向の長さより長い絶縁ゲ
ート型電界効果トランジスタを、マスクずれ等による性
能のばらつきなどを発生することなく容易かつ確実に作
製することが可能となる。
長がゲート電極のチャネル長方向の長さより長い絶縁ゲ
ート型電界効果トランジスタを、マスクずれ等による性
能のばらつきなどを発生することなく容易かつ確実に作
製することが可能となる。
【0015】以下に実施例を示す。
【0016】〔実施例1〕本実施例では、対角1インチ
を有する液晶電気光学装置を用いた、ビデオカメラ用ビ
ューファインダーを作製し、本発明を実施したので説明
を加える。
を有する液晶電気光学装置を用いた、ビデオカメラ用ビ
ューファインダーを作製し、本発明を実施したので説明
を加える。
【0017】本実施例では画素数が387×128の構
成にして、本発明の構成を有した低温プロセスによる高
移動度TFT(薄膜トランジスタ)を用いた素子を形成
し、ビューファインダーを構成した。本実施例で使用す
る液晶表示装置の基板上のアクティブ素子の配置の様子
を図7に示し、図6に本実施例の回路図を示す。図7の
A−A’断面およびB−B’断面を示す作製プロセスを
図8に描く。A−A’断面はNTFTを示し、B−B’
断面はPTFTを示す。
成にして、本発明の構成を有した低温プロセスによる高
移動度TFT(薄膜トランジスタ)を用いた素子を形成
し、ビューファインダーを構成した。本実施例で使用す
る液晶表示装置の基板上のアクティブ素子の配置の様子
を図7に示し、図6に本実施例の回路図を示す。図7の
A−A’断面およびB−B’断面を示す作製プロセスを
図8に描く。A−A’断面はNTFTを示し、B−B’
断面はPTFTを示す。
【0018】図8(A)において、安価な、700℃以
下、例えば約600℃の熱処理に耐え得るガラス基板5
1上にマグネトロンRF(高周波) スパッタ法を用いて
ブロッキング層52としての酸化珪素膜を1000〜3
000Åの厚さに作製する。プロセス条件は酸素100
%雰囲気、成膜温度150℃、出力400〜800W、
圧力0.5Paとした。タ−ゲットに石英または単結晶
シリコンを用いた成膜速度は30〜100Å/分であっ
た。
下、例えば約600℃の熱処理に耐え得るガラス基板5
1上にマグネトロンRF(高周波) スパッタ法を用いて
ブロッキング層52としての酸化珪素膜を1000〜3
000Åの厚さに作製する。プロセス条件は酸素100
%雰囲気、成膜温度150℃、出力400〜800W、
圧力0.5Paとした。タ−ゲットに石英または単結晶
シリコンを用いた成膜速度は30〜100Å/分であっ
た。
【0019】この上にシリコン膜をLPCVD(減圧気
相)法、スパッタ法またはプラズマCVD法により形成
した。減圧気相法で形成する場合、結晶化温度よりも1
00〜200℃低い450〜550℃、例えば530℃
でジシラン(Si2H6) またはトリシラン(Si3H8) をCVD
装置に供給して成膜した。反応炉内圧力は30〜300
Paとした。成膜速度は50〜250Å/ 分であった。
PTFTとNTFTとのスレッシュホ−ルド電圧(Vt
h)に概略同一に制御するため、ホウ素をジボランを用
いて1×1015〜1×1018cm-3の濃度として成膜中に添加
してもよい。
相)法、スパッタ法またはプラズマCVD法により形成
した。減圧気相法で形成する場合、結晶化温度よりも1
00〜200℃低い450〜550℃、例えば530℃
でジシラン(Si2H6) またはトリシラン(Si3H8) をCVD
装置に供給して成膜した。反応炉内圧力は30〜300
Paとした。成膜速度は50〜250Å/ 分であった。
PTFTとNTFTとのスレッシュホ−ルド電圧(Vt
h)に概略同一に制御するため、ホウ素をジボランを用
いて1×1015〜1×1018cm-3の濃度として成膜中に添加
してもよい。
【0020】スパッタ法で行う場合、スパッタ前の背圧
を1×10-5Pa以下とし、単結晶シリコンをタ−ゲット
として、アルゴンに水素を20〜80%混入した雰囲気
で行った。例えばアルゴン20%、水素80%とした。
成膜温度は150℃、周波数は13.56MHz、スパ
ッタ出力は400〜800W、圧力は0.5Paであっ
た。
を1×10-5Pa以下とし、単結晶シリコンをタ−ゲット
として、アルゴンに水素を20〜80%混入した雰囲気
で行った。例えばアルゴン20%、水素80%とした。
成膜温度は150℃、周波数は13.56MHz、スパ
ッタ出力は400〜800W、圧力は0.5Paであっ
た。
【0021】プラズマCVD法により珪素膜を作製する
場合、温度は例えば300℃とし、モノシラン(SiH4)ま
たはジシラン(Si2H6) を用いた。これらをPCVD装置
内に導入し、13.56MHzの高周波電力を加えて成
膜した。
場合、温度は例えば300℃とし、モノシラン(SiH4)ま
たはジシラン(Si2H6) を用いた。これらをPCVD装置
内に導入し、13.56MHzの高周波電力を加えて成
膜した。
【0022】これらの方法によって形成された被膜は、
酸素が5×1021cm-3以下であることが好ましい。この酸
素濃度が高いと、結晶化させにくく、熱アニ−ル温度を
高くまたは熱アニ−ル時間を長くしなければならない。
また少なすぎると、バックライトによりオフ状態のリ−
ク電流が増加してしまう。そのため4×1019〜4×1021
cm-3の範囲とした。水素は4×1020cm-3であり、珪素4
×1022cm-3として比較すると1原子%であった。
酸素が5×1021cm-3以下であることが好ましい。この酸
素濃度が高いと、結晶化させにくく、熱アニ−ル温度を
高くまたは熱アニ−ル時間を長くしなければならない。
また少なすぎると、バックライトによりオフ状態のリ−
ク電流が増加してしまう。そのため4×1019〜4×1021
cm-3の範囲とした。水素は4×1020cm-3であり、珪素4
×1022cm-3として比較すると1原子%であった。
【0023】上記方法によって、アモルファス状態の珪
素膜を500〜5000Å、例えば1500Åの厚さに
作製の後、450〜700℃の温度にて12〜70時間
非酸化物雰囲気にて中温の加熱処理、例えば水素雰囲気
下にて600℃の温度で保持した。珪素膜の下の基板表
面にアモルファス構造の酸化珪素膜が形成されているた
め、この熱処理で特定の核が存在せず、全体が均一に加
熱アニ−ルされる。即ち、成膜時はアモルファス構造を
有し、また水素は単に混入しているのみである。
素膜を500〜5000Å、例えば1500Åの厚さに
作製の後、450〜700℃の温度にて12〜70時間
非酸化物雰囲気にて中温の加熱処理、例えば水素雰囲気
下にて600℃の温度で保持した。珪素膜の下の基板表
面にアモルファス構造の酸化珪素膜が形成されているた
め、この熱処理で特定の核が存在せず、全体が均一に加
熱アニ−ルされる。即ち、成膜時はアモルファス構造を
有し、また水素は単に混入しているのみである。
【0024】アニ−ルにより、珪素膜はアモルファス構
造から秩序性の高い状態に移り、一部は結晶状態を呈す
る。特にシリコンの成膜後の状態で比較的秩序性の高い
領域は特に結晶化をして結晶状態となろうとする。しか
しこれらの領域間に存在する珪素により互いの結合がな
されるため、珪素同志は互いにひっぱりあう。レ−ザラ
マン分光により測定すると単結晶の珪素のピ−ク522
cm-1より低周波側にシフトしたピ−クが観察される。そ
れの見掛け上の粒径は半値巾から計算すると、50〜5
00Åとマイクロクリスタルのようになっているが、実
際はこの結晶性の高い領域は多数あってクラスタ構造を
有し、各クラスタ間は互いに珪素同志で結合(アンカリ
ング) がされたセミアモルファス構造の被膜を形成させ
ることができた。
造から秩序性の高い状態に移り、一部は結晶状態を呈す
る。特にシリコンの成膜後の状態で比較的秩序性の高い
領域は特に結晶化をして結晶状態となろうとする。しか
しこれらの領域間に存在する珪素により互いの結合がな
されるため、珪素同志は互いにひっぱりあう。レ−ザラ
マン分光により測定すると単結晶の珪素のピ−ク522
cm-1より低周波側にシフトしたピ−クが観察される。そ
れの見掛け上の粒径は半値巾から計算すると、50〜5
00Åとマイクロクリスタルのようになっているが、実
際はこの結晶性の高い領域は多数あってクラスタ構造を
有し、各クラスタ間は互いに珪素同志で結合(アンカリ
ング) がされたセミアモルファス構造の被膜を形成させ
ることができた。
【0025】結果として、被膜は実質的にグレインバウ
ンダリ(以下GBという)がないといってもよい状態を
呈する。キャリアは各クラスタ間をアンカリングされた
個所を通じ互いに容易に移動し得るため、いわゆるGBの
明確に存在する多結晶珪素よりも高いキャリア移動度と
なる。即ちホ−ル移動度(μh)=10〜200cm2/
VSec、電子移動度(μe )=15〜300cm2 /V
Secが得られる。
ンダリ(以下GBという)がないといってもよい状態を
呈する。キャリアは各クラスタ間をアンカリングされた
個所を通じ互いに容易に移動し得るため、いわゆるGBの
明確に存在する多結晶珪素よりも高いキャリア移動度と
なる。即ちホ−ル移動度(μh)=10〜200cm2/
VSec、電子移動度(μe )=15〜300cm2 /V
Secが得られる。
【0026】他方、上記の如き中温でのアニ−ルではな
く、900〜1200℃の高温アニ−ルにより被膜を多
結晶化してもよい、しかしその場合は核からの固相成長
により被膜中の不純物の偏析がおきて、GBには酸素、
炭素、窒素等の不純物が多くなり、結晶中の移動度は大
きいが、GBでのバリア(障壁)を作ってそこでのキャ
リアの移動を阻害してしまう。結果として10cm2/Vsec
以上の移動度がなかなか得られないのが実情である。そ
のために酸素、炭素、窒素等の不純物濃度をセミアモル
ファスのものよりも数分の1から数十分の1にする必要
がある。その様にした場合、50〜100cm2 /Vse
cが得られた。
く、900〜1200℃の高温アニ−ルにより被膜を多
結晶化してもよい、しかしその場合は核からの固相成長
により被膜中の不純物の偏析がおきて、GBには酸素、
炭素、窒素等の不純物が多くなり、結晶中の移動度は大
きいが、GBでのバリア(障壁)を作ってそこでのキャ
リアの移動を阻害してしまう。結果として10cm2/Vsec
以上の移動度がなかなか得られないのが実情である。そ
のために酸素、炭素、窒素等の不純物濃度をセミアモル
ファスのものよりも数分の1から数十分の1にする必要
がある。その様にした場合、50〜100cm2 /Vse
cが得られた。
【0027】このようにして形成した珪素膜にフォトエ
ッチングを施し、NTFT用の半導体層53(チャネル
巾20μm)、PTFT用の半導体層54を作製した。
ッチングを施し、NTFT用の半導体層53(チャネル
巾20μm)、PTFT用の半導体層54を作製した。
【0028】この上にゲート絶縁膜となる酸化珪素膜を
500〜2000Å例えば1000Åの厚さに形成し
た。これはブロッキング層としての酸化珪素膜の作製と
同一条件とした。これを成膜中に弗素を少量添加し、ナ
トリウムイオンの固定化をさせてもよい。
500〜2000Å例えば1000Åの厚さに形成し
た。これはブロッキング層としての酸化珪素膜の作製と
同一条件とした。これを成膜中に弗素を少量添加し、ナ
トリウムイオンの固定化をさせてもよい。
【0029】この後、この上側にアルミニウム膜を形成
した。これをフォトマスクにてパタ−ニングして図8
(B) を得た。NTFT用のゲート絶縁膜55、ゲート電
極部56を形成し、両者のチャネル長方向の長さは10
μmすなわちチャネル長を10μmとした。同様に、P
TFT用のゲート絶縁膜57、ゲート電極部58を形成
し、両者のチャネル長方向の長さは7μmすなわちチャ
ネル長を7μmとした。また双方のゲート電極部56、
58の厚さは共に0.8μmとした。図8(C)におい
て、PTFT用のソ−ス59、ドレイン60に対し、ホ
ウ素(B)を1〜5×1015cm-2のド−ズ量でイオン注
入法により添加した。次に図8(D)の如く、フォトレ
ジスト61をフォトマスクを用いて形成した。NTFT
用のソ−ス62、ドレイン63としてリン(P)を1〜
5×1015cm-2のドーズ量でイオン注入法により添加し
た。
した。これをフォトマスクにてパタ−ニングして図8
(B) を得た。NTFT用のゲート絶縁膜55、ゲート電
極部56を形成し、両者のチャネル長方向の長さは10
μmすなわちチャネル長を10μmとした。同様に、P
TFT用のゲート絶縁膜57、ゲート電極部58を形成
し、両者のチャネル長方向の長さは7μmすなわちチャ
ネル長を7μmとした。また双方のゲート電極部56、
58の厚さは共に0.8μmとした。図8(C)におい
て、PTFT用のソ−ス59、ドレイン60に対し、ホ
ウ素(B)を1〜5×1015cm-2のド−ズ量でイオン注
入法により添加した。次に図8(D)の如く、フォトレ
ジスト61をフォトマスクを用いて形成した。NTFT
用のソ−ス62、ドレイン63としてリン(P)を1〜
5×1015cm-2のドーズ量でイオン注入法により添加し
た。
【0030】その後、ゲート電極部に陽極酸化を施し
た。L−酒石酸をエチレングリコールに5%の濃度で希
釈し、アンモニアを用いてpHを7.0±0.2に調整
した。その溶液中に基板を浸し、定電流源の+側を接続
し、−側には白金の電極を接続して20mAの定電流状
態で電圧を印加し、150Vに到達するまで酸化を継続
した。さらに、150Vで定電圧状態で加え0.1mA
以下になるまで酸化を継続した。このようにして、ゲー
ト電極部56、58の表面に酸化アルミニウム層64を
形成し、NTFT用のゲート電極65、PTFT用のゲ
ート電極66を得た。酸化アルミニウム層64は0.3
μmの厚さに形成した。
た。L−酒石酸をエチレングリコールに5%の濃度で希
釈し、アンモニアを用いてpHを7.0±0.2に調整
した。その溶液中に基板を浸し、定電流源の+側を接続
し、−側には白金の電極を接続して20mAの定電流状
態で電圧を印加し、150Vに到達するまで酸化を継続
した。さらに、150Vで定電圧状態で加え0.1mA
以下になるまで酸化を継続した。このようにして、ゲー
ト電極部56、58の表面に酸化アルミニウム層64を
形成し、NTFT用のゲート電極65、PTFT用のゲ
ート電極66を得た。酸化アルミニウム層64は0.3
μmの厚さに形成した。
【0031】次に、600℃にて10〜50時間再び加
熱アニ−ルを行った。NTFTのソ−ス62、ドレイン
63、PTFTのソ−ス59、ドレイン60を不純物を
活性化してN+ 、P+ として作製した。またゲイト絶縁
膜55、57下にはチャネル形成領域67、68がセミ
アモルファス半導体として形成されている。
熱アニ−ルを行った。NTFTのソ−ス62、ドレイン
63、PTFTのソ−ス59、ドレイン60を不純物を
活性化してN+ 、P+ として作製した。またゲイト絶縁
膜55、57下にはチャネル形成領域67、68がセミ
アモルファス半導体として形成されている。
【0032】本作製方法においては、不純物のイオン注
入とゲート電極周囲の陽極酸化の順序を入れ換えても良
い。この様に、ゲート電極の周囲に酸化金属からなる絶
縁層を形成したことで、ゲート電極の実質長さは、チャ
ネル長さよりも絶縁膜の厚さの2倍分、この場合は0.
6μmだけ短くなることになり、電界のかからないオフ
セット領域を設けることで、逆バイアス時のリーク電流
を減少させることが出来た。
入とゲート電極周囲の陽極酸化の順序を入れ換えても良
い。この様に、ゲート電極の周囲に酸化金属からなる絶
縁層を形成したことで、ゲート電極の実質長さは、チャ
ネル長さよりも絶縁膜の厚さの2倍分、この場合は0.
6μmだけ短くなることになり、電界のかからないオフ
セット領域を設けることで、逆バイアス時のリーク電流
を減少させることが出来た。
【0033】本実施例では熱アニ−ルは図8(A)、
(E)で2回行った。しかし図8(A)のアニ−ルは求
める特性により省略し、双方を図8(E)のアニ−ルに
より兼ね製造時間の短縮を図ってもよい。図8(E)に
おいて、層間絶縁物69を前記したスパッタ法により酸
化珪素膜の形成として行った。この酸化珪素膜の形成は
LPCVD法、光CVD法、常圧CVD法を用いてもよ
い。層間絶縁物は0.2〜0.6μmたとえば0.3μ
mの厚さに形成し、その後、フォトマスクを用いて電極
用の窓70を形成した。さらに、図8(F)に示す如く
これら全体にアルミニウムをスパッタ法により形成し、
リード71、73、およびコンタクト72をフォトマス
クを用いて作製した後、表面を平坦化用有機樹脂74例
えば透光性ポリイミド樹脂を塗布形成し、再度の電極穴
あけをフォトマスクにて行った。
(E)で2回行った。しかし図8(A)のアニ−ルは求
める特性により省略し、双方を図8(E)のアニ−ルに
より兼ね製造時間の短縮を図ってもよい。図8(E)に
おいて、層間絶縁物69を前記したスパッタ法により酸
化珪素膜の形成として行った。この酸化珪素膜の形成は
LPCVD法、光CVD法、常圧CVD法を用いてもよ
い。層間絶縁物は0.2〜0.6μmたとえば0.3μ
mの厚さに形成し、その後、フォトマスクを用いて電極
用の窓70を形成した。さらに、図8(F)に示す如く
これら全体にアルミニウムをスパッタ法により形成し、
リード71、73、およびコンタクト72をフォトマス
クを用いて作製した後、表面を平坦化用有機樹脂74例
えば透光性ポリイミド樹脂を塗布形成し、再度の電極穴
あけをフォトマスクにて行った。
【0034】2つのTFTを相補型構成とし、かつその
出力端を液晶装置の一方の画素の電極を透明電極として
それに連結するため、スパッタ法によりITO(インジ
ュ−ムスズ酸化膜)を形成した。それをフォトマスクに
よりエッチングし、電極75を構成させた。このITO
は室温〜150℃で成膜し、200〜400℃の酸素ま
たは大気中のアニ−ルにより成就した。かくの如くにし
てNTFT76とPTFT77と透明導電膜の電極75
とを同一ガラス基板51上に作製した。得られたTFT
の電気的な特性はPTFTで移動度は20(cm2/Vs)、
Vthは−5.9(V)で、NTFTで移動度は40(cm
2/Vs)、Vthは5.0(V)であった。
出力端を液晶装置の一方の画素の電極を透明電極として
それに連結するため、スパッタ法によりITO(インジ
ュ−ムスズ酸化膜)を形成した。それをフォトマスクに
よりエッチングし、電極75を構成させた。このITO
は室温〜150℃で成膜し、200〜400℃の酸素ま
たは大気中のアニ−ルにより成就した。かくの如くにし
てNTFT76とPTFT77と透明導電膜の電極75
とを同一ガラス基板51上に作製した。得られたTFT
の電気的な特性はPTFTで移動度は20(cm2/Vs)、
Vthは−5.9(V)で、NTFTで移動度は40(cm
2/Vs)、Vthは5.0(V)であった。
【0035】上記の様な方法に従って液晶装置用の一方
の基板を作製した。この液晶表示装置の電極等の配置は
図7に示している。NTFT76およびPTFT77を
第1の信号線40と第2の信号線41との交差部に設け
た。このようなC/TFTを用いたマトリクス構成を有
せしめた。NTFT76は、ドレイン63の入力端のリ
ード71を介し第2の信号線41に連結され、ゲート5
6は多層配線形成がなされた信号線40に連結されてい
る。ソ−ス62の出力端はコンタクト72を介して画素
の電極75に連結している。
の基板を作製した。この液晶表示装置の電極等の配置は
図7に示している。NTFT76およびPTFT77を
第1の信号線40と第2の信号線41との交差部に設け
た。このようなC/TFTを用いたマトリクス構成を有
せしめた。NTFT76は、ドレイン63の入力端のリ
ード71を介し第2の信号線41に連結され、ゲート5
6は多層配線形成がなされた信号線40に連結されてい
る。ソ−ス62の出力端はコンタクト72を介して画素
の電極75に連結している。
【0036】他方、PTFT77はドレイン60の入力
端がリード73を介して第2の信号線41に連結され、
ゲート58は信号線40に、ソ−ス59の出力端はコン
タクト72を介してNTFTと同様に画素電極75に連
結している。かかる構造を左右、上下に繰り返すことに
より、本実施例は構成されている。
端がリード73を介して第2の信号線41に連結され、
ゲート58は信号線40に、ソ−ス59の出力端はコン
タクト72を介してNTFTと同様に画素電極75に連
結している。かかる構造を左右、上下に繰り返すことに
より、本実施例は構成されている。
【0037】次に第二の基板として、青板ガラス上にス
パッタ法を用いて、酸化珪素膜を2000Å積層した基
板上に、やはり スパッタ法によりITO(インジュ−
ム・スズ酸化膜)を形成した。このITOは室温〜15
0℃で成膜し、200〜400℃の酸素または大気中の
アニ−ルにより成就した。また、この基板上にカラーフ
ィルターを形成して、第二の基板とした。
パッタ法を用いて、酸化珪素膜を2000Å積層した基
板上に、やはり スパッタ法によりITO(インジュ−
ム・スズ酸化膜)を形成した。このITOは室温〜15
0℃で成膜し、200〜400℃の酸素または大気中の
アニ−ルにより成就した。また、この基板上にカラーフ
ィルターを形成して、第二の基板とした。
【0038】その後、前記第一の基板と第二の基板によ
って、紫外線硬化型アクリル樹脂とネマチック液晶組成
物の6対4の混合物を挟持し、周囲をエポキシ性接着剤
にて固定した。基板上のリードはそのピッチが46μm
と微細なため、COG法を用いて接続をおこなった。本
実施例ではICチップ上に設けた金バンプをエポキシ系
の銀パラジウム樹脂で接続し、ICチップと基板間を固
着と封止を目的としたエポキシ変成アクリル樹脂にて埋
めて固定する方法を用いた。その後、外側に偏光板を貼
り、透過型の液晶表示装置を得た。
って、紫外線硬化型アクリル樹脂とネマチック液晶組成
物の6対4の混合物を挟持し、周囲をエポキシ性接着剤
にて固定した。基板上のリードはそのピッチが46μm
と微細なため、COG法を用いて接続をおこなった。本
実施例ではICチップ上に設けた金バンプをエポキシ系
の銀パラジウム樹脂で接続し、ICチップと基板間を固
着と封止を目的としたエポキシ変成アクリル樹脂にて埋
めて固定する方法を用いた。その後、外側に偏光板を貼
り、透過型の液晶表示装置を得た。
【0039】〔実施例2〕本実施例ではオフセット領域
の幅によるセミアモルファスシリコンTFTの特性の違
いについて記述する。本実施例では、セミアモルファス
シリコンTFTはアルミニウムゲートとし、アルミニウ
ムゲートの周囲を陽極酸化法によって酸化することによ
って、オフセット領域を形成させた。以下に詳細な作製
方法を記述する。
の幅によるセミアモルファスシリコンTFTの特性の違
いについて記述する。本実施例では、セミアモルファス
シリコンTFTはアルミニウムゲートとし、アルミニウ
ムゲートの周囲を陽極酸化法によって酸化することによ
って、オフセット領域を形成させた。以下に詳細な作製
方法を記述する。
【0040】ガラス基板上に窒化珪素膜と酸化珪素膜の
多層膜を形成し、プラズマCVD法によって、アモルフ
ァス上のシリコン膜を150nm形成した。パターニン
グでは、その幅を80μmとした。したがって、このT
FTのチャネル幅は80μmである。これを窒素雰囲気
中で600℃、60時間加熱することによってセミアモ
ルファス状態のシリコンとした。
多層膜を形成し、プラズマCVD法によって、アモルフ
ァス上のシリコン膜を150nm形成した。パターニン
グでは、その幅を80μmとした。したがって、このT
FTのチャネル幅は80μmである。これを窒素雰囲気
中で600℃、60時間加熱することによってセミアモ
ルファス状態のシリコンとした。
【0041】次いで、酸素雰囲気中での酸化珪素ターゲ
ットのスパッタリングによって、ゲート酸化膜となる酸
化珪素被膜を形成した。その厚さは115nmとした。
さらに、電子ビーム蒸着によって、アルミニウム被膜を
形成し、公知のフォトリソグラフィー法によってアルミ
ニウム被膜および下地の酸化珪素被膜をエッチングし
て、ゲート電極を形成した。エチングには反応性イオン
エッチング(RIE)法を使用した。このようにして形
成したゲート電極のチャネル長は8μmとした。
ットのスパッタリングによって、ゲート酸化膜となる酸
化珪素被膜を形成した。その厚さは115nmとした。
さらに、電子ビーム蒸着によって、アルミニウム被膜を
形成し、公知のフォトリソグラフィー法によってアルミ
ニウム被膜および下地の酸化珪素被膜をエッチングし
て、ゲート電極を形成した。エチングには反応性イオン
エッチング(RIE)法を使用した。このようにして形
成したゲート電極のチャネル長は8μmとした。
【0042】そして、ゲート電極およびその配線を陽極
酸化をおこなった。陽極酸化の方法は以下のようにおこ
なった。まず、容器内に3%の酒石酸のエチレングリコ
ール溶液を入れ、これに5wt%のアンモニア水を加え
て、pHを7.0±0.2となるように調整した。そし
て、25±2℃の温度で白金電極を陰極として、ガラス
基板ごと溶液中に浸し、アルミニウム配線を直流電源の
正極に接続して、陽極酸化をおこなった。
酸化をおこなった。陽極酸化の方法は以下のようにおこ
なった。まず、容器内に3%の酒石酸のエチレングリコ
ール溶液を入れ、これに5wt%のアンモニア水を加え
て、pHを7.0±0.2となるように調整した。そし
て、25±2℃の温度で白金電極を陰極として、ガラス
基板ごと溶液中に浸し、アルミニウム配線を直流電源の
正極に接続して、陽極酸化をおこなった。
【0043】陽極酸化では、最初に0.2〜1.0mA
/cm2 の定電流を流し、100〜250Vの適当な電
圧に到達した後は、電圧を一定に保ったまま、陽極酸化
を進め、電流が0.005mA/cm2 まで減少した時
点で通電をやめて、取り出した。本発明者の実験では、
初期の定電流の値は酸化膜形成の時間にのみ影響があ
り、最終的に形成される酸化膜の厚さにはほとんど影響
しないことが明らかになった。酸化膜の厚さに大きな影
響力を持つパラメータは到達最大電圧であり、例えば、
これが100V、150V、200V、250Vである
ときの得られる酸化膜の厚さは、それぞれ70nm、1
40nm、230nm、320nmであった。また、こ
のときには酸化されるアルミニウムの厚さの1.5倍の
酸化アルミニウムが得られることが本発明者の実験から
明らかになった。さらに、得られる酸化膜の厚さは全て
の部分にわたって極めて均質であった。
/cm2 の定電流を流し、100〜250Vの適当な電
圧に到達した後は、電圧を一定に保ったまま、陽極酸化
を進め、電流が0.005mA/cm2 まで減少した時
点で通電をやめて、取り出した。本発明者の実験では、
初期の定電流の値は酸化膜形成の時間にのみ影響があ
り、最終的に形成される酸化膜の厚さにはほとんど影響
しないことが明らかになった。酸化膜の厚さに大きな影
響力を持つパラメータは到達最大電圧であり、例えば、
これが100V、150V、200V、250Vである
ときの得られる酸化膜の厚さは、それぞれ70nm、1
40nm、230nm、320nmであった。また、こ
のときには酸化されるアルミニウムの厚さの1.5倍の
酸化アルミニウムが得られることが本発明者の実験から
明らかになった。さらに、得られる酸化膜の厚さは全て
の部分にわたって極めて均質であった。
【0044】その後、レーザードーピング法によってソ
ース、ドレイン領域を形成した。レーザードーピング法
は以下の方法によっておこなった。使用したレーザー
は、エキシマーレーザーの1種であるKrFレーザー
で、その発振波長は248nmである。試料を気密性の
ある容器内に配置し、95paの減圧雰囲気とせしめ、
内部にドーピングガスとしてジボラン(B2 H6 )、あ
るいはフォスヒン(PH3)を導入して、1ショットの
エネルギーが350mJのレーザーパルスを50ショッ
ト照射した。
ース、ドレイン領域を形成した。レーザードーピング法
は以下の方法によっておこなった。使用したレーザー
は、エキシマーレーザーの1種であるKrFレーザー
で、その発振波長は248nmである。試料を気密性の
ある容器内に配置し、95paの減圧雰囲気とせしめ、
内部にドーピングガスとしてジボラン(B2 H6 )、あ
るいはフォスヒン(PH3)を導入して、1ショットの
エネルギーが350mJのレーザーパルスを50ショッ
ト照射した。
【0045】ドーピングガスには、P型チャネルを形成
する場合には水素で希釈したジボランを用い、その流量
はジボラン100sccm、水素20sccmとした。
また、N型チャネルを形成する場合にはフォスヒンを用
い、その流量は100sccmとした。
する場合には水素で希釈したジボランを用い、その流量
はジボラン100sccm、水素20sccmとした。
また、N型チャネルを形成する場合にはフォスヒンを用
い、その流量は100sccmとした。
【0046】その後、チャネル領域の活性化を促進する
目的で、水素中で250℃、30分のアニールをおこな
った。そして、公知の方法によって層間絶縁膜とソー
ス、ドレイン電極・配線を形成し、TFTを完成させ
た。
目的で、水素中で250℃、30分のアニールをおこな
った。そして、公知の方法によって層間絶縁膜とソー
ス、ドレイン電極・配線を形成し、TFTを完成させ
た。
【0047】このようにして作製したTFTの特性例を
図9および図10に示す。図9はPチャネルTFT、図
10はNチャネルTFTである。オフセットの大きさは
直接測定することは困難であるので、ゲート電極の周囲
の酸化膜の厚さ(オフセットの大きさを十分に反映する
と考えられる)によって、本発明の効果を記述する。
図9および図10に示す。図9はPチャネルTFT、図
10はNチャネルTFTである。オフセットの大きさは
直接測定することは困難であるので、ゲート電極の周囲
の酸化膜の厚さ(オフセットの大きさを十分に反映する
と考えられる)によって、本発明の効果を記述する。
【0048】図9、図10から明らかなように、酸化膜
の厚さが大きいほど、すなわちオフセット領域の幅が大
きいほど、逆方向リーク電流やオフ電流が減少すること
がわかった。特にその効果はNチャネルTFTで著しい
ことがあきらかになった。すなわち、図から分かるよう
に、NチャネルTFTでは、ゲイト電圧が0のときの電
流(オフ電流)が、オフセット領域の形成とともに減少
して、実用的なレベルにまで低下した。PチャネルTF
Tでは、オフ電流が低下するということはなかったが、
逆方向リーク電流は著しく減少した。このようにオフセ
ット領域を設けることによるオフ電流の減少は、図11
に示される。図中でIOFF はオフ電流、Ionはオン電流
である。
の厚さが大きいほど、すなわちオフセット領域の幅が大
きいほど、逆方向リーク電流やオフ電流が減少すること
がわかった。特にその効果はNチャネルTFTで著しい
ことがあきらかになった。すなわち、図から分かるよう
に、NチャネルTFTでは、ゲイト電圧が0のときの電
流(オフ電流)が、オフセット領域の形成とともに減少
して、実用的なレベルにまで低下した。PチャネルTF
Tでは、オフ電流が低下するということはなかったが、
逆方向リーク電流は著しく減少した。このようにオフセ
ット領域を設けることによるオフ電流の減少は、図11
に示される。図中でIOFF はオフ電流、Ionはオン電流
である。
【0049】また、オフセット領域を設けることによる
TFTのしきい値電圧(Vth)の変化は見られなかっ
た。この様子を図12に示す。しかしながら、別の実験
によると、オフセット領域が異常に大きい場合にはチャ
ネルの形成が不連続的であるので、特性の悪化が観測さ
れた。例えば、図13に示すようにオフセット領域の幅
が300nmを越えると、NチャネルでもPチャネルで
も急速に電界移動度が減少した。これらの結果を考慮す
ると、オフセット領域の幅としては、200〜400n
mが適していることが明らかになった。
TFTのしきい値電圧(Vth)の変化は見られなかっ
た。この様子を図12に示す。しかしながら、別の実験
によると、オフセット領域が異常に大きい場合にはチャ
ネルの形成が不連続的であるので、特性の悪化が観測さ
れた。例えば、図13に示すようにオフセット領域の幅
が300nmを越えると、NチャネルでもPチャネルで
も急速に電界移動度が減少した。これらの結果を考慮す
ると、オフセット領域の幅としては、200〜400n
mが適していることが明らかになった。
【0050】〔実施例3〕本発明によって得られるTF
Tにおいては、オフセット領域の幅によって、オフ電流
だけでなく、ソース/ドレイン間の耐圧や動作速度が変
化する。したがって、例えば、陽極酸化膜の厚さ等のパ
ラメータを最適化することによって、目的に応じたTF
Tを作製することが出来る。しかしながら、このような
パラメータは一般に1枚の基板上に形成された個々のT
FTに対して調節できるものではない。例えば、実際の
回路においては、1枚の基板上に、低速動作でもよい
が、高耐圧のTFTと低耐圧でもよいが、高速動作の要
求されるTFTを同時に形成することが望まれる場合が
ある。一般に、本発明においては、オフセット領域の幅
が大きいほど、オフ電流が小さく、耐圧性も向上する
が、動作速度が低下するという欠点もあった。
Tにおいては、オフセット領域の幅によって、オフ電流
だけでなく、ソース/ドレイン間の耐圧や動作速度が変
化する。したがって、例えば、陽極酸化膜の厚さ等のパ
ラメータを最適化することによって、目的に応じたTF
Tを作製することが出来る。しかしながら、このような
パラメータは一般に1枚の基板上に形成された個々のT
FTに対して調節できるものではない。例えば、実際の
回路においては、1枚の基板上に、低速動作でもよい
が、高耐圧のTFTと低耐圧でもよいが、高速動作の要
求されるTFTを同時に形成することが望まれる場合が
ある。一般に、本発明においては、オフセット領域の幅
が大きいほど、オフ電流が小さく、耐圧性も向上する
が、動作速度が低下するという欠点もあった。
【0051】本実施例はこのような問題を解決する1例
を示す。図14(断面図)および図15(上面図)には
本実施例を示す。本実施例では、特願平3−29633
1に記述されるような、PチャネルTFTとNチャネル
TFTを1つの画素(液晶画素等『を駆動するために使
用する画像表示方法において使用される回路の作製に関
するものである。ここで、NチャネルTFTは高速性が
要求され、耐圧はさほど問題とされない。一方、Pチャ
ネルTFTは、動作速度はさほど問題とされないが、オ
フ電流が低いことが必要とされ、場合によっては耐圧性
がよいことも必要とされる。したがって、NチャネルT
FTは陽極酸化膜が薄く(20〜100nm)、Pチャ
ネルTFTは陽極酸化膜が厚い(250〜400nm)
ことが望まれる。以下にその作製工程について説明す
る。
を示す。図14(断面図)および図15(上面図)には
本実施例を示す。本実施例では、特願平3−29633
1に記述されるような、PチャネルTFTとNチャネル
TFTを1つの画素(液晶画素等『を駆動するために使
用する画像表示方法において使用される回路の作製に関
するものである。ここで、NチャネルTFTは高速性が
要求され、耐圧はさほど問題とされない。一方、Pチャ
ネルTFTは、動作速度はさほど問題とされないが、オ
フ電流が低いことが必要とされ、場合によっては耐圧性
がよいことも必要とされる。したがって、NチャネルT
FTは陽極酸化膜が薄く(20〜100nm)、Pチャ
ネルTFTは陽極酸化膜が厚い(250〜400nm)
ことが望まれる。以下にその作製工程について説明す
る。
【0052】図14(A)および図15(A)に示すよ
うにコーニング7059を基板101として、実質真性
のアモルファスあるいは多結晶半導体、例えばアモルフ
ァスシリコン膜を厚さ50nmだけ形成し、これを島状
にパターニングして、NチャネルTFT領域102とP
チャネルTFT領域103を形成する。これを窒素雰囲
気中600℃で60時間アニールし、再結晶化させた。
うにコーニング7059を基板101として、実質真性
のアモルファスあるいは多結晶半導体、例えばアモルフ
ァスシリコン膜を厚さ50nmだけ形成し、これを島状
にパターニングして、NチャネルTFT領域102とP
チャネルTFT領域103を形成する。これを窒素雰囲
気中600℃で60時間アニールし、再結晶化させた。
【0053】さらに、ECRプラズマCVD法によって
ゲイト酸化膜104として、酸化珪素被膜を厚さ115
nmだけ堆積し、スパッタリング法によって耐熱金属で
あるタンタルの被膜を厚さ500nmだけ形成し、これ
をパターニングして、NチャネルTFTのゲイト電極部
105およびPチャネルTFTのゲイト電極部106を
形成した。タンタルのかわりに抵抗の小さな(不純物が
十分にドープされた)多結晶シリコンでもよい。このと
きのチャネルの大きさは長さを8μm、幅を8μmとし
た。また、全てのゲイト電極・配線は図15(A)に示
されているように共通の配線150に電気的に接続され
ている。
ゲイト酸化膜104として、酸化珪素被膜を厚さ115
nmだけ堆積し、スパッタリング法によって耐熱金属で
あるタンタルの被膜を厚さ500nmだけ形成し、これ
をパターニングして、NチャネルTFTのゲイト電極部
105およびPチャネルTFTのゲイト電極部106を
形成した。タンタルのかわりに抵抗の小さな(不純物が
十分にドープされた)多結晶シリコンでもよい。このと
きのチャネルの大きさは長さを8μm、幅を8μmとし
た。また、全てのゲイト電極・配線は図15(A)に示
されているように共通の配線150に電気的に接続され
ている。
【0054】さらに、ゲイト電極・配線150に電気を
通じ、陽極酸化法によって、ゲイト電極・配線105、
106の周囲(上面および側面)に酸化タンタルの被膜
107、108を形成した。陽極酸化は実施例2と同じ
条件でおこなった。ただし、最大電圧は50Vととし
た。したがって、この工程で作製された陽極酸化膜の厚
さは約60nmである。(図14(B))
通じ、陽極酸化法によって、ゲイト電極・配線105、
106の周囲(上面および側面)に酸化タンタルの被膜
107、108を形成した。陽極酸化は実施例2と同じ
条件でおこなった。ただし、最大電圧は50Vととし
た。したがって、この工程で作製された陽極酸化膜の厚
さは約60nmである。(図14(B))
【0055】次に図15(B)において、151で示さ
れるように、ゲイト電極・配線105をレーザーエッチ
ングによって配線150から切り離した。そして、この
状態で再び、陽極酸化を始めた。条件は先と同じである
が、このときには最大電圧は250Vまで上げた。その
結果、配線105には電流が流れないので、何の変化も
生じなかったが、配線106には電流が流れるため、ゲ
イト配線106の周囲に厚さ約300nmの酸化タンタ
ル皮膜109が形成された。(図14(C))
れるように、ゲイト電極・配線105をレーザーエッチ
ングによって配線150から切り離した。そして、この
状態で再び、陽極酸化を始めた。条件は先と同じである
が、このときには最大電圧は250Vまで上げた。その
結果、配線105には電流が流れないので、何の変化も
生じなかったが、配線106には電流が流れるため、ゲ
イト配線106の周囲に厚さ約300nmの酸化タンタ
ル皮膜109が形成された。(図14(C))
【0056】その後、イオンドーピング法によって、不
純物を島状半導体102および103に導入した。公知
のCMOS技術を採用することにより、半導体領域10
2にはリン(P)を、半導体領域103には硼素(B)
を導入した。イオンドーピングのエネルギーは5keV
ととした。本発明人らの知るところでは、このエネルギ
ーが10keVを越えると、不純物拡散領域の活性化を
おこなうためには、600℃以上の高温が必要とされた
が、そのようなプロセスでは製品の歩留りを高くするこ
とが非常に難しかった。しかしながら、イオンドーピン
グのエネルギーが10keV以下であれば、600℃以
下、例えば450〜500℃で十分に抵抗の低い状態と
することが出来た。
純物を島状半導体102および103に導入した。公知
のCMOS技術を採用することにより、半導体領域10
2にはリン(P)を、半導体領域103には硼素(B)
を導入した。イオンドーピングのエネルギーは5keV
ととした。本発明人らの知るところでは、このエネルギ
ーが10keVを越えると、不純物拡散領域の活性化を
おこなうためには、600℃以上の高温が必要とされた
が、そのようなプロセスでは製品の歩留りを高くするこ
とが非常に難しかった。しかしながら、イオンドーピン
グのエネルギーが10keV以下であれば、600℃以
下、例えば450〜500℃で十分に抵抗の低い状態と
することが出来た。
【0057】イオンドーピングの後、窒素雰囲気中で、
500℃のアニールを30時間おこなうことによって、
ソース/ドレイン領域のシート抵抗を十分低くすること
が出来た。ここまでの状態を図14(D)に示す。図か
ら明らかなように、左側のTFTのオフセットの幅は小
さく、また、右側のTFTのオフセットの幅は大きい。
その後、公知の技術によって、金属配線106や150
の必要な箇所(例えば152や153)を切断し、さら
に、層間絶縁膜を形成し、コンタクトホールを形成し、
各電極に配線(例えば112や113)を形成し、図1
5(C)に示すように回路を完成させた。
500℃のアニールを30時間おこなうことによって、
ソース/ドレイン領域のシート抵抗を十分低くすること
が出来た。ここまでの状態を図14(D)に示す。図か
ら明らかなように、左側のTFTのオフセットの幅は小
さく、また、右側のTFTのオフセットの幅は大きい。
その後、公知の技術によって、金属配線106や150
の必要な箇所(例えば152や153)を切断し、さら
に、層間絶縁膜を形成し、コンタクトホールを形成し、
各電極に配線(例えば112や113)を形成し、図1
5(C)に示すように回路を完成させた。
【0058】このようにして作製された回路において
は、NチャネルTFTは、オフセット領域の幅が小さ
く、オフ電流は若干多いが、高速性に優れていた。一
方、PチャネルTFTは、高速動作は困難であったが、
オフ電流が少なく、画素キャパシターに蓄積された電荷
を保持する能力に優れていた。
は、NチャネルTFTは、オフセット領域の幅が小さ
く、オフ電流は若干多いが、高速性に優れていた。一
方、PチャネルTFTは、高速動作は困難であったが、
オフ電流が少なく、画素キャパシターに蓄積された電荷
を保持する能力に優れていた。
【0059】このように1枚の基板上に機能が異なるT
FTを集積しなければならない場合は他にもある。例え
ば、液晶表示ドライバーにおいては、シフトレジスター
等の論理回路には高速TFTが、出力回路には高耐圧T
FTが要求される。このような相反する目的に応じたT
FTを作製する場合には本実施例で示した方法は有効で
ある。
FTを集積しなければならない場合は他にもある。例え
ば、液晶表示ドライバーにおいては、シフトレジスター
等の論理回路には高速TFTが、出力回路には高耐圧T
FTが要求される。このような相反する目的に応じたT
FTを作製する場合には本実施例で示した方法は有効で
ある。
【0060】
【発明の効果】このようにして、本発明ではゲート電極
の表面に陽極酸化からなる絶縁膜層を設けることで、チ
ャネル長をゲート電極のチャネル長方向の長さよりも長
くなり、チャネル領域の両側部にゲート電極による電界
のかからないあるいは非常に弱い電界のかかるオフセッ
ト領域を設けることができ、逆バイアス時のリーク電流
を削減することが出来た。その結果、従来不可欠であっ
た電荷保持容量が不要となって、従来20%程度であっ
た開口率を35%以上にすることができ、より良好な表
示品質を得ることができた。
の表面に陽極酸化からなる絶縁膜層を設けることで、チ
ャネル長をゲート電極のチャネル長方向の長さよりも長
くなり、チャネル領域の両側部にゲート電極による電界
のかからないあるいは非常に弱い電界のかかるオフセッ
ト領域を設けることができ、逆バイアス時のリーク電流
を削減することが出来た。その結果、従来不可欠であっ
た電荷保持容量が不要となって、従来20%程度であっ
た開口率を35%以上にすることができ、より良好な表
示品質を得ることができた。
【図1】本発明による半導体装置の構造を示す。
【図2】従来例による半導体装置の構造を示す。
【図3】従来例による半導体装置の電流電圧特性を示
す。
す。
【図4】本発明による半導体装置の電流電圧特性を示
す。
す。
【図5】従来例によるアクティブマトリクス型液晶電気
光学装置の回路構成を示す。
光学装置の回路構成を示す。
【図6】実施例1におけるアクティブマトリクス型液晶
電気光学装置の回路図を示す。
電気光学装置の回路図を示す。
【図7】実施例1におけるアクティブマトリクス型液晶
電気光学装置の構造を示す。
電気光学装置の構造を示す。
【図8】実施例1におけるアクティブマトリクス型液晶
電気光学装置の作製工程を示す。
電気光学装置の作製工程を示す。
【図9】実施例2におけるPチャネルTFTの電流電圧
特性を示す。
特性を示す。
【図10】実施例2におけるNチャネルTFTの電流電
圧特性を示す。
圧特性を示す。
【図11】実施例2におけるドレイン電流の陽極酸化膜
厚依存性を示す。
厚依存性を示す。
【図12】実施例2におけるしきい値電圧の陽極酸化膜
厚依存性を示す。
厚依存性を示す。
【図13】実施例2における電界移動度の陽極酸化膜厚
依存性を示す。
依存性を示す。
【図14】実施例2におけるTFT作製工程の断面図を
示す。
示す。
【図15】実施例2におけるTFT作製工程の上面図を
示す。
示す。
9、25 絶縁基板 8、24、52 ブロッキング層 3、19、67、68 チャネル領域 10、28 チャネル長 4,20、59、62 ソース領域 5、21、60、63 ドレイン領域 2、17、55、57 ゲート絶縁膜 1、15、65、66 ゲート電極 16、64 酸化物層 6、22 ソース電極 7、23 ドレイン電極 12、69 層間絶縁膜 51 ガラス基板 72 コンタクト 75 画素電極 32 電荷保持用コンデンサー 53 NTFT用半導体層 54 PTFT用半導体層 76 NTFT 77 PTFT
───────────────────────────────────────────────────── フロントページの続き (72)発明者 竹村 保彦 神奈川県厚木市長谷398番地 株式会社半 導体エネルギー研究所内 (72)発明者 張 宏勇 神奈川県厚木市長谷398番地 株式会社半 導体エネルギー研究所内 (72)発明者 魚地 秀貴 神奈川県厚木市長谷398番地 株式会社半 導体エネルギー研究所内 (72)発明者 根本 英樹 神奈川県厚木市長谷398番地 株式会社半 導体エネルギー研究所内
Claims (12)
- 【請求項1】 絶縁表面を有する基板上に、 ソース領域と、ドレイン領域と、前記ソース領域と前記
ドレイン領域の間に設けられたチャネル領域と、 前記チャネル領域に隣接してゲイト絶縁膜を介して設け
られたゲイト電極と、 前記ゲイト電極に隣接して設けられた酸化絶縁膜とを有
する薄膜トランジスタが設けられ、 前記薄膜トランジスタの上に設けられた層間絶縁膜と、 前記薄膜トランジスタと前記層間絶縁膜と前記信号線
の、上方に設けられた平坦化用有機樹脂膜と、 を有することを特徴とする半導体装置。 - 【請求項2】 請求項1において、前記ゲイト電極は前
記チャネル領域の上方に設けられたことを特徴とする半
導体装置。 - 【請求項3】 請求項1において、前記酸化絶縁膜は、
前記ゲイト電極を構成する金属の陽極酸化物であること
を特徴とする半導体装置。 - 【請求項4】 請求項1において、前記平坦化用有機樹
脂膜はポリイミド樹脂でなることを特徴とする半導体装
置。 - 【請求項5】 絶縁表面を有する基板上に、 ソース領域と、ドレイン領域と、前記ソース領域と前記
ドレイン領域の間に設けられたチャネル領域と、 前記チャネル領域に隣接してゲイト絶縁膜を介して設け
られたゲイト電極と、 前記ゲイト電極に隣接して設けられた酸化絶縁膜とを有
する複数の薄膜トランジスタが設けられ、 前記複数の薄膜トランジスタの上に設けられた層間絶縁
膜と、 前記層間絶縁膜中に設けられたコンタクトホールを通し
て前記複数の薄膜トランジスタのソース領域またはドレ
イン領域に接続された複数の信号線と、 前記複数の薄膜トランジスタと前記層間絶縁膜と前記複
数の信号線の、上方に設けられた平坦化用有機樹脂膜
と、 前記平坦化用有機樹脂膜中に設けられたコンタクトホー
ルを通して前記複数の薄膜トランジスタのドレイン領域
またはソース領域に電気的に接続された複数の透明電極
とを有するアクティブマトリクス型液晶表示装置におい
て、 前記ゲイト電極の表面を酸化することにより酸化絶縁膜
が前記ゲイト電極に設けられ、 前記層間絶縁膜は前記平坦化用有機樹脂膜と前記薄膜ト
ランジスタとが直接接することを防ぐことを特徴とする
アクティブマトリクス型液晶表示装置。 - 【請求項6】 請求項5において、前記ゲイト電極は前
記チャネル領域の上方に設けられたことを特徴とするア
クティブマトリクス型液晶表示装置。 - 【請求項7】 請求項5において、前記酸化絶縁膜は、
前記ゲイト電極を構成する金属の陽極酸化物であること
を特徴とするアクティブマトリクス型液晶表示装置。 - 【請求項8】 請求項5において、前記平坦化用有機樹
脂膜はポリイミド樹脂でなることを特徴とするアクティ
ブマトリクス型液晶表示装置。 - 【請求項9】 絶縁表面を有する基板上に、 ソース領域と、ドレイン領域と、前記ソース領域と前記
ドレイン領域の間に設けられたチャネル領域と、 前記チャネル領域に隣接してゲイト絶縁膜を介して設け
られたゲイト電極と、 前記ゲイト電極に隣接して設けられた酸化絶縁膜と を
有する複数の薄膜トランジスタが設けられ、 前記基板上に設けられ、前記複数の薄膜トランジスタの
ゲイト電極に接続された複数の第1の信号線と、 前記複数の薄膜トランジスタと前記複数の第1の信号線
とを覆う層間絶縁膜と、 前記層間絶縁膜中に設けられ
たコンタクトホールを通して前記複数の薄膜トランジス
タのソース領域またはドレイン領域に接続された複数の
第2の信号線と、 前記複数の薄膜トランジスタと前記層間絶縁膜と前記複
数のゲイト線と前記複数の信号線の、上方に設けられた
平坦化用有機樹脂膜と、 前記平坦化用有機樹脂膜中に設けられたコンタクトホー
ルと通して前記複数の薄膜トランジスタのドレイン領域
またはソース領域に電気的に接続された複数の透明電極
とを有するアクティブマトリクス型液晶表示装置におい
て、 前記ゲイト電極および前記第1の信号線の表面を酸化す
ることにより酸化絶縁膜が前記ゲイト電極および前記第
1の信号線に設けられたことを特徴とするアクティブマ
トリクス型液晶表示装置。 - 【請求項10】 請求項9において、前記ゲイト電極は
前記チャネル領域の上方に設けられたことを特徴とする
アクティブマトリクス型液晶表示装置。 - 【請求項11】 請求項9において、前記酸化絶縁膜
は、前記ゲイト電極を構成する金属の陽極酸化物である
ことを特徴とするアクティブマトリクス型液晶表示装
置。 - 【請求項12】 請求項9において、前記平坦化用有機
樹脂膜はポリイミド樹脂でなることを特徴とするアクテ
ィブマトリクス型液晶表示装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8294546A JPH09166791A (ja) | 1996-10-16 | 1996-10-16 | 半導体装置とアクティブマトリクス型液晶表示装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8294546A JPH09166791A (ja) | 1996-10-16 | 1996-10-16 | 半導体装置とアクティブマトリクス型液晶表示装置 |
Related Parent Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3419492A Division JP2845303B2 (ja) | 1991-08-23 | 1992-01-24 | 半導体装置とその作製方法 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH09166791A true JPH09166791A (ja) | 1997-06-24 |
Family
ID=17809194
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8294546A Pending JPH09166791A (ja) | 1996-10-16 | 1996-10-16 | 半導体装置とアクティブマトリクス型液晶表示装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH09166791A (ja) |
-
1996
- 1996-10-16 JP JP8294546A patent/JPH09166791A/ja active Pending
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