JPH09283696A - 半導体混載実装方法 - Google Patents

半導体混載実装方法

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JPH09283696A
JPH09283696A JP8092357A JP9235796A JPH09283696A JP H09283696 A JPH09283696 A JP H09283696A JP 8092357 A JP8092357 A JP 8092357A JP 9235796 A JP9235796 A JP 9235796A JP H09283696 A JPH09283696 A JP H09283696A
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JP
Japan
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bare
substrate
tab
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module substrate
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JP8092357A
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Tadahito Kawabata
理仁 川端
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Panasonic Holdings Corp
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Matsushita Electric Industrial Co Ltd
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Publication date
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Abstract

(57)【要約】 【課題】 安価な基板を用いても接合不良を起こすこと
なく、モジュール化したいICのKGDが揃わない場合
にもMCM化することのできる半導体混載実装方法を提
供する。 【解決手段】 ベアIC1とTAB2とを絶縁性接着剤
3を介して接着し、上記ベアIC1をフェースダウンで
封止樹脂7を介してモジュール基板6にフリップチップ
実装し、上記TAB2のアウタリード8を上記モジュー
ル基板6に実装する。

Description

【発明の詳細な説明】
【0001】
【発明の属する技術分野】本発明は、半導体ICの実装
に関し、特に複数のICをモジュール化して実装するマ
ルチチップモジュール(以下、MCMという)に使用す
る半導体混載実装方法に関するものである。
【0002】
【従来の技術】図3は、従来の半導体混載実装方法によ
り実装されたMCMの上面図を示しており、図4は、従
来の半導体混載実装方法により実装されたMCMの樹脂
封止後の側面図である。
【0003】図3及び図4において、複数のIC31は
モジュール基板32にそれぞれ実装され、金(Au)線
等のワイヤー33によりワイヤーボンディングした後
に、封止樹脂34により封止されMCMとして完成す
る。その後に、他の部品とともにMCMは、ハンダ35
等によりマザー基板36に接合される。
【0004】
【発明が解決しようとする課題】しかしながら、上記従
来の半導体混載実装方法では、ICの数が増加した場
合、モジュール基板の面積が大きくなるにしたがい、モ
ジュール基板の反りが大きくなり、モジュール基板とマ
ザー基板との接合部に短絡あるいは未接合などの接合不
良が発生するという問題があった。
【0005】また、ICにワイヤーボンディング法を用
いた場合には樹脂封止を行うため、モジュール基板の面
積が大きくなって封止する樹脂量が増加すると、封止樹
脂とモジュール基板との熱膨脹係数の違いからモジュー
ル基板の反りがさらに大きくなり接合不良の原因となる
ものであった。
【0006】さらに、品質保証されたベアIC(以下、
KGD(Known Good Die)という)が入手困難な場合
に、モジュール化したい全てのICがKGDで存在しな
いために、MCM化できない場合が多く発生していた。
【0007】本発明は、上記従来の問題点を解決するも
のであり、安価な基板を用いても接合不良を起こすこと
なく、モジュール化したいICのKGDが揃わない場合
にもMCM化することのできる半導体混載実装方法を提
供することを目的とするものである。
【0008】
【課題を解決するための手段】本発明は、上記目的を達
成するために、ベアICとTABとを絶縁性接着剤を介
して接着し、上記ベアICをフェースダウンで封止樹脂
を介して基板にフリップチップ実装し、上記TABのア
ウタリードを上記基板に実装するようにしたものであ
る。
【0009】以上により、安価な基板を用いても接合不
良を起こすことなく、モジュール化したいICのKGD
が揃わない場合にも、MCM化することのできるもので
ある。
【0010】
【発明の実施の形態】本発明の請求項1に記載の発明
は、ベアICとTABとを絶縁性接着剤を介して接着
し、上記ベアICをフェースダウンで封止樹脂を介して
基板にフリップチップ実装し、上記TABのアウタリー
ドを上記基板に実装するものであり、基板の大きさを小
型化することができ、安価な基板を用いても接合不良を
起こすことなく、モジュール化したいICのKGDが揃
わない場合にも、MCM化することのできる作用を有す
る。
【0011】また、請求項2に記載の発明は、請求項1
に記載の発明で、ベアICとTABをコンパクトパッケ
ージ化したものであり、モジュール基板の面積を小さく
でき、基板の反りを少なくし接合不良を防止できる。
【0012】また、請求項3に記載の発明は、ベアIC
とTABとを放熱性の高い干渉材を介して積層し、上記
ベアICをフェースダウンで封止樹脂を介して基板にフ
リップチップ実装し、上記TABのアウタリードを上記
基板に実装するものであり、モジュール基板の面積を小
さくでき、基板の反りを少なくし接合不良を防止でき
る。
【0013】また、請求項4に記載の発明は、請求項3
に記載の発明で、ベアICとTABをコンパクトパッケ
ージ化したものであり、モジュール基板の面積を小さく
でき、基板の反りを少なくし接合不良を防止できる。
【0014】以下、本発明の実施の形態について、図1
〜図2とともに説明する。 (実施の形態1)図1および図2は、本発明の実施の形
態におけるベアICとTABとによる半導体混載実装方
法を示す側断面図および上面図である。図1および図2
において、1はベアIC、2はTABであり、それぞれ
絶縁性接着剤3を介して接合されている。4はバンプで
あり、このバンプ4により導電性接着剤5を介してベア
IC1およびモジュール基板6が接続される。7はベア
IC1をモジュール基板6上に封止する封止樹脂であ
る。8はアウタリードであり、このアウタリード8はT
AB2とモジュール基板6とを接続するものである。
【0015】次に、上記実施の形態における実装方法に
ついて説明する。まず、ベアIC1とTAB2とを絶縁
性接着剤3を介して接着固定する。次に、一体化したベ
アIC1をフェースダウンでバンプ4を形成し、導電性
接着剤5で仮接合した後、ベアIC1とモジュール基板
6との間を封止樹脂7にて封止する(これをFC実装と
いう)。その後、TAB2とモジュール基板6とをアウ
タリード8にて接合する。
【0016】上記実施の形態によれば、以下に示すよう
な利点を有するものである。 (1)ベアIC1とTAB2とを積層した構成であるた
めに、実装面積が半減し、モジュール基板6を小さくす
ることができ、モジュール基板6全体の反りが小さくな
り、マザー基板への接合部での短絡や接合不良等を回避
することができる。
【0017】(2)ベアICをフェースダウンしてバン
プを形成し、ベアIC1とモジュール基板との間を封止
樹脂にて封止(FC実装)しているため、ベアICをワ
イヤーボンディングにより実装する従来方法に比べて、
ワイヤー部分に封止樹脂を上部から山状に覆う必要がな
く、封止樹脂とモジュール基板との線膨脹係数の差が原
因で生じる基板の反りも少なくなり、これにより、マザ
ー基板への接合部での短絡や接合不良等を確実に回避で
きる。
【0018】(3)モジュール化したいベアICのKG
Dが揃わない場合にも、TABで置き換えることによ
り、全てのICに対してKGDを使用することなく、M
CM化することが可能となる。
【0019】なお、上記実施の形態では、一方をベアI
Cで構成した例で説明したが、ベアICに予めバンプを
メッキ等で形成し、コンパクトパッケージ化した構成の
ものを使用した場合にも同様の効果が得られるものであ
る。
【0020】また、上記実施の形態では、ベアIC1と
TAB2とを絶縁性接着剤3により接合固定した構成で
あるが、絶縁性接着剤3の代わりに、放熱性の高い物
質、あるいはベアIC1とTAB2とを干渉を防ぐ材料
に置き換えた場合にも、上記実施の形態と同様の効果が
得られるものである。
【0021】
【発明の効果】以上のように本発明は、ベアICとTA
Bとを絶縁性接着剤を介して接着し、上記ベアICをフ
ェースダウンで封止樹脂を介して基板にフリップチップ
実装し、上記TABのアウタリードを上記基板に実装し
たものであり、以下のような効果を有するものである。
【0022】ベアICとTABとを積層した構成である
ため、従来のように横並べに実装した場合に比べて実装
面積が半減しモジュール基板を小さくすることができ、
高密度実装が可能となると共に、モジュール基板の反り
が小さくなり、接合不良を回避することができる。
【0023】また、ベアICをフェースダウンしてバン
プを形成し、ベアICとモジュール基板との間を封止樹
脂にて封止(FC実装)しているため、ベアICをワイ
ヤーボンディングにより実装する従来方法に比べて、ワ
イヤー部分に封止樹脂を上部から山状に覆う必要がな
く、封止樹脂とモジュール基板との線膨脹係数の差が原
因で生じる基板の反りも少なくなり、マザー基板への接
合部での短絡や接合不良等を確実に回避できる。
【0024】さらに、モジュール化したいベアICのK
GDが揃わない場合にも、TABで置き換えることによ
り、MCM化することが可能となる。
【図面の簡単な説明】
【図1】本発明の実施の形態における半導体混載実装方
法を示す側断面図
【図2】同実施の形態の半導体混載実装方法を示す上面
【図3】従来の半導体混載実装方法を示す上面図
【図4】従来の半導体混載実装方法を示す側断面図
【符号の説明】
1 ベアIC 2 TAB 3 絶縁性接着剤 4 バンプ 5 導電性接着剤 6 モジュール基板 7 封止樹脂 8 アウタリード

Claims (4)

    【特許請求の範囲】
  1. 【請求項1】 ベアICとTABとを絶縁性接着剤を介
    して接着し、上記ベアICをフェースダウンで封止樹脂
    を介して基板にフリップチップ実装し、上記TABのア
    ウタリードを上記基板に実装する半導体混載実装方法。
  2. 【請求項2】 ベアICとTABとがコンパクトパッケ
    イージ化したことを特徴とする請求項1記載の半導体混
    載実装方法。
  3. 【請求項3】 ベアICとTABとを放熱性の高い干渉
    材を介して積層し、上記ベアICをフェースダウンで封
    止樹脂を介して基板にフリップチップ実装し、上記TA
    Bのアウタリードを上記基板に実装する半導体混載実装
    方法。
  4. 【請求項4】 ベアICとTABとがコンパクトパッケ
    イージ化したことを特徴とする請求項3記載の半導体混
    載実装方法。
JP8092357A 1996-04-15 1996-04-15 半導体混載実装方法 Pending JPH09283696A (ja)

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Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100281115B1 (ko) * 1998-05-12 2001-02-01 김영환 멀티칩모듈
WO2001037332A1 (en) * 1999-11-16 2001-05-25 Indian Space Research Organisation A high density hybrid integrated circuit package having a flip-con structure
KR20020016278A (ko) * 2000-08-25 2002-03-04 듀흐 마리 에스. 플립 칩 기술 공정에서 개량된 칩 실장 방법

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WO2001037332A1 (en) * 1999-11-16 2001-05-25 Indian Space Research Organisation A high density hybrid integrated circuit package having a flip-con structure
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