JPH09292596A - 液晶駆動用電源回路 - Google Patents
液晶駆動用電源回路Info
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- JPH09292596A JPH09292596A JP10524296A JP10524296A JPH09292596A JP H09292596 A JPH09292596 A JP H09292596A JP 10524296 A JP10524296 A JP 10524296A JP 10524296 A JP10524296 A JP 10524296A JP H09292596 A JPH09292596 A JP H09292596A
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- 230000006866 deterioration Effects 0.000 abstract description 3
- 239000000463 material Substances 0.000 abstract description 2
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- 101100422768 Saccharomyces cerevisiae (strain ATCC 204508 / S288c) SUL2 gene Proteins 0.000 description 3
- 238000006243 chemical reaction Methods 0.000 description 3
- 101100191136 Arabidopsis thaliana PCMP-A2 gene Proteins 0.000 description 2
- 101100048260 Saccharomyces cerevisiae (strain ATCC 204508 / S288c) UBX2 gene Proteins 0.000 description 2
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- Liquid Crystal (AREA)
- Liquid Crystal Display Device Control (AREA)
Abstract
(57)【要約】
【課題】低消費電力でかつ波形の歪や液晶画質の悪化を
防止するための液晶駆動用電源電圧を供給することを目
的とする。 【解決手段】液晶表示素子を駆動するためのオペアンプ
回路を充電用・放電用のＺ回路を別々に有し、上記回路
を充放電のタイミングにより切り換えるためのスイッチ
回路およびそのタイミングを発生させるためのタイミン
グ回路を有する。これにより各オペアンプ回路の低消費
電力化をはかる。
防止するための液晶駆動用電源電圧を供給することを目
的とする。 【解決手段】液晶表示素子を駆動するためのオペアンプ
回路を充電用・放電用のＺ回路を別々に有し、上記回路
を充放電のタイミングにより切り換えるためのスイッチ
回路およびそのタイミングを発生させるためのタイミン
グ回路を有する。これにより各オペアンプ回路の低消費
電力化をはかる。
Description
【０００１】
【発明の属する技術分野】本発明は液晶表示装置に係
り、特に時分割数（デューティ）が大きい中型又は大型
のドットマトリックスタイプの液晶表示素子に好適な液
晶駆動用電源回路に関する。
り、特に時分割数（デューティ）が大きい中型又は大型
のドットマトリックスタイプの液晶表示素子に好適な液
晶駆動用電源回路に関する。
【０００２】
【従来の技術】図６を参照すると、従来の液晶駆動回路
は、この液晶駆動回路における液晶電圧をプラス側電源
（例えば＋１０Ｖ）とマイナス側電源（例えば０Ｖ）と
の電圧差を内部抵抗により分圧し、さらにボルテージフ
ォロア型オペアンプによりインピーダンス変換したもの
を直接液晶駆動電圧とする。
は、この液晶駆動回路における液晶電圧をプラス側電源
（例えば＋１０Ｖ）とマイナス側電源（例えば０Ｖ）と
の電圧差を内部抵抗により分圧し、さらにボルテージフ
ォロア型オペアンプによりインピーダンス変換したもの
を直接液晶駆動電圧とする。
【０００３】このような従来の液晶駆動回路は、例えば
特開平５−２７３９３２号公報に開示されている。この
従来の回路構成では中型又は大型の液晶表示素子を駆動
する場合、各オペアンプの駆動能力を上げて用いる。
特開平５−２７３９３２号公報に開示されている。この
従来の回路構成では中型又は大型の液晶表示素子を駆動
する場合、各オペアンプの駆動能力を上げて用いる。
【０００４】
【発明が解決しようとする課題】しかしながら従来の回
路構成では以下に示す問題点がある。
路構成では以下に示す問題点がある。
【０００５】（１）液晶の表示素子数が大きくなるとそ
れだけ電源の駆動能力が必要になるため、各オペアンプ
の駆動能力を上げる必要があり、消費電流が大きくなっ
てしまう。
れだけ電源の駆動能力が必要になるため、各オペアンプ
の駆動能力を上げる必要があり、消費電流が大きくなっ
てしまう。
【０００６】（２）液晶素子は一般にはコモン電極とセ
グメント電極間に電圧を印加することにより表示するこ
とを可能にするが、セグメント数つまり表示行数が多く
なれば、コモン電極は共通であるため、各コモンにかか
る負荷容量（液晶素子は容量負荷であるため）が大きく
なるが図６に示す様に例えばデューティ数がｎの場合、
ｎ番目のコモンに関しては液晶負荷からの充放電が１番
目から（ｎ−１）番目までのコモンに比べ放電電荷が大
きく、その結果ｎ番目コモンの駆動能力を考えると充電
放電の両方の能力を持ったオペアンプを使用する必要が
あり消費電力を極力小さくすることができないという問
題がある。
グメント電極間に電圧を印加することにより表示するこ
とを可能にするが、セグメント数つまり表示行数が多く
なれば、コモン電極は共通であるため、各コモンにかか
る負荷容量（液晶素子は容量負荷であるため）が大きく
なるが図６に示す様に例えばデューティ数がｎの場合、
ｎ番目のコモンに関しては液晶負荷からの充放電が１番
目から（ｎ−１）番目までのコモンに比べ放電電荷が大
きく、その結果ｎ番目コモンの駆動能力を考えると充電
放電の両方の能力を持ったオペアンプを使用する必要が
あり消費電力を極力小さくすることができないという問
題がある。
【０００７】
【課題を解決するための手段】本発明の液晶駆動用電源
回路は、第１の電源電位と第２の電源電位との間を分圧
する複数の抵抗を有する抵抗分圧回路と、この抵抗分圧
回路の出力電圧を入力に受け液晶表示素子を充電駆動す
る第１のオペアンプ回路と、前記抵抗分圧回路の出力電
圧を入力に受け前記液晶表示素子を放電駆動する第２の
オペアンプ回路と、前記第１のオペアンプ回路と前記第
２のオペアンプ回路を所定のタイミングで切り換える第
１のスイッチ回路と、この第１のスイッチ回路を制御す
るタイミング回路とを有する構成である。
回路は、第１の電源電位と第２の電源電位との間を分圧
する複数の抵抗を有する抵抗分圧回路と、この抵抗分圧
回路の出力電圧を入力に受け液晶表示素子を充電駆動す
る第１のオペアンプ回路と、前記抵抗分圧回路の出力電
圧を入力に受け前記液晶表示素子を放電駆動する第２の
オペアンプ回路と、前記第１のオペアンプ回路と前記第
２のオペアンプ回路を所定のタイミングで切り換える第
１のスイッチ回路と、この第１のスイッチ回路を制御す
るタイミング回路とを有する構成である。
【０００８】また、前記抵抗分圧回路の出力電圧を受け
前記タイミング回路により前記抵抗分圧回路の供給レベ
ル電圧を切り換える第２のスイッチ回路を有する構成と
することもできる。
前記タイミング回路により前記抵抗分圧回路の供給レベ
ル電圧を切り換える第２のスイッチ回路を有する構成と
することもできる。
【０００９】さらにまた、本発明の液晶駆動用電源回路
の前記第１のスイッチ回路と前記第２のスイッチ回路と
が前記タイミング回路により同期して動作する構成とす
ることもできる。
の前記第１のスイッチ回路と前記第２のスイッチ回路と
が前記タイミング回路により同期して動作する構成とす
ることもできる。
【００１０】
【発明の実施の形態】本発明の第１の実施の形態を図を
参照して説明する。
参照して説明する。
【００１１】図１を参照すると本実施の形態の液晶駆動
用電源回路は、プラス側電源Ｖ０とマイナス側電源ＶＥ
Ｅの両電源間を電位分割する抵抗Ｒと、それぞれ分割し
た電圧をインピーダンス変換し、液晶素子駆動用電源
（Ｖ１，Ｖ２ａ，Ｖ２ｂ，Ｖ３，Ｖ４，Ｖａ，Ｖ５ｂ）
の７レベルを供給するオペアンプ（ＯＡａ，ＯＡｂ）を
備える。さらに、電圧Ｖ２ｂおよびＶ５ｂについては液
晶負荷容量に対する充放電の向きを考慮した図２に示す
様な切換えタイミングにより（Ａ，Ｂに示すコモンｎ番
目の波形エッジ）アンプＯＡａ，ＯＡｂを切換えて電圧
Ｖ２ｂ，Ｖ５ｂをそれぞれ出力するセレクタ回路ＳＥＬ
およびセレクタ回路ＳＥＬを制御するタイミング発生回
路ＴＭを備える。各基準電圧（Ｖ１〜Ｖ６）とコモンと
の対応は、デューティ数ｎの液晶装置を例にすると、コ
モン１番目〜（ｎ−１）番目は電圧Ｖ１，Ｖ２ａ，Ｖ５
ａ，Ｖ６の各レベルを選択し、コモンのｎ番目は電圧Ｖ
１，Ｖ２ｂ，Ｖ５ｂ，Ｖ６レベルを選択することにな
る。
用電源回路は、プラス側電源Ｖ０とマイナス側電源ＶＥ
Ｅの両電源間を電位分割する抵抗Ｒと、それぞれ分割し
た電圧をインピーダンス変換し、液晶素子駆動用電源
（Ｖ１，Ｖ２ａ，Ｖ２ｂ，Ｖ３，Ｖ４，Ｖａ，Ｖ５ｂ）
の７レベルを供給するオペアンプ（ＯＡａ，ＯＡｂ）を
備える。さらに、電圧Ｖ２ｂおよびＶ５ｂについては液
晶負荷容量に対する充放電の向きを考慮した図２に示す
様な切換えタイミングにより（Ａ，Ｂに示すコモンｎ番
目の波形エッジ）アンプＯＡａ，ＯＡｂを切換えて電圧
Ｖ２ｂ，Ｖ５ｂをそれぞれ出力するセレクタ回路ＳＥＬ
およびセレクタ回路ＳＥＬを制御するタイミング発生回
路ＴＭを備える。各基準電圧（Ｖ１〜Ｖ６）とコモンと
の対応は、デューティ数ｎの液晶装置を例にすると、コ
モン１番目〜（ｎ−１）番目は電圧Ｖ１，Ｖ２ａ，Ｖ５
ａ，Ｖ６の各レベルを選択し、コモンのｎ番目は電圧Ｖ
１，Ｖ２ｂ，Ｖ５ｂ，Ｖ６レベルを選択することにな
る。
【００１２】次に、回路上の抵抗Ｒの設定について説明
すると、まず抵抗Ｒは基本的に電源間Ｖ０〜ＶＥＥを単
に分圧するだけであり、電流値を小さくするために大き
な定数のものを選ぶ。また抵抗Ｒ′はオペアンプ（ＯＡ
ａ，又はＯＡｂ）のインピーダンスとほぼ等しい定数を
選び全体のバランスを均等にする。
すると、まず抵抗Ｒは基本的に電源間Ｖ０〜ＶＥＥを単
に分圧するだけであり、電流値を小さくするために大き
な定数のものを選ぶ。また抵抗Ｒ′はオペアンプ（ＯＡ
ａ，又はＯＡｂ）のインピーダンスとほぼ等しい定数を
選び全体のバランスを均等にする。
【００１３】抵抗Ｒ″は各オペアンプでの低電流回路に
流す電流値を決める抵抗であり、全体の消費電流を小さ
くするために数百ＫΩ程度の大きなものを選択する。
流す電流値を決める抵抗であり、全体の消費電流を小さ
くするために数百ＫΩ程度の大きなものを選択する。
【００１４】また図２に示すパルス幅ｔｓ及びｔｈにつ
いてはセグメント、コモン出力の応答時間を考慮して、
数十μｓ程度で設定することによりタイミングのずれに
よる表示への影響がない様に十分時間をとる。
いてはセグメント、コモン出力の応答時間を考慮して、
数十μｓ程度で設定することによりタイミングのずれに
よる表示への影響がない様に十分時間をとる。
【００１５】次に、本発明の第２の実施の形態を図４お
よび図５を参照して説明する。
よび図５を参照して説明する。
【００１６】図４を参照すると、この実施の形態は、第
１の電源電位Ｖ０をレベル電圧Ｖ１に調整する抵抗Ｒ′
と抵抗分圧回路の出力電圧のうち２個の出力電圧を切り
換えるセレクタ回路ＳＥＬ２をさらに備える以外は第１
の実施の形態と同一構成であり、同一の構成要素には同
一参照符号を付して図示してある。
１の電源電位Ｖ０をレベル電圧Ｖ１に調整する抵抗Ｒ′
と抵抗分圧回路の出力電圧のうち２個の出力電圧を切り
換えるセレクタ回路ＳＥＬ２をさらに備える以外は第１
の実施の形態と同一構成であり、同一の構成要素には同
一参照符号を付して図示してある。
【００１７】この実施の形態のタイミング回路ＴＭは図
５に示すようにセレクタ回路ＳＥＬ１を駆動する出力０
１とセレクタ回路ＳＥＬ２を駆動する出力０２を同期し
て出力しこの実施の形態の液晶表示駆動電圧（Ｖ１〜Ｖ
６）はそれぞれセレクタ回路ＳＥＬ１，ＳＥＬ２の切り
換えにより図５に示す波形を出力する。
５に示すようにセレクタ回路ＳＥＬ１を駆動する出力０
１とセレクタ回路ＳＥＬ２を駆動する出力０２を同期し
て出力しこの実施の形態の液晶表示駆動電圧（Ｖ１〜Ｖ
６）はそれぞれセレクタ回路ＳＥＬ１，ＳＥＬ２の切り
換えにより図５に示す波形を出力する。
【００１８】本発明の第２の実施の形態は、電圧Ｖ０を
調整する場合の回路構成であり、プラス側電源電位Ｖ０
を高圧系電源ＶＤＤとして、内部又は外部より供給する
場合、オペアンプ回路ＯＡａを用いてインピーダンス変
換する必要がない。したがって出力レベルＶ１のオペア
ンプ回路ＯＡａは不要となる。また出力レベルＶ２ａを
入力するオペアンプＯＡａとレベルＶ４を入力するオペ
アンプのＯＡａとは同一時間内では同時に選択されない
ため共用することが可能であり、出力レベルＶ５を入力
するオペアンプＯＡｂと出力レベルを入力するオペアン
プＯＡｂもまた共用可能となる。従ってオペアンプ回路
を第１の実施の形態より３個削除して同一の効果を得る
ことが可能となり、さらに低消費電力化をはかることが
できる。
調整する場合の回路構成であり、プラス側電源電位Ｖ０
を高圧系電源ＶＤＤとして、内部又は外部より供給する
場合、オペアンプ回路ＯＡａを用いてインピーダンス変
換する必要がない。したがって出力レベルＶ１のオペア
ンプ回路ＯＡａは不要となる。また出力レベルＶ２ａを
入力するオペアンプＯＡａとレベルＶ４を入力するオペ
アンプのＯＡａとは同一時間内では同時に選択されない
ため共用することが可能であり、出力レベルＶ５を入力
するオペアンプＯＡｂと出力レベルを入力するオペアン
プＯＡｂもまた共用可能となる。従ってオペアンプ回路
を第１の実施の形態より３個削除して同一の効果を得る
ことが可能となり、さらに低消費電力化をはかることが
できる。
【００１９】
【発明の効果】以上説明した様に本発明によれば、液晶
材の容量が大きい表示装置や、大型パネルの液晶表示素
子においても、電源の駆動能力不足による波形の歪や画
質の悪化を防止することができかつ電源回路を有する液
晶駆動用の半導体素子の消費電力を小さくする効果があ
る。
材の容量が大きい表示装置や、大型パネルの液晶表示素
子においても、電源の駆動能力不足による波形の歪や画
質の悪化を防止することができかつ電源回路を有する液
晶駆動用の半導体素子の消費電力を小さくする効果があ
る。
【図１】本発明の液晶駆動用電源回路の第１の実施の形
態の回路図である。
態の回路図である。
【図２】図１に示したタイミング回路の出力タイミング
波形である。
波形である。
【図３】図１に示したオペアンプ回路の回路図である。
【図４】本発明の第２の実施の形態の回路図である。
【図５】図４に示したタイミング回路の出力波形であ
る。
る。
【図６】従来の液晶駆動用電源回路の回路図である。
【図７】図６の電圧Ｖ１〜Ｖ６と液晶駆動時のコモンお
よびセグメント波形を示すタイミングチャートである。
よびセグメント波形を示すタイミングチャートである。
Ｖ１〜Ｖ６ 液晶駆動電圧 Ｖ０ プラス電源 ＶＥＥ マイナス電源 ＯＡａ，ｂ オペアンプ Ｒ ブリーダ抵抗 Ｒ′ 補助抵抗 Ｒ″ バイアス抵抗 ＴＭ タイミング発生回路 ＳＥＬ セレクタ回路 ＶＤＤ 高圧系電源
Claims (3)
- 【請求項１】 第１の電源電位と第２の電源電位との間
を分圧する複数の抵抗を有する抵抗分圧回路と、この抵
抗分圧回路の出力電圧を入力に受け液晶表示素子を充電
駆動する第１のオペアンプ回路と、前記抵抗分圧回路の
出力電圧を入力に受け前記液晶表示素子を放電駆動する
第２のオペアンプ回路と、前記第１のオペアンプ回路と
前記第２のオペアンプ回路を所定のタイミングで切り換
える第１のスイッチ回路と、この第１のスイッチ回路を
制御するタイミング回路とを有することを特徴とする液
晶駆動用電源回路。 - 【請求項２】 前記抵抗分圧回路の出力電圧を受け前記
タイミング回路により前記抵抗分圧回路の供給レベル電
圧を切り換える第２のスイッチ回路を有することを特徴
とする請求項１記載の液晶駆動用電源回路。 - 【請求項３】 前記第１のスイッチ回路と前記第２のス
イッチ回路とが前記タイミング回路により同期して動作
する請求項２記載の液晶駆動用電源回路
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10524296A JP2865053B2 (ja) | 1996-04-25 | 1996-04-25 | 液晶駆動用電源回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10524296A JP2865053B2 (ja) | 1996-04-25 | 1996-04-25 | 液晶駆動用電源回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH09292596A true JPH09292596A (ja) | 1997-11-11 |
| JP2865053B2 JP2865053B2 (ja) | 1999-03-08 |
Family
ID=14402190
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP10524296A Expired - Fee Related JP2865053B2 (ja) | 1996-04-25 | 1996-04-25 | 液晶駆動用電源回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2865053B2 (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7486288B2 (en) | 2003-12-08 | 2009-02-03 | Rohm Co., Ltd. | Display device driving apparatus and display device using the same |
| JP2023526187A (ja) * | 2020-05-19 | 2023-06-21 | エーエスエムエル ホールディング エヌ．ブイ． | アライメントマークの局所的な歪みに基づくアライメント信号の生成 |
-
1996
- 1996-04-25 JP JP10524296A patent/JP2865053B2/ja not_active Expired - Fee Related
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7486288B2 (en) | 2003-12-08 | 2009-02-03 | Rohm Co., Ltd. | Display device driving apparatus and display device using the same |
| JP2023526187A (ja) * | 2020-05-19 | 2023-06-21 | エーエスエムエル ホールディング エヌ．ブイ． | アライメントマークの局所的な歪みに基づくアライメント信号の生成 |
| US12474647B2 (en) | 2020-05-19 | 2025-11-18 | Asml Netherlands B.V. | Generating an alignment signal based on local alignment mark distortions |
Also Published As
| Publication number | Publication date |
|---|---|
| JP2865053B2 (ja) | 1999-03-08 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 19981117 |
|
| LAPS | Cancellation because of no payment of annual fees |