JPH09298662A - シェーディング補正装置 - Google Patents

シェーディング補正装置

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JPH09298662A
JPH09298662A JP8112467A JP11246796A JPH09298662A JP H09298662 A JPH09298662 A JP H09298662A JP 8112467 A JP8112467 A JP 8112467A JP 11246796 A JP11246796 A JP 11246796A JP H09298662 A JPH09298662 A JP H09298662A
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JP
Japan
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Pending
Application number
JP8112467A
Other languages
English (en)
Inventor
Hiromi Tanimizu
弘実 谷水
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Panasonic Holdings Corp
Original Assignee
Matsushita Electric Industrial Co Ltd
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Publication date
Application filed by Matsushita Electric Industrial Co Ltd filed Critical Matsushita Electric Industrial Co Ltd
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Abstract

(57)【要約】 【課題】 ごみ、汚れ等の影響をうけず、何らかの原因
で蓄積してある白基準データが破壊されても復帰可能な
シェーディング補正装置を提供することを目的とする。 【解決手段】 白基準データを蓄積しておくメモリ10
4と、メモリ104に蓄積されている白基準データに異
常がないか判定する異常検出部107とを備え、白基準
データに異常がある場合は白基準データの蓄積を再度行
う。

Description

【発明の詳細な説明】
【0001】
【発明の属する技術分野】本発明は、画像のシェーディ
ング歪を補正するシェーディング補正装置に関するもの
である。
【0002】
【従来の技術】従来、画像読取装置において原稿を読み
取る場合、光源およびレンズ等によるシェーディング歪
を補正することが一般的に行われている。
【0003】図6は、従来のシェーディング補正回路と
その周囲を示すブロック図である。まず、原稿を読み取
る前に、図示していない光源を点灯させ、スキャナ10
1で白基準となる面を読み取る。
【0004】この白基準のデータを取得する際におい
て、スイッチ103はa側(つまりメモリ104側)に
あり、読み取られた白基準データはA/D変換器102
によりデジタルデータに変換された後、メモリ104に
書きこまれる。勿論この一連の動作は、制御部105で
制御される。
【0005】次に、読み取り対象の原稿を読み取る場
合、スイッチ103はb側(シェーディング補正回路1
06側)になり、読み取られたデータは、予めメモリ1
04に書き込まれている白基準データを使用して、シェ
ーディング補正回路106でシェーディング補正が行わ
れる。
【0006】以上説明したようシェーディング補正をす
る場合は、予め白基準となる情報を蓄積しておく必要が
ある。そして、従来の画像読み取り装置において、白基
準となるデータは、原稿を読み取る直前にメモリに書き
込まれていた。
【0007】
【発明が解決しようとする課題】このように、白基準と
なるデータを原稿読み取り直前にメモリに書き込むと、
白基準となる面にごみや汚れ等が付着した場合、当然の
ことながら、正常なシェーディング補正が行われないと
いう問題がある。
【0008】そこで、この問題を解決するため、白基準
面にごみや汚れが付着する前、例えば製品出荷時に白基
準のデータを、メモリ(通常、作業効率および価格面か
らバックアップ可能なSRAMに蓄積される)に蓄積す
るという方法がある。
【0009】しかしこのようにすると、例えばCPUが
暴走して白基準のデータを破壊した場合、2度と正常な
シェーディング補正ができなくなるという問題がある。
【0010】そこで本発明は、ごみや汚れの影響を受け
にくくまた、何らかの原因で白基準データが破壊された
場合でも復帰できるシェーディング補正装置を提供する
ことを目的とする。
【0011】
【課題を解決するための手段】本発明のシェーディング
補正装置は、白基準データを蓄積しておく蓄積手段と、
蓄積されている白基準データに異常がないかどうかを判
定する異常検出手段を具備し、異常検出手段で異常と判
定された場合は蓄積手段に白基準データが再度蓄積する
ようにしている。
【0012】
【発明の実施の形態】上記構成により、蓄積してある白
基準データと予め設定されている値との比較結果と、白
基準データの隣接画素間の差分と予め設定された値との
比較結果により蓄積してある白基準データが破壊されて
いないか判断し、破壊されていた場合は、再度白基準デ
ータの書き込みをおこなうため何らかの原因で白基準デ
ータが破壊されても復帰することができる。
【0013】以下本発明の実施の形態について図面を参
照しながら説明する。図1は、本発明の一実施の形態に
おけるシェーディング補正回路とその周辺を示すブロッ
ク図である。図1において、101はスキャナ、102
はスキャナ101より出力されるアナログ信号をデジタ
ル信号に変換するA/D変換器、103はスイッチ、1
04は白基準データを蓄積しておく蓄積手段としてのメ
モリ、105はスイッチ103およびメモリ104の動
作を制御する制御部、106はシェーディング補正回
路、107は白基準データの異常を検出する異常検出手
段としての異常検出部である。
【0014】次に動作について説明する。まず、白基準
面にごみ、汚れ等が付着する前(たとえば工場出荷前)
に、スキャナ101で白基準面を読み取りA/D変換器
102でデジタル信号に変換したあと、メモリ104に
データを蓄積する。勿論このとき、スイッチ103はa
側にある。スイッチ103の動作とメモリ104への書
き込みの動作は、制御部105で制御される。なお本実
施の形態において、メモリ104は揮発性を有するので
電池でバックアップしてある。
【0015】次に、原稿読み取り時は、まずメモリ10
4に蓄積してある白基準データに異常が発生していない
か異常検出部107で判定し、異常がなければスイッチ
103をb側にして原稿を読み取ったデータに対して、
メモリ104内の白基準データによりシェーディング補
正回路106がシェーディング補正を行う。異常検出部
107で異常が確認された場合は、制御部105がスイ
ッチ103をa側にしてメモリ104に書き込み動作の
制御を行って、白基準データの再書き込みをおこなう。
【0016】図2は、本発明の一実施の形態における異
常検出部のブロック図である。201は入力端子、20
2は白基準データの上限を示すため予め設定しておく設
定値A、203は比較器、204は白基準データの下限
を示すため予め設定しておく設定値B、205は比較器
である。比較器204、205は第1の比較手段に対応
する。また、206は隣接画素間の差を検出する検出手
段としての減算器、207は予め設定しておく設定値
C、208は比較器、209は比較器203と比較器2
05、および比較器208の結果より異常であるか判定
する判定手段としての判定回路、210は出力端子であ
る。
【0017】また、図3は本発明の一実施の形態におけ
る設定値Aおよび設定値Bの説明図、図4は本発明の一
実施の形態における設定値Cの説明図である。
【0018】次にこれらの設定値A,B,Cを含めて、
動作を説明する。メモリ104より読み出された白基準
データは、入力端子201より入力される。入力された
データは、白基準波形の上限値を示す設定値A202と
比較器203で、また白基準波形の下限値を示す設定値
Bと比較器205で比較される。
【0019】ここで図3では、横軸を時間、縦軸をデジ
タル値として白基準データ1ラインの状態を示してい
る。図3に示すように、白基準データは、必ずあるデジ
タル値B以上の値をまた、あるデジタル値A以下の値を
持っているため、設定値A以下あるいは設定値B以上の
値があれば異常となる。従って、比較器203で設定値
Aとまた比較器205で設定値Bと白基準データとの比
較を行う。
【0020】次に、白基準データの隣接画素間の差を減
算器206で検出して、予め設定されている設定値C2
07と比較器208で比較する。図4は白基準データの
画素間の状況を示している。図4に示すように白基準デ
ータの隣接画素間の差は必ずある値の範囲で推移する。
【0021】従って、隣接画素間の差と設定値Cとを比
較器208で比較し隣接画素間の差が設定値Cより大き
い場合は異常と判定できる。判定回路209では比較器
203、205、208の結果より異常であることを判
定するとその情報を出力端子210より出力する。
【0022】以上の説明において、デジタル値の値が高
いほうを白としたが、低いほうが白の場合でも同様の判
定ができる。また、原稿読み取り直前にメモリに蓄積さ
れている白基準データの異常の検出を行ったが、リセッ
ト直後に実施しても良い。
【0023】図5は、本発明の他の実施の形態における
異常検出部のブロック図である。図5において、201
は入力端子202は白基準データの上限を示す設定値、
203は比較器、204は白基準データの下限を示す設
定値、205は比較器、206は隣接画素間の差を検出
する減算器、207は設定値、208は比較器、209
は判定回路、210は出力端子で以上は図2の構成と同
様なものである。
【0024】図2の構成と異なるのは、白基準データで
同じ値が連続する場合、連続数を計数する計数手段とし
ての計数器301と、予め設定しておく設定値302及
び比較器303を追加した点である。図5においては、
図2と同様な動作をさせてさらに、白基準データの連続
数も計数し予め設定しておく設定値Dとの比較結果を判
定条件とし追加する。これは図Aに示すように白基準デ
ータは同一値がたとえば1ライン分連続することはな
く、連続している場合は異常と判定できるからである。
【0025】
【発明の効果】本発明は、ごみ、汚れが付着するまえに
書き込んだ白基準データを使用するためごみ、汚れの影
響をうけないシェーディング補正を実現するととも、白
基準データに異常が発生しているか判定回路を設けるこ
とで、異常が発生している場合は、再度シェーディング
データの書き込みが行えるため、何らかの原因で予め蓄
積してある白基準データが破壊されても復帰可能なシェ
ーディング補正装置を得ることができる。
【図面の簡単な説明】
【図1】本発明の一実施の形態におけるシェーディング
補正回路とその周辺を示すブロック図
【図2】本発明の一実施の形態における異常検出部のブ
ロック図
【図3】本発明の一実施の形態における設定値Aおよび
設定値Bの説明図
【図4】本発明の一実施の形態における設定値Cの説明
図
【図5】本発明の他の実施の形態における異常検出部の
ブロック図
【図6】従来のシェーディング補正回路とその周囲を示
すブロック図
【符号の説明】
104 メモリ 105 制御部 106 シェーディング補正回路 107 異常検出部 203 比較器 205 比較器 208 比較器 209 判定回路 301 計数器 303 比較器

Claims (3)

    【特許請求の範囲】
  1. 【請求項1】原稿読み取り位置において、一様な白を有
    する面を予め読み取って白基準データとし、この白基準
    データを使用してシェーディング補正をおこなうシェー
    ディング補正装置であって、 白基準データを蓄積しておく蓄積手段と、蓄積されてい
    る白基準データに異常がないかどうかを判定する異常検
    出手段を具備し、前記異常検出手段で異常と判定された
    場合は前記蓄積手段に白基準データが再度蓄積するよう
    にしたことを特徴とするシェーディング補正装置。
  2. 【請求項2】白基準データと予め設定されている値とを
    比較する第1の比較手段と、白基準データの隣接画素間
    の差を検出する検出手段と、予め設定されている値と前
    記隣接画素間の差を比較する第2の比較手段と、前記第
    1、第2の比較手段の結果が異常であるかどうかを判定
    する判定手段を具備することを特徴とする請求項1記載
    のシェーディング補正装置。
  3. 【請求項3】白基準データと予め設定されている値とを
    比較する第1の比較手段と、白基準データの隣接画素間
    の差を検出する検出手段と、予め設定されている値と前
    記隣接画素間の差を比較する第2の比較手段と、白基準
    データで同じ値が連続する場合その連続数を計数する計
    数手段と、予め設定している値と前記計数手段による計
    数値とを比較する第2の比較手段と、前記第1、第2の
    比較手段の結果および前記比較手段の結果により異常で
    あるか判定する判定手段を具備することを特徴とする請
    求項1記載のシェーディング補正装置。
JP8112467A 1996-05-07 1996-05-07 シェーディング補正装置 Pending JPH09298662A (ja)

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