JPH095408A - タイミング信号発生回路 - Google Patents

タイミング信号発生回路

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JPH095408A
JPH095408A JP7179462A JP17946295A JPH095408A JP H095408 A JPH095408 A JP H095408A JP 7179462 A JP7179462 A JP 7179462A JP 17946295 A JP17946295 A JP 17946295A JP H095408 A JPH095408 A JP H095408A
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Abstract

(57)【要約】 【目的】 複数の微小可変遅延回路より成る可変遅延回
路を位相比較器による帰還制御により安定化したタイミ
ング信号発生回路の遅延時間測定をループ発振法で行
い、高精度のデーターを短時間に得る。 【構成】 タイミング信号発生回路の帰還制御ループに
トラック／ホールド回路１７０を設け、通常のタイミン
グ信号発生動作時はトラック／ホールド回路１７０のト
ラック動作により帰還制御機能を働かせて可変遅延回路
１２０の遅延時間を安定化する、遅延時間測定のための
ループ発振動作時はトラック／ホールド回路１７０のホ
ールド動作により帰還制御機能を停止して可変遅延回路
１２０の遅延時間を固定しループ発振法により遅延時間
の測定を行う。

Description

【発明の詳細な説明】
【０００１】
【産業上の利用分野】この発明は、例えば、ＩＣテスタ
ーのような電子機器に使用する高分解能のタイミング信
号発生回路の遅延時間を、ループ発振法で高精度に測定
可能にしたタイミング信号発生回路に関するものであ
り、本出願人が先に開示した特願平６−１４３９５０
「タイミング信号発生回路」において、ループ発振法で
遅延時間を測定可能にする改良発明である。
【０００２】
【従来の技術】高分解能のタイミング信号発生回路とし
て、特願平６−１４３９５０「タイミング信号発生回
路」に述べた高安定度のクロック信号を基準とし、位相
同期ループ回路による帰還制御により安定化された可変
遅延回路を使って、タイミング信号を発生するタイミン
グ信号発生回路がある。
【０００３】このタイミング信号発生回路のブロック図
を、図４に示す。このタイミング信号発生回路は大別し
て、位相同期ループ回路部１００と、タイミング信号選
択回路部２００に別れる。それぞれの回路部について説
明する。
【０００４】第一の部分は、クロック信号を入力するｍ
個の可変遅延素子を従続に接続した可変遅延回路１２０
と、この可変遅延回路１２０の出力信号とクロック信号
の位相を比較する位相比較器１４０と、この位相比較器
１４０の出力信号から可変遅延回路１２０の遅延時間を
制御するために可変遅延回路１２０に帰還される遅延制
御信号を発生する帰還回路１５０と、より構成される位
相同期ループ回路部１００である。
【０００５】この位相同期ループ回路部１００では、位
相比較器１４０により、クロック信号と可変遅延回路１
２０を通過し遅延した信号とを比較して、それらの位相
が一致するように可変遅延回路１２０を制御しているの
で、可変遅延回路１２０の遅延時間はクロック信号の１
周期と等しくなり、可変遅延回路１２０内のｍ個の可変
遅延素子の各々からは、クロック信号の１周期をｍ等分
した遅延時間差を持つ信号が得られる。
【０００６】第二の部分は、タイミング信号発生回路の
出力のタイミングを指定する遅延データを受ける同期型
遅延回路１１０およびデコーダー１６０と、可変遅延回
路１２０のｍ個の可変遅延素子からの信号のうち一つを
選択するセレクタ回路１３０と、より構成されるタイミ
ング信号選択回路部２００である。
【０００７】このタイミング信号選択回路部２００で
は、同期型遅延回路１１０が、タイミング信号発生回路
の出力のタイミングを指定する遅延データの上位桁をも
とにクロック信号の周期の整数倍の遅延時間を持つ出力
信号を発生し、デコーダー１６０が、上記遅延データの
下位桁をもとに可変遅延回路１２０の出力のうち所定の
段数の信号を選択する選択信号を発生し、セレクタ回路
１３０が、同期型遅延回路１１０の出力信号と、デコー
ダー１６０からの選択信号と、可変遅延回路１２０の出
力とを受けて、遅延時間が（クロック信号の周期の整数
倍の遅延時間）＋（クロック信号の周期の１／ｍの整数
倍の遅延時間）であるタイミング信号を発生している。
【０００８】遅延回路の遅延時間の高精度高速の測定法
として図５に示すループ発振法が使われている。このル
ープ発振法では、切り替えスイッチＡおよびＢを上側に
接続し、被測定遅延回路５００とパルス注入帰還回路３
００とをループ状に接続したループ発振器を構成し、そ
の発振周波数Ｆ１を周波数カウンタで測定し、つぎに、
切り替えスイッチＡおよびＢを下側に接続し、パルス注
入帰還回路３００のみでループ発振器を構成したときの
発振周波数Ｆ２を周波数カウンタで測定し、被測定遅延
回路５００の遅延時間ＤＴを ＤＴ＝（１／Ｆ１）−
（１／Ｆ２）により求めている。
【０００９】前記のタイミング信号発生回路はクロック
信号の周波数を基準にし、可変遅延回路１２０の遅延時
間を、位相同期ループ回路による帰還制御により制御し
ているので、クロック信号の周波数が変わることは、可
変遅延回路の遅延時間の変化と成る。
【００１０】ループ発振法をこのタイミング信号発生回
路の遅延時間測定に使用することは、クロック信号の周
波数とは異なるループ発振器全体の遅延時間により決ま
るループ発振周波数を基準にしてタイミング信号発生回
路の可変遅延回路１２０の遅延時間を制御することにな
り、可変遅延回路１２０は、本来のクロック信号を基準
にして動作しているときとは異なる遅延時間に制御され
てしまうことに成るため、ループ発振法を使用してこの
タイミング信号発生回路の遅延時間を測定することは出
来なかった。
【００１１】
【発明が解決しようとする課題】この発明の課題は、こ
のタイミング信号発生回路の遅延回路の遅延時間の測定
に、従来は使用不可能であった高精度高速のループ発振
法を、使用可能にすることにより、高精度のデーターを
短時間に得ることである。
【００１２】
【課題を解決するための手段】この発明では、クロック
信号を基準とし、位相同期ループ回路による帰還制御に
より安定化された可変遅延回路を使ってタイミング信号
を発生するタイミング信号発生回路に、可変遅延回路１
２０を制御する遅延制御信号が、帰還回路１５０の出力
を追従し、位相比較器１４０の比較結果により可変遅延
回路１２０が制御されるトラッキング動作と、可変遅延
回路１２０を制御する遅延制御信号が、帰還回路１５０
の出力を追従せず、位相比較器１４０の比較結果と関係
なく、直前のトラッキング動作の最後の遅延制御信号の
状態を保持するホールド動作と、を行うトラック・ホー
ルド回路１７０を設けている。
【００１３】さらに、タイミング信号発生回路と組み合
わせてループ発振器を構成するためのパルス注入帰還回
路３００と、タイミング信号選択回路部２００の入力信
号を、基準クロック信号、あるいは、ループ発振のため
のパルス帰還信号のいずれかに切り替えるための入力セ
レクタ回路４００を設けている。
【００１４】
【実施例】図１に、この発明の一実施例を示し、図２と
共に動作を説明する。動作は、位相同期ループ回路の帰
還機能を有効にする第一の状態と、位相同期ループ回路
の帰還機能を停止する第二の状態がある。それぞれにつ
いて説明する。
【００１５】まず第一の状態は、クロック信号がタイミ
ング信号選択回路部２００に入力される状態に入力セレ
クタ回路４００を制御し、遅延制御信号が、帰還回路１
５０の出力を追従し、位相比較器１４０の比較結果によ
り可変遅延回路１２０が制御されるトラッキング動作状
態にトラック・ホールド回路１７０を制御する。
【００１６】この状態では、特願平６−１４３９５０に
述べた通り、可変遅延回路１２０は、位相同期ループ回
路による帰還制御により制御され、電源変動や温度変化
による可変遅延回路１２０の遅延時間の変化要因を補正
するための遅延制御信号が生成され、可変遅延回路１２
０の遅延時間は、クロック信号を基準として安定化され
る。
【００１７】次に第二の状態では、前記の第一の状態で
可変遅延回路１２０の遅延時間が安定化された後、トラ
ック・ホールド回路１７０を、トラック・ホールド制御
信号により制御し、図２に示すように、遅延制御信号
が、帰還回路１５０の出力を追従せず、位相比較器１４
０の比較結果と関係なく、直前のトラッキング動作の最
後の遅延制御信号の状態を保持するホールド動作に制御
する。
【００１８】この第二の状態では、位相同期ループ回路
による帰還制御は機能を停止し、可変遅延回路１２０は
トラック・ホールド回路１７０により保持された一定の
遅延制御信号により制御され、可変遅延回路１２０の遅
延時間は一定に保たれる。しかし、電源変動や温度変化
による可変遅延回路１２０の遅延時間の変化要因によ
り、可変遅延回路１２０の遅延時間はわずかに変動する
が、次に述べるループ発振法により可変遅延回路１２０
の遅延時間を測定するための約１ミリ秒から約１００ミ
リ秒の時間の間では、実用上無視出来る。
【００１９】さらに、この第二の状態で、トラック・ホ
ールド回路１７０が可変遅延回路１２０の遅延制御信号
を保持したまま、入力セレクタ回路４００をパルス帰還
信号がタイミング信号選択回路部２００に入力される状
態に入力セレクタ回路４００を入力セレクタ制御信号に
より制御し、入力セレクタ回路４００、可変遅延回路１
２０、タイミング信号選択回路部２００、および、パル
ス注入帰還回路３００により、ループ回路を構成する。
【００２０】このループ回路に、パルス注入帰還回路３
００内のスタートパルス発生回路３１０より単一の狭パ
ルス幅、例えば、約１０ナノ秒から約１００ナノ秒程度
のパルス幅のパルス信号を注入すると、このパルスは、
入力セレクタ回路４００を経由して可変遅延回路１２０
に入力され、可変遅延回路１２０内で、トラック・ホー
ルド回路１７０により直前のトラッキング動作の最後の
遅延制御信号の状態に保持された遅延制御信号により決
まる遅延時間の分だけ遅延する。
【００２１】そして、可変遅延回路１２０を構成する複
数の可変遅延素子の各々１ｂ、２ｂ、３ｂ・・・ｍｂよ
り出力される各段の信号の内、測定対照となる可変遅延
回路１２０の段数の位置の信号を選択する選択信号によ
りセレクタ回路１３０で選択された可変遅延回路１２０
の出力信号が、タイミング信号選択回路部２００の出力
であるタイミング信号として出力され、パルス注入帰還
回路３００に戻り、再度、入力セレクタ回路４００へ出
力さる。
【００２２】以降、同様の動作をくり返し、このループ
回路内をパルス信号が巡回するループ発振器が構成さ
れ、このループ回路内をパルス信号が一巡回する時間を
Ｄとすれば、タイミング信号選択回路部２００の出力で
あるタイミング信号は、Ｆ＝１／Ｄで決まるくり返し周
波数のパルス列の信号となる。
【００２３】このとき、可変遅延回路１２０は、ホール
ド動作に制御されたトラック・ホールド回路１７０によ
り、直前のトラッキング動作の最後の遅延制御信号の状
態を保持した遅延制御信号で一定に制御されているの
で、基準クロック信号とは異なる周波数の信号を発振す
るループ発振器の発振周波数に影響されず、第一の状態
と同一の遅延時間を保てるので、ループ発振法で、クロ
ック信号を基準とし、位相同期ループ回路による帰還制
御により安定化された可変遅延回路によりタイミング信
号を発生するタイミング信号発生回路の遅延時間を測定
可能である。
【００２４】以上の説明は、ループ発振器を正帰還のル
ープで構成し、スタートパルス発生回路３１０より単一
の狭パルス信号を注入する例を用いたが、図３に示すよ
うに、ループ発振器を負帰還のループで構成し、スター
トパルス発生回路３１０より単一のステップ信号を注入
しループ発振器の発振周波数Ｆが、ループ回路内を信号
が一巡回する時間をＤとするとき、Ｆ＝１／（２＊Ｄ）
となるループ発振器を使用してもよい。
【００２５】
【発明の効果】この発明は、高分解能のタイミング信号
を発生するための、クロック信号を基準とし、位相同期
ループ回路による帰還制御により安定化された可変遅延
回路によりタイミング信号を発生するタイミング信号発
生回路の遅延時間の測定法として、高精度高速の測定法
であるループ発振法を使用可能とし、高精度のデーター
を短時間に得る効果がある。
【図面の簡単な説明】
【図１】本発明のタイミング信号発生回路の一実施例を
示すブロック図である。
【図２】トラック・ホールド回路の機能を示すタイムチ
ャートである。
【図３】負帰還のループ発振法の原理を示すブロック図
である。
【図４】従来のタイミング信号発生回路の一実施例を示
すブロック図である。
【図５】ループ発振法の原理を示すブロック図である。
【符号の説明】
１００ 位相同期ループ回路 １１０ 同期型遅延回路 １２０ 可変遅延回路 １３０ セレクタ回路 １３１ 遅延回路 １４０ 位相比較器 １５０ 帰還回路 １６０ デコーダー １７０ トラック・ホールド回路 ２００ タイミング信号選択回路部 ３００ パルス注入帰還回路 ３１０ スタートパルス発生回路 ４００ 入力セレクタ回路 ５００ 被測定遅延回路

Claims (1)

    【特許請求の範囲】
  1. 【請求項１】 電子機器に使用する、クロック信号を基
    準とし、位相同期ループ回路による帰還制御により安定
    化された可変遅延回路を使ってタイミング信号を発生す
    るタイミング信号発生回路において、位相同期ループ回
    路内に、帰還回路（１５０）の出力を受け、トラック・
    ホールド制御信号により制御され、可変遅延回路（１２
    ０）へ遅延制御信号を出力するトラック・ホールド回路
    （１７０）を備えたタイミング信号発生回路。
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