JPH0964722A - 信号処理装置 - Google Patents
信号処理装置Info
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- JPH0964722A JPH0964722A JP7211871A JP21187195A JPH0964722A JP H0964722 A JPH0964722 A JP H0964722A JP 7211871 A JP7211871 A JP 7211871A JP 21187195 A JP21187195 A JP 21187195A JP H0964722 A JPH0964722 A JP H0964722A
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- logic circuit
- circuit
- digital
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Abstract
(57)【要約】
【課題】 消費電力を少なくし、基板占有面積を小さく
する。 【解決手段】 ＣＭＯＳロジック回路からなるディジタ
ル変調回路５１，７８及びディジタル復調回路６０，７
７と、ＥＣＬ回路からなるＤ／Ａ変換器５２，７９及び
Ａ／Ｄ変換器５９，７６とを有し、ＥＣＬ回路はＣＭＯ
Ｓロジック回路の信号とセンタレベルを揃えるような正
負の２電源で動作し、ＣＭＯＳロジック回路はＥＣＬ回
路の信号と揃った信号振幅で動作し、ＥＣＬ回路とＣＭ
ＯＳロジック回路を直接接続して両ロジック回路間で高
速信号の受け渡しを行う。
する。 【解決手段】 ＣＭＯＳロジック回路からなるディジタ
ル変調回路５１，７８及びディジタル復調回路６０，７
７と、ＥＣＬ回路からなるＤ／Ａ変換器５２，７９及び
Ａ／Ｄ変換器５９，７６とを有し、ＥＣＬ回路はＣＭＯ
Ｓロジック回路の信号とセンタレベルを揃えるような正
負の２電源で動作し、ＣＭＯＳロジック回路はＥＣＬ回
路の信号と揃った信号振幅で動作し、ＥＣＬ回路とＣＭ
ＯＳロジック回路を直接接続して両ロジック回路間で高
速信号の受け渡しを行う。
Description
【０００１】
【発明の属する技術分野】本発明は、ＣＭＯＳ（Comple
mentary Metal Oxide Semiconductor）ロジック回路と
ＥＣＬ（Emitter Coupled Logic）回路との間で高速信
号の受け渡しを行う信号処理装置に関する。
mentary Metal Oxide Semiconductor）ロジック回路と
ＥＣＬ（Emitter Coupled Logic）回路との間で高速信
号の受け渡しを行う信号処理装置に関する。
【０００２】
【従来の技術】同軸伝送路に信号を伝送するシステムの
一例として、例えば図３に示すように、テレビカメラの
カメラヘッドユニット１と例えば編集室や映像室等に設
けられるカメラコントロールユニット（ＣＣＵ）２３の
間を、３軸の同軸ケーブル１０（以下、ＴＲＩＡＸケー
ブル１０と呼ぶ）で接続し、上記テレビカメラで撮影し
た映像信号をカメラコントロールユニット側に伝送する
ようなシステムが存在する。
一例として、例えば図３に示すように、テレビカメラの
カメラヘッドユニット１と例えば編集室や映像室等に設
けられるカメラコントロールユニット（ＣＣＵ）２３の
間を、３軸の同軸ケーブル１０（以下、ＴＲＩＡＸケー
ブル１０と呼ぶ）で接続し、上記テレビカメラで撮影し
た映像信号をカメラコントロールユニット側に伝送する
ようなシステムが存在する。
【０００３】すなわち図３において、カメラヘッドユニ
ット１からは撮影した映像信号として赤（Ｒ），緑
（Ｇ），青（Ｂ）の映像信号が出力され、当該映像信号
が当該カメラ側の送受信装置２に送られる。当該カメラ
側の送受信装置２では、上記カメラヘッドユニット１か
らの上記Ｒ，Ｇ，Ｂのディジタル映像信号に対して所定
の変調処理を施すと共に、後述する他の信号と周波数多
重化して出力する。この送受信装置２から出力された多
重化信号は、ローパスフィルタ（ＬＰＦ）３を介し、さ
らに特性インピーダンスが７５ΩのＴＲＩＡＸケーブル
３０を介してカメラコントロールユニット側に送信され
る。
ット１からは撮影した映像信号として赤（Ｒ），緑
（Ｇ），青（Ｂ）の映像信号が出力され、当該映像信号
が当該カメラ側の送受信装置２に送られる。当該カメラ
側の送受信装置２では、上記カメラヘッドユニット１か
らの上記Ｒ，Ｇ，Ｂのディジタル映像信号に対して所定
の変調処理を施すと共に、後述する他の信号と周波数多
重化して出力する。この送受信装置２から出力された多
重化信号は、ローパスフィルタ（ＬＰＦ）３を介し、さ
らに特性インピーダンスが７５ΩのＴＲＩＡＸケーブル
３０を介してカメラコントロールユニット側に送信され
る。
【０００４】上記ＴＲＩＡＸケーブル３０を介してテレ
ビカメラ側の送受信装置２から伝送されてきた多重化信
号は、当該カメラコントロールユニット側のローパスフ
ィルタ（ＬＰＦ）２１を介して送受信装置２２に供給さ
れる。当該送受信装置２２では、上記多重化信号から上
記変調された映像信号とその他の信号とを分離すると共
に、上記変調された映像信号を復調して出力する。当該
送受信装置２２での復調により得られたＲ，Ｇ，Ｂの映
像信号は、カメラコントロールユニット２３に送られ、
さらに当該ユニット２３から外部（例えば編集室内の他
の装置等）に送られる。
ビカメラ側の送受信装置２から伝送されてきた多重化信
号は、当該カメラコントロールユニット側のローパスフ
ィルタ（ＬＰＦ）２１を介して送受信装置２２に供給さ
れる。当該送受信装置２２では、上記多重化信号から上
記変調された映像信号とその他の信号とを分離すると共
に、上記変調された映像信号を復調して出力する。当該
送受信装置２２での復調により得られたＲ，Ｇ，Ｂの映
像信号は、カメラコントロールユニット２３に送られ、
さらに当該ユニット２３から外部（例えば編集室内の他
の装置等）に送られる。
【０００５】また、この図３のシステムにおいては、カ
メラマンと編集室等との間で映像信号とは独立に、音声
信号による双方向の連絡も可能となっている。なお、こ
の双方向の音声による連絡用信号を、以下、ＩＮＣＯＭ
信号と呼ぶ。
メラマンと編集室等との間で映像信号とは独立に、音声
信号による双方向の連絡も可能となっている。なお、こ
の双方向の音声による連絡用信号を、以下、ＩＮＣＯＭ
信号と呼ぶ。
【０００６】すなわち、カメラヘッドユニット１には、
カメラマンが使用するヘッドホン及びマイクロホン４が
接続され、このマイクロホン４からの音声信号がテレビ
カメラ側のＩＮＣＯＭ信号として、当該カメラ側の送受
信装置２に送られる。このＩＮＣＯＭ信号は、送受信装
置２にて所定の変調処理を受け、前述同様に他の信号と
多重化された後、ローパスフィルタ３及びＴＲＩＡＸケ
ーブル１０を介し、さらにカメラコントロールユニット
側のローパスフィルタ２１を介して送受信装置２２に送
られる。当該送受信装置２２では、上記多重化信号より
上記カメラ側からのＩＮＣＯＭ信号を取り出すと共に復
調する。この復調されたＩＮＣＯＭ信号は、カメラコン
トロールユニット２３に送られる。このカメラコントロ
ールユニット２３にもヘッドホン及びマイクロホン２４
が接続されており、したがって、当該ヘッドホン２４の
使用者は、上記カメラ側からのＩＮＣＯＭ信号すなわち
音声を聞くことができるようことになる。
カメラマンが使用するヘッドホン及びマイクロホン４が
接続され、このマイクロホン４からの音声信号がテレビ
カメラ側のＩＮＣＯＭ信号として、当該カメラ側の送受
信装置２に送られる。このＩＮＣＯＭ信号は、送受信装
置２にて所定の変調処理を受け、前述同様に他の信号と
多重化された後、ローパスフィルタ３及びＴＲＩＡＸケ
ーブル１０を介し、さらにカメラコントロールユニット
側のローパスフィルタ２１を介して送受信装置２２に送
られる。当該送受信装置２２では、上記多重化信号より
上記カメラ側からのＩＮＣＯＭ信号を取り出すと共に復
調する。この復調されたＩＮＣＯＭ信号は、カメラコン
トロールユニット２３に送られる。このカメラコントロ
ールユニット２３にもヘッドホン及びマイクロホン２４
が接続されており、したがって、当該ヘッドホン２４の
使用者は、上記カメラ側からのＩＮＣＯＭ信号すなわち
音声を聞くことができるようことになる。
【０００７】一方、カメラコントロールユニット側の上
記ヘッドホン及びマイクロホン２４の使用者からの音声
は、マイクロホン２４を介してカメラコントロールユニ
ット２３に送られる。この音声信号がカメラコントロー
ルユニット側のＩＮＣＯＭ信号として、当該カメラコン
トロールユニット側の送受信装置２２に送られる。この
ＩＮＣＯＭ信号は、送受信装置２２にて所定の変調処理
を受け、前述同様に他の信号と多重化された後、ローパ
スフィルタ２１及びＴＲＩＡＸケーブル１０を介し、さ
らにカメラ側のローパスフィルタ３を介して送受信装置
２に送られる。当該送受信装置２では、上記多重化信号
より上記カメラコントロールユニット側からのＩＮＣＯ
Ｍ信号を取り出すと共に復調する。この復調されたＩＮ
ＣＯＭ信号は、カメラヘッド１に送られる。したがっ
て、カメラマンは上記カメラコントロールユニット側か
らのＩＮＣＯＭ信号すなわち音声を、前記ヘッドホン４
によって聞くことができることになる。
記ヘッドホン及びマイクロホン２４の使用者からの音声
は、マイクロホン２４を介してカメラコントロールユニ
ット２３に送られる。この音声信号がカメラコントロー
ルユニット側のＩＮＣＯＭ信号として、当該カメラコン
トロールユニット側の送受信装置２２に送られる。この
ＩＮＣＯＭ信号は、送受信装置２２にて所定の変調処理
を受け、前述同様に他の信号と多重化された後、ローパ
スフィルタ２１及びＴＲＩＡＸケーブル１０を介し、さ
らにカメラ側のローパスフィルタ３を介して送受信装置
２に送られる。当該送受信装置２では、上記多重化信号
より上記カメラコントロールユニット側からのＩＮＣＯ
Ｍ信号を取り出すと共に復調する。この復調されたＩＮ
ＣＯＭ信号は、カメラヘッド１に送られる。したがっ
て、カメラマンは上記カメラコントロールユニット側か
らのＩＮＣＯＭ信号すなわち音声を、前記ヘッドホン４
によって聞くことができることになる。
【０００８】さらに、この図３のシステムにおいては、
上記カメラヘッドユニット１のテレビカメラによって撮
影した映像信号が正常に送られているかを、カメラマン
が確認できるようにするために、上記外部に送られた映
像信号がリターン信号としてテレビカメラ側に送り返さ
れるようにもなっている。すなわち、カメラコントロー
ルユニット２３に外部から送り帰されてきたリターン信
号は、当該ユニット側の送受信装置２２にて変調された
後、他の信号と多重化され、前述同様の経路を通って、
カメラ側の送受信装置２に送られる。カメラ側の送受信
装置では上記多重化信号からリターン信号を取り出すと
共に復調し、この復調したリターン信号をカメラヘッド
ユニット１に送る。
上記カメラヘッドユニット１のテレビカメラによって撮
影した映像信号が正常に送られているかを、カメラマン
が確認できるようにするために、上記外部に送られた映
像信号がリターン信号としてテレビカメラ側に送り返さ
れるようにもなっている。すなわち、カメラコントロー
ルユニット２３に外部から送り帰されてきたリターン信
号は、当該ユニット側の送受信装置２２にて変調された
後、他の信号と多重化され、前述同様の経路を通って、
カメラ側の送受信装置２に送られる。カメラ側の送受信
装置では上記多重化信号からリターン信号を取り出すと
共に復調し、この復調したリターン信号をカメラヘッド
ユニット１に送る。
【０００９】なお、上述のシステムにおいては、上記映
像信号（リターン信号を含む）やＩＮＣＯＭ信号の他
に、カメラ制御等のための各種データ（ＤＡＴＡ）を
も、前述同様の経路を使用して、カメラ側とカメラコン
トロールユニット側との間で送受信可能となっている。
像信号（リターン信号を含む）やＩＮＣＯＭ信号の他
に、カメラ制御等のための各種データ（ＤＡＴＡ）を
も、前述同様の経路を使用して、カメラ側とカメラコン
トロールユニット側との間で送受信可能となっている。
【００１０】その他、上述のシステムにおいて、カメラ
側の電源は、カメラコントロールユニット側から上記Ｔ
ＲＩＡＸケーブル１０を介して送られるようになってい
る。すなわち、カメラコントロールユニット側の例えば
ＡＣ２４０Ｖの電源信号は、ローパスフィルタ２１を介
してＴＲＩＡＸケーブル１０に送られ、このＴＲＩＡＸ
ケーブル１０を通ってカメラ側に送られるようになって
いる。当該カメラ側では、上記ＴＲＩＡＸケーブル１０
を通って供給された電源信号を、ローパスフィルタ３に
て他の信号と分けて取り出すようになっている。
側の電源は、カメラコントロールユニット側から上記Ｔ
ＲＩＡＸケーブル１０を介して送られるようになってい
る。すなわち、カメラコントロールユニット側の例えば
ＡＣ２４０Ｖの電源信号は、ローパスフィルタ２１を介
してＴＲＩＡＸケーブル１０に送られ、このＴＲＩＡＸ
ケーブル１０を通ってカメラ側に送られるようになって
いる。当該カメラ側では、上記ＴＲＩＡＸケーブル１０
を通って供給された電源信号を、ローパスフィルタ３に
て他の信号と分けて取り出すようになっている。
【００１１】次に、上記システムにおいて、カメラ側の
送受信装置とカメラコントロールユニット側の送受信装
置の具体的構成は、図４に示すようになものとなってい
る。なお、この図４の例では、前記ＴＲＩＡＸケーブル
１５０に接続されるローパスフィルタ１１５，１３１を
それぞれ対応する送受信装置１００，１３０に含めてい
る。また、図４の例では、説明を簡略化するため、Ｒ，
Ｇ，Ｂのディジタル映像信号と前記リターン信号の経路
のみを示している。
送受信装置とカメラコントロールユニット側の送受信装
置の具体的構成は、図４に示すようになものとなってい
る。なお、この図４の例では、前記ＴＲＩＡＸケーブル
１５０に接続されるローパスフィルタ１１５，１３１を
それぞれ対応する送受信装置１００，１３０に含めてい
る。また、図４の例では、説明を簡略化するため、Ｒ，
Ｇ，Ｂのディジタル映像信号と前記リターン信号の経路
のみを示している。
【００１２】図４において、カメラ側の送受信装置１０
０には、前記カメラヘッドユニットからの前記Ｒ，Ｇ，
Ｂのディジタル映像信号が供給される。当該ディジタル
映像信号は、ディジタル変調回路１１０に送られ、ここ
で所定のディジタル変調が施される。この変調されたデ
ィジタル映像信号は、後述するＥＣＬ−ＣＭＯＳ変換回
路１１１を介してディジタル／アナログ（Ｄ／Ａ）変換
器１１２に送られ、このＤ／Ａ変換器１１２にてアナロ
グ映像信号に変換されることになる。
０には、前記カメラヘッドユニットからの前記Ｒ，Ｇ，
Ｂのディジタル映像信号が供給される。当該ディジタル
映像信号は、ディジタル変調回路１１０に送られ、ここ
で所定のディジタル変調が施される。この変調されたデ
ィジタル映像信号は、後述するＥＣＬ−ＣＭＯＳ変換回
路１１１を介してディジタル／アナログ（Ｄ／Ａ）変換
器１１２に送られ、このＤ／Ａ変換器１１２にてアナロ
グ映像信号に変換されることになる。
【００１３】上記Ｄ／Ａ変換器１１２から出力されたア
ナログ映像信号は、バッファアンプ１１３を介し、さら
に７５Ωの抵抗Ｒ100を介してマルチプレクサ（ＭＰ
Ｘ）１１４に送られる。当該マルチプレクサ１１４で
は、上記アナログ映像信号を他の信号と周波数多重化し
て出力する。このマルチプレクサ１１４から出力された
多重化信号は、ローパスフィルタ１１５を介し、さらに
特性インピーダンスが７５ΩのＴＲＩＡＸケーブル１５
０を介してカメラコントロールユニット側の送受信装置
１３０に送信される。
ナログ映像信号は、バッファアンプ１１３を介し、さら
に７５Ωの抵抗Ｒ100を介してマルチプレクサ（ＭＰ
Ｘ）１１４に送られる。当該マルチプレクサ１１４で
は、上記アナログ映像信号を他の信号と周波数多重化し
て出力する。このマルチプレクサ１１４から出力された
多重化信号は、ローパスフィルタ１１５を介し、さらに
特性インピーダンスが７５ΩのＴＲＩＡＸケーブル１５
０を介してカメラコントロールユニット側の送受信装置
１３０に送信される。
【００１４】上記ＴＲＩＡＸケーブル１５０を介してテ
レビカメラ側の送受信装置１００から伝送された多重化
信号は、カメラコントロールユニット側のローパスフィ
ルタ１３１を介して、送受信装置１３０のマルチプレク
サ（ＭＰＸ）１３２に供給される。当該マルチプレクサ
１３２は、上記多重化信号から上記アナログ映像信号を
取り出し、バッファアンプ１３３を介してＡＧＣ回路１
３４に送る。当該ＡＧＣ回路１３４で自動利得調整がな
されたアナログ映像信号は、さらにバッファアンプ１３
５を介してアナログ／ディジタル（Ａ／Ｄ）変換器１３
６に送られ、ここでディジタル映像に変換される。当該
ディジタル映像信号は、後述するＥＣＬ−ＣＭＯＳ変換
回路１３７を介してディジタル復調回路１３８に送られ
る。このディジタル復調回路１３８では、前記ディジタ
ル変調回路１１０での変調処理に対応するディジタル復
調処理を行う。このディジタル復調が施されて得られた
Ｒ，Ｇ，Ｂのディジタル映像信号は、その後、前記カメ
ラコントロールユニットに送られることになる。
レビカメラ側の送受信装置１００から伝送された多重化
信号は、カメラコントロールユニット側のローパスフィ
ルタ１３１を介して、送受信装置１３０のマルチプレク
サ（ＭＰＸ）１３２に供給される。当該マルチプレクサ
１３２は、上記多重化信号から上記アナログ映像信号を
取り出し、バッファアンプ１３３を介してＡＧＣ回路１
３４に送る。当該ＡＧＣ回路１３４で自動利得調整がな
されたアナログ映像信号は、さらにバッファアンプ１３
５を介してアナログ／ディジタル（Ａ／Ｄ）変換器１３
６に送られ、ここでディジタル映像に変換される。当該
ディジタル映像信号は、後述するＥＣＬ−ＣＭＯＳ変換
回路１３７を介してディジタル復調回路１３８に送られ
る。このディジタル復調回路１３８では、前記ディジタ
ル変調回路１１０での変調処理に対応するディジタル復
調処理を行う。このディジタル復調が施されて得られた
Ｒ，Ｇ，Ｂのディジタル映像信号は、その後、前記カメ
ラコントロールユニットに送られることになる。
【００１５】一方、当該カメラコントロールユニット側
からテレビカメラ側に送られることになる前記リターン
信号は、当該カメラコントロールユニット側の送受信装
置１３０のディジタル変調回路１３９に送られ、ここで
所定のディジタル変調が施される。この変調されたリタ
ーン信号は、後述するＥＣＬ−ＣＭＯＳ変換回路１４０
を介してディジタル／アナログ（Ｄ／Ａ）変換器１４１
に送られ、このＤ／Ａ変換器１４１にてアナログ信号に
変換されることになる。
からテレビカメラ側に送られることになる前記リターン
信号は、当該カメラコントロールユニット側の送受信装
置１３０のディジタル変調回路１３９に送られ、ここで
所定のディジタル変調が施される。この変調されたリタ
ーン信号は、後述するＥＣＬ−ＣＭＯＳ変換回路１４０
を介してディジタル／アナログ（Ｄ／Ａ）変換器１４１
に送られ、このＤ／Ａ変換器１４１にてアナログ信号に
変換されることになる。
【００１６】上記Ｄ／Ａ変換器１４１から出力されたア
ナログのリターン信号は、バッファアンプ１４２を介
し、さらに７５Ωの抵抗Ｒ130を介してマルチプレクサ
１３２に送られる。当該マルチプレクサ１３２では、上
記リターン信号を他の信号と周波数多重化して出力す
る。このマルチプレクサ１３２から出力された多重化信
号は、ローパスフィルタ１３１を介し、さらにＴＲＩＡ
Ｘケーブル１５０を介してカメラ側の送受信装置１００
に送信される。
ナログのリターン信号は、バッファアンプ１４２を介
し、さらに７５Ωの抵抗Ｒ130を介してマルチプレクサ
１３２に送られる。当該マルチプレクサ１３２では、上
記リターン信号を他の信号と周波数多重化して出力す
る。このマルチプレクサ１３２から出力された多重化信
号は、ローパスフィルタ１３１を介し、さらにＴＲＩＡ
Ｘケーブル１５０を介してカメラ側の送受信装置１００
に送信される。
【００１７】上記ＴＲＩＡＸケーブル１５０を介してカ
メラコントロールユニット側の送受信装置１３０から伝
送された多重化信号は、当該カメラ側のローパスフィル
タ１１５を介して、送受信装置のマルチプレクサ１１４
に供給される。当該マルチプレクサ１１４では、上記多
重化信号から上記アナログのリターン信号を取り出し、
バッファアンプ１１６を介してＡＧＣ回路１１７に送
る。当該ＡＧＣ回路１１７で自動利得調整がなされたリ
ターン信号は、さらにバッファアンプ１１８を介してア
ナログ／ディジタル（Ａ／Ｄ）変換器１１９に送られ、
ここでディジタル映像に変換される。当該ディジタル映
像信号は、後述するＥＣＬ−ＣＭＯＳ変換回路１２０を
介してディジタル復調回路１２１に送られる。このディ
ジタル復調回路１２１では、前記ディジタル変調回路１
３９での変調処理に対応するディジタル復調処理を行
う。このディジタル復調が施されて得られたＲ，Ｇ，Ｂ
のディジタル映像信号は、その後、前記カメラヘッドユ
ニットに送られることになる。
メラコントロールユニット側の送受信装置１３０から伝
送された多重化信号は、当該カメラ側のローパスフィル
タ１１５を介して、送受信装置のマルチプレクサ１１４
に供給される。当該マルチプレクサ１１４では、上記多
重化信号から上記アナログのリターン信号を取り出し、
バッファアンプ１１６を介してＡＧＣ回路１１７に送
る。当該ＡＧＣ回路１１７で自動利得調整がなされたリ
ターン信号は、さらにバッファアンプ１１８を介してア
ナログ／ディジタル（Ａ／Ｄ）変換器１１９に送られ、
ここでディジタル映像に変換される。当該ディジタル映
像信号は、後述するＥＣＬ−ＣＭＯＳ変換回路１２０を
介してディジタル復調回路１２１に送られる。このディ
ジタル復調回路１２１では、前記ディジタル変調回路１
３９での変調処理に対応するディジタル復調処理を行
う。このディジタル復調が施されて得られたＲ，Ｇ，Ｂ
のディジタル映像信号は、その後、前記カメラヘッドユ
ニットに送られることになる。
【００１８】
【発明が解決しようとする課題】ところで、上記ディジ
タル変調回路１１０，１３９やディジタル復調回路１２
１，１３８は、それぞれＣＭＯＳ（Complementary Meta
l Oxide Semiconductor）ロジック回路にて構成されて
いる。また、上記Ｄ／Ａ変換器１１２，１４１やＡ／Ｄ
変換器１１９，１３６は、それぞれＥＣＬ（Emitter Co
upled Logic）回路にて構成されている。すなわち、デ
ィジタル変調回路１１０，１３９やディジタル復調回路
１２１，１３８は、比較的低周波数動作でもよく、また
低消費電力化のために、上記ＣＭＯＳロジック回路を使
用し、上記Ｄ／Ａ変換器１１２，１４１やＡ／Ｄ変換器
１１９，１３６は、高速動作を必要とするために上記Ｅ
ＣＬ回路が使用されている。
タル変調回路１１０，１３９やディジタル復調回路１２
１，１３８は、それぞれＣＭＯＳ（Complementary Meta
l Oxide Semiconductor）ロジック回路にて構成されて
いる。また、上記Ｄ／Ａ変換器１１２，１４１やＡ／Ｄ
変換器１１９，１３６は、それぞれＥＣＬ（Emitter Co
upled Logic）回路にて構成されている。すなわち、デ
ィジタル変調回路１１０，１３９やディジタル復調回路
１２１，１３８は、比較的低周波数動作でもよく、また
低消費電力化のために、上記ＣＭＯＳロジック回路を使
用し、上記Ｄ／Ａ変換器１１２，１４１やＡ／Ｄ変換器
１１９，１３６は、高速動作を必要とするために上記Ｅ
ＣＬ回路が使用されている。
【００１９】このため、上記送受信装置１００，１３０
には、ＣＭＯＳロジック回路とＥＣＬ回路との間に、オ
フセット電圧と信号振幅を合わせるためのＥＣＬ−ＣＭ
ＯＳ変換回路１１１，１２０，１３７，１４０が設けら
れている。なお、実際には、ＥＣＬ−ＣＭＯＳ変換用の
ＩＣ（大規模集積回路）の代わりに、ＥＣＬ−ＴＴＬ
（Transistor Transistor Logic）変換用ＩＣが用いら
れている。このＥＣＬ−ＴＴＬ変換用ＩＣとしては、例
えば富士通株式会社製のＭＢ１０ＨＬ１２４（ＴＴＬ→
ＥＣＬ）やＭＢ１０ＨＬ１２５（ＥＣＬ→ＴＴＬ）が使
用されている。
には、ＣＭＯＳロジック回路とＥＣＬ回路との間に、オ
フセット電圧と信号振幅を合わせるためのＥＣＬ−ＣＭ
ＯＳ変換回路１１１，１２０，１３７，１４０が設けら
れている。なお、実際には、ＥＣＬ−ＣＭＯＳ変換用の
ＩＣ（大規模集積回路）の代わりに、ＥＣＬ−ＴＴＬ
（Transistor Transistor Logic）変換用ＩＣが用いら
れている。このＥＣＬ−ＴＴＬ変換用ＩＣとしては、例
えば富士通株式会社製のＭＢ１０ＨＬ１２４（ＴＴＬ→
ＥＣＬ）やＭＢ１０ＨＬ１２５（ＥＣＬ→ＴＴＬ）が使
用されている。
【００２０】このようなＣＭＯＳロジック回路及びＥＣ
Ｌ回路とこれらの間の変換用ＩＣ、さらにアナログ回路
をも含む図４の送受信装置１００，１３０における各部
の電源電圧，各部の入出力信号の振幅及び波形の関係
は、図５に示すようになっている。
Ｌ回路とこれらの間の変換用ＩＣ、さらにアナログ回路
をも含む図４の送受信装置１００，１３０における各部
の電源電圧，各部の入出力信号の振幅及び波形の関係
は、図５に示すようになっている。
【００２１】すなわち、図４のカメラ側の送受信装置１
００において、図４のＡ100の範囲のディジタル変調回
路１１０やディジタル復調回路１２１はＣＭＯＳロジッ
ク回路であり、当該ＣＭＯＳロジック回路では、図５の
Ａ100に示すように電源電圧が＋３．３Ｖ（ボルト）、
内部の信号振幅及び出力信号振幅が略々３．３ＶP-Pと
なっている。また、図４のＡ102の範囲のＤ／Ａ変換器
１１２及びＡ／Ｄ変換器１１９はＥＣＬ回路であり、当
該ＥＣＬ回路では、図５のＡ102に示すように電源電圧
が−５Ｖ、入力信号振幅がハイレベル（以下Ｈとする）
＝−０．８Ｖでローレベル（以下Ｌとする）＝−１．６
Ｖの略々０．８ＶP-Pとなっている。したがって、ＣＭ
ＯＳロジック回路とＥＣＬ回路との間のオフセット電圧
と信号振幅を合わせるためのＥＣＬ−ＣＭＯＳ変換回路
１１１，１２０は、図５のＡ101に示すように電源電圧
が＋５Ｖ，−５．２Ｖの２電源で、入力信号振幅はＬ＝
０Ｖ，Ｈ＝＋３．３Ｖの略々３．３ＶP-Pとなり、出力
信号振幅はＨ＝−０．８Ｖ，Ｌ＝−１．６Ｖの略々０．
８ＶP-Pとなっている。なお、図４中のＡ103で示す範囲
のアナログ系では、図５中のＡ103に示すように電源電
圧が＋５Ｖ，−５．２Ｖとなっている。
００において、図４のＡ100の範囲のディジタル変調回
路１１０やディジタル復調回路１２１はＣＭＯＳロジッ
ク回路であり、当該ＣＭＯＳロジック回路では、図５の
Ａ100に示すように電源電圧が＋３．３Ｖ（ボルト）、
内部の信号振幅及び出力信号振幅が略々３．３ＶP-Pと
なっている。また、図４のＡ102の範囲のＤ／Ａ変換器
１１２及びＡ／Ｄ変換器１１９はＥＣＬ回路であり、当
該ＥＣＬ回路では、図５のＡ102に示すように電源電圧
が−５Ｖ、入力信号振幅がハイレベル（以下Ｈとする）
＝−０．８Ｖでローレベル（以下Ｌとする）＝−１．６
Ｖの略々０．８ＶP-Pとなっている。したがって、ＣＭ
ＯＳロジック回路とＥＣＬ回路との間のオフセット電圧
と信号振幅を合わせるためのＥＣＬ−ＣＭＯＳ変換回路
１１１，１２０は、図５のＡ101に示すように電源電圧
が＋５Ｖ，−５．２Ｖの２電源で、入力信号振幅はＬ＝
０Ｖ，Ｈ＝＋３．３Ｖの略々３．３ＶP-Pとなり、出力
信号振幅はＨ＝−０．８Ｖ，Ｌ＝−１．６Ｖの略々０．
８ＶP-Pとなっている。なお、図４中のＡ103で示す範囲
のアナログ系では、図５中のＡ103に示すように電源電
圧が＋５Ｖ，−５．２Ｖとなっている。
【００２２】同じく、図４のカメラコントロールユニッ
ト側の送受信装置１３０において、図４のＡ133の範囲
のディジタル変調回路１３８やディジタル復調回路１３
９はＣＭＯＳロジック回路であり、図５のＡ133に示す
ように電源電圧が＋３．３Ｖ、内部の信号振幅及び出力
信号振幅が略々３．３ＶP-Pとなっている。また、図４
のＡ131の範囲のＡ／Ｄ変換器１３６及びＤ／Ａ変換器
１４１はＥＣＬ回路であり、図５のＡ131に示すように
電源電圧が−５Ｖ、入力信号振幅がＨ＝−０．８Ｖ，Ｌ
＝−１．６Ｖの略々０．８ＶP-Pとなっている。さら
に、ＥＣＬ−ＣＭＯＳ変換回路１３７，１４０は、図５
のＡ132に示すように電源電圧が＋５Ｖ，−５．２Ｖの
２電源で、入力信号振幅はＬ＝０Ｖ，Ｈ＝＋３．３Ｖの
略々３．３ＶP-Pとなり、出力信号振幅はＨ＝−０．８
Ｖ，Ｌ＝−１．６Ｖの略々０．８ＶP-Pとなっている。
図４中のＡ130で示す範囲のアナログ系も同様に、図５
中のＡ130に示すように電源電圧が＋５Ｖ，−５．２Ｖ
となっている。
ト側の送受信装置１３０において、図４のＡ133の範囲
のディジタル変調回路１３８やディジタル復調回路１３
９はＣＭＯＳロジック回路であり、図５のＡ133に示す
ように電源電圧が＋３．３Ｖ、内部の信号振幅及び出力
信号振幅が略々３．３ＶP-Pとなっている。また、図４
のＡ131の範囲のＡ／Ｄ変換器１３６及びＤ／Ａ変換器
１４１はＥＣＬ回路であり、図５のＡ131に示すように
電源電圧が−５Ｖ、入力信号振幅がＨ＝−０．８Ｖ，Ｌ
＝−１．６Ｖの略々０．８ＶP-Pとなっている。さら
に、ＥＣＬ−ＣＭＯＳ変換回路１３７，１４０は、図５
のＡ132に示すように電源電圧が＋５Ｖ，−５．２Ｖの
２電源で、入力信号振幅はＬ＝０Ｖ，Ｈ＝＋３．３Ｖの
略々３．３ＶP-Pとなり、出力信号振幅はＨ＝−０．８
Ｖ，Ｌ＝−１．６Ｖの略々０．８ＶP-Pとなっている。
図４中のＡ130で示す範囲のアナログ系も同様に、図５
中のＡ130に示すように電源電圧が＋５Ｖ，−５．２Ｖ
となっている。
【００２３】上述したようなことから、ＥＣＬ−ＴＴＬ
（ＥＣＬ−ＣＭＯＳ）変換用ＩＣを使用する場合の問題
点としては、以下のようなことが挙げられる。
（ＥＣＬ−ＣＭＯＳ）変換用ＩＣを使用する場合の問題
点としては、以下のようなことが挙げられる。
【００２４】すなわち、上記ＥＣＬ−ＣＭＯＳ（ＴＴ
Ｌ）変換用ＩＣは、ＥＣＬ回路の高速、且つＣＭＯＳレ
ベルの大振幅で動作させるため、大電流を必要とし、消
費電力が大きくなってしまう。また、当該変換用ＩＣ
は、外形が大きく、入出力配線の面積も大きくなってい
る。このような問題点は、信号ライン数が増加するほ
ど、顕著になっている。
Ｌ）変換用ＩＣは、ＥＣＬ回路の高速、且つＣＭＯＳレ
ベルの大振幅で動作させるため、大電流を必要とし、消
費電力が大きくなってしまう。また、当該変換用ＩＣ
は、外形が大きく、入出力配線の面積も大きくなってい
る。このような問題点は、信号ライン数が増加するほ
ど、顕著になっている。
【００２５】そこで、本発明はこの様な実情に鑑みてな
されたものであり、低消費電力化が可能で、基板占有面
積も小さくできる信号処理装置を提供することを目的と
する。
されたものであり、低消費電力化が可能で、基板占有面
積も小さくできる信号処理装置を提供することを目的と
する。
【００２６】
【課題を解決するための手段】本発明の信号処理装置
は、相補形ＭＯＳロジック回路と、エミッタ接合ロジッ
ク回路とを有し、上記エミッタ結合ロジック回路は上記
相補形ＭＯＳロジック回路の信号とセンタレベルを揃え
るような正負の２電源で動作し、上記相補形ＭＯＳロジ
ック回路は上記エミッタ接合ロジック回路の信号と揃っ
た信号振幅で動作し、上記エミッタ接合ロジック回路と
上記相補形ＭＯＳロジック回路を直接接続することによ
り、上述した課題を解決する。
は、相補形ＭＯＳロジック回路と、エミッタ接合ロジッ
ク回路とを有し、上記エミッタ結合ロジック回路は上記
相補形ＭＯＳロジック回路の信号とセンタレベルを揃え
るような正負の２電源で動作し、上記相補形ＭＯＳロジ
ック回路は上記エミッタ接合ロジック回路の信号と揃っ
た信号振幅で動作し、上記エミッタ接合ロジック回路と
上記相補形ＭＯＳロジック回路を直接接続することによ
り、上述した課題を解決する。
【００２７】すなわち、本発明によれば、相補形ＭＯＳ
（ＣＭＯＳ）ロジック回路とエミッタ接合ロジック（Ｅ
ＣＬ）回路とを、ＥＣＬ−ＣＭＯＳ変換回路を介さずに
直接接続できるようにしたことにより、高周波信号が通
るラインを単純化して基板占有面積を少なくし、消費電
力も低くしている。
（ＣＭＯＳ）ロジック回路とエミッタ接合ロジック（Ｅ
ＣＬ）回路とを、ＥＣＬ−ＣＭＯＳ変換回路を介さずに
直接接続できるようにしたことにより、高周波信号が通
るラインを単純化して基板占有面積を少なくし、消費電
力も低くしている。
【００２８】
【発明の実施の形態】以下、本発明の好ましい実施の形
態について、図面を参照にしながら説明する。
態について、図面を参照にしながら説明する。
【００２９】図１には、本発明の信号処理装置の一例と
して、前記図３に示すようなシステムに適用される送受
信装置の構成を示す。なお、この図１の例では、ＴＲＩ
ＡＸケーブル９０に接続されるローパスフィルタ５５，
７１をそれぞれ対応する送受信装置５０，７０に含めて
いる。また、図１の例では、説明を簡略化するため、
Ｒ，Ｇ，Ｂのディジタル映像信号と前記リターン信号の
経路のみを示している。
して、前記図３に示すようなシステムに適用される送受
信装置の構成を示す。なお、この図１の例では、ＴＲＩ
ＡＸケーブル９０に接続されるローパスフィルタ５５，
７１をそれぞれ対応する送受信装置５０，７０に含めて
いる。また、図１の例では、説明を簡略化するため、
Ｒ，Ｇ，Ｂのディジタル映像信号と前記リターン信号の
経路のみを示している。
【００３０】図１において、カメラ側の送受信装置５０
には、前記カメラヘッドユニットからの前記Ｒ，Ｇ，Ｂ
のディジタル映像信号が供給される。当該ディジタル映
像信号は、ディジタル変調回路５１に送られ、ここでい
わゆる６４ＱＡＭ（quadrature amplitude modulatio
n：直交振幅変調）による変調が施される。この変調さ
れたディジタル映像信号は、Ｄ／Ａ変換器５２に送ら
れ、このＤ／Ａ変換器５２にてアナログ映像信号に変換
される。
には、前記カメラヘッドユニットからの前記Ｒ，Ｇ，Ｂ
のディジタル映像信号が供給される。当該ディジタル映
像信号は、ディジタル変調回路５１に送られ、ここでい
わゆる６４ＱＡＭ（quadrature amplitude modulatio
n：直交振幅変調）による変調が施される。この変調さ
れたディジタル映像信号は、Ｄ／Ａ変換器５２に送ら
れ、このＤ／Ａ変換器５２にてアナログ映像信号に変換
される。
【００３１】上記Ｄ／Ａ変換器５２から出力されたアナ
ログ映像信号は、バッファアンプ５３を介し、さらに７
５Ωの抵抗Ｒ50を介してマルチプレクサ５４に送られ
る。当該マルチプレクサ５４では、上記アナログ映像信
号を他の信号と周波数多重化して出力する。このマルチ
プレクサ５４から出力された多重化信号は、ローパスフ
ィルタ５５を介し、さらに特性インピーダンスが７５Ω
のＴＲＩＡＸケーブル９０を介してカメラコントロール
ユニット側の送受信装置７０に送信される。
ログ映像信号は、バッファアンプ５３を介し、さらに７
５Ωの抵抗Ｒ50を介してマルチプレクサ５４に送られ
る。当該マルチプレクサ５４では、上記アナログ映像信
号を他の信号と周波数多重化して出力する。このマルチ
プレクサ５４から出力された多重化信号は、ローパスフ
ィルタ５５を介し、さらに特性インピーダンスが７５Ω
のＴＲＩＡＸケーブル９０を介してカメラコントロール
ユニット側の送受信装置７０に送信される。
【００３２】上記ＴＲＩＡＸケーブル９０を介してテレ
ビカメラ側の送受信装置５０から伝送された多重化信号
は、カメラコントロールユニット側のローパスフィルタ
７１を介して、送受信装置７０のマルチプレクサ７１に
供給される。当該マルチプレクサ７１は、上記多重化信
号から上記アナログ映像信号を取り出し、バッファアン
プ７３を介してＡＧＣ回路７４に送る。当該ＡＧＣ回路
７４で自動利得調整がなされたアナログ映像信号は、さ
らにバッファアンプ７５を介してＡ／Ｄ変換器７６に送
られ、ここでディジタル映像に変換される。当該ディジ
タル映像信号は、ディジタル復調回路７７に送られる。
このディジタル復調回路７７では、前記ディジタル変調
回路５１での６４ＱＭＦの変調処理に対応するディジタ
ル復調処理を行う。このディジタル復調が施されて得ら
れたＲ，Ｇ，Ｂのディジタル映像信号は、その後、前記
カメラコントロールユニット２３に送られることにな
る。
ビカメラ側の送受信装置５０から伝送された多重化信号
は、カメラコントロールユニット側のローパスフィルタ
７１を介して、送受信装置７０のマルチプレクサ７１に
供給される。当該マルチプレクサ７１は、上記多重化信
号から上記アナログ映像信号を取り出し、バッファアン
プ７３を介してＡＧＣ回路７４に送る。当該ＡＧＣ回路
７４で自動利得調整がなされたアナログ映像信号は、さ
らにバッファアンプ７５を介してＡ／Ｄ変換器７６に送
られ、ここでディジタル映像に変換される。当該ディジ
タル映像信号は、ディジタル復調回路７７に送られる。
このディジタル復調回路７７では、前記ディジタル変調
回路５１での６４ＱＭＦの変調処理に対応するディジタ
ル復調処理を行う。このディジタル復調が施されて得ら
れたＲ，Ｇ，Ｂのディジタル映像信号は、その後、前記
カメラコントロールユニット２３に送られることにな
る。
【００３３】一方、当該カメラコントロールユニット２
３からテレビカメラ側に送られることになる前記リター
ン信号は、当該カメラコントロールユニット側の送受信
装置７０のディジタル変調回路７８に送られ、ここで前
記６４ＱＭＦのディジタル変調が施される。この変調さ
れたリターン信号は、Ｄ／Ａ変換器７９に送られ、この
Ｄ／Ａ変換器７９にてアナログ信号に変換されることに
なる。
３からテレビカメラ側に送られることになる前記リター
ン信号は、当該カメラコントロールユニット側の送受信
装置７０のディジタル変調回路７８に送られ、ここで前
記６４ＱＭＦのディジタル変調が施される。この変調さ
れたリターン信号は、Ｄ／Ａ変換器７９に送られ、この
Ｄ／Ａ変換器７９にてアナログ信号に変換されることに
なる。
【００３４】上記Ｄ／Ａ変換器７９から出力されたアナ
ログのリターン信号は、バッファアンプ８０を介し、さ
らに７５Ωの抵抗Ｒ70を介してマルチプレクサ７２に送
られる。当該マルチプレクサ７２では、上記リターン信
号を他の信号と周波数多重化して出力する。このマルチ
プレクサ７２から出力された多重化信号は、ローパスフ
ィルタ７１を介し、さらにＴＲＩＡＸケーブル９０を介
してカメラ側の送受信装置５０に送信される。
ログのリターン信号は、バッファアンプ８０を介し、さ
らに７５Ωの抵抗Ｒ70を介してマルチプレクサ７２に送
られる。当該マルチプレクサ７２では、上記リターン信
号を他の信号と周波数多重化して出力する。このマルチ
プレクサ７２から出力された多重化信号は、ローパスフ
ィルタ７１を介し、さらにＴＲＩＡＸケーブル９０を介
してカメラ側の送受信装置５０に送信される。
【００３５】上記ＴＲＩＡＸケーブル９０を介してカメ
ラコントロールユニット側の送受信装置７０から伝送さ
れた多重化信号は、当該カメラ側のローパスフィルタ５
５を介して、送受信装置のマルチプレクサ５４に供給さ
れる。当該マルチプレクサ５４では、上記多重化信号か
ら上記アナログのリターン信号を取り出し、バッファア
ンプ５６を介してＡＧＣ回路５７に送る。当該ＡＧＣ回
路５７で自動利得調整がなされたリターン信号は、さら
にバッファアンプ５８を介してＡ／Ｄ変換器５９に送ら
れ、ここでディジタル映像に変換される。当該ディジタ
ル映像信号は、ディジタル復調回路６０に送られる。こ
のディジタル復調回路６０では、前記ディジタル変調回
路７８での６４ＱＭＦの変調処理に対応するディジタル
復調処理を行う。このディジタル復調が施されて得られ
たＲ，Ｇ，Ｂのディジタル映像信号は、その後、前記カ
メラヘッドユニット１に送られることになる。
ラコントロールユニット側の送受信装置７０から伝送さ
れた多重化信号は、当該カメラ側のローパスフィルタ５
５を介して、送受信装置のマルチプレクサ５４に供給さ
れる。当該マルチプレクサ５４では、上記多重化信号か
ら上記アナログのリターン信号を取り出し、バッファア
ンプ５６を介してＡＧＣ回路５７に送る。当該ＡＧＣ回
路５７で自動利得調整がなされたリターン信号は、さら
にバッファアンプ５８を介してＡ／Ｄ変換器５９に送ら
れ、ここでディジタル映像に変換される。当該ディジタ
ル映像信号は、ディジタル復調回路６０に送られる。こ
のディジタル復調回路６０では、前記ディジタル変調回
路７８での６４ＱＭＦの変調処理に対応するディジタル
復調処理を行う。このディジタル復調が施されて得られ
たＲ，Ｇ，Ｂのディジタル映像信号は、その後、前記カ
メラヘッドユニット１に送られることになる。
【００３６】ここで、上記ディジタル変調回路５１，７
８やディジタル復調回路６０，７７は、それぞれＣＭＯ
Ｓロジック回路にて構成されている。また、上記Ｄ／Ａ
変換器５２，７９やＡ／Ｄ変換器５９，７６は、それぞ
れＥＣＬ回路にて構成されている。すなわち、ディジタ
ル変調回路５１，７８やディジタル復調回路６０，７７
は、比較的低周波数動作でもよく、また低消費電力化の
ために、上記ＣＭＯＳロジック回路を使用し、上記Ｄ／
Ａ変換器５２，７９やＡ／Ｄ変換器５９，７６は、高速
動作を必要とするために上記ＥＣＬ回路が使用されてい
る。
８やディジタル復調回路６０，７７は、それぞれＣＭＯ
Ｓロジック回路にて構成されている。また、上記Ｄ／Ａ
変換器５２，７９やＡ／Ｄ変換器５９，７６は、それぞ
れＥＣＬ回路にて構成されている。すなわち、ディジタ
ル変調回路５１，７８やディジタル復調回路６０，７７
は、比較的低周波数動作でもよく、また低消費電力化の
ために、上記ＣＭＯＳロジック回路を使用し、上記Ｄ／
Ａ変換器５２，７９やＡ／Ｄ変換器５９，７６は、高速
動作を必要とするために上記ＥＣＬ回路が使用されてい
る。
【００３７】ただし、本発明にかかる図１の送受信装置
５０，７０においては、上記ディジタル変調回路５１，
７８やディジタル復調回路６０，７７に使用するＣＭＯ
Ｓロジック回路、上記Ｄ／Ａ変換器５２，７９やＡ／Ｄ
変換器５９，７６に使用するＥＣＬ回路、さらに他のア
ナログ回路等の、各部の電源電圧，各部の入出力信号の
振幅及び波形の関係は、図２に示すようになっている。
５０，７０においては、上記ディジタル変調回路５１，
７８やディジタル復調回路６０，７７に使用するＣＭＯ
Ｓロジック回路、上記Ｄ／Ａ変換器５２，７９やＡ／Ｄ
変換器５９，７６に使用するＥＣＬ回路、さらに他のア
ナログ回路等の、各部の電源電圧，各部の入出力信号の
振幅及び波形の関係は、図２に示すようになっている。
【００３８】すなわち、図１のカメラ側の送受信装置５
０において、図１のＡ50の範囲のディジタル変調回路５
１やディジタル復調回路６０に使用されるＣＭＯＳロジ
ック回路は、図２のＡ50に示すように電源電圧が＋３．
３Ｖ（ボルト）、内部の信号振幅は略々３．３ＶP-Pと
なっているが、出力若しくは入力信号振幅（ディジタル
変調回路５１の場合には出力信号振幅、ディジタル復調
回路６０の場合は入力信号振幅）がＧＴＬ（Gunning Tr
anceiver Logic）モード（Ｈ＝＋１．６Ｖ、Ｌ＝＋０．
８Ｖ）となっている。また、図１のＡ51の範囲のＤ／Ａ
変換器５２及びＡ／Ｄ変換器５９に使用されるＥＣＬ回
路は、図２のＡ51に示すように電源電圧が＋２Ｖ，−
３．３Ｖの２電源であり、入出力信号振幅はＨ＝＋１．
６Ｖ，Ｌ＝＋０．８Ｖとなっている。なお、図１中のＡ
52で示す範囲のアナログ系では、図２中のＡ52に示すよ
うに電源電圧が＋５．２Ｖ，−５．２Ｖとなっている。
０において、図１のＡ50の範囲のディジタル変調回路５
１やディジタル復調回路６０に使用されるＣＭＯＳロジ
ック回路は、図２のＡ50に示すように電源電圧が＋３．
３Ｖ（ボルト）、内部の信号振幅は略々３．３ＶP-Pと
なっているが、出力若しくは入力信号振幅（ディジタル
変調回路５１の場合には出力信号振幅、ディジタル復調
回路６０の場合は入力信号振幅）がＧＴＬ（Gunning Tr
anceiver Logic）モード（Ｈ＝＋１．６Ｖ、Ｌ＝＋０．
８Ｖ）となっている。また、図１のＡ51の範囲のＤ／Ａ
変換器５２及びＡ／Ｄ変換器５９に使用されるＥＣＬ回
路は、図２のＡ51に示すように電源電圧が＋２Ｖ，−
３．３Ｖの２電源であり、入出力信号振幅はＨ＝＋１．
６Ｖ，Ｌ＝＋０．８Ｖとなっている。なお、図１中のＡ
52で示す範囲のアナログ系では、図２中のＡ52に示すよ
うに電源電圧が＋５．２Ｖ，−５．２Ｖとなっている。
【００３９】同じく、図１のカメラコントロールユニッ
ト側の送受信装置７０において、図１のＡ72の範囲のデ
ィジタル変調回路７７やディジタル復調回路７８に使用
されるＣＭＯＳロジック回路も、図２のＡ72に示すよう
に電源電圧が＋３．３Ｖ、内部の信号振幅は略々３．３
ＶP-P、出力若しくは入力信号振幅（ディジタル変調回
路７７の場合には出力信号振幅、ディジタル復調回路７
８の場合は入力信号振幅）がＧＴＬモード（Ｈ＝＋１．
６Ｖ、Ｌ＝＋０．８Ｖ）となっている。また、図１のＡ
71の範囲のＡ／Ｄ変換器７６及びＤ／Ａ変換器７９に使
用されるＥＣＬ回路も、図２のＡ71に示すように電源電
圧が＋２Ｖ，−３．３Ｖの２電源であり、入出力信号振
幅はＨ＝＋１．６Ｖ，Ｌ＝＋０．８Ｖとなっている。な
お、図１中のＡ70で示す範囲のアナログ系でも、図２中
のＡ70に示すように電源電圧が＋５．２Ｖ，−５．２Ｖ
となっている。
ト側の送受信装置７０において、図１のＡ72の範囲のデ
ィジタル変調回路７７やディジタル復調回路７８に使用
されるＣＭＯＳロジック回路も、図２のＡ72に示すよう
に電源電圧が＋３．３Ｖ、内部の信号振幅は略々３．３
ＶP-P、出力若しくは入力信号振幅（ディジタル変調回
路７７の場合には出力信号振幅、ディジタル復調回路７
８の場合は入力信号振幅）がＧＴＬモード（Ｈ＝＋１．
６Ｖ、Ｌ＝＋０．８Ｖ）となっている。また、図１のＡ
71の範囲のＡ／Ｄ変換器７６及びＤ／Ａ変換器７９に使
用されるＥＣＬ回路も、図２のＡ71に示すように電源電
圧が＋２Ｖ，−３．３Ｖの２電源であり、入出力信号振
幅はＨ＝＋１．６Ｖ，Ｌ＝＋０．８Ｖとなっている。な
お、図１中のＡ70で示す範囲のアナログ系でも、図２中
のＡ70に示すように電源電圧が＋５．２Ｖ，−５．２Ｖ
となっている。
【００４０】上述のように、本発明の構成例において
は、ＥＣＬ回路部分の電源電圧が＋２Ｖ，−３．３Ｖと
なっており、また、このＥＣＬ回路の入出力信号振幅も
上記ＣＭＯＳロジック回路と同様にＨ＝＋１．６Ｖ，Ｌ
＝＋０．８Ｖとなっており、したがってＣＭＯＳロジッ
ク回路とＥＣＬ回路との間には前述した従来例のような
ＥＣＬ−ＣＭＯＳ変換回路が必要なく、直接接続できる
ようになっている。
は、ＥＣＬ回路部分の電源電圧が＋２Ｖ，−３．３Ｖと
なっており、また、このＥＣＬ回路の入出力信号振幅も
上記ＣＭＯＳロジック回路と同様にＨ＝＋１．６Ｖ，Ｌ
＝＋０．８Ｖとなっており、したがってＣＭＯＳロジッ
ク回路とＥＣＬ回路との間には前述した従来例のような
ＥＣＬ−ＣＭＯＳ変換回路が必要なく、直接接続できる
ようになっている。
【００４１】さらに、ＥＣＬ回路の電源電圧は＋５Ｖか
らスイッチングレギュレータによって作るようにしてい
る。すなわち、このようにすることは、効率が良く、さ
らに、入力が単一電源のため、＋２Ｖ，−３．３Ｖの電
圧が同時に入り、また同時に切れることになるのでＥＣ
Ｌ回路が壊れ難いことになる。
らスイッチングレギュレータによって作るようにしてい
る。すなわち、このようにすることは、効率が良く、さ
らに、入力が単一電源のため、＋２Ｖ，−３．３Ｖの電
圧が同時に入り、また同時に切れることになるのでＥＣ
Ｌ回路が壊れ難いことになる。
【００４２】上述したように、本発明の図１の構成例に
よれば、ＣＭＯＳロジック回路とＥＣＬ回路との間に、
ＥＣＬ−ＣＭＯＳ変換回路を必要とせずに、直接接続で
きるようになったことにより、高周波信号が通るライン
が単純化され、最短最小ラインで接続する理想状態に、
より近づけることが可能となっている。
よれば、ＣＭＯＳロジック回路とＥＣＬ回路との間に、
ＥＣＬ−ＣＭＯＳ変換回路を必要とせずに、直接接続で
きるようになったことにより、高周波信号が通るライン
が単純化され、最短最小ラインで接続する理想状態に、
より近づけることが可能となっている。
【００４３】また、従来は電源を単純化（例えば−５．
２Ｖ）して、信号を複雑に処理（ＥＣＬ−ＣＭＯＳ変換
回路を入れてオフセット電圧と振幅を合わせる）してい
たが、本発明の構成によれば、電源はやや複雑になる
が、ＥＣＬ−ＣＭＯＳ変換回路とその入出力用パターン
が不要になったため、信号ライン部分の長さと基板面積
を少なくでき、信号電力も少なくすることができると共
に、他のブロック、他の機器への不要輻射を減らすこと
も可能となっている。さらに、ＥＣＬ−ＣＭＯＳ変換回
路を無くすことは、高周波信号が通るラインとＩＣが減
ることを意味するため、このことから基板設計が容易と
なり、設計の自由度が増えることになる。
２Ｖ）して、信号を複雑に処理（ＥＣＬ−ＣＭＯＳ変換
回路を入れてオフセット電圧と振幅を合わせる）してい
たが、本発明の構成によれば、電源はやや複雑になる
が、ＥＣＬ−ＣＭＯＳ変換回路とその入出力用パターン
が不要になったため、信号ライン部分の長さと基板面積
を少なくでき、信号電力も少なくすることができると共
に、他のブロック、他の機器への不要輻射を減らすこと
も可能となっている。さらに、ＥＣＬ−ＣＭＯＳ変換回
路を無くすことは、高周波信号が通るラインとＩＣが減
ることを意味するため、このことから基板設計が容易と
なり、設計の自由度が増えることになる。
【００４４】またさらに、本発明の構成例では従来例の
構成のようなＥＣＬ−ＣＭＯＳ変換回路が不要となった
ため、当該ＥＣＬ−ＣＭＯＳ変換回路が消費していた電
力を節約することが可能である。例えば、従来のように
ＥＣＬ−ＣＭＯＳ変換回路を使用した場合、カメラ側の
送受信装置１００では例えば１５ワットの電力が必要と
なり、ＣＣＵ側の送受信装置１３０では例えば２２ワッ
トの電力が必要であったのに対し、本発明の構成例で
は、例えば前記カメラ側の送受信装置５０が例えば１０
ワットとなり、前記ＣＣＵ側の送受信装置７０が例えば
１７ワットとなり、省電力化が可能である。
構成のようなＥＣＬ−ＣＭＯＳ変換回路が不要となった
ため、当該ＥＣＬ−ＣＭＯＳ変換回路が消費していた電
力を節約することが可能である。例えば、従来のように
ＥＣＬ−ＣＭＯＳ変換回路を使用した場合、カメラ側の
送受信装置１００では例えば１５ワットの電力が必要と
なり、ＣＣＵ側の送受信装置１３０では例えば２２ワッ
トの電力が必要であったのに対し、本発明の構成例で
は、例えば前記カメラ側の送受信装置５０が例えば１０
ワットとなり、前記ＣＣＵ側の送受信装置７０が例えば
１７ワットとなり、省電力化が可能である。
【００４５】なお、上述した構成例では、ＣＭＯＳロジ
ック回路の出力信号振幅をＧＴＬモードとしているが、
当該ＣＭＯＳロジック回路の電源電圧が３．３Ｖ以下で
あれば必ずしも出力信号振幅はＧＴＬモードでなくても
良い。この場合、ＥＣＬ回路の動作電圧の（Ｈ＋Ｌ）／
２が、ＣＭＯＳロジック回路の電源電圧の１／２になる
ように電源電圧を選ぶようにする。
ック回路の出力信号振幅をＧＴＬモードとしているが、
当該ＣＭＯＳロジック回路の電源電圧が３．３Ｖ以下で
あれば必ずしも出力信号振幅はＧＴＬモードでなくても
良い。この場合、ＥＣＬ回路の動作電圧の（Ｈ＋Ｌ）／
２が、ＣＭＯＳロジック回路の電源電圧の１／２になる
ように電源電圧を選ぶようにする。
【００４６】
【発明の効果】本発明の信号処理装置においては、エミ
ッタ結合ロジック回路を相補形ＭＯＳロジック回路の信
号とセンタレベルを揃えるような正負の２電源で動作さ
せ、相補形ＭＯＳロジック回路をエミッタ接合ロジック
回路の信号と揃った信号振幅で動作させ、両ロジック回
路を直接接続することにより、高周波信号が通るライン
を単純化して基板占有面積を少なくでき、消費電力も低
くすることを可能としている。
ッタ結合ロジック回路を相補形ＭＯＳロジック回路の信
号とセンタレベルを揃えるような正負の２電源で動作さ
せ、相補形ＭＯＳロジック回路をエミッタ接合ロジック
回路の信号と揃った信号振幅で動作させ、両ロジック回
路を直接接続することにより、高周波信号が通るライン
を単純化して基板占有面積を少なくでき、消費電力も低
くすることを可能としている。
【図１】本発明の信号処理装置の一例である送受信装置
の要部の構成を示すブロック回路図である。
の要部の構成を示すブロック回路図である。
【図２】本発明構成例の送受信装置の各部の電源電圧，
各部の入出力信号の振幅及び波形の関係を示す図であ
る。
各部の入出力信号の振幅及び波形の関係を示す図であ
る。
【図３】本発明の信号処理装置及び従来の信号処理装置
が適用されるシステムの一例を示すブロック回路図であ
る。
が適用されるシステムの一例を示すブロック回路図であ
る。
【図４】従来例の送受信装置の要部の構成を示すブロッ
ク回路図である。
ク回路図である。
【図５】従来例の送受信装置の各部の電源電圧，各部の
入出力信号の振幅及び波形の関係を示す図である。
入出力信号の振幅及び波形の関係を示す図である。
５０ カメラ側送受信装置 ５１，７８ ＣＭＯＳロジック回路からなるディジタル
変調回路 ５２，７９ ＥＣＬ回路からなるＤ／Ａ変換器 ６０，７７ ＣＭＯＳロジック回路からなるディジタル
復調回路 ５９，７６ ＥＣＬ回路からなるＡ／Ｄ変換器
変調回路 ５２，７９ ＥＣＬ回路からなるＤ／Ａ変換器 ６０，７７ ＣＭＯＳロジック回路からなるディジタル
復調回路 ５９，７６ ＥＣＬ回路からなるＡ／Ｄ変換器
フロントページの続き (51)Int.Cl.6 識別記号 庁内整理番号 ＦＩ 技術表示箇所 Ｈ０４Ｎ 11/04 Ｈ０３Ｋ 19/092
Claims (4)
- 【請求項１】 相補形ＭＯＳロジック回路と、 エミッタ接合ロジック回路とを有し、 上記エミッタ結合ロジック回路は上記相補形ＭＯＳロジ
ック回路の信号とセンタレベルを揃えるような正負の２
電源で動作し、上記相補形ＭＯＳロジック回路は上記エ
ミッタ接合ロジック回路の信号と揃った信号振幅で動作
し、上記エミッタ接合ロジック回路と上記相補形ＭＯＳ
ロジック回路を直接接続して両ロジック回路間で高速信
号の受け渡しを行うことを特徴とする信号処理装置。 - 【請求項２】 上記エミッタ結合ロジック回路の正負の
２電源電圧を生成するスイッチングレギュレータを有す
ることを特徴とする請求項１記載の信号処理装置。 - 【請求項３】 ディジタル映像信号を変調する、相補形
ＭＯＳロジック回路からなる変調手段と、 上記変調手段にて変調されたディジタル映像信号をアナ
ログ映像信号に変換する、エミッタ接合ロジック回路か
らなるディジタル／アナログ変換手段と、 ディジタル変調された後にアナログ変換されたアナログ
映像信号をディジタル変換する、エミッタ接合ロジック
回路からなるアナログ／ディジタル変換手段と、 上記アナログ／ディジタル変換手段から出力された変調
されているディジタル映像信号を復調する、相補形ＭＯ
Ｓロジック回路からなる復調手段とを有し、 上記エミッタ結合ロジック回路は上記相補形ＭＯＳロジ
ック回路の信号とセンタレベルを揃えるような正負の２
電源で動作し、上記相補形ＭＯＳロジック回路は上記エ
ミッタ接合ロジック回路の信号と揃った信号振幅で動作
し、上記エミッタ接合ロジック回路と上記相補形ＭＯＳ
ロジック回路を直接接続することを特徴とする信号処理
装置。 - 【請求項４】 上記エミッタ結合ロジック回路の正負の
２電源電圧を生成するスイッチングレギュレータを有す
ることを特徴とする請求項３記載の信号処理装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7211871A JPH0964722A (ja) | 1995-08-21 | 1995-08-21 | 信号処理装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7211871A JPH0964722A (ja) | 1995-08-21 | 1995-08-21 | 信号処理装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0964722A true JPH0964722A (ja) | 1997-03-07 |
Family
ID=16613002
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7211871A Withdrawn JPH0964722A (ja) | 1995-08-21 | 1995-08-21 | 信号処理装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0964722A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2008029000A (ja) * | 2006-06-22 | 2008-02-07 | Sony Corp | ゲイン制御回路、及び撮像装置と制御装置、並びにゲイン制御方法 |
-
1995
- 1995-08-21 JP JP7211871A patent/JPH0964722A/ja not_active Withdrawn
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2008029000A (ja) * | 2006-06-22 | 2008-02-07 | Sony Corp | ゲイン制御回路、及び撮像装置と制御装置、並びにゲイン制御方法 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A300 | Application deemed to be withdrawn because no request for examination was validly filed |
Free format text: JAPANESE INTERMEDIATE CODE: A300 Effective date: 20021105 |