JPH0965653A - Ｄｃ−ｄｃコンバータ - Google Patents
Ｄｃ−ｄｃコンバータInfo
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- JPH0965653A JPH0965653A JP7214897A JP21489795A JPH0965653A JP H0965653 A JPH0965653 A JP H0965653A JP 7214897 A JP7214897 A JP 7214897A JP 21489795 A JP21489795 A JP 21489795A JP H0965653 A JPH0965653 A JP H0965653A
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- 239000003990 capacitor Substances 0.000 claims abstract description 73
- 230000008878 coupling Effects 0.000 claims description 4
- 238000010168 coupling process Methods 0.000 claims description 4
- 238000005859 coupling reaction Methods 0.000 claims description 4
- 238000010586 diagram Methods 0.000 description 8
- 238000006243 chemical reaction Methods 0.000 description 3
- 230000007423 decrease Effects 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- 230000004907 flux Effects 0.000 description 2
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- H—ELECTRICITY
- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02M—APPARATUS FOR CONVERSION BETWEEN AC AND AC, BETWEEN AC AND DC, OR BETWEEN DC AND DC, AND FOR USE WITH MAINS OR SIMILAR POWER SUPPLY SYSTEMS; CONVERSION OF DC OR AC INPUT POWER INTO SURGE OUTPUT POWER; CONTROL OR REGULATION THEREOF
- H02M3/00—Conversion of DC power input into DC power output
- H02M3/22—Conversion of DC power input into DC power output with intermediate conversion into AC
- H02M3/24—Conversion of DC power input into DC power output with intermediate conversion into AC by static converters
- H02M3/28—Conversion of DC power input into DC power output with intermediate conversion into AC by static converters using discharge tubes with control electrode or semiconductor devices with control electrode to produce the intermediate AC
- H02M3/285—Single converters with a plurality of output stages connected in parallel
-
- H—ELECTRICITY
- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02M—APPARATUS FOR CONVERSION BETWEEN AC AND AC, BETWEEN AC AND DC, OR BETWEEN DC AND DC, AND FOR USE WITH MAINS OR SIMILAR POWER SUPPLY SYSTEMS; CONVERSION OF DC OR AC INPUT POWER INTO SURGE OUTPUT POWER; CONTROL OR REGULATION THEREOF
- H02M3/00—Conversion of DC power input into DC power output
- H02M3/02—Conversion of DC power input into DC power output without intermediate conversion into AC
- H02M3/04—Conversion of DC power input into DC power output without intermediate conversion into AC by static converters
- H02M3/10—Conversion of DC power input into DC power output without intermediate conversion into AC by static converters using discharge tubes with control electrode or semiconductor devices with control electrode
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Abstract
(57)【要約】 （修正有）
【課題】 正負の出力電圧を確実に制御できる低コスト
のＤＣ−ＤＣコンバータを提供する。 【解決手段】 電源１０に一端が接続された１次巻線１
１の他端にスイッチング素子１２が接続され、１次巻線
１１と磁気結合している２次巻線１３の出力側と接地電
位１６との間には、第１のダイオード１４ａと第１のコ
ンデンサ１５ａの直列回路が接続され、第１のダイオー
ド１４ａと第１のコンデンサ１５ａの接続点Ａと接地電
位１６との間には第２のダイオード１４ｂが接続されて
いる。この際、第１のダイオード１４ａのアノードは第
１のコンデンサ１５ａに接続され、第２のダイオード１
４ｂのアノードは接地電位１６に接続されている。ま
た、負の出力電圧を得るための構成および接続は、上記
正の出力電圧を得るための構成および接続と同様であ
る。さらに、第１のダイオード１４ａのカソードとスイ
ッチング素子１２のベースの間に制御回路１７を接続し
て帰還回路を形成している。
のＤＣ−ＤＣコンバータを提供する。 【解決手段】 電源１０に一端が接続された１次巻線１
１の他端にスイッチング素子１２が接続され、１次巻線
１１と磁気結合している２次巻線１３の出力側と接地電
位１６との間には、第１のダイオード１４ａと第１のコ
ンデンサ１５ａの直列回路が接続され、第１のダイオー
ド１４ａと第１のコンデンサ１５ａの接続点Ａと接地電
位１６との間には第２のダイオード１４ｂが接続されて
いる。この際、第１のダイオード１４ａのアノードは第
１のコンデンサ１５ａに接続され、第２のダイオード１
４ｂのアノードは接地電位１６に接続されている。ま
た、負の出力電圧を得るための構成および接続は、上記
正の出力電圧を得るための構成および接続と同様であ
る。さらに、第１のダイオード１４ａのカソードとスイ
ッチング素子１２のベースの間に制御回路１７を接続し
て帰還回路を形成している。
Description
【０００１】
【発明の属する技術分野】本発明は、ＤＣ−ＤＣコンバ
ータに関する。
ータに関する。
【０００２】
【従来の技術】図５は、従来のＤＣ−ＤＣコンバータを
示す。電源５１に一端が接続された１次巻線５２の他端
にスイッチング素子５３が接続され、１次巻線５３に対
し２つの２次巻線５４ａ、５４ｂが磁気結合している。
また、２次巻線５４ａの出力側にダイオード５５ａのア
ノードを、２次巻線５４ｂの出力側にダイオード５５ｂ
のカソードをそれぞれ接続し、ダイオード５５ａのカソ
ードとスイッチング素子５３のベースの間に制御回路５
６を接続して帰還回路を形成している。そして、２次巻
線５４ａの出力側からダイオード５５ａを介して正の出
力電圧＋Ｖを、２次巻線５４ｂの出力側からダイオード
５５ｂを介して負の出力電圧−Ｖを取り出している。
示す。電源５１に一端が接続された１次巻線５２の他端
にスイッチング素子５３が接続され、１次巻線５３に対
し２つの２次巻線５４ａ、５４ｂが磁気結合している。
また、２次巻線５４ａの出力側にダイオード５５ａのア
ノードを、２次巻線５４ｂの出力側にダイオード５５ｂ
のカソードをそれぞれ接続し、ダイオード５５ａのカソ
ードとスイッチング素子５３のベースの間に制御回路５
６を接続して帰還回路を形成している。そして、２次巻
線５４ａの出力側からダイオード５５ａを介して正の出
力電圧＋Ｖを、２次巻線５４ｂの出力側からダイオード
５５ｂを介して負の出力電圧−Ｖを取り出している。
【０００３】一般に、電子機器には±５Ｖや±１２Ｖの
正負対称電圧が必要であるが、従来のＤＣ−ＤＣコンバ
ータでは、図５に示すように、複数の２次巻線を用いる
ことにより、正負対称電圧を取り出していた。
正負対称電圧が必要であるが、従来のＤＣ−ＤＣコンバ
ータでは、図５に示すように、複数の２次巻線を用いる
ことにより、正負対称電圧を取り出していた。
【０００４】
【発明が解決しようとする課題】しかしながら、従来の
ＤＣ−ＤＣコンバータでは、１つの制御回路５６を用い
た出力電圧制御は、１つの出力電圧しか制御できないた
め、例えば、正の出力電圧を制御すると、正の出力電圧
用２次巻線と負の出力電圧用２次巻線の磁気結合度が１
００％であれば、制御されていない負の出力電圧の絶対
値も正の出力電圧と等しくなる。しかし、現実には多巻
線間結合度を１００％にすることは不可能なため、正負
の出力電圧の絶対値に差が生じ、正負の出力電圧を確実
に制御することは不可能であるという問題点があった。
ＤＣ−ＤＣコンバータでは、１つの制御回路５６を用い
た出力電圧制御は、１つの出力電圧しか制御できないた
め、例えば、正の出力電圧を制御すると、正の出力電圧
用２次巻線と負の出力電圧用２次巻線の磁気結合度が１
００％であれば、制御されていない負の出力電圧の絶対
値も正の出力電圧と等しくなる。しかし、現実には多巻
線間結合度を１００％にすることは不可能なため、正負
の出力電圧の絶対値に差が生じ、正負の出力電圧を確実
に制御することは不可能であるという問題点があった。
【０００５】また、１、２次巻線間の磁気結合度が１０
０％にならないので電力変換効率が低下するという問題
点があった。
０％にならないので電力変換効率が低下するという問題
点があった。
【０００６】さらに、正負２つの出力電圧を取り出すに
は、１次巻線、正負の２次巻線の少なくとも３巻線を有
するトランスが必要になり、コストが高くなるという問
題点があった。
は、１次巻線、正負の２次巻線の少なくとも３巻線を有
するトランスが必要になり、コストが高くなるという問
題点があった。
【０００７】本発明は、このような問題点を解消するた
めになされたものであり、正負の出力電圧を確実に制御
できる低コストのＤＣ−ＤＣコンバータを提供すること
を目的とする。
めになされたものであり、正負の出力電圧を確実に制御
できる低コストのＤＣ−ＤＣコンバータを提供すること
を目的とする。
【０００８】
【課題を解決するための手段】上述の問題点を解決する
ため本発明は、電源と、該電源に一端が接続された１次
巻線と、該１次巻線の他端に接続されたスイッチング素
子と、前記１次巻線と磁気結合している２次巻線と、前
記２次巻線の出力側と基準電位との間に接続された第１
のコンデンサ及び第１のダイオードからなる直列回路
と、前記第１のコンデンサと前記第１のダイオードの接
続点と基準電位との間に接続された第２のダイオード
と、前記２次巻線の出力側と第１のコンデンサの接続点
と基準電位との間に接続された第２のコンデンサ及び第
３のダイオードからなる直列回路と、前記第２のコンデ
ンサと前記第３のダイオードの接続点と基準電位との間
に接続された第４のダイオードとを備え、前記第１のダ
イオードのアノードが前記第１のコンデンサに接続さ
れ、前記第２のダイオードのアノードが基準電位に接続
され、前記第３のダイオードのカソードが前記第２のコ
ンデンサに接続され、前記第４のダイオードのカソード
が基準電位に接続されていることを特徴とする。
ため本発明は、電源と、該電源に一端が接続された１次
巻線と、該１次巻線の他端に接続されたスイッチング素
子と、前記１次巻線と磁気結合している２次巻線と、前
記２次巻線の出力側と基準電位との間に接続された第１
のコンデンサ及び第１のダイオードからなる直列回路
と、前記第１のコンデンサと前記第１のダイオードの接
続点と基準電位との間に接続された第２のダイオード
と、前記２次巻線の出力側と第１のコンデンサの接続点
と基準電位との間に接続された第２のコンデンサ及び第
３のダイオードからなる直列回路と、前記第２のコンデ
ンサと前記第３のダイオードの接続点と基準電位との間
に接続された第４のダイオードとを備え、前記第１のダ
イオードのアノードが前記第１のコンデンサに接続さ
れ、前記第２のダイオードのアノードが基準電位に接続
され、前記第３のダイオードのカソードが前記第２のコ
ンデンサに接続され、前記第４のダイオードのカソード
が基準電位に接続されていることを特徴とする。
【０００９】また、電源と、該電源に一端が接続された
スイッチング素子と、前記スイッチング素子の他端と基
準電位との間に接続された巻線と、前記スイッチング素
子と前記巻線の接続点と基準電位との間に接続された第
１のコンデンサ及び第１のダイオードからなる直列回路
と、前記第１のコンデンサと前記第１のダイオードの接
続点と基準電位との間に接続された第２のダイオード
と、前記スイッチング素子と前記第１のコンデンサの接
続点と基準電位との間に接続された第２のコンデンサ及
び第３のダイオードからなる直列回路と、前記第２のコ
ンデンサと前記第３のダイオードの接続点と基準電位と
の間に接続された第４のダイオードとを備え、前記第１
のダイオードのアノードが前記第１のコンデンサに接続
され、前記第２のダイオードのカソードが基準電位に接
続され、前記第３のダイオードのカソードが前記第２の
コンデンサに接続され、前記第４のダイオードのカソー
ドが基準電位に接続されていることを特徴とする。
スイッチング素子と、前記スイッチング素子の他端と基
準電位との間に接続された巻線と、前記スイッチング素
子と前記巻線の接続点と基準電位との間に接続された第
１のコンデンサ及び第１のダイオードからなる直列回路
と、前記第１のコンデンサと前記第１のダイオードの接
続点と基準電位との間に接続された第２のダイオード
と、前記スイッチング素子と前記第１のコンデンサの接
続点と基準電位との間に接続された第２のコンデンサ及
び第３のダイオードからなる直列回路と、前記第２のコ
ンデンサと前記第３のダイオードの接続点と基準電位と
の間に接続された第４のダイオードとを備え、前記第１
のダイオードのアノードが前記第１のコンデンサに接続
され、前記第２のダイオードのカソードが基準電位に接
続され、前記第３のダイオードのカソードが前記第２の
コンデンサに接続され、前記第４のダイオードのカソー
ドが基準電位に接続されていることを特徴とする。
【００１０】また、電源と、該電源に一端が接続された
巻線と、該巻線の他端に接続されたスイッチング素子
と、前記巻線と前記スイッチング素子の接続点と基準電
位との間に接続された第１のダイオードと、前記巻線と
前記第１のダイオードの接続点と基準電位との間に接続
された第１のコンデンサ及び第２のダイオードからなる
直列回路と、前記第１のコンデンサと前記第２のダイオ
ードの接続点と基準電位との間に接続された第３のダイ
オードとを備え、前記第１のダイオードのアノードが前
記巻線と前記スイッチング素子の接続点に接続され、前
記第２のダイオードのカソードが前記コンデンサに接続
され、前記第３のダイオードのカソードが基準電位に接
続されていることを特徴とする。
巻線と、該巻線の他端に接続されたスイッチング素子
と、前記巻線と前記スイッチング素子の接続点と基準電
位との間に接続された第１のダイオードと、前記巻線と
前記第１のダイオードの接続点と基準電位との間に接続
された第１のコンデンサ及び第２のダイオードからなる
直列回路と、前記第１のコンデンサと前記第２のダイオ
ードの接続点と基準電位との間に接続された第３のダイ
オードとを備え、前記第１のダイオードのアノードが前
記巻線と前記スイッチング素子の接続点に接続され、前
記第２のダイオードのカソードが前記コンデンサに接続
され、前記第３のダイオードのカソードが基準電位に接
続されていることを特徴とする。
【００１１】これにより、請求項１のＤＣ−ＤＣコンバ
ータでは、正の出力電圧は、第１のコンデンサと第１及
び第２のダイオードを介して取り出され、負の出力電圧
は、第２のコンデンサと第３及び第４のダイオードを介
して取り出される。
ータでは、正の出力電圧は、第１のコンデンサと第１及
び第２のダイオードを介して取り出され、負の出力電圧
は、第２のコンデンサと第３及び第４のダイオードを介
して取り出される。
【００１２】請求項２のＤＣ−ＤＣコンバータでは、正
の出力電圧は、第１のコンデンサと第１及び第２のダイ
オードを介して取り出され、負の出力電圧は、第２のコ
ンデンサと第３及び第４のダイオードを介して取り出さ
れる。
の出力電圧は、第１のコンデンサと第１及び第２のダイ
オードを介して取り出され、負の出力電圧は、第２のコ
ンデンサと第３及び第４のダイオードを介して取り出さ
れる。
【００１３】請求項３のＤＣ−ＤＣコンバータでは、正
の出力電圧は、第１のダイオードのみを介して取り出さ
れ、負の出力電圧は、コンデンサと第２のダイオードを
介して取り出される。
の出力電圧は、第１のダイオードのみを介して取り出さ
れ、負の出力電圧は、コンデンサと第２のダイオードを
介して取り出される。
【００１４】
【発明の実施の形態】以下、図面を参照して本発明の実
施例を説明する。図１に本発明に係るＤＣ−ＤＣコンバ
ータの第１の実施例の回路図を示す。この回路では、電
源１０に一端が接続された１次巻線１１の他端にスイッ
チング素子（バイポーラトランジスタ）１２が接続され
ており、１次巻線１１と磁気結合している２次巻線１３
の出力側と基準電位、すなわち接地電位１６との間に
は、第１のダイオード１４ａと第１のコンデンサ１５ａ
の直列回路が接続され、第１のダイオード１４ａと第１
のコンデンサ１５ａの接続点Ａと接地電位１６との間に
は、それぞれ第２のダイオード１４ｂが接続されてい
る。この際、第１のダイオード１４ａのアノードは第１
のコンデンサ１５ａに接続され、第２のダイオード１４
ｂのアノードは接地電位１６に接続されている。
施例を説明する。図１に本発明に係るＤＣ−ＤＣコンバ
ータの第１の実施例の回路図を示す。この回路では、電
源１０に一端が接続された１次巻線１１の他端にスイッ
チング素子（バイポーラトランジスタ）１２が接続され
ており、１次巻線１１と磁気結合している２次巻線１３
の出力側と基準電位、すなわち接地電位１６との間に
は、第１のダイオード１４ａと第１のコンデンサ１５ａ
の直列回路が接続され、第１のダイオード１４ａと第１
のコンデンサ１５ａの接続点Ａと接地電位１６との間に
は、それぞれ第２のダイオード１４ｂが接続されてい
る。この際、第１のダイオード１４ａのアノードは第１
のコンデンサ１５ａに接続され、第２のダイオード１４
ｂのアノードは接地電位１６に接続されている。
【００１５】また、２次巻線１３の出力側と第１のコン
デンサ１５ａの接続点と接地電位１６との間には、第３
のダイオード１４ｃと第２のコンデンサ１５ｂの直列回
路が接続され、第３のダイオード１４ｃと第２のコンデ
ンサ１５ｂの接続点Ｂと接地電位１６との間には、第４
のダイオード１４ｄが接続されている。この際、第３の
ダイオード１４ｃのカソードは第２のコンデンサ１５ｂ
に接続され、第４のダイオード１４ｄのカソードは接地
電位１６に接続されている。
デンサ１５ａの接続点と接地電位１６との間には、第３
のダイオード１４ｃと第２のコンデンサ１５ｂの直列回
路が接続され、第３のダイオード１４ｃと第２のコンデ
ンサ１５ｂの接続点Ｂと接地電位１６との間には、第４
のダイオード１４ｄが接続されている。この際、第３の
ダイオード１４ｃのカソードは第２のコンデンサ１５ｂ
に接続され、第４のダイオード１４ｄのカソードは接地
電位１６に接続されている。
【００１６】さらに、第１のダイオード１４ａのカソー
ドとスイッチング素子１２のベースの間に制御回路１７
を接続して帰還回路を形成している。
ドとスイッチング素子１２のベースの間に制御回路１７
を接続して帰還回路を形成している。
【００１７】そして、正の出力電圧＋Ｖは、２次巻線１
３の出力側から第１のコンデンサ１５ａ、第１及び第２
のダイオード１４ａ、１４ｂを介して取り出され、負の
出力電圧−Ｖは、２次巻線１３の出力側から第２のコン
デンサ１５ｂ、第３及び第４のダイオード１４ｃ、１４
ｄを介して取り出される。
３の出力側から第１のコンデンサ１５ａ、第１及び第２
のダイオード１４ａ、１４ｂを介して取り出され、負の
出力電圧−Ｖは、２次巻線１３の出力側から第２のコン
デンサ１５ｂ、第３及び第４のダイオード１４ｃ、１４
ｄを介して取り出される。
【００１８】図４を用いて、時間に対する各発生電圧の
動作を説明する。ここで、各接続点に発生する電圧を発
生電圧とする。
動作を説明する。ここで、各接続点に発生する電圧を発
生電圧とする。
【００１９】まず、第１のダイオード１４ａのアノード
と第１のコンデンサ１５ａの接続点Ａの発生電圧をＶａ
とし、第３のダイオード１４ｃのカソードと第２のコン
デンサ１５ｂの接続点Ｂの発生電圧をＶｂとする。
と第１のコンデンサ１５ａの接続点Ａの発生電圧をＶａ
とし、第３のダイオード１４ｃのカソードと第２のコン
デンサ１５ｂの接続点Ｂの発生電圧をＶｂとする。
【００２０】各接続点における発生電圧の動作波形を図
４に示す。図４において、横軸は時間ｔ、縦軸はそれぞ
れ、スイッチング素子１２のベース電圧Ｖｓ、２次巻線
１３に発生する電圧Ｖｄ、接続点Ａの発生電圧Ｖａ、接
続点Ｂの発生電圧Ｖｂである。
４に示す。図４において、横軸は時間ｔ、縦軸はそれぞ
れ、スイッチング素子１２のベース電圧Ｖｓ、２次巻線
１３に発生する電圧Ｖｄ、接続点Ａの発生電圧Ｖａ、接
続点Ｂの発生電圧Ｖｂである。
【００２１】まず、ｔが０のとき（始動前）は、各電圧
Ｖｓ、Ｖｄ、Ｖａ、Ｖｂはそれぞれ０である。
Ｖｓ、Ｖｄ、Ｖａ、Ｖｂはそれぞれ０である。
【００２２】次いで、スイッチング素子１２のベース電
圧にＶｓが印加され、スイッチング素子１２が”ＯＮ”
になる（図中１の領域）と、２次巻線１３に電圧−Ｖ２
が発生するため、接続点Ａの発生電圧Ｖａは第２のダイ
オード１４ｂが導通するので０となる。一方、接続点Ｂ
の発生電圧Ｖｂは第３のダイオード１４ｃが導通するの
で−Ｖ２となる。以上を動作１とする。
圧にＶｓが印加され、スイッチング素子１２が”ＯＮ”
になる（図中１の領域）と、２次巻線１３に電圧−Ｖ２
が発生するため、接続点Ａの発生電圧Ｖａは第２のダイ
オード１４ｂが導通するので０となる。一方、接続点Ｂ
の発生電圧Ｖｂは第３のダイオード１４ｃが導通するの
で−Ｖ２となる。以上を動作１とする。
【００２３】次いで、スイッチング素子１２のベース電
圧に−Ｖｓが印加され、スイッチング素子１２が”ＯＦ
Ｆ”になる（図中２の領域）と、２次巻線１３に電圧＋
Ｖ１が発生するため、接続点Ａの発生電圧Ｖａは第１の
ダイオード１４ａが導通するので＋Ｖ１となる。一方、
接続点Ｂの発生電圧Ｖｂは第４のダイオード１４ｄが導
通するので０となる。以上を動作２とする。
圧に−Ｖｓが印加され、スイッチング素子１２が”ＯＦ
Ｆ”になる（図中２の領域）と、２次巻線１３に電圧＋
Ｖ１が発生するため、接続点Ａの発生電圧Ｖａは第１の
ダイオード１４ａが導通するので＋Ｖ１となる。一方、
接続点Ｂの発生電圧Ｖｂは第４のダイオード１４ｄが導
通するので０となる。以上を動作２とする。
【００２４】次いで、スイッチング素子１２のベース電
圧に＋Ｖｓが印加され、スイッチング素子１２が”Ｏ
Ｎ”になる（図中３の領域）と、２次巻線１３に電圧−
Ｖ２が発生するため、接続点Ａの発生電圧Ｖａは第２の
ダイオード１４ｂが導通するので０となる。一方、接続
点Ｂの発生電圧Ｖｂは第３のダイオード１ｃｂが導通す
るので−Ｖ１と−Ｖ２の和である−Ｖとなる。以上を動
作３とする。
圧に＋Ｖｓが印加され、スイッチング素子１２が”Ｏ
Ｎ”になる（図中３の領域）と、２次巻線１３に電圧−
Ｖ２が発生するため、接続点Ａの発生電圧Ｖａは第２の
ダイオード１４ｂが導通するので０となる。一方、接続
点Ｂの発生電圧Ｖｂは第３のダイオード１ｃｂが導通す
るので−Ｖ１と−Ｖ２の和である−Ｖとなる。以上を動
作３とする。
【００２５】次いで、スイッチング素子１２のベース電
圧に−Ｖｓが印加され、スイッチング素子１２が”ＯＦ
Ｆ”になる（図中４の領域）と、２次巻線１３に電圧＋
Ｖ１が発生するため、接続点Ａの発生電圧Ｖａは第１の
ダイオード１４ａが導通するのでＶ１とＶ２の和である
Ｖとなる。一方、接続点Ｂの発生電圧Ｖｂは第４のダイ
オード１４ｄが導通するので０となる。以上を動作４と
する。
圧に−Ｖｓが印加され、スイッチング素子１２が”ＯＦ
Ｆ”になる（図中４の領域）と、２次巻線１３に電圧＋
Ｖ１が発生するため、接続点Ａの発生電圧Ｖａは第１の
ダイオード１４ａが導通するのでＶ１とＶ２の和である
Ｖとなる。一方、接続点Ｂの発生電圧Ｖｂは第４のダイ
オード１４ｄが導通するので０となる。以上を動作４と
する。
【００２６】その後、動作３と動作４が順次繰り返さ
れ、その結果、２次巻線１３の出力側から第１のコンデ
ンサ１５ａ、第１及び第２のダイオード１４ａ、１４ｂ
を介して正の出力電圧＋Ｖ、２次巻線１３の出力側から
第２のコンデンサ１５ｂ、第３及び第４のダイオード１
４ｃ、１４ｄを介して負の出力電圧−Ｖが取り出され
る。
れ、その結果、２次巻線１３の出力側から第１のコンデ
ンサ１５ａ、第１及び第２のダイオード１４ａ、１４ｂ
を介して正の出力電圧＋Ｖ、２次巻線１３の出力側から
第２のコンデンサ１５ｂ、第３及び第４のダイオード１
４ｃ、１４ｄを介して負の出力電圧−Ｖが取り出され
る。
【００２７】上記のように、第１の実施例のＤＣ−ＤＣ
コンバータによれば、絶対値の等しい正負の出力電圧を
取り出すのに１つの２次巻線しか用いていないため、一
方の出力電圧（例えば、正の出力電圧）を制御すれば、
他方の出力電圧（例えば、負の出力電圧）も同時に制御
することができ、従来のＤＣ−ＤＣコンバータに比べ、
負荷電流変動時の出力電圧値の変動が小さくなる。
コンバータによれば、絶対値の等しい正負の出力電圧を
取り出すのに１つの２次巻線しか用いていないため、一
方の出力電圧（例えば、正の出力電圧）を制御すれば、
他方の出力電圧（例えば、負の出力電圧）も同時に制御
することができ、従来のＤＣ−ＤＣコンバータに比べ、
負荷電流変動時の出力電圧値の変動が小さくなる。
【００２８】また、１つの１次巻線及び１つの２次巻線
の２巻線を有するトランスで、正負２つの出力電圧を取
り出すことが可能になり、トランスの巻線数を減らすこ
とができるため、低コスト化が可能になる。
の２巻線を有するトランスで、正負２つの出力電圧を取
り出すことが可能になり、トランスの巻線数を減らすこ
とができるため、低コスト化が可能になる。
【００２９】図２に本発明に係るＤＣ−ＤＣコンバータ
の第２の実施例の回路図を示す。この回路では、電源１
０とスイッチング素子１２の一端が接続されており、ス
イッチング素子１２の他端と接地電位１６との間には巻
線２１が接続されている。
の第２の実施例の回路図を示す。この回路では、電源１
０とスイッチング素子１２の一端が接続されており、ス
イッチング素子１２の他端と接地電位１６との間には巻
線２１が接続されている。
【００３０】また、スイッチング素子１２の他端と巻線
２１の接続点と接地電位１６との間には第１のダイオー
ド２２ａと第１のコンデンサ２３ａの直列回路が接続さ
れ、第１のダイオード２２ａと第１のコンデンサ２３ａ
の接続点と接地電位１６との間には、それぞれ第２のダ
イオード２２ｂが接続されている。この際、第１のダイ
オード２２ａのアノードは第１のコンデンサ２３ａに接
続され、第２のダイオード２２ｂのアノードは接地電位
１６に接続されている。
２１の接続点と接地電位１６との間には第１のダイオー
ド２２ａと第１のコンデンサ２３ａの直列回路が接続さ
れ、第１のダイオード２２ａと第１のコンデンサ２３ａ
の接続点と接地電位１６との間には、それぞれ第２のダ
イオード２２ｂが接続されている。この際、第１のダイ
オード２２ａのアノードは第１のコンデンサ２３ａに接
続され、第２のダイオード２２ｂのアノードは接地電位
１６に接続されている。
【００３１】さらに、スイッチング素子１２の他端と第
１のコンデンサ２３ａの接続点と接地電位１６との間に
は第３のダイオード２２ｃと第２のコンデンサ２３ｂの
直列回路が接続され、第３のダイオード２２ｃと第２の
コンデンサ２３ｂの接続点と接地電位１６との間には、
第４のダイオード２２ｄが接続されている。この際、第
３のダイオード２２ｃのカソードは第２のコンデンサ２
３ｂに接続され、第４のダイオード２２ｄのカソードは
接地電位１６に接続されている。
１のコンデンサ２３ａの接続点と接地電位１６との間に
は第３のダイオード２２ｃと第２のコンデンサ２３ｂの
直列回路が接続され、第３のダイオード２２ｃと第２の
コンデンサ２３ｂの接続点と接地電位１６との間には、
第４のダイオード２２ｄが接続されている。この際、第
３のダイオード２２ｃのカソードは第２のコンデンサ２
３ｂに接続され、第４のダイオード２２ｄのカソードは
接地電位１６に接続されている。
【００３２】また、第１のダイオード２２ａのカソード
とスイッチング素子１２のベースの間に制御回路１７を
接続して帰還回路を形成している。
とスイッチング素子１２のベースの間に制御回路１７を
接続して帰還回路を形成している。
【００３３】そして、正の出力電圧＋Ｖは、スイッチン
グ素子１２の他端から第１のコンデンサ２３ａ、第１及
び第２のダイオード２２ａ、２２ｂを介して取り出さ
れ、負の出力電圧−Ｖは、スイッチング素子１２の他端
から第２のコンデンサ２３ｂ、第３及び第４のダイオー
ド２２ｃ、２２ｄを介して取り出される。
グ素子１２の他端から第１のコンデンサ２３ａ、第１及
び第２のダイオード２２ａ、２２ｂを介して取り出さ
れ、負の出力電圧−Ｖは、スイッチング素子１２の他端
から第２のコンデンサ２３ｂ、第３及び第４のダイオー
ド２２ｃ、２２ｄを介して取り出される。
【００３４】上記のように、第２の実施例のＤＣ−ＤＣ
コンバータによれば、第１の実施例と同様の効果に加
え、スイッチング素子１２に接続された巻線２１から直
接正負の出力電圧を取り出すため、トランスを使用した
場合のように、１次巻線、２次巻線間の漏れ磁束による
電力変換効率の低下がなく、高効率化が実現できる。
コンバータによれば、第１の実施例と同様の効果に加
え、スイッチング素子１２に接続された巻線２１から直
接正負の出力電圧を取り出すため、トランスを使用した
場合のように、１次巻線、２次巻線間の漏れ磁束による
電力変換効率の低下がなく、高効率化が実現できる。
【００３５】また、トランスを使用しないため、小形化
及び低コスト化が可能になる。
及び低コスト化が可能になる。
【００３６】図３に本発明に係るＤＣ−ＤＣコンバータ
の第３の実施例の回路図を示す。この回路では、電源１
０に一端が接続された巻線３１の他端にスイッチング素
子１２が接続されており、巻線３１の出力側とスイッチ
ング素子１２の一端の接続点と接地電位１６との間には
第１のダイオード３２ａが接続されている。この際、第
１のダイオード３２ａのアノードは巻線３１の他端に接
続されている。
の第３の実施例の回路図を示す。この回路では、電源１
０に一端が接続された巻線３１の他端にスイッチング素
子１２が接続されており、巻線３１の出力側とスイッチ
ング素子１２の一端の接続点と接地電位１６との間には
第１のダイオード３２ａが接続されている。この際、第
１のダイオード３２ａのアノードは巻線３１の他端に接
続されている。
【００３７】また、巻線３１の他端と第１のダイオード
３２ａの接続点と接地電位１６との間には第２のダイオ
ード３２ｂとコンデンサ３３ａの直列回路が接続され、
第２のダイオード３２ｂとコンデンサ３３ａの接続点と
接地電位１６との間には、第３のダイオード３２ｃが接
続されている。この際、第２のダイオード３２ｂのカソ
ードはコンデンサ３３ａに接続され、第３のダイオード
３２ｃのカソードは接地電位１６に接続されている。
３２ａの接続点と接地電位１６との間には第２のダイオ
ード３２ｂとコンデンサ３３ａの直列回路が接続され、
第２のダイオード３２ｂとコンデンサ３３ａの接続点と
接地電位１６との間には、第３のダイオード３２ｃが接
続されている。この際、第２のダイオード３２ｂのカソ
ードはコンデンサ３３ａに接続され、第３のダイオード
３２ｃのカソードは接地電位１６に接続されている。
【００３８】さらに、第１のダイオード３２ａのカソー
ドとスイッチング素子１２のベースの間に制御回路１７
を接続して帰還回路を形成している。
ドとスイッチング素子１２のベースの間に制御回路１７
を接続して帰還回路を形成している。
【００３９】そして、正の出力電圧＋Ｖは、巻線３１の
出力側から第１のダイオード３２ａを介して取り出さ
れ、負の出力電圧−Ｖは、巻線３１の出力側からコンデ
ンサ３３ａ、第２及び第３のダイオード３２ｂ、３２ｃ
を介して取り出される。
出力側から第１のダイオード３２ａを介して取り出さ
れ、負の出力電圧−Ｖは、巻線３１の出力側からコンデ
ンサ３３ａ、第２及び第３のダイオード３２ｂ、３２ｃ
を介して取り出される。
【００４０】上記のように、第３の実施例のＤＣ−ＤＣ
コンバータによれば、第２の実施例と同様の効果に加
え、部品点数が少なくなるため、さらなる小形化及び低
コスト化が実現できる。
コンバータによれば、第２の実施例と同様の効果に加
え、部品点数が少なくなるため、さらなる小形化及び低
コスト化が実現できる。
【００４１】
【発明の効果】請求項１のＤＣ−ＤＣコンバータでは、
絶対値の等しい正負の出力電圧を取り出すのに１つの２
次巻線しか用いていないため、一方の出力電圧を制御す
れば、他方の出力電圧も同時に制御することができ、従
来のＤＣ−ＤＣコンバータに比べ、負荷電流変動時の出
力電圧値の変動が小さくなる。
絶対値の等しい正負の出力電圧を取り出すのに１つの２
次巻線しか用いていないため、一方の出力電圧を制御す
れば、他方の出力電圧も同時に制御することができ、従
来のＤＣ−ＤＣコンバータに比べ、負荷電流変動時の出
力電圧値の変動が小さくなる。
【００４２】また、１つの１次巻線及び１つの２次巻線
の２巻線を有するトランスで、正負２つの出力電圧を取
り出すことが可能になり、トランスの巻線数を減らすこ
とができるため、低コスト化が可能になる。
の２巻線を有するトランスで、正負２つの出力電圧を取
り出すことが可能になり、トランスの巻線数を減らすこ
とができるため、低コスト化が可能になる。
【００４３】請求項２のＤＣ−ＤＣコンバータでは、ス
イッチング素子に接続された第１の巻線から直接正負の
出力電圧を取り出すため、トランスを使用した場合のよ
うに、１次巻線、２次巻線間の漏れ磁束による電力変換
効率の低下がなく、高効率化が実現できる。
イッチング素子に接続された第１の巻線から直接正負の
出力電圧を取り出すため、トランスを使用した場合のよ
うに、１次巻線、２次巻線間の漏れ磁束による電力変換
効率の低下がなく、高効率化が実現できる。
【００４４】また、トランスを使用しないため、小形化
及び低コスト化が可能になる。
及び低コスト化が可能になる。
【００４５】請求項３のＤＣ−ＤＣコンバータでは、部
品点数が少なくなるため、さらなる小形化及び低コスト
化が実現できる。
品点数が少なくなるため、さらなる小形化及び低コスト
化が実現できる。
【図１】本発明に係るＤＣ−ＤＣコンバータの第１の実
施例の回路図である。
施例の回路図である。
【図２】本発明に係るＤＣ−ＤＣコンバータの第２の実
施例の回路図である。
施例の回路図である。
【図３】本発明に係るＤＣ−ＤＣコンバータの第３の実
施例の回路図である。
施例の回路図である。
【図４】図１のＤＣ−ＤＣコンバータにおける出力電圧
の特性を示す動作波形図である。
の特性を示す動作波形図である。
【図５】従来のＤＣ−ＤＣコンバータの回路図である。
１０ 電源 １１ １次巻線 １２ スイッチング素子（バイポーラトランジス
タ） １３ ２次巻線 １４ａ〜１４ｄ、２２ａ〜２２ｄ、３２ａ〜３２ｃ
ダイオード １５ａ、１５ｂ、２３ａ、２３ｂ、３３ａ コンデ
ンサ １６ 基準電位（接地電位） ２１、３１ 巻線 Ａ、Ｂ、Ｃ、Ｄ、Ｅ、Ｆ 接続点
タ） １３ ２次巻線 １４ａ〜１４ｄ、２２ａ〜２２ｄ、３２ａ〜３２ｃ
ダイオード １５ａ、１５ｂ、２３ａ、２３ｂ、３３ａ コンデ
ンサ １６ 基準電位（接地電位） ２１、３１ 巻線 Ａ、Ｂ、Ｃ、Ｄ、Ｅ、Ｆ 接続点
Claims (3)
- 【請求項１】 電源と、該電源に一端が接続された１次
巻線と、該１次巻線の他端に接続されたスイッチング素
子と、前記１次巻線と磁気結合している２次巻線と、前
記２次巻線の出力側と基準電位との間に接続された第１
のコンデンサ及び第１のダイオードからなる直列回路
と、前記第１のコンデンサと前記第１のダイオードの接
続点と基準電位との間に接続された第２のダイオード
と、前記２次巻線の出力側と第１のコンデンサの接続点
と基準電位との間に接続された第２のコンデンサ及び第
３のダイオードからなる直列回路と、前記第２のコンデ
ンサと前記第３のダイオードの接続点と基準電位との間
に接続された第４のダイオードとを備え、 前記第１のダイオードのアノードが前記第１のコンデン
サに接続され、前記第２のダイオードのアノードが基準
電位に接続され、前記第３のダイオードのカソードが前
記第２のコンデンサに接続され、前記第４のダイオード
のカソードが基準電位に接続されていることを特徴とす
るＤＣ−ＤＣコンバータ。 - 【請求項２】 電源と、該電源に一端が接続されたスイ
ッチング素子と、前記スイッチング素子の他端と基準電
位との間に接続された巻線と、前記スイッチング素子と
前記巻線の接続点と基準電位との間に接続された第１の
コンデンサ及び第１のダイオードからなる直列回路と、
前記第１のコンデンサと前記第１のダイオードの接続点
と基準電位との間に接続された第２のダイオードと、前
記スイッチング素子と前記第１のコンデンサの接続点と
基準電位との間に接続された第２のコンデンサ及び第３
のダイオードからなる直列回路と、前記第２のコンデン
サと前記第３のダイオードの接続点と基準電位との間に
接続された第４のダイオードとを備え、 前記第１のダイオードのアノードが前記第１のコンデン
サに接続され、前記第２のダイオードのカソードが基準
電位に接続され、前記第３のダイオードのカソードが前
記第２のコンデンサに接続され、前記第４のダイオード
のカソードが基準電位に接続されていることを特徴とす
るＤＣ−ＤＣコンバータ。 - 【請求項３】 電源と、該電源に一端が接続された巻線
と、該巻線の他端に接続されたスイッチング素子と、前
記巻線と前記スイッチング素子の接続点と基準電位との
間に接続された第１のダイオードと、前記巻線の他端と
前記第１のダイオードの接続点と基準電位との間に接続
された第１のコンデンサ及び第２のダイオードからなる
直列回路と、前記第１のコンデンサと前記第２のダイオ
ードの接続点と基準電位との間に接続された第３のダイ
オードとを備え、 前記第１のダイオードのアノードが前記巻線の他端に接
続され、前記第２のダイオードのカソードが前記コンデ
ンサに接続され、前記第３のダイオードのカソードが基
準電位に接続されていることを特徴とするＤＣ−ＤＣコ
ンバータ。
Priority Applications (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7214897A JPH0965653A (ja) | 1995-08-23 | 1995-08-23 | Ｄｃ−ｄｃコンバータ |
| TW085108072A TW437145B (en) | 1995-08-23 | 1996-07-04 | DC-DC converter |
| KR1019960030677A KR100224124B1 (ko) | 1995-08-23 | 1996-07-26 | 디씨-디씨 컨버터 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7214897A JPH0965653A (ja) | 1995-08-23 | 1995-08-23 | Ｄｃ−ｄｃコンバータ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0965653A true JPH0965653A (ja) | 1997-03-07 |
Family
ID=16663378
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7214897A Pending JPH0965653A (ja) | 1995-08-23 | 1995-08-23 | Ｄｃ−ｄｃコンバータ |
Country Status (3)
| Country | Link |
|---|---|
| JP (1) | JPH0965653A (ja) |
| KR (1) | KR100224124B1 (ja) |
| TW (1) | TW437145B (ja) |
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2001075539A (ja) * | 1999-09-06 | 2001-03-23 | Citizen Watch Co Ltd | 液晶表示装置 |
| WO2008062706A1 (en) * | 2006-11-20 | 2008-05-29 | Fujitsu Ten Limited | Voltage output circuit, integrated circuit and electronic device |
| JP2008131837A (ja) * | 2006-11-24 | 2008-06-05 | Stanley Electric Co Ltd | 電源装置 |
| CN110572029A (zh) * | 2019-09-17 | 2019-12-13 | 深圳市千分一智能技术有限公司 | 主动笔电路 |
-
1995
- 1995-08-23 JP JP7214897A patent/JPH0965653A/ja active Pending
-
1996
- 1996-07-04 TW TW085108072A patent/TW437145B/zh active
- 1996-07-26 KR KR1019960030677A patent/KR100224124B1/ko not_active Expired - Lifetime
Cited By (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2001075539A (ja) * | 1999-09-06 | 2001-03-23 | Citizen Watch Co Ltd | 液晶表示装置 |
| WO2008062706A1 (en) * | 2006-11-20 | 2008-05-29 | Fujitsu Ten Limited | Voltage output circuit, integrated circuit and electronic device |
| JP2008131731A (ja) * | 2006-11-20 | 2008-06-05 | Fujitsu Ten Ltd | 電圧出力回路，集積回路，および電子機器 |
| US8058853B2 (en) | 2006-11-20 | 2011-11-15 | Fujitsu Ten Limited | Voltage output circuit, integrated circuit and electronic device |
| JP2008131837A (ja) * | 2006-11-24 | 2008-06-05 | Stanley Electric Co Ltd | 電源装置 |
| CN110572029A (zh) * | 2019-09-17 | 2019-12-13 | 深圳市千分一智能技术有限公司 | 主动笔电路 |
Also Published As
| Publication number | Publication date |
|---|---|
| KR970013613A (ko) | 1997-03-29 |
| KR100224124B1 (ko) | 1999-10-15 |
| TW437145B (en) | 2001-05-28 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 20031224 |