JPH10260762A - 通信用ｌｓｉ - Google Patents
通信用ｌｓｉInfo
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- JPH10260762A JPH10260762A JP6831597A JP6831597A JPH10260762A JP H10260762 A JPH10260762 A JP H10260762A JP 6831597 A JP6831597 A JP 6831597A JP 6831597 A JP6831597 A JP 6831597A JP H10260762 A JPH10260762 A JP H10260762A
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- communication
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Abstract
(57)【要約】
【課題】 データ転送が正常に行われなくなった場合
に、異常個所又は異常原因を容易に特定することが可能
な通信用ＬＳＩを提供すること。 【解決手段】 インディケート信号出力部１０１は、自
己のボードがいわゆる「オンボード」状態である場合、
すなわち通信デバイス４Ａが主制御回路１と外部接続機
器７Ａとの間のデータ転送のための制御動作中である場
合に、この動作中であることを示すためのインディケー
ト信号を出力するものである。ＬＥＤ制御部１０２は、
このインディケート信号を入力して、ボード表面に取り
付けられたＬＥＤ１０３を点灯するようになっている。
に、異常個所又は異常原因を容易に特定することが可能
な通信用ＬＳＩを提供すること。 【解決手段】 インディケート信号出力部１０１は、自
己のボードがいわゆる「オンボード」状態である場合、
すなわち通信デバイス４Ａが主制御回路１と外部接続機
器７Ａとの間のデータ転送のための制御動作中である場
合に、この動作中であることを示すためのインディケー
ト信号を出力するものである。ＬＥＤ制御部１０２は、
このインディケート信号を入力して、ボード表面に取り
付けられたＬＥＤ１０３を点灯するようになっている。
Description
【０００１】
【発明の属する技術分野】本発明は、コンピュータのイ
ンタフェイス装置などに用いられる通信用ＬＳＩに関す
るものである。
ンタフェイス装置などに用いられる通信用ＬＳＩに関す
るものである。
【０００２】
【従来の技術】図２は、コンピュータ装置内の内部バス
の接続構成を示すブロック図である。この図において、
ＣＰＵ内に構成されている主制御回路１は、ＰＣＩバス
３を介して複数のインタフェイス装置２Ａ，２Ｂ，２Ｃ
に接続されている。
の接続構成を示すブロック図である。この図において、
ＣＰＵ内に構成されている主制御回路１は、ＰＣＩバス
３を介して複数のインタフェイス装置２Ａ，２Ｂ，２Ｃ
に接続されている。
【０００３】インタフェイス装置２Ａは、ＬＳＩ上に形
成された通信デバイス４Ａを有しており、通信デバイス
４ＡにはＰＣＩバス制御部５Ａ及び外部接続制御部６Ａ
が設けられている。そして、外部接続機器７Ａがこのイ
ンタフェイス装置２Ａに接続されている。
成された通信デバイス４Ａを有しており、通信デバイス
４ＡにはＰＣＩバス制御部５Ａ及び外部接続制御部６Ａ
が設けられている。そして、外部接続機器７Ａがこのイ
ンタフェイス装置２Ａに接続されている。
【０００４】インタフェイス装置２Ｂは、バスブリッジ
８に接続された複数の通信デバイス４Ｂ1 ，４Ｂ2 ，４
Ｂ3 を有している。インタフェイス装置には、接続部の
スロットの制約から１つの通信デバイスしか設けられな
いのが原則であるが、設計上の要求により複数の通信デ
バイスを設けなければならない場合がある。バスブリッ
ジ８は、このような場合に設けられるものであり、通信
デバイス４Ｂ1 ，４Ｂ2 ，４Ｂ3 のうちのいずれか１つ
を選択してデータ転送路を形成するようになっている。
そして、外部接続機器７Ｂ1 ，７Ｂ2 ，７Ｂ3 がこのイ
ンタフェイス装置２Ｂに接続されている。なお、通信デ
バイス４Ｂ1 ，４Ｂ2 ，４Ｂ3 は通信デバイス４Ａと同
様の構成のものである。
８に接続された複数の通信デバイス４Ｂ1 ，４Ｂ2 ，４
Ｂ3 を有している。インタフェイス装置には、接続部の
スロットの制約から１つの通信デバイスしか設けられな
いのが原則であるが、設計上の要求により複数の通信デ
バイスを設けなければならない場合がある。バスブリッ
ジ８は、このような場合に設けられるものであり、通信
デバイス４Ｂ1 ，４Ｂ2 ，４Ｂ3 のうちのいずれか１つ
を選択してデータ転送路を形成するようになっている。
そして、外部接続機器７Ｂ1 ，７Ｂ2 ，７Ｂ3 がこのイ
ンタフェイス装置２Ｂに接続されている。なお、通信デ
バイス４Ｂ1 ，４Ｂ2 ，４Ｂ3 は通信デバイス４Ａと同
様の構成のものである。
【０００５】インタフェイス装置２Ｃはインタフェイス
装置２Ａと同様の構成であり、通信デバイス４Ｃを有し
ている。そして、外部接続機器７Ｃがこのインタフェイ
ス装置２Ｃに接続されている。
装置２Ａと同様の構成であり、通信デバイス４Ｃを有し
ている。そして、外部接続機器７Ｃがこのインタフェイ
ス装置２Ｃに接続されている。
【０００６】次に、図２の動作につき説明する。例え
ば、主制御回路１と外部接続機器７Ａとの間でデータ転
送を行う場合、ＰＣＩバス制御部５ＡがＰＣＩバス３に
対するバス制御を行い、外部接続制御部６Ａが外部接続
機器７Ａに対する接続についての制御を行う。ＰＣＩバ
ス上のデータ転送制御は、基本的には、ＦＲＥＡＭＥ信
号，ＩＲＤＹ信号，ＴＲＤＹ信号の３つの信号を用いて
行われる（これらの信号を用いた制御は周知であるた
め、その制御内容の説明は省略する。）。これらの信号
を用いて、主制御回路１及び通信デバイス４Ａの一方が
マスタ側となり、他方がターゲット側となってＰＣＩバ
ス転送制御が行われ、主制御回路１と外部接続機器７Ａ
との間のデータ転送が可能となる。
ば、主制御回路１と外部接続機器７Ａとの間でデータ転
送を行う場合、ＰＣＩバス制御部５ＡがＰＣＩバス３に
対するバス制御を行い、外部接続制御部６Ａが外部接続
機器７Ａに対する接続についての制御を行う。ＰＣＩバ
ス上のデータ転送制御は、基本的には、ＦＲＥＡＭＥ信
号，ＩＲＤＹ信号，ＴＲＤＹ信号の３つの信号を用いて
行われる（これらの信号を用いた制御は周知であるた
め、その制御内容の説明は省略する。）。これらの信号
を用いて、主制御回路１及び通信デバイス４Ａの一方が
マスタ側となり、他方がターゲット側となってＰＣＩバ
ス転送制御が行われ、主制御回路１と外部接続機器７Ａ
との間のデータ転送が可能となる。
【０００７】また、主制御回路１と外部接続機器７Ｂ1
〜７Ｂ3 のいずれかとの間でデータ転送を行う場合、バ
スブリッジ８は主制御回路１からのアドレスデータの入
力に基づき（主制御回路１がマスタ側の場合）、通信デ
バイス４Ｂ1 ，４Ｂ2 ，４Ｂ3 のうちのいずれか１つを
選択してデータ転送路を形成する。これにより、主制御
回路１と外部接続機器７Ｂ1 〜７Ｂ3 のいずれかとの間
のデータ転送が可能となる。
〜７Ｂ3 のいずれかとの間でデータ転送を行う場合、バ
スブリッジ８は主制御回路１からのアドレスデータの入
力に基づき（主制御回路１がマスタ側の場合）、通信デ
バイス４Ｂ1 ，４Ｂ2 ，４Ｂ3 のうちのいずれか１つを
選択してデータ転送路を形成する。これにより、主制御
回路１と外部接続機器７Ｂ1 〜７Ｂ3 のいずれかとの間
のデータ転送が可能となる。
【０００８】
【発明が解決しようとする課題】ところで、何らかの異
常により上記のデータ転送が正常に行われなくなる場合
がある。異常の内容としては、例えば、通信デバイス４
Ａ，４Ｂ1 ，４Ｂ2 ，４Ｂ3 ，４Ｃ及びその他のハード
ウエアの故障、あるいはマスタ側とターゲット側との間
で転送されるアドレスデータ自体が間違っている場合等
がある。
常により上記のデータ転送が正常に行われなくなる場合
がある。異常の内容としては、例えば、通信デバイス４
Ａ，４Ｂ1 ，４Ｂ2 ，４Ｂ3 ，４Ｃ及びその他のハード
ウエアの故障、あるいはマスタ側とターゲット側との間
で転送されるアドレスデータ自体が間違っている場合等
がある。
【０００９】このような場合、オペレータは、ＬＳＩ上
に設けられている主制御回路１、通信デバイス４Ａ，４
Ｂ1 ，４Ｂ2 ，４Ｂ3 ，４Ｃ及びバスブリッジ８等の全
ての回路に対してロジックアナライザ等の解析機器を順
次適用し、異常個所又は異常原因を特定しなければなら
なかった。そして、大型のコンピュータ装置の場合に
は、ロジックアナライザの使用回数及び使用時間が多く
なり、オペレータは多大な労力を強いられる結果となっ
ていた。
に設けられている主制御回路１、通信デバイス４Ａ，４
Ｂ1 ，４Ｂ2 ，４Ｂ3 ，４Ｃ及びバスブリッジ８等の全
ての回路に対してロジックアナライザ等の解析機器を順
次適用し、異常個所又は異常原因を特定しなければなら
なかった。そして、大型のコンピュータ装置の場合に
は、ロジックアナライザの使用回数及び使用時間が多く
なり、オペレータは多大な労力を強いられる結果となっ
ていた。
【００１０】本発明は、上記事情に鑑みてなされたもの
であり、データ転送が正常に行われなくなった場合に、
異常個所又は異常原因を容易に特定することが可能な通
信用ＬＳＩを提供することを目的としている。
であり、データ転送が正常に行われなくなった場合に、
異常個所又は異常原因を容易に特定することが可能な通
信用ＬＳＩを提供することを目的としている。
【００１１】
【課題を解決するための手段】上記課題を解決するため
の手段として請求項１記載の発明は、主制御回路との間
で内部バスを介してデータ転送を行う通信デバイスを搭
載した通信用ＬＳＩにおいて、前記通信デバイスは、前
記データ転送の制御動作中は、該制御動作中であること
を示すインディケート信号を出力するインディケート信
号出力手段を備えた、ことを特徴とする。
の手段として請求項１記載の発明は、主制御回路との間
で内部バスを介してデータ転送を行う通信デバイスを搭
載した通信用ＬＳＩにおいて、前記通信デバイスは、前
記データ転送の制御動作中は、該制御動作中であること
を示すインディケート信号を出力するインディケート信
号出力手段を備えた、ことを特徴とする。
【００１２】請求項２記載の発明は、複数の通信デバイ
スに接続され、そのうちの一の通信デバイスと主制御回
路との間で内部バスを介してデータ転送を行う場合に、
該一の通信デバイスを選択してこれを内部バスに接続す
る内部バスブリッジを搭載した通信用ＬＳＩにおいて、
前記内部バスブリッジは、前記一の通信デバイスの選択
及び前記内部バスへの接続についての制御動作中は、該
制御動作中であることを示すインディケート信号を出力
するインディケート信号出力手段を備えた、ことを特徴
とする。
スに接続され、そのうちの一の通信デバイスと主制御回
路との間で内部バスを介してデータ転送を行う場合に、
該一の通信デバイスを選択してこれを内部バスに接続す
る内部バスブリッジを搭載した通信用ＬＳＩにおいて、
前記内部バスブリッジは、前記一の通信デバイスの選択
及び前記内部バスへの接続についての制御動作中は、該
制御動作中であることを示すインディケート信号を出力
するインディケート信号出力手段を備えた、ことを特徴
とする。
【００１３】
【発明の実施の形態】以下、本発明の実施形態を図に基
づき説明する。図１は本実施形態に係るインタフェイス
装置２Ａの構成を示すブロック図である。ＬＳＩのボー
ド上に形成された通信デバイス４Ａは、ＰＣＩバス制御
部５Ａ及び外部接続制御部６Ａを有しており、ＰＣＩバ
ス制御部５Ａにはインディケート信号出力部１０１が設
けられている。そして、ＬＥＤ制御部１０２及びＬＥＤ
１０３も通信デバイス４Ａに設けられている。
づき説明する。図１は本実施形態に係るインタフェイス
装置２Ａの構成を示すブロック図である。ＬＳＩのボー
ド上に形成された通信デバイス４Ａは、ＰＣＩバス制御
部５Ａ及び外部接続制御部６Ａを有しており、ＰＣＩバ
ス制御部５Ａにはインディケート信号出力部１０１が設
けられている。そして、ＬＥＤ制御部１０２及びＬＥＤ
１０３も通信デバイス４Ａに設けられている。
【００１４】インディケート信号出力部１０１は、自己
のボードがいわゆる「オンボード」状態である場合、す
なわち通信デバイス４Ａが主制御回路１と外部接続機器
７Ａとの間のデータ転送のための制御動作中である場合
に、この動作中であることを示すためのインディケート
信号を出力するものである。ＬＥＤ制御部１０２は、こ
のインディケート信号を入力して、ボード表面に取り付
けられたＬＥＤ１０３を点灯するようになっている。
のボードがいわゆる「オンボード」状態である場合、す
なわち通信デバイス４Ａが主制御回路１と外部接続機器
７Ａとの間のデータ転送のための制御動作中である場合
に、この動作中であることを示すためのインディケート
信号を出力するものである。ＬＥＤ制御部１０２は、こ
のインディケート信号を入力して、ボード表面に取り付
けられたＬＥＤ１０３を点灯するようになっている。
【００１５】また、図１では図示を省略しているが、図
２における通信デバイス４Ｂ1 ，４Ｂ2 ，４Ｂ3 ，４Ｃ
内及びバスブリッジ８内にも、同様に、インディケート
信号出力部１０１、ＬＥＤ制御部１０２、及びＬＥＤ１
０３が設けられている。
２における通信デバイス４Ｂ1 ，４Ｂ2 ，４Ｂ3 ，４Ｃ
内及びバスブリッジ８内にも、同様に、インディケート
信号出力部１０１、ＬＥＤ制御部１０２、及びＬＥＤ１
０３が設けられている。
【００１６】次に、上記のように構成された本実施形態
の動作を図１及び図２を参照しつつ説明する。主制御回
路１と外部接続機器７Ａとの間でデータ転送を行う場合
は、通信デバイス４Ａがオンボード状態となる。したが
って、通信デバイス４ＡのＰＣＩバス制御部５Ａのアク
セス動作中は、そのインディケート信号出力部１０１が
インディケート信号の出力を継続し、ＬＥＤ制御部１０
２がＬＥＤ１０３を点灯表示させる。
の動作を図１及び図２を参照しつつ説明する。主制御回
路１と外部接続機器７Ａとの間でデータ転送を行う場合
は、通信デバイス４Ａがオンボード状態となる。したが
って、通信デバイス４ＡのＰＣＩバス制御部５Ａのアク
セス動作中は、そのインディケート信号出力部１０１が
インディケート信号の出力を継続し、ＬＥＤ制御部１０
２がＬＥＤ１０３を点灯表示させる。
【００１７】また、主制御回路１と外部接続機器７Ｂ1
との間でデータ転送を行う場合は、バスブリッジ８及び
通信デバイス４Ｂ1 がオンボード状態となる。したがっ
て、バスブリッジ８及び通信デバイス４Ｂ1 の各ＰＣＩ
バス制御部のアクセス動作中は、それらのインディケー
ト信号出力部１０１がインディケート信号の出力を継続
し、ＬＥＤ制御部１０２がＬＥＤ１０３を点灯表示させ
る。同様に、主制御回路１と外部接続機器７Ｂ2 との間
でデータ転送を行う場合は、バスブリッジ８及び通信デ
バイス４Ｂ2 がオンボード状態となり、バスブリッジ８
及び通信デバイス４Ｂ2 の各ＰＣＩバス制御部のアクセ
ス動作中は、それらのインディケート信号出力部１０１
がインディケート信号の出力を継続し、ＬＥＤ制御部１
０２がＬＥＤ１０３を点灯表示させる。主制御回路１と
外部接続機器７Ｂ3 ，７ｃとの間でデータ転送を行う場
合も上記と同様の動作を行う。
との間でデータ転送を行う場合は、バスブリッジ８及び
通信デバイス４Ｂ1 がオンボード状態となる。したがっ
て、バスブリッジ８及び通信デバイス４Ｂ1 の各ＰＣＩ
バス制御部のアクセス動作中は、それらのインディケー
ト信号出力部１０１がインディケート信号の出力を継続
し、ＬＥＤ制御部１０２がＬＥＤ１０３を点灯表示させ
る。同様に、主制御回路１と外部接続機器７Ｂ2 との間
でデータ転送を行う場合は、バスブリッジ８及び通信デ
バイス４Ｂ2 がオンボード状態となり、バスブリッジ８
及び通信デバイス４Ｂ2 の各ＰＣＩバス制御部のアクセ
ス動作中は、それらのインディケート信号出力部１０１
がインディケート信号の出力を継続し、ＬＥＤ制御部１
０２がＬＥＤ１０３を点灯表示させる。主制御回路１と
外部接続機器７Ｂ3 ，７ｃとの間でデータ転送を行う場
合も上記と同様の動作を行う。
【００１８】このように、主制御回路１と外部接続機器
７Ａ，７Ｂ1 ，７Ｂ2 ，７Ｂ3 ，７Ｃとの間でデータ転
送を行っている間に、何らかの異常が発生し、データ転
送が正常に行われなくなったとする。すると、オペレー
タは、インタフェイス装置２Ａ，２Ｂ，２Ｃのカバーを
取り外した状態で、各通信デバイス４Ａ，４Ｂ1 ，４Ｂ
2 ，４Ｂ3 ，４Ｃ及びバスブリッジ８に上記と同様のア
クセス動作を行わせるようにする。
７Ａ，７Ｂ1 ，７Ｂ2 ，７Ｂ3 ，７Ｃとの間でデータ転
送を行っている間に、何らかの異常が発生し、データ転
送が正常に行われなくなったとする。すると、オペレー
タは、インタフェイス装置２Ａ，２Ｂ，２Ｃのカバーを
取り外した状態で、各通信デバイス４Ａ，４Ｂ1 ，４Ｂ
2 ，４Ｂ3 ，４Ｃ及びバスブリッジ８に上記と同様のア
クセス動作を行わせるようにする。
【００１９】この場合、これらの各ボード上にはＬＥＤ
１０３が取り付けられているので、オペレータはその点
灯動作の有無を確認することによって、正常に機能して
いない通信デバイスを容易に特定することができる。例
えば、ハードウエアに故障が発生している通信デバイス
がある場合には、そのＬＥＤが点灯せず、あるいは、ア
ドレスデータに誤りがある場合には、点灯すべき通信デ
バイスのＬＥＤが点灯せず、逆に、点灯すべきでない通
信デバイスのＬＥＤが点灯したりするなどの事態が生じ
る。
１０３が取り付けられているので、オペレータはその点
灯動作の有無を確認することによって、正常に機能して
いない通信デバイスを容易に特定することができる。例
えば、ハードウエアに故障が発生している通信デバイス
がある場合には、そのＬＥＤが点灯せず、あるいは、ア
ドレスデータに誤りがある場合には、点灯すべき通信デ
バイスのＬＥＤが点灯せず、逆に、点灯すべきでない通
信デバイスのＬＥＤが点灯したりするなどの事態が生じ
る。
【００２０】上記のように、各通信デバイスに新たに追
加したインディケート信号出力部１０１、ＬＥＤ制御部
１０２、及びＬＥＤ１０３の機能は、各通信デバイスが
正常に動作している限りにおいては、何ら格別の効果を
奏するものではない。そして、これらの機能を付加する
ことにより、さほど大きなものではないものの、幾分か
はコストがアップすることは事実である。したがって、
一見すると、これらの機能は不要なものであるように見
える。しかし、一旦、何らかの異常によりデータ転送が
正常に行われなくなった場合に、オペレータが従来負担
していた多大な労力を考えると、これらの機能の追加に
よりもたらされるメリットは幾分かのコストアップを補
って余りあるものと言える。
加したインディケート信号出力部１０１、ＬＥＤ制御部
１０２、及びＬＥＤ１０３の機能は、各通信デバイスが
正常に動作している限りにおいては、何ら格別の効果を
奏するものではない。そして、これらの機能を付加する
ことにより、さほど大きなものではないものの、幾分か
はコストがアップすることは事実である。したがって、
一見すると、これらの機能は不要なものであるように見
える。しかし、一旦、何らかの異常によりデータ転送が
正常に行われなくなった場合に、オペレータが従来負担
していた多大な労力を考えると、これらの機能の追加に
よりもたらされるメリットは幾分かのコストアップを補
って余りあるものと言える。
【００２１】すなわち、インディケート信号出力部から
出力されるインディケート信号をインディケータとして
使用することが可能となるため、オンボードがアクセス
されたか否かを容易に判別することができる。したがっ
て、このインディケート信号と同期して他の信号をモニ
タリングすることができるので、全てのアクセスサイク
ルにおいて他の信号解析を行うことができ、障害解析を
容易に行うことができるようになる。
出力されるインディケート信号をインディケータとして
使用することが可能となるため、オンボードがアクセス
されたか否かを容易に判別することができる。したがっ
て、このインディケート信号と同期して他の信号をモニ
タリングすることができるので、全てのアクセスサイク
ルにおいて他の信号解析を行うことができ、障害解析を
容易に行うことができるようになる。
【００２２】上記の実施形態では、インディケート信号
の利用形態としてＬＥＤの点灯表示という最も単純な例
につき説明したが、このインディケート信号は種々の形
態で利用することが可能である。例えば、インディケー
ト信号を信号解析回路やシステム診断回路に出力して利
用することができ、あるいは、ＣＲＴ等の表示機器にア
クセス動作中の通信デバイス名などを表示させるように
することもできる。また、上記実施形態では、接続され
るバスがＰＣＩバスである場合につき説明したが、勿論
これに限定されるわけではなく、種々の内部バスに本発
明を適用することができる。
の利用形態としてＬＥＤの点灯表示という最も単純な例
につき説明したが、このインディケート信号は種々の形
態で利用することが可能である。例えば、インディケー
ト信号を信号解析回路やシステム診断回路に出力して利
用することができ、あるいは、ＣＲＴ等の表示機器にア
クセス動作中の通信デバイス名などを表示させるように
することもできる。また、上記実施形態では、接続され
るバスがＰＣＩバスである場合につき説明したが、勿論
これに限定されるわけではなく、種々の内部バスに本発
明を適用することができる。
【００２３】
【発明の効果】以上のように、本発明によれば、データ
転送が正常に行われなくなった場合に、異常個所又は異
常原因を容易に特定することが可能な通信用ＬＳＩを提
供することができる。
転送が正常に行われなくなった場合に、異常個所又は異
常原因を容易に特定することが可能な通信用ＬＳＩを提
供することができる。
【図１】本発明の実施形態の要部の構成を示すブロック
図。
図。
【図２】コンピュータ装置内の内部バスの接続構成を示
すブロック図。
すブロック図。
１ 主制御回路 ２Ａ，２Ｂ，２Ｃ インタフェイス装置 ３ ＰＣＩバス ４Ａ，４Ｂ1 ，４Ｂ2 ，４Ｂ3 ，４Ｃ 通信デバイス ５Ａ ＰＣＩバス制御部 ６Ａ 外部接続制御部 ７Ａ，７Ｂ1 ，７Ｂ2 ，７Ｂ3 ，７Ｃ 外部接続機器 ８ バスブリッジ １０１ インディケート信号出力部 １０２ ＬＥＤ制御部 １０３ ＬＥＤ
Claims (2)
- 【請求項１】主制御回路との間で内部バスを介してデー
タ転送を行う通信デバイスを搭載した通信用ＬＳＩにお
いて、 前記通信デバイスは、前記データ転送の制御動作中は、
該制御動作中であることを示すインディケート信号を出
力するインディケート信号出力手段を備えた、 ことを特徴とする通信用ＬＳＩ。 - 【請求項２】複数の通信デバイスに接続され、そのうち
の一の通信デバイスと主制御回路との間で内部バスを介
してデータ転送を行う場合に、該一の通信デバイスを選
択してこれを内部バスに接続する内部バスブリッジを搭
載した通信用ＬＳＩにおいて、 前記内部バスブリッジは、前記一の通信デバイスの選択
及び前記内部バスへの接続についての制御動作中は、該
制御動作中であることを示すインディケート信号を出力
するインディケート信号出力手段を備えた、 ことを特徴とする通信用ＬＳＩ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6831597A JPH10260762A (ja) | 1997-03-21 | 1997-03-21 | 通信用ｌｓｉ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6831597A JPH10260762A (ja) | 1997-03-21 | 1997-03-21 | 通信用ｌｓｉ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH10260762A true JPH10260762A (ja) | 1998-09-29 |
Family
ID=13370273
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP6831597A Pending JPH10260762A (ja) | 1997-03-21 | 1997-03-21 | 通信用ｌｓｉ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH10260762A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2007232641A (ja) * | 2006-03-02 | 2007-09-13 | Nec Corp | タイミング解析システム、デバイス及びタイミング解析方法 |
-
1997
- 1997-03-21 JP JP6831597A patent/JPH10260762A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2007232641A (ja) * | 2006-03-02 | 2007-09-13 | Nec Corp | タイミング解析システム、デバイス及びタイミング解析方法 |
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