JPH10270475A - Pressure contact type semiconductor device - Google Patents
Pressure contact type semiconductor deviceInfo
- Publication number
- JPH10270475A JPH10270475A JP6982097A JP6982097A JPH10270475A JP H10270475 A JPH10270475 A JP H10270475A JP 6982097 A JP6982097 A JP 6982097A JP 6982097 A JP6982097 A JP 6982097A JP H10270475 A JPH10270475 A JP H10270475A
- Authority
- JP
- Japan
- Prior art keywords
- electrode
- gate
- cathode
- anode
- terminal plate
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
Landscapes
- Thyristors (AREA)
- Die Bonding (AREA)
Abstract
(57)【要約】
【課題】 主電流を確実にゲート回路に転流することが
できるとともに、ゲートドライバへの取り付けが容易に
できる圧接型半導体装置を提供する。
【解決手段】 ゲートドライバGD1はGCTサイリス
タ100をサイリスタ挿入部9に挿入した状態で、カソ
ードスタック電極SK1の上に載置される。そして、G
CTサイリスタ100を取り囲むように絶縁円筒体(ゲ
ート端子板圧接手段)50を配設する。
(57) [Problem] To provide a press-contact type semiconductor device which can surely commutate a main current to a gate circuit and can be easily attached to a gate driver. SOLUTION: A gate driver GD1 is mounted on a cathode stack electrode SK1 with a GCT thyristor 100 inserted in a thyristor insertion section 9. And G
An insulating cylindrical body (gate terminal plate pressing means) 50 is provided so as to surround the CT thyristor 100.
Description
【0001】[0001]
【発明の属する技術分野】本発明は圧接型半導体装置に
関し、特にゲート転流型ターンオフサイリスタ(GC
T)に関する。BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a pressure contact type semiconductor device, and more particularly to a gate commutation type turn-off thyristor (GC).
T).
【0002】[0002]
【従来の技術】ゲート転流型ターンオフサイリスタ(以
後、GCTサイリスタと呼称)は、ゲートターンオフサ
イリスタ(以後、GTOと呼称)と異なり、ゲート逆電
流の上昇率をGTOサイリスタの100倍程度に高め、
主電流をすべてゲート回路に流して(転流して)ターン
オフ動作を行うものである。2. Description of the Related Art A gate commutation type turn-off thyristor (hereinafter, referred to as a GCT thyristor) is different from a gate turn-off thyristor (hereinafter, referred to as a GTO) in that the rate of increase of a gate reverse current is increased to about 100 times that of a GTO thyristor.
The turn-off operation is performed by flowing (commutating) all the main current to the gate circuit.
【0003】図8および図9に、GCTサイリスタ90
の断面構成および平面構成を示す。なお、図8は、図9
に示す矢印方向からGCTサイリスタ90を見た正面図
である。従って、図9の線A−Aに関する縦断面図が図
8にあたる。FIGS. 8 and 9 show a GCT thyristor 90.
1 shows a cross-sectional configuration and a planar configuration of FIG. 8 is the same as FIG.
FIG. 5 is a front view of the GCT thyristor 90 viewed from the direction of the arrow shown in FIG. Accordingly, FIG. 8 is a longitudinal sectional view taken along the line AA in FIG.
【0004】図8において、GCTサイリスタ90の各
セグメントが形成された半導体基板28の下側表面の外
周部側に位置する面上に、ゲート電極29aが形成され
ており、さらにゲート電極29aよりも内側の半導体基
板28の下側表面上には、各セグメントの位置に対応し
て各カソード電極29bが形成されている。In FIG. 8, a gate electrode 29a is formed on a surface located on the outer peripheral side of the lower surface of the semiconductor substrate 28 on which each segment of the GCT thyristor 90 is formed. On the lower surface of the inner semiconductor substrate 28, each cathode electrode 29b is formed corresponding to the position of each segment.
【0005】半導体基板28の下側表面上のカソード電
極29bの下には、カソード歪緩衝板30およびカソー
ドポスト電極31が順に配設されている。一方、半導体
基板28の図示しないアノード電極の表面(カソード電
極29bと反対側の面)上には、アノード歪緩衝板32
およびアノードポスト電極33が順に配設されている。Under the cathode electrode 29b on the lower surface of the semiconductor substrate 28, a cathode strain buffer plate 30 and a cathode post electrode 31 are sequentially arranged. On the other hand, an anode distortion buffer plate 32 is provided on the surface of the anode electrode (not shown) of the semiconductor substrate 28 (the surface opposite to the cathode electrode 29b).
And an anode post electrode 33 are sequentially arranged.
【0006】また、半導体基板28のゲート電極29a
の表面に接するようにリング状ゲート電極34が配設さ
れており、リング状金属板からなるゲート端子板38
が、その内周端縁面がリングゲート電極34と摺動可能
になるように、同電極34に対して接触・配置されてい
る。The gate electrode 29a of the semiconductor substrate 28
A ring-shaped gate electrode 34 is disposed so as to be in contact with the surface of the gate terminal plate 38 made of a ring-shaped metal plate.
However, it is arranged in contact with the inner peripheral edge surface of the ring gate electrode 34 so that the inner peripheral edge surface can slide with the electrode 34.
【0007】そして、ゲート端子板38とともに、リン
グ状ゲート電極34をゲート電極29aに対して押圧す
るための皿バネあるいは波バネのようなリング状の弾性
体35が配設されている。なお、弾性体35はリング状
絶縁体36を介してゲート端子板38を押圧する構成と
なっている。Along with the gate terminal plate 38, a ring-shaped elastic body 35 such as a disc spring or a wave spring for pressing the ring-shaped gate electrode 34 against the gate electrode 29a is provided. The elastic body 35 presses the gate terminal plate 38 via the ring-shaped insulator 36.
【0008】また、リング状ゲート電極34をカソード
歪緩衝板30およびカソードポスト電極31から絶縁す
るための絶縁シート等からなる絶縁体37が、カソード
歪緩衝板30およびカソードポスト電極31の壁面に沿
って配設されている。An insulator 37 made of an insulating sheet or the like for insulating the ring-shaped gate electrode 34 from the cathode strain buffer plate 30 and the cathode post electrode 31 extends along the wall surfaces of the cathode strain buffer plate 30 and the cathode post electrode 31. It is arranged.
【0009】カソードポスト電極31の端縁部にはカソ
ードフランジ26が固着され、アノードポスト電極33
にはアノードフランジ40が固着されている。そして、
カソードフランジ26とアノードフランジ40との間に
は、GCTサイリスタ90の主要部を取り囲むように、
セラミック等の絶縁物で構成された絶縁筒41が配設さ
れている。絶縁筒41は、ゲート端子板38を挟んで上
下に分割されているとともに、沿面距離を長くするため
の突起部42を有した構成である。従って、ゲート端子
板38の外周側部分は絶縁筒41の側面から外部に突出
することになる。なお、絶縁筒41はゲート端子板38
の上下表面に気密に固着されている。A cathode flange 26 is fixed to the edge of the cathode post electrode 31, and an anode post electrode 33
Has an anode flange 40 fixed thereto. And
Between the cathode flange 26 and the anode flange 40, so as to surround the main part of the GCT thyristor 90,
An insulating cylinder 41 made of an insulating material such as ceramic is provided. The insulating cylinder 41 has a configuration in which the insulating cylinder 41 is divided vertically with the gate terminal plate 38 interposed therebetween, and has a protrusion 42 for increasing the creepage distance. Therefore, the outer peripheral side portion of the gate terminal plate 38 projects outside from the side surface of the insulating cylinder 41. The insulating cylinder 41 is provided on the gate terminal plate 38.
It is air-tightly fixed to the upper and lower surfaces.
【0010】そして、絶縁筒41の下側端面に固着され
た接続板43aがカソードフランジ26と気密に固着さ
れ、絶縁筒41の上側端面に固着された接続板43bが
アノードフランジ40と気密に固着されており、これに
よってGCTサイリスタ90が密閉されたパッケージ構
造になっている。なお、この内部は、不活性ガスで置換
されている。A connecting plate 43a fixed to the lower end face of the insulating cylinder 41 is airtightly fixed to the cathode flange 26, and a connecting plate 43b fixed to the upper end face of the insulating cylinder 41 is airtightly fixed to the anode flange 40. As a result, the GCT thyristor 90 has a sealed package structure. The interior is replaced with an inert gas.
【0011】また、ゲート端子板38の端縁部には、取
り付け穴21が所定の間隔で複数個設けられている。図
9に示すように、GCTサイリスタ90の外観は円盤形
状であり、カソードポスト電極31、カソードフランジ
26、ゲート端子板38が順に同心円状に配設されてい
る。Further, a plurality of mounting holes 21 are provided at predetermined intervals in an edge portion of the gate terminal plate 38. As shown in FIG. 9, the appearance of the GCT thyristor 90 has a disk shape, and the cathode post electrode 31, the cathode flange 26, and the gate terminal plate 38 are arranged concentrically in this order.
【0012】ここで、図10にGCTサイリスタのゲー
トとカソード間に、ゲートターンオン制御電流を発生さ
せるゲートドライバGDの外観図を示す。また、図11
にゲートドライバGDにGCTサイリスタ90を取り付
けた状態の断面図を示す。FIG. 10 is an external view of a gate driver GD for generating a gate turn-on control current between the gate and the cathode of the GCT thyristor. FIG.
2 shows a cross-sectional view of a state where the GCT thyristor 90 is attached to the gate driver GD.
【0013】図10および図11において、ゲートドラ
イバ回路部15からは、ゲートドライバ回路部15とG
CTサイリスタ90とを電気的に接続するための、回路
パターンが形成された接続基板70が延在している。In FIG. 10 and FIG. 11, the gate driver circuit 15 and the G
A connection substrate 70 on which a circuit pattern is formed for electrically connecting to the CT thyristor 90 extends.
【0014】図10において、接続基板70にはGCT
サイリスタ90を挿入するサイリスタ挿入部71ととも
に、GCTサイリスタ90のゲート端子板38を固定す
るためのネジ穴21Aが設けられている。GCTサイリ
スタ90は、サイリスタ挿入部71にカソードポスト電
極31が下側になるように挿入され、ゲート端子板38
の取り付け穴21とネジ穴21Aの位置を合わせ、ネジ
止めで固定される。In FIG. 10, a connection board 70 has a GCT
A screw hole 21A for fixing the gate terminal plate 38 of the GCT thyristor 90 is provided together with the thyristor insertion portion 71 for inserting the thyristor 90. The GCT thyristor 90 is inserted into the thyristor insertion portion 71 such that the cathode post electrode 31 faces down, and the gate terminal plate 38
The mounting hole 21 and the screw hole 21A are aligned with each other, and are fixed by screws.
【0015】図11はGCTサイリスタ90をゲートド
ライバGDに取り付けた状態を模式的に表した図であ
り、図10の線B−Bに関する縦断面図が図11にあた
る。なお、図11においては接続基板70の構成のみを
断面図として示している。FIG. 11 is a diagram schematically showing a state in which the GCT thyristor 90 is mounted on the gate driver GD. FIG. 11 is a longitudinal sectional view taken along line BB in FIG. In FIG. 11, only the configuration of the connection substrate 70 is shown as a cross-sectional view.
【0016】図11において、接続基板70はゲートリ
ード基板72、カソードリード基板73、両基板72と
73とを絶縁するための絶縁体74とを有している。こ
のような多層基板構造を設けたのは、ゲートドライバ回
路部15の内部インダクタンスを低減するためである。
なお、カソードリード基板73およびゲートリード基板
72は、ゲートターンオン制御電流の伝達経路となる。In FIG. 11, the connection board 70 has a gate lead board 72, a cathode lead board 73, and an insulator 74 for insulating the two boards 72 and 73 from each other. The reason why such a multilayer substrate structure is provided is to reduce the internal inductance of the gate driver circuit unit 15.
The cathode lead substrate 73 and the gate lead substrate 72 serve as a transmission path of a gate turn-on control current.
【0017】また、カソードポスト電極31およびアノ
ードポスト電極33の外部には、両者を互いに向き合う
方向に付勢し、カソード歪緩衝板30およびアノード歪
緩衝板32を半導体基板28に圧接するためのカソード
スタック電極SKおよびアノードスタックSAが配置さ
れている。The cathode post electrode 31 and the anode post electrode 33 are urged to face each other in a direction facing each other to press the cathode strain buffer plate 30 and the anode strain buffer plate 32 against the semiconductor substrate 28. A stack electrode SK and an anode stack SA are arranged.
【0018】以上のように、GCTサイリスタ90は、
半導体基板28上に形成されたゲート電極29a側から
延在するリング状ないし円盤状のゲート端子板38を有
しており、当該ゲート端子板38の外周部分を直接ゲー
トドライバGDの接続基板70にネジ75で固定してい
た。As described above, the GCT thyristor 90 is
It has a ring-shaped or disk-shaped gate terminal plate 38 extending from the gate electrode 29a formed on the semiconductor substrate 28, and the outer peripheral portion of the gate terminal plate 38 is directly connected to the connection substrate 70 of the gate driver GD. It was fixed with the screw 75.
【0019】ここで、GCTサイリスタとゲートドライ
バの動作について説明する。図12にGCTサイリスタ
と、それを動作させるための回路構成を示す。図12に
おいて、各参照符号3はGCTサイリスタであり、この
GCTサイリスタ3のゲート電極3Gとカソード電極3
Kのノード13との間に、ゲートドライバ4(駆動制御
手段)が接続される。なお、ゲートドライバ4は先に説
明したゲートドライバ回路部15と実質的に同じであ
る。Here, the operation of the GCT thyristor and the gate driver will be described. FIG. 12 shows a GCT thyristor and a circuit configuration for operating the GCT thyristor. In FIG. 12, each reference numeral 3 denotes a GCT thyristor, and the gate electrode 3G and the cathode electrode 3 of the GCT thyristor 3 are shown.
The gate driver 4 (drive control means) is connected between the gate driver 4 and the K node 13. The gate driver 4 is substantially the same as the gate driver circuit section 15 described above.
【0020】ゲートドライバ4は、その駆動電源4a
(電源電圧VGD(例えば20V))、コンデンサ4b、
インダクタンス4C、トランジスタ4dから成る。The gate driver 4 has a driving power supply 4a
(Power supply voltage V GD (for example, 20 V)), capacitor 4b,
It has an inductance 4C and a transistor 4d.
【0021】このゲートドライバ4は、GCTサイリス
タ3をターンオンさせるためのターンオン制御電流IG
を発生して、配線経路ないしラインL1を介してこの電
流IGをゲート電極3Gに印加する。これに応じて、G
CTサイリスタ3はオン状態となる。また、符号11は
ノードであり、9は同装置10を駆動するための電源、
すなわち主回路用電源(電源電圧VDD)である。The gate driver 4 has a turn-on control current I G for turning on the GCT thyristor 3.
The generated, the wiring path or via the line L1 is applied to the current I G to the gate electrode 3G. In response, G
CT thyristor 3 is turned on. Reference numeral 11 denotes a node, 9 denotes a power supply for driving the device 10,
That is, it is a main circuit power supply (power supply voltage V DD ).
【0022】他方、符号1は、GCTサイリスタ3がタ
ーンオンした時に流れる主電流ないし陽極電流IAの上
昇率dIA/dtを抑制するためのインダクタンスであ
り、2は、GCTサイリスタ3がターンオフした時にイ
ンダクタンス1に発生するエネルギーを還流させるため
の還流用ダイオードである。[0022] On the other hand, reference numeral 1 is an inductance for suppressing the increase rate dI A / dt of the primary current to the anode current I A flows when the GCT thyristor 3 is turned on, 2, when the GCT thyristor 3 is turned off This is a return diode for returning energy generated in the inductance 1.
【0023】符号5は、アノード電極3Aのノード11
とカソード電極3Kのノード12との間にGCTサイリ
スタ3に対して並列に接続されており、かつGCTサイ
リスタ3がターンオフした時にアノード・カソード電極
間電圧VAKの上昇に伴って発生するピーク電圧のみを抑
制するためのピーク電圧抑制回路である。同回路5は、
上記電圧VAKがターンオフ時にGCTサイリスタ3の電
圧阻止能力に応じて定まる所定の電圧値に所定の時間だ
け上記電圧VAKを保持ないしクランプする機能を有す
る。Reference numeral 5 denotes a node 11 of the anode electrode 3A.
And the node 12 of the cathode electrode 3K are connected in parallel to the GCT thyristor 3, and only the peak voltage generated as the anode-cathode electrode voltage V AK rises when the GCT thyristor 3 is turned off. Is a peak voltage suppression circuit for suppressing the peak voltage. The circuit 5
When the voltage V AK is turned off, the voltage V AK has a function of holding or clamping the voltage V AK for a predetermined time to a predetermined voltage value determined according to the voltage blocking ability of the GCT thyristor 3.
【0024】なお、従来のGTOサイリスタでは、ター
ンオフ時に、主電流IAより分流してゲートドライバ4
側へ流入していたが、GCTサイリスタではゲート逆電
流IGQの変化率ないし上昇率(勾配)dIGQ/dtの絶
対値を出来る限り大きくして(理想的には、|dIGQ/
dt|は∞)、主電流IAの全てをゲート逆電流IGQと
してゲートドライバ4を介してノード12へ流すことと
する。すなわち、主電流IAとゲート逆電流IGQとの比
の絶対値で定まるターンオフゲインG(=|IA/IGQ
|)を1以下(G≦1)に設定することで、主電流IA
の全てを、ターンオン制御電流IGとは逆方向に、アノ
ード電極3Aからゲート電極3Gを介してゲートドライ
バ4及びノード12側へと転流させ、以てGCTサイリ
スタ3をターンオフさせる。このとき、アノード電極3
Aからカソード電極3Kへ向けて直接GCTサイリスタ
3内部を流れるカソード電流IKは、直ちに全く流れな
くなる。その意味で、本方式は、主電流IAの分流では
なくて、「主電流IAの転流」を実現しているのであ
る。[0024] In the conventional GTO thyristor, during turn-off, the gate driver 4 and diverted from the main current I A
It had flowed to the side, the at GCT thyristor by increasing as much as possible the absolute value of the rate of change or rate of rise of the gate reverse current I GQ (gradient) dI GQ / dt (ideally, | dI GQ /
dt | is ∞), and to flow all of the main current I A to the node 12 via the gate driver 4 as the gate reverse current I GQ. That is, the main current I A and the gate reverse current I GQ and the ratio of the absolute value determined turn-off gain G (= | I A / I GQ
|) Is set to 1 or less (G ≦ 1), so that the main current I A
All, the turn-on control current I G in the reverse direction, from the anode electrode 3A through the gate electrode 3G was commutated to the gate driver 4 and node 12 side, turning off the GCT thyristor 3 Te following. At this time, the anode electrode 3
The cathode current I K flowing through the GCT thyristor 3 directly from A to the cathode electrode 3K immediately stops flowing at all. In that sense, this method, rather than the shunt of the main current I A, with each other to achieve a "commutation of the main current I A."
【0025】ここで、ゲートドライバ4の駆動電源(主
電源)4aの電源電圧値VGDと、ループR1のインダク
タンス値との関係に応じて、上昇率dIGQ/dtの値を
変化させることができるので、両者4(4a)、R1の
値を適切に設定することで、上昇率|dIGQ/dt|を
限りなく∞値に近い極めて大きな値に設定してやれば、
極めて短時間で主電流IAを全てゲートドライバ4側へ
転流させることができる。[0025] Here, the power supply voltage value V GD of the driving power source (mains) 4a of the gate driver 4, depending on the relationship between the inductance value of the loop R1, is possible to change the value of the increase rate dI GQ / dt It is possible to set the rise rate | dI GQ / dt | to an extremely large value that is as close as possible to the ∞ value by appropriately setting the values of both 4 (4a) and R1.
Can be very short time it flows the main current I A rolling a to all gate driver 4 side.
【0026】他方、そのようなゲート逆電流IGQの転流
をゲートドライバ4単独で以て実現することは、当該ド
ライバ4の駆動電源4aがとりうる電源電圧値VGDに限
界があるため容易でないが、その反面、ゲートドライバ
4の駆動電源電圧VGDを設定可能な実用値に設定してお
き、ゲートターンオフゲインGを1以下とするために必
要な上昇率dIGQ/dtの絶対値を実現しうるループR
1の内部インダクタンスの値を設定することは、現実に
可能である。On the other hand, it is easy to realize such a commutation of the gate reverse current IGQ by the gate driver 4 alone because there is a limit in the power supply voltage value V GD that the driving power supply 4a of the driver 4 can take. However, on the other hand, the driving power supply voltage V GD of the gate driver 4 is set to a practical value that can be set, and the absolute value of the rate of rise dI GQ / dt required to set the gate turn-off gain G to 1 or less is set. Realizable loop R
It is actually possible to set the value of the internal inductance of 1.
【0027】そこで、ゲート電極3Gからゲートドライ
バ4までのラインL1と、ゲートドライバ4と、ゲート
ドライバ4からノード13を介してカソード電極3Kま
でのラインL2と、ゲート・カソード電極間のGCTサ
イリスタ3内部の経路とからなるループないし経路R1
内の(浮遊)内部インダクタンスの値を、ターンオフゲ
インGを1以下とするのに必要な値にまで低減させるこ
とが求められる。Therefore, a line L1 from the gate electrode 3G to the gate driver 4, a gate driver 4, a line L2 from the gate driver 4 to the cathode 3K via the node 13, and a GCT thyristor 3 between the gate and the cathode. Loop or route R1 consisting of internal route
(Floating) internal inductance is required to be reduced to a value required to make the turn-off gain G 1 or less.
【0028】[0028]
【発明が解決しようとする課題】以上説明したように、
従来のGCTサイリスタ90においては、ゲート逆電流
の上昇率(dIGQ/dt)を増加させるために、ゲート
電極をリング状にすること、および、GCTサイリスタ
のゲート端子板とゲートドライバとの接触面積を広くし
て、ゲートドライバとGCTサイリスタとの間のトータ
ルインダクタンスを低減する構成としている。As described above,
In the conventional GCT thyristor 90, the gate electrode is formed in a ring shape in order to increase the rate of rise (dI GQ / dt) of the gate reverse current, and the contact area between the gate terminal plate of the GCT thyristor and the gate driver is increased. To reduce the total inductance between the gate driver and the GCT thyristor.
【0029】しかし、ゲート端子板38はゲートドライ
バGDの接続基板70にネジ止めで固定される構造であ
ったので、ネジの締め加減やネジ穴の配置によっては、
ゲート端子板38が接続基板70に均一に接触しないと
いう状態になり、接触が不十分な部分からは主電流をゲ
ート回路に転流することができず、ターンオフ失敗によ
る素子破壊につながる可能性があった。また、複数のネ
ジを使用するので作業性が悪いという問題もあった。However, since the gate terminal plate 38 is fixed to the connection board 70 of the gate driver GD by screws, depending on the degree of screw tightening and the arrangement of screw holes,
The gate terminal plate 38 does not uniformly contact the connection substrate 70, and the main current cannot be diverted to the gate circuit from the insufficiently contacted portion, which may lead to device breakdown due to turn-off failure. there were. There is also a problem that workability is poor because a plurality of screws are used.
【0030】本発明は上記のような問題点を解消するた
めになされたもので、主電流を確実にゲート回路に転流
することができるとともに、ゲートドライバへの取り付
けが容易にできる圧接型半導体装置を提供する。SUMMARY OF THE INVENTION The present invention has been made to solve the above-described problems, and a press-contact type semiconductor that can reliably transfer a main current to a gate circuit and can be easily mounted on a gate driver. Provide equipment.
【0031】[0031]
【課題を解決するための手段】本発明に係る請求項1記
載の圧接型半導体装置は、一方主面の外周端縁部に沿っ
てゲート電極が形成され、該ゲート電極の内側にカソー
ド電極が形成され、他方主面にアノード電極が形成され
た半導体基板と、一方端面が前記ゲート電極に接触する
リング状ゲート電極と、前記カソード電極に電気的に接
続されるカソードポスト電極と、前記アノード電極に電
気的に接続されるアノードポスト電極と、前記カソード
ポスト電極および前記アノードポスト電極を取り囲むよ
うに配設され、少なくとも前記半導体基板および前記リ
ング状ゲート電極を内包する電気絶縁性の絶縁筒と、内
周端縁部が前記リング状ゲート電極に電気的に接続さ
れ、外周端縁部が前記絶縁筒の側面から突出するゲート
端子板とを備え、前記カソードポスト電極および前記ア
ノードポスト電極の外側にそれぞれ配設された、カソー
ドスタック電極およびアノードスタック電極によって、
前記カソードポスト電極および前記アノードポスト電極
を互いに向き合う方向に付勢し、両者を前記カソード電
極および前記アノード電極に圧接するとともに、前記ゲ
ート電極と前記カソード電極間に、ゲートターンオン制
御電流を発生させるゲートドライバが前記ゲート端子板
および前記カソードポスト電極に電気的に接続される圧
接型半導体装置において、前記ゲートドライバが、前記
ゲート端子板に直接に接触し、前記ゲートターンオン制
御電流の伝達経路となるゲートリード基板を有し、前記
圧接型半導体装置が、前記カソードポスト電極および前
記アノードポスト電極の圧接に伴って、前記ゲート端子
板の外周端縁部を前記ゲートリード基板に圧接するゲー
ト端子板圧接手段をさらに備えている。According to a first aspect of the present invention, there is provided a press-contact type semiconductor device, wherein a gate electrode is formed along an outer peripheral edge of one main surface, and a cathode electrode is formed inside the gate electrode. A semiconductor substrate having an anode electrode formed on the other main surface, a ring-shaped gate electrode having one end surface in contact with the gate electrode, a cathode post electrode electrically connected to the cathode electrode, and the anode electrode An anode post electrode electrically connected to, and disposed so as to surround the cathode post electrode and the anode post electrode, an electrically insulating insulating cylinder including at least the semiconductor substrate and the ring-shaped gate electrode, A gate terminal plate having an inner peripheral edge electrically connected to the ring-shaped gate electrode and an outer peripheral edge protruding from a side surface of the insulating cylinder; Each outside the cathode post electrode and the anode post electrode disposed, by the cathode stack electrode and an anode stacked electrode,
A gate that urges the cathode post electrode and the anode post electrode in directions facing each other, presses them both against the cathode electrode and the anode electrode, and generates a gate turn-on control current between the gate electrode and the cathode electrode. In a press-contact type semiconductor device in which a driver is electrically connected to the gate terminal plate and the cathode post electrode, the gate driver directly contacts the gate terminal plate and serves as a transmission path for the gate turn-on control current. A gate terminal plate press-contact means having a lead substrate, wherein the press-contact type semiconductor device press-connects an outer peripheral edge of the gate terminal plate to the gate lead substrate with press-contact of the cathode post electrode and the anode post electrode; Is further provided.
【0032】本発明に係る請求項2記載の圧接型半導体
装置は、前記ゲートドライバが、前記カソードポスト電
極および前記アノードポスト電極の圧接に伴って、前記
カソードポスト電極の端面に圧接され、前記ゲートター
ンオン制御電流の伝達経路となるカソードリード基板を
さらに有し、前記ゲートリード基板およびカソードリー
ド基板は積層されて積層体を構成し、前記積層体は、前
記カソードポスト電極側を挿入した場合に、前記カソー
ドポスト電極の端面が底面部となる前記カソードリード
基板に接触し、前記ゲート端子板の外周端縁部が、周縁
部となる前記ゲートリード基板上に接触する寸法を有し
た有底孔である挿入部を有し、前記ゲート端子板圧接手
段は、その内周直径が、前記絶縁筒を取り囲む大きさに
設定された電気絶縁性の絶縁円筒体であって、前記アノ
ードスタック電極は、少なくとも前記絶縁円筒体の外周
までを覆う寸法を有し、前記カソードポスト電極および
前記アノードポスト電極の圧接の際に、前記絶縁円筒体
が前記ゲート端子板の外周端縁部と前記ゲートリード基
板とを圧接するものである。According to a second aspect of the present invention, in the pressure contact type semiconductor device, the gate driver is pressed against an end face of the cathode post electrode with the pressure contact between the cathode post electrode and the anode post electrode. A cathode lead substrate serving as a transmission path of a turn-on control current is further provided, wherein the gate lead substrate and the cathode lead substrate are stacked to form a stacked body, and the stacked body is configured such that when the cathode post electrode side is inserted, An end surface of the cathode post electrode is in contact with the cathode lead substrate serving as a bottom surface portion, and an outer peripheral edge portion of the gate terminal plate is a bottomed hole having a dimension to be in contact with the gate lead substrate serving as a peripheral portion. An electrical connection having a certain insertion portion, wherein the gate terminal plate press-contact means has an inner diameter set to a size surrounding the insulating cylinder. The anode stack electrode has a dimension that covers at least the outer periphery of the insulating cylinder, and when the cathode post electrode and the anode post electrode are pressed against each other, the insulating cylinder is The outer peripheral edge of the gate terminal plate is brought into pressure contact with the gate lead substrate.
【0033】本発明に係る請求項3記載の圧接型半導体
装置は、前記絶縁円筒体が、少なくとも軸方向に可撓性
を有している。According to a third aspect of the present invention, the insulating cylindrical body has flexibility at least in an axial direction.
【0034】本発明に係る請求項4記載の圧接型半導体
装置は、前記絶縁円筒体が、少なくとも一部分に、軸方
向に可撓性を有する部材を備えた多層構造体である。According to a fourth aspect of the present invention, in the press-contact type semiconductor device, the insulating cylindrical body is a multilayer structure having at least a part thereof provided with a member having flexibility in the axial direction.
【0035】本発明に係る請求項5記載の圧接型半導体
装置は、前記絶縁円筒体が、前記アノードスタック電極
の所定位置に固着されている。In the pressure contact type semiconductor device according to a fifth aspect of the present invention, the insulating cylinder is fixed to a predetermined position of the anode stack electrode.
【0036】本発明に係る請求項6記載の圧接型半導体
装置は、一方主面の外周端縁部に沿ってゲート電極が形
成され、該ゲート電極の内側にカソード電極が形成さ
れ、他方主面にアノード電極が形成された半導体基板
と、一方端面が前記ゲート電極に接触するリング状ゲー
ト電極と、前記カソード電極に電気的に接続されるカソ
ードポスト電極と、前記アノード電極に電気的に接続さ
れるアノードポスト電極と、前記カソードポスト電極お
よび前記アノードポスト電極を取り囲むように配設さ
れ、少なくとも前記半導体基板および前記リング状ゲー
ト電極を内包する電気絶縁性の絶縁筒と、内周端縁部が
前記リング状ゲート電極に電気的に接続され、外周端縁
部が前記絶縁筒の側面から突出するゲート端子板とを備
え、前記カソードポスト電極および前記アノードポスト
電極の外側にそれぞれ配設された、カソードスタック電
極およびアノードスタック電極によって、前記カソード
ポスト電極および前記アノードポスト電極を互いに向き
合う方向に付勢し、両者を前記カソード電極および前記
アノード電極に圧接するとともに、前記ゲート電極と前
記カソード電極間に、ゲートターンオン制御電流を発生
させるゲートドライバが前記ゲート端子板および前記カ
ソードポスト電極に電気的に接続される圧接型半導体装
置において、前記ゲートドライバが、前記ゲート端子板
に直接に接触し、前記ゲートターンオン制御電流の伝達
経路となるゲートリード基板を有し、前記ゲート端子板
が、その外周端縁部がバネ性を有するように折り曲げら
れた折り曲げ部を有している。In the pressure contact type semiconductor device according to the present invention, a gate electrode is formed along an outer peripheral edge of one main surface, a cathode electrode is formed inside the gate electrode, and the other main surface is formed. A semiconductor substrate having an anode electrode formed thereon, a ring-shaped gate electrode having one end surface in contact with the gate electrode, a cathode post electrode electrically connected to the cathode electrode, and an electrical connection to the anode electrode. An anode post electrode, an electrically insulating insulating cylinder provided to surround the cathode post electrode and the anode post electrode, and including at least the semiconductor substrate and the ring-shaped gate electrode; and an inner peripheral edge portion. A gate terminal plate electrically connected to the ring-shaped gate electrode and having an outer peripheral edge projecting from a side surface of the insulating cylinder; A cathode stack electrode and an anode stack electrode disposed outside the pole and the anode post electrode respectively urge the cathode post electrode and the anode post electrode in directions facing each other, and both of them are urged to the cathode electrode and the anode. In a press-contact type semiconductor device in which a gate driver that press-contacts an electrode and generates a gate turn-on control current between the gate electrode and the cathode electrode is electrically connected to the gate terminal plate and the cathode post electrode, A driver directly contacts the gate terminal plate and has a gate lead substrate serving as a transmission path of the gate turn-on control current, and the gate terminal plate is bent so that its outer peripheral edge has a spring property. It has a folded part.
【0037】本発明に係る請求項7記載の圧接型半導体
装置は、前記ゲートドライバが、前記カソードポスト電
極および前記アノードポスト電極の圧接に伴って、前記
カソードポスト電極の端面に圧接され、前記ゲートター
ンオン制御電流の伝達経路となるカソードリード基板を
さらに有し、前記ゲートリード基板およびカソードリー
ド基板は積層されて積層体を構成し、前記積層体が、前
記カソードポスト電極側を挿入した場合に、前記カソー
ドポスト電極の端面が底面部となる前記カソードリード
基板に接触し、前記ゲート端子板の外周端縁部が、周縁
部となる前記ゲートリード基板上に接触する寸法を有し
た有底孔である挿入部を有し、前記ゲート端子板が、バ
ネ性を有する前記外周端縁部が、前記カソードポスト電
極および前記アノードポスト電極の圧接に伴って前記ゲ
ートリード基板に押圧されるものである。8. The pressure-contact type semiconductor device according to claim 7, wherein the gate driver is pressed against an end face of the cathode post electrode with the pressure contact between the cathode post electrode and the anode post electrode. A cathode lead substrate serving as a transmission path of a turn-on control current is further provided, wherein the gate lead substrate and the cathode lead substrate are stacked to form a stacked body, and when the stacked body inserts the cathode post electrode side, An end surface of the cathode post electrode is in contact with the cathode lead substrate serving as a bottom surface portion, and an outer peripheral edge portion of the gate terminal plate is a bottomed hole having a dimension to be in contact with the gate lead substrate serving as a peripheral portion. The gate terminal plate has an insertion portion, and the outer peripheral edge portion having a spring property is provided with the cathode post electrode and the anode. It is intended to be pressed against the gate lead substrate with the pressure of Doposuto electrode.
【0038】本発明に係る請求項8記載の圧接型半導体
装置は、前記ゲート端子板が、バネ性を有する前記外周
端縁部に所定の間隔で形成された複数の切り込みによっ
て規定される可撓片を複数備えている。In the pressure contact type semiconductor device according to the present invention, the gate terminal plate may be defined by a plurality of cuts formed at predetermined intervals in the outer peripheral edge portion having a spring property. It has multiple pieces.
【0039】[0039]
<実施の形態1> <装置構成>図1に本発明に係る圧接型半導体装置の実
施の形態1として、ゲート転流型ターンオフサイリスタ
(以後、GCTサイリスタと呼称)100の断面構成を
示す。First Embodiment <Device Configuration> FIG. 1 shows a cross-sectional configuration of a gate commutation type turn-off thyristor (hereinafter, referred to as a GCT thyristor) 100 as a press-contact type semiconductor device according to a first embodiment of the present invention.
【0040】図1において、GCTサイリスタ100の
各セグメントが形成された半導体基板28の下側表面の
外周部側に位置する面上にゲート電極29aが形成され
ており、さらにゲート電極29aよりも内側の半導体基
板28の下側表面上には、各セグメントの位置に対応し
て各カソード電極29bが形成されている。In FIG. 1, a gate electrode 29a is formed on a surface located on the outer peripheral side of the lower surface of the semiconductor substrate 28 on which each segment of the GCT thyristor 100 is formed, and further inside the gate electrode 29a. Each cathode electrode 29b is formed on the lower surface of the semiconductor substrate 28 corresponding to the position of each segment.
【0041】半導体基板28の下側表面上のカソード電
極29bの下には、カソード歪緩衝板30およびカソー
ドポスト電極31が順に配設されている。一方、半導体
基板28の図示しないアノード電極の表面(カソード電
極29bと反対側の面)上には、アノード歪緩衝板32
およびアノードポスト電極33が順に配設されている。Under the cathode electrode 29b on the lower surface of the semiconductor substrate 28, a cathode strain buffer plate 30 and a cathode post electrode 31 are sequentially arranged. On the other hand, an anode distortion buffer plate 32 is provided on the surface of the anode electrode (not shown) of the semiconductor substrate 28 (the surface opposite to the cathode electrode 29b).
And an anode post electrode 33 are sequentially arranged.
【0042】また、半導体基板28のゲート電極29a
の表面に接するようにリング状ゲート電極34が配設さ
れており、リング状金属板からなるゲート端子板38A
が、その内周端縁面がリングゲート電極34と摺動可能
になるように、同電極34に対して接触・配置されてい
る。The gate electrode 29a of the semiconductor substrate 28
A ring-shaped gate electrode 34 is disposed so as to be in contact with the surface of the gate terminal plate 38A made of a ring-shaped metal plate.
However, it is arranged in contact with the inner peripheral edge surface of the ring gate electrode 34 so that the inner peripheral edge surface can slide with the electrode 34.
【0043】そして、ゲート端子板38Aとともに、リ
ング状ゲート電極34をゲート電極29aに対して押圧
するための皿バネあるいは波バネのようなリング状の弾
性体35が配設されている。なお、弾性体35はリング
状絶縁体36を介してゲート端子板38Aを押圧する構
成となっている。Along with the gate terminal plate 38A, a ring-shaped elastic body 35 such as a disc spring or a wave spring for pressing the ring-shaped gate electrode 34 against the gate electrode 29a is provided. Note that the elastic body 35 is configured to press the gate terminal plate 38A via the ring-shaped insulator 36.
【0044】また、リング状ゲート電極34をカソード
歪緩衝板30およびカソードポスト電極31から絶縁す
るための絶縁シート等からなる絶縁体37が、カソード
歪緩衝板30およびカソードポスト電極31の壁面に沿
って配設されている。An insulator 37 made of an insulating sheet or the like for insulating the ring-shaped gate electrode 34 from the cathode strain buffer plate 30 and the cathode post electrode 31 extends along the wall surfaces of the cathode strain buffer plate 30 and the cathode post electrode 31. It is arranged.
【0045】カソードポスト電極31の端縁部にはカソ
ードフランジ26が固着され、アノードポスト電極33
にはアノードフランジ40が固着されている。そして、
カソードフランジ26とアノードフランジ40との間に
は、GCTサイリスタ100の主要部を取り囲むよう
に、セラミック等の絶縁物で構成された絶縁筒41が配
設されている。絶縁筒41は、ゲート端子板38Aを挟
んで上下に分割されているとともに、沿面距離を長くす
るための突起部42を有した構成である。従って、ゲー
ト端子板38Aの外周側部分は絶縁筒41の側面から外
部に突出することになる。なお、絶縁筒41はゲート端
子板38Aの上下表面に気密に固着されている。ここ
で、ゲート端子板38Aは、絶縁筒41の突起部42の
外周よりもさらに外側に突出するような直径を有するリ
ング状金属板で形成されている。A cathode flange 26 is fixed to the edge of the cathode post electrode 31, and the anode post electrode 33
Has an anode flange 40 fixed thereto. And
Between the cathode flange 26 and the anode flange 40, an insulating cylinder 41 made of an insulating material such as ceramic is disposed so as to surround a main part of the GCT thyristor 100. The insulating cylinder 41 has a configuration in which the insulating cylinder 41 is vertically divided with the gate terminal plate 38A interposed therebetween, and has a protrusion 42 for increasing the creepage distance. Therefore, the outer peripheral portion of the gate terminal plate 38A protrudes outside from the side surface of the insulating cylinder 41. The insulating cylinder 41 is air-tightly fixed to the upper and lower surfaces of the gate terminal plate 38A. Here, the gate terminal plate 38A is formed of a ring-shaped metal plate having a diameter such that the gate terminal plate 38A projects further outward than the outer periphery of the protrusion 42 of the insulating cylinder 41.
【0046】そして、絶縁筒41の下側端面に固着され
た接続板43aがカソードフランジ26と気密に固着さ
れ、絶縁筒41の上側端面に固着された接続板43bが
アノードフランジ40と気密に固着されており、これに
よってGCTサイリスタ100が密閉されたパッケージ
構造になっている。なお、この内部は、不活性ガスで置
換されている。A connecting plate 43a fixed to the lower end face of the insulating cylinder 41 is airtightly fixed to the cathode flange 26, and a connecting plate 43b fixed to the upper end face of the insulating cylinder 41 is airtightly fixed to the anode flange 40. As a result, the GCT thyristor 100 has a sealed package structure. The interior is replaced with an inert gas.
【0047】次に、ゲートドライバGD1の構成、およ
びゲートドライバGD1にGCTサイリスタ100を取
り付けた状態を図2を用いて説明する。Next, the configuration of the gate driver GD1 and a state in which the GCT thyristor 100 is attached to the gate driver GD1 will be described with reference to FIG.
【0048】図2はGCTサイリスタ100をゲートド
ライバGD1に取り付けた状態を模式的に表した図であ
る。FIG. 2 is a diagram schematically showing a state in which the GCT thyristor 100 is mounted on the gate driver GD1.
【0049】図2に示すようにゲートドライバGD1
は、ゲートドライバ回路部15と、当該ゲートドライバ
回路部15とGCTサイリスタ100とを電気的に接続
するための、回路パターンが形成された接続基板10と
を備えている。接続基板10はゲートドライバ回路部1
5内にも延在している。As shown in FIG. 2, the gate driver GD1
Includes a gate driver circuit section 15 and a connection substrate 10 on which a circuit pattern is formed for electrically connecting the gate driver circuit section 15 and the GCT thyristor 100. The connection substrate 10 is a gate driver circuit unit 1
5 also extends.
【0050】図2において、接続基板10にはGCTサ
イリスタ100を挿入するサイリスタ挿入部9が形成さ
れ、その平面視形状は図10を用いて説明したゲートド
ライバGDとほぼ同様であるので図示は省略する。GC
Tサイリスタ100は、サイリスタ挿入部9にカソード
ポスト電極31側を下にして挿入される。In FIG. 2, a thyristor insertion portion 9 for inserting the GCT thyristor 100 is formed in the connection substrate 10, and its plan view shape is substantially the same as the gate driver GD described with reference to FIG. I do. GC
The T thyristor 100 is inserted into the thyristor insertion portion 9 with the cathode post electrode 31 side down.
【0051】ここで、接続基板10の構成について説明
する。接続基板10は、最下部に位置するカソードリー
ド基板101、当該カソードリード基板101の上部に
配設された絶縁体102、当該絶縁体102の上部に配
設されたゲートリード基板103を備えている。そし
て、ゲートリード基板103および絶縁体102を貫通
し、カソードリード基板101の所定深さに達するよう
に開口部が設けられ、それがサイリスタ挿入部9となっ
ている。サイリスタ挿入部9の直径は、少なくともGC
Tサイリスタ100のカソードフランジ26を収容でき
る大きさに設定される。また、その深さはGCTサイリ
スタ100を挿入した状態でゲート端子板38Aがゲー
トリード基板103に接触する深さに設定される。な
お、カソードリード基板101およびゲートリード基板
103は、ゲートターンオン制御電流の伝達経路とな
る。Here, the configuration of the connection board 10 will be described. The connection substrate 10 includes a cathode lead substrate 101 located at the lowermost position, an insulator 102 provided above the cathode lead substrate 101, and a gate lead substrate 103 provided above the insulator 102. . An opening is provided so as to penetrate the gate lead substrate 103 and the insulator 102 and reach a predetermined depth of the cathode lead substrate 101, which serves as a thyristor insertion portion 9. The diameter of the thyristor insertion part 9 is at least GC
The size is set such that the cathode flange 26 of the T thyristor 100 can be accommodated. The depth is set to a depth at which the gate terminal plate 38A contacts the gate lead substrate 103 with the GCT thyristor 100 inserted. The cathode lead substrate 101 and the gate lead substrate 103 serve as a transmission path for a gate turn-on control current.
【0052】ゲートドライバGD1はGCTサイリスタ
100をサイリスタ挿入部9に挿入した状態で、カソー
ドスタック電極SK1の上に載置される。そして、GC
Tサイリスタ100を取り囲むように絶縁円筒体(ゲー
ト端子板圧接手段)50を配設する。なお、カソードス
タック電極SK1およびアノードスタックSA1は、カ
ソードポスト電極31およびアノードポスト電極33を
互いに向き合う方向に付勢し、カソード歪緩衝板30お
よびアノード歪緩衝板32を半導体基板28に圧接する
ためのものである。The gate driver GD1 is mounted on the cathode stack electrode SK1 with the GCT thyristor 100 inserted in the thyristor insertion section 9. And GC
An insulating cylindrical body (gate terminal plate pressing means) 50 is arranged so as to surround the T thyristor 100. Note that the cathode stack electrode SK1 and the anode stack SA1 bias the cathode post electrode 31 and the anode post electrode 33 in directions facing each other, and press the cathode strain buffer plate 30 and the anode strain buffer plate 32 against the semiconductor substrate 28. Things.
【0053】絶縁円筒体50は、その内側にGCTサイ
リスタ100を収容できるように、その内周直径が少な
くとも絶縁筒41の外周直径より大きく形成されてい
る。そして、その高さは、GCTサイリスタ100のサ
イリスタ挿入部9に収容されない部分を完全に収容する
高さに設定される。The inner diameter of the insulating cylinder 50 is larger than at least the outer diameter of the insulating cylinder 41 so that the GCT thyristor 100 can be accommodated inside. Then, the height is set to a height that completely accommodates a portion of the GCT thyristor 100 that is not accommodated in the thyristor insertion section 9.
【0054】そして、絶縁円筒体50は、その一方の端
面がゲート端子板38Aの端縁部に接触しており、カソ
ードスタック電極SK1およびアノスタックSA1によ
るGCTサイリスタ100の押圧により、ゲート端子板
38Aの端縁部が均等な力でゲートリード基板103に
押し付けられることになる。The insulating cylindrical body 50 has one end surface in contact with the edge of the gate terminal plate 38A, and is pressed by the cathode stack electrode SK1 and the anostack SA1 against the GCT thyristor 100, so that the gate terminal plate 38A is pressed. Is pressed against the gate lead substrate 103 with a uniform force.
【0055】なお、ゲート端子板38Aは、その外周端
縁部が絶縁円筒体50の端面に確実に接触しなければな
らないので、その外周直径は、少なくとも絶縁円筒体5
0の外周と同程度にする必要がある。またアノードスタ
ック電極SA1は、少なくとも絶縁円筒体50の外周ま
でを覆う大きさが必要である。Since the outer peripheral edge of the gate terminal plate 38A must surely contact the end face of the insulating cylinder 50, the outer peripheral diameter of the gate terminal plate 38A must be at least 5 mm.
It is necessary to make the outer circumference of the same as 0. The anode stack electrode SA1 needs to have a size that covers at least the outer periphery of the insulating cylinder 50.
【0056】絶縁円筒体50は可撓性を有した部材で形
成されることが望ましい。すなわち、可撓性を有さない
部材、例えばセラミックスなどで形成すると、製造時の
寸法公差で、GCTサイリスタ100を収容してさらに
余るような高さになった場合、カソードスタック電極S
K1およびアノードスタック電極SA1でGCTサイリ
スタ100を押圧しても、圧力は絶縁円筒体50にのみ
加わり、カソードポスト電極31およびアノードポスト
電極33は押圧されないことになる。しかし、可撓性を
有していれば、圧力によって高さが縮み、カソードポス
ト電極31およびアノードポスト電極33を押圧するこ
とが可能になる。また、絶縁円筒体50によりカソード
スタック電極SK1およびアノードスタック電極SA1
から加わる力が多少緩和されるので、ゲートドライバG
D1の接続基板10に加わる圧力を緩和できる。The insulating cylinder 50 is desirably formed of a flexible member. In other words, when formed of a non-flexible member, for example, ceramics or the like, if the height of the GCT thyristor 100 becomes too large to accommodate the GCT thyristor 100 due to dimensional tolerances during manufacture, the cathode stack electrode
Even if the GCT thyristor 100 is pressed by the K1 and the anode stack electrode SA1, the pressure is applied only to the insulating cylinder 50, and the cathode post electrode 31 and the anode post electrode 33 are not pressed. However, if it has flexibility, the height is reduced by the pressure, and the cathode post electrode 31 and the anode post electrode 33 can be pressed. Also, the cathode stack electrode SK1 and the anode stack electrode SA1 are formed by the insulating cylinder 50.
From the gate driver G
The pressure applied to the connection substrate 10 of D1 can be reduced.
【0057】絶縁円筒体50の材質としては、ゴムなど
が使用される。ゴムの種類としては、強度的にも、耐熱
的にも優れたもの、例えば真空シールに使用されるよう
なニトリルゴムやシリコンゴムなどを使用する。As a material of the insulating cylinder 50, rubber or the like is used. As the type of rubber, one having excellent strength and heat resistance, for example, nitrile rubber or silicon rubber used for vacuum sealing is used.
【0058】なお、以上説明した絶縁円筒体50は、そ
の材質としてゴムのみを使用した例を示したが、複数の
材質を用いることで可撓性を持たせるようにしても良
い。Although the insulating cylinder 50 described above has been described using an example in which only rubber is used as the material, the insulating cylinder 50 may be made flexible by using a plurality of materials.
【0059】図3に複数の材質で構成された絶縁円筒体
50Aを示す。図3において、絶縁円筒体50Aはガラ
スエポキシ樹脂522を間に挟んで、両側端面がゴム5
21となった多層構造を有している。ガラスエポキシ樹
脂522は可撓性を有していないが、ゴム521の存在
により絶縁円筒体50A全体としては可撓性を有するこ
とになる。ここで、ガラスエポキシ樹脂522とゴム5
21とは、接着剤を使用して接合すれば良い。FIG. 3 shows an insulating cylindrical body 50A made of a plurality of materials. In FIG. 3, an insulating cylinder 50A has a glass epoxy resin 522 interposed therebetween and has rubber 5 on both sides.
21. Although the glass epoxy resin 522 does not have flexibility, the presence of the rubber 521 makes the entire insulating cylindrical body 50A flexible. Here, the glass epoxy resin 522 and the rubber 5
21 may be joined by using an adhesive.
【0060】なお、ガラスエポキシ樹脂はコスト的に安
価であり、加工も容易であるので、大型化する傾向にあ
る圧接型半導体装置に適している。Since the glass epoxy resin is inexpensive and easy to process, it is suitable for a pressure-contact type semiconductor device which tends to be large.
【0061】図4に複数の材質で構成された絶縁円筒体
50Bを示す。図4において、皿バネなどの弾性体53
3を円筒中央に配設し、その両側にガラスエポキシ樹脂
532を配設し、さらにその両側にゴム531を配設し
た多層構造を有している。ゴム531だけでも十分に可
撓性を有しているが、弾性体533の存在によりさらに
可撓性を向上させることができる。FIG. 4 shows an insulating cylindrical body 50B made of a plurality of materials. In FIG. 4, an elastic body 53 such as a disc spring is used.
3 is disposed at the center of the cylinder, a glass epoxy resin 532 is disposed on both sides thereof, and a rubber structure 531 is disposed on both sides thereof. Although the rubber 531 alone has sufficient flexibility, the flexibility can be further improved by the presence of the elastic body 533.
【0062】また、図2を用いた説明では、絶縁円筒体
50は独立した存在であったが、アノードスタック電極
SA1に固着されていても良い。すなわち、GCTサイ
リスタ100を囲むように配設する場合、絶縁円筒体5
0が独立していると位置合わせに時間がかかるという問
題がある。装置の小型化のために、絶縁円筒体50の内
周直径と絶縁筒41の外周直径の差は小さく設定してあ
る。従って、絶縁円筒体50の内周と絶縁筒41の外周
とが接触しないように絶縁円筒体50を配設するには時
間がかかる。しかし、予めアノードスタック電極SA1
に固着させておけば、組み立て時には位置合わせをする
必要がなくなり製造工程を簡略化できる。In the description with reference to FIG. 2, the insulating cylinder 50 is provided independently, but may be fixed to the anode stack electrode SA1. That is, when the GCT thyristor 100 is disposed so as to surround the same, the insulating cylinder 5
If the 0s are independent, there is a problem that it takes a long time for positioning. To reduce the size of the device, the difference between the inner diameter of the insulating cylinder 50 and the outer diameter of the insulating cylinder 41 is set small. Therefore, it takes time to arrange the insulating cylinder 50 so that the inner periphery of the insulating cylinder 50 does not contact the outer periphery of the insulating cylinder 41. However, the anode stack electrode SA1
In this case, it is not necessary to perform positioning at the time of assembling, and the manufacturing process can be simplified.
【0063】<特徴的作用効果>以上説明したように、
絶縁円筒体50の一方の端面がゲート端子板38Aの端
縁部に接触するように、ゲート端子板38Aの外周直径
を大きくし、カソードスタック電極SK1およびアノー
ドスタック電極SA1によるGCTサイリスタ100の
押圧に際して、絶縁円筒体50の端面によりゲート端子
板38Aを押圧することで、ゲート端子板38Aの端縁
部が均等な力でゲートリード基板103に押し付けられ
ることになり、ゲート端子板38Aがゲートリード基板
103に確実に接触することになる。従って、接触不良
に起因する主電流の損失を防止して、主電流をゲート回
路に転流することができ、ターンオフ失敗による素子破
壊を防止することができる。<Characteristic Effects> As described above,
The outer diameter of the gate terminal plate 38A is increased so that one end surface of the insulating cylindrical body 50 contacts the edge of the gate terminal plate 38A, and the cathode stack electrode SK1 and the anode stack electrode SA1 press the GCT thyristor 100. By pressing the gate terminal plate 38A with the end surface of the insulating cylindrical body 50, the edge of the gate terminal plate 38A is pressed against the gate lead substrate 103 with a uniform force, and the gate terminal plate 38A is 103 will surely come into contact. Therefore, loss of the main current due to poor contact can be prevented, the main current can be diverted to the gate circuit, and element destruction due to failure to turn off can be prevented.
【0064】また、ゲート端子板38Aのゲートリード
基板103への取り付けが簡単にでき、作業性が向上し
て製造コストを低減することができる。Further, the attachment of the gate terminal plate 38A to the gate lead substrate 103 can be simplified, the workability can be improved, and the manufacturing cost can be reduced.
【0065】<実施の形態2> <装置構成>図5に本発明に係る圧接型半導体装置の実
施の形態2として、GCTサイリスタ200の断面構成
を示す。<Second Embodiment><DeviceConfiguration> FIG. 5 shows a cross-sectional configuration of a GCT thyristor 200 as a second embodiment of the press-contact type semiconductor device according to the present invention.
【0066】なお、図5において、図1を用いて説明し
たGCTサイリスタ100と同様の構成については同一
の符号を付し、重複する説明は省略する。In FIG. 5, the same components as those of the GCT thyristor 100 described with reference to FIG. 1 are denoted by the same reference numerals, and redundant description will be omitted.
【0067】図5において、半導体基板28のゲート電
極29aの表面に接するようにリング状ゲート電極34
が配設されており、当該リング状ゲート電極34にはゲ
ート端子板39が摺動可能に接触・配置されている。In FIG. 5, a ring-shaped gate electrode 34 is in contact with the surface of gate electrode 29a of semiconductor substrate 28.
The gate terminal plate 39 is slidably contacted with the ring-shaped gate electrode 34.
【0068】ゲート端子板39はリング状金属板であ
り、その外周端縁部がカソード側に曲率を有して折れ曲
がっている。図5において、ゲート端子板39の外周端
縁部は曲率を有して上方(アノード方向)に突出した曲
部39aを有し、曲部39aより外側の最端縁部39b
は裾広がりに緩やかに傾斜している。このような構成に
よりゲート端子板39の外周端縁部がバネ性を有するこ
とになる。The gate terminal plate 39 is a ring-shaped metal plate, and its outer peripheral edge is bent with a curvature on the cathode side. 5, the outer peripheral edge of the gate terminal plate 39 has a curved portion 39a having a curvature and projecting upward (toward the anode), and the outermost edge 39b outside the curved portion 39a.
Is gently inclined to spread the hem. With such a configuration, the outer peripheral edge of the gate terminal plate 39 has a spring property.
【0069】次に、ゲートドライバGD1にGCTサイ
リスタ200を取り付けた状態を図6を用いて説明す
る。なお、図6において、図2に示す構成と同様の構成
については同一の符号を付し、重複する説明は省略す
る。Next, a state where the GCT thyristor 200 is attached to the gate driver GD1 will be described with reference to FIG. In FIG. 6, the same components as those shown in FIG. 2 are denoted by the same reference numerals, and redundant description will be omitted.
【0070】図6において、GCTサイリスタ200を
サイリスタ挿入部9にカソードポスト電極31側を下に
して挿入すると、ゲート端子板39の最端縁部39aが
ゲートリード基板103に接触する。そして、この状態
でカソードスタック電極SK1およびアノードスタック
電極SA1によりGCTサイリスタ200を押圧する
と、バネ性を有したゲート端子板39の外周端縁部が広
がりながらゲートリード基板103に押し付けられ、最
端縁部39bがゲートリード基板103に確実に接触す
ることになる。In FIG. 6, when the GCT thyristor 200 is inserted into the thyristor insertion portion 9 with the cathode post electrode 31 side down, the outermost edge 39 a of the gate terminal plate 39 comes into contact with the gate lead substrate 103. When the GCT thyristor 200 is pressed by the cathode stack electrode SK1 and the anode stack electrode SA1 in this state, the outer peripheral edge of the gate terminal plate 39 having a spring property is pressed against the gate lead substrate 103 while expanding, and the outermost edge is pressed. The portion 39b surely contacts the gate lead substrate 103.
【0071】<変形例>なお、ゲート端子板39の外周
端縁部に径方向に切り欠き部を設けることで、バネ性を
より高めた構成にすることができる。<Modification> By providing a cutout in the radial direction at the outer peripheral edge of the gate terminal plate 39, it is possible to make the structure more springy.
【0072】図7にゲート端子板39の最端縁部39b
に所定の間隔で切り込み部39cを設け、切り込み部3
9cに挟まれた部分の可撓性を高めて可撓片39dを形
成する。FIG. 7 shows the outermost edge 39b of the gate terminal plate 39.
Are provided with notches 39c at predetermined intervals, and the notches 3
The flexibility of the portion sandwiched between 9c is increased to form the flexible piece 39d.
【0073】このような構成とすることで、カソードス
タック電極SK1およびアノードスタック電極SA1に
より押圧された場合に外周端縁部が広がり易くなり、ゲ
ートリード基板103との接触がより確実になるという
効果を有している。With such a configuration, when pressed by the cathode stack electrode SK1 and the anode stack electrode SA1, the outer peripheral edge becomes easy to spread, and the contact with the gate lead substrate 103 becomes more reliable. have.
【0074】<特徴的作用効果>以上説明したように、
ゲート端子板39の外周端縁部をバネ性を有した構造と
し、カソードスタック電極SK1およびアノードスタッ
ク電極SA1による押圧でゲートリード基板103と電
気的に接続するので、ゲート端子板39の端縁部が均等
な力でゲートリード基板103に押し付けられることに
なり、ゲート端子板39がゲートリード基板103に確
実に接触することになる。従って、接触不良に起因する
主電流の損失を防止して、主電流をゲート回路に転流す
ることができ、ターンオフ失敗による素子破壊を防止す
ることができる。<Characteristic Effects> As described above,
The outer peripheral edge of the gate terminal plate 39 has a structure having a spring property, and is electrically connected to the gate lead substrate 103 by being pressed by the cathode stack electrode SK1 and the anode stack electrode SA1. Is pressed against the gate lead substrate 103 with an equal force, so that the gate terminal plate 39 reliably contacts the gate lead substrate 103. Therefore, loss of the main current due to poor contact can be prevented, the main current can be diverted to the gate circuit, and element destruction due to failure to turn off can be prevented.
【0075】また、ゲートリード基板103との接続の
ための構成が簡単であり、部品点数も少なく、作業性が
向上して製造コストを低減することができる。Further, the configuration for connection to the gate lead substrate 103 is simple, the number of parts is small, workability is improved, and manufacturing cost can be reduced.
【0076】[0076]
【発明の効果】本発明に係る請求項1記載の圧接型半導
体装置によれば、ゲート端子板圧接手段によって、カソ
ードポスト電極およびアノードポスト電極の圧接に伴っ
て、ゲート端子板の外周端縁部をゲートリード基板に圧
接するので、ゲート端子板の外周端縁部がゲートリード
基板に確実に接触することになり、接触不良に起因する
主電流の損失を防止して、主電流をゲート回路に転流す
ることができ、ターンオフ失敗による素子破壊を防止す
ることができる。According to the pressure contact type semiconductor device according to the first aspect of the present invention, the outer peripheral edge of the gate terminal plate is brought into contact with the cathode post electrode and the anode post electrode by the gate terminal plate pressing means. Is pressed into contact with the gate lead substrate, so that the outer peripheral edge of the gate terminal plate comes into reliable contact with the gate lead substrate, preventing loss of the main current due to poor contact and transferring the main current to the gate circuit. Commutation can be performed, and element destruction due to turn-off failure can be prevented.
【0077】本発明に係る請求項2記載の圧接型半導体
装置によれば、絶縁円筒体によって、カソードポスト電
極およびアノードポスト電極の圧接に伴って、ゲート端
子板の外周端縁部をゲートリード基板に圧接するので、
ゲート端子板の外周端縁部がゲートリード基板に均等な
圧力で確実に接触することになり、接触不良に起因する
主電流の損失を防止して、主電流をゲート回路に転流す
ることができ、ターンオフ失敗による素子破壊を防止す
ることができる。また、ゲート端子板のゲートリード基
板への取り付けは、絶縁円筒体を配置するだけで済むの
で、ネジ止めでゲート端子板をゲートリード基板に取り
付けるような構成に比べて、取り付けが簡単であり、作
業性が向上して製造コストを低減することができる。According to the pressure-contact type semiconductor device according to the second aspect of the present invention, the outer peripheral edge of the gate terminal plate is formed by the insulating cylindrical body along with the pressure contact between the cathode post electrode and the anode post electrode. Because it is pressed against
The outer peripheral edge of the gate terminal plate surely contacts the gate lead substrate with uniform pressure, preventing loss of the main current due to poor contact and commutating the main current to the gate circuit. Thus, device destruction due to turn-off failure can be prevented. Also, since the mounting of the gate terminal plate to the gate lead substrate only requires placing the insulating cylinder, the mounting is simpler than a configuration in which the gate terminal plate is mounted on the gate lead substrate by screwing, Workability is improved and manufacturing costs can be reduced.
【0078】本発明に係る請求項3記載の圧接型半導体
装置によれば、絶縁円筒体が、少なくとも軸方向に可撓
性を有しているので、製造時の寸法公差により高さが若
干高くなった場合でも、カソードスタック電極およびア
ノードスタック電極により押圧されることで高さが縮む
ので、絶縁円筒体の存在によりカソードポスト電極およ
びアノードポスト電極が押圧されないと言った不具合が
防止される。また、絶縁円筒体によりカソードスタック
電極およびアノードスタック電極から加わる力が多少緩
和されるので、ゲートドライバのカソードリード基板お
よびゲートリード基板に加わる圧力を緩和でき、両者に
過度の圧力がかかることによる不具合を防止できる。According to the pressure-contact type semiconductor device according to the third aspect of the present invention, since the insulating cylindrical body has flexibility at least in the axial direction, the height is slightly increased due to dimensional tolerances during manufacturing. Even in such a case, since the height is reduced by being pressed by the cathode stack electrode and the anode stack electrode, a problem that the cathode post electrode and the anode post electrode are not pressed by the presence of the insulating cylinder is prevented. Further, since the force applied from the cathode stack electrode and the anode stack electrode is somewhat reduced by the insulating cylindrical body, the pressure applied to the cathode lead substrate and the gate lead substrate of the gate driver can be alleviated, and an excessive pressure is applied to both of them. Can be prevented.
【0079】本発明に係る請求項4記載の圧接型半導体
装置によれば、絶縁円筒体は、軸方向に可撓性を有した
部材を少なくとも一部分に備えていれば、カソードスタ
ック電極およびアノードスタック電極により押圧される
ことで高さが縮むので、絶縁円筒体の存在によりカソー
ドポスト電極およびアノードポスト電極が押圧されない
と言った不具合が防止される。また、可撓性を有した部
材が高価である場合でも、絶縁円筒体全体の製造コスト
を低減することができる。According to the pressure-contact type semiconductor device according to the fourth aspect of the present invention, if the insulating cylindrical body has at least a portion of a member having flexibility in the axial direction, the cathode stack electrode and the anode stack Since the height is reduced by being pressed by the electrode, a problem that the cathode post electrode and the anode post electrode are not pressed by the presence of the insulating cylinder is prevented. Further, even when the flexible member is expensive, the manufacturing cost of the entire insulating cylinder can be reduced.
【0080】本発明に係る請求項5記載の圧接型半導体
装置によれば、絶縁円筒体がアノードスタック電極の所
定位置に固着されているので、絶縁円筒体の位置合わせ
にかかる時間を低減することができる。According to the pressure contact type semiconductor device of the fifth aspect of the present invention, since the insulating cylinder is fixed to the predetermined position of the anode stack electrode, the time required for positioning the insulating cylinder can be reduced. Can be.
【0081】本発明に係る請求項6記載の圧接型半導体
装置によれば、ゲート端子板の外周端縁部をバネ性を有
した構造とし、カソードスタック電極およびアノードス
タック電極による押圧でゲートリード基板と電気的に接
続するので、ゲート端子板の端縁部が均等な力でゲート
リード基板に押し付けられることになり、ゲート端子板
がゲートリード基板に確実に接触することになる。従っ
て、接触不良に起因する主電流の損失を防止して、主電
流をゲート回路に転流することができ、ターンオフ失敗
による素子破壊を防止することができる。また、ゲート
リード基板との接続のための構成が簡単であり、部品点
数も少なく、作業性が向上して製造コストを低減するこ
とができる。According to the pressure contact type semiconductor device of the sixth aspect of the present invention, the outer peripheral edge of the gate terminal plate has a springy structure, and the gate lead substrate is pressed by the cathode stack electrode and the anode stack electrode. Since the gate terminal plate is electrically connected to the gate lead substrate, the edge of the gate terminal plate is pressed against the gate lead substrate with a uniform force, and the gate terminal plate surely contacts the gate lead substrate. Therefore, loss of the main current due to poor contact can be prevented, the main current can be diverted to the gate circuit, and element destruction due to failure to turn off can be prevented. Further, the configuration for connection with the gate lead substrate is simple, the number of parts is small, workability is improved, and manufacturing cost can be reduced.
【0082】本発明に係る請求項7記載の圧接型半導体
装置によれば、カソードスタック電極およびアノードス
タック電極による押圧でゲート端子板とゲートリード基
板とを電気的に接続するための具体的な構成を得ること
ができ、接触不良に起因する主電流の損失を防止して、
主電流をゲート回路に転流することができ、ターンオフ
失敗による素子破壊を防止した圧接型半導体装置を実現
することができる。According to the pressure contact type semiconductor device of the seventh aspect of the present invention, a specific structure for electrically connecting the gate terminal plate and the gate lead substrate by pressing with the cathode stack electrode and the anode stack electrode. To prevent loss of main current due to poor contact,
A main current can be diverted to the gate circuit, and a pressure-contact type semiconductor device in which element breakdown due to turn-off failure is prevented can be realized.
【0083】本発明に係る請求項8記載の圧接型半導体
装置によれば、ゲート端子板が、その外周端縁部に可撓
片を複数備えているので、ゲート端子板の外周端縁部の
バネ性をより高めることができ、ゲート端子板とゲート
リード基板との接触がより確実になる。According to the pressure contact type semiconductor device of the present invention, since the gate terminal plate has a plurality of flexible pieces on the outer peripheral edge, the outer peripheral edge of the gate terminal plate is provided. The spring property can be further improved, and the contact between the gate terminal plate and the gate lead substrate becomes more reliable.
【図1】 本発明に係る圧接型半導体装置の実施の形態
1の構成を説明する断面図である。FIG. 1 is a cross-sectional view illustrating a configuration of a press contact type semiconductor device according to a first embodiment of the present invention.
【図2】 本発明に係る圧接型半導体装置の実施の形態
1の圧接状態を示す図である。FIG. 2 is a diagram illustrating a press-contact state of the press-contact semiconductor device according to the first embodiment of the present invention;
【図3】 絶縁円筒体の構成の一例を示す斜視図であ
る。FIG. 3 is a perspective view showing an example of a configuration of an insulating cylinder.
【図4】 絶縁円筒体の構成の一例を示す斜視図であ
る。FIG. 4 is a perspective view showing an example of a configuration of an insulating cylinder.
【図5】 本発明に係る圧接型半導体装置の実施の形態
2の構成を説明する断面図である。FIG. 5 is a sectional view illustrating a configuration of a press contact type semiconductor device according to a second embodiment of the present invention;
【図6】 本発明に係る圧接型半導体装置の実施の形態
2の圧接状態を示す図である。FIG. 6 is a diagram illustrating a press-contact state of a press-contact type semiconductor device according to a second embodiment of the present invention;
【図7】 本発明に係る圧接型半導体装置の実施の形態
2の変形例の構成を説明する断面図である。FIG. 7 is a cross-sectional view illustrating a configuration of a modification of the press contact type semiconductor device according to the second embodiment of the present invention;
【図8】 従来の圧接型半導体装置の構成を説明する断
面図である。FIG. 8 is a cross-sectional view illustrating a configuration of a conventional pressure contact type semiconductor device.
【図9】 従来の圧接型半導体装置の構成を説明する平
面図である。FIG. 9 is a plan view illustrating a configuration of a conventional pressure contact type semiconductor device.
【図10】 ゲートドライバの構成を示す平面図であ
る。FIG. 10 is a plan view showing a configuration of a gate driver.
【図11】 ゲートドライバの構成を示す断面図であ
る。FIG. 11 is a cross-sectional view illustrating a configuration of a gate driver.
【図12】 GCTサイリスタの動作を説明する回路図
である。FIG. 12 is a circuit diagram illustrating an operation of the GCT thyristor.
9 サイリスタ挿入部、10 接続基板、28 半導体
基板、31 カソードポスト電極、33 アノードポス
ト電極、34 リング状ゲート電極、38A,39 ゲ
ート端子板、39a 曲部、39b 最端縁部、39c
切り込み部、39d 可撓片、41 絶縁筒、50
絶縁円筒体、101 カソードリード基板、102 絶
縁体、103 ゲートリード基板、GD1 ゲートドラ
イバ、SA1 アノードスタック電極、SK1 カソー
ドスタック電極。9 Thyristor insertion portion, 10 Connection substrate, 28 Semiconductor substrate, 31 Cathode post electrode, 33 Anode post electrode, 34 Ring-shaped gate electrode, 38A, 39 Gate terminal plate, 39a Curved portion, 39b End edge, 39c
Notch, 39d Flexible piece, 41 Insulation tube, 50
Insulating cylinder, 101 cathode lead substrate, 102 insulator, 103 gate lead substrate, GD1 gate driver, SA1 anode stack electrode, SK1 cathode stack electrode.
Claims (8)
極が形成され、該ゲート電極の内側にカソード電極が形
成され、他方主面にアノード電極が形成された半導体基
板と、 一方端面が前記ゲート電極に接触するリング状ゲート電
極と、 前記カソード電極に電気的に接続されるカソードポスト
電極と、 前記アノード電極に電気的に接続されるアノードポスト
電極と、 前記カソードポスト電極および前記アノードポスト電極
を取り囲むように配設され、少なくとも前記半導体基板
および前記リング状ゲート電極を内包する電気絶縁性の
絶縁筒と、 内周端縁部が前記リング状ゲート電極に電気的に接続さ
れ、外周端縁部が前記絶縁筒の側面から突出するゲート
端子板とを備え、 前記カソードポスト電極および前記アノードポスト電極
の外側にそれぞれ配設された、カソードスタック電極お
よびアノードスタック電極によって、前記カソードポス
ト電極および前記アノードポスト電極を互いに向き合う
方向に付勢し、両者を前記カソード電極および前記アノ
ード電極に圧接するとともに、前記ゲート電極と前記カ
ソード電極間に、ゲートターンオン制御電流を発生させ
るゲートドライバが前記ゲート端子板および前記カソー
ドポスト電極に電気的に接続される圧接型半導体装置に
おいて、 前記ゲートドライバは、 前記ゲート端子板に直接に接触し、前記ゲートターンオ
ン制御電流の伝達経路となるゲートリード基板を有し、 前記圧接型半導体装置は、 前記カソードポスト電極および前記アノードポスト電極
の圧接に伴って、前記ゲート端子板の外周端縁部を前記
ゲートリード基板に圧接するゲート端子板圧接手段をさ
らに備えることを特徴とする圧接型半導体装置。A semiconductor substrate having a gate electrode formed along an outer peripheral edge of one main surface, a cathode electrode formed inside the gate electrode, and an anode electrode formed on the other main surface; A ring-shaped gate electrode contacting the gate electrode, a cathode post electrode electrically connected to the cathode electrode, an anode post electrode electrically connected to the anode electrode, the cathode post electrode and the anode An electrically insulating insulating cylinder disposed so as to surround a post electrode and including at least the semiconductor substrate and the ring-shaped gate electrode; an inner peripheral edge portion electrically connected to the ring-shaped gate electrode; A gate terminal plate having an edge protruding from a side surface of the insulating cylinder; and a gate terminal plate outside the cathode post electrode and the anode post electrode. The cathode post electrode and the anode post electrode are urged in directions facing each other by a cathode stack electrode and an anode stack electrode, respectively, and both are pressed against the cathode electrode and the anode electrode. In a press-contact type semiconductor device in which a gate driver for generating a gate turn-on control current is electrically connected to the gate terminal plate and the cathode post electrode between a gate electrode and the cathode electrode, the gate driver includes the gate terminal plate And a gate lead substrate serving as a transmission path of the gate turn-on control current. The press-contact type semiconductor device is provided with a press-contact of the cathode post electrode and the anode post electrode. Press the outer peripheral edge against the gate lead substrate. A press-contact type semiconductor device, further comprising a gate terminal plate press-contact means in contact with the press-contact type.
の圧接に伴って、前記カソードポスト電極の端面に圧接
され、前記ゲートターンオン制御電流の伝達経路となる
カソードリード基板をさらに有し、 前記ゲートリード基板およびカソードリード基板は積層
されて積層体を構成し、 前記積層体は、 前記カソードポスト電極側を挿入した場合に、前記カソ
ードポスト電極の端面が底面部となる前記カソードリー
ド基板に接触し、前記ゲート端子板の外周端縁部が、周
縁部となる前記ゲートリード基板上に接触する寸法を有
した有底孔である挿入部を有し、 前記ゲート端子板圧接手段は、 その内周直径が、前記絶縁筒を取り囲む大きさに設定さ
れた電気絶縁性の絶縁円筒体であって、 前記アノードスタック電極は、少なくとも前記絶縁円筒
体の外周までを覆う寸法を有し、 前記カソードポスト電極および前記アノードポスト電極
の圧接の際に、前記絶縁円筒体が前記ゲート端子板の外
周端縁部と前記ゲートリード基板とを圧接する、請求項
1記載の圧接型半導体装置。2. The gate driver further comprises: a cathode lead substrate which is pressed against an end face of the cathode post electrode in accordance with the pressure contact between the cathode post electrode and the anode post electrode, and serves as a transmission path of the gate turn-on control current. The gate lead substrate and the cathode lead substrate are stacked to form a stacked body, and the stacked body is configured such that, when the cathode post electrode side is inserted, the end face of the cathode post electrode is a bottom surface portion. A gate terminal plate press-fitting means having an insertion portion which is in contact with a lead substrate and has a bottomed hole with an outer peripheral edge of the gate terminal plate having a dimension to be in contact with the gate lead substrate serving as a peripheral portion; Is an electrically insulating insulating cylinder whose inner diameter is set to a size surrounding the insulating cylinder; The back electrode has a dimension that covers at least the outer periphery of the insulating cylinder, and when the cathode post electrode and the anode post electrode are pressed against each other, the insulating cylinder is in contact with the outer peripheral edge of the gate terminal plate. The pressure-contact type semiconductor device according to claim 1, wherein the pressure-contact type semiconductor device is pressed against the gate lead substrate.
可撓性を有する、請求項2記載の圧接型半導体装置。3. The pressure-contact type semiconductor device according to claim 2, wherein the insulating cylinder has flexibility at least in an axial direction.
に、軸方向に可撓性を有する部材を備えた多層構造体で
ある、請求項3記載の圧接型半導体装置。4. The pressure-contact type semiconductor device according to claim 3, wherein the insulating cylinder is a multilayer structure having a member having flexibility in an axial direction at least in part.
ク電極の所定位置に固着されている請求項3記載の圧接
型半導体装置。5. The pressure contact type semiconductor device according to claim 3, wherein the insulating cylinder is fixed to a predetermined position of the anode stack electrode.
極が形成され、該ゲート電極の内側にカソード電極が形
成され、他方主面にアノード電極が形成された半導体基
板と、 一方端面が前記ゲート電極に接触するリング状ゲート電
極と、 前記カソード電極に電気的に接続されるカソードポスト
電極と、 前記アノード電極に電気的に接続されるアノードポスト
電極と、 前記カソードポスト電極および前記アノードポスト電極
を取り囲むように配設され、少なくとも前記半導体基板
および前記リング状ゲート電極を内包する電気絶縁性の
絶縁筒と、 内周端縁部が前記リング状ゲート電極に電気的に接続さ
れ、外周端縁部が前記絶縁筒の側面から突出するゲート
端子板とを備え、 前記カソードポスト電極および前記アノードポスト電極
の外側にそれぞれ配設された、カソードスタック電極お
よびアノードスタック電極によって、前記カソードポス
ト電極および前記アノードポスト電極を互いに向き合う
方向に付勢し、両者を前記カソード電極および前記アノ
ード電極に圧接するとともに、前記ゲート電極と前記カ
ソード電極間に、ゲートターンオン制御電流を発生させ
るゲートドライバが前記ゲート端子板および前記カソー
ドポスト電極に電気的に接続される圧接型半導体装置に
おいて、 前記ゲートドライバは、 前記ゲート端子板に直接に接触し、前記ゲートターンオ
ン制御電流の伝達経路となるゲートリード基板を有し、 前記ゲート端子板は、 その外周端縁部がバネ性を有するように折り曲げられた
折り曲げ部を有することを特徴とする圧接型半導体装
置。6. A semiconductor substrate having a gate electrode formed along an outer peripheral edge of one main surface, a cathode electrode formed inside the gate electrode, and an anode electrode formed on the other main surface; A ring-shaped gate electrode contacting the gate electrode, a cathode post electrode electrically connected to the cathode electrode, an anode post electrode electrically connected to the anode electrode, the cathode post electrode and the anode An electrically insulating insulating cylinder disposed so as to surround a post electrode and including at least the semiconductor substrate and the ring-shaped gate electrode; an inner peripheral edge portion electrically connected to the ring-shaped gate electrode; A gate terminal plate having an edge protruding from a side surface of the insulating cylinder; and a gate terminal plate outside the cathode post electrode and the anode post electrode. The cathode post electrode and the anode post electrode are urged in directions facing each other by a cathode stack electrode and an anode stack electrode, respectively, and both are pressed against the cathode electrode and the anode electrode. In a press-contact type semiconductor device in which a gate driver for generating a gate turn-on control current is electrically connected to the gate terminal plate and the cathode post electrode between a gate electrode and the cathode electrode, the gate driver includes the gate terminal plate And a gate lead substrate that is in direct contact with the gate turn-on control current and has a bent portion whose outer peripheral edge is bent to have a spring property. A pressure-contact type semiconductor device.
の圧接に伴って、前記カソードポスト電極の端面に圧接
され、前記ゲートターンオン制御電流の伝達経路となる
カソードリード基板をさらに有し、 前記ゲートリード基板およびカソードリード基板は積層
されて積層体を構成し、 前記積層体は、 前記カソードポスト電極側を挿入した場合に、前記カソ
ードポスト電極の端面が底面部となる前記カソードリー
ド基板に接触し、前記ゲート端子板の外周端縁部が、周
縁部となる前記ゲートリード基板上に接触する寸法を有
した有底孔である挿入部を有し、 前記ゲート端子板は、 バネ性を有する前記外周端縁部が、前記カソードポスト
電極および前記アノードポスト電極の圧接に伴って前記
ゲートリード基板に押圧される、請求項6記載の圧接型
半導体装置。7. The gate driver further includes: a cathode lead substrate which is pressed against an end face of the cathode post electrode in accordance with the pressing of the cathode post electrode and the anode post electrode, and serves as a transmission path of the gate turn-on control current. The gate lead substrate and the cathode lead substrate are stacked to form a stacked body, and the stacked body is configured such that, when the cathode post electrode side is inserted, the end face of the cathode post electrode is a bottom surface portion. The gate terminal plate has an insertion portion that is a bottomed hole having a dimension to be in contact with the lead substrate and the outer peripheral edge of the gate terminal plate to be in contact with the gate lead substrate serving as the peripheral portion. The outer peripheral edge having a spring property is adapted to press the gate post electrode and the anode post electrode together with the gate post electrode. The pressure-contact type semiconductor device according to claim 6, which is pressed against a substrate.
た複数の切り込みによって規定される可撓片を複数備え
る、請求項7記載の圧接型半導体装置。8. The pressure-contact type semiconductor according to claim 7, wherein the gate terminal plate includes a plurality of flexible pieces defined by a plurality of cuts formed at predetermined intervals in the outer peripheral edge having a spring property. apparatus.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP06982097A JP3535341B2 (en) | 1997-03-24 | 1997-03-24 | Pressure welding type semiconductor device |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP06982097A JP3535341B2 (en) | 1997-03-24 | 1997-03-24 | Pressure welding type semiconductor device |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH10270475A true JPH10270475A (en) | 1998-10-09 |
| JP3535341B2 JP3535341B2 (en) | 2004-06-07 |
Family
ID=13413788
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP06982097A Expired - Lifetime JP3535341B2 (en) | 1997-03-24 | 1997-03-24 | Pressure welding type semiconductor device |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3535341B2 (en) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2000152646A (en) * | 1998-11-16 | 2000-05-30 | Mitsubishi Electric Corp | Inverter device |
| WO2000042664A1 (en) * | 1999-01-18 | 2000-07-20 | Mitsubishi Denki Kabushiki Kaisha | Compression bonded semiconductor device |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2016062983A (en) | 2014-09-16 | 2016-04-25 | 株式会社東芝 | Semiconductor device |
-
1997
- 1997-03-24 JP JP06982097A patent/JP3535341B2/en not_active Expired - Lifetime
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2000152646A (en) * | 1998-11-16 | 2000-05-30 | Mitsubishi Electric Corp | Inverter device |
| WO2000042664A1 (en) * | 1999-01-18 | 2000-07-20 | Mitsubishi Denki Kabushiki Kaisha | Compression bonded semiconductor device |
| US6303987B1 (en) | 1999-01-18 | 2001-10-16 | Mitsubishi Denki Kabushiki Kaisha | Compression bonded type semiconductor device |
Also Published As
| Publication number | Publication date |
|---|---|
| JP3535341B2 (en) | 2004-06-07 |
Similar Documents
| Publication | Publication Date | Title |
|---|---|---|
| EP0637080B1 (en) | Pressure contact type semiconductor device | |
| JP3256636B2 (en) | Pressure contact type semiconductor device | |
| US5646445A (en) | Semiconductor device having electrodes embedded in an insulating case | |
| KR100305227B1 (en) | Turn-Off High Power Semiconductor Components | |
| JP3319569B2 (en) | Pressure contact type semiconductor device | |
| JP2001036002A (en) | Semiconductor device | |
| JP3344552B2 (en) | Pressure welding type semiconductor device | |
| JP2002222916A (en) | Pressure welding type semiconductor device | |
| JP3535341B2 (en) | Pressure welding type semiconductor device | |
| JP2004221381A (en) | Semiconductor device | |
| US6445013B1 (en) | Gate commutated turn-off semiconductor device | |
| JP3989583B2 (en) | Pressure contact type semiconductor device | |
| JP3390653B2 (en) | Semiconductor switching device, semiconductor stack device and power conversion device using the same | |
| EP0788152B1 (en) | Internal compression bonded semiconductor device with a chip frame enabling a longer creepage distance | |
| US5115300A (en) | High-power semiconductor device | |
| CN110767643B (en) | An electrical device | |
| JP3228043B2 (en) | Parallel connection structure of flat semiconductor switches | |
| JP4077130B2 (en) | Gate commutation type turn-off thyristor module | |
| WO2023149257A1 (en) | Semiconductor device | |
| CN114038808A (en) | High power semiconductor device | |
| JP4125908B2 (en) | Semiconductor device | |
| JPH0325414Y2 (en) | ||
| JP3376245B2 (en) | Semiconductor switching device, semiconductor stack device and power conversion device using the same | |
| JP3995618B2 (en) | Semiconductor device | |
| JP3376243B2 (en) | Semiconductor switching device, semiconductor stack device and power conversion device using the same |
Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20040114 |
|
| A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20040120 |
|
| A521 | Written amendment |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20040213 |
|
| TRDD | Decision of grant or rejection written | ||
| A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20040309 |
|
| A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20040311 |
|
| R150 | Certificate of patent or registration of utility model |
Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20080319 Year of fee payment: 4 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20090319 Year of fee payment: 5 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20100319 Year of fee payment: 6 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20100319 Year of fee payment: 6 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20110319 Year of fee payment: 7 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20110319 Year of fee payment: 7 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20120319 Year of fee payment: 8 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20130319 Year of fee payment: 9 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20130319 Year of fee payment: 9 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20140319 Year of fee payment: 10 |
|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
| EXPY | Cancellation because of completion of term |