JPH10320302A - 情報処理装置 - Google Patents
情報処理装置Info
- Publication number
- JPH10320302A JPH10320302A JP9131901A JP13190197A JPH10320302A JP H10320302 A JPH10320302 A JP H10320302A JP 9131901 A JP9131901 A JP 9131901A JP 13190197 A JP13190197 A JP 13190197A JP H10320302 A JPH10320302 A JP H10320302A
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- JP
- Japan
- Prior art keywords
- memory
- power
- main
- switch
- storage memory
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Techniques For Improving Reliability Of Storages (AREA)
Abstract
(57)【要約】
【課題】ハイバネーション機能を利用する際、主記憶メ
モリのすべての情報をＨＤＤなどの２次記憶装置に格納
するために、ＨＤＤの特定エリアを主記憶分消費してし
まい、実装メモリ容量が増えているため、その場所が大
きくなる一方である。 【解決手段】本発明の情報処理装置は、電源オフスイッ
チと電源オンスイッチを押されるごとに主記憶転送手段
によって主記憶メモリと不揮発性記憶メモリとの間でメ
モリ内容の転送を行う。
モリのすべての情報をＨＤＤなどの２次記憶装置に格納
するために、ＨＤＤの特定エリアを主記憶分消費してし
まい、実装メモリ容量が増えているため、その場所が大
きくなる一方である。 【解決手段】本発明の情報処理装置は、電源オフスイッ
チと電源オンスイッチを押されるごとに主記憶転送手段
によって主記憶メモリと不揮発性記憶メモリとの間でメ
モリ内容の転送を行う。
Description
【０００１】
【発明の属する技術分野】本発明は、電源オフの直前の
使用状態へ電源オンのときに戻す必要があるノートパソ
コンなどの情報処理装置に関する。
使用状態へ電源オンのときに戻す必要があるノートパソ
コンなどの情報処理装置に関する。
【０００２】
【従来の技術】近年、コンピュータ、特にパーソナルコ
ンピュータ（以下、ＰＣと記す）の性能は飛躍に向上
し、主記憶メモリの値段の低下から、主記憶メモリの最
大容量は年々増加をたどっている。
ンピュータ（以下、ＰＣと記す）の性能は飛躍に向上
し、主記憶メモリの値段の低下から、主記憶メモリの最
大容量は年々増加をたどっている。
【０００３】電源オフ直前の使用状態に電源オンのとき
に戻すような仕組みを備えたＰＣとしてノートパソコン
のハイバネーション機能があり、この仕組みを備えたも
のとして、例えばＩＢＭ社のThinkPadと呼ばれるノート
ＰＣ必ず備えている。
に戻すような仕組みを備えたＰＣとしてノートパソコン
のハイバネーション機能があり、この仕組みを備えたも
のとして、例えばＩＢＭ社のThinkPadと呼ばれるノート
ＰＣ必ず備えている。
【０００４】
【発明が解決しようとする課題】ところが、ハイバネー
ション機能を利用する際、主記憶メモリのすべての情報
をＨＤＤなどの２次記憶装置に格納したり、あるいは読
み出したりさせるために、ＨＤＤの特定エリアを主記憶
分消費してしまい、実装メモリ容量が増えているため、
その場所が大きくなる一方である。また、その分、情報
の転送に時間がかかり、特にＨＤＤが動作中なため、す
ぐに使用を止めたい、あるいはすぐに使用可能な状態に
しようと思っても、ノートＰＣをすぐに持ち運ぶとＨＤ
Ｄに衝撃を与えるため危険なため、使用者はその間待た
されるといった点において配慮が不足していた。
ション機能を利用する際、主記憶メモリのすべての情報
をＨＤＤなどの２次記憶装置に格納したり、あるいは読
み出したりさせるために、ＨＤＤの特定エリアを主記憶
分消費してしまい、実装メモリ容量が増えているため、
その場所が大きくなる一方である。また、その分、情報
の転送に時間がかかり、特にＨＤＤが動作中なため、す
ぐに使用を止めたい、あるいはすぐに使用可能な状態に
しようと思っても、ノートＰＣをすぐに持ち運ぶとＨＤ
Ｄに衝撃を与えるため危険なため、使用者はその間待た
されるといった点において配慮が不足していた。
【０００５】
【課題を解決するための手段】そこで、本発明ではＨＤ
Ｄなど駆動回転するような機械部品を持つ２次記憶装置
の代わりに、フラッシュメモリに代表される機械部品を
備えない不揮発性メモリを用い、主記憶転送手段を備
え、電源オフ、電源オンの時に高速なデータ転送を行
い、データ転送期間を短くするものである。また、高速
なデータ転送を保証するために主記憶メモリと同様に、
メモリ基板上に実装された不揮発性メモリを用いる。
Ｄなど駆動回転するような機械部品を持つ２次記憶装置
の代わりに、フラッシュメモリに代表される機械部品を
備えない不揮発性メモリを用い、主記憶転送手段を備
え、電源オフ、電源オンの時に高速なデータ転送を行
い、データ転送期間を短くするものである。また、高速
なデータ転送を保証するために主記憶メモリと同様に、
メモリ基板上に実装された不揮発性メモリを用いる。
【０００６】
【発明の実施の形態】上記発明の具体的な実施の形態に
ついて、以下に図を用いて説明する。
ついて、以下に図を用いて説明する。
【０００７】図１は、本発明の実施例を示すシステムブ
ロック図である。同図において、ハイバネーション移行
ＳＷ１、フラッシュメモリ２、電源ＳＷ３、主記憶フラ
ッシュメモリ４間のデータ転送手段とより成る。
ロック図である。同図において、ハイバネーション移行
ＳＷ１、フラッシュメモリ２、電源ＳＷ３、主記憶フラ
ッシュメモリ４間のデータ転送手段とより成る。
【０００８】この動作は、ＰＣにおいて電源ＳＷ３によ
る起動後、ＯＳが起動した後、ＡＰなどを起動した状態
において、ハイバネーション移行ＳＷ１Ａがユーザによ
って押されると、主記憶上のメモリイメージを主記憶フ
ラッシュメモリ４間データ転送手段がフラッシュメモリ
２に書き出し、ハイバネーションフラグを１にして電源
をオフにする。
る起動後、ＯＳが起動した後、ＡＰなどを起動した状態
において、ハイバネーション移行ＳＷ１Ａがユーザによ
って押されると、主記憶上のメモリイメージを主記憶フ
ラッシュメモリ４間データ転送手段がフラッシュメモリ
２に書き出し、ハイバネーションフラグを１にして電源
をオフにする。
【０００９】その後、電源ＳＷが押されると、ハイバネ
ーションフラグが１の時にはフラッシュメモリに主記憶
のメモリイメージが格納されているので主記憶フラッシ
ュメモリ間データ転送手段はフラッシュメモリから主記
憶のメモリイメージを取り出し、主記憶に格納する。
ーションフラグが１の時にはフラッシュメモリに主記憶
のメモリイメージが格納されているので主記憶フラッシ
ュメモリ間データ転送手段はフラッシュメモリから主記
憶のメモリイメージを取り出し、主記憶に格納する。
【００１０】ハイバネーションフラグが０の時には、通
常のＯＳの起動を行う。フラッシュメモリはＣＰＵ、メ
モリなどが搭載された回路基板上に固定されている。フ
ラッシュメモリはＰＣカードなど、脱着可能な形態で使
用されている主記憶とフラッシュメモリは、直接バスに
よって接続されており、主記憶フラッシュメモリ転送手
段はアドレスバス、データバスを出力しＤＭＡ転送する
ものである。フラッシュメモリは主記憶と同じSIMM，DI
MMのようなユーザによって増設可能な状態で実装されて
いる。
常のＯＳの起動を行う。フラッシュメモリはＣＰＵ、メ
モリなどが搭載された回路基板上に固定されている。フ
ラッシュメモリはＰＣカードなど、脱着可能な形態で使
用されている主記憶とフラッシュメモリは、直接バスに
よって接続されており、主記憶フラッシュメモリ転送手
段はアドレスバス、データバスを出力しＤＭＡ転送する
ものである。フラッシュメモリは主記憶と同じSIMM，DI
MMのようなユーザによって増設可能な状態で実装されて
いる。
【００１１】
【発明の効果】以上のような構成を備えることで、主記
憶メモリと不揮発性メモリとの間で高速にデータ転送を
行い、電源オフ直前の状態へ電源オンのときに復帰させ
ることが可能である。
憶メモリと不揮発性メモリとの間で高速にデータ転送を
行い、電源オフ直前の状態へ電源オンのときに復帰させ
ることが可能である。
【図１】図１は本発明の全体構成を示すシステムブロッ
ク図。
ク図。
【図２】図２は本発明を備えたＰＣ。
【図３】図３は本発明の図1における不揮発性メモリの
概観図。
概観図。
１Ａ…ハイバネーション移行ＳＷ、 ２…フラッシュメ
モリ、 ３…電源ＳＷ、 ４…主記憶フラッシ
ュメモリ。
モリ、 ３…電源ＳＷ、 ４…主記憶フラッシ
ュメモリ。
Claims (2)
- 【請求項１】主記憶メモリ、ＣＰＵ、電源オフスイッ
チ、電源オンスイッチを備えた情報処理装置において、
不揮発性記憶メモリ、主記憶転送手段を備え、電源オフ
スイッチと電源オンスイッチを押されるごとに主記憶転
送手段によって主記憶メモリと不揮発性記憶メモリとの
間でメモリ内容の転送を行う情報処理装置。 - 【請求項２】請求項１の不揮発性記憶メモリは主記憶メ
モリと同様な基板上に実装され、主記憶メモリと同じデ
ータバス幅を持ち、主記憶転送手段から直接読み書き可
能な不揮発性記憶メモリ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9131901A JPH10320302A (ja) | 1997-05-22 | 1997-05-22 | 情報処理装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9131901A JPH10320302A (ja) | 1997-05-22 | 1997-05-22 | 情報処理装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH10320302A true JPH10320302A (ja) | 1998-12-04 |
Family
ID=15068825
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP9131901A Pending JPH10320302A (ja) | 1997-05-22 | 1997-05-22 | 情報処理装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH10320302A (ja) |
Cited By (18)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100630129B1 (ko) * | 2005-03-28 | 2006-09-27 | 삼성전자주식회사 | 휴대단말기에서 하드디스크 드라이브의 데이터 저장방법 |
| JP2011508341A (ja) * | 2007-12-28 | 2011-03-10 | インテル コーポレイション | 高速なプラットフォーム・ハイバーネーションおよびレジュームのためのシステムおよび方法 |
| JP2012514787A (ja) * | 2009-01-05 | 2012-06-28 | マーベル ワールド トレード リミテッド | 不揮発性メモリデバイスを利用するハイバネートまたはサスペンド方法およびシステム |
| US8443187B1 (en) | 2007-04-12 | 2013-05-14 | Marvell International Ltd. | Authentication of computing devices in server based on mapping between port identifier and MAC address that allows actions-per-group instead of just actions-per-single device |
| US8510560B1 (en) | 2008-08-20 | 2013-08-13 | Marvell International Ltd. | Efficient key establishment for wireless networks |
| US8839016B2 (en) | 2007-07-23 | 2014-09-16 | Marvell World Trade Ltd. | USB self-idling techniques |
| US8843686B1 (en) | 2007-04-05 | 2014-09-23 | Marvell International Ltd. | Processor management using a buffer |
| US8984316B2 (en) | 2011-12-29 | 2015-03-17 | Intel Corporation | Fast platform hibernation and resumption of computing systems providing secure storage of context data |
| US9032139B2 (en) | 2012-12-28 | 2015-05-12 | Intel Corporation | Memory allocation for fast platform hibernation and resumption of computing systems |
| US9141394B2 (en) | 2011-07-29 | 2015-09-22 | Marvell World Trade Ltd. | Switching between processor cache and random-access memory |
| US9436629B2 (en) | 2011-11-15 | 2016-09-06 | Marvell World Trade Ltd. | Dynamic boot image streaming |
| US9436251B2 (en) | 2011-10-01 | 2016-09-06 | Intel Corporeation | Fast platform hibernation and resumption of computing systems |
| US9575768B1 (en) | 2013-01-08 | 2017-02-21 | Marvell International Ltd. | Loading boot code from multiple memories |
| US9652249B1 (en) | 2008-09-18 | 2017-05-16 | Marvell World Trade Ltd. | Preloading an application while an operating system loads |
| US9736801B1 (en) | 2013-05-20 | 2017-08-15 | Marvell International Ltd. | Methods and apparatus for synchronizing devices in a wireless data communication system |
| US9836306B2 (en) | 2013-07-31 | 2017-12-05 | Marvell World Trade Ltd. | Parallelizing boot operations |
| US9860862B1 (en) | 2013-05-21 | 2018-01-02 | Marvell International Ltd. | Methods and apparatus for selecting a device to perform shared functionality in a deterministic and fair manner in a wireless data communication system |
| US10979412B2 (en) | 2016-03-08 | 2021-04-13 | Nxp Usa, Inc. | Methods and apparatus for secure device authentication |
-
1997
- 1997-05-22 JP JP9131901A patent/JPH10320302A/ja active Pending
Cited By (22)
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| US10275377B2 (en) | 2011-11-15 | 2019-04-30 | Marvell World Trade Ltd. | Dynamic boot image streaming |
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