JPH10513582A - 電界放出型表示器のセル駆動装置 - Google Patents

電界放出型表示器のセル駆動装置

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JPH10513582A JP9521943A JP52194397A JPH10513582A JP H10513582 A JPH10513582 A JP H10513582A JP 9521943 A JP9521943 A JP 9521943A JP 52194397 A JP52194397 A JP 52194397A JP H10513582 A JPH10513582 A JP H10513582A
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Abstract

(57)【要約】 FED セル駆動装置は、カソードに供給される電流量を調節して一定の限界以上の階調(Gray Level)の輝度を画素に提供する。このため、前記 FED セル駆動装置は電子を放出するためのカソードにそれぞれ一定の電流信号を供給するよう少なくとも二つ以上の電流源を設ける。前記少なくとも一つ以上の電流源等はビデオ信号を入力とする制御手段により選別的に駆動される。

Description

【発明の詳細な説明】 電界放出型表示器のセル駆動装置 技術分野 本発明は、冷陰極及び電界を利用して電子を放出させる電子放出型素子に関し 、特にカソードに供給される電流量を調節して多段階階調を実現することができ る電界放出型表示器(Field Emission Display;以下“FED”という)の セル駆動装置に関する。背景技術 通常の陰極線管(“CRT”という)は多様な電子装置、通常の表示装置であ るテレビジョン受像機、オシロスコープ及びコンピューター モニターに有用な 特別構造の真空管である。前記 CRT の源泉的な機能は、電気入力信号に含ま れた情報を光ビーム エネルギーに変換して前記電気入力信号の可視的な表示を 提供することにある。 基本的な CRT において、電子等は熱電子カソードから放出され制御グリッ ドにより制御される。自由電子等のビームは陽極を通過しながら磁気又は静電気 力により加速され、磁気偏向コイル又は静電気偏向板により通常水平及び垂直軸 上で偏向される。前記電子ビームは蛍光膜に衝突して短期間の時間の間、可視光 を放出させる。 前記表示される情報を含む前記入力信号は前記制御グリッド及び前記カソード の間に供給される。しかし、通常ガンマ特性と呼ばれるビーム電流及び制御電圧 間の関係は非常に非線形的な関数なので、線形的な表示強度を提供するためには 比較的複雑な補償回路が前記入力信号及び前記制御グリッドの間に接続されるよ う求められる。 最近数年間に、平板表示器の領域での普遍的な傾向は非熱電子カソード、詳し く説明すれば電界放出アレイを開発することである。 前記 CRT での前記通常の熱電子カソードの代りに前記電界放出カソード アレイの使用は僅かながら確実な長所等を提供する。特に、電界放出カソード等 の使用は非常に高い電流密度を可能にし、併せてヒーター素子を除去して CR T の寿命を延長させるであろう。 しかし、前記電界放出カソードは入力信号に対する電子の放出量が熱電子方式 よりも一層非線形的に変化されるようにしてさらに複雑な補償回路を要求する。 このような問題点を解消するための方案としては、ドーラン(Doran)により 提案された受動マトリックスアドレス指定方式の FED セル駆動装置(米国特 許公報第 5、103、145 号)と、キャスパー(Casper)等により提案された能動マ トリックスアドレス指定方式の FED セル駆動装置(米国特許公報第 210、472 号)がある。 前記米国特許公報第 5、103、145 号に従えば、前記手動マトリックス指定方式 の FED セル駆動装置は入力信号をディジタル信号に変換し、前記ディジタル 信号の論理値に従い駆動するカソードの数を1、2、3又は4倍ずつ増加させて 電子の放出量を線形的に増加させる。この場合、カソードの数量により多段階階 調を現すため、一定の限界以上の階調を実現させることができない。これはセル の占有面積に設けられる数カソードの数量が制限されることに基づく。 併せて、前記手動マトリックス指定方式の FED セル駆動装置は、カソード 及びゲートの間に電圧差により電子が放出されるようにする電圧駆動方式を採用 している。この場合、電圧に対し電流が非線形的に変化することにより、カソー ドから放出される電子量を正確に調節できないようにする問題点を引き起こす。 一方、前記米国特許公報第 210、472 号に記載された前記能動マトリックス指 定方式の FED セル駆動装置は CMOS 回路、又は NMOS トランジスタ 等でなる集積回路及び互換可能な低電圧の入力信号を利用して高電界の画素を駆 動するようになっている。また、前記能動マトリックス指定方式の FED セル 駆動装置は、ローライン(Row Lines)及びカラム ライン(Column Lines) の配列されたカソード等を駆動するためスキャン及びデータ スイッチとして高 電圧用 MOS トランジスタ等を用いる。さらに、前記能動マトリックス指定方 式の FED セル駆動装置は、各カラム駆動機及びカソードの間に接続されたヒューズ等と、 カソード及びゲートの間に抵抗として接続された電界効果トランジスタを備える 。前記ヒューズ等はカソードに過電流が印加されないように過電流を制限する役 割を果し、また、前記抵抗に用いられた前記電界効果トランジスタは自らの抵抗 値が調節されることにより前記ゲート及び前記カソード間の電圧差を調節してカ ソードからの放出電子量を調節する。その結果、画面の明るさが調節される。ま た、前記カラム駆動機はカラム ラインのカソード等が駆動する時間、即ちデュ ーティ サイクルを調節することにより多段階階調を実現する。 しかし、前記能動マトリックス指定方式の FED セル駆動装置は、スキャン ライン及びデータ ライン間の高電圧を切り換えるため高電圧用 MOS トラン ジスタを用いなければならない。また、ゲート及びカソードの間に接続された抵 抗用の電界効果トランジスタのゲートが高電圧に堪え得るよう厚く形成されなけ ればならない。これらにより、前記能動マトリックス指定方式の FED セル駆 動装置は、前記手動マトリックス指定方式の FED セル駆動装置に比べさらに 多いトランジスタ等を必要とし、併せて製造工程を複雑にする短所を有している 。 さらに、多段階階調を実現するための前記デューティ サイクルの調節可能な 数が制限されることにより、前記能動マトリックス指定方式の FED セル駆動 装置は一定限界以上の階調を実現することができない。発明の開示 従って、本発明の目的はカソードに供給される電流量を調節して一定限界以上 の階調を実現できる FED セル駆動装置を提供することにある。 前記目的を達成するため、本発明の FED セル駆動装置は電子を放出するた めのカソードにそれぞれ一定の電流信号を供給するよう少なくとも二つ以上の電 流源を設ける。前記少なくとも二つ以上の電流源等はビデオ信号を入力とする制 御手段により選別的に駆動される。図面の簡単な説明 図1は、本発明の実施例に係る電界放出型表示器のセル駆動装置の回路図。 図2は、図1に示した駆動装置に供給される制御信号のタイミング図。 図3は、図1に示したトランジスタの転換動作に従いその動作信号に対する電 流の大きさを現したダイアグラム。発明を実施するためのベストモード 以下、本発明の実施例を添付した図1乃至図3を参照して詳細に説明する。 図1を参照すれば、カソード(10)と、前記カソードから電子を放出させる ためのゲート電極(12)と、前記ゲート電極(12)に供給される第1電圧( Vdd1)を切り換えるための第1 NMOS トランジスタ(14)と、また、前 記カソード(10)に供給される第2低電圧(Vdd2)を切り換えるための第2 NMOS トランジスタ(16)を備えた本発明の実施例に係る FED セル駆 動装置が説明されている。 前記第1 NMOS トランジスタ(14)はスキャン信号(SS)の論理状態 に従い選択的に駆動される。詳しく記述すれば、前記スキャン信号(SS)がハ イ論理を維持する場合、前記第1 NMOS トランジスタ(14)はターンオン され前記第1電圧(Vdd1)が前記ゲート電極(12)に供給されるようにする 。この際、前記ゲート電極(12)は前記第1 NMOS トランジスタ(14) を経て供給される前記第1電圧(Vdd1)により電界放出を誘導して前記カソー ド(10)から電子等が放出されるようにする。その反面、前記スキャン信号( SS)がロー論理を維持する場合、前記第1 NMOS トランジスタ(14)は ターンオフ(Turn−Off)され前記ゲート電極(12)に前記第1電圧(Vdd1 )供給されないようにする。 一方、前記第2 NMOS トランジスタ(16)は充電制御信号(CCS)の 論理状態に従い選択的に駆動される。前記充電制御信号(CCS)がハイ論理を 維持する間、前記第2 NMOS トランジスタ(16)は前記第2電圧(Vdd2 )が前記カソード(10)に供給されるようにし、電子の放出直前の動作初期に 前記カソード(10)を臨界電圧状態となるようにする。このため、前記カソー ド(10)は動作開始時に遅延時間なく電子を直ちに放出することになる。前記 充電制御信号(CCS)は、図2に示すように前記スキャン信号(SS)と同様 な位相を有し、また前記スキャン信号(SS)に比べ非常に短いハイ論理のパル ス幅を有する。 尚、前記 FED セル駆動装置は前記カソード(10)と第3電圧(Vdd3) の間に並列に接続した第3乃至第6 NMOS トランジスタ(18、20、22、 24)と、前記第3乃至第6 NMOS トランジスタ(18、20、22、24) の駆動電圧を発生するための分圧機の形体で第4電圧(Vdd4)及び前記第3電 圧(Vdd3)の間に直列接続した第7及び第8 NMOS トランジスタ(26、 28)を備える。 前記第7 NMOS トランジスタ(26)は、表示制御信号(DCS)に応答 して前記第4電圧(Vdd4)を接続ノード(11)側に選択的に伝送されるよう にする。前記表示制御信号(DCS)がハイ論理を維持する場合、前記第7 N MOS トランジスタ(26)はターンオンされ、前記第4電圧(Vdd4)が前記 接続ノード(11)を経て前記第3乃至第6 NMOS トランジスタ(18、2 0、22、24)のゲート側に伝送できるようにする。前記表示制御信号(DCS )は、図2に示すように、前記充電制御信号(CCS)の終了始点(即ち、下降 エッジ)から前記スキャン信号(SS)の終了始点(即ち、下降エッジ)までに 至るハイ論理のパルス幅を有する。 前記第8 NMOS トランジスタ(28)は前記接続ノード(11)に共通的 に接続したゲート及びドレインと、また、前記第3電圧(Vdd3)に接続したソ ースを備えて一つの電流制御機としての機能を果す。前記第8 NMOS トラン ジスタ(28)の抵抗値は自らのチャンネル幅及びチャンネルのドーピング濃度 により決定される。また、前記第8 NMOS トランジスタ(28)は前記第7 NMOS トランジスタ(26)と共に制御用分圧機の機能を実現する。前記第 7 NMOS トランジスタ(26)の電流値は前記表示制御信号(DCS)の電 圧レベル及び自らのチャンネル幅により調節可能である。 結局、前記第7及び第8 NMOS トランジスタ(26、28)は、前記表示 制御信号(DCS)がハイ論理を維持する場合、自分等の抵抗値による前記第4 電 圧及び前記第3電圧(Vdd3)間の電圧差を分圧し、分圧された電圧が前記接続 ノード(11)を経て前記第3乃至第6 NMOS トランジスタ(18乃至24 )のゲート側へ伝送できるようにする。 また、前記第3乃至第6 NMOS トランジスタ(18乃至24)は、前記接 続ノード(11)からの前記分圧電圧が自分等のゲートに印加される間、前記カ ソード(10)から自分等を経て前記第3電圧(Vdd3)側に一定量の電流が流 れ得るようにする。これを取り替えて説明すれば、前記第3乃至第6 NMOS トランジスタ(18乃至24)はそれぞれ一定の大きさの電流信号等をそれぞれ 発生して前記カソード(10)に供給すると言える。この際、第3乃至第6 NM OS トランジスタ(18乃至24)により発生する電流信号等は全て同一な大 きさを有するようにすることもできるが、最下位の NMOS トランジスタ(1 8)により発生する電流信号から最上位 NMOS トランジスタ(24)により 発生する電流信号へ行くほど電流量が2n倍に増加するのが好ましい。このため 、前記第3乃至第6 NMOS トランジスタ(18乃至24)のチャンネル幅は 、前記第3 NMOS トランジスタ(18a)のチャンネル幅に比べそれぞれ2 倍、4倍及び8倍のチャンネル幅を有するよう設定されるのが好ましい。例えば 、前記第3 NMOS トランジスタ(18)を経る電流信号が10 mAを有する 場合、前記第4乃至第6 NMOS トランジスタ(18b 乃至 18d)を経る電流信 号等は、それぞれ20 mA、40 mA及び80 mAを有するようにするのが好ま しい。結局、前記第3乃至第6 NMOS トランジスタ(18乃至24)は、前 記カソード(10)にそれぞれ異なる大きさの電流信号を供給できる四つの電流 源の機能を現す。 さらに、前記 FED セル駆動装置は前記接続ノード(11)から前記第3乃 至第6 NMOS トランジスタ(18乃至24)のゲート側に印加される前記分 圧電圧をそれぞれ切り換えるための第9乃至第12 NMOS トランジスタ(3 0乃至36)と、前記第9乃至第12 NMOS トランジスタ(30乃至36) を制御するための切換え制御部(38)をさらに備える。 前記切換え制御部(38)はビデオ信号(VS)を入力し、前記ビデオ信号( VS)を4ビットのディジタル論理信号(D0 乃至 D3)に変換する。また、前 記切換え制御部(38)は前記4ビットのディジタル論理信号(D0、D1、D2、D 3)を前記第9乃至第12 NMOS トランジスタ(30、32、34、36)のゲ ート等にそれぞれ印加する。このため、前記電流バルブ制御部(22)はアナロ グ−ディジタル変換器又はエンコーダを用いることができる。 前記4ビットのディジタル論理信号(D0 D1 D2 D3)は図3で表したよう に、差別的な電流源の使用に従い“0(0 0 0 0)”乃至“15(1 1 1 1)”の論理値を有することができる。これとは別に、前記4ビットのディジタ ル論理信号(D0 乃至 D3)はビデオ信号の大きさに従い“0(0 0 0 0) ”乃至“4(0 0 1 0)”の論理値を有することもできる。しかし、高いレ ベルの階調を達成するためには前者が好ましい。また、前記4ビットのディジタ ル論理信号(D0 D1 D2 D3)はそれぞれハイ論理を有する場合に“1”の論 理値を表わす。この結果、前記4ビットのディジタル論理信号(D0 D1 D2 D 3)は前記ビデオ信号の大きさに従い一部、又は全てが“1”の論理値を有する ことができ、併せて全て“0”の論理値を有することもできる。 前記第9乃至第12 NMOS トランジスタ(30乃至36)は、自分等のゲ ートにそれぞれ印加される前記4ビットのディジタル論理信号(D0 乃至 D3) の論理値に基づき選別的に駆動され、前記第3乃至第6 NMOS トランジスタ (18乃至24)が選別的に駆動されるようにする。この結果、前記カソード( 10)を経て流れる電流量が調節されるようにして前記カソード(10)から放 出される電子量が調節されるようにする。 例えば、前記4ビットのディジタル論理信号(D0 乃至 D3)の論理値が“1 ”の場合、前記第9 NMOS トランジスタ(30)だけがターンオンし、前記 第3 NMOS トランジスタ(18)を経る電流通路だけが形成されるようにす る。これにより、前記カソード(10)に流れる電流信号は10 mAとなるよう にする。 前記4ビットのディジタル論理信号(D0 乃至 D3)の論理値が“2”の場合 、前記第10 NMOS トランジスタ(32)だけがターンオンされ前記第4 NMOS トランジスタ(20)を経る電流通路だけが形成されるようにする。 この結果、前記カソード(10)に流れる電流信号は20 mAとなる。 前記4ビットのディジタル論理信号(D0 乃至 D3)の論理値が“4”の場合 、前記第11 NMOS トランジスタ(34)だけがターンオンされ前記第5 NMOS トランジスタ(22)を経る電流通路だけが形成されるようにする。 この際、前記カソード(10)に流れる電流信号は40 mAとなる。 前記4ビットのディジタル論理信号(D0 乃至 D3)の論理値が“8”の場合 、前記第12 NMOS トランジスタ(36)だけがターンオンされ前記第6 NMOS トランジスタ(24)を経る電流通路だけが形成されるようにする。 これにより、前記カソード(10)に流れる電流信号は80 mAとなる。 最後に、前記4ビットのディジタル論理信号(D0 乃至 D3)の論理値が“15 ”の場合、前記第9乃至第12 NMOS トランジスタ(30乃至36)が全て ターンオンされ前記第3乃至第6 NMOS トランジスタ(18乃至24)を経 る四つの電流通路等が全て形成されるようにする。この結果、前記カソード(1 0)に流れる電流量は150 mAとなる。 上述したように、本発明はカソードに互いに異なる量の電流信号を発生する少 なくとも二つ以上の電流源をビデオ信号の大きさに従い選別的に駆動してカソー ドから放出される電子量をビデオ信号に対し線形的に変化されるようにすること ができる。これにより、本発明は階調のレベルが増加しても画素に含まれるカソ ードの数量の増加及び画素の占有面積に制限を受けない長所を提供することがで きる。また、本発明の FED セル駆動装置は画素の占有面積と係りなく画素に 一定レベル以上の階調の輝度を提供することができる。 前述にて説明した実施例の図の図1で、カソードを一つのみ示したが、当業者 であれば一つの画素に数個乃至数十個のカソードが設けられるということが分か る程であり、併せて本発明の実施例で説明した一つのカソードは実際に相 互共通的に接続した数個乃至数十個のカソード等であるということが分かる程で ある。 尚、本発明の実施例を16レベルの階調を画素に提供する場合に限り説明した が、この分野に通暁する当業者であれば誰でも本発明を利用して32レベル、6 4レベル、124レベルさらに進んでそれ以上の階調の輝度を画素に提供できる ということが分かる程である。 従って、本発明の思想及び範囲は次に添付される特許請求範囲により限定され るべきである。

Claims (1)

  1. 【特許請求の範囲】 1.電子を放出するためのカソード、及び前記カソードから放出された電子等を 集束及び加速するためのゲート電極を有する電界放出画素セルを備えた電界放出 型表示器において、 前記ゲート電極に供給される第1電圧を切換えるための第1切換え手段と、 前記カソード及び第2電圧の間に電流ミラーを形成するよう、並列接続された 少なくとも二つ以上の電流制御用トランジスタ等と、 前記少なくとも二つ以上の電流制御用トランジスタ等を同一電圧で駆動するた め、第3電圧及び前記第2電圧の間に接続された電圧分圧手段と、 前記電圧分圧手段、及び前記少なくとも二つ以上の電流制御用トランジスタ等 の間にそれぞれ接続された少なくとも二つ以上の電圧切換え用トランジスタ等と 、 ビデオ信号の大きさに伴い、前記少なくとも二つ以上の電圧切換え用トランジ スタ等を制御するための制御手段を備えたことを特徴とする、電界放出型表示器 のセル駆動装置。 2.前記少なくとも二つ以上の電流制御用トランジスタ等は、自分等を経由する 電流信号がそれぞれ22倍の大きさを維持するよう互いに異なるチャンネル幅等 を有することを特徴とする、請求項1記載の電界放出型表示器のセル駆動装置。 3.前記制御手段が、前記ビデオ信号の大きさに伴い前記少なくとも二つ以上の 電圧切換え用トランジスタ等を一部、及び全部駆動させるようになったことを特 徴とする、請求項2記載の電界放出型表示器のセル駆動装置。 4.前記制御手段が、前記ビデオ信号の大きさに伴い漸進的に1の論理値が増加 する少なくとも2ビット以上の論理信号を発生するインコーダを備えたことを特 徴とする、請求項3記載の電界放出型表示器のセル駆動装置。 5.前記制御手段が、前記ビデオ信号を少なくとも2ビット以上のディジタル論 理信号に変換するアナログ−ディジタル変換器を備えたことを特徴とする、 請求項3記載の電界放出型表示器のセル駆動装置。 6.前記カソードに第4電圧を選択的に供給し、動作初期に前記カソードが臨界 電圧状態を維持するようにする第2切換え手段を追加して備えたことを特徴とす る、請求項1記載の電界放出型表示器のセル駆動装置。 7.前記分圧手段は、前記第2切換え手段が前記第4電圧を前記カソードに供給 される前記第4電圧を遮断した後、一定期間の間駆動され分圧電圧を前記少なく とも二つ以上の電圧切換え用トランジスタ等に供給するようにし、 前記第1切換え手段が、前記第1電圧を前記第2切換え手段及び前記分圧手段 が駆動する期間の間駆動し前記ゲート電極に供給されるようにすることを特徴と する、請求項6記載の電界放出表示器用セル駆動装置。
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