JPH11143423A - プラズマディスプレイパネルの駆動方法 - Google Patents
プラズマディスプレイパネルの駆動方法Info
- Publication number
- JPH11143423A JPH11143423A JP9310629A JP31062997A JPH11143423A JP H11143423 A JPH11143423 A JP H11143423A JP 9310629 A JP9310629 A JP 9310629A JP 31062997 A JP31062997 A JP 31062997A JP H11143423 A JPH11143423 A JP H11143423A
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- Japan
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- electrode
- period
- sustain discharge
- pulse
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- Control Of Indicators Other Than Cathode Ray Tubes (AREA)
- Control Of Gas Discharge Display Tubes (AREA)
Abstract
(57)【要約】
【課題】 連続的に放電が多数回発生してセル内での荷
電粒子が過剰になることによる放電強度の低下を防止
し、輝度の直線性を確保して画質向上を図る。 【解決手段】 各サブフィールドの維持放電期間４８ｃ
では、Ｘ電極及びＹ電極に維持放電パルスが連続的に印
加され、アドレスされたセルで放電が行なわれるように
するが、特に、放電回数が多いサブフィールドでは、駆
動波形Ｘ，Ｙ１，Ｙ２で示すように、この維持放電期間
４８ｃに維持放電パルスを印加しない略１０〜１００μ
secの電荷中和期間ＴN を設け、この電荷中和期間ＴNで
この放電するセルに生ずる過剰荷電粒子を中和消去する
ようにする。
電粒子が過剰になることによる放電強度の低下を防止
し、輝度の直線性を確保して画質向上を図る。 【解決手段】 各サブフィールドの維持放電期間４８ｃ
では、Ｘ電極及びＹ電極に維持放電パルスが連続的に印
加され、アドレスされたセルで放電が行なわれるように
するが、特に、放電回数が多いサブフィールドでは、駆
動波形Ｘ，Ｙ１，Ｙ２で示すように、この維持放電期間
４８ｃに維持放電パルスを印加しない略１０〜１００μ
secの電荷中和期間ＴN を設け、この電荷中和期間ＴNで
この放電するセルに生ずる過剰荷電粒子を中和消去する
ようにする。
Description
【０００１】
【発明の属する技術分野】本発明はパーソナルコンピュ
ータやワークステーションなどのディスプレイ装置，平
面型の壁掛けテレビジョン，広告，情報等の表示装置な
どに用いられるプラズマディスプレイパネルの駆動方法
に関する。
ータやワークステーションなどのディスプレイ装置，平
面型の壁掛けテレビジョン，広告，情報等の表示装置な
どに用いられるプラズマディスプレイパネルの駆動方法
に関する。
【０００２】
【従来の技術】２つの電極に交互にパルス状電圧を印加
して表示のための放電を行なうＡＣ型のプラズマディス
プレイ装置では、１フィールド（１枚の画面の期間）を
輝度毎に時間軸で複数のサブフィールドに区分し、各画
素（セル）毎に、放電により紫外線を発生させて蛍光体
を励起することにより、発光させている。この放電は維
持放電と呼ばれ、例えば、特開平４−１９５１８８号公
報に開示されているように、サブフィールド毎に放電回
数を変えることにより、中間調の表示が行なわれるよう
にしている。
して表示のための放電を行なうＡＣ型のプラズマディス
プレイ装置では、１フィールド（１枚の画面の期間）を
輝度毎に時間軸で複数のサブフィールドに区分し、各画
素（セル）毎に、放電により紫外線を発生させて蛍光体
を励起することにより、発光させている。この放電は維
持放電と呼ばれ、例えば、特開平４−１９５１８８号公
報に開示されているように、サブフィールド毎に放電回
数を変えることにより、中間調の表示が行なわれるよう
にしている。
【０００３】
【発明が解決しようとする課題】ところで、このような
プラズマディスプレイパネルの駆動に際しては、連続し
て１００回以上の放電が繰り返される場合もある。この
ような場合には、セル内の電荷が多くなり過ぎて放電を
阻害することがあり、印加されるパルス数と輝度との関
係が比例しなくなり、所望とする中間調表示ができなく
なるなどの問題があった。
プラズマディスプレイパネルの駆動に際しては、連続し
て１００回以上の放電が繰り返される場合もある。この
ような場合には、セル内の電荷が多くなり過ぎて放電を
阻害することがあり、印加されるパルス数と輝度との関
係が比例しなくなり、所望とする中間調表示ができなく
なるなどの問題があった。
【０００４】本発明の目的は、かかる問題を解消し、維
持放電期間中のセル内の電荷量を制御することができる
ようにしたプラズマディスプレイパネルの駆動方法を提
供することにある。
持放電期間中のセル内の電荷量を制御することができる
ようにしたプラズマディスプレイパネルの駆動方法を提
供することにある。
【０００５】
【課題を解決するための手段】上記目的を達成するため
に、本発明は、維持放電期間中に放電を行なう２つの電
極群のどちらにも電圧を印加しない期間を設ける。
に、本発明は、維持放電期間中に放電を行なう２つの電
極群のどちらにも電圧を印加しない期間を設ける。
【０００６】かかる期間を設けることにより、過多状態
となった電荷を中和消去することができる。
となった電荷を中和消去することができる。
【０００７】
【発明の実施の形態】以下、本発明の実施形態を図面に
より説明する。
より説明する。
【０００８】図２は本発明を用いたプラズマディスプレ
イパネルの一部を拡大して示す分解斜視図であって、２
１は前面ガラス基板、２２はＸ電極、２３はＹ電極、２
４はＸバス電極、２５はＹバス電極、２６は誘電体、２
７は保護層、２８は背面ガラス基板、２９はアドレス電
極、３０は誘電体３０、３１は隔壁、３２は蛍光体であ
る。
イパネルの一部を拡大して示す分解斜視図であって、２
１は前面ガラス基板、２２はＸ電極、２３はＹ電極、２
４はＸバス電極、２５はＹバス電極、２６は誘電体、２
７は保護層、２８は背面ガラス基板、２９はアドレス電
極、３０は誘電体３０、３１は隔壁、３２は蛍光体であ
る。
【０００９】同図において、前面ガラス基板２１の下面
には、透明なＸ電極２２と透明なＹ電極２３とが交互に
かつ互いに平行に設けられており、Ｘ電極２２にＸバス
電極２４が、Ｙ電極２３にＹバス電極２５が夫々積層さ
れている。そして、これら電極が誘電体２６によって覆
われ、さらにその上にＭｇＯなどの保護層２７が設けら
れている。
には、透明なＸ電極２２と透明なＹ電極２３とが交互に
かつ互いに平行に設けられており、Ｘ電極２２にＸバス
電極２４が、Ｙ電極２３にＹバス電極２５が夫々積層さ
れている。そして、これら電極が誘電体２６によって覆
われ、さらにその上にＭｇＯなどの保護層２７が設けら
れている。
【００１０】一方、背面ガラス基板２８の上面には、前
面ガラス基板２１のＸ電極２２やＹ電極２３に直交する
方向に、アドレス電極２９が設けられており、このアド
レス電極２９を誘電体３０が覆い、さらにその上に、ア
ドレス電極２９を挾むような位置に、隔壁３１がアドレ
ス電極２９と平行に設けられている。さらに、隔壁３１
とアドレス電極２９の上には、蛍光体３２が塗布されて
いる。２つの隔壁３１で囲まれ、かつＸ電極２２とＹ電
極２３を対として含む領域が１つのセルを構成してい
る。
面ガラス基板２１のＸ電極２２やＹ電極２３に直交する
方向に、アドレス電極２９が設けられており、このアド
レス電極２９を誘電体３０が覆い、さらにその上に、ア
ドレス電極２９を挾むような位置に、隔壁３１がアドレ
ス電極２９と平行に設けられている。さらに、隔壁３１
とアドレス電極２９の上には、蛍光体３２が塗布されて
いる。２つの隔壁３１で囲まれ、かつＸ電極２２とＹ電
極２３を対として含む領域が１つのセルを構成してい
る。
【００１１】図３は図２での矢印Ａ方向からみたプラズ
マディスプレイパネルの１つのセル部分を示す断面図で
あって、３３は空間であり、図２に対応する部分には同
一符号を付けている。
マディスプレイパネルの１つのセル部分を示す断面図で
あって、３３は空間であり、図２に対応する部分には同
一符号を付けている。
【００１２】同図において、アドレス電極２９は、隣合
う２つの隔壁３１の中間部に位置している。また、かか
る隔壁３１で隔離される前面ガラス基板２１と背面ガラ
ス基板２８との間の空間３３には、Ｎｅ，Ｘｅなどの放
電ガスが充填されている。
う２つの隔壁３１の中間部に位置している。また、かか
る隔壁３１で隔離される前面ガラス基板２１と背面ガラ
ス基板２８との間の空間３３には、Ｎｅ，Ｘｅなどの放
電ガスが充填されている。
【００１３】図４は図２での矢印Ｂ方向からみたプラズ
マディスプレイパネルの３つのセル部分を示す断面図で
あって、各セルは縦の破線で区分して示し、図２に対応
する部分には同一符号を付けている。
マディスプレイパネルの３つのセル部分を示す断面図で
あって、各セルは縦の破線で区分して示し、図２に対応
する部分には同一符号を付けている。
【００１４】同図において、各セルには、Ｘ電極２２と
行Ｙ電極２３とが１つずつ含まれている。ＡＣ型のプラ
ズマディスプレイパネルでは、これらＸ電極２２とＹ電
極２３との近傍の誘電体２６上に正負の電荷を分けて集
め、この電荷を利用して放電を行なうための電界を形成
する。
行Ｙ電極２３とが１つずつ含まれている。ＡＣ型のプラ
ズマディスプレイパネルでは、これらＸ電極２２とＹ電
極２３との近傍の誘電体２６上に正負の電荷を分けて集
め、この電荷を利用して放電を行なうための電界を形成
する。
【００１５】図５は図２〜図４に示したＸ電極２２，Ｙ
電極２３及びアドレス電極２９の配線とその駆動回路と
を模式的に示す構成図であって、２９ａ，２９ｂはアド
レス電極、３４はＸ駆動回路、３５はＹ駆動回路、３６
ａ，３６ｂはアドレス駆動回路であり、前出図面に対応
する部分には同一符号をつけて重複する説明を省略す
る。なお、ここでは、前出のアドレス電極２９の１つお
きをアドレス電極２９ａとし、他の１つおきをアドレス
電極２９ｂとしている。
電極２３及びアドレス電極２９の配線とその駆動回路と
を模式的に示す構成図であって、２９ａ，２９ｂはアド
レス電極、３４はＸ駆動回路、３５はＹ駆動回路、３６
ａ，３６ｂはアドレス駆動回路であり、前出図面に対応
する部分には同一符号をつけて重複する説明を省略す
る。なお、ここでは、前出のアドレス電極２９の１つお
きをアドレス電極２９ａとし、他の１つおきをアドレス
電極２９ｂとしている。
【００１６】同図において、Ｘ駆動回路３４はＸ電極２
２に印加する駆動パルスを発生している。Ｙ駆動回路３
５はＹ電極２３の１本毎に接続され、Ｙ電極２３に印加
する駆動パルスを発生している。また、２つのアドレス
駆動回路３６ａ，３６ｂが設けられており、一方のアド
レス駆動回路３６ａは１つおきのアドレス電極２９ａの
１本毎に接続されて、これらアドレス電極２９ａに印加
する駆動パルスを発生し、他方のアドレス駆動回路３６
ｂは他の１つおきのアドレス電極２９ｂの１本毎に接続
されて、これらアドレス電極２９ｂに印加する駆動パル
スを発生する。
２に印加する駆動パルスを発生している。Ｙ駆動回路３
５はＹ電極２３の１本毎に接続され、Ｙ電極２３に印加
する駆動パルスを発生している。また、２つのアドレス
駆動回路３６ａ，３６ｂが設けられており、一方のアド
レス駆動回路３６ａは１つおきのアドレス電極２９ａの
１本毎に接続されて、これらアドレス電極２９ａに印加
する駆動パルスを発生し、他方のアドレス駆動回路３６
ｂは他の１つおきのアドレス電極２９ｂの１本毎に接続
されて、これらアドレス電極２９ｂに印加する駆動パル
スを発生する。
【００１７】図６は本発明によるプラズマディスプレイ
パネルの駆動方法におけるフィールド構成を示す図であ
って、横軸を時間軸ｔ、縦軸をセルの行ｙとしている。
ここで、４０は１フィールド期間、４１〜４８はサブフ
ィールド、４１ａ〜４８ａはリセット期間、４１ｂ〜４
８ｂはアドレス期間、４１ｃ〜４８ｃは維持放電期間で
ある。
パネルの駆動方法におけるフィールド構成を示す図であ
って、横軸を時間軸ｔ、縦軸をセルの行ｙとしている。
ここで、４０は１フィールド期間、４１〜４８はサブフ
ィールド、４１ａ〜４８ａはリセット期間、４１ｂ〜４
８ｂはアドレス期間、４１ｃ〜４８ｃは維持放電期間で
ある。
【００１８】同図において、１フィールド期間４０が複
数のサブフィールドに区分されている。ここでは、８個
のサブフィールド４１〜４８に区分されているものとす
る。、この場合、第１のサブフィールド４１が最も放電
回数が少ないサブフィールドとして割り当てられ、放電
回数の少ない順にサブフィールド４１〜４８が図示のよ
うに配列されている。
数のサブフィールドに区分されている。ここでは、８個
のサブフィールド４１〜４８に区分されているものとす
る。、この場合、第１のサブフィールド４１が最も放電
回数が少ないサブフィールドとして割り当てられ、放電
回数の少ない順にサブフィールド４１〜４８が図示のよ
うに配列されている。
【００１９】夫々のサブフィールド４１〜４８には、最
初にリセット期間４１ａ〜４８ａが設定され、続いて、
表示するセルを規定するアドレス期間４１ｂ〜４８ｂ
が、さらにこれに続いて、アドレス放電で電荷を形成さ
れたセルのみの放電を行なう維持放電期間４１ｃ〜４８
ｃが設定されている。これら維持放電期間４１ｃ〜４８
ｃでは、夫々に放電回数が割り振られており、この放電
回数に応じて維持放電期間４１ｃ〜４８ｃの時間長が異
なる。また、これらの放電回数の組合せによって（即
ち、どのサブフィールドとどのサブフィールドで放電を
行なわせるかに応じて）表示される階調が異なる。
初にリセット期間４１ａ〜４８ａが設定され、続いて、
表示するセルを規定するアドレス期間４１ｂ〜４８ｂ
が、さらにこれに続いて、アドレス放電で電荷を形成さ
れたセルのみの放電を行なう維持放電期間４１ｃ〜４８
ｃが設定されている。これら維持放電期間４１ｃ〜４８
ｃでは、夫々に放電回数が割り振られており、この放電
回数に応じて維持放電期間４１ｃ〜４８ｃの時間長が異
なる。また、これらの放電回数の組合せによって（即
ち、どのサブフィールドとどのサブフィールドで放電を
行なわせるかに応じて）表示される階調が異なる。
【００２０】なお、放電回数の多少とサブフィールドの
順番は任意であるが、連続して放電が多数回繰り返され
るサブフィールドもある。
順番は任意であるが、連続して放電が多数回繰り返され
るサブフィールドもある。
【００２１】図１は本発明によるプラズマディスプレイ
パネルの駆動方法の一実施形態を示すタイミング図であ
って、図６における１つのサブフィールドでの駆動波形
の一部を示すものである。なお、ＸはＸ電極２２に印加
される駆動波形の一部を、Ｙ１，Ｙ２は、例えば、１行
目，２行目のように、同じＸ電極２２を挟んで配置され
る２つのＹ電極２３に印加される駆動波形の一部を、Ａ
は１つのアドレス電極２９に印加される駆動波形の一部
を夫々示しており、１はリセットパルス、２はＸスキャ
ンパルス、３，４はＸ維持放電パルス、５はＹスキャン
パルス、６〜８はＹ維持放電パルス、９はアドレスパル
ス、１０は全面パルスである。
パネルの駆動方法の一実施形態を示すタイミング図であ
って、図６における１つのサブフィールドでの駆動波形
の一部を示すものである。なお、ＸはＸ電極２２に印加
される駆動波形の一部を、Ｙ１，Ｙ２は、例えば、１行
目，２行目のように、同じＸ電極２２を挟んで配置され
る２つのＹ電極２３に印加される駆動波形の一部を、Ａ
は１つのアドレス電極２９に印加される駆動波形の一部
を夫々示しており、１はリセットパルス、２はＸスキャ
ンパルス、３，４はＸ維持放電パルス、５はＹスキャン
パルス、６〜８はＹ維持放電パルス、９はアドレスパル
ス、１０は全面パルスである。
【００２２】同図において、ここでは、最も放電回数の
多いサブフィールド４８を例として説明する。このサブ
フィールド４８では、維持放電期間４８ｃで印加される
維持放電パルス形のサブフィールド４１〜４７に比べて
最も多い。
多いサブフィールド４８を例として説明する。このサブ
フィールド４８では、維持放電期間４８ｃで印加される
維持放電パルス形のサブフィールド４１〜４７に比べて
最も多い。
【００２３】Ｘ電極２２に印加される駆動波形Ｘは、リ
セット期間４８ａに印加されるリセットパルス１と、ア
ドレス期間４８ｂに印加されるＸスキャンパルス２と、
維持放電期間４８ｃに印加される維持放電パルス３，４
とからなっている。なお、このリセットパルス１は放電
開始電圧よりも高い電圧に設定されている。また、Ｙ電
極２３に印加される駆動波形Ｙ１，Ｙ２は夫々、アドレ
ス期間４８ｂに印加されるＹスキャンパルス５と、維持
放電期間４８ｃに印加される維持放電パルス６，７，８
とからなっている。
セット期間４８ａに印加されるリセットパルス１と、ア
ドレス期間４８ｂに印加されるＸスキャンパルス２と、
維持放電期間４８ｃに印加される維持放電パルス３，４
とからなっている。なお、このリセットパルス１は放電
開始電圧よりも高い電圧に設定されている。また、Ｙ電
極２３に印加される駆動波形Ｙ１，Ｙ２は夫々、アドレ
ス期間４８ｂに印加されるＹスキャンパルス５と、維持
放電期間４８ｃに印加される維持放電パルス６，７，８
とからなっている。
【００２４】ここで、従来では、維持放電期間４８ｃで
の駆動波形Ｘの維持放電パルスは連続して印加され、ま
た、駆動波形Ｙ１，Ｙ２の維持放電パルスも連続して印
加されているが、この実施形態では、所定個数の維持放
電パルスが印加される毎に電荷中和期間ＴN を設け、こ
の電荷中和期間ＴNでは、維持放電パルスが印加されな
いようにしている。
の駆動波形Ｘの維持放電パルスは連続して印加され、ま
た、駆動波形Ｙ１，Ｙ２の維持放電パルスも連続して印
加されているが、この実施形態では、所定個数の維持放
電パルスが印加される毎に電荷中和期間ＴN を設け、こ
の電荷中和期間ＴNでは、維持放電パルスが印加されな
いようにしている。
【００２５】なお、このように電荷中和期間ＴNが設け
られても、この維持放電期間４８ｃに印加される維持放
電パルスの個数は、このサブフィールド４８で所定の輝
度レベルが得られるような個数に設定される。従って、
例えば、夫々のサブフィールド４１〜４８で所定の輝度
レベルを得るために、サブフィールド４１，４２，４
３，……，４７，４８での維持放電期間４１ｃ，４２
ｃ，４３ｃ，……４７ｃ，４８ｃで印加される維持放電
パルスの個数を２1，２2，２3，……，２7，２8とした
とすると、例えば、サブフィールド４８で放電させるた
めに、その維持放電期間４８ｃで維持放電パルスを印加
する場合、上記の電荷中和期間ＴNを設けても、印加さ
れる維持放電パルスの個数は２8 個である。
られても、この維持放電期間４８ｃに印加される維持放
電パルスの個数は、このサブフィールド４８で所定の輝
度レベルが得られるような個数に設定される。従って、
例えば、夫々のサブフィールド４１〜４８で所定の輝度
レベルを得るために、サブフィールド４１，４２，４
３，……，４７，４８での維持放電期間４１ｃ，４２
ｃ，４３ｃ，……４７ｃ，４８ｃで印加される維持放電
パルスの個数を２1，２2，２3，……，２7，２8とした
とすると、例えば、サブフィールド４８で放電させるた
めに、その維持放電期間４８ｃで維持放電パルスを印加
する場合、上記の電荷中和期間ＴNを設けても、印加さ
れる維持放電パルスの個数は２8 個である。
【００２６】従って、駆動波形Ｘにおいて、維持放電パ
ルス３，４と分けられているのは、電荷中和期間ＴNが
設けられたことによって維持放電パルスの一部の間隔が
広げられたことによるものであり、駆動波形Ｙ１，Ｙ２
での維持放電パルス７，８についても同様である。
ルス３，４と分けられているのは、電荷中和期間ＴNが
設けられたことによって維持放電パルスの一部の間隔が
広げられたことによるものであり、駆動波形Ｙ１，Ｙ２
での維持放電パルス７，８についても同様である。
【００２７】アドレス電極２９に印加される駆動波形Ａ
は、発光させるセルに対応するアドレス期間４８ｂのア
ドレスパルス９と駆動波形Ｘ，Ｘでの維持放電パルスに
対応する全面パルス１０とからなっている。なお、発光
させるセルがない場合には、アドレスパルス９も発生さ
れない。また、全面パルス１０とアドレスパルス９は略
同電圧に設定されている。
は、発光させるセルに対応するアドレス期間４８ｂのア
ドレスパルス９と駆動波形Ｘ，Ｘでの維持放電パルスに
対応する全面パルス１０とからなっている。なお、発光
させるセルがない場合には、アドレスパルス９も発生さ
れない。また、全面パルス１０とアドレスパルス９は略
同電圧に設定されている。
【００２８】次に、この実施形態の動作について説明す
る。
る。
【００２９】Ｙ電極２３に印加されるＹスキャンパルス
５に対してアドレス電極２９にアドレスパルス９が印加
されたセルでは、アドレス放電が起こり、このセルでの
Ｙ電極２３近傍の誘電体２６上にプラスの荷電粒子が、
同じくＸ電極２２近傍の誘電体２６上にマイナスの荷電
粒子が夫々蓄積される。かかる荷電粒子が蓄積したセル
でのみ、これ続くＸ電極２２への維持放電パルス３の印
加及びＹ電極２３への維持放電パルス６及びＹ維持放電
パルス７の印加により、このセルで連続放電が起こる。
５に対してアドレス電極２９にアドレスパルス９が印加
されたセルでは、アドレス放電が起こり、このセルでの
Ｙ電極２３近傍の誘電体２６上にプラスの荷電粒子が、
同じくＸ電極２２近傍の誘電体２６上にマイナスの荷電
粒子が夫々蓄積される。かかる荷電粒子が蓄積したセル
でのみ、これ続くＸ電極２２への維持放電パルス３の印
加及びＹ電極２３への維持放電パルス６及びＹ維持放電
パルス７の印加により、このセルで連続放電が起こる。
【００３０】この連続放電回数が多くなると、セル内の
荷電粒子が過剰になり、放電の強度が低下することがあ
るが、この維持放電期間４８ｃ中にＸ電極２２及びＹ電
極２３に維持放電パルスを印加しない電荷中和期間ＴN
が設けられているため、セル内の荷電粒子は互いに中和
消去し合い、この荷電粒子を減らすことができる。
荷電粒子が過剰になり、放電の強度が低下することがあ
るが、この維持放電期間４８ｃ中にＸ電極２２及びＹ電
極２３に維持放電パルスを印加しない電荷中和期間ＴN
が設けられているため、セル内の荷電粒子は互いに中和
消去し合い、この荷電粒子を減らすことができる。
【００３１】これでも、Ｘ電極２２及びＹ電極２３近傍
の誘電体２６上の荷電粒子は充分残留するため、これに
続くＸ維持放電パルス４及びＹ維持放電パルス８が印加
されることにより、再び安定した維持放電が行なわれ
る。
の誘電体２６上の荷電粒子は充分残留するため、これに
続くＸ維持放電パルス４及びＹ維持放電パルス８が印加
されることにより、再び安定した維持放電が行なわれ
る。
【００３２】ここで、電荷中和期間ＴNは、過剰な荷電
粒子を効果的に除くためには、略１０μsec以上必要で
あって、また、不要な荷電粒子（放電空間に漂う荷電粒
子）は数１０μsecで中和するので、１００μsecあれば
充分である。従って、この電荷中和期間ＴN は略１０〜
１００μsecが望ましい。
粒子を効果的に除くためには、略１０μsec以上必要で
あって、また、不要な荷電粒子（放電空間に漂う荷電粒
子）は数１０μsecで中和するので、１００μsecあれば
充分である。従って、この電荷中和期間ＴN は略１０〜
１００μsecが望ましい。
【００３３】なお、ここでは、維持放電期間４８ｃ中に
１回の電荷中和期間ＴNだけを示しているが、複数回設
けてもよい。この場合、電荷中和期間ＴNの設定時間間
隔は上記の過剰荷電粒子を考慮して設定されることはい
うまでもない。また、放電回数の少ないサブフィールド
では、電荷中和期間ＴNを設ける必要がない場合もあ
る。
１回の電荷中和期間ＴNだけを示しているが、複数回設
けてもよい。この場合、電荷中和期間ＴNの設定時間間
隔は上記の過剰荷電粒子を考慮して設定されることはい
うまでもない。また、放電回数の少ないサブフィールド
では、電荷中和期間ＴNを設ける必要がない場合もあ
る。
【００３４】以上のようにして、この実施形態では、維
持放電回数が多くてセル内の荷電粒子が過剰になること
による放電強度の低下を防止することができる。
持放電回数が多くてセル内の荷電粒子が過剰になること
による放電強度の低下を防止することができる。
【００３５】図７は本発明によるプラズマディスプレイ
パネルの駆動方法の他の実施形態を示すタイミング図で
あって、図１に対応する部分には同一符号をつけて重複
する説明を省略する。
パネルの駆動方法の他の実施形態を示すタイミング図で
あって、図１に対応する部分には同一符号をつけて重複
する説明を省略する。
【００３６】同図において、この実施形態では、アドレ
ス電極２９に印加される駆動波形Ａでも、Ｘ電極２２及
びＹ電極２３に印加される駆動波形Ｘ，Ｙ１，Ｙ２に合
わせて、略１０〜１００μｓｅｃの電荷中和期間ＴNに
維持放電期間４８ｃに印加される全面パルス１０を中断
させる。これにより、セル内の全電極に電圧が印加され
ない期間が設定され、セル全体で過剰荷電粒子の中和消
去が起こる。
ス電極２９に印加される駆動波形Ａでも、Ｘ電極２２及
びＹ電極２３に印加される駆動波形Ｘ，Ｙ１，Ｙ２に合
わせて、略１０〜１００μｓｅｃの電荷中和期間ＴNに
維持放電期間４８ｃに印加される全面パルス１０を中断
させる。これにより、セル内の全電極に電圧が印加され
ない期間が設定され、セル全体で過剰荷電粒子の中和消
去が起こる。
【００３７】この点以外については、図１に示した実施
形態と同様であり、従って、図７に示すこの実施形態に
おいても、維持放電回数が多くてセル内の荷電粒子が過
剰になることによる放電強度の低下を防止することがで
きる。
形態と同様であり、従って、図７に示すこの実施形態に
おいても、維持放電回数が多くてセル内の荷電粒子が過
剰になることによる放電強度の低下を防止することがで
きる。
【００３８】
【発明の効果】以上説明したように、本発明によれば、
維持放電回数が多くても、セル内の過剰な荷電粒子を低
減させることができ、従って、かかる過剰荷電粒子によ
る放電強度の低下を防止することができて、輝度の直線
性を確保して画質を向上されることができる。
維持放電回数が多くても、セル内の過剰な荷電粒子を低
減させることができ、従って、かかる過剰荷電粒子によ
る放電強度の低下を防止することができて、輝度の直線
性を確保して画質を向上されることができる。
【図１】本発明によるプラズマディスプレイパネルの駆
動方法の一実施形態を示すタイミング図である。
動方法の一実施形態を示すタイミング図である。
【図２】本発明によるプラズマディスプレイパネルの駆
動方法を用いるプラズマディスプレイパネルの構造の一
部を拡大して示す分解斜視図である。
動方法を用いるプラズマディスプレイパネルの構造の一
部を拡大して示す分解斜視図である。
【図３】図２に示すプラズマディスプレイパネルの矢印
Ａ方向からみた断面図である。
Ａ方向からみた断面図である。
【図４】図２に示すプラズマディスプレイパネルの矢印
Ｂ方向からみた断面図である。
Ｂ方向からみた断面図である。
【図５】プラズマディスプレイパネルでのパネル電極の
配列とその駆動回路とを模式的に示す構成図である。
配列とその駆動回路とを模式的に示す構成図である。
【図６】本発明によるプラズマディスプレイパネルの駆
動方法におけるフィールド構成を示す図である。
動方法におけるフィールド構成を示す図である。
【図７】本発明によるプラズマディスプレイパネルの駆
動方法の他の実施形態を示すタイミング図である。
動方法の他の実施形態を示すタイミング図である。
１ リセットパルス ２ Ｘスキャンパルス ３，４ Ｘ維持放電パルス ５ Ｙスキャンパルス ６，７，８ Ｙ維持放電パルス ９ アドレスパルス １０ 全面パルス ２１ 前面ガラス基板 ２２ Ｘ電極 ２３ Ｙ電極 ２８ 背面ガラス基板 ２９ アドレスＡ電極 ３１ 隔壁 ３４ Ｘ駆動回路 ３５ Ｙ駆動回路 ３６ Ａ駆動回路 ４０ １フィールド ４１〜４８ サブフィールド ４１ａ〜４８ａ リセット期間 ４１ｂ〜４８ｂ アドレス期間 ４１ｃ〜４８ｃ 維持放電期間 ＴN 電荷中和期間
───────────────────────────────────────────────────── フロントページの続き (72)発明者 大高 広 東京都千代田区神田駿河台四丁目６番地 株式会社日立製作所家電・情報メディア事 業部内 (72)発明者 増田 健夫 東京都千代田区神田駿河台四丁目６番地 株式会社日立製作所家電・情報メディア事 業部内
Claims (3)
- 【請求項１】 第１のガラス基板に互いに平行にかつ互
いに独立に駆動可能な第１，第２の電極群が配置され、
該第１，第２の電極群に交互にパルス状の電圧を印加し
て連続的に放電を行なうプラズマディスプレイパネルの
駆動方法において、 該連続的に放電を行なう期間中に該第１，第２の電極群
に該電圧を印加しない期間を設けたことを特徴とするプ
ラズマディスプレイパネルの駆動方法。 - 【請求項２】 請求項１において、 前記連続的に放電を行なう期間中に設けた前記第１，第
２の電極群に前記電圧を印加しない期間を略１０〜１０
０μsecとしたことを特徴とするプラズマディスプレイ
パネルの駆動方法。 - 【請求項３】 請求項１または２において、 前記第１のガラス基板に対向する第２のガラス基板に前
記第１，第２の電極群と直交して交差する第３の電極群
を有し、 前記第１，第２の電極群で連続的に放電を行なう期間中
に該第３の電極群に電圧を印加し、かつ前記第１，第２
の電極群に前記電圧を印加しない期間に該第３の電極群
に該電圧を印加しないことを特徴とするプラズマディス
プレイパネルの駆動方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9310629A JPH11143423A (ja) | 1997-11-12 | 1997-11-12 | プラズマディスプレイパネルの駆動方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9310629A JPH11143423A (ja) | 1997-11-12 | 1997-11-12 | プラズマディスプレイパネルの駆動方法 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH11143423A true JPH11143423A (ja) | 1999-05-28 |
Family
ID=18007566
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP9310629A Pending JPH11143423A (ja) | 1997-11-12 | 1997-11-12 | プラズマディスプレイパネルの駆動方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH11143423A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP1528531A2 (en) | 2003-11-03 | 2005-05-04 | Lg Electronics Inc. | Method of driving a plasma display panel |
-
1997
- 1997-11-12 JP JP9310629A patent/JPH11143423A/ja active Pending
Cited By (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP1528531A2 (en) | 2003-11-03 | 2005-05-04 | Lg Electronics Inc. | Method of driving a plasma display panel |
| JP2005141223A (ja) * | 2003-11-03 | 2005-06-02 | Lg Electronics Inc | プラズマディスプレイパネルの駆動方法 |
| KR100563463B1 (ko) * | 2003-11-03 | 2006-03-23 | 엘지전자 주식회사 | 플라즈마 디스플레이 패널의 구동방법 |
| EP1528531A3 (en) * | 2003-11-03 | 2007-11-28 | Lg Electronics Inc. | Method of driving a plasma display panel |
| US7508359B2 (en) | 2003-11-03 | 2009-03-24 | Lg Electronics Inc. | Method of driving a plasma display panel |
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