JPH11203208A - シリアル通信線のショート検出方法 - Google Patents
シリアル通信線のショート検出方法Info
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- JPH11203208A JPH11203208A JP10006969A JP696998A JPH11203208A JP H11203208 A JPH11203208 A JP H11203208A JP 10006969 A JP10006969 A JP 10006969A JP 696998 A JP696998 A JP 696998A JP H11203208 A JPH11203208 A JP H11203208A
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- Combined Controls Of Internal Combustion Engines (AREA)
- Detection And Correction Of Errors (AREA)
Abstract
(57)【要約】
【課題】確実にシリアル通信線のショートを検出するこ
とができるシリアル通信線のショート検出方法を提供す
る。 【解決手段】マイクロコンピュータ１に０１付与回路８
を、ＥＥＰＲＯＭ１０に０１削除回路１７を設け、ま
た、ＥＥＰＲＯＭ１０に０１付与回路１８を、マイクロ
コンピュータ１に０１削除回路９を設け、信号線Ｌ３，
Ｌ４にて接続されている。０１付与回路８，１８におい
て、転送される単位データ（書き込み・読み込みデー
タ）の上位および下位ビットに０(2) と１(2) が付加さ
れ、０１削除回路１７，９において、付加した０(2) と
１(2) が取り除かれるとともに、転送されたデータが全
て０(2) または全て１(2) となると信号線Ｌ３，Ｌ４で
のショートが発生したと判断する。
とができるシリアル通信線のショート検出方法を提供す
る。 【解決手段】マイクロコンピュータ１に０１付与回路８
を、ＥＥＰＲＯＭ１０に０１削除回路１７を設け、ま
た、ＥＥＰＲＯＭ１０に０１付与回路１８を、マイクロ
コンピュータ１に０１削除回路９を設け、信号線Ｌ３，
Ｌ４にて接続されている。０１付与回路８，１８におい
て、転送される単位データ（書き込み・読み込みデー
タ）の上位および下位ビットに０(2) と１(2) が付加さ
れ、０１削除回路１７，９において、付加した０(2) と
１(2) が取り除かれるとともに、転送されたデータが全
て０(2) または全て１(2) となると信号線Ｌ３，Ｌ４で
のショートが発生したと判断する。
Description
【０００１】
【発明の属する技術分野】この発明は、シリアル通信線
のショート検出方法に関するものである。
のショート検出方法に関するものである。
【０００２】
【従来の技術】エンジン制御用コントローラにおいて、
燃料噴射制御を行う際に理論空燃比への制御精度向上の
ために学習制御が行われている。これは、理論空燃比か
らの空燃比ズレ量を求めるとともに空燃比ズレ量を修正
する補正量（学習補正量）を求め記憶し、現在の運転状
態に該当する学習補正量を噴射時間に反映するものであ
る。ここで、記憶される学習補正量はイグニッションス
イッチを切っても消去されないものであるが、バッテリ
交換の際に消去されてしまう。これを回避する一手段と
して、マイクロコンピュータに対し外付けＥＥＰＲＯＭ
を接続し、ＥＥＰＲＯＭに学習補正量を記憶することが
行われている。
燃料噴射制御を行う際に理論空燃比への制御精度向上の
ために学習制御が行われている。これは、理論空燃比か
らの空燃比ズレ量を求めるとともに空燃比ズレ量を修正
する補正量（学習補正量）を求め記憶し、現在の運転状
態に該当する学習補正量を噴射時間に反映するものであ
る。ここで、記憶される学習補正量はイグニッションス
イッチを切っても消去されないものであるが、バッテリ
交換の際に消去されてしまう。これを回避する一手段と
して、マイクロコンピュータに対し外付けＥＥＰＲＯＭ
を接続し、ＥＥＰＲＯＭに学習補正量を記憶することが
行われている。
【０００３】このマイクロコンピュータに対して外付け
ＥＥＰＲＯＭを接続する場合には、マイクロコンピュー
タの限られたポートを有効に活用するためにシリアル通
信を使用している。つまり、図１７に示すように、マイ
クロコンピュータ５０に対しＥＥＰＲＯＭ６０を外付け
し、両者をシリアル通信線Ｌ１０〜Ｌ１２にて接続し、
マイクロコンピュータ５０のＣＰＵ５１が学習値を算出
するとともに当該学習値をＥＥＰＲＯＭ６０のメモリア
レー６１に記憶させ、必要時にマイクロコンピュータ５
０のＣＰＵ５１はＥＥＰＲＯＭ６０のメモリアレー６１
からデータを読み出し演算に使用する。
ＥＥＰＲＯＭを接続する場合には、マイクロコンピュー
タの限られたポートを有効に活用するためにシリアル通
信を使用している。つまり、図１７に示すように、マイ
クロコンピュータ５０に対しＥＥＰＲＯＭ６０を外付け
し、両者をシリアル通信線Ｌ１０〜Ｌ１２にて接続し、
マイクロコンピュータ５０のＣＰＵ５１が学習値を算出
するとともに当該学習値をＥＥＰＲＯＭ６０のメモリア
レー６１に記憶させ、必要時にマイクロコンピュータ５
０のＣＰＵ５１はＥＥＰＲＯＭ６０のメモリアレー６１
からデータを読み出し演算に使用する。
【０００４】この種のシステムにおける異常検出方法と
して、メモリ内のデータの破壊の有無をチェックする方
法が一般的に用いられている。より具体的には、図１８
に示すように、ＣＰＵ５１はステップ１００１において
書き込みデータをＥＥＰＲＯＭ６０の領域Ｚ１に書き込
むとともにステップ１００２で領域Ｚ２，Ｚ３にも同一
のデータを書き込む。そして、ＣＰＵ５１は図１９のス
テップ１１０１でＥＥＰＲＯＭ６０の領域Ｚ１，Ｚ２，
Ｚ３のデータを読み出し、ステップ１１０２で領域Ｚ
１，Ｚ２，Ｚ３のデータを比較する。より詳しくは、図
２０のステップ１２０１のように、領域Ｚ１，Ｚ２，Ｚ
３のデータが全て一致するか否か判定し、一致しないと
ステップ１２０２で警報を行うとともに、ステップ１２
０３でデータを全て多数の方に統一する。このように、
ＥＥＰＲＯＭ６０に同一データを複数持つことにより、
１つのデータが異常の場合でも他のデータによりその異
常を検出し、かつ異常データを修復可能とすることがで
きる。その後、ＣＰＵ５１は図１９のステップ１１０３
に移行してデータを使用した処理、即ち、学習値を用い
た燃料噴射量の演算を行う。
して、メモリ内のデータの破壊の有無をチェックする方
法が一般的に用いられている。より具体的には、図１８
に示すように、ＣＰＵ５１はステップ１００１において
書き込みデータをＥＥＰＲＯＭ６０の領域Ｚ１に書き込
むとともにステップ１００２で領域Ｚ２，Ｚ３にも同一
のデータを書き込む。そして、ＣＰＵ５１は図１９のス
テップ１１０１でＥＥＰＲＯＭ６０の領域Ｚ１，Ｚ２，
Ｚ３のデータを読み出し、ステップ１１０２で領域Ｚ
１，Ｚ２，Ｚ３のデータを比較する。より詳しくは、図
２０のステップ１２０１のように、領域Ｚ１，Ｚ２，Ｚ
３のデータが全て一致するか否か判定し、一致しないと
ステップ１２０２で警報を行うとともに、ステップ１２
０３でデータを全て多数の方に統一する。このように、
ＥＥＰＲＯＭ６０に同一データを複数持つことにより、
１つのデータが異常の場合でも他のデータによりその異
常を検出し、かつ異常データを修復可能とすることがで
きる。その後、ＣＰＵ５１は図１９のステップ１１０３
に移行してデータを使用した処理、即ち、学習値を用い
た燃料噴射量の演算を行う。
【０００５】
【発明が解決しようとする課題】しかし、シリアル通信
線Ｌ１０〜Ｌ１２がグランドショートまたは電源ショー
ト（５ボルトショート）となった時の異常を検出するこ
とができない。
線Ｌ１０〜Ｌ１２がグランドショートまたは電源ショー
ト（５ボルトショート）となった時の異常を検出するこ
とができない。
【０００６】このようにシリアル通信線Ｌ１０〜Ｌ１２
のグランドショートまたは電源ショートを検出できない
と、データを読み出した際、複数個のデータを持ってい
たとしても、全てデータが００００(16)またはＦＦＦＦ
(16)となり、正常データとして、そのデータを誤って使
用することとなる。
のグランドショートまたは電源ショートを検出できない
と、データを読み出した際、複数個のデータを持ってい
たとしても、全てデータが００００(16)またはＦＦＦＦ
(16)となり、正常データとして、そのデータを誤って使
用することとなる。
【０００７】そこで、この発明の目的は、確実にシリア
ル通信線のショートを検出することができるシリアル通
信線のショート検出方法を提供することにある。
ル通信線のショートを検出することができるシリアル通
信線のショート検出方法を提供することにある。
【０００８】
【課題を解決するための手段】請求項１に記載のシリア
ル通信線のショート検出方法は、転送されるデータとし
て、全て０(2) または全て１(2) とならないデータ構成
とし、当該データによりシリアル通信線でのショートの
有無を判定するようにしたことを特徴としている。
ル通信線のショート検出方法は、転送されるデータとし
て、全て０(2) または全て１(2) とならないデータ構成
とし、当該データによりシリアル通信線でのショートの
有無を判定するようにしたことを特徴としている。
【０００９】このように、転送されるデータが全て０
(2) または全て１(2) とならないデータ構成とすること
により、このデータによりシリアル通信線でのショート
の有無が判定される。つまり、転送されたデータが全て
０(2) または全て１(2) とならなければシリアル通信線
でのショートは発生しておらず、転送されたデータが全
て０(2) または全て１(2) となるとシリアル通信線での
ショートが発生したと判断できる。
(2) または全て１(2) とならないデータ構成とすること
により、このデータによりシリアル通信線でのショート
の有無が判定される。つまり、転送されたデータが全て
０(2) または全て１(2) とならなければシリアル通信線
でのショートは発生しておらず、転送されたデータが全
て０(2) または全て１(2) となるとシリアル通信線での
ショートが発生したと判断できる。
【００１０】
【発明の実施の形態】（第１の実施の形態）以下、この
発明を具体化した実施の形態を図面に従って説明する。
発明を具体化した実施の形態を図面に従って説明する。
【００１１】本実施形態においては、エンジン制御装置
（ＥＣＵ；エンジンコントロールユニット）を想定して
おり、より詳しくは、車載ガソリンエンジンの燃料噴射
量を制御するエンジン制御装置である。図１には、エン
ジン制御装置の回路構成を示す。
（ＥＣＵ；エンジンコントロールユニット）を想定して
おり、より詳しくは、車載ガソリンエンジンの燃料噴射
量を制御するエンジン制御装置である。図１には、エン
ジン制御装置の回路構成を示す。
【００１２】図１に示すように、演算処理装置としての
マイクロコンピュータ１はＣＰＵ２、ＲＯＭ３、ＲＡＭ
４、汎用ポート５、シリアルポート６を具備している。
ＣＰＵ２とＲＯＭ３とＲＡＭ４と汎用ポート５とシリア
ルポート６とはバスライン７にて相互に接続され、バス
ライン７を通してデータのやり取りを行うことができる
ようになっている。
マイクロコンピュータ１はＣＰＵ２、ＲＯＭ３、ＲＡＭ
４、汎用ポート５、シリアルポート６を具備している。
ＣＰＵ２とＲＯＭ３とＲＡＭ４と汎用ポート５とシリア
ルポート６とはバスライン７にて相互に接続され、バス
ライン７を通してデータのやり取りを行うことができる
ようになっている。
【００１３】このマイクロコンピュータ１に外付けされ
る外部記憶装置としてのＥＥＰＲＯＭ１０は、制御装置
１１、メモリアレー１２、書き込み装置１３、読み込み
装置１４を備えている。メモリアレー１２においては、
ｎ個の記憶領域Ｚ１〜Ｚｎを有する。つまり、第１記憶
領域Ｚ１、第２記憶領域Ｚ２、第３記憶領域Ｚ３，・・
・，第ｎ記憶領域Ｚｎを有する。書き込み装置１３とメ
モリアレー１２はバスライン１５にて接続され、メモリ
アレー１２と読み込み装置１４はバスライン１６にて接
続されている。
る外部記憶装置としてのＥＥＰＲＯＭ１０は、制御装置
１１、メモリアレー１２、書き込み装置１３、読み込み
装置１４を備えている。メモリアレー１２においては、
ｎ個の記憶領域Ｚ１〜Ｚｎを有する。つまり、第１記憶
領域Ｚ１、第２記憶領域Ｚ２、第３記憶領域Ｚ３，・・
・，第ｎ記憶領域Ｚｎを有する。書き込み装置１３とメ
モリアレー１２はバスライン１５にて接続され、メモリ
アレー１２と読み込み装置１４はバスライン１６にて接
続されている。
【００１４】マイクロコンピュータ１の汎用ポート５と
ＥＥＰＲＯＭ１０の制御装置１１とはチップセレクト信
号線Ｌ１にて接続されている。また、マイクロコンピュ
ータ１とＥＥＰＲＯＭ１０とはシリアル通信線（Ｌ２〜
Ｌ４）にて接続されている。このシリアル通信線（Ｌ２
〜Ｌ４）による通信機器として、本例では、０１付与回
路８、０１削除回路１７、０１付与回路１８、０１削除
回路９を具備している。つまり、マイクロコンピュータ
１に０１付与回路８が、ＥＥＰＲＯＭ１０に０１削除回
路１７が設けられ、マイクロコンピュータ１のシリアル
ポート６は０１付与回路８を介してデータ書き込み信号
線Ｌ３と接続されるとともに、ＥＥＰＲＯＭ１０におい
て０１削除回路１７を介して書き込み装置１３及び制御
装置１１に接続されている。同様に、ＥＥＰＲＯＭ１０
に０１付与回路１８が、マイクロコンピュータ１に０１
削除回路９が設けられ、ＥＥＰＲＯＭ１０の読み込み装
置１４は０１付与回路１８を介してデータ読み込み信号
線Ｌ４と接続されるとともに、マイクロコンピュータ１
において０１削除回路９を介してシリアルポート６に接
続されている。さらに、マイクロコンピュータ１のシリ
アルポート６とＥＥＰＲＯＭ１０の制御装置１１とはク
ロック信号線Ｌ２にて接続されている。
ＥＥＰＲＯＭ１０の制御装置１１とはチップセレクト信
号線Ｌ１にて接続されている。また、マイクロコンピュ
ータ１とＥＥＰＲＯＭ１０とはシリアル通信線（Ｌ２〜
Ｌ４）にて接続されている。このシリアル通信線（Ｌ２
〜Ｌ４）による通信機器として、本例では、０１付与回
路８、０１削除回路１７、０１付与回路１８、０１削除
回路９を具備している。つまり、マイクロコンピュータ
１に０１付与回路８が、ＥＥＰＲＯＭ１０に０１削除回
路１７が設けられ、マイクロコンピュータ１のシリアル
ポート６は０１付与回路８を介してデータ書き込み信号
線Ｌ３と接続されるとともに、ＥＥＰＲＯＭ１０におい
て０１削除回路１７を介して書き込み装置１３及び制御
装置１１に接続されている。同様に、ＥＥＰＲＯＭ１０
に０１付与回路１８が、マイクロコンピュータ１に０１
削除回路９が設けられ、ＥＥＰＲＯＭ１０の読み込み装
置１４は０１付与回路１８を介してデータ読み込み信号
線Ｌ４と接続されるとともに、マイクロコンピュータ１
において０１削除回路９を介してシリアルポート６に接
続されている。さらに、マイクロコンピュータ１のシリ
アルポート６とＥＥＰＲＯＭ１０の制御装置１１とはク
ロック信号線Ｌ２にて接続されている。
【００１５】ここで、０１付与回路８、０１削除回路１
７、０１付与回路１８、０１削除回路９について言及す
ると、０１付与回路８，１８は図４（ａ）に示す単位デ
ータ（１６ビットデータ）に対し図４（ｂ）に示すよう
に上位ビットおよび下位ビットに１(2) と０(2) を付与
する機能を有する。また、０１削除回路１７，９は、図
４（ｂ）のように１(2) と０(2) が付与された単位デー
タに対し図４（ｃ）に示すように１(2) と０(2) を削除
する機能を有する。さらに、図１のＥＥＰＲＯＭ１０の
０１削除回路１７は、信号線Ｌ３から送られてきた１８
ビットデータが全て０(2) または全て１(2) であるかを
判定し、全て０(2) または全て１(2) であると０１付与
回路１８に非動作指令信号を送出する機能を有する。マ
イクロコンピュータ１の０１削除回路９は、信号線Ｌ４
から送られてきた１８ビットデータが全て０(2) または
全て１(2) であるかを判定し、全て０(2) または全て１
(2 ) であると異常検出信号をＣＰＵ２に送出する機能を
有する。
７、０１付与回路１８、０１削除回路９について言及す
ると、０１付与回路８，１８は図４（ａ）に示す単位デ
ータ（１６ビットデータ）に対し図４（ｂ）に示すよう
に上位ビットおよび下位ビットに１(2) と０(2) を付与
する機能を有する。また、０１削除回路１７，９は、図
４（ｂ）のように１(2) と０(2) が付与された単位デー
タに対し図４（ｃ）に示すように１(2) と０(2) を削除
する機能を有する。さらに、図１のＥＥＰＲＯＭ１０の
０１削除回路１７は、信号線Ｌ３から送られてきた１８
ビットデータが全て０(2) または全て１(2) であるかを
判定し、全て０(2) または全て１(2) であると０１付与
回路１８に非動作指令信号を送出する機能を有する。マ
イクロコンピュータ１の０１削除回路９は、信号線Ｌ４
から送られてきた１８ビットデータが全て０(2) または
全て１(2) であるかを判定し、全て０(2) または全て１
(2 ) であると異常検出信号をＣＰＵ２に送出する機能を
有する。
【００１６】一方、図１において、マイクロコンピュー
タ１には警報器２０が接続されている。警報器２０は警
報ランプあるいは警報ブザーよりなる。次に、このよう
に構成したエンジン制御装置の作用を説明する。
タ１には警報器２０が接続されている。警報器２０は警
報ランプあるいは警報ブザーよりなる。次に、このよう
に構成したエンジン制御装置の作用を説明する。
【００１７】まず、エンジン制御装置の基本動作を説明
する。マイクロコンピュータ１のＣＰＵ２は図示しない
多数のセンサからエンジン運転に関するデータ（アクセ
ル開度、エンジン回転数、エンジン冷却水温、吸入空気
量、吸入空気温度、空燃比など）を取り込むとともに、
これらのデータに基づきエンジン運転に応じた燃料噴射
量（噴射時間）を算出する。このとき、ＣＰＵ２は理論
空燃比からの空燃比ズレ量を求めるとともに空燃比ズレ
量を修正する学習補正量を求め、現在の運転状態に該当
する学習補正量を燃料噴射量に反映させる。ＣＰＵ２は
この学習補正量を外付けＥＥＰＲＯＭ１０に記憶させ
る。そして、ＣＰＵ２は算出した燃料噴射量となるよう
に図示しないインジェクタ（燃料噴射弁）を制御する。
する。マイクロコンピュータ１のＣＰＵ２は図示しない
多数のセンサからエンジン運転に関するデータ（アクセ
ル開度、エンジン回転数、エンジン冷却水温、吸入空気
量、吸入空気温度、空燃比など）を取り込むとともに、
これらのデータに基づきエンジン運転に応じた燃料噴射
量（噴射時間）を算出する。このとき、ＣＰＵ２は理論
空燃比からの空燃比ズレ量を求めるとともに空燃比ズレ
量を修正する学習補正量を求め、現在の運転状態に該当
する学習補正量を燃料噴射量に反映させる。ＣＰＵ２は
この学習補正量を外付けＥＥＰＲＯＭ１０に記憶させ
る。そして、ＣＰＵ２は算出した燃料噴射量となるよう
に図示しないインジェクタ（燃料噴射弁）を制御する。
【００１８】以下、マイクロコンピュータ１とＥＥＰＲ
ＯＭ１０との間で行われるデータ（学習補正量）の通信
について説明する。本例におけるシリアル通信方式は、
図３に示すように、クロック信号の送出開始タイミング
ｔ１にてデータの送信が開始され、データの送信の終了
タイミングｔ２にてクロック信号の送出が終了するよう
になっている。
ＯＭ１０との間で行われるデータ（学習補正量）の通信
について説明する。本例におけるシリアル通信方式は、
図３に示すように、クロック信号の送出開始タイミング
ｔ１にてデータの送信が開始され、データの送信の終了
タイミングｔ２にてクロック信号の送出が終了するよう
になっている。
【００１９】データの書き込みの際には、マイクロコン
ピュータ１のＣＰＵ２は学習補正量を図４（ａ）に示す
ように１６ビットのデータとして生成し、図１のシリア
ルポート６から信号線Ｌ３に送出させる。この際、０１
付与回路８において、図４（ａ）に示すデータに対し図
４（ｂ）に示すように上位ビットおよび下位ビットに１
(2) と０(2) が付与され、１８ビットデータとなって信
号線Ｌ３に送出される。そして、ＥＥＰＲＯＭ１０の０
１削除回路１７において図４（ｂ）のように１ (2) と０
(2) が付与されたデータに対し図４（ｃ）に示すように
１(2) と０(2)が削除され１６ビットデータとなって書
き込み装置１３に送られる。書き込み装置１３はその１
６ビットデータをメモリアレー１２の所定の記憶領域Ｚ
１〜Ｚｎに格納する。また、０１削除回路１７におい
て、マイクロコンピュータ１から送られてきた１８ビッ
トデータが全て０(2) または全て１(2) であるか判定さ
れ、全て０(2) または全て１(2) であると０１付与回路
１８に非動作指令信号が送られる。この非動作指令信号
により０１付与回路１８は、”Ｈ固定出力”又は”Ｌ固
定出力”を行う。このように、マイクロコンピュータ１
から送られてきた１８ビットデータが全て０(2) または
全て１(2) であると、シリアル通信線Ｌ３のグランドシ
ョートまたは電源ショートが発生したとして、０１付与
回路１８が固定出力状態にされる。
ピュータ１のＣＰＵ２は学習補正量を図４（ａ）に示す
ように１６ビットのデータとして生成し、図１のシリア
ルポート６から信号線Ｌ３に送出させる。この際、０１
付与回路８において、図４（ａ）に示すデータに対し図
４（ｂ）に示すように上位ビットおよび下位ビットに１
(2) と０(2) が付与され、１８ビットデータとなって信
号線Ｌ３に送出される。そして、ＥＥＰＲＯＭ１０の０
１削除回路１７において図４（ｂ）のように１ (2) と０
(2) が付与されたデータに対し図４（ｃ）に示すように
１(2) と０(2)が削除され１６ビットデータとなって書
き込み装置１３に送られる。書き込み装置１３はその１
６ビットデータをメモリアレー１２の所定の記憶領域Ｚ
１〜Ｚｎに格納する。また、０１削除回路１７におい
て、マイクロコンピュータ１から送られてきた１８ビッ
トデータが全て０(2) または全て１(2) であるか判定さ
れ、全て０(2) または全て１(2) であると０１付与回路
１８に非動作指令信号が送られる。この非動作指令信号
により０１付与回路１８は、”Ｈ固定出力”又は”Ｌ固
定出力”を行う。このように、マイクロコンピュータ１
から送られてきた１８ビットデータが全て０(2) または
全て１(2) であると、シリアル通信線Ｌ３のグランドシ
ョートまたは電源ショートが発生したとして、０１付与
回路１８が固定出力状態にされる。
【００２０】データの読み出しの際には、マイクロコン
ピュータ１のＣＰＵ２はＥＥＰＲＯＭ１０の制御装置１
１に対し読み出し指令を出す。ＥＥＰＲＯＭ１０の制御
装置１１は読み込み装置１４を制御して所定の記憶領域
Ｚ１〜Ｚｎに格納された１６ビットデータを読み出す。
このデータは０１付与回路１８に送られ、図４（ｃ）に
示すデータに対し図４（ｄ）に示すように上位ビットお
よび下位ビットに１(2 ) と０(2) が付与され、１８ビッ
トデータとなる。
ピュータ１のＣＰＵ２はＥＥＰＲＯＭ１０の制御装置１
１に対し読み出し指令を出す。ＥＥＰＲＯＭ１０の制御
装置１１は読み込み装置１４を制御して所定の記憶領域
Ｚ１〜Ｚｎに格納された１６ビットデータを読み出す。
このデータは０１付与回路１８に送られ、図４（ｃ）に
示すデータに対し図４（ｄ）に示すように上位ビットお
よび下位ビットに１(2 ) と０(2) が付与され、１８ビッ
トデータとなる。
【００２１】そして、この１８ビットデータは信号線Ｌ
４を通してマイクロコンピュータ１に送られる。マイク
ロコンピュータ１の０１削除回路９において、図４
（ｄ）のように１(2) と０(2) が付与されたデータに対
し図４（ｅ）に示すように１(2)と０(2) が削除され１
６ビットデータとなり、シリアルポート６からＣＰＵ２
に取り込まれる。また、０１削除回路９において、ＥＥ
ＰＲＯＭ１０から送られてきた１８ビットデータが全て
０(2) または全て１(2) であるか判定され、全て０ (2)
または全て１(2) であるとシリアル通信線Ｌ４のグラン
ドショートまたは電源ショートが発生したとして異常検
出信号がＣＰＵ２に送られる。
４を通してマイクロコンピュータ１に送られる。マイク
ロコンピュータ１の０１削除回路９において、図４
（ｄ）のように１(2) と０(2) が付与されたデータに対
し図４（ｅ）に示すように１(2)と０(2) が削除され１
６ビットデータとなり、シリアルポート６からＣＰＵ２
に取り込まれる。また、０１削除回路９において、ＥＥ
ＰＲＯＭ１０から送られてきた１８ビットデータが全て
０(2) または全て１(2) であるか判定され、全て０ (2)
または全て１(2) であるとシリアル通信線Ｌ４のグラン
ドショートまたは電源ショートが発生したとして異常検
出信号がＣＰＵ２に送られる。
【００２２】図２には、マイクロコンピュータ１のＣＰ
Ｕ２が実行するデータ受信処理のフローチャートを示
す。図２において、ＣＰＵ２はステップ１０１で０１削
除回路９から異常検出信号から送出されたか否か判定す
る。そして、異常検出信号が送出されていなければ、Ｃ
ＰＵ２はステップ１０２においてシリアル通信線Ｌ４の
ショートは発生していないものとして、図４（ｅ）に示
すように１(2) と０(2) が削除された１６ビットデータ
による学習値を有効化し、燃料噴射量の算出処理を行
う。
Ｕ２が実行するデータ受信処理のフローチャートを示
す。図２において、ＣＰＵ２はステップ１０１で０１削
除回路９から異常検出信号から送出されたか否か判定す
る。そして、異常検出信号が送出されていなければ、Ｃ
ＰＵ２はステップ１０２においてシリアル通信線Ｌ４の
ショートは発生していないものとして、図４（ｅ）に示
すように１(2) と０(2) が削除された１６ビットデータ
による学習値を有効化し、燃料噴射量の算出処理を行
う。
【００２３】一方、ＣＰＵ２はステップ１０１において
異常検出信号が送出されていると（シリアル通信線Ｌ４
による１８ビットデータが全て０(2) または全て１(2)
であると）、シリアル通信線Ｌ４のグランドショートま
たは電源ショートが発生したとして、ステップ１０３に
移行して読み出したデータを使用せずＲＯＭ３に記憶し
たデフォルト値（標準値）を有効化し、燃料噴射量の算
出処理を行う。このように異常と判断したときは予めＲ
ＯＭ３に記憶された値を使用することで誤動作を防止す
ることができる。
異常検出信号が送出されていると（シリアル通信線Ｌ４
による１８ビットデータが全て０(2) または全て１(2)
であると）、シリアル通信線Ｌ４のグランドショートま
たは電源ショートが発生したとして、ステップ１０３に
移行して読み出したデータを使用せずＲＯＭ３に記憶し
たデフォルト値（標準値）を有効化し、燃料噴射量の算
出処理を行う。このように異常と判断したときは予めＲ
ＯＭ３に記憶された値を使用することで誤動作を防止す
ることができる。
【００２４】さらに、ＣＰＵ２はステップ１０４に移行
して警報器２０を駆動してシリアル通信線Ｌ４のショー
トを運転者に知らせる。また、前述したようにシリアル
通信線Ｌ３のショートが発生した場合には０１付与回路
１８が固定出力状態となっているので、０１削除回路９
において、読み出したデータが全て０(2) または全て１
(2) になるので、やはり、異常検出信号をＣＰＵ２に送
出する。これによって、ＣＰＵ２はステップ１０３のデ
フォルト値を用いた制御を行うとともにステップ１０４
の警報を行う。
して警報器２０を駆動してシリアル通信線Ｌ４のショー
トを運転者に知らせる。また、前述したようにシリアル
通信線Ｌ３のショートが発生した場合には０１付与回路
１８が固定出力状態となっているので、０１削除回路９
において、読み出したデータが全て０(2) または全て１
(2) になるので、やはり、異常検出信号をＣＰＵ２に送
出する。これによって、ＣＰＵ２はステップ１０３のデ
フォルト値を用いた制御を行うとともにステップ１０４
の警報を行う。
【００２５】このように本実施形態は、下記の特徴を有
する。 （イ）図１のマイクロコンピュータ１の０１付与回路８
において、転送される単位データ（書き込みデータ）の
上位および下位ビットに０(2) と１(2) を付加するとと
もに、ＥＥＰＲＯＭ１０の０１削除回路１７において、
付加した０(2) と１(2) を取り除くようにして、転送さ
れるデータとして、全て０(2) または全て１(2) となら
ないデータ構成とし、０１削除回路１７において当該デ
ータによりシリアル通信線Ｌ３でのショートの有無を判
定するようした。つまり、転送されたデータが全て０
(2) または全て１(2) とならなければシリアル通信線Ｌ
３でのショートは発生しておらず、転送されたデータが
全て０(2) または全て１(2) となるとシリアル通信線Ｌ
３でのショートが発生したと判断できる。同様に、ＥＥ
ＰＲＯＭ１０の０１付与回路１８において、転送される
単位データ（読み出しデータ）の上位および下位ビット
に０(2) と１(2) を付加するとともに、マイクロコンピ
ュータ１の０１削除回路９において、付加した０(2) と
１(2) を取り除くようにして、転送されるデータとし
て、全て０(2) または全て１(2) とならないデータ構成
とし、０１削除回路９において当該データによりシリア
ル通信線Ｌ４でのショートの有無を判定するようした。
つまり、転送されたデータが全て０(2 ) または全て１
(2) とならなければシリアル通信線Ｌ４でのショートは
発生しておらず、転送されたデータが全て０(2) または
全て１(2) となるとシリアル通信線Ｌ４でのショートが
発生したと判断できる。
する。 （イ）図１のマイクロコンピュータ１の０１付与回路８
において、転送される単位データ（書き込みデータ）の
上位および下位ビットに０(2) と１(2) を付加するとと
もに、ＥＥＰＲＯＭ１０の０１削除回路１７において、
付加した０(2) と１(2) を取り除くようにして、転送さ
れるデータとして、全て０(2) または全て１(2) となら
ないデータ構成とし、０１削除回路１７において当該デ
ータによりシリアル通信線Ｌ３でのショートの有無を判
定するようした。つまり、転送されたデータが全て０
(2) または全て１(2) とならなければシリアル通信線Ｌ
３でのショートは発生しておらず、転送されたデータが
全て０(2) または全て１(2) となるとシリアル通信線Ｌ
３でのショートが発生したと判断できる。同様に、ＥＥ
ＰＲＯＭ１０の０１付与回路１８において、転送される
単位データ（読み出しデータ）の上位および下位ビット
に０(2) と１(2) を付加するとともに、マイクロコンピ
ュータ１の０１削除回路９において、付加した０(2) と
１(2) を取り除くようにして、転送されるデータとし
て、全て０(2) または全て１(2) とならないデータ構成
とし、０１削除回路９において当該データによりシリア
ル通信線Ｌ４でのショートの有無を判定するようした。
つまり、転送されたデータが全て０(2 ) または全て１
(2) とならなければシリアル通信線Ｌ４でのショートは
発生しておらず、転送されたデータが全て０(2) または
全て１(2) となるとシリアル通信線Ｌ４でのショートが
発生したと判断できる。
【００２６】このようにして、ハード構成にて確実にシ
リアル通信線のショートを検出することができる。な
お、上述した例では、０１付与回路８と０１削除回路１
７とを対として設けるとともに０１付与回路１８と０１
削除回路９とを対として設けたが、０１付与回路８と０
１削除回路１７のみを設けたり、０１付与回路１８と０
１削除回路９のみを設けてもよい。 （第２の実施の形態）次に、第２の実施の形態を、第１
の実施の形態との相違点を中心に説明する。
リアル通信線のショートを検出することができる。な
お、上述した例では、０１付与回路８と０１削除回路１
７とを対として設けるとともに０１付与回路１８と０１
削除回路９とを対として設けたが、０１付与回路８と０
１削除回路１７のみを設けたり、０１付与回路１８と０
１削除回路９のみを設けてもよい。 （第２の実施の形態）次に、第２の実施の形態を、第１
の実施の形態との相違点を中心に説明する。
【００２７】図５には、本実施の形態におけるエンジン
制御装置の回路構成を示す。本装置においては図１の０
１付与回路８，１８と０１削除回路１７，９は設けられ
ておらず、ＥＥＰＲＯＭ１０のメモリアレー１２から読
み出したデータは読み込み装置１４を介してマイクロコ
ンピュータ１のシリアルポート６に直接送られるように
なっている。
制御装置の回路構成を示す。本装置においては図１の０
１付与回路８，１８と０１削除回路１７，９は設けられ
ておらず、ＥＥＰＲＯＭ１０のメモリアレー１２から読
み出したデータは読み込み装置１４を介してマイクロコ
ンピュータ１のシリアルポート６に直接送られるように
なっている。
【００２８】図６，７には、マイクロコンピュータ１の
ＣＰＵ２が実行するシリアル通信線のショート検出処理
のフローチャートを示す。図６において、ＣＰＵ２はス
テップ２０１で学習補正量を図８（ａ）に示すように１
４ビットのデータとして生成し、ステップ２０２で図８
（ｂ）に示すように最下位ビットに１(2) を、最下位ビ
ットより１つ上位ビットに０(2) を付加して１６ビット
データとする。そして、ＣＰＵ２はステップ２０３でこ
の１６ビットデータを図５のシリアルポート６から信号
線Ｌ３に送出させる。ＥＥＰＲＯＭ１０の書き込み装置
１３はその１６ビットデータをメモリアレー１２の所定
の記憶領域Ｚ１〜Ｚｎに格納する。
ＣＰＵ２が実行するシリアル通信線のショート検出処理
のフローチャートを示す。図６において、ＣＰＵ２はス
テップ２０１で学習補正量を図８（ａ）に示すように１
４ビットのデータとして生成し、ステップ２０２で図８
（ｂ）に示すように最下位ビットに１(2) を、最下位ビ
ットより１つ上位ビットに０(2) を付加して１６ビット
データとする。そして、ＣＰＵ２はステップ２０３でこ
の１６ビットデータを図５のシリアルポート６から信号
線Ｌ３に送出させる。ＥＥＰＲＯＭ１０の書き込み装置
１３はその１６ビットデータをメモリアレー１２の所定
の記憶領域Ｚ１〜Ｚｎに格納する。
【００２９】データの読み出しの際には、マイクロコン
ピュータ１のＣＰＵ２はＥＥＰＲＯＭ１０の制御装置１
１に対し読み出し指令を出す。ＥＥＰＲＯＭ１０の制御
装置１１は読み込み装置１４を制御して所定の記憶領域
Ｚ１〜Ｚｎに格納された１６ビットデータを読み出す。
このデータ（１６ビットデータ）は信号線Ｌ４を通して
マイクロコンピュータ１に送られる。マイクロコンピュ
ータ１において、ＣＰＵ２は図７のステップ３０１にお
いて読み出した１６ビットデータが全て０(2)または全
て１(2) か否か判定する。そして、１６ビットデータが
全て０(2) または全て１(2) でなければ、ＣＰＵ２はシ
リアル通信線Ｌ２〜Ｌ４のショートは発生していないも
のとして、ステップ３０２に移行して図８（ｃ）に示す
ように最下位ビットとその１つ上位ビットに付加した１
(2) と０(2) を削除し、図８（ｄ）のように１４ビット
データにする。そして、このデータ（学習値）を用いた
燃料噴射量の算出処理が行われる。
ピュータ１のＣＰＵ２はＥＥＰＲＯＭ１０の制御装置１
１に対し読み出し指令を出す。ＥＥＰＲＯＭ１０の制御
装置１１は読み込み装置１４を制御して所定の記憶領域
Ｚ１〜Ｚｎに格納された１６ビットデータを読み出す。
このデータ（１６ビットデータ）は信号線Ｌ４を通して
マイクロコンピュータ１に送られる。マイクロコンピュ
ータ１において、ＣＰＵ２は図７のステップ３０１にお
いて読み出した１６ビットデータが全て０(2)または全
て１(2) か否か判定する。そして、１６ビットデータが
全て０(2) または全て１(2) でなければ、ＣＰＵ２はシ
リアル通信線Ｌ２〜Ｌ４のショートは発生していないも
のとして、ステップ３０２に移行して図８（ｃ）に示す
ように最下位ビットとその１つ上位ビットに付加した１
(2) と０(2) を削除し、図８（ｄ）のように１４ビット
データにする。そして、このデータ（学習値）を用いた
燃料噴射量の算出処理が行われる。
【００３０】一方、ＣＰＵ２はステップ３０１において
１６ビットデータが全て０(2) または全て１(2) である
と、シリアル通信線Ｌ２〜Ｌ４のグランドショートまた
は電源ショートが発生したとして、ステップ３０３に移
行して読み出したデータを使用せずＲＯＭ３に記憶した
デフォルト値（標準値）を有効化し、燃料噴射量の算出
処理を行う。さらに、ＣＰＵ２はステップ３０４に移行
して警報器２０を駆動してシリアル通信線Ｌ２〜Ｌ４の
ショートを運転者に知らせる。
１６ビットデータが全て０(2) または全て１(2) である
と、シリアル通信線Ｌ２〜Ｌ４のグランドショートまた
は電源ショートが発生したとして、ステップ３０３に移
行して読み出したデータを使用せずＲＯＭ３に記憶した
デフォルト値（標準値）を有効化し、燃料噴射量の算出
処理を行う。さらに、ＣＰＵ２はステップ３０４に移行
して警報器２０を駆動してシリアル通信線Ｌ２〜Ｌ４の
ショートを運転者に知らせる。
【００３１】このように本実施形態は、下記の特徴を有
する。 （イ）ＣＰＵ２は図６のステップ２０２において転送さ
れるデータにおける所定箇所のビットに、０(2) と１
(2) を挿入し、全て０(2) または全て１(2) とならない
データ構成として、図７の処理にて該データによりシリ
アル通信線Ｌ２〜Ｌ４でのショートの有無を判定する。
このようにして、ソフト構成にて確実にシリアル通信線
Ｌ２〜Ｌ４のショートを検出することができる。 （第３の実施の形態）次に、第３の実施の形態を、第２
の実施の形態との相違点を中心に説明する。
する。 （イ）ＣＰＵ２は図６のステップ２０２において転送さ
れるデータにおける所定箇所のビットに、０(2) と１
(2) を挿入し、全て０(2) または全て１(2) とならない
データ構成として、図７の処理にて該データによりシリ
アル通信線Ｌ２〜Ｌ４でのショートの有無を判定する。
このようにして、ソフト構成にて確実にシリアル通信線
Ｌ２〜Ｌ４のショートを検出することができる。 （第３の実施の形態）次に、第３の実施の形態を、第２
の実施の形態との相違点を中心に説明する。
【００３２】全体構成は、図５と同様である。また、図
６のステップ２０２の処理として、本例では以下のよう
にしている。学習補正量を１５ビットのデータとして生
成し、図９（ａ）に示すように当該１５ビットデータが
全て０(2) ならば最下位ビットに１(2) を付加し、図９
（ｂ）に示すように当該１５ビットデータが全て１(2)
ならば最下位ビットに０(2) を付加する。
６のステップ２０２の処理として、本例では以下のよう
にしている。学習補正量を１５ビットのデータとして生
成し、図９（ａ）に示すように当該１５ビットデータが
全て０(2) ならば最下位ビットに１(2) を付加し、図９
（ｂ）に示すように当該１５ビットデータが全て１(2)
ならば最下位ビットに０(2) を付加する。
【００３３】このように、マイクロコンピュータ１によ
り、転送される単位データが全て０ (2) の場合には所定
のビットに１(2) を、全て１(2) の場合には所定のビッ
トに０(2) を挿入しても、全て０(2) または全て１(2)
とならないデータ構成とすることができる。 （第４の実施の形態）次に、第４の実施の形態を、第２
の実施の形態との相違点を中心に説明する。
り、転送される単位データが全て０ (2) の場合には所定
のビットに１(2) を、全て１(2) の場合には所定のビッ
トに０(2) を挿入しても、全て０(2) または全て１(2)
とならないデータ構成とすることができる。 （第４の実施の形態）次に、第４の実施の形態を、第２
の実施の形態との相違点を中心に説明する。
【００３４】全体構成は、図５と同様である。また、図
６のステップ２０２の処理として、本例では以下のよう
にしている。学習補正量を８ビットのデータとして生成
し、図１０に示すように当該８ビットデータの反転デー
タを下位ビット側に付加し、１６ビットの転送データと
する。つまり、書き込みデータを２分割し、片側にデー
タ（非反転データ）を書き込み、残りの片側に反転デー
タを書き込む。
６のステップ２０２の処理として、本例では以下のよう
にしている。学習補正量を８ビットのデータとして生成
し、図１０に示すように当該８ビットデータの反転デー
タを下位ビット側に付加し、１６ビットの転送データと
する。つまり、書き込みデータを２分割し、片側にデー
タ（非反転データ）を書き込み、残りの片側に反転デー
タを書き込む。
【００３５】このように、マイクロコンピュータ１によ
り、転送される単位データにおける反転データと非反転
データを書き込むことにより、全て０(2) または全て１
(2)とならないデータ構成とすることができる。 （第５の実施の形態）次に、第５の実施の形態を、第４
の実施の形態との相違点を中心に説明する。
り、転送される単位データにおける反転データと非反転
データを書き込むことにより、全て０(2) または全て１
(2)とならないデータ構成とすることができる。 （第５の実施の形態）次に、第５の実施の形態を、第４
の実施の形態との相違点を中心に説明する。
【００３６】全体構成は、図５と同様である。また、図
６のステップ２０２の処理として、本例では以下のよう
にしている。学習補正量を１６ビットのデータとして生
成し、図１１に示すように書き込みデータを複数個持た
せ、その内の１つを反転データにする。そして、ＣＰＵ
２はＥＥＰＲＯＭ１０のメモリアレー１２における第１
および第２記憶領域Ｚ１，Ｚ２には反転しないデータを
書き込むとともに、第３記憶領域Ｚ３には反転させたデ
ータを書き込む。
６のステップ２０２の処理として、本例では以下のよう
にしている。学習補正量を１６ビットのデータとして生
成し、図１１に示すように書き込みデータを複数個持た
せ、その内の１つを反転データにする。そして、ＣＰＵ
２はＥＥＰＲＯＭ１０のメモリアレー１２における第１
および第２記憶領域Ｚ１，Ｚ２には反転しないデータを
書き込むとともに、第３記憶領域Ｚ３には反転させたデ
ータを書き込む。
【００３７】そして、ＣＰＵ２は図１２のステップ４０
１において第１〜第３記憶領域Ｚ１〜Ｚ３のデータを読
み出し、ステップ４０２において第１〜第３記憶領域Ｚ
１〜Ｚ３のデータが全て１(2) または０(2) でないか否
か判定し、全て１(2) または０(2) でないとステップ４
０３で第３記憶領域Ｚ３のデータを反転し、第１〜第３
記憶領域Ｚ１〜Ｚ３のデータが一致するか否か判定し、
ステップ４０４で第１〜第３記憶領域Ｚ１〜Ｚ３のデー
タのうちの多数を占めるデータを用いた処理を実行す
る。一方、ＣＰＵ２はステップ４０２において第１〜第
３記憶領域Ｚ１〜Ｚ３のデータが全て１(2) または０
(2) であると、シリアル通信線Ｌ２〜Ｌ４のグランドシ
ョートまたは電源ショートが発生したとして、ステップ
４０５に移行して読み出したデータを使用せずＲＯＭ３
に記憶したデフォルト値（標準値）を有効化し、燃料噴
射量の算出処理を行う。さらに、ＣＰＵ２はステップ４
０６に移行して警報器２０を駆動してシリアル通信線Ｌ
２〜Ｌ４のショートを運転者に知らせる。
１において第１〜第３記憶領域Ｚ１〜Ｚ３のデータを読
み出し、ステップ４０２において第１〜第３記憶領域Ｚ
１〜Ｚ３のデータが全て１(2) または０(2) でないか否
か判定し、全て１(2) または０(2) でないとステップ４
０３で第３記憶領域Ｚ３のデータを反転し、第１〜第３
記憶領域Ｚ１〜Ｚ３のデータが一致するか否か判定し、
ステップ４０４で第１〜第３記憶領域Ｚ１〜Ｚ３のデー
タのうちの多数を占めるデータを用いた処理を実行す
る。一方、ＣＰＵ２はステップ４０２において第１〜第
３記憶領域Ｚ１〜Ｚ３のデータが全て１(2) または０
(2) であると、シリアル通信線Ｌ２〜Ｌ４のグランドシ
ョートまたは電源ショートが発生したとして、ステップ
４０５に移行して読み出したデータを使用せずＲＯＭ３
に記憶したデフォルト値（標準値）を有効化し、燃料噴
射量の算出処理を行う。さらに、ＣＰＵ２はステップ４
０６に移行して警報器２０を駆動してシリアル通信線Ｌ
２〜Ｌ４のショートを運転者に知らせる。
【００３８】このように、マイクロコンピュータ１によ
り、転送される単位データにおける反転データと非反転
データをＥＥＰＲＯＭ１０のメモリアレー１２の第１〜
第３記憶領域Ｚ１〜Ｚ３に書き込むことによって、全て
０(2) または全て１(2) とならないデータ構成とするこ
とができる。 （第６の実施の形態）次に、第６の実施の形態を、第２
の実施の形態との相違点を中心に説明する。
り、転送される単位データにおける反転データと非反転
データをＥＥＰＲＯＭ１０のメモリアレー１２の第１〜
第３記憶領域Ｚ１〜Ｚ３に書き込むことによって、全て
０(2) または全て１(2) とならないデータ構成とするこ
とができる。 （第６の実施の形態）次に、第６の実施の形態を、第２
の実施の形態との相違点を中心に説明する。
【００３９】全体構成は、図５と同様である。また、図
６のステップ２０２の処理として、本例では以下のよう
にしている。学習補正量を８ビットのデータとして生成
し、図１３に示すように８ビットのキーワードを下位ビ
ットに付加し、１６ビットデータにする。このキーワー
ドは０ (2) と１(2) を含むデータである。図１３ではキ
ーワードとして５Ａ(16)を使用した場合を示す。このよ
うに、上位８ビットを学習補正量データとし、下位８ビ
ットにキーワード５Ａ(16)を書き込む。
６のステップ２０２の処理として、本例では以下のよう
にしている。学習補正量を８ビットのデータとして生成
し、図１３に示すように８ビットのキーワードを下位ビ
ットに付加し、１６ビットデータにする。このキーワー
ドは０ (2) と１(2) を含むデータである。図１３ではキ
ーワードとして５Ａ(16)を使用した場合を示す。このよ
うに、上位８ビットを学習補正量データとし、下位８ビ
ットにキーワード５Ａ(16)を書き込む。
【００４０】このようにしても、全て０(2) または全て
１(2) とならないデータ構成とすることができる。つま
り、第２の実施形態で説明したように、マイクロコンピ
ュータ１により、転送されるデータにおける所定箇所の
ビットに、０(2) と１(2) を挿入して全て０(2) または
全て１(2) とならないデータ構成とするときに、キーワ
ードとしての５Ａ(16)を、転送されるデータに挿入して
もよい。 （第７の実施の形態）次に、第７の実施の形態を、第２
の実施の形態との相違点を中心に説明する。
１(2) とならないデータ構成とすることができる。つま
り、第２の実施形態で説明したように、マイクロコンピ
ュータ１により、転送されるデータにおける所定箇所の
ビットに、０(2) と１(2) を挿入して全て０(2) または
全て１(2) とならないデータ構成とするときに、キーワ
ードとしての５Ａ(16)を、転送されるデータに挿入して
もよい。 （第７の実施の形態）次に、第７の実施の形態を、第２
の実施の形態との相違点を中心に説明する。
【００４１】書き込みデータとして００００(16)とＦＦ
ＦＦ(16)以外のデータ構成とする。つまり、００００
(16)とＦＦＦＦ(16)は書き込みデータとして使用しない
データ構成にする。
ＦＦ(16)以外のデータ構成とする。つまり、００００
(16)とＦＦＦＦ(16)は書き込みデータとして使用しない
データ構成にする。
【００４２】そして、異常判定は、図７に示すように、
読み出しデータが全て１(2) または０(2) の時に異常と
判断する。このように、マイクロコンピュータ１によ
り、書き込みデータとして全て０(2 ) または全て１(2)
とならないデータを用いることにより、全て０(2) また
は全て１(2) とならないデータ構成としてもよい。 （第８の実施の形態）次に、第８の実施の形態を、第２
の実施の形態との相違点を中心に説明する。
読み出しデータが全て１(2) または０(2) の時に異常と
判断する。このように、マイクロコンピュータ１によ
り、書き込みデータとして全て０(2 ) または全て１(2)
とならないデータを用いることにより、全て０(2) また
は全て１(2) とならないデータ構成としてもよい。 （第８の実施の形態）次に、第８の実施の形態を、第２
の実施の形態との相違点を中心に説明する。
【００４３】定められた時期にシリアル通信線Ｌ２〜Ｌ
４のチェックとして、図１４に示すように、定められた
コードの書き込み処理と読み出し処理を実行する。当該
コードは０(2) と１(2) を含むデータである。例えば、
イニシャルルーチンにて図１５に示すように、ＣＰＵ２
はステップ５０１において５ＡＡ５(16)の書き込み処理
を実施する。そして、シリアル通信線Ｌ２〜Ｌ４のチェ
ック時にＣＰＵ２は図１６のステップ６０１において該
データを読み出し、ステップ６０２において、全て０
(2) または全て１(2) でないか判定し、全て０(2) また
は全て１(2) であると、シリアル通信線Ｌ２〜Ｌ４のグ
ランドショートまたは電源ショートが発生したとして、
ステップ６０３に移行してＲＯＭ３によるデフォルト値
の有効化および警報器２０によるシリアル通信線Ｌ２〜
Ｌ４のショートを運転者に知らせる。
４のチェックとして、図１４に示すように、定められた
コードの書き込み処理と読み出し処理を実行する。当該
コードは０(2) と１(2) を含むデータである。例えば、
イニシャルルーチンにて図１５に示すように、ＣＰＵ２
はステップ５０１において５ＡＡ５(16)の書き込み処理
を実施する。そして、シリアル通信線Ｌ２〜Ｌ４のチェ
ック時にＣＰＵ２は図１６のステップ６０１において該
データを読み出し、ステップ６０２において、全て０
(2) または全て１(2) でないか判定し、全て０(2) また
は全て１(2) であると、シリアル通信線Ｌ２〜Ｌ４のグ
ランドショートまたは電源ショートが発生したとして、
ステップ６０３に移行してＲＯＭ３によるデフォルト値
の有効化および警報器２０によるシリアル通信線Ｌ２〜
Ｌ４のショートを運転者に知らせる。
【００４４】このようにしても第７の実施の形態と同様
に、マイクロコンピュータ１により、書き込みデータと
して全て０(2) または全て１(2) とならないデータを用
いることにより、全て０(2) または全て１(2) とならな
いデータ構成とすることができる。
に、マイクロコンピュータ１により、書き込みデータと
して全て０(2) または全て１(2) とならないデータを用
いることにより、全て０(2) または全て１(2) とならな
いデータ構成とすることができる。
【００４５】これまでの説明においては、外部記憶装置
としてＥＥＰＲＯＭを用いたが、それ以外の記憶装置を
用いてもよく、要は不揮発性メモリであればよい。
としてＥＥＰＲＯＭを用いたが、それ以外の記憶装置を
用いてもよく、要は不揮発性メモリであればよい。
【図１】 第１の実施の形態におけるエンジン制御装置
の回路構成を示す図。
の回路構成を示す図。
【図２】 同じく作用を説明するためのフローチャー
ト。
ト。
【図３】 シリアル通信を説明するためのタイミングチ
ャート。
ャート。
【図４】 データを説明するための図。
【図５】 第２の実施の形態におけるエンジン制御装置
の回路構成を示す図。
の回路構成を示す図。
【図６】 同じく作用を説明するためのフローチャー
ト。
ト。
【図７】 同じく作用を説明するためのフローチャー
ト。
ト。
【図８】 第２の実施の形態におけるデータを説明する
ための図。
ための図。
【図９】 第３の実施の形態におけるデータを説明する
ための図。
ための図。
【図１０】 第４の実施の形態におけるデータを説明す
るための図。
るための図。
【図１１】 第５の実施の形態におけるデータを説明す
るための図。
るための図。
【図１２】 第５の実施の形態における作用を説明する
ためのフローチャート。
ためのフローチャート。
【図１３】 第６の実施の形態におけるデータを説明す
るための図。
るための図。
【図１４】 第８の実施の形態におけるデータを説明す
るための図。
るための図。
【図１５】 第８の実施の形態における作用を説明する
ためのフローチャート。
ためのフローチャート。
【図１６】 第８の実施の形態における作用を説明する
ためのフローチャート。
ためのフローチャート。
【図１７】 従来のエンジン制御装置の回路構成を示す
図。
図。
【図１８】 同じく作用を説明するためのフローチャー
ト。
ト。
【図１９】 同じく作用を説明するためのフローチャー
ト。
ト。
【図２０】 同じく作用を説明するためのフローチャー
ト。
ト。
１…マイクロコンピュータ、２…ＣＰＵ、８…０１削除
回路、１０…ＥＥＰＲＯＭ、１２…メモリアレー、１７
…０１付与回路。
回路、１０…ＥＥＰＲＯＭ、１２…メモリアレー、１７
…０１付与回路。
フロントページの続き (72)発明者 鈴木 範幸 愛知県刈谷市昭和町１丁目１番地 株式会 社デンソー内
Claims (7)
- 【請求項１】 外部記憶装置から、シリアル通信線に
て、所定のビット数のデータを演算処理装置に取り込む
システムに用いられるものであって、 前記転送されるデータとして、全て０(2) または全て１
(2) とならないデータ構成とし、当該データによりシリ
アル通信線でのショートの有無を判定するようにしたこ
とを特徴とするシリアル通信線のショート検出方法。 - 【請求項２】 前記全て０(2) または全て１(2) となら
ないデータ構成として、前記演算処理装置と外部記憶装
置の一方において、転送される単位データの上位および
下位ビットに０(2) と１(2) を付加するとともに、演算
処理装置と外部記憶装置の他方において、前記付加した
０(2) と１(2) を取り除くようにした請求項１に記載の
シリアル通信線のショート検出方法。 - 【請求項３】 前記全て０(2) または全て１(2) となら
ないデータ構成として、演算処理装置により、転送され
るデータにおける所定箇所のビットに、０(2 ) と１(2)
を挿入するようにした請求項１に記載のシリアル通信線
のショート検出方法。 - 【請求項４】 転送されるデータにおける二箇所のビッ
トに、０(2) と１(2 ) を挿入するようにした請求項３に
記載のシリアル通信線のショート検出方法。 - 【請求項５】 前記全て０(2) または全て１(2) となら
ないデータ構成として、演算処理装置により、転送され
る単位データが全て０(2) の場合には所定のビットに１
(2) を、全て１(2) の場合には所定のビットに０(2) を
挿入するようにした請求項１に記載のシリアル通信線の
ショート検出方法。 - 【請求項６】 前記全て０(2) または全て１(2) となら
ないデータ構成として、演算処理装置により、転送され
る単位データにおける反転データと非反転データを書き
込むようにした請求項１に記載のシリアル通信線のショ
ート検出方法。 - 【請求項７】 前記全て０(2) または全て１(2) となら
ないデータ構成として、演算処理装置により、書き込み
データとして全て０(2) または全て１(2) とならないデ
ータを用いるようにした請求項１に記載のシリアル通信
線のショート検出方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10006969A JPH11203208A (ja) | 1998-01-16 | 1998-01-16 | シリアル通信線のショート検出方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10006969A JPH11203208A (ja) | 1998-01-16 | 1998-01-16 | シリアル通信線のショート検出方法 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH11203208A true JPH11203208A (ja) | 1999-07-30 |
Family
ID=11653039
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP10006969A Pending JPH11203208A (ja) | 1998-01-16 | 1998-01-16 | シリアル通信線のショート検出方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH11203208A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2014033267A (ja) * | 2012-08-01 | 2014-02-20 | Denso Corp | 演算処理装置 |
-
1998
- 1998-01-16 JP JP10006969A patent/JPH11203208A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2014033267A (ja) * | 2012-08-01 | 2014-02-20 | Denso Corp | 演算処理装置 |
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