JPH11219945A - 半導体装置のエッチングマスク形成方法 - Google Patents
半導体装置のエッチングマスク形成方法Info
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- Drying Of Semiconductors (AREA)
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Abstract
産物による汚染を減らすことができ、イン−ウェーハの
均一度及びバッチの均一度を増加させることができる半
導体装置のエッチングマスク形成方法を提供する。 【解決手段】 半導体装置のトレンチ隔離は、まず半導
体基板10上に形成されたパッド酸化膜12と、シリコ
ンリッチ窒化膜13と、該シリコンリッチ窒化膜13上
に形成されたHTO膜14とを含む。前記シリコンリッ
チ窒化膜13は、既存のシリコン窒化膜であるSi3N4
とは異なり、Si4N4以上のシリコンと窒素の組成比を
有するシリコン含量の多い窒化膜を示す。次に、前記半
導体基板10の一部をエッチングして形成されたトレン
チ18と、該トレンチ18を充填して形成されたトレン
チフィリング酸化膜20とを含む。
Description
チングマスク(etch mask)形成方法に関するものであ
り、より詳しくは半導体装置のトレンチ隔離(trench i
solation)形成時、エッチングマスクで使用されるシリ
コン窒化膜の残留引張応力(residual tensile stres
s)を減少させる半導体装置のエッチングマスク形成方
法に関するものである。
することによって素子隔離方法でSTI(Shallow Tren
ch Isolation)方法がよく使用されている。
膜をマスクで使用してトレンチを形成し、トレンチを絶
縁膜で充填する。
法でSiH2Cl2(以下、DCSと称する):NH3=
1:10の含量比を有するソースガス(source gas)を
使用して形成する。
時、よく発生されるシーム(seam)等の欠陥を除去す
る。
10dyne/cm2以上の高い残留引張応力(residual
tensile stress)を有するシリコン窒化膜によってアク
ティブ領域(active region)にディスロケション(dis
location)等の欠陥が発生される。
膜(gate oxide)の信頼度(reliability)を減少さ
せ、リフレッシュ(refresh)特性も減少させるように
なる。
として、残留引張応力が小さいシリコンリッチ窒化膜
(Si-rich nitride)を使用するようになった。
比によるシリコン窒化膜の残留引張応力を示すグラフで
ある。
09dyne/cm2以下を有するシリコンリッチ窒化膜
を形成するためにはDCSとNH3の比を5:1以上で
増加させなければならないことが分かる。
よってDCSの分解副産物であるHClとNH3が反応
して半導体基板上にNH4Cl性粒子(particle)をた
くさん発生させるようになる。
の代わりにSiH4を使用すると、HClが発生されな
いため、NH4Cl性粒子による汚染を減らすようにな
る。
使用してシリコンリッチ窒化膜を形成する場合、第一、
イン−ウェーハ(in-wafer)均一度(uniformity)を5
%内に減らすことが難しい。第二、ウェーハの間の均一
度が落してバッチ(batch)当たり進行できるウェーハ
数が減少される。第三、バッチ均一度を合わせるために
はチューブ(tube)内の温度勾配を増加させなければな
らないため、シリコン窒化膜の乾式及び湿式エッチング
率等の基本物性に差が発生される。
問題点を解決するため提案されたものとして、シリコン
リッチ窒化膜形成時、ソースガスの副産物による汚染を
減らすことができ、イン−ウェーハの均一度及びバッチ
の均一度を増加させることができる半導体装置のエッチ
ングマスク形成方法を提供することがその目的である。
膜が3×109dyne/cm2以下の残留引張応力を有
するようにして、ゲート酸化膜特性劣化が防止できる半
導体装置のエッチングマスク形成方法を提供することが
その目的である。
め提案された本発明の特徴によると、半導体装置の製造
方法は、シリコンリッチ窒化膜をエッチングマスクで使
用してトレンチを形成する半導体装置の製造方法におい
て、半導体基板上にパッド酸化膜を形成する段階と、パ
ッド酸化膜上にLPCVD方法でシリコンリッチ窒化膜
(Si-rich nitride)を形成するが、シリコンリッチ窒
化膜を形成するためのシリコンソースガスとして、少な
くとも2種類以上の違い合うガスを使用して形成する段
階とを含む。
リッチ窒化膜は、SixNyの組成を有する膜として、x
が少なくともy以上の値を有する。
リッチ窒化膜は、Si4N4である。
ソースガスは、DCS(SiH2Cl2)とSiH4を含
む混合ガスであり、シリコンリッチ窒化膜を形成するた
めの窒素ソースガスは、NH3である。
ソースガスDCS(SiH2Cl2)とSiH4の含量比
は、約1:0.1である。
ソースガスDCS(SiH2Cl2)と窒素ソースガスN
H3の含量比は、1:10である。
によると、半導体装置の製造方法は、半導体装置のトレ
ンチ隔離形成方法において、半導体基板上にパッド酸化
膜を形成する段階と、パッド酸化膜上にSi4H4以上の
組成を有するシリコンリッチ窒化膜を形成する段階と、
半導体基板上のシリコンリッチ窒化膜及びパッド酸化膜
の一部を除去してトレンチ形成用マスク膜を形成する段
階と、マスク膜形成によって、オープンされた半導体基
板をエッチングしてトレンチを形成する段階と、トレン
チを絶縁膜で充填してトレンチ隔離を形成する段階と、
トレンチ及び絶縁膜形成時、発生された欠陥を除去する
ための高温熱処理工程を行う段階とを含む。
リッチ窒化膜は、LPCVDで形成される。
リッチ窒化膜は、少なくとも2種類以上のシリコンソー
スガスと窒素ソースガスを使用して形成される。
ソースガスは、DCS(SiH2Cl2)とSiH4の混
合ガスであり、窒素ソースガスは、NH3である。
ソースガスDCS(SiH2Cl2)と窒素ソースガスN
H3の含量比は、1:10である。
ソースガスDCS(SiH2Cl2)とSiH4の含量比
は、約1:0.1である。
理工程温度は、約1150℃である。
理後のシリコンリッチ窒化膜の残留凝力は、3×109
dyne/cm2以下である。
によると、半導体装置の製造方法は、シリコンリッチ窒
化膜をエッチングマスクで使用する半導体装置の製造方
法において、半導体基板上にLPCVD方法でシリコン
リッチ窒化膜を形成するが、シリコンリッチ窒化膜を形
成するためのソースガスとして、窒素ソースガスと、少
なくとも2種類以上の違い合うシリコンソースガスを使
用して形成し、違い合うシリコンソースガスは、窒素ソ
ースガスと反応してシリコン窒化膜を形成する第1シリ
コンソースガスと、シリコンリッチ窒化膜を形成するこ
とにおいて、必要なシリコンソースの不足量を保証する
機能を有する。
リッチ窒化膜は、SixNyの組成を有する膜としてxが
少なくともy以上の値を有する。
リッチ窒化膜は、Si4N4である。
スガスは、NH3である。
コンソースガスは、DCS(SiH2Cl2)であり、第
2シリコンソースガスは、SiH4である。
(SiH2Cl2)とSiH4の含量比は、約1:0.1
である。
ク形成方法は、シリコンソースガスとして少なくとも2
つ以上の違い合うソースガスを使用してシリコンリッチ
窒化膜を形成することによって、NH4Cl性粒子によ
る汚染を減らし、イン−ウェーハの均一度及びバッチ均
一度を向上させる。
形態による新規した半導体装置のエッチングマスク形成
方法は、半導体基板上にパッド酸化膜(pad oxide)を
形成し、パッド酸化膜上にLPCVD方法でシリコンリ
ッチ窒化膜を形成する。この時、シリコンリッチ窒化膜
を形成するためのシリコンソースガスとして、少なくと
も2種類以上が違い合うガスを使用して形成する。この
ような半導体装置に製造方法によって、シリコンソース
ガスとしてDCSガスとSiH4を混用することによっ
てDCSガスの過量によるNH4Cl性粒子の汚染を減
らすことができ、イン−ウェーハの均一度及びバッチ均
一度を向上させることができる。又このようなシリコン
リッチ窒化膜形成でゲート酸化膜の特性劣化が防止でき
る。
実施形態を詳細に説明する。
置のトレンチ隔離を示す図面である。
る半導体装置のトレンチ隔離は、まず半導体基板10上
に形成されたパッド酸化膜12とシリコンリッチ窒化膜
13を含む。そしてシリコンリッチ窒化膜13上に形成
されたHTO(High Temperature Oxide)膜14とを含
む。
存のシリコン窒化膜であるSi3N4とは異なり、Si4
N4以上のシリコンと窒素の組成比を有するシリコン含
量の多い窒化膜を示す。
して形成されたトレンチ18と、トレンチ18を充填し
て形成されたトレンチフィリング(filing)酸化膜20
とを含む。
にトレンチ隔離領域を定義し、HTO膜14及びシリコ
ンリッチ窒化膜13、そしてパッド酸化膜12を順序に
エッチングしてトレンチ隔離領域の半導体基板10をオ
ープン(open)させる。そして、膜14、13、12を
エッチングマスクで使用して半導体基板10をエッチン
グすることによって形成される。
(Undoped Silicate Glass)等の絶縁膜が使用される。
陥を除去するため約1150℃以上の高温熱処理工程を
行われるが、この時シリコンリッチ窒化膜1の残留引張
応力は、3×109dyne/cm2以下の従来の割に相
対的に小さい値を示す。
0、即ちアクティブ領域に発生されるディスロケション
等の欠陥を防止するようになる。
のシリコンリッチ窒化膜1の形成方法は、次のようであ
る。
型LPCVD製造装置乃至シングルウェーハタイプ(si
ngle wafertype)式LPCVD製造装置によって形成さ
れる。
シリコンソースガスでは、DCSガス及びSiH4混合
ガス(mixed source)が使用され、窒素ソースガスで
は、NH3ガスが使用される。
とNH3を使用する場合、その比が5:1以上になった
時形成されるが、ここではDCSとNH3の含量比を既
存の1:10の比をそのまま維持しながらSiH4を少
量添加するようになる。この時、DCSとSiH4の含
量比は、約1:0.1になる。
時、シリコンソースの不足量をSiH4が供給するよう
になるから、シリコンリッチ窒化膜1が易く形成され
る。
の形成で、シリコンリッチ窒化膜1を形成するため過量
のDCSを使用されたりSiH4だけを使用する場合、
発生されるNH4Cl性粒子汚染問題及び均一度等の問
題を減らすようになる。
ート酸化膜の信頼度を示すグラフである。
比を有する従来シリコン窒化膜を示し、参照番号23
は、Si4N4以上の組成比を有するシリコンリッチ窒化
膜を示す。
成されたシリコンリッチ窒化膜は、50%の分布を基準
で取る時、従来シリコン窒化膜の単位面積当たり電荷量
が約0.3C/cm2を示す反面、シリコンリッチ窒化
膜は、約0.6C/cm2の相対的に高い値を示す。従
ってシリコンリッチ窒化膜の信頼度がより高いことが分
かる。
め、DCSとNH3を使用してシリコン窒化膜を形成す
る製造装置にSiH4ガスライン(gas line)だけ追加
することによって、新規装備使用が要求されない。
を反応器外部で混合させた後、1つのインジェクタ(in
jector)を通して反応器内に噴射させることができ、シ
リコンリッチ窒化膜の組成比のバッチ均一度を増加させ
るため混入インジェクタ外にSiH4だけを噴射する補
助インジェクタを使用することもできる。
させるため、この分野でよく知られたリング−ボート
(ring-boat)が使用でき、ウェーハを回転させること
もできる。
Cl性粒子発生を減らすことができ、イン−ウェーハ均
一度及びバッチ均一度を向上させることができ、従っ
て、シリコンリッチ窒化膜の形成でゲート酸化膜の特性
劣化が防止できる効果がある。
リコン窒化膜の残留引張応力を示すグラフである。
チ隔離を示す図面である。
の信頼度を示すグラフである。
化膜
Claims (20)
- 【請求項1】 シリコンリッチ窒化膜をエッチングマス
クで使用してトレンチを形成する半導体装置の製造方法
において、 半導体基板上にパッド酸化膜を形成する段階と、 前記パッド酸化膜上にLPCVD方法でシリコンリッチ
窒化膜を形成するが、前記シリコンリッチ窒化膜を形成
するためのシリコンソースガスとして、少なくとも2種
類以上の違い合うガスを使用して形成する段階とを含む
ことを特徴とする半導体装置の製造方法。 - 【請求項2】 前記シリコンリッチ窒化膜は、SixNy
の組成を有する膜として、xが少なくともy以上の値を
有することを特徴とする請求項1に記載の半導体装置の
製造方法。 - 【請求項3】 前記シリコンリッチ窒化膜は、Si4N4
であることを特徴とする請求項1に記載の半導体装置の
製造方法。 - 【請求項4】 前記シリコンソースガスは、DCS(S
iH2Cl2)とSiH4を含む混合ガスであり、前記シ
リコンリッチ窒化膜を形成するための窒素ソースガス
は、NH3であることを特徴とする請求項1に記載の半
導体装置の製造方法。 - 【請求項5】 前記シリコンソースガスDCS(SiH
2Cl2)とSiH4の含量比は、約1:0.1であるこ
とを特徴とする請求項4に記載の半導体装置の製造方
法。 - 【請求項6】 前記シリコンソースガスDCS(SiH
2Cl2)と窒素ソースガスNH3の含量比は、1:10
であることを特徴とする請求項4に記載の半導体装置の
製造方法。 - 【請求項7】 半導体装置のトレンチ隔離形成方法にお
いて、半導体基板上にパッド酸化膜を形成する段階と、 前記パッド酸化膜上にSi4H4以上の組成を有するシリ
コンリッチ窒化膜を形成する段階と、 前記半導体基板上のシリコンリッチ窒化膜及びパッド酸
化膜の一部を除去してトレンチ形成用マスク膜を形成す
る段階と、 前記マスク膜形成によって、オープンされた半導体基板
をエッチングしてトレンチを形成する段階と、 前記トレンチを絶縁膜で充填してトレンチ隔離を形成す
る段階と、 前記トレンチ及び前記絶縁膜形成時、発生された欠陥を
除去するための高温熱処理工程を行う段階とを含むこと
を特徴とする半導体装置の製造方法。 - 【請求項8】 前記シリコンリッチ窒化膜は、LPCV
Dで形成されることを特徴とする請求項7に記載の半導
体装置の製造方法。 - 【請求項9】 前記シリコンリッチ窒化膜は、少なくと
も2種類以上のシリコンソースガスと窒素ソースガスを
使用して形成されることを特徴とする請求項7に記載の
半導体装置の製造方法。 - 【請求項10】 前記シリコンソースガスは、DCS
(SiH2Cl2)とSiH4の混合ガスであり、前記窒
素ソースガスは、NH3であることを特徴とする請求項
9に記載の半導体装置の製造方法。 - 【請求項11】 前記シリコンソースガスDCS(Si
H2Cl2)と窒素ソースガスNH3の含量比は、1:1
0であることを特徴とする請求項10に記載の半導体装
置の製造方法。 - 【請求項12】 前記シリコンソースガスDCS(Si
H2Cl2)とSiH4の含量比は、約1:0.1である
ことを特徴とする請求項10に記載の半導体装置の製造
方法。 - 【請求項13】 前記高温熱処理工程温度は、約115
0℃であることを特徴とする請求項7に記載の半導体装
置の製造方法。 - 【請求項14】 前記高温熱処理後のシリコンリッチ窒
化膜の残留引張応力は、3×109dyne/cm2以下
であることを特徴とする請求項7に記載の半導体装置の
製造方法。 - 【請求項15】 シリコンリッチ窒化膜をエッチングマ
スクで使用する半導体装置の製造方法において、 半導体基板上にLPCVD方法でシリコンリッチ窒化膜
(Si−rich nitride)を形成するが、前
記シリコンリッチ窒化膜を形成するためのソースガスと
して、窒素ソースガスと、少なくとも2種類以上の違い
合うシリコンソースガスを使用して形成し、 前記違い合うシリコンソースガスは、窒素ソースガスと
反応してシリコン窒化膜を形成する第1シリコンソース
ガスと、 前記シリコンリッチ窒化膜を形成することにおいて、必
要なシリコンソースの不足量を補充する機能を有する第
2シリコンソースガスを含むことを特徴とする半導体装
置の製造方法。 - 【請求項16】 前記シリコンリッチ窒化膜は、Six
Nyの組成を有する膜としてxが少なくともy以上の値
を有することを特徴とする請求項15に記載の半導体装
置の製造方法。 - 【請求項17】 前記シリコンリッチ窒化膜は、Si4
N4であることを特徴とする請求項15に記載の半導体
装置の製造方法。 - 【請求項18】 前記窒素ソースガスは、NH3である
ことを特徴とする請求項15に記載の半導体装置の製造
方法。 - 【請求項19】 前記第1シリコンソースガスは、DC
S(SiH2Cl2)であり、前記第2シリコンソースガ
スは、SiH4であることを特徴とする請求項15に記
載の半導体装置の製造方法。 - 【請求項20】 前記DCS(SiH2Cl2)とSiH
4の含量比は、約1:0.1であることを特徴とする請
求項19に記載の半導体装置の製造方法。
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