JPH11259152A - シリーズレギュレータ - Google Patents
シリーズレギュレータInfo
- Publication number
- JPH11259152A JPH11259152A JP7643398A JP7643398A JPH11259152A JP H11259152 A JPH11259152 A JP H11259152A JP 7643398 A JP7643398 A JP 7643398A JP 7643398 A JP7643398 A JP 7643398A JP H11259152 A JPH11259152 A JP H11259152A
- Authority
- JP
- Japan
- Prior art keywords
- voltage
- output
- input
- transistor
- output voltage
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- Pending
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- Continuous-Control Power Sources That Use Transistors (AREA)
Abstract
(57)【要約】
【課題】 本発明の課題は、複数の入力電圧から一つの
出力電圧を得るようにしてあり、入力電圧と出力電圧の
差を小さくすると共に、出力電圧の切り換え時の変動を
小さくできるシリーズレギュレータを提供することにあ
る。 【解決手段】 入力端子１、２と出力端子３間に直列接
続されているトランジスタＱ１、Ｑ２のいずれかを共通
の誤差増幅回路５により制御することにより、出力電圧
が得られる。入力端子と出力端子３間の電圧降下は、直
列接続されるトランジスタＱ１又はトランジスタＱ２だ
けによって生ずるので入力電圧と出力電圧の差は小さく
なり、また共通の誤差増幅回路５の出力により該トラン
ジスタＱ１、Ｑ２を制御することにより出力電圧の切り
換え時の変動を小さくできる。
出力電圧を得るようにしてあり、入力電圧と出力電圧の
差を小さくすると共に、出力電圧の切り換え時の変動を
小さくできるシリーズレギュレータを提供することにあ
る。 【解決手段】 入力端子１、２と出力端子３間に直列接
続されているトランジスタＱ１、Ｑ２のいずれかを共通
の誤差増幅回路５により制御することにより、出力電圧
が得られる。入力端子と出力端子３間の電圧降下は、直
列接続されるトランジスタＱ１又はトランジスタＱ２だ
けによって生ずるので入力電圧と出力電圧の差は小さく
なり、また共通の誤差増幅回路５の出力により該トラン
ジスタＱ１、Ｑ２を制御することにより出力電圧の切り
換え時の変動を小さくできる。
Description
【０００１】
【発明の属する技術分野】本発明は、複数の入力電圧か
ら一つの出力電圧を得るシリーズレギュレータに関する
ものである。
ら一つの出力電圧を得るシリーズレギュレータに関する
ものである。
【０００２】
【従来の技術】シリーズレギュレータは携帯用電子機器
の主電源として多用されるが、最近では複数の入力電圧
を用いて一つの出力電圧を得るための接続手法がしばし
ば行われる。このようなレギュレータの接続手法は、一
つの入力電圧を供給する電源の能力が低下しても別の電
源から供給される入力電圧を用いることによりレギュレ
ータを正常に動作させることができる。また、値の異な
る入力電圧を供給する種々の電源を用いることのできる
便利さもある。図２と図３は、従来のこのようなシリー
ズレギュレータの接続手法の説明図である。図２におい
て、１と２は入力端子、３は出力端子、２０はシリーズ
レギュレータである。
の主電源として多用されるが、最近では複数の入力電圧
を用いて一つの出力電圧を得るための接続手法がしばし
ば行われる。このようなレギュレータの接続手法は、一
つの入力電圧を供給する電源の能力が低下しても別の電
源から供給される入力電圧を用いることによりレギュレ
ータを正常に動作させることができる。また、値の異な
る入力電圧を供給する種々の電源を用いることのできる
便利さもある。図２と図３は、従来のこのようなシリー
ズレギュレータの接続手法の説明図である。図２におい
て、１と２は入力端子、３は出力端子、２０はシリーズ
レギュレータである。
【０００３】入力端子１とシリーズレギュレータ２０間
には、スイッチ１０によりオン、オフされるトランジス
タＱ３が接続し、また入力端子２とシリーズレギュレー
タ２０間にはスイッチ１１によりオン、オフされるトラ
ンジスタＱ４が接続している。なお、Ｒ３とＲ４はバイ
アス用の抵抗である。図３のシリーズレギュレータは、
入力端子１と出力端子３間にシリーズレギュレータ２
１、入力端子２と出力端子３間にシリーズレギュレータ
２２を接続してある。従来のシリーズレギュレータの接
続方法は、このように個々のシリーズレギュレータの本
体内部の構成が変更されることなく用いられている。
には、スイッチ１０によりオン、オフされるトランジス
タＱ３が接続し、また入力端子２とシリーズレギュレー
タ２０間にはスイッチ１１によりオン、オフされるトラ
ンジスタＱ４が接続している。なお、Ｒ３とＲ４はバイ
アス用の抵抗である。図３のシリーズレギュレータは、
入力端子１と出力端子３間にシリーズレギュレータ２
１、入力端子２と出力端子３間にシリーズレギュレータ
２２を接続してある。従来のシリーズレギュレータの接
続方法は、このように個々のシリーズレギュレータの本
体内部の構成が変更されることなく用いられている。
【０００４】すなわち、図２の場合には、レギュレータ
２０の外部に複数の入力端子１、２を設けてありいずれ
かの入力端子の入力電圧がレギュレータ２０に加えられ
る。図３の場合は、入力端子の異なるシリーズレギュレ
ータ２１、２２が単に並列接続され、いずれかの出力電
圧が出力端子３に得られるようにしてある。しかし、図
２では、レギュレータ２０の外部のトランジスタＱ３又
はトランジスタＱ４とレギュレータ２０の制御トランジ
スタによる電圧降下が生ずるので、入力端子１、２の入
力電圧を高くする必要がある。外部のトランジスタとレ
ギュレータの内部の制御トランジスタによる電圧降下を
夫々0.3V、0.2Vとすると、入力電圧は出力電圧に比較し
て少なくとも0.5Vだけ高くする必要がある。
２０の外部に複数の入力端子１、２を設けてありいずれ
かの入力端子の入力電圧がレギュレータ２０に加えられ
る。図３の場合は、入力端子の異なるシリーズレギュレ
ータ２１、２２が単に並列接続され、いずれかの出力電
圧が出力端子３に得られるようにしてある。しかし、図
２では、レギュレータ２０の外部のトランジスタＱ３又
はトランジスタＱ４とレギュレータ２０の制御トランジ
スタによる電圧降下が生ずるので、入力端子１、２の入
力電圧を高くする必要がある。外部のトランジスタとレ
ギュレータの内部の制御トランジスタによる電圧降下を
夫々0.3V、0.2Vとすると、入力電圧は出力電圧に比較し
て少なくとも0.5Vだけ高くする必要がある。
【０００５】図３の場合は、レギュレータ本体の制御ト
ランジスタによる電圧降下だけなので、入力電圧は出力
電圧に比較して少なくとも0.2Vだけ高くすればよく、入
力電圧と出力電圧の差を小さくできる。しかし、レギュ
レータ２１とレギュレータ２２の出力電圧の差が生じや
すい。通常、レギュレータの出力電圧の誤差の規格は出
力電圧が3V程度において±50mVにしてあるので、出力電
圧を得るレギュレータ２１、２２を切り換えることによ
り最大で出力電圧が0.1V変化することになる。これは、
レギュレータの出力電圧の誤差の規格である±50mVを越
えるので不都合である。また、レギュレータの切り換え
により、出力電圧が変動しやすいことは大きな欠点であ
る。このように、複数の入力電圧から一つの出力電圧を
得る従来のシリーズレギュレータの接続手法は種々の欠
点を有していた。
ランジスタによる電圧降下だけなので、入力電圧は出力
電圧に比較して少なくとも0.2Vだけ高くすればよく、入
力電圧と出力電圧の差を小さくできる。しかし、レギュ
レータ２１とレギュレータ２２の出力電圧の差が生じや
すい。通常、レギュレータの出力電圧の誤差の規格は出
力電圧が3V程度において±50mVにしてあるので、出力電
圧を得るレギュレータ２１、２２を切り換えることによ
り最大で出力電圧が0.1V変化することになる。これは、
レギュレータの出力電圧の誤差の規格である±50mVを越
えるので不都合である。また、レギュレータの切り換え
により、出力電圧が変動しやすいことは大きな欠点であ
る。このように、複数の入力電圧から一つの出力電圧を
得る従来のシリーズレギュレータの接続手法は種々の欠
点を有していた。
【０００６】
【発明が解決しようとする課題】本発明の課題は、複数
の入力電圧から一つの出力電圧を得るようにしてあり、
入力電圧と出力電圧の差を小さくすると共に、入力電圧
が切り換った場合の出力電圧の変動をなくすことのでき
るシリーズレギュレータを提供することにある。
の入力電圧から一つの出力電圧を得るようにしてあり、
入力電圧と出力電圧の差を小さくすると共に、入力電圧
が切り換った場合の出力電圧の変動をなくすことのでき
るシリーズレギュレータを提供することにある。
【０００７】
【課題を解決するための手段】本発明のシリーズレギュ
レータは、複数の入力端子と一つの出力端子を有してお
り、各入力端子と出力端子間には夫々トランジスタが直
列接続され、出力電圧に対応する電圧と基準電圧が共通
の誤差増幅回路で比較され、該誤差増幅回路の出力によ
りいずれかの該トランジスタが制御されることを特徴と
する。
レータは、複数の入力端子と一つの出力端子を有してお
り、各入力端子と出力端子間には夫々トランジスタが直
列接続され、出力電圧に対応する電圧と基準電圧が共通
の誤差増幅回路で比較され、該誤差増幅回路の出力によ
りいずれかの該トランジスタが制御されることを特徴と
する。
【０００８】
【発明の実施の形態】本発明のシリーズレギュレータ
は、各入力端子と出力端子間に直列接続されているトラ
ンジスタのいずれかを共通の誤差増幅回路により制御す
ることにより、出力電圧が得られる。入力端子と出力端
子間の電圧降下は直列接続される一つの制御トランジス
タだけによるから入力電圧と出力電圧の差は小さくな
り、また同じ誤差増幅回路の出力により該トランジスタ
を制御することにより出力電圧の切り換え時の変動を小
さくできる。
は、各入力端子と出力端子間に直列接続されているトラ
ンジスタのいずれかを共通の誤差増幅回路により制御す
ることにより、出力電圧が得られる。入力端子と出力端
子間の電圧降下は直列接続される一つの制御トランジス
タだけによるから入力電圧と出力電圧の差は小さくな
り、また同じ誤差増幅回路の出力により該トランジスタ
を制御することにより出力電圧の切り換え時の変動を小
さくできる。
【０００９】
【実施例】以下、本発明のシリーズレギュレータの実施
例を示す回路図である図１を参照しながら説明する。な
お、図２、図３と同一部分は同じ符号を付与してある。
図１において、入力端子１と出力端子３間にはＰＮＰ形
のトランジスタＱ１が１列接続し、別の入力端子２と出
力端子３間にはＰＮＰ形のトランジスタＱ２が直列接続
している。通常、トランジスタＱ１、Ｑ２は制御トラン
ジスタと称される。Ｒ１とＲ２は出力端子３に得られる
出力電圧を分圧して検出する抵抗であり、出力端子３と
アース間に直列接続されている。５はオペアンプからな
る誤差増幅回路であり、非反転入力端子が抵抗Ｒ１と抵
抗Ｒ２の接続点、反転入力端子には基準電圧を供給する
電圧源Ｓ１が接続する。誤差増幅回路５の出力側はスイ
ッチ回路６に接続し、スイッチ回路６を経てトランジス
タＱ１又はトランジスタＱ２のベースに接続される。４
はスイッチ回路６を制御する制御端子である。
例を示す回路図である図１を参照しながら説明する。な
お、図２、図３と同一部分は同じ符号を付与してある。
図１において、入力端子１と出力端子３間にはＰＮＰ形
のトランジスタＱ１が１列接続し、別の入力端子２と出
力端子３間にはＰＮＰ形のトランジスタＱ２が直列接続
している。通常、トランジスタＱ１、Ｑ２は制御トラン
ジスタと称される。Ｒ１とＲ２は出力端子３に得られる
出力電圧を分圧して検出する抵抗であり、出力端子３と
アース間に直列接続されている。５はオペアンプからな
る誤差増幅回路であり、非反転入力端子が抵抗Ｒ１と抵
抗Ｒ２の接続点、反転入力端子には基準電圧を供給する
電圧源Ｓ１が接続する。誤差増幅回路５の出力側はスイ
ッチ回路６に接続し、スイッチ回路６を経てトランジス
タＱ１又はトランジスタＱ２のベースに接続される。４
はスイッチ回路６を制御する制御端子である。
【００１０】このように構成されたシリーズレギュレー
タは、入力端子１と入力端子２に加えられる入力電圧か
らトランジスタＱ１又はトランジスタＱ２を制御するこ
とににより一つの出力端子３に設定された出力電圧が得
られる。出力電圧は分圧して検出され、検出された出力
電圧に対応する電圧は誤差増幅回路５で基準電圧と比較
され、誤差増幅回路５の出力をトランジスタＱ１又はト
ランジスタＱ２のベースに加えることにより、トランジ
スタＱ１又はトランジスタＱ２は設定された出力電圧を
得るように制御される。トランジスタＱ１又はトランジ
スタＱ２の選択は、制御端子４からの信号により行われ
る。なお、スイッチ回路６は１回路２接点のスイッチと
して表示してあるが、トランジスタ回路として種々の構
成が可能であることはいうまでもない。各入力端子と出
力端子間に接続されるトランジスタは出力電圧を制御す
るものであるから、ダーリントン接続された複数のトラ
ンジスタから構成することもできる。無論、トランジス
タはＮＰＮ形のトランジスタを用いてもよい。
タは、入力端子１と入力端子２に加えられる入力電圧か
らトランジスタＱ１又はトランジスタＱ２を制御するこ
とににより一つの出力端子３に設定された出力電圧が得
られる。出力電圧は分圧して検出され、検出された出力
電圧に対応する電圧は誤差増幅回路５で基準電圧と比較
され、誤差増幅回路５の出力をトランジスタＱ１又はト
ランジスタＱ２のベースに加えることにより、トランジ
スタＱ１又はトランジスタＱ２は設定された出力電圧を
得るように制御される。トランジスタＱ１又はトランジ
スタＱ２の選択は、制御端子４からの信号により行われ
る。なお、スイッチ回路６は１回路２接点のスイッチと
して表示してあるが、トランジスタ回路として種々の構
成が可能であることはいうまでもない。各入力端子と出
力端子間に接続されるトランジスタは出力電圧を制御す
るものであるから、ダーリントン接続された複数のトラ
ンジスタから構成することもできる。無論、トランジス
タはＮＰＮ形のトランジスタを用いてもよい。
【００１１】
【発明の効果】以上述べたように本発明のシリーズレギ
ュレータは、各入力端子と一つの出力端子間にトランジ
スタを接続してあり、いずれかのトランジスタを共通の
誤差増幅回路で制御するものである。入力端子と出力端
子間における電圧降下が小さいので入力電圧と出力電圧
の差を小さくできるし、また制御トランジスタの選択に
より入力電圧が切り換えられた場合でも変動をなくすこ
とのできる利点がある。さらに、誤差増幅回路を主とす
る制御回路部が共通になるようにレギュレータ本体の回
路を根本的に改良してあるので、半導体集積回路の形状
を従来に比較して小さくできる利点もある。
ュレータは、各入力端子と一つの出力端子間にトランジ
スタを接続してあり、いずれかのトランジスタを共通の
誤差増幅回路で制御するものである。入力端子と出力端
子間における電圧降下が小さいので入力電圧と出力電圧
の差を小さくできるし、また制御トランジスタの選択に
より入力電圧が切り換えられた場合でも変動をなくすこ
とのできる利点がある。さらに、誤差増幅回路を主とす
る制御回路部が共通になるようにレギュレータ本体の回
路を根本的に改良してあるので、半導体集積回路の形状
を従来に比較して小さくできる利点もある。
【図１】 本発明のシリーズレギュレータの実施例を示
す回路図である。
す回路図である。
【図２】 従来のシリーズレギュレータの説明図であ
る。
る。
【図３】 従来のシリーズレギュレータの別の説明図で
ある。
ある。
１、２ 入力端子 ３ 出力端子 ５ 誤差増幅回路 Ｑ１ トランジスタ Ｑ２ トランジスタ
Claims (1)
- 【請求項１】 複数の入力端子と一つの出力端子を有し
ており、各入力端子と出力端子間には夫々トランジスタ
が直列接続され、出力電圧に対応する電圧と基準電圧が
共通の誤差増幅回路で比較され、該誤差増幅回路の出力
によりいずれかの該トランジスタが制御されることを特
徴とするシリーズレギュレータ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7643398A JPH11259152A (ja) | 1998-03-11 | 1998-03-11 | シリーズレギュレータ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7643398A JPH11259152A (ja) | 1998-03-11 | 1998-03-11 | シリーズレギュレータ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH11259152A true JPH11259152A (ja) | 1999-09-24 |
Family
ID=13605033
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7643398A Pending JPH11259152A (ja) | 1998-03-11 | 1998-03-11 | シリーズレギュレータ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH11259152A (ja) |
Cited By (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2005174264A (ja) * | 2003-11-18 | 2005-06-30 | Ricoh Co Ltd | 電源切換回路 |
| JP2007334400A (ja) * | 2006-06-12 | 2007-12-27 | Toshiba Corp | 電源電圧制御回路および半導体集積回路 |
| JP2008009683A (ja) * | 2006-06-29 | 2008-01-17 | Sanyo Electric Co Ltd | 電源回路 |
| JP2019159465A (ja) * | 2018-03-08 | 2019-09-19 | ローム株式会社 | リニアレギュレータ |
| WO2020084966A1 (ja) * | 2018-10-23 | 2020-04-30 | 日立オートモティブシステムズ株式会社 | 電子制御装置 |
-
1998
- 1998-03-11 JP JP7643398A patent/JPH11259152A/ja active Pending
Cited By (9)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2005174264A (ja) * | 2003-11-18 | 2005-06-30 | Ricoh Co Ltd | 電源切換回路 |
| JP2007334400A (ja) * | 2006-06-12 | 2007-12-27 | Toshiba Corp | 電源電圧制御回路および半導体集積回路 |
| JP2008009683A (ja) * | 2006-06-29 | 2008-01-17 | Sanyo Electric Co Ltd | 電源回路 |
| JP2019159465A (ja) * | 2018-03-08 | 2019-09-19 | ローム株式会社 | リニアレギュレータ |
| WO2020084966A1 (ja) * | 2018-10-23 | 2020-04-30 | 日立オートモティブシステムズ株式会社 | 電子制御装置 |
| CN112840289A (zh) * | 2018-10-23 | 2021-05-25 | 日立安斯泰莫株式会社 | 电子控制装置 |
| JPWO2020084966A1 (ja) * | 2018-10-23 | 2021-09-30 | 日立Astemo株式会社 | 電子制御装置 |
| CN112840289B (zh) * | 2018-10-23 | 2022-05-10 | 日立安斯泰莫株式会社 | 电子控制装置 |
| US12093066B2 (en) | 2018-10-23 | 2024-09-17 | Hitachi Astemo, Ltd. | Electronic control device |
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