JPH11272209A - 表示用集積回路ビデオ・タイル - Google Patents

表示用集積回路ビデオ・タイル

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JPH11272209A
JPH11272209A JP1554199A JP1554199A JPH11272209A JP H11272209 A JPH11272209 A JP H11272209A JP 1554199 A JP1554199 A JP 1554199A JP 1554199 A JP1554199 A JP 1554199A JP H11272209 A JPH11272209 A JP H11272209A
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JP
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video
integrated circuit
display
tile
tiles
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JP1554199A
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Atul Goel
アツル・ゲール
Robert P Martin
ロバート・ピー・マーティン
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HP Inc
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Hewlett Packard Co
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Publication date
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    • G09G3/2085Special arrangements for addressing the individual elements of the matrix, other than by driving respective rows and columns in combination
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    • G06F3/147Digital output to display device ; Cooperation and interconnection of the display device with other functional units using display panels
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Abstract

(57)【要約】 【課題】 近年、益々大型のフラットパネル・ディスプ
レイを開発するよう強く要請されてきている。大きなサ
イズのフラットパネル・ディスプレイの製造に関する問
題は、数百万のアクティブ素子を組み込んだディスプレ
イ全般に渡って高い歩留りを達成するのが困難なことで
ある。 【解決手段】 高い生産歩留りを達成するために、タイ
ル式ビデオ・ディスプレイ装置の各タイルを適度に小さ
なサイズ(たとえば、1インチ×1インチ)で製造し、
これらをビデオ・バスを介して蛇行状に接続する。また
各ビデオ・タイルがイメージのどの部分を表示するかを
判定することができるよう自己構成する。

Description

【発明の詳細な説明】
【0001】
【発明の属する技術分野】本発明は、ビデオ情報の表示
に関するものであり、より詳細には、タイル式ビデオ・
ディスプレイ装置を形成するため複製することができる
集積回路ビデオ・タイルを介する、アナログまたはディ
ジタルいずれかのビデオ情報の表示に関するものであ
る。
【0002】
【従来の技術】近年、益々大型のフラットパネル・ディ
スプレイを開発するよう強く要請されてきている。技術
の進歩によって、製造業者が白黒ディスプレイからカラ
ー・ディスプレイに、そして発光ダイオード(LED)
ディスプレイから薄膜トランジスタ(TFT)ディスプ
レイに移行し、これらのディスプレイのサイズも比較的
ゆっくり増大してきた。たとえば、大型ディスプレイは
作動不能ピクセル(すなわち、低い歩留り)に苦心する
ことが頻繁で、フラットパネル・ディスプレイの対角線
は、過去5年間に渡って約9インチから14インチに増
大しただけである。より大きなサイズのフラットパネル
・ディスプレイの製造に関する問題は、数百万のアクテ
ィブ素子を組み込んだディスプレイ全般に渡って高い歩
留りを達成するのが困難なことである。
【0003】
【発明が解決しようとする課題】従って、本発明の主要
な目的は、任意のサイズのディスプレイにおける高い歩
留りを達成するための方法および装置を提供することで
ある。
【0004】本発明の他の目的は、重複モジュラ要素か
ら任意のサイズの画面を組み立てることができるディス
プレイ技術を提供することである。
【0005】本発明の他の目的は、自己構成する集積回
路ビデオ・タイルを提供することである。
【0006】本発明の他の目的は、必ずしも平面でなく
てよいディスプレイを生産するための手段を提供するこ
とである。
【0007】本発明のさらに他の目的は、環境的な浪費
を削減するディスプレイ技術を提供することである。
【0008】
【課題を解決するための手段】前述の目的達成におい
て、本発明者は、タイル式ビデオ・ディスプレイ装置を
形成するため複製することができる集積回路ビデオ・タ
イルを考案した。ビデオ・ディスプレイ装置の集積回路
ビデオ・タイル(すなわち、ビデオ・タイル)は、ビデ
オ・バスを介して蛇行状に接続されることが好ましく、
各ビデオ・タイルがイメージのどの部分を表示するかを
判定することができるよう自己構成する。各ビデオ・タ
イルは、イメージの1つまたは多数のピクセルを表示す
るため1つまたは複数の表示要素を有する。
【0009】高い生産歩留りを達成するように、各タイ
ルを適度に小さなサイズ(たとえば、1インチ×1イン
チ)で製造することができる点において、このタイル式
ビデオ・ディスプレイ装置は、従来の「フラットパネル
・ディスプレイ」よりも有益である。従って、数百万の
作動要素(すなわち、作動不能ピクセルがない)を持つ
大型ディスプレイの製造の問題を解決する。代わりに、
わずか1つの、またはせいぜい少数の作動要素を持つ小
型集積回路を製造し、配列に組み立て、任意のサイズの
ディスプレイを生産するために使用する。たとえば、比
較的小さなビデオ・タイルを組み立てて、作動不能ピク
セルが一つもない、数兆の作動要素を有するビルボード
を形成することができることが構想される。
【0010】集積回路(特に特定用途向け集積回路(A
SIC))を製作するために既存の確立された保証済の
インフラストラクチャによって、工作機械を設備するの
に多大な費用をかけずに、高い費用効率でビデオ・タイ
ルを製造することができる。さらに、1つのサイズのビ
デオ・タイルだけで任意のサイズの画面を組み立てるこ
とが可能である。
【0011】タイル式ビデオ・ディスプレイ装置を利用
する他の利点は、現在の技術の「フラット・パネル」と
いう制限がこれ以上存在しなくなることである。タイル
のサイズがディスプレイ全体のサイズに対して十分小さ
くなるように製造した場合、湾曲した幻影を映し出す画
面を形成するようタイルを接続することができる。
【0012】ビデオ・タイルはまた、環境的な浪費を削
減する。「完璧な」大型画面の歩留りは小さい(一般に
はおよそ20%)ので、ビデオ・タイルは、製造過程の
途中で取り除かれる画面の材料の量を削減することによ
って、環境的な浪費を削減する。
【0013】これらと他の本発明の重要な利点と目的に
ついて、付属の記述、図面および特許請求の範囲の中で
さらに説明し、それらから明らかになるであろう。
【0014】
【発明の実施の形態】図1〜図3に1つの集積回路ビデ
オ・タイル100が描かれており、一般に集積回路パッ
ケージ102、ディジタル信号処理装置308、グラフ
ィック・ドライバ310、および1つまたは複数の表示
要素104を備えることもできる。集積回路パッケージ
は、表示要素104を装着した上部108を有する。グ
ラフィック・ドライバ310をディジタル信号処理装置
308と1つまたは複数の表示要素104の両方に電気
的に結合し、ディジタル信号処理装置308、およびグ
ラフィック・ドライバ310を集積回路パッケージ10
2の内部に装着する。
【0015】本開示で使用するように、「結合して」ま
たは「電気的に結合して」という用語は、ワイヤおよび
/または他の要素を介する2つ以上の要素間の接続を意
味する。従って、要素Aが要素Bに結合しているという
文は、要素AとBの間の直接接続と他の要素を介する
(たとえば、レジスタ、バス・インタフェースなどを介
する)要素AとBの間の接続の両方を含む。
【0016】図4にタイル式ビデオ表示装置400が描
かれており、一般に複数の集積回路ビデオ・タイル10
0、406〜442を有するプリント回路板402を備
える。プリント回路板402に電気的に結合した配列中
に端と端を合わせて、複数の集積回路ビデオ・タイル1
00、406〜442を配置する。各集積回路ビデオ・
タイル100、406〜442を、図1〜図3に示すよ
うに組み立てることもできる。
【0017】図1に示す1つまたは複数のビデオ・タイ
ル100上、または図4のタイル式ビデオ・ディスプレ
イ装置400上にビデオ情報を表示する方法は、一般に
集積回路ビデオ・タイル100、406〜442が直列
に接続した配列を形成するよう、複数の集積回路ビデオ
・タイル100、406〜442を配置する段階で始ま
る。次に、複数のビデオ・データ・パケットを複数の集
積回路ビデオ・タイル100、406〜442の間で渡
し、渡す各ビデオ・データ・パケットに対して、第1の
集積回路ビデオ・タイル406がビデオ・データ・パケ
ットから表示情報の第1の部分を検索し、第2の集積回
路ビデオ・タイル408がビデオ・データ・パケットか
ら表示情報の第2の部分を検索し、ビデオ・データ・パ
ケット中の表示情報の各部分を検索し終えるまでこれを
続行する。表示情報の各部分を検索した後、集積回路ビ
デオ・タイル100、406〜442が表示情報の各部
分を表示する。
【0018】集積回路ビデオ・タイル100、タイル式
ビデオ・ディスプレイ装置400、および一般にビデオ
情報を表示する方法について述べてきたが、次に前述の
装置、およびその使用方法についてさらに詳しく述べ
る。
【0019】図1のビデオ・タイル100を特定用途向
け集積回路(ASIC)として製造することもできる。
ASICの中核となる要素は、ディジタル信号処理装置
(DSP)308およびグラフィック・ドライバ310
である。
【0020】集積回路パッケージ102は、底の表面上
に表面実装技術(SMT)で組み立てるためのボール・
グリッド配列(BGA)106、およびその上部の表面
108上の1つまたは複数の表示要素104を備える。
【0021】1つまたは複数の表示要素104は、発光
ダイオード(LED)ディスプレイ、薄膜トランジスタ
(TFT)ディスプレイ、液晶ディスプレイ(LC
D)、マイクロミラー・ディスプレイ、プラズマ・ディ
スプレイ、または白黒もしくはカラーの光を発光もしく
は反射し、集積回路パッケージ102に接着している
(またはその一部として組み立てられている)こともあ
る、他の任意の形式のディスプレイを形成することもで
きる。1つまたは複数の表示要素104が、集積回路パ
ッケージ102の上部の表面108を端から端まで覆う
ことが好ましいが、光の「溢出(spill ove
r)」が要素104間に残った空間の中を満たすよう
に、多数のビデオ・タイル100を配置することが可能
なため、必ずしも必要ではない。
【0022】各ビデオ・タイル100の1つまたは複数
の表示要素104は、1つまたは複数のピクセルのイメ
ージを表示する。たとえば、ビデオ・タイル100は、
1)イメージの1つのピクセルを表示する1つの表示要
素か、2)共にイメージの1つのピクセルを表示する複
数の表示要素(たとえば、赤、緑、および青のLED)
か、または3)イメージの複数のピクセルを表示する複
数の表示要素を備えることもできる。後者の場合、各ビ
デオ・タイル100は垂直解像度および/または水平解
像度を有する。
【0023】各ビデオ・タイル100は、さらに表示要
素104によって表示されるデータを記憶する、スタテ
ィック・メモリまたはリフレシュ・ダイナミック・メモ
リ312を備えることもできる。次にDSP308は、
ビデオ・タイル100が接続しているバスからビデオ・
データを検索し、データをメモリ312中に記憶するよ
うにする。その後グラフィック・ドライバ310は、表
示要素104によって後で表示するためメモリ312か
らデータを検索する。メモリは、DSP308の内部
(たとえば、キャッシュ)でも外部(たとえば、VRA
M)でもよい。イメージの更新によって目に見える裂け
目(tearing)を見せないように、メモリ312
をダブル・バッファにすることもできる。
【0024】タイル式ビデオ・ディスプレイ装置400
(すなわち、ディスプレイ画面)を形成するため、多数
のビデオ・タイルをプリント回路板(PCB)に取り付
けることもできる。図4を参照されたい。ディスプレイ
画面は、平面でも、湾曲していても、階段状などでもよ
い。各ビデオ・タイルが隣接するタイルと接触している
ことが好ましいが、再度光の溢出によってタイル間の小
さな境目を満たすこともできる。このようなディスプレ
イの解像度は、1つのビデオ・タイル100の解像度
を、タイル式ビデオ・ディスプレイ装置400を形成す
るビデオ・タイル100、406〜442の総数で掛け
たものになる。
【0025】モジュラ・ビデオ・タイルより任意のサイ
ズのディスプレイ画面を製作することを構想する。ウォ
ールトゥウォールの画面もしくはビルボードなどの超大
型画面に関して、プリント回路板タイル402およびビ
デオ・タイル100の両方の組み合わせにより画面を組
み立てることもできる。
【0026】プリント回路板402中のトレース404
によって、ビデオ・タイル配列400に電源を入れたり
相互接続したりすることができる。ローカルまたは遠隔
のいずれかの信号手段によって、プリント回路板402
中のこれらのトレースに電源、タイミング、およびデー
タ信号を適用することができる。遠隔信号手段の1つの
例はテレビジョン受信機/送信機であってもよい。ま
た、ハード接続(たとえば、ワイヤ、もしくはバス)、
または他の手段(たとえば、赤外線、もしくはUHF通
信システム)を介して、信号をプリント回路板トレース
404に適用することもできる。
【0027】多数のビデオ・タイル100、406〜4
42を相互接続する1つの手段は、ビデオ・バス502
(図5)を介する。このような配置において、各ビデオ
・タイル408は、着信ビデオ・バス部分504と発信
ビデオ・バス部分506に関連する。蛇行型バス構成が
好ましいが、他の構成も許容できる。ビデオ・バス50
2を介してイメージ情報を含むビデオ・データ・パケッ
トを送信する時、各ビデオ・タイトルはイメージの部分
を表示するために必要な、ビデオ情報の部分を順に抽出
し、残りを無視する。
【0028】60Hzで再表示された表面解像度200
0×1000(ピクセル)の場合、このディスプレイで
1つのピクセルを生成するのに3バイトが必要であると
仮定すると、400メガバイト/秒よりいくらか少ない
帯域幅が必要である。50MHzクロックでは、前述の
ようなビデオ・バス502は8バイト(64ビット)幅
でなければならない。25MHzクロックでは、ビデオ
・バス502が16バイト(128ビット)幅である必
要がある。好ましくは着信ビデオ・バスおよび発信ビデ
オ・バスの両方に対して外部接点を持つ各ビデオ・タイ
ル100、406〜442を提供する必要があるため、
これらの例の中で各ビデオ・タイルが持たなければなら
ないビデオ接点の数は、それぞれ128と256であ
る。現在の集積回路パッキング技術の場合、これは十分
ピン出力制限の許容範囲内である。
【0029】タイル式ビデオ・ディスプレイ装置400
の電源投入時、ビデオ・バス502上の1つのプロトコ
ルが、ビデオ・タイル100、406〜442の自己構
成を提供する。このプロトコルは、タイルが相互にカウ
ントしてイメージをそれら自体間で分割する手段を提供
することのみが必要である。
【0030】好適な実施形態において、このプロトコル
はビデオ・バス502を介する第1および第2の情報パ
ケットの伝送を備える。ビデオ・バス502を介して転
送される第1の情報パケットは、水平および垂直解像度
情報パケットである。この情報パケットは、修正されず
にすべてのビデオ・タイル100、406〜442に渡
され、タイル式ビデオ・ディスプレイ装置400の一部
を形成する各ビデオ・タイル100、406〜442
に、タイル式ビデオ・ディスプレイ装置の水平および垂
直解像度をアップロードするための手段を提供する。
【0031】ビデオ・バス502を介して伝送される第
2の情報パケットは、「XおよびYビデオ・タイル座標
パケット」である。このパケットもまた、各ビデオ・タ
イル100、406〜442に渡されるが、渡される際
に修正される。第1のビデオ・タイル406が受信した
時、このパケットには第1のビデオ・タイル406の物
理的なXおよびYの位置(すなわち、ビデオ・ディスプ
レイ装置400内の第1のビデオ・タイルの位置)が含
まれる。一般に、第1のビデオ・タイル406の位置は
(0、0)である。このパケットが第2のビデオ・タイ
ル408に渡されたとき、この第2のビデオ・タイル4
08(たとえば、(1、0))の位置を反映するよう
に、パケットのXおよびY座標を更新する。このプロセ
スは、各ビデオ・タイル100、406〜442がその
XおよびY座標を決定し終え、最終的にイメージのどの
部分を表示するかが分かるまで続行される。タイルの送
信もしくは受信のいずれかによって、パケットのXおよ
びY座標の更新を行う。XおよびYビデオ・タイル座標
パケットにはまた、ビデオ・タイル100、406〜4
42がビデオ・バスを介する接続の物理的パスを決定す
るために使用することができる情報が含まれる。ビデオ
・タイル100、406〜442がパケットのXおよび
Y座標値を更新する方法を決定することができるよう、
この情報を必要とする。
【0032】追加もしくは代替の情報パケットもまた、
ビデオ・バス502を介してビデオ・タイル100、4
06〜442間で渡すことができる。たとえば、ダブル
・バッファ・ビデオ・タイルがいつバッファを切り換え
るかを示すため、フレーム情報パケットの終了を渡すこ
ともできる。
【0033】ビデオ・タイル100、406〜442の
サイズが比較的小さいため、ビデオ・バス502はデジ
タル・データのみを伝送するのが好適である。しかしな
がら、オプションのビデオ・コンバータ・チップ508
を備えることによって、アナログ信号(たとえば、テレ
ビジョン信号)とディジタル信号(たとえば、コンピュ
ータ・ビデオ・グラフィック)の両方を受信するよう
に、ビデオ・ディスプレイ装置400を適応させること
もできる。ビデオ・コンバータ・チップ508はアナロ
グ信号またはディジタル信号を受信し、次に容認された
プロトコルに適合してビデオ・バス502上を伝送する
ことができるディジタル形式にその信号を変換する。ま
た、初期化パケットをビデオ・タイル100、406〜
442に送信するように、ビデオ・コンバータ・チップ
508を構成することもできる。
【0034】以上、本発明の実施例について詳述した
が、以下、本発明の各実施態様の例を示す。
【0035】(実施態様1)以下(a)から(d)を含
むことを特徴とする集積回路ビデオ・タイル(10
0)、 a)集積回路パッケージ(102)、 b)前記集積回路パッケージの内部に装着されたディジ
タル信号処理装置(308)、 c)前記集積回路パッケージのほぼすべての上部(10
8)を覆う1以上の表示要素(104)、 d)前記ディジタル信号処理装置および前記1つ以上の
表示要素の両方に電気的に結合し、前記集積回路パッケ
ージの内部に装着されたグラフィック・ドライバ(31
0)。
【0036】(実施態様2)前記集積回路パッケージ
(102)は表面実装パッケージであることを特徴とす
る、実施態様1に記載の集積回路ビデオ・タイル(10
0)。
【0037】(実施態様3)前記1つ以上の表示要素
(104)は前記集積回路パッケージ(102)の前記
上部(108)を完全に覆うことを特徴とする、実施態
様1に記載の集積回路ビデオ・タイル(100)。
【0038】(実施態様4)以下(a)及び(b)を含
むことを特徴とするタイル式ビデオ・ディスプレイ装置
(400) a)ビデオ・バス(502)を備えるプリント回路板
(402)と、 b)前記プリント回路板に電気的に結合し、前記ビデオ
・バスを介して相互に電気的に結合する複数の集積回路
ビデオ・タイル(100、406〜442)。
【0039】(実施態様5)各前記複数の集積回路ビデ
オ・タイル(100、406〜442)はイメージを表
示するための1つ以上の表示要素(104)を備えるこ
とを特徴とする、実施態様4に記載のタイル式ビデオ・
ディスプレイ装置(400)。
【0040】(実施態様6)以下(a)及び(b)を含
むことを特徴とする、実施態様4に記載のタイル式ビデ
オ・ディスプレイ装置(400)、 a)各前記複数の集積回路ビデオ・タイル(100、4
06〜442)が1つ以上の表示要素(104)を備え
ており、 b)前記複数の集積回路ビデオ・タイルは、前記表示要
素が3次元表示面を形成することができるようにする方
式で前記プリント回路板(402)に電気的に結合す
る。
【0041】(実施態様7)前記ビデオ・バス(50
2)上で使用されるプロトコルによって、前記ビデオ・
バスを介して伝送するイメージを、前記複数の集積回路
ビデオ・タイルに適切に分割するように、電源投入時
に、前記複数の集積回路ビデオ・タイル(100、40
6〜442)が自己構成することができることを特徴と
する、実施態様4に記載のタイル式ビデオ・ディスプレ
イ装置(400)。
【0042】(実施態様8)以下(a)から(c)のス
テップを含むことを特徴とする、ビデオ情報を表示する
方法。 a)集積回路ビデオ・タイルが直列に接続した配列(5
00)を形成するよう、複数の集積回路ビデオ・タイル
(100、406〜442)を配置するステップと、 b)複数のビデオ・データ・パケットを前記複数の集積
回路ビデオ・タイル間で渡すステップであって、該ステ
ップは、渡した各前記ビデオ・データ・パケットに対し
て、第1の集積回路ビデオ・タイルが前記ビデオ・デー
タ・パケットからイメージの第1の部分を検索し、第2
の集積回路ビデオ・タイルが前記ビデオ・データ・パケ
ットからイメージの第2の部分を検索し、各イメージ部
分を前記ビデオ・データ・パケットから検索し終えるま
でこれを続行し、 c)前記複数の集積回路ビデオ・タイルの1つ以上の表
示要素上にイメージを表示するステップ。
【0043】(実施態様9)各前記複数の集積回路ビデ
オ・タイルが、前記集積回路ビデオ・タイルの前記配列
(500)の水平および垂直解像度をダウンロードする
こともできるように、前記複数の集積回路ビデオ・タイ
ル(100、406〜442)間で水平および垂直解像
度情報パケットを渡すステップをさらに備えることを特
徴とする、実施態様8に記載の方法。
【0044】(実施態様10)以下(a)及び(b)を
含むことを特徴とする、実施態様8に記載の方法、 a)前記複数の集積回路ビデオ・タイル(100、40
6〜442)間でXおよびYビデオ・タイル座標パケッ
トを渡すステップ、 b)各前記複数の集積回路ビデオ・タイルが、前記複数
の集積回路ビデオ・タイルを使用して、水平位置および
垂直位置を決定することができるように、前記配列(5
00)の水平および垂直解像度に応答して、前記Xおよ
びYビデオ・タイル座標パケットのXおよびY座標を、
渡すとき、増分するステップ。
【0045】例示的および提示的な本発明の好適な実施
形態について本明細書で詳細に述べてきたが、本発明の
概念を別の方法で多様に実施したり利用することもでき
ること、ならびに付属の特許請求の範囲が、従来技術に
よって制限されるもの以外のこれらの変形形態を含むと
解釈されるものであることを理解されたい。
【図面の簡単な説明】
【図1】集積回路ビデオ・タイルの上面斜視図である。
【図2】図1の集積回路ビデオ・タイルの底面斜視図で
ある。
【図3】ビデオ・タイルの内部の構成要素を示すために
ビデオ・タイルの上部を取り除いた、図1の集積回路ビ
デオ・タイルの上面斜視図である。
【図4】配列して組み立てた複数の図1の集積回路ビデ
オ・タイルを備える、タイル式ビデオ表示装置の上面斜
視図である。
【図5】集積回路ビデオ・タイルを図4のビデオ・ディ
スプレイ装置に接続するための好適なビデオ・バスを示
す概略図である。
【符号の説明】
100、406:集積回路ビデオ・タイル 102:集積回路パッケージ 104:表示要素 108:集積回路パッケージ上部 308:ディジタル信号処理装置 310:グラフィック・ドライバ 400:タイル式ビデオ・ディスプレイ装置 402:プリント回路板 500:配列 502:ビデオ・バス

Claims (1)

    【特許請求の範囲】
  1. 【請求項1】以下(a)から(d)を含むことを特徴と
    する集積回路ビデオ・タイル、 a)集積回路パッケージ、 b)前記集積回路パッケージの内部に装着されたディジ
    タル信号処理装置、 c)前記集積回路パッケージのほぼすべての上部を覆う
    1以上の表示要素、 d)前記ディジタル信号処理装置および前記1つ以上の
    表示要素の両方に電気的に結合し、前記集積回路パッケ
    ージの内部に装着されたグラフィック・ドライバ。
JP1554199A 1998-01-30 1999-01-25 表示用集積回路ビデオ・タイル Pending JPH11272209A (ja)

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Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US7042156B2 (en) 2002-10-24 2006-05-09 Noritake Co., Limited Flat-panel display device, and process of sealing the device along its periphery
US7101729B2 (en) 2002-03-28 2006-09-05 Seiko Epson Corporation Method of manufacturing a semiconductor device having adjoining substrates
US10741107B2 (en) 2013-12-31 2020-08-11 Ultravision Technologies, Llc Modular display panel
US10891881B2 (en) 2012-07-30 2021-01-12 Ultravision Technologies, Llc Lighting assembly with LEDs and optical elements

Families Citing this family (27)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2000077565A1 (en) * 1999-06-14 2000-12-21 Augusto Carlos J R P Active matrix for flat panel display
US6999045B2 (en) * 2002-07-10 2006-02-14 Eastman Kodak Company Electronic system for tiled displays
US7129910B2 (en) 2002-07-10 2006-10-31 Hewlett-Packard Development Company, L.P. Active display system and method with optical addressing
FR2845812B1 (fr) * 2002-10-10 2005-09-23 Inanov Systeme d'adressage d'ecran de visualisation
EP1513060A1 (en) * 2003-09-08 2005-03-09 Barco N.V. Large-area display system, modular unit used therein and method of operating the display
EP1548571A1 (en) * 2003-12-23 2005-06-29 Barco N.V. Configurable tiled emissive display
EP1550947A3 (en) * 2003-12-23 2009-06-17 Barco N.V. Configurable tiled emissive display
DE102006014800B4 (de) * 2006-03-29 2012-03-22 Insta Elektro Gmbh LED-Modul, LED-Darstellungssystem, LED-Darstellungsanordnung, Verwendung, Verfahren
US10210793B2 (en) 2008-03-11 2019-02-19 Robe Lighting S.R.O. Array of LED array luminaires
US20100225639A1 (en) * 2008-03-11 2010-09-09 Robe Lighting S.R.O. Array of led array luminaires
WO2014005600A2 (en) * 2012-07-06 2014-01-09 Hepion Aps A modular led display system, a module therefore and an application thereof
GB2531558B (en) * 2014-10-22 2021-01-13 Facebook Tech Llc Display
KR102403901B1 (ko) * 2015-11-12 2022-06-02 삼성전자 주식회사 디스플레이장치 및 그 제어방법
DE102016124983A1 (de) * 2016-12-20 2018-06-21 Osram Opto Semiconductors Gmbh Videowandmodul
CN108877663B (zh) * 2017-05-10 2020-07-10 矽照光电(厦门)有限公司 显示屏及其制造方法、以及显示结构
US10930709B2 (en) 2017-10-03 2021-02-23 Lockheed Martin Corporation Stacked transparent pixel structures for image sensors
US10510812B2 (en) 2017-11-09 2019-12-17 Lockheed Martin Corporation Display-integrated infrared emitter and sensor structures
US10690910B2 (en) 2018-02-07 2020-06-23 Lockheed Martin Corporation Plenoptic cellular vision correction
US10979699B2 (en) 2018-02-07 2021-04-13 Lockheed Martin Corporation Plenoptic cellular imaging system
US11616941B2 (en) 2018-02-07 2023-03-28 Lockheed Martin Corporation Direct camera-to-display system
US10652529B2 (en) 2018-02-07 2020-05-12 Lockheed Martin Corporation In-layer Signal processing
US10594951B2 (en) 2018-02-07 2020-03-17 Lockheed Martin Corporation Distributed multi-aperture camera array
US10838250B2 (en) 2018-02-07 2020-11-17 Lockheed Martin Corporation Display assemblies with electronically emulated transparency
US10951883B2 (en) * 2018-02-07 2021-03-16 Lockheed Martin Corporation Distributed multi-screen array for high density display
US10866413B2 (en) 2018-12-03 2020-12-15 Lockheed Martin Corporation Eccentric incident luminance pupil tracking
US10698201B1 (en) 2019-04-02 2020-06-30 Lockheed Martin Corporation Plenoptic cellular axis redirection
EP3761163A1 (en) * 2019-07-05 2021-01-06 Vestel Elektronik Sanayi ve Ticaret A.S. Method of operating a display system having a plurality of display units, and display system

Family Cites Families (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4368467A (en) * 1980-02-29 1983-01-11 Fujitsu Limited Display device
US5067021A (en) * 1988-07-21 1991-11-19 Brody Thomas P Modular flat-screen television displays and modules and circuit drives therefor
JPH07146671A (ja) * 1993-06-16 1995-06-06 Mitsubishi Electric Corp 大型映像表示装置
WO1996010244A1 (en) * 1994-09-27 1996-04-04 Shinsuke Nishida Display
JPH09159985A (ja) * 1995-12-08 1997-06-20 Mitsubishi Electric Corp 画像表示システム

Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US7101729B2 (en) 2002-03-28 2006-09-05 Seiko Epson Corporation Method of manufacturing a semiconductor device having adjoining substrates
US7042156B2 (en) 2002-10-24 2006-05-09 Noritake Co., Limited Flat-panel display device, and process of sealing the device along its periphery
US10891881B2 (en) 2012-07-30 2021-01-12 Ultravision Technologies, Llc Lighting assembly with LEDs and optical elements
US10741107B2 (en) 2013-12-31 2020-08-11 Ultravision Technologies, Llc Modular display panel

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EP0933753A3 (en) 1999-11-03

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