JPH11289490A - 静止画記録装置、画像処理装置および静止画記録方法 - Google Patents
静止画記録装置、画像処理装置および静止画記録方法Info
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- JPH11289490A JPH11289490A JP10093012A JP9301298A JPH11289490A JP H11289490 A JPH11289490 A JP H11289490A JP 10093012 A JP10093012 A JP 10093012A JP 9301298 A JP9301298 A JP 9301298A JP H11289490 A JPH11289490 A JP H11289490A
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Abstract
(57)【要約】
【課題】 読み出した静止画に合成等の画像処理を施
し、再び静止画記録用のメモリに書き込むことが可能な
静止画記録装置、画像処理装置および静止画記録方法を
提供すること。 【解決手段】 ビデオカメラ等に装備された静止画記録
装置において、静止画記録用のメモリ１９から静止画を
読み出す読み出し回路３１と、読み出した静止画と他の
画像信号とを合成する合成回路３０と、合成結果を静止
画記録用のメモリ１９へ書き込む書き込み手段３１とを
備える。本発明によれば、静止画用のメモリ１９へのア
クセスを工夫して、静止画を読み出しながら合成結果を
静止画記録用のメモリ１９へ書き込むことを可能にして
いる。
し、再び静止画記録用のメモリに書き込むことが可能な
静止画記録装置、画像処理装置および静止画記録方法を
提供すること。 【解決手段】 ビデオカメラ等に装備された静止画記録
装置において、静止画記録用のメモリ１９から静止画を
読み出す読み出し回路３１と、読み出した静止画と他の
画像信号とを合成する合成回路３０と、合成結果を静止
画記録用のメモリ１９へ書き込む書き込み手段３１とを
備える。本発明によれば、静止画用のメモリ１９へのア
クセスを工夫して、静止画を読み出しながら合成結果を
静止画記録用のメモリ１９へ書き込むことを可能にして
いる。
Description
【０００１】
【発明の属する技術分野】本発明は静止画記録装置、画
像処理装置および静止画記録方法に関し、特に、読み出
した静止画に合成等の画像処理を施し、再びメモリに書
き込むことが可能な静止画記録装置、該静止画記録装置
を備えた画像処理装置および静止画記録方法に関するも
のである。
像処理装置および静止画記録方法に関し、特に、読み出
した静止画に合成等の画像処理を施し、再びメモリに書
き込むことが可能な静止画記録装置、該静止画記録装置
を備えた画像処理装置および静止画記録方法に関するも
のである。
【０００２】
【従来の技術】従来、ビデオカメラやＶＴＲ等の画像処
理装置において、予め用意しておいた静止画と動画をル
ミキー、クロマキー、オーバーラップといった各種画像
処理機能で合成するものはタイトラーとして提案されて
いた。以下、従来の静止画記録機能を持つビデオカメラ
の静止画、動画ミックス機能について説明する。図１２
は、従来のＰＣカード等の記録メディアへの静止画記録
機能を有するビデオカメラの構成、および画像取り込み
時の動作を示すブロック図である。このビデオカメラ１
０は、カメラブロック１１やライン１２からの動画をキ
ャプチャー（取り込み）した静止画を一時バッファとな
るＤＲＡＭ１９に記録した上で、ＪＰＥＧ圧縮してＰＣ
カードのような記録メデイア２１に記録するようになっ
ている。
理装置において、予め用意しておいた静止画と動画をル
ミキー、クロマキー、オーバーラップといった各種画像
処理機能で合成するものはタイトラーとして提案されて
いた。以下、従来の静止画記録機能を持つビデオカメラ
の静止画、動画ミックス機能について説明する。図１２
は、従来のＰＣカード等の記録メディアへの静止画記録
機能を有するビデオカメラの構成、および画像取り込み
時の動作を示すブロック図である。このビデオカメラ１
０は、カメラブロック１１やライン１２からの動画をキ
ャプチャー（取り込み）した静止画を一時バッファとな
るＤＲＡＭ１９に記録した上で、ＪＰＥＧ圧縮してＰＣ
カードのような記録メデイア２１に記録するようになっ
ている。
【０００３】図１３は、従来のビデオカメラ１０の画像
再生時の動作を示すブロック図である。記録メデイア２
１に記録された静止画は逆に読み出されて、一時バッフ
ァとなるＤＲＡＭ１９に記録された上で、モニター１４
へ出カされたり、テープ１６へ記録させる。本方式のビ
デオカメラ１０では通常のタイトラーのように記録メデ
イア２１に記録された静止画とカメラ１１、ライン１２
やテープ１６から入力される動画とをミックスする画像
処理機能を有している。画像処理機能としてはオーバー
ラップ、ルミキー、クロマキー、インポーズなどがある
が、いずれも記録メデイア２１の静止画と動画をミック
スしたものをモニター１４に出カするかテープ１６に記
録することになる。
再生時の動作を示すブロック図である。記録メデイア２
１に記録された静止画は逆に読み出されて、一時バッフ
ァとなるＤＲＡＭ１９に記録された上で、モニター１４
へ出カされたり、テープ１６へ記録させる。本方式のビ
デオカメラ１０では通常のタイトラーのように記録メデ
イア２１に記録された静止画とカメラ１１、ライン１２
やテープ１６から入力される動画とをミックスする画像
処理機能を有している。画像処理機能としてはオーバー
ラップ、ルミキー、クロマキー、インポーズなどがある
が、いずれも記録メデイア２１の静止画と動画をミック
スしたものをモニター１４に出カするかテープ１６に記
録することになる。
【０００４】図１４は、従来の静止画記録用回路の構成
を示すブロック図である。実際の回路としては、ライン
やカメラ１１からの動画の映像信号が信号処理ＩＣ１３
から静止画記録用Ｉ／Ｆ‐ＩＣ１８へ入力され、ＩＣ内
で静止画と合成されたものを再度信号処理ＩＣ１３で受
け取り、モニター１４やＶＴＲ信号処理回路１５へ送
る。静止画記録Ｉ／Ｆ−ＩＣ１８内にはＤＲＡＭコント
ロ―ルブロック３１があり、信号処理ＩＣ１３からの同
期信号に合わせてバッファＤＲＡＭ１９をアクセスし、
カメラやラインからの動画のタイミングに合わせて静止
画をＭＩＸ（合成）回路へ送るようになっている。
を示すブロック図である。実際の回路としては、ライン
やカメラ１１からの動画の映像信号が信号処理ＩＣ１３
から静止画記録用Ｉ／Ｆ‐ＩＣ１８へ入力され、ＩＣ内
で静止画と合成されたものを再度信号処理ＩＣ１３で受
け取り、モニター１４やＶＴＲ信号処理回路１５へ送
る。静止画記録Ｉ／Ｆ−ＩＣ１８内にはＤＲＡＭコント
ロ―ルブロック３１があり、信号処理ＩＣ１３からの同
期信号に合わせてバッファＤＲＡＭ１９をアクセスし、
カメラやラインからの動画のタイミングに合わせて静止
画をＭＩＸ（合成）回路へ送るようになっている。
【０００５】ＭＩＸ回路３０内では、カメラやラインか
らの動画とバッファＤＲＡＭ１９からの静止画をルミキ
ー、クロマキー、オーバーラップ、インポーズといった
画像処理機能で合成して信号処理ＩＣ１３へ送り返す。
以上述べたような機能は通常のビデオカメラのタイトラ
ーと同様のものであり、信号の道筋としては、 （１）カメラからの動画＋静止画をモニターへ出カす
る。 （２）カメラからの動画＋静止画をＶＴＲに記録する。 （３）ラインからの動画＋静止画をモニターへ出カす
る。 （４）ラインからの動画＋静止画をＶＴＲに記録する。 （５）ＶＴＲからの動画＋静止画をモニターに出カする
といったものがある。これらはいずれも各ブロックを―
方向に進んでいるだけの静止画と動画をミックスするだ
けであるために簡単に実現できる。なお、関連する従来
例としては、特開平5-236310、特開平5-336421、特開平
6-133221、特開平7-162747等がある。
らの動画とバッファＤＲＡＭ１９からの静止画をルミキ
ー、クロマキー、オーバーラップ、インポーズといった
画像処理機能で合成して信号処理ＩＣ１３へ送り返す。
以上述べたような機能は通常のビデオカメラのタイトラ
ーと同様のものであり、信号の道筋としては、 （１）カメラからの動画＋静止画をモニターへ出カす
る。 （２）カメラからの動画＋静止画をＶＴＲに記録する。 （３）ラインからの動画＋静止画をモニターへ出カす
る。 （４）ラインからの動画＋静止画をＶＴＲに記録する。 （５）ＶＴＲからの動画＋静止画をモニターに出カする
といったものがある。これらはいずれも各ブロックを―
方向に進んでいるだけの静止画と動画をミックスするだ
けであるために簡単に実現できる。なお、関連する従来
例としては、特開平5-236310、特開平5-336421、特開平
6-133221、特開平7-162747等がある。
【０００６】
【発明が解決しようとする課題】前記したような、従来
のタイトラー機能を持つビデオカメラ等の画像処理装置
においては、合成画像はモニターかＶＴＲに出カされ、
合成された画像を再びタイトルの記録されている記録メ
ディアのＥＥＰＲＯＭやＲＡＭへ記録し直すことはでき
ないという問題点があった。本発明の目的は、前記のよ
うな従来技術の問題点を解決し、読み出した静止画に合
成等の画像処理を施し、再び静止画記録用のメモリに書
き込むことが可能な静止画記録装置、画像処理装置およ
び静止画記録方法を提供することにある。
のタイトラー機能を持つビデオカメラ等の画像処理装置
においては、合成画像はモニターかＶＴＲに出カされ、
合成された画像を再びタイトルの記録されている記録メ
ディアのＥＥＰＲＯＭやＲＡＭへ記録し直すことはでき
ないという問題点があった。本発明の目的は、前記のよ
うな従来技術の問題点を解決し、読み出した静止画に合
成等の画像処理を施し、再び静止画記録用のメモリに書
き込むことが可能な静止画記録装置、画像処理装置およ
び静止画記録方法を提供することにある。
【０００７】
【課題を解決するための手段】本発明は、静止画記録装
置において、静止画記録用の記憶手段から静止画を読み
出す読み出し手段と、読み出した静止画と他の画像信号
とを合成する合成手段と、合成結果を静止画記録用の記
憶手段へ書き込む書き込み手段とを備えたことを特徴と
する。また、該静止画記録装置を備えた画像処理装置お
よび静止画記録方法にも特徴がある。本発明によれば、
静止画用の記憶手段へのアクセスを工夫して、静止画を
読み出しながら合成結果を静止画記録用の記憶手段へ書
き込むことを可能にしている。
置において、静止画記録用の記憶手段から静止画を読み
出す読み出し手段と、読み出した静止画と他の画像信号
とを合成する合成手段と、合成結果を静止画記録用の記
憶手段へ書き込む書き込み手段とを備えたことを特徴と
する。また、該静止画記録装置を備えた画像処理装置お
よび静止画記録方法にも特徴がある。本発明によれば、
静止画用の記憶手段へのアクセスを工夫して、静止画を
読み出しながら合成結果を静止画記録用の記憶手段へ書
き込むことを可能にしている。
【０００８】
【発明の実施の形態】以下、本発明の実施の形態を詳細
に説明する。図１は、本発明を適用したビデオカメラの
要部構成を示すブロック図である。本発明においては、
バッファＤＲＡＭ１９から読み出し、ＭＩＸ回路３０に
おいてミックスした画像データを再びバッファＤＲＡＭ
１９に記録する。なお、Ｄラッチ３２は読み出した静止
画データを一時的に保持するためのラッチ回路である。
ＤＲＡＭコントロ―ルブロック３１は、信号処理ＩＣ１
３からの同期信号に合わせてアドレス信号およびRAS（ロ
ーアト゛レスセレクト）、CAS（コラムアト゛レスセレクト）、WE（ライトイネーフ゛ル）
等のアクセス制御信号を発生する。
に説明する。図１は、本発明を適用したビデオカメラの
要部構成を示すブロック図である。本発明においては、
バッファＤＲＡＭ１９から読み出し、ＭＩＸ回路３０に
おいてミックスした画像データを再びバッファＤＲＡＭ
１９に記録する。なお、Ｄラッチ３２は読み出した静止
画データを一時的に保持するためのラッチ回路である。
ＤＲＡＭコントロ―ルブロック３１は、信号処理ＩＣ１
３からの同期信号に合わせてアドレス信号およびRAS（ロ
ーアト゛レスセレクト）、CAS（コラムアト゛レスセレクト）、WE（ライトイネーフ゛ル）
等のアクセス制御信号を発生する。
【０００９】静止画を記録メデイアに記録するためのバ
ッファとなる記録用メモリーは通常ＤＲＡＭを使用する
が、静止画のキャプチャー時には動画をキャプチャーし
たデータのライトが実行され、静止画のモニターやＶＴ
Ｒへの再生時にはＤＲＡＭに書かれたデータのリードが
実行される。本発明で実行しようとしている静止画を再
生して動画とミックスし、更にその結果を静止画キャプ
チャー用のメモリーに書き込むためには、静止画キャプ
チャー用のＤＲＡＭのリードとライトを同時に行う必要
がある。オーバーラップ、ルミキー、クロマキー、イン
ポーズといった静止画と動画のミックスを行う画像処理
を実行している時は静止画記録用のメモリーから静止画
データを読み出しているため、何らかの方法を用いて静
止画記録用メモリーを読み出しながら書き込むことを行
わなければならない。
ッファとなる記録用メモリーは通常ＤＲＡＭを使用する
が、静止画のキャプチャー時には動画をキャプチャーし
たデータのライトが実行され、静止画のモニターやＶＴ
Ｒへの再生時にはＤＲＡＭに書かれたデータのリードが
実行される。本発明で実行しようとしている静止画を再
生して動画とミックスし、更にその結果を静止画キャプ
チャー用のメモリーに書き込むためには、静止画キャプ
チャー用のＤＲＡＭのリードとライトを同時に行う必要
がある。オーバーラップ、ルミキー、クロマキー、イン
ポーズといった静止画と動画のミックスを行う画像処理
を実行している時は静止画記録用のメモリーから静止画
データを読み出しているため、何らかの方法を用いて静
止画記録用メモリーを読み出しながら書き込むことを行
わなければならない。
【００１０】ミックスした画像データを再びバッファＤ
ＲＡＭ１９に記録するための実現方法としては、下記の
３つの方法が挙げられる。 （１）静止画記録用ＤＲＡＭを２つ用意して、静止画再
生と合成結果の記録を同時に行う。 （２）静止画記録用ＤＲＡＭを読み出しながら、合成結
果を再びそのＤＲＡＭに上書きする。 （３）静止画記録用ＤＲＡＭを読み出しながら、合成結
果をＤＲＡＭの余剰エリアに記録する。 また、静止画と動画の合成回路のディレイを吸収するた
めに、合成結果をメモリーへ送る前に１ライン分のバッ
ファＲＡＭを用意して、水平方向で同じ位置のデータを
メモリーにライトするようにすることも考えられる。以
下、具体的な実施例の構成について説明する。
ＲＡＭ１９に記録するための実現方法としては、下記の
３つの方法が挙げられる。 （１）静止画記録用ＤＲＡＭを２つ用意して、静止画再
生と合成結果の記録を同時に行う。 （２）静止画記録用ＤＲＡＭを読み出しながら、合成結
果を再びそのＤＲＡＭに上書きする。 （３）静止画記録用ＤＲＡＭを読み出しながら、合成結
果をＤＲＡＭの余剰エリアに記録する。 また、静止画と動画の合成回路のディレイを吸収するた
めに、合成結果をメモリーへ送る前に１ライン分のバッ
ファＲＡＭを用意して、水平方向で同じ位置のデータを
メモリーにライトするようにすることも考えられる。以
下、具体的な実施例の構成について説明する。
【００１１】図２は、本発明の実施例１の構成を示すブ
ロック図である。第１の実施例においては、静止画再生
用のバッファＤＲＡＭ-1（３４）の他に同容量のＭＩＸ
画像保存用のバッファＤＲＡＭ-2（３５）を持ち、ＭＩ
Ｘされた画像を順次そのＤＲＡＭ-2（３５）にライトし
ていく。なお、Ｄラッチ３３はＭＩＸした混合画データ
を一時的に保持するためのラッチ回路である。
ロック図である。第１の実施例においては、静止画再生
用のバッファＤＲＡＭ-1（３４）の他に同容量のＭＩＸ
画像保存用のバッファＤＲＡＭ-2（３５）を持ち、ＭＩ
Ｘされた画像を順次そのＤＲＡＭ-2（３５）にライトし
ていく。なお、Ｄラッチ３３はＭＩＸした混合画データ
を一時的に保持するためのラッチ回路である。
【００１２】図３は、第１の実施例の要部の動作タイミ
ングを示すタイミング図である。静止画記縁用Ｉ／Ｆ−
ｌＣ１８内のＤＲＡＭコントロ―ルブロック３１で生成
されるアドレスとコントロ―ル信号（ＲＡＳ、ＣＡＳ
等）によりバッファＤＲＡＭ１から一時保存されていた
静止画データを入力される動画のタイミングに合わせて
リードする。バッファＤＲＡＭ１（３４）からリードさ
れた静止画データは順次信号処理ＩＣからの動画データ
とＭＩＸされて信号処理ＩＣへ戻される。それと同時に
ＭＩＸされた映像信号は、Ｄラッチ３３を経て、もう―
つのバッファＤＲＡＭ２（３５）に順次ライトされてい
く。
ングを示すタイミング図である。静止画記縁用Ｉ／Ｆ−
ｌＣ１８内のＤＲＡＭコントロ―ルブロック３１で生成
されるアドレスとコントロ―ル信号（ＲＡＳ、ＣＡＳ
等）によりバッファＤＲＡＭ１から一時保存されていた
静止画データを入力される動画のタイミングに合わせて
リードする。バッファＤＲＡＭ１（３４）からリードさ
れた静止画データは順次信号処理ＩＣからの動画データ
とＭＩＸされて信号処理ＩＣへ戻される。それと同時に
ＭＩＸされた映像信号は、Ｄラッチ３３を経て、もう―
つのバッファＤＲＡＭ２（３５）に順次ライトされてい
く。
【００１３】図４は、高速ページモードＲＡＭを使用し
た場合の第１の実施例の要部の動作タイミングを示すタ
イミング図である。ＤＲＡＭのアクセススピードがあま
り高速でなく、ＤＲＡＭアクセスに高速ページモード
（ＲＡＳアドレスを１つ入れた後、ＣＡＳアドレスを順
次変えていき―つのＲＡＳアドレスに対してＣＡＳアド
レスのみ変えてメモリーのリード、ライトをする方法）
を使用する場合でも同様の手順で実行できる。
た場合の第１の実施例の要部の動作タイミングを示すタ
イミング図である。ＤＲＡＭのアクセススピードがあま
り高速でなく、ＤＲＡＭアクセスに高速ページモード
（ＲＡＳアドレスを１つ入れた後、ＣＡＳアドレスを順
次変えていき―つのＲＡＳアドレスに対してＣＡＳアド
レスのみ変えてメモリーのリード、ライトをする方法）
を使用する場合でも同様の手順で実行できる。
【００１４】図５は、本発明の実施例２の構成を示すブ
ロック図である。実施例２においては、バッファＤＲＡ
ＭｌとバッファＤＲＡＭ２のアドレスバスを共通にする
ことで、回路とＩＣ間の配線を簡略化することができ
る。しかし、通常ＭＩＸ回路は数〜数十クロック分のデ
ィレイを持っているため、バッファＤＲＡＭｌとバッフ
ァＤＲＡＭ２を同じアドレスでアクセスするとＭＩＸさ
れた信号はずれた位置にライトされることになる。この
対策としてＭＩＸ回路とバッファＤＲＡＭ２の間に１ラ
イン分のバッファＲＡＭ３６を２ライン分用意してお
き、１ライン毎にＭＩＸされた信号のライトと、ＤＲＡ
Ｍへライトするためのリードとを切り替える。なお、Ｒ
ＡＭ３６のアドレス信号もＤＲＡＭコントロ―ルブロッ
ク３１から発生するか、あるいはＲＡＭとしてＦＩＦＯ
バッファを使用する。
ロック図である。実施例２においては、バッファＤＲＡ
ＭｌとバッファＤＲＡＭ２のアドレスバスを共通にする
ことで、回路とＩＣ間の配線を簡略化することができ
る。しかし、通常ＭＩＸ回路は数〜数十クロック分のデ
ィレイを持っているため、バッファＤＲＡＭｌとバッフ
ァＤＲＡＭ２を同じアドレスでアクセスするとＭＩＸさ
れた信号はずれた位置にライトされることになる。この
対策としてＭＩＸ回路とバッファＤＲＡＭ２の間に１ラ
イン分のバッファＲＡＭ３６を２ライン分用意してお
き、１ライン毎にＭＩＸされた信号のライトと、ＤＲＡ
Ｍへライトするためのリードとを切り替える。なお、Ｒ
ＡＭ３６のアドレス信号もＤＲＡＭコントロ―ルブロッ
ク３１から発生するか、あるいはＲＡＭとしてＦＩＦＯ
バッファを使用する。
【００１５】図６は、第２の実施例の要部の動作タイミ
ングを示すタイミング図である。即ちＭＩＸされたデー
タを１ライン分バッファとなるＲＡＭに貯えておき、Ｄ
ＲＡＭのアドレスアクセスのタイミングに合わせてＭＩ
Ｘされた結果をＭＩＸ画記録用ＤＲＡＭにライトしてい
く。最初のライン（第１ライン）で入力された動画のタ
イミングに合わせて、ＤＲＡＭコントロ―ルブロック３
１はＤＲＡＭアドレスを発生して、静止画の記録されて
いるＤＲＡＭｌから静止画データをリードしていく。
ングを示すタイミング図である。即ちＭＩＸされたデー
タを１ライン分バッファとなるＲＡＭに貯えておき、Ｄ
ＲＡＭのアドレスアクセスのタイミングに合わせてＭＩ
Ｘされた結果をＭＩＸ画記録用ＤＲＡＭにライトしてい
く。最初のライン（第１ライン）で入力された動画のタ
イミングに合わせて、ＤＲＡＭコントロ―ルブロック３
１はＤＲＡＭアドレスを発生して、静止画の記録されて
いるＤＲＡＭｌから静止画データをリードしていく。
【００１６】ＭＩＸ回路で各種の処理を施されたＭＩＸ
画データは数〜数十クロック遅れて出カされるので、こ
れをバッファＲＡＭｌに１ライン分記録する。次の第２
ラインで入力された動画のタイミングに合わせてＤＲＡ
Ｍコントロ―ルブロックがＤＲＡＭアドレスを発生する
と、そのアドレスのタイミングに合わせて、前の第１ラ
インでＲＡＭｌに記録されたＭＩＸ画データをリードし
て、順次ＭＩＸ画データ記録用のＤＲＡＭ２にライトし
ていく。
画データは数〜数十クロック遅れて出カされるので、こ
れをバッファＲＡＭｌに１ライン分記録する。次の第２
ラインで入力された動画のタイミングに合わせてＤＲＡ
Ｍコントロ―ルブロックがＤＲＡＭアドレスを発生する
と、そのアドレスのタイミングに合わせて、前の第１ラ
インでＲＡＭｌに記録されたＭＩＸ画データをリードし
て、順次ＭＩＸ画データ記録用のＤＲＡＭ２にライトし
ていく。
【００１７】第２ラインでＭＩＸされた信号は、もう―
つのバッファＲＡＭ２に記録され、次の第３ラインでＤ
ＲＡＭ２にライトされる。この動作を順次繰り返すこと
で１画面分のＭＩＸ画がＤＲＡＭ２に記録される。但
し、ＤＲＡＭ２は垂直方向で１ライン分ずれた位置にデ
ータを記録することになるので、静止画記録メデイアに
データを記録する際にアドレスを調整して正しい位置か
らデータを読み出す必要がある。
つのバッファＲＡＭ２に記録され、次の第３ラインでＤ
ＲＡＭ２にライトされる。この動作を順次繰り返すこと
で１画面分のＭＩＸ画がＤＲＡＭ２に記録される。但
し、ＤＲＡＭ２は垂直方向で１ライン分ずれた位置にデ
ータを記録することになるので、静止画記録メデイアに
データを記録する際にアドレスを調整して正しい位置か
らデータを読み出す必要がある。
【００１８】図７は、本発明の実施例３の構成を示すブ
ロック図である。第３の実施例は、静止画記録のバッフ
ァとなるＤＲＡＭを１個だけ用意して、ＭＩＸされたデ
ータをＤＲＡＭ上に上書きする方法である。上記したよ
うにＭＩＸ結果を記録する際のアドレスタイミング調整
のためにバッファＲＡＭ３６が必要であるほかに、その
バッファＲＡＭ３６の出カがＤＲＡＭからの入カライン
とつながるため、バッファＲＡＭ出力に３ステートのバ
ッファ３７が必要となる。
ロック図である。第３の実施例は、静止画記録のバッフ
ァとなるＤＲＡＭを１個だけ用意して、ＭＩＸされたデ
ータをＤＲＡＭ上に上書きする方法である。上記したよ
うにＭＩＸ結果を記録する際のアドレスタイミング調整
のためにバッファＲＡＭ３６が必要であるほかに、その
バッファＲＡＭ３６の出カがＤＲＡＭからの入カライン
とつながるため、バッファＲＡＭ出力に３ステートのバ
ッファ３７が必要となる。
【００１９】図８は、第３の実施例の要部の動作タイミ
ングを示すタイミング図である。処理のプロセスは実施
例１あるいは２の方法とほぼ同様であるが、１画素分の
処理時間内で最初にＭＩＸ用の静止画データの読み出し
を行い、後半でＭＩＸされてバッファＲＡＭに収められ
ていたデータの書き込みの両方を行うようになる。図９
は、高速ページモードＲＡＭを使用した場合の第３の実
施例の要部の動作タイミングを示すタイミング図であ
る。ＤＲＡＭに高速ページモードリードモディファイラ
イトサイクル（口ーアドレスを固定してコラムアドレス
のみを変化される高速ページモードで、アドレスを再入
力せずにＷＥ信号のコントロ―ルによりリードとライト
を連続して行うモード）の機能があれば、１画素分の処
理をより高速で実行できるため、比較的アクセススピー
ドの遅いＤＲＡＭでも実現可能となる。
ングを示すタイミング図である。処理のプロセスは実施
例１あるいは２の方法とほぼ同様であるが、１画素分の
処理時間内で最初にＭＩＸ用の静止画データの読み出し
を行い、後半でＭＩＸされてバッファＲＡＭに収められ
ていたデータの書き込みの両方を行うようになる。図９
は、高速ページモードＲＡＭを使用した場合の第３の実
施例の要部の動作タイミングを示すタイミング図であ
る。ＤＲＡＭに高速ページモードリードモディファイラ
イトサイクル（口ーアドレスを固定してコラムアドレス
のみを変化される高速ページモードで、アドレスを再入
力せずにＷＥ信号のコントロ―ルによりリードとライト
を連続して行うモード）の機能があれば、１画素分の処
理をより高速で実行できるため、比較的アクセススピー
ドの遅いＤＲＡＭでも実現可能となる。
【００２０】なお、通常のリードライトサイクルを使用
する場合はリードアドレス、ライトアドレスを別々に設
定できるが、高速ページモードリードモデイファイライ
トサイクルを使用するとリードアドレスとライトサイク
ルが同じ値になるため、実施例２でも述べたように、バ
ッファＲＡＭを介していることにより垂直方向１ライン
分ＤＲＡＭデータがずれることになる。従って、ＭＩＸ
処理が終了した時点でＤＲＡＭのデータを１ラインずつ
読み出して元のアドレスの場所にずらして書き直す必要
がある。この方法では、元の静止画は上書きされて消え
てしまうが、ＤＲＡＭを１つ使うだけで実現できる。
する場合はリードアドレス、ライトアドレスを別々に設
定できるが、高速ページモードリードモデイファイライ
トサイクルを使用するとリードアドレスとライトサイク
ルが同じ値になるため、実施例２でも述べたように、バ
ッファＲＡＭを介していることにより垂直方向１ライン
分ＤＲＡＭデータがずれることになる。従って、ＭＩＸ
処理が終了した時点でＤＲＡＭのデータを１ラインずつ
読み出して元のアドレスの場所にずらして書き直す必要
がある。この方法では、元の静止画は上書きされて消え
てしまうが、ＤＲＡＭを１つ使うだけで実現できる。
【００２１】図１０は、本発明の実施例４の構成を示す
ブロック図である。実施例４は実施例３の方式と似てい
るが、静止画バッファ用のＤＲＡＭ３８として倍の容量
を持つ物を用意しておき、動画とＭＩＸをされたデータ
を元々静止画が記録されていない部分に順次ライトして
いく。本方式では元々の静止画が残されている上に、容
量は大きくなるが、１つのＤＲＡＭで実現可能となる。
ブロック図である。実施例４は実施例３の方式と似てい
るが、静止画バッファ用のＤＲＡＭ３８として倍の容量
を持つ物を用意しておき、動画とＭＩＸをされたデータ
を元々静止画が記録されていない部分に順次ライトして
いく。本方式では元々の静止画が残されている上に、容
量は大きくなるが、１つのＤＲＡＭで実現可能となる。
【００２２】図１１は、第４の実施例の要部の動作タイ
ミングを示すタイミング図である。この実施例の場合も
第３の実施例同様に通常のリードライトサイクルを使用
すれば、リードアドレスとライトアドレスを別々に設定
できるので、ＤＲＡＭデータを書き変える必要はない。
ミングを示すタイミング図である。この実施例の場合も
第３の実施例同様に通常のリードライトサイクルを使用
すれば、リードアドレスとライトアドレスを別々に設定
できるので、ＤＲＡＭデータを書き変える必要はない。
【００２３】以上、本発明の実施例を開示したが、本発
明には下記のような変形例も考えられる。実施例におい
ては、ＤＲＡＭを使用する例を開示したが、本発明を実
施するためには、ＳＲＡＭをはじめとして、任意の静的
あるいは動的記憶手段を利用可能である。なお、実施例
においては、ＩＣカード等の記録メディアを利用する例
を開示したが、記録メディアの利用自体は本発明に必須
の構成要件ではなく、ＤＲＡＭのみでも本発明を実施可
能である。また、ビデオカメラに本発明を適用する例を
開示したが、本発明はＶＴＲやテレビ、ＤＶＤ装置、ミ
キサ装置など画像信号を扱う任意の画像処理装置に適用
可能である。
明には下記のような変形例も考えられる。実施例におい
ては、ＤＲＡＭを使用する例を開示したが、本発明を実
施するためには、ＳＲＡＭをはじめとして、任意の静的
あるいは動的記憶手段を利用可能である。なお、実施例
においては、ＩＣカード等の記録メディアを利用する例
を開示したが、記録メディアの利用自体は本発明に必須
の構成要件ではなく、ＤＲＡＭのみでも本発明を実施可
能である。また、ビデオカメラに本発明を適用する例を
開示したが、本発明はＶＴＲやテレビ、ＤＶＤ装置、ミ
キサ装置など画像信号を扱う任意の画像処理装置に適用
可能である。
【００２４】
【発明の効果】以上述べたように、本発明においては、
例えば静止画記録機能を有するビデオカメラだけでなく
通常のデジタルスチルカメラにおいても、予め保存して
おいた静止画とその時撮影されている画像との各種フィ
ーチャー合成画（ルミキー、クロマキー、オーバーラッ
プ、インポーズ）をキャプチャーすることが可能となる
という効果がある。また、その実現方法に関しても、第
１の方法（２つのＤＲＡＭを用いる方法）では比較的ア
クセススピードの遅いＤＲＡＭでも実現可能となり、第
２の方法（元の静止画上に合成画を上書きする方法）で
はＤＲＡＭの容量、個数を削減できる。また、第３の方
法（合成画をＤＲＡＭの余剰エリアに記録する方法）で
はＤＲＡＭの容量は増えるが、個数を削減できる上に元
の静止画を残せるという効果がある。
例えば静止画記録機能を有するビデオカメラだけでなく
通常のデジタルスチルカメラにおいても、予め保存して
おいた静止画とその時撮影されている画像との各種フィ
ーチャー合成画（ルミキー、クロマキー、オーバーラッ
プ、インポーズ）をキャプチャーすることが可能となる
という効果がある。また、その実現方法に関しても、第
１の方法（２つのＤＲＡＭを用いる方法）では比較的ア
クセススピードの遅いＤＲＡＭでも実現可能となり、第
２の方法（元の静止画上に合成画を上書きする方法）で
はＤＲＡＭの容量、個数を削減できる。また、第３の方
法（合成画をＤＲＡＭの余剰エリアに記録する方法）で
はＤＲＡＭの容量は増えるが、個数を削減できる上に元
の静止画を残せるという効果がある。
【図１】本発明を適用したビデオカメラの要部構成を示
すブロック図である。
すブロック図である。
【図２】本発明の実施例１の構成を示すブロック図であ
る。
る。
【図３】第１の実施例の要部の動作タイミングを示すタ
イミング図である。
イミング図である。
【図４】高速ページモードＲＡＭを使用した場合の第１
の実施例の要部の動作タイミングを示すタイミング図で
ある。
の実施例の要部の動作タイミングを示すタイミング図で
ある。
【図５】本発明の実施例２の構成を示すブロック図であ
る。
る。
【図６】第２の実施例の要部の動作タイミングを示すタ
イミング図である。
イミング図である。
【図７】本発明の実施例３の構成を示すブロック図であ
る。
る。
【図８】第３の実施例の要部の動作タイミングを示すタ
イミング図である。
イミング図である。
【図９】高速ページモードＲＡＭを使用した場合の第３
の実施例の要部の動作タイミングを示すタイミング図で
ある。
の実施例の要部の動作タイミングを示すタイミング図で
ある。
【図１０】本発明の実施例４の構成を示すブロック図で
ある。
ある。
【図１１】第４の実施例の要部の動作タイミングを示す
タイミング図である。
タイミング図である。
【図１２】従来の記録メディアへの静止画記録機能を有
するビデオカメラの構成および画像取り込み時の動作を
示すブロック図である。
するビデオカメラの構成および画像取り込み時の動作を
示すブロック図である。
【図１３】従来のビデオカメラ１０の画像再生時の動作
を示すブロック図である。
を示すブロック図である。
【図１４】従来の静止画記録用回路の構成を示すブロッ
ク図である。
ク図である。
１０…ビデオカメラ、１１…カメラブロック、１２…ラ
イン入力、１３…信号処理ＩＣ、１４…モニター、１５
…ＶＴＲ信号処理ＩＣ、１６…テープ、１７…静止画記
録ブロック、１８…静止画記録インターフェイスＩＣ、
１９…ＤＲＡＭ、２０…JPEG圧縮ＩＣ、２１…記録メデ
ィア、３０…合成回路、３１…ＤＲＡＭコントロールブ
ロック、３２…Ｄラッチ回路
イン入力、１３…信号処理ＩＣ、１４…モニター、１５
…ＶＴＲ信号処理ＩＣ、１６…テープ、１７…静止画記
録ブロック、１８…静止画記録インターフェイスＩＣ、
１９…ＤＲＡＭ、２０…JPEG圧縮ＩＣ、２１…記録メデ
ィア、３０…合成回路、３１…ＤＲＡＭコントロールブ
ロック、３２…Ｄラッチ回路
Claims (6)
- 【請求項１】 静止画記録用の記憶手段から静止画を読
み出す読み出し手段と、 読み出した静止画と他の画像信号とを合成する合成手段
と、 合成結果を静止画記録用の記憶手段へ書き込む書き込み
手段とを備えたことを特徴とする静止画記録装置。 - 【請求項２】 静止画情報を読み出した記憶装置とは別
の記憶装置に合成後の画像信号を書き込むことを特徴と
する請求項１に記載の静止画記録装置。 - 【請求項３】 静止画情報を読み出した記憶装置と同一
の記憶装置に合成後の画像信号を書き込むことを特徴と
する請求項１に記載の静止画記録装置。 - 【請求項４】 合成後の画像信号を１ライン分記憶する
バッファ記憶手段を備え、前記バッファ記憶手段の出力
を静止画記録用の記憶手段に書き込むことを特徴とする
請求項１に記載の静止画記録装置。 - 【請求項５】 静止画記録用のメモリから静止画を読み
出し、他の画像信号と合成して、合成結果を静止画記録
用のメモリへ書き込む静止画記録手段を備えたことを特
徴とする画像処理装置。 - 【請求項６】 静止画記録用の記憶手段から静止画を読
み出す工程と、 読み出した静止画と他の画像信号とを合成する工程と、 合成結果を静止画記録用の記憶手段へ書き込む工程とを
含むことを特徴とする静止画記録方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10093012A JPH11289490A (ja) | 1998-04-06 | 1998-04-06 | 静止画記録装置、画像処理装置および静止画記録方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10093012A JPH11289490A (ja) | 1998-04-06 | 1998-04-06 | 静止画記録装置、画像処理装置および静止画記録方法 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH11289490A true JPH11289490A (ja) | 1999-10-19 |
Family
ID=14070530
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP10093012A Pending JPH11289490A (ja) | 1998-04-06 | 1998-04-06 | 静止画記録装置、画像処理装置および静止画記録方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH11289490A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2003015624A (ja) * | 2001-07-04 | 2003-01-17 | Fujitsu Ltd | オンスクリーンディスプレイ装置 |
-
1998
- 1998-04-06 JP JP10093012A patent/JPH11289490A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2003015624A (ja) * | 2001-07-04 | 2003-01-17 | Fujitsu Ltd | オンスクリーンディスプレイ装置 |
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Legal Events
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|---|---|---|---|
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Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20070228 |
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Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 20080227 |