JPH11327503A - プラズマディスプレイ装置 - Google Patents
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Abstract
(57)【要約】
【課題】 Ｘ、Ｙ電極を奇数番と偶数番で別々の維持放
電信号を印加するＰＤＰにおいて、駆動回路の配線を簡
単にすると共に、ドライバのＩＣ化する。 【解決手段】 インターレース表示で隣接する第１の電
極２と第２の電極３の組に交互に逆相の維持放電信号を
印加するプラズマディスプレイ装置の第２の電極の駆動
回路が、奇数番目の第２の電極に印加する電圧パルスを
出力する第１の駆動回路16と、偶数番目の第２の電極に
印加する電圧パルスを出力する第２の駆動回路17と、こ
れらの電圧パルスと走査信号を第２の電極に選択的に印
加するための第３の回路とを備えるプラズマディスプレ
イ装置において、第３の回路は、奇数番目の第２の電極
に接続される第３奇数回路41と、偶数番目の第２の電極
に接続される第３偶数回路42とに分けられ、それぞれ集
積化されている。
電信号を印加するＰＤＰにおいて、駆動回路の配線を簡
単にすると共に、ドライバのＩＣ化する。 【解決手段】 インターレース表示で隣接する第１の電
極２と第２の電極３の組に交互に逆相の維持放電信号を
印加するプラズマディスプレイ装置の第２の電極の駆動
回路が、奇数番目の第２の電極に印加する電圧パルスを
出力する第１の駆動回路16と、偶数番目の第２の電極に
印加する電圧パルスを出力する第２の駆動回路17と、こ
れらの電圧パルスと走査信号を第２の電極に選択的に印
加するための第３の回路とを備えるプラズマディスプレ
イ装置において、第３の回路は、奇数番目の第２の電極
に接続される第３奇数回路41と、偶数番目の第２の電極
に接続される第３偶数回路42とに分けられ、それぞれ集
積化されている。
Description
【０００１】
【発明の属する技術分野】本発明は、メモリ機能を有す
る表示素子であるセルの集合によって構成された表示パ
ネルを駆動する技術に係わり、特にＡＣ（交流）型プラ
ズマディスプレイパネル（Plasma Display Panel:PDP)
においてインターレース表示を行う装置に関する。
る表示素子であるセルの集合によって構成された表示パ
ネルを駆動する技術に係わり、特にＡＣ（交流）型プラ
ズマディスプレイパネル（Plasma Display Panel:PDP)
においてインターレース表示を行う装置に関する。
【０００２】
【従来の技術】上記のＡＣ型ＰＤＰは、２本の維持電極
に交互に電圧波形を印加することで放電を持続し、発光
表示を行うものである。一度の放電は、パルス印加直後
１μｓから数μｓで終了する。放電によって発生した正
電荷であるイオンは、負の電圧が印加されている電極上
の絶縁層の表面に蓄積され、同様に負電荷である電子
は、正の電圧が印加されている電極上の絶縁層の表面に
蓄積される。
に交互に電圧波形を印加することで放電を持続し、発光
表示を行うものである。一度の放電は、パルス印加直後
１μｓから数μｓで終了する。放電によって発生した正
電荷であるイオンは、負の電圧が印加されている電極上
の絶縁層の表面に蓄積され、同様に負電荷である電子
は、正の電圧が印加されている電極上の絶縁層の表面に
蓄積される。
【０００３】従って、初めに高い電圧（書込み電圧）の
パルス（書込みパルス）で放電させて壁電荷を生成した
後、極性の異なる前回より低い電圧（維持放電電圧）の
パルス（維持放電パルス）を印加すると、前に蓄積され
た壁電荷が重畳され、放電空間に対する電圧は大きくな
り、放電電圧のしきい値を越えて放電を開始する。つま
り、一度書込み放電を行い、壁電荷を生成した表示セル
は、その後、維持放電パルスを交互に逆極性で印加する
ことで、放電を持続するという特徴がある。これをメモ
リ効果、又はメモリ機能と呼んでいる。一般にＡＣ型Ｐ
ＤＰは、このメモリ効果を利用して表示を行うものであ
る。
パルス（書込みパルス）で放電させて壁電荷を生成した
後、極性の異なる前回より低い電圧（維持放電電圧）の
パルス（維持放電パルス）を印加すると、前に蓄積され
た壁電荷が重畳され、放電空間に対する電圧は大きくな
り、放電電圧のしきい値を越えて放電を開始する。つま
り、一度書込み放電を行い、壁電荷を生成した表示セル
は、その後、維持放電パルスを交互に逆極性で印加する
ことで、放電を持続するという特徴がある。これをメモ
リ効果、又はメモリ機能と呼んでいる。一般にＡＣ型Ｐ
ＤＰは、このメモリ効果を利用して表示を行うものであ
る。
【０００４】従来のＡＣ型ＰＤＰでは、維持電極の一方
のＸ電極と他方のＹ電極を交互に配列し、奇数番目のＸ
電極とＹ電極の間及び偶数番目のＸ電極とＹ電極の間で
放電を行わせていた。すなわち、表示セルは、奇数番目
のＸ電極とＹ電極の間と偶数番目のＸ電極とＹ電極の間
に形成され、奇数番目のＹ電極と偶数番目のＸ電極及び
奇数番目のＸ電極と偶数番目のＹ電極の間には形成され
なかった。しかし、これでは高精細化及び高輝度化する
のが難しいなどの問題があった。そこで、本出願人は、
特開平９−１６０５２５号公報で、インターレース走査
において、奇数番目のＹ電極と偶数番目のＸ電極及び奇
数番目のＸ電極と偶数番目のＹ電極の間にも表示セルを
形成することにより高精細化及び高輝度化を図ったＰＤ
Ｐを開示している。本発明は、特開平９−１６０５２５
号公報に開示されたようなＹ電極が両側のＸ電極との間
で放電が行われ、表示セルが形成されるプラズマディス
プレイパネル（ＰＤＰ）に適用される。
のＸ電極と他方のＹ電極を交互に配列し、奇数番目のＸ
電極とＹ電極の間及び偶数番目のＸ電極とＹ電極の間で
放電を行わせていた。すなわち、表示セルは、奇数番目
のＸ電極とＹ電極の間と偶数番目のＸ電極とＹ電極の間
に形成され、奇数番目のＹ電極と偶数番目のＸ電極及び
奇数番目のＸ電極と偶数番目のＹ電極の間には形成され
なかった。しかし、これでは高精細化及び高輝度化する
のが難しいなどの問題があった。そこで、本出願人は、
特開平９−１６０５２５号公報で、インターレース走査
において、奇数番目のＹ電極と偶数番目のＸ電極及び奇
数番目のＸ電極と偶数番目のＹ電極の間にも表示セルを
形成することにより高精細化及び高輝度化を図ったＰＤ
Ｐを開示している。本発明は、特開平９−１６０５２５
号公報に開示されたようなＹ電極が両側のＸ電極との間
で放電が行われ、表示セルが形成されるプラズマディス
プレイパネル（ＰＤＰ）に適用される。
【０００５】図１は、上記の特開平９−１６０５２５号
公報に開示されたＰＤＰの概要を示すブロック図であ
り、図２はそのパネルの断面構造であり、図３は１フレ
ームの構成を示す図であり、図４は１サブフィールドで
各電極に印加される駆動波形を示すタイムチャートであ
る。これらの図を参照して、本発明が適用されるＰＤＰ
について説明する。
公報に開示されたＰＤＰの概要を示すブロック図であ
り、図２はそのパネルの断面構造であり、図３は１フレ
ームの構成を示す図であり、図４は１サブフィールドで
各電極に印加される駆動波形を示すタイムチャートであ
る。これらの図を参照して、本発明が適用されるＰＤＰ
について説明する。
【０００６】図１に示すように、パネル１には、維持放
電電極を構成する第１の電極（Ｘ電極）２−１、２−
２、…、第２の電極（Ｙ電極）３−１、３−２、…及び
アドレス電極４−１、４−２、…が設けられている。図
２に示すように、パネル１は、２枚のガラス基板５、６
によって構成されている。第１の基板６には、Ｘ電極を
構成する透明電極２２−１、…とバス電極２１−１、
…、及びＹ電極を構成する透明電極３２−１、３２−２
…とバス電極３１−１、３１−２、…が平行に交互に配
置されている。基板５が表示面側であり、透明電極は蛍
光体９からの反射光を透過させる目的で使用される。し
かし透明電極だけでは電圧の降下が大きくなるので、電
極抵抗による電圧降下を防ぐ目的でバス電極が設けられ
る。更に、これらの電極を誘電体で被覆し、放電面には
保護膜としてＭｇＯ（酸化マグネシューム）膜を形成す
る。
電電極を構成する第１の電極（Ｘ電極）２−１、２−
２、…、第２の電極（Ｙ電極）３−１、３−２、…及び
アドレス電極４−１、４−２、…が設けられている。図
２に示すように、パネル１は、２枚のガラス基板５、６
によって構成されている。第１の基板６には、Ｘ電極を
構成する透明電極２２−１、…とバス電極２１−１、
…、及びＹ電極を構成する透明電極３２−１、３２−２
…とバス電極３１−１、３１−２、…が平行に交互に配
置されている。基板５が表示面側であり、透明電極は蛍
光体９からの反射光を透過させる目的で使用される。し
かし透明電極だけでは電圧の降下が大きくなるので、電
極抵抗による電圧降下を防ぐ目的でバス電極が設けられ
る。更に、これらの電極を誘電体で被覆し、放電面には
保護膜としてＭｇＯ（酸化マグネシューム）膜を形成す
る。
【０００７】また、ガラス基板５と向き合うガラス基板
６には、アドレス電極４をＸ及びＹ電極と直交する形で
形成する。更に、アドレス電極間には、障壁１０を形成
し、その障壁の間には、アドレス電極を覆う形で赤、
緑、青の発光特性を持つ螢光体９を形成する。障壁１０
の尾根とＭｇＯ膜が密着する形で２枚のガラス基板５、
６が組み立てられる。
６には、アドレス電極４をＸ及びＹ電極と直交する形で
形成する。更に、アドレス電極間には、障壁１０を形成
し、その障壁の間には、アドレス電極を覆う形で赤、
緑、青の発光特性を持つ螢光体９を形成する。障壁１０
の尾根とＭｇＯ膜が密着する形で２枚のガラス基板５、
６が組み立てられる。
【０００８】各電極は、その両側の電極のすきま（つま
り放電スリット）８で放電することができる。Ｙ電極は
アドレス動作時の表示ラインの選択及び維持放電に主と
して利用される。アドレス電極は、選択された表示ライ
ンのＹ電極との間で表示セルの選択を行うためのアドレ
ス放電に主として利用される。Ｘ電極はアドレス動作時
に選択されたＹ電極のどちらの側の放電スリットにアド
レス放電を発生させるかの選択と維持放電に主として利
用される。
り放電スリット）８で放電することができる。Ｙ電極は
アドレス動作時の表示ラインの選択及び維持放電に主と
して利用される。アドレス電極は、選択された表示ライ
ンのＹ電極との間で表示セルの選択を行うためのアドレ
ス放電に主として利用される。Ｘ電極はアドレス動作時
に選択されたＹ電極のどちらの側の放電スリットにアド
レス放電を発生させるかの選択と維持放電に主として利
用される。
【０００９】図１に示すように、アドレス電極４−１、
４−２、…は、１本毎にアドレスドライバ１３に接続さ
れ、そのアドレスドライバ１３によってアドレス放電時
のアドレスパルスが印加される。また、Ｙ電極は、個別
にスキャンドライバ１２に接続される。スキャンドライ
バ１２は、１ビット毎に、奇数Ｙ電極４−１、４−３、
…の駆動用と偶数Ｙ電極４−２、４−４、…の駆動用に
分けられ、奇数Ｙサスティン回路１６と偶数Ｙサスティ
ン回路１７に接続されている。アドレス動作時のパルス
はスキャンドライバ１２の中で発生し、維持放電パルス
などは奇数Ｙサスティン回路１６及び偶数Ｙサスティン
回路１７で発生し、スキャンドライバ１２を経由して各
Ｙ電極に印加される。Ｘ電極２−１、２−２、…は、奇
数Ｘ電極２−１、２−３、…と偶数Ｘ電極２−２、２−
４、…に分けられ、それぞれのグループ毎に奇数Ｘサス
ティン回路１４と偶数Ｘサスティン回路１５に接続され
る。これらのドライバ回路は、制御回路１１によって制
御され、その制御回路は装置の外部より入力される同期
信号や表示データ信号によって制御される。
４−２、…は、１本毎にアドレスドライバ１３に接続さ
れ、そのアドレスドライバ１３によってアドレス放電時
のアドレスパルスが印加される。また、Ｙ電極は、個別
にスキャンドライバ１２に接続される。スキャンドライ
バ１２は、１ビット毎に、奇数Ｙ電極４−１、４−３、
…の駆動用と偶数Ｙ電極４−２、４−４、…の駆動用に
分けられ、奇数Ｙサスティン回路１６と偶数Ｙサスティ
ン回路１７に接続されている。アドレス動作時のパルス
はスキャンドライバ１２の中で発生し、維持放電パルス
などは奇数Ｙサスティン回路１６及び偶数Ｙサスティン
回路１７で発生し、スキャンドライバ１２を経由して各
Ｙ電極に印加される。Ｘ電極２−１、２−２、…は、奇
数Ｘ電極２−１、２−３、…と偶数Ｘ電極２−２、２−
４、…に分けられ、それぞれのグループ毎に奇数Ｘサス
ティン回路１４と偶数Ｘサスティン回路１５に接続され
る。これらのドライバ回路は、制御回路１１によって制
御され、その制御回路は装置の外部より入力される同期
信号や表示データ信号によって制御される。
【００１０】図３に示すように、上記のＰＤＰにおける
１フレームの駆動シーケンスは、奇数フィールドと偶数
フィールドに分割され、奇数フィールドでは奇数行の表
示を、偶数フィールドでは偶数行の表示をそれぞれ行
う。すなわち、奇数フィールドでは、奇数番目のＸ電極
とＹ電極の間と偶数番目のＸ電極とＹ電極の間で放電を
行い、偶数フィールドでは奇数番目のＹ電極と偶数番目
のＸ電極及び奇数番目のＸ電極と偶数番目のＹ電極の間
で放電を行う。更に、各フィールドは、いくつかのサブ
フィールドに分割されている。図３では、８個のサブフ
ィールドＳＦ１、ＳＦ２、…、ＳＦ８に分割した例を示
している。各サブフィールドは、表示セルの初期化を行
うリセット期間と、表示データの書込み（アドレス）を
行うアドレス期間と、アドレスによって壁電荷が形成さ
れたセルのみ繰り返し放電（維持放電）を行い発光する
サスティン期間とで構成される。奇数フィールドでは、
奇数行（ライン）においてのみアドレス放電及び維持放
電が行われ、偶数フィールドでは偶数行においてのみア
ドレス放電及び維持放電が行われる。なお、表示の輝度
は、維持放電期間の長短、つまり維持放電パルスの回数
によって決定される。
１フレームの駆動シーケンスは、奇数フィールドと偶数
フィールドに分割され、奇数フィールドでは奇数行の表
示を、偶数フィールドでは偶数行の表示をそれぞれ行
う。すなわち、奇数フィールドでは、奇数番目のＸ電極
とＹ電極の間と偶数番目のＸ電極とＹ電極の間で放電を
行い、偶数フィールドでは奇数番目のＹ電極と偶数番目
のＸ電極及び奇数番目のＸ電極と偶数番目のＹ電極の間
で放電を行う。更に、各フィールドは、いくつかのサブ
フィールドに分割されている。図３では、８個のサブフ
ィールドＳＦ１、ＳＦ２、…、ＳＦ８に分割した例を示
している。各サブフィールドは、表示セルの初期化を行
うリセット期間と、表示データの書込み（アドレス）を
行うアドレス期間と、アドレスによって壁電荷が形成さ
れたセルのみ繰り返し放電（維持放電）を行い発光する
サスティン期間とで構成される。奇数フィールドでは、
奇数行（ライン）においてのみアドレス放電及び維持放
電が行われ、偶数フィールドでは偶数行においてのみア
ドレス放電及び維持放電が行われる。なお、表示の輝度
は、維持放電期間の長短、つまり維持放電パルスの回数
によって決定される。
【００１１】サブフィールドＳＦ１、ＳＦ２、…、ＳＦ
８においては、リセット期間とアドレス期間はそれぞれ
同一の長さであり、維持放電期間の長さは、１：２：
４：８：１６：３２：６４：１２８の比率になってい
る。点灯させるサブフィールドの組を選択することで、
０から２５５までの２５６段階の輝度の違いを表示でき
る。
８においては、リセット期間とアドレス期間はそれぞれ
同一の長さであり、維持放電期間の長さは、１：２：
４：８：１６：３２：６４：１２８の比率になってい
る。点灯させるサブフィールドの組を選択することで、
０から２５５までの２５６段階の輝度の違いを表示でき
る。
【００１２】図４は、図１に示すプラズマディスプレイ
装置の駆動する波形を示すタイムチャートであり、１サ
ブフィールド期間を示している。この例では、１サブフ
ィールドは、リセット／アドレス期間、更に維持放電期
間（サスティン期間）に分割される。リセット期間にお
いては、まず、すべてのＹ電極が０Ｖレベルにされ、同
時にＸ電極に電圧Ｖｓ＋Ｖｗ（約３００Ｖ）からなる全
面書込みパルスが印加される。このリセット動作は、前
のサブフィールドの点灯状態に係わらず、すべての表示
セルを同じ状態にする作用があり、次のアドレス（書込
み）放電を安定に行うために行われる。
装置の駆動する波形を示すタイムチャートであり、１サ
ブフィールド期間を示している。この例では、１サブフ
ィールドは、リセット／アドレス期間、更に維持放電期
間（サスティン期間）に分割される。リセット期間にお
いては、まず、すべてのＹ電極が０Ｖレベルにされ、同
時にＸ電極に電圧Ｖｓ＋Ｖｗ（約３００Ｖ）からなる全
面書込みパルスが印加される。このリセット動作は、前
のサブフィールドの点灯状態に係わらず、すべての表示
セルを同じ状態にする作用があり、次のアドレス（書込
み）放電を安定に行うために行われる。
【００１３】次に、アドレス期間において、表示データ
に応じた表示セルのオン・オフを行うために、線順次で
アドレス放電が行われる。ここで、従来のＰＤＰではす
べてのＸ電極は同じ電圧が印加されＹ電極に順に走査パ
ルスを印加するが、図１に示したＰＤＰにおける動作は
異なり、アドレス期間は、前半アドレス期間と後半アド
レス期間に分割される。例えば、奇数フィールドの前半
アドレス期間では、１行目、５行目、…の表示セルのア
ドレスが行われ、後半アドレス期間では、３行目、７行
目、…の表示セルのアドレスが行われ、偶数フィールド
の前半アドレス期間では、２行目、６行目、…の表示セ
ルのアドレスが行われ、後半アドレス期間では、４行
目、８行目、…の表示セルのアドレスが行われる。
に応じた表示セルのオン・オフを行うために、線順次で
アドレス放電が行われる。ここで、従来のＰＤＰではす
べてのＸ電極は同じ電圧が印加されＹ電極に順に走査パ
ルスを印加するが、図１に示したＰＤＰにおける動作は
異なり、アドレス期間は、前半アドレス期間と後半アド
レス期間に分割される。例えば、奇数フィールドの前半
アドレス期間では、１行目、５行目、…の表示セルのア
ドレスが行われ、後半アドレス期間では、３行目、７行
目、…の表示セルのアドレスが行われ、偶数フィールド
の前半アドレス期間では、２行目、６行目、…の表示セ
ルのアドレスが行われ、後半アドレス期間では、４行
目、８行目、…の表示セルのアドレスが行われる。
【００１４】まず、奇数フィールドの前半アドレス期間
では、１番目、３番目、…の奇数番目のＸ電極に電圧Ｖ
ｘ（約５０Ｖ）が印加され、２番目、４番目、…の偶数
番目のＸ電極に電圧０Ｖが印加され、１番目、３番目、
…の奇数番目のＹ電極に走査パルス（−ＶＹ：−１５０
Ｖ）を印加する。この時、２番目、４番目、…の偶数番
目のＹ電極には電圧０Ｖが印加される。これと共に、ア
ドレス電極に電圧Ｖａ（約５０Ｖ）のアドレスパルスが
選択的に印加され、点灯させる表示セルのアドレス電極
とＹ電極の間で放電が起きる。次に、この放電をプライ
ミング（種火）として、直ちにＸ電極とＹ電極間の放電
が行われる。Ｘ電極にこの時、奇数番目のＸ電極には電
圧Ｖｘが印加され、偶数番目のＸ電極には０Ｖが印加さ
れており、上記の放電は電圧Ｖｘが印加された側の放電
スリットで行われる。これにより、選択ラインの選択セ
ルのＸ電極とＹ電極上のＭｇＯ膜に維持放電が可能な壁
電荷が蓄積する。以上の動作を最後のＹ電極まで行う
と、１行目、５行目、…の表示セルのアドレスが行われ
ることになる。
では、１番目、３番目、…の奇数番目のＸ電極に電圧Ｖ
ｘ（約５０Ｖ）が印加され、２番目、４番目、…の偶数
番目のＸ電極に電圧０Ｖが印加され、１番目、３番目、
…の奇数番目のＹ電極に走査パルス（−ＶＹ：−１５０
Ｖ）を印加する。この時、２番目、４番目、…の偶数番
目のＹ電極には電圧０Ｖが印加される。これと共に、ア
ドレス電極に電圧Ｖａ（約５０Ｖ）のアドレスパルスが
選択的に印加され、点灯させる表示セルのアドレス電極
とＹ電極の間で放電が起きる。次に、この放電をプライ
ミング（種火）として、直ちにＸ電極とＹ電極間の放電
が行われる。Ｘ電極にこの時、奇数番目のＸ電極には電
圧Ｖｘが印加され、偶数番目のＸ電極には０Ｖが印加さ
れており、上記の放電は電圧Ｖｘが印加された側の放電
スリットで行われる。これにより、選択ラインの選択セ
ルのＸ電極とＹ電極上のＭｇＯ膜に維持放電が可能な壁
電荷が蓄積する。以上の動作を最後のＹ電極まで行う
と、１行目、５行目、…の表示セルのアドレスが行われ
ることになる。
【００１５】次に、奇数フィールドの後半アドレス期間
では、２番目、４番目、…の偶数番目のＸ電極に電圧Ｖ
ｘ（約５０Ｖ）を印加し、１番目、３番目、…の奇数番
目のＸ電極に電圧０Ｖを印加し、２番目、４番目、…の
偶数番目のＹ電極に走査パルス（−ＶＹ：−１５０Ｖ）
を順次印加する。これにより、３行目、７行目、…の表
示セルのアドレスが行われることになる。このようにし
て、奇数フィールドの前半と後半のアドレス期間で、１
行目、３行目、５行目、…の奇数番目の表示セルのアド
レスが終了する。
では、２番目、４番目、…の偶数番目のＸ電極に電圧Ｖ
ｘ（約５０Ｖ）を印加し、１番目、３番目、…の奇数番
目のＸ電極に電圧０Ｖを印加し、２番目、４番目、…の
偶数番目のＹ電極に走査パルス（−ＶＹ：−１５０Ｖ）
を順次印加する。これにより、３行目、７行目、…の表
示セルのアドレスが行われることになる。このようにし
て、奇数フィールドの前半と後半のアドレス期間で、１
行目、３行目、５行目、…の奇数番目の表示セルのアド
レスが終了する。
【００１６】次に維持放電期間になると、Ｙ電極とＸ電
極に交互に電圧Ｖｓ（約１８０Ｖ）からなる維持パルス
が印加されて維持放電が行われ、奇数フィールドの１サ
ブフィールドの画像表示が行われる。この時、奇数番目
のＸ電極とＹ電極間に印加する電圧と偶数番目のＸ電極
とＹ電極間に印加する電圧は逆相であり、奇数番目の放
電スリットを囲む奇数番目のＸ電極とＹ電極間及び偶数
番目のＸ電極とＹ電極間には電位差Ｖｓが発生するが、
偶数番目の放電スリットを囲む奇数番目のＸ電極と偶数
番目のＹ電極間及び偶数番目のＸ電極と奇数番目のＹ電
極間には電位差Ｖｓが発生しないようにしている。従っ
て、維持放電は奇数番目の表示セルでのみ行われる。
極に交互に電圧Ｖｓ（約１８０Ｖ）からなる維持パルス
が印加されて維持放電が行われ、奇数フィールドの１サ
ブフィールドの画像表示が行われる。この時、奇数番目
のＸ電極とＹ電極間に印加する電圧と偶数番目のＸ電極
とＹ電極間に印加する電圧は逆相であり、奇数番目の放
電スリットを囲む奇数番目のＸ電極とＹ電極間及び偶数
番目のＸ電極とＹ電極間には電位差Ｖｓが発生するが、
偶数番目の放電スリットを囲む奇数番目のＸ電極と偶数
番目のＹ電極間及び偶数番目のＸ電極と奇数番目のＹ電
極間には電位差Ｖｓが発生しないようにしている。従っ
て、維持放電は奇数番目の表示セルでのみ行われる。
【００１７】同様に、偶数フィールドでは、偶数番目の
表示セルで画像表示が行われる。以上のようにして、Ｙ
電極とその両側に隣接するＸ電極の間に表示セルが形成
されるため、同じようなパネル構造であっても従来に比
べて高精細な表示を行うことが可能になる。
表示セルで画像表示が行われる。以上のようにして、Ｙ
電極とその両側に隣接するＸ電極の間に表示セルが形成
されるため、同じようなパネル構造であっても従来に比
べて高精細な表示を行うことが可能になる。
【００１８】
【発明が解決しようとする課題】図５は、図１のＰＤＰ
の奇数Ｙサスティン回路１６と偶数Ｙサスティン回路１
７とスキャンドライバ１２の部分の回路構成を示す図で
ある。なお、図示していないが、スキャンドライバ１２
には制御回路１１からの同期信号を受けて走査パルスを
発生する回路が設けられているがここでは省略してあ
る。奇数Ｙサスティン回路１６と偶数Ｙサスティン回路
１７は同じ構成を有し、放電電流のグランドＧＮＤへの
引込み用の信号ＣＤ１とＣＤ２がゲートに印加される電
界効果トランジスタ（ＦＥＴ）（以下、単にトランジス
タと称する。）Ｔｒ１、Ｔｒ６と、放電電流のＶｓ電源
からの供給用の信号ＣＵ１とＣＵ２がゲートに印加され
るトランジスタＴｒ２、Ｔｒ７と、アドレス動作時の選
択電位−ＶＹを与えるための信号ＶＹ１とＶＹ２がゲー
トに印加されるトランジスタＴｒ４、Ｔｒ９と、アドレ
ス動作時の非選択電位−ＶＳＣを与えるための信号ＶＳ
Ｃ１とＶＳＣ２がゲートに印加されるトランジスタＴｒ
５、Ｔｒ１０と、アドレス動作時にトランジスタＴｒ
２、Ｔｒ７を分離するための信号ＡＳ１とＡＳ２がゲー
トに印加されるトランジスタＴｒ３、Ｔｒ８とによって
構成される。
の奇数Ｙサスティン回路１６と偶数Ｙサスティン回路１
７とスキャンドライバ１２の部分の回路構成を示す図で
ある。なお、図示していないが、スキャンドライバ１２
には制御回路１１からの同期信号を受けて走査パルスを
発生する回路が設けられているがここでは省略してあ
る。奇数Ｙサスティン回路１６と偶数Ｙサスティン回路
１７は同じ構成を有し、放電電流のグランドＧＮＤへの
引込み用の信号ＣＤ１とＣＤ２がゲートに印加される電
界効果トランジスタ（ＦＥＴ）（以下、単にトランジス
タと称する。）Ｔｒ１、Ｔｒ６と、放電電流のＶｓ電源
からの供給用の信号ＣＵ１とＣＵ２がゲートに印加され
るトランジスタＴｒ２、Ｔｒ７と、アドレス動作時の選
択電位−ＶＹを与えるための信号ＶＹ１とＶＹ２がゲー
トに印加されるトランジスタＴｒ４、Ｔｒ９と、アドレ
ス動作時の非選択電位−ＶＳＣを与えるための信号ＶＳ
Ｃ１とＶＳＣ２がゲートに印加されるトランジスタＴｒ
５、Ｔｒ１０と、アドレス動作時にトランジスタＴｒ
２、Ｔｒ７を分離するための信号ＡＳ１とＡＳ２がゲー
トに印加されるトランジスタＴｒ３、Ｔｒ８とによって
構成される。
【００１９】一方、スキャンドライバ１２は、各電極毎
に設けられる信号ＳＵ１、ＳＵ２、…がゲートに印加さ
れるトランジスタＴｒ２１−１、Ｔｒ２１−２、…と、
信号ＳＤ１、ＳＤ２、…がゲートに印加されるトランジ
スタＴｒ２１−１、Ｔｒ２１−２、…で構成される、電
極の個数分設けられた個別のドライバ１２−１、１２−
２、…で構成される。これらのドライバ１２−１、１２
−２、…は、奇数及び偶数電極毎に共通に、奇数Ｙサス
ティン回路１６の端子ＤＯＤ１とＤＯＵＴ１及び偶数Ｙ
サスティン回路１７の端子ＤＯＤ２とＤＯＵＴ２に接続
される。
に設けられる信号ＳＵ１、ＳＵ２、…がゲートに印加さ
れるトランジスタＴｒ２１−１、Ｔｒ２１−２、…と、
信号ＳＤ１、ＳＤ２、…がゲートに印加されるトランジ
スタＴｒ２１−１、Ｔｒ２１−２、…で構成される、電
極の個数分設けられた個別のドライバ１２−１、１２−
２、…で構成される。これらのドライバ１２−１、１２
−２、…は、奇数及び偶数電極毎に共通に、奇数Ｙサス
ティン回路１６の端子ＤＯＤ１とＤＯＵＴ１及び偶数Ｙ
サスティン回路１７の端子ＤＯＤ２とＤＯＵＴ２に接続
される。
【００２０】図５の回路の動作を簡単に説明すると、維
持放電パルス（サスティンパルス）は、Ｖｓ電源から、
トランジスタＴｒ２、Ｔｒ３、及びＴｒ２２−１、２２
−２、…を経由してパネルのＹ電極に印加され、放電電
流も同じ経路で流れる。また、パルスを除去する際に
は、Ｙ電極からトランジスタＴｒ２１−１、２１−２、
…のダイオードを通り、ダイオードＤ２とトランジスタ
Ｔｒ１を経由してＧＮＤに流れ込む。この時、Ｘ電極に
Ｖｓパルスが印加され、維持放電電流も同じ経路で流れ
る。
持放電パルス（サスティンパルス）は、Ｖｓ電源から、
トランジスタＴｒ２、Ｔｒ３、及びＴｒ２２−１、２２
−２、…を経由してパネルのＹ電極に印加され、放電電
流も同じ経路で流れる。また、パルスを除去する際に
は、Ｙ電極からトランジスタＴｒ２１−１、２１−２、
…のダイオードを通り、ダイオードＤ２とトランジスタ
Ｔｒ１を経由してＧＮＤに流れ込む。この時、Ｘ電極に
Ｖｓパルスが印加され、維持放電電流も同じ経路で流れ
る。
【００２１】アドレス放電時には、トランジスタＴｒ
１、Ｔｒ２、Ｔｒ２をそれぞれオフにし、トランジスタ
Ｔｒ５とＴｒ４をオンにすることで、スキャンドライバ
１２の一端に選択電位が、他端に非選択電位が与えられ
る。Ｙ電極を選択する場合には、トランジスタＴｒ２２
−１、２２−２、…側をオンにし、非選択とする場合に
はトランジスタＴｒ２１−１、２２−２、…側をオンに
する。
１、Ｔｒ２、Ｔｒ２をそれぞれオフにし、トランジスタ
Ｔｒ５とＴｒ４をオンにすることで、スキャンドライバ
１２の一端に選択電位が、他端に非選択電位が与えられ
る。Ｙ電極を選択する場合には、トランジスタＴｒ２２
−１、２２−２、…側をオンにし、非選択とする場合に
はトランジスタＴｒ２１−１、２２−２、…側をオンに
する。
【００２２】以上、本発明が適用されるＰＤＰのＹ電極
駆動回路について説明したが、走査パルスが印加されな
い点を除けば、Ｘ電極を駆動する回路も同様である。Ｙ
電極を奇数番と偶数番で分けて駆動する必要のない従来
の方式のＰＤＰでは、サスティン回路は１個で、維持放
電信号も一種類であるため、１組の配線を設けるだけで
よく、配線は簡単であった。これに対して、図５で明ら
かなように、本発明が適用されるＰＤＰでは、各Ｙ電極
を直接駆動するためのスキャンドライバ１２の各ドライ
バに１個おきに別なサスティン回路を接続するため、回
路内部における配線が複雑になるという問題が生じた。
すなわち、スキャンドライバ１２の各出力をパネル１の
Ｙ電極に接続し易いように、順番に配置するため、２個
のサスティン回路から供給される維持放電信号が印加さ
れる２組の配線を配置し、各ドライバを対応する配線に
接続する必要がある。これはＸ電極を駆動する回路につ
いても同じである。
駆動回路について説明したが、走査パルスが印加されな
い点を除けば、Ｘ電極を駆動する回路も同様である。Ｙ
電極を奇数番と偶数番で分けて駆動する必要のない従来
の方式のＰＤＰでは、サスティン回路は１個で、維持放
電信号も一種類であるため、１組の配線を設けるだけで
よく、配線は簡単であった。これに対して、図５で明ら
かなように、本発明が適用されるＰＤＰでは、各Ｙ電極
を直接駆動するためのスキャンドライバ１２の各ドライ
バに１個おきに別なサスティン回路を接続するため、回
路内部における配線が複雑になるという問題が生じた。
すなわち、スキャンドライバ１２の各出力をパネル１の
Ｙ電極に接続し易いように、順番に配置するため、２個
のサスティン回路から供給される維持放電信号が印加さ
れる２組の配線を配置し、各ドライバを対応する配線に
接続する必要がある。これはＸ電極を駆動する回路につ
いても同じである。
【００２３】従来のＰＤＰでは、小型化や製造コストの
低減のために、スキャンドライバ１２を１個又は数個の
チップにＩＣ化することが行われている。スキャンドラ
イバ１２には上記のように走査パルスを発生する回路が
設けられており、ＩＣ化しない場合、図５のドライバ１
２−１、１２−２、…に加えてこの回路をディスクリー
ト（個別）部品で構成する必要があり、回路規模やコス
トなどの面で問題がある。そのため、本発明が適用され
るＰＤＰについても、小型化や製造コストの低減のため
にスキャンドライバ１２をＩＣ化することが望ましい。
しかし、ＩＣ化する上で問題のあることが分かった。
低減のために、スキャンドライバ１２を１個又は数個の
チップにＩＣ化することが行われている。スキャンドラ
イバ１２には上記のように走査パルスを発生する回路が
設けられており、ＩＣ化しない場合、図５のドライバ１
２−１、１２−２、…に加えてこの回路をディスクリー
ト（個別）部品で構成する必要があり、回路規模やコス
トなどの面で問題がある。そのため、本発明が適用され
るＰＤＰについても、小型化や製造コストの低減のため
にスキャンドライバ１２をＩＣ化することが望ましい。
しかし、ＩＣ化する上で問題のあることが分かった。
【００２４】図５のスキャンドライバ１２のドライバ１
２−１、１２−２、…をＩＣ化する場合、パネル１との
接続を考慮してドライバ１２−１、１２−２、…をこの
順で配置することになる。チップには２個のサスティン
回路１６、１７から供給される維持放電信号を受けるた
めの４個の端子を設け、各ドライバに維持放電信号を供
給するための２組の配線をチップ内に並行して設けるこ
とになる。チップ内であるので、２組の配線はある程度
近接して配置せざるを得ない。しかし、上記のように、
維持放電信号は約１８０Ｖであり、２組の配線に印加さ
れる信号は逆相であるため、２組の配線間には約１８０
Ｖがそのまま印加されることになる。従って、２組の配
線をチップ内に近接して配置するのは非常に難しく、Ｉ
Ｃ化できないという問題が生じた。また、たとえＩＣ化
しても、チップを大きくせざるを得ず、その分コストが
増加し、チップが大きくなるという問題がある。なお、
維持放電信号が印加される配線が１組であれば、配線間
の電位差はドライバ１２−１、１２−２、…におけるト
ランジスタＴｒ２１−１、Ｔｒ２１−２、…とＴｒ２２
−１、Ｔｒ２２−２、…による電圧降下分であり、十分
に小さい。
２−１、１２−２、…をＩＣ化する場合、パネル１との
接続を考慮してドライバ１２−１、１２−２、…をこの
順で配置することになる。チップには２個のサスティン
回路１６、１７から供給される維持放電信号を受けるた
めの４個の端子を設け、各ドライバに維持放電信号を供
給するための２組の配線をチップ内に並行して設けるこ
とになる。チップ内であるので、２組の配線はある程度
近接して配置せざるを得ない。しかし、上記のように、
維持放電信号は約１８０Ｖであり、２組の配線に印加さ
れる信号は逆相であるため、２組の配線間には約１８０
Ｖがそのまま印加されることになる。従って、２組の配
線をチップ内に近接して配置するのは非常に難しく、Ｉ
Ｃ化できないという問題が生じた。また、たとえＩＣ化
しても、チップを大きくせざるを得ず、その分コストが
増加し、チップが大きくなるという問題がある。なお、
維持放電信号が印加される配線が１組であれば、配線間
の電位差はドライバ１２−１、１２−２、…におけるト
ランジスタＴｒ２１−１、Ｔｒ２１−２、…とＴｒ２２
−１、Ｔｒ２２−２、…による電圧降下分であり、十分
に小さい。
【００２５】以上のような問題があるため、本発明が適
用されるＰＤＰでは、Ｘ電極とＹ電極の駆動回路におけ
る配線が複雑で、スキャンドライバをＩＣ化するのが難
しいという問題があった。本発明は、このような問題を
解決するためのもので、Ｘ電極とＹ電極を奇数番と偶数
番で別々の維持放電信号を印加するＰＤＰにおいて、Ｘ
電極とＹ電極の駆動回路における配線を簡単にすると共
に、スキャンドライバのＩＣ化を可能にすることを目的
とする。
用されるＰＤＰでは、Ｘ電極とＹ電極の駆動回路におけ
る配線が複雑で、スキャンドライバをＩＣ化するのが難
しいという問題があった。本発明は、このような問題を
解決するためのもので、Ｘ電極とＹ電極を奇数番と偶数
番で別々の維持放電信号を印加するＰＤＰにおいて、Ｘ
電極とＹ電極の駆動回路における配線を簡単にすると共
に、スキャンドライバのＩＣ化を可能にすることを目的
とする。
【００２６】
【課題を解決するための手段】上記目的を実現するた
め、本発明のプラズマディスプレイ装置は、スキャンド
ライバを奇数番目のＹ電極に接続される回路と、偶数番
目のＹ電極に接続される回路に分割する。これにより、
チップ内では１種類の維持放電信号が存在するだけなの
で、耐圧の問題は生ぜず、ＩＣ化が可能となる。また、
Ｙ電極の駆動回路と同様に、Ｘ電極についても奇数番目
のＸ電極に接続される回路と、偶数番目のＸ電極に接続
される回路に分割する。
め、本発明のプラズマディスプレイ装置は、スキャンド
ライバを奇数番目のＹ電極に接続される回路と、偶数番
目のＹ電極に接続される回路に分割する。これにより、
チップ内では１種類の維持放電信号が存在するだけなの
で、耐圧の問題は生ぜず、ＩＣ化が可能となる。また、
Ｙ電極の駆動回路と同様に、Ｘ電極についても奇数番目
のＸ電極に接続される回路と、偶数番目のＸ電極に接続
される回路に分割する。
【００２７】すなわち、本発明のプラズマディスプレイ
装置は、平行に配置された第１及び第２の電極と、第１
及び第２の電極に対して直交する形で配置された第３の
電極とを有する表示パネルを備え、第２と第３の電極に
印加する走査信号とアドレス信号により放電セルの選択
を行い、第１と第２の電極に維持放電信号を印加して選
択したセルで維持放電を行わせるプラズマディスプレイ
装置であって、隣接する第１の電極及び第２の電極の組
に交互に逆相の維持放電信号を印加することにより、第
２の電極と第１の電極の中の奇数番目の電極で第１の表
示セルが形成され、第２の電極と前記第１の電極の中の
偶数番目の電極で第２の表示セルが形成され、第１の表
示セルと第２の表示セルで発光表示を交互に繰り返すイ
ンターレース表示が行われ、プラズマディスプレイ装置
の第２の電極の駆動回路は、第２の電極の中の奇数番目
の電極に共通に印加する電圧パルスを出力する第１の駆
動回路と、第２の電極の中の偶数番目の電極に共通に印
加する電圧パルスを出力する第２の駆動回路と、第２の
電極毎に設けられ、第１の駆動回路と第２の駆動回路の
出力する電圧パルスを第２の電極に印加すると共に、走
査信号を第２の電極に選択的に印加するための第３の回
路とを備えるプラズマディスプレイ装置において、第３
の回路は、第２の電極の中の奇数番目の電極に接続され
る第３奇数回路と、第２の電極の中の偶数番目の電極に
接続される第３偶数回路とに分けられており、第３奇数
回路を少なくとも１個のチップに集積化し、第３偶数回
路を少なくとも１個のチップに集積化することを特徴と
する。
装置は、平行に配置された第１及び第２の電極と、第１
及び第２の電極に対して直交する形で配置された第３の
電極とを有する表示パネルを備え、第２と第３の電極に
印加する走査信号とアドレス信号により放電セルの選択
を行い、第１と第２の電極に維持放電信号を印加して選
択したセルで維持放電を行わせるプラズマディスプレイ
装置であって、隣接する第１の電極及び第２の電極の組
に交互に逆相の維持放電信号を印加することにより、第
２の電極と第１の電極の中の奇数番目の電極で第１の表
示セルが形成され、第２の電極と前記第１の電極の中の
偶数番目の電極で第２の表示セルが形成され、第１の表
示セルと第２の表示セルで発光表示を交互に繰り返すイ
ンターレース表示が行われ、プラズマディスプレイ装置
の第２の電極の駆動回路は、第２の電極の中の奇数番目
の電極に共通に印加する電圧パルスを出力する第１の駆
動回路と、第２の電極の中の偶数番目の電極に共通に印
加する電圧パルスを出力する第２の駆動回路と、第２の
電極毎に設けられ、第１の駆動回路と第２の駆動回路の
出力する電圧パルスを第２の電極に印加すると共に、走
査信号を第２の電極に選択的に印加するための第３の回
路とを備えるプラズマディスプレイ装置において、第３
の回路は、第２の電極の中の奇数番目の電極に接続され
る第３奇数回路と、第２の電極の中の偶数番目の電極に
接続される第３偶数回路とに分けられており、第３奇数
回路を少なくとも１個のチップに集積化し、第３偶数回
路を少なくとも１個のチップに集積化することを特徴と
する。
【００２８】本発明のプラズマディスプレイ装置では、
第２の電極（Ｙ電極）を駆動する駆動回路が、奇数番目
のＹ電極に接続される回路と、偶数番目のＹ電極に接続
される回路に分割されているため、配線の自由度が向上
し、ＩＣ化する場合にも、第３奇数回路と第３偶数回路
をＩＣ化すれば、チップ内では１種類の維持放電信号が
存在するだけなので、耐圧の問題は生じない。
第２の電極（Ｙ電極）を駆動する駆動回路が、奇数番目
のＹ電極に接続される回路と、偶数番目のＹ電極に接続
される回路に分割されているため、配線の自由度が向上
し、ＩＣ化する場合にも、第３奇数回路と第３偶数回路
をＩＣ化すれば、チップ内では１種類の維持放電信号が
存在するだけなので、耐圧の問題は生じない。
【００２９】これらの回路を配置する場合には、第１の
回路の近傍に第３奇数回路のチップを配置し、第２の回
路の近傍に第３偶数回路のチップを配置することが望ま
しい。第３奇数回路と第３偶数回路のチップの出力順を
パネルのＹ電極の配置順に合わせるには、回路基板上の
配線パターンやケーブルなどの配置変換手段を設ける。
回路の近傍に第３奇数回路のチップを配置し、第２の回
路の近傍に第３偶数回路のチップを配置することが望ま
しい。第３奇数回路と第３偶数回路のチップの出力順を
パネルのＹ電極の配置順に合わせるには、回路基板上の
配線パターンやケーブルなどの配置変換手段を設ける。
【００３０】第１の回路及び第２の回路はそれぞれ複数
個設ける場合には、交互に配置することが望ましい。更
に、第３奇数回路及び第３偶数回路が、それぞれ複数の
チップで構成される場合には、第１の回路と第２の回路
に対応して交互に配置することが望ましい。走査時に使
用される選択電圧と非選択電圧は、第１の回路及び第２
の回路で共通に使用されるので、第４の回路を設けて供
給してもよい。
個設ける場合には、交互に配置することが望ましい。更
に、第３奇数回路及び第３偶数回路が、それぞれ複数の
チップで構成される場合には、第１の回路と第２の回路
に対応して交互に配置することが望ましい。走査時に使
用される選択電圧と非選択電圧は、第１の回路及び第２
の回路で共通に使用されるので、第４の回路を設けて供
給してもよい。
【００３１】第１の回路と第３奇数回路との間及び第２
の回路と第３偶数回路との間には、少なくとも電流供給
用配線と電流引込み用配線とを設ける。第４の回路は、
選択電圧を与える第１のスイッチング素子と、第１のス
イッチング素子に接続された第１と第２のダイオード
と、非選択電圧を与える第２のスイッチング素子と、第
２のスイッチング素子に接続された第３と第４のダイオ
ードとを有し、第１のダイオードを第３奇数回路の一端
に接続し、第３のダイオードを第３奇数回路の他端に接
続し、第２のダイオードを第３偶数回路の一端に接続
し、第４のダイオードを第３偶数回路の他端に接続す
る。
の回路と第３偶数回路との間には、少なくとも電流供給
用配線と電流引込み用配線とを設ける。第４の回路は、
選択電圧を与える第１のスイッチング素子と、第１のス
イッチング素子に接続された第１と第２のダイオード
と、非選択電圧を与える第２のスイッチング素子と、第
２のスイッチング素子に接続された第３と第４のダイオ
ードとを有し、第１のダイオードを第３奇数回路の一端
に接続し、第３のダイオードを第３奇数回路の他端に接
続し、第２のダイオードを第３偶数回路の一端に接続
し、第４のダイオードを第３偶数回路の他端に接続す
る。
【００３２】第１及び第２の回路は、少なくとも維持放
電電圧を供給するスイッチング素子と、走査信号の印加
時に第２の電極に選択的に印加する電圧を供給するスイ
ッチング素子を備える。基板の一方の面に第１の回路と
第３奇数回路のチップを配置し、他方の面に第２の回路
と第３偶数回路のチップを配置すると、配線が簡単にな
る。また、第３奇数回路のチップを基板の一方の面に配
置し、第３偶数回路のチップを他方の面に配置し、第１
及び第２の回路は一方の面又は他方の面のいずれかに配
置するようにしてもよい。
電電圧を供給するスイッチング素子と、走査信号の印加
時に第２の電極に選択的に印加する電圧を供給するスイ
ッチング素子を備える。基板の一方の面に第１の回路と
第３奇数回路のチップを配置し、他方の面に第２の回路
と第３偶数回路のチップを配置すると、配線が簡単にな
る。また、第３奇数回路のチップを基板の一方の面に配
置し、第３偶数回路のチップを他方の面に配置し、第１
及び第２の回路は一方の面又は他方の面のいずれかに配
置するようにしてもよい。
【００３３】第３奇数回路のチップと第３偶数回路のチ
ップの走査信号を順次出力する出力端子は、一方の面か
ら見て同じ方向に走査信号が順次出力されるように配置
して、パネルのＹ電極の配置と合うようにすることが望
ましい。また、本発明の別の態様のプラズマディスプレ
イ装置は、平行に配置された第１及び第２の電極と、第
１及び第２の電極に対して直交する形で配置された第３
の電極とを有する表示パネルを備え、第２と第３の電極
に印加する走査信号とアドレス信号により放電セルの選
択を行い、第１と第２の電極に維持放電信号を印加して
選択したセルで維持放電を行わせるプラズマディスプレ
イ装置であって、隣接する第１の電極及び隣接する第２
の電極に交互に逆相の維持放電信号を印加することによ
り、第２の電極と第１の電極の中の奇数番目の電極で第
１の表示セルが形成され、第２の電極と前記第１の電極
の中の偶数番目の電極で第２の表示セルが形成され、第
１の表示セルと第２の表示セルで発光表示を交互に繰り
返すインターレース表示が行われるプラズマディスプレ
イ装置において、プラズマディスプレイ装置の第１の電
極の駆動回路は、第１の電極の中の奇数番目の電極に共
通に印加する電圧パルスを出力する第５の駆動回路と、
第１の電極の中の偶数番目の電極に共通に印加する電圧
パルスを出力する第６の駆動回路とを備え、第５の回路
及び第６の回路をそれぞれ複数個設け、交互に配置する
ことを特徴とする。
ップの走査信号を順次出力する出力端子は、一方の面か
ら見て同じ方向に走査信号が順次出力されるように配置
して、パネルのＹ電極の配置と合うようにすることが望
ましい。また、本発明の別の態様のプラズマディスプレ
イ装置は、平行に配置された第１及び第２の電極と、第
１及び第２の電極に対して直交する形で配置された第３
の電極とを有する表示パネルを備え、第２と第３の電極
に印加する走査信号とアドレス信号により放電セルの選
択を行い、第１と第２の電極に維持放電信号を印加して
選択したセルで維持放電を行わせるプラズマディスプレ
イ装置であって、隣接する第１の電極及び隣接する第２
の電極に交互に逆相の維持放電信号を印加することによ
り、第２の電極と第１の電極の中の奇数番目の電極で第
１の表示セルが形成され、第２の電極と前記第１の電極
の中の偶数番目の電極で第２の表示セルが形成され、第
１の表示セルと第２の表示セルで発光表示を交互に繰り
返すインターレース表示が行われるプラズマディスプレ
イ装置において、プラズマディスプレイ装置の第１の電
極の駆動回路は、第１の電極の中の奇数番目の電極に共
通に印加する電圧パルスを出力する第５の駆動回路と、
第１の電極の中の偶数番目の電極に共通に印加する電圧
パルスを出力する第６の駆動回路とを備え、第５の回路
及び第６の回路をそれぞれ複数個設け、交互に配置する
ことを特徴とする。
【００３４】第５及び第６の回路は、少なくとも維持放
電電圧を供給するスイッチング素子と、走査信号の印加
時に第１の電極に選択的に印加する電圧を供給するスイ
ッチング素子を備える。基板の一方の面に第５の回路を
配置し、他方の面に第６の回路を配置すると、配線が簡
単になる。
電電圧を供給するスイッチング素子と、走査信号の印加
時に第１の電極に選択的に印加する電圧を供給するスイ
ッチング素子を備える。基板の一方の面に第５の回路を
配置し、他方の面に第６の回路を配置すると、配線が簡
単になる。
【００３５】
【発明の実施の形態】図６は、本発明の第１実施例のＰ
ＤＰの奇数Ｙサスティン回路１６と偶数Ｙサスティン回
路１７とスキャンドライバの部分の回路構成を示す図で
ある。奇数Ｙサスティン回路１６と偶数Ｙサスティン回
路１７は、図５の従来例と同じ構成である。スキャンド
ライバ４１は、奇数番目のＹ電極に接続されるドライバ
１２−１、１２−３、…を集積した多出力のＬＳＩであ
り、スキャンドライバ４２は、偶数番目のＹ電極に接続
されるドライバ１２−２、１２−４、…を集積した多出
力のＬＳＩである。各スキャンドライバからの出力は、
パネル１のＹ電極に接続する際に交互に引き出されて接
続される。実際には、配列を変換するための回路基板４
３が設けられている。回路基板４３には、スキャンドラ
イバ４１と４２に接続されるコネクタとパネル１に接続
されるコネクタがあり、内部で配線の順序を入れ換え
る。また、回路基板４３の替わりにケーブルを使用して
もよい。
ＤＰの奇数Ｙサスティン回路１６と偶数Ｙサスティン回
路１７とスキャンドライバの部分の回路構成を示す図で
ある。奇数Ｙサスティン回路１６と偶数Ｙサスティン回
路１７は、図５の従来例と同じ構成である。スキャンド
ライバ４１は、奇数番目のＹ電極に接続されるドライバ
１２−１、１２−３、…を集積した多出力のＬＳＩであ
り、スキャンドライバ４２は、偶数番目のＹ電極に接続
されるドライバ１２−２、１２−４、…を集積した多出
力のＬＳＩである。各スキャンドライバからの出力は、
パネル１のＹ電極に接続する際に交互に引き出されて接
続される。実際には、配列を変換するための回路基板４
３が設けられている。回路基板４３には、スキャンドラ
イバ４１と４２に接続されるコネクタとパネル１に接続
されるコネクタがあり、内部で配線の順序を入れ換え
る。また、回路基板４３の替わりにケーブルを使用して
もよい。
【００３６】図７は、本発明の第２実施例のＰＤＰの奇
数Ｙサスティン回路と偶数Ｙサスティン回路とスキャン
ドライバの部分の回路構成を示す図である。奇数Ｙサス
ティン回路１６と偶数Ｙサスティン回路１７は、第１実
施例と同じ構成である。第１実施例のスキャンドライバ
４１と４２は、それぞれ２個のスキャンドライバＡ４１
−１とスキャンドライバＣ４１−２及びスキャンドライ
バＢ４２−１とスキャンドライバＤ４２−２で構成され
る。スキャンドライバＡ４１−１が上位の奇数番目のＹ
電極に接続され、スキャンドライバＣ４１−２が下位の
奇数番目のＹ電極に接続され、スキャンドライバＢ４２
−１が上位の偶数番目のＹ電極に接続され、スキャンド
ライバＤ４２−２が下位の偶数番目のＹ電極に接続され
る。図示のように、奇数Ｙサスティン回路１６、偶数Ｙ
サスティン回路１７、スキャンドライバＡ４１−１、ス
キャンドライバＣ４１−２、スキャンドライバＢ４２−
１及びスキャンドライバＤ４２−２は、Ｙ電極駆動回路
基板５１に実装される。また、Ｙ電極駆動回路基板５１
からの出力は、Ｙ電極の配列順であり、各スキャンドラ
イバからの出力をこの配列順になるように変換する部分
が設けられている。スキャンドライバＡ４１−１とスキ
ャンドライバＣ４１−２は奇数Ｙサスティン回路１６に
近くに、スキャンドライバＢ４２−１とスキャンドライ
バＤ４２−２は偶数Ｙサスティン回路１７の近くに配置
される。
数Ｙサスティン回路と偶数Ｙサスティン回路とスキャン
ドライバの部分の回路構成を示す図である。奇数Ｙサス
ティン回路１６と偶数Ｙサスティン回路１７は、第１実
施例と同じ構成である。第１実施例のスキャンドライバ
４１と４２は、それぞれ２個のスキャンドライバＡ４１
−１とスキャンドライバＣ４１−２及びスキャンドライ
バＢ４２−１とスキャンドライバＤ４２−２で構成され
る。スキャンドライバＡ４１−１が上位の奇数番目のＹ
電極に接続され、スキャンドライバＣ４１−２が下位の
奇数番目のＹ電極に接続され、スキャンドライバＢ４２
−１が上位の偶数番目のＹ電極に接続され、スキャンド
ライバＤ４２−２が下位の偶数番目のＹ電極に接続され
る。図示のように、奇数Ｙサスティン回路１６、偶数Ｙ
サスティン回路１７、スキャンドライバＡ４１−１、ス
キャンドライバＣ４１−２、スキャンドライバＢ４２−
１及びスキャンドライバＤ４２−２は、Ｙ電極駆動回路
基板５１に実装される。また、Ｙ電極駆動回路基板５１
からの出力は、Ｙ電極の配列順であり、各スキャンドラ
イバからの出力をこの配列順になるように変換する部分
が設けられている。スキャンドライバＡ４１−１とスキ
ャンドライバＣ４１−２は奇数Ｙサスティン回路１６に
近くに、スキャンドライバＢ４２−１とスキャンドライ
バＤ４２−２は偶数Ｙサスティン回路１７の近くに配置
される。
【００３７】図８は、本発明の第３実施例のＰＤＰの奇
数Ｙサスティン回路と偶数Ｙサスティン回路とスキャン
ドライバの部分の回路構成を示す図である。第３実施例
の構成は、奇数Ｙサスティン回路１６と偶数Ｙサスティ
ン回路１７が、それぞれ２個の奇数Ｙサスティン回路Ａ
１６−１と奇数Ｙサスティン回路Ｂ１６−２及び偶数Ｙ
サスティン回路Ａ１７−１と偶数Ｙサスティン回路Ｂ１
７−２で構成されている点を除けば、第２実施例の構成
と同じである。スキャンドライバＡ４１−１、スキャン
ドライバＣ４１−２、スキャンドライバＢ４２−１及び
スキャンドライバＤ４２−２は、それぞれ奇数Ｙサステ
ィン回路Ａ１６−１、偶数Ｙサスティン回路Ａ１７−
１、奇数Ｙサスティン回路Ｂ１６−２及び偶数Ｙサステ
ィン回路Ｂ１７−２の近くに配置される。第３実施例
は、第１及び２実施例に比べて、スキャンドライバの出
力からＹ電極までの配線を短くできるため、配線のイン
ピーダンス（抵抗成分、容量成分、誘導成分）が低くな
り、電圧低下が低減されるという利点がある。
数Ｙサスティン回路と偶数Ｙサスティン回路とスキャン
ドライバの部分の回路構成を示す図である。第３実施例
の構成は、奇数Ｙサスティン回路１６と偶数Ｙサスティ
ン回路１７が、それぞれ２個の奇数Ｙサスティン回路Ａ
１６−１と奇数Ｙサスティン回路Ｂ１６−２及び偶数Ｙ
サスティン回路Ａ１７−１と偶数Ｙサスティン回路Ｂ１
７−２で構成されている点を除けば、第２実施例の構成
と同じである。スキャンドライバＡ４１−１、スキャン
ドライバＣ４１−２、スキャンドライバＢ４２−１及び
スキャンドライバＤ４２−２は、それぞれ奇数Ｙサステ
ィン回路Ａ１６−１、偶数Ｙサスティン回路Ａ１７−
１、奇数Ｙサスティン回路Ｂ１６−２及び偶数Ｙサステ
ィン回路Ｂ１７−２の近くに配置される。第３実施例
は、第１及び２実施例に比べて、スキャンドライバの出
力からＹ電極までの配線を短くできるため、配線のイン
ピーダンス（抵抗成分、容量成分、誘導成分）が低くな
り、電圧低下が低減されるという利点がある。
【００３８】図９は、本発明の第４実施例のＰＤＰの奇
数Ｙサスティン回路と偶数Ｙサスティン回路とスキャン
ドライバの部分の回路構成を示す図である。第４実施例
の構成は、スキャン電圧生成部６１が設けられている点
を除けば、第２実施例の構成と同じである。図４に示し
たように、Ｙ電極の駆動波形は、維持放電期間では位相
が異なった波形であるが、アドレス期間は、両電極とも
非選択時には−Ｖｓｃが、選択時には−ＶＹが印加され
る。よって、アドレス期間に必要な電位を供給する回路
は共通にすることができる。そこで、第４実施例では、
スキャン電圧生成部６１を設けて、アドレス期間では、
ここで発生した電圧を各スキャンドライバに供給する。
数Ｙサスティン回路と偶数Ｙサスティン回路とスキャン
ドライバの部分の回路構成を示す図である。第４実施例
の構成は、スキャン電圧生成部６１が設けられている点
を除けば、第２実施例の構成と同じである。図４に示し
たように、Ｙ電極の駆動波形は、維持放電期間では位相
が異なった波形であるが、アドレス期間は、両電極とも
非選択時には−Ｖｓｃが、選択時には−ＶＹが印加され
る。よって、アドレス期間に必要な電位を供給する回路
は共通にすることができる。そこで、第４実施例では、
スキャン電圧生成部６１を設けて、アドレス期間では、
ここで発生した電圧を各スキャンドライバに供給する。
【００３９】図１０は、第４実施例のスキャン電圧生成
部６１と奇数Ｙサスティン回路１６と偶数Ｙサスティン
回路１７の部分の回路構成を示す図である。スキャン電
圧生成部６１は、アドレス動作時の選択電位−ＶＹを与
えるための信号ＶＹがゲートに印加されるトランジスタ
Ｔｒ１０と、アドレス動作時の非選択電位−ＶＳＣを与
えるための信号ＶＳＣがゲートに印加されるトランジス
タＴｒ１１と、ダイオードＤ９〜Ｄ１４が設けられてい
る。また、奇数Ｙサスティン回路１６と偶数Ｙサスティ
ン回路１７から、トランジスタＴｒ４、Ｔｒ５、Ｔｒ
９、Ｔｒ１０、ダイオードＤ３、Ｄ７が除かれている。
これにより、トランジスタを２個減らすことができる。
部６１と奇数Ｙサスティン回路１６と偶数Ｙサスティン
回路１７の部分の回路構成を示す図である。スキャン電
圧生成部６１は、アドレス動作時の選択電位−ＶＹを与
えるための信号ＶＹがゲートに印加されるトランジスタ
Ｔｒ１０と、アドレス動作時の非選択電位−ＶＳＣを与
えるための信号ＶＳＣがゲートに印加されるトランジス
タＴｒ１１と、ダイオードＤ９〜Ｄ１４が設けられてい
る。また、奇数Ｙサスティン回路１６と偶数Ｙサスティ
ン回路１７から、トランジスタＴｒ４、Ｔｒ５、Ｔｒ
９、Ｔｒ１０、ダイオードＤ３、Ｄ７が除かれている。
これにより、トランジスタを２個減らすことができる。
【００４０】第１実施例から第４実施例では、Ｙ電極の
駆動回路についての実施例を説明したが、次にＸ電極の
駆動回路の実施例を説明する。奇数番目と偶数番目のＸ
電極を別々に駆動しない従来のＰＤＰでは、Ｘ電極はパ
ネル１内で共通に接続されていた。従って、接続端子は
１個であり、Ｘ電極駆動回路の出力を単に接続するだけ
でよかった。しかし、本発明を適用するＰＤＰでは、奇
数番目と偶数番目のＸ電極に別々の駆動信号を印加する
必要がある。
駆動回路についての実施例を説明したが、次にＸ電極の
駆動回路の実施例を説明する。奇数番目と偶数番目のＸ
電極を別々に駆動しない従来のＰＤＰでは、Ｘ電極はパ
ネル１内で共通に接続されていた。従って、接続端子は
１個であり、Ｘ電極駆動回路の出力を単に接続するだけ
でよかった。しかし、本発明を適用するＰＤＰでは、奇
数番目と偶数番目のＸ電極に別々の駆動信号を印加する
必要がある。
【００４１】図１１は、従来のＸ電極駆動回路を実装し
たＸ側駆動回路基板７１の構成を示す図である。この従
来例では、パネル１には、Ｘ電極にそれぞれ接続される
接続端子がその順番で設けられている。従って、Ｘ側駆
動回路基板７１の出力もこれに対応した接続端子を有
し、奇数Ｘサスティン回路１４と偶数Ｘサスティン回路
１５からの出力が交互に接続されている。
たＸ側駆動回路基板７１の構成を示す図である。この従
来例では、パネル１には、Ｘ電極にそれぞれ接続される
接続端子がその順番で設けられている。従って、Ｘ側駆
動回路基板７１の出力もこれに対応した接続端子を有
し、奇数Ｘサスティン回路１４と偶数Ｘサスティン回路
１５からの出力が交互に接続されている。
【００４２】図１２は、奇数Ｘサスティン回路１４の構
成を示す図である。偶数Ｘサスティン回路１５も同じ構
成を有する。サスティンパルスはＶｓ電源から、ダイオ
ードＤ２１とトランジスタＴｒ３３を経由してパネル１
のＸ電極に印加され、放電電流も同じ経路で流れる。ま
た、パルスを除去する際には、Ｙ電極からトランジスタ
Ｔｒ１を通りＧＮＤに流れ込む。リセット時の書込み電
圧は、トランジスタＴｒ３１をオンにすることで、容量
Ｃに充電されたＶｓ電圧と、Ｖｗ電圧が重畳されて、ト
ランジスタＴｒ２を経由してＸ電極に印加される。
成を示す図である。偶数Ｘサスティン回路１５も同じ構
成を有する。サスティンパルスはＶｓ電源から、ダイオ
ードＤ２１とトランジスタＴｒ３３を経由してパネル１
のＸ電極に印加され、放電電流も同じ経路で流れる。ま
た、パルスを除去する際には、Ｙ電極からトランジスタ
Ｔｒ１を通りＧＮＤに流れ込む。リセット時の書込み電
圧は、トランジスタＴｒ３１をオンにすることで、容量
Ｃに充電されたＶｓ電圧と、Ｖｗ電圧が重畳されて、ト
ランジスタＴｒ２を経由してＸ電極に印加される。
【００４３】ここで、図１１に示すような構成では、奇
数Ｘサスティン回路１４からの接続端子Ｘ５１３まで、
及び偶数Ｘサスティン回路１５から接続端子Ｘ２までの
配線距離が長く、電圧降下などの問題が生じた。図１３
は、第６実施例のＸ電極駆動回路を実装したＸ側駆動回
路基板７２の構成を示す図である。奇数Ｘサスティン回
路１４は２個の奇数Ｘサスティン回路Ａ１４−１と奇数
Ｘサスティン回路Ｂ１４−２に分割され、偶数Ｘサステ
ィン回路１５は、２個の偶数Ｘサスティン回路Ａ１５−
１と偶数Ｘサスティン回路Ｂ１５−２に分割され、交互
に配置される。これにより配線での電圧降下の問題が低
減された。
数Ｘサスティン回路１４からの接続端子Ｘ５１３まで、
及び偶数Ｘサスティン回路１５から接続端子Ｘ２までの
配線距離が長く、電圧降下などの問題が生じた。図１３
は、第６実施例のＸ電極駆動回路を実装したＸ側駆動回
路基板７２の構成を示す図である。奇数Ｘサスティン回
路１４は２個の奇数Ｘサスティン回路Ａ１４−１と奇数
Ｘサスティン回路Ｂ１４−２に分割され、偶数Ｘサステ
ィン回路１５は、２個の偶数Ｘサスティン回路Ａ１５−
１と偶数Ｘサスティン回路Ｂ１５−２に分割され、交互
に配置される。これにより配線での電圧降下の問題が低
減された。
【００４４】図１４は、Ｙ電極駆動回路の回路基板への
実装例を示す図である。図１４の（１）では、基板５０
の一方の面に奇数Ｙサスティン回路１６と奇数番目のＹ
電極に接続されるスキャンドライバ４１を配置し、他方
の面に偶数Ｙサスティン回路１７と偶数番目のＹ電極に
接続されるスキャンドライバ４２を配置する。このよう
な配置により、部品の実装面積を縮小でき、更にスキャ
ンドライバ４１、４２の出力を最短距離で、パネル１の
Ｙ電極接続端子に接続できる。特に、パネル１との接続
部分で、一方の面に奇数番目のＹ電極に接続される端子
を、他方の面に偶数番目のＹ電極に接続される端子を設
ければ、回路基板における配線の組み替えも必要ない。
実装例を示す図である。図１４の（１）では、基板５０
の一方の面に奇数Ｙサスティン回路１６と奇数番目のＹ
電極に接続されるスキャンドライバ４１を配置し、他方
の面に偶数Ｙサスティン回路１７と偶数番目のＹ電極に
接続されるスキャンドライバ４２を配置する。このよう
な配置により、部品の実装面積を縮小でき、更にスキャ
ンドライバ４１、４２の出力を最短距離で、パネル１の
Ｙ電極接続端子に接続できる。特に、パネル１との接続
部分で、一方の面に奇数番目のＹ電極に接続される端子
を、他方の面に偶数番目のＹ電極に接続される端子を設
ければ、回路基板における配線の組み替えも必要ない。
【００４５】図１４の（２）では、スキャンドライバ４
１とスキャンドライバ４２を基板の別の面に配置した例
を示す。この配置でも、スキャンドライバ４１、４２の
出力を最短距離でパネル１のＹ電極接続端子に接続で
き、回路基板における配線の組み替えを必要としないと
いう効果が得られる。
１とスキャンドライバ４２を基板の別の面に配置した例
を示す。この配置でも、スキャンドライバ４１、４２の
出力を最短距離でパネル１のＹ電極接続端子に接続で
き、回路基板における配線の組み替えを必要としないと
いう効果が得られる。
【００４６】
【発明の効果】以上説明したように、微細な構造としな
くても高精細化が可能なＰＤＰの駆動回路を小規模で且
つ低コストで実現できる。
くても高精細化が可能なＰＤＰの駆動回路を小規模で且
つ低コストで実現できる。
【図１】本発明の適用されるプラズマディスプレイパネ
ル（ＰＤＰ）の構成を示すブロック図である。
ル（ＰＤＰ）の構成を示すブロック図である。
【図２】図１のパネルの断面構造を示す図である。
【図３】図１のＰＤＰの表示フレームの構成を示す図で
ある。
ある。
【図４】図１のＰＤＰの駆動波形を示すタイムチャート
である。
である。
【図５】従来の第２（Ｙ）電極駆動回路の構成を示す図
である。
である。
【図６】本発明の第１実施例のＹ電極駆動回路の構成を
示す図である。
示す図である。
【図７】本発明の第２実施例のＹ電極駆動回路の構成を
示す図である。
示す図である。
【図８】本発明の第３実施例のＹ電極駆動回路の構成を
示す図である。
示す図である。
【図９】本発明の第４実施例のＹ電極駆動回路の構成を
示す図である。
示す図である。
【図１０】第４実施例のＹ電極駆動回路の詳細な構成を
示す図である。
示す図である。
【図１１】従来例のＸ電極駆動回路の構成を示す図であ
る。
る。
【図１２】従来例の奇数Ｘサスティン回路の構成を示す
図である。
図である。
【図１３】本発明の第５実施例のＸ電極駆動回路の構成
を示す図である。
を示す図である。
【図１４】Ｙ電極駆動回路の実装例を示す図である。
１…パネル ２、２−１、２−２…第１（Ｘ）電極 ３−１、３−２…第２（Ｙ）電極 ４−１、４−７…アドレス電極 １２、１２−１、１２−２…スキャンドライバ １４…奇数Ｘサスティン回路 １５…偶数Ｘサスティン回路 １６…奇数Ｙサスティン回路 １７…偶数Ｙサスティン回路 ４１…奇数Ｙスキャンドライバ ４２…偶数Ｙスキャンドライバ
─────────────────────────────────────────────────────
【手続補正書】
【提出日】平成１０年９月２１日
【手続補正１】
【補正対象書類名】明細書
【補正対象項目名】請求項１
【補正方法】変更
【補正内容】
【手続補正２】
【補正対象書類名】明細書
【補正対象項目名】請求項１１
【補正方法】変更
【補正内容】
【手続補正３】
【補正対象書類名】明細書
【補正対象項目名】００２７
【補正方法】変更
【補正内容】
【００２７】すなわち、本発明のプラズマディスプレイ
装置は、平行に配置された第１及び第２の電極と、第１
及び第２の電極に対して直交する形で配置された第３の
電極とを有する表示パネルを備え、第２と第３の電極に
印加する走査信号とアドレス信号により放電セルの選択
を行い、第１と第２の電極に維持放電信号を印加して選
択したセルで維持放電を行わせるプラズマディスプレイ
装置であって、隣接する第１の電極及び第２の電極の組
に交互に逆相の維持放電信号を印加することにより、第
２の電極と第２の電極の一方の側の第１の電極との間で
第１の表示セルが形成され、第２の電極と第２の電極の
他方の側の第１の電極との間で第２の表示セルが形成さ
れ、第１の表示セルと第２の表示セルで発光表示を交互
に繰り返すインターレース表示が行われ、プラズマディ
スプレイ装置の第２の電極の駆動回路は、第２の電極の
中の奇数番目の電極に共通に印加する電圧パルスを出力
する第１の駆動回路と、第２の電極の中の偶数番目の電
極に共通に印加する電圧パルスを出力する第２の駆動回
路と、第２の電極毎に設けられ、第１の駆動回路と第２
の駆動回路の出力する電圧パルスを第２の電極に印加す
ると共に、走査信号を第２の電極に選択的に印加するた
めの第３の回路とを備えるプラズマディスプレイ装置に
おいて、第３の回路は、第２の電極の中の奇数番目の電
極に接続される第３奇数回路と、第２の電極の中の偶数
番目の電極に接続される第３偶数回路とに分けられてお
り、第３奇数回路を少なくとも１個のチップに集積化
し、第３偶数回路を少なくとも１個のチップに集積化す
ることを特徴とする。
装置は、平行に配置された第１及び第２の電極と、第１
及び第２の電極に対して直交する形で配置された第３の
電極とを有する表示パネルを備え、第２と第３の電極に
印加する走査信号とアドレス信号により放電セルの選択
を行い、第１と第２の電極に維持放電信号を印加して選
択したセルで維持放電を行わせるプラズマディスプレイ
装置であって、隣接する第１の電極及び第２の電極の組
に交互に逆相の維持放電信号を印加することにより、第
２の電極と第２の電極の一方の側の第１の電極との間で
第１の表示セルが形成され、第２の電極と第２の電極の
他方の側の第１の電極との間で第２の表示セルが形成さ
れ、第１の表示セルと第２の表示セルで発光表示を交互
に繰り返すインターレース表示が行われ、プラズマディ
スプレイ装置の第２の電極の駆動回路は、第２の電極の
中の奇数番目の電極に共通に印加する電圧パルスを出力
する第１の駆動回路と、第２の電極の中の偶数番目の電
極に共通に印加する電圧パルスを出力する第２の駆動回
路と、第２の電極毎に設けられ、第１の駆動回路と第２
の駆動回路の出力する電圧パルスを第２の電極に印加す
ると共に、走査信号を第２の電極に選択的に印加するた
めの第３の回路とを備えるプラズマディスプレイ装置に
おいて、第３の回路は、第２の電極の中の奇数番目の電
極に接続される第３奇数回路と、第２の電極の中の偶数
番目の電極に接続される第３偶数回路とに分けられてお
り、第３奇数回路を少なくとも１個のチップに集積化
し、第３偶数回路を少なくとも１個のチップに集積化す
ることを特徴とする。
【手続補正４】
【補正対象書類名】明細書
【補正対象項目名】００３３
【補正方法】変更
【補正内容】
【００３３】第３奇数回路のチップと第３偶数回路のチ
ップの走査信号を順次出力する出力端子は、一方の面か
ら見て同じ方向に走査信号が順次出力されるように配置
して、パネルのＹ電極の配置と合うようにすることが望
ましい。また、本発明の別の態様のプラズマディスプレ
イ装置は、平行に配置された第１及び第２の電極と、第
１及び第２の電極に対して直交する形で配置された第３
の電極とを有する表示パネルを備え、第２と第３の電極
に印加する走査信号とアドレス信号により放電セルの選
択を行い、第１と第２の電極に維持放電信号を印加して
選択したセルで維持放電を行わせるプラズマディスプレ
イ装置であって、隣接する第１の電極及び隣接する第２
の電極に交互に逆相の維持放電信号を印加することによ
り、第２の電極と第２の電極の一方の側の第１の電極と
の間で第１の表示セルが形成され、第２の電極と第２の
電極の他方の側の第１の電極との間で第２の表示セルが
形成され、第１の表示セルと第２の表示セルで発光表示
を交互に繰り返すインターレース表示が行われるプラズ
マディスプレイ装置において、プラズマディスプレイ装
置の第１の電極の駆動回路は、第１の電極の中の奇数番
目の電極に共通に印加する電圧パルスを出力する第５の
駆動回路と、第１の電極の中の偶数番目の電極に共通に
印加する電圧パルスを出力する第６の駆動回路とを備
え、第５の回路及び第６の回路をそれぞれ複数個設け、
交互に配置することを特徴とする。
ップの走査信号を順次出力する出力端子は、一方の面か
ら見て同じ方向に走査信号が順次出力されるように配置
して、パネルのＹ電極の配置と合うようにすることが望
ましい。また、本発明の別の態様のプラズマディスプレ
イ装置は、平行に配置された第１及び第２の電極と、第
１及び第２の電極に対して直交する形で配置された第３
の電極とを有する表示パネルを備え、第２と第３の電極
に印加する走査信号とアドレス信号により放電セルの選
択を行い、第１と第２の電極に維持放電信号を印加して
選択したセルで維持放電を行わせるプラズマディスプレ
イ装置であって、隣接する第１の電極及び隣接する第２
の電極に交互に逆相の維持放電信号を印加することによ
り、第２の電極と第２の電極の一方の側の第１の電極と
の間で第１の表示セルが形成され、第２の電極と第２の
電極の他方の側の第１の電極との間で第２の表示セルが
形成され、第１の表示セルと第２の表示セルで発光表示
を交互に繰り返すインターレース表示が行われるプラズ
マディスプレイ装置において、プラズマディスプレイ装
置の第１の電極の駆動回路は、第１の電極の中の奇数番
目の電極に共通に印加する電圧パルスを出力する第５の
駆動回路と、第１の電極の中の偶数番目の電極に共通に
印加する電圧パルスを出力する第６の駆動回路とを備
え、第５の回路及び第６の回路をそれぞれ複数個設け、
交互に配置することを特徴とする。
Claims (13)
- 【請求項１】 平行に配置された第１及び第２の電極
と、該第１及び第２の電極に対して直交する形で配置さ
れた第３の電極とを有する表示パネルを備え、前記第２
と第３の電極に印加する走査信号とアドレス信号により
放電セルの選択を行い、前記第１と第２の電極に維持放
電信号を印加して選択したセルで維持放電を行わせるプ
ラズマディスプレイ装置であって、 隣接する前記第１の電極と前記第２の電極の組に交互に
逆相の維持放電信号を印加することにより、前記第２の
電極と前記第１の電極の中の奇数番目の電極で第１の表
示セルが形成され、前記第２の電極と前記第１の電極の
中の偶数番目の電極で第２の表示セルが形成され、 前記第１の表示セルと前記第２の表示セルで発光表示を
交互に繰り返すインターレース表示が行われ、 当該プラズマディスプレイ装置の前記第２の電極の駆動
回路は、 前記第２の電極の中の奇数番目の電極に共通に印加する
電圧パルスを出力する第１の駆動回路と、 前記第２の電極の中の偶数番目の電極に共通に印加する
電圧パルスを出力する第２の駆動回路と、 前記第２の電極毎に設けられ、前記第１の駆動回路と前
記第２の駆動回路の出力する前記電圧パルスを前記第２
の電極に印加すると共に、前記走査信号を前記第２の電
極に選択的に印加するための第３の回路とを備えるプラ
ズマディスプレイ装置において、 前記第３の回路は、前記第２の電極の中の奇数番目の電
極に接続される第３奇数回路と、前記第２の電極の中の
偶数番目の電極に接続される第３偶数回路とに分けられ
ており、 前記第３奇数回路は少なくとも１個のチップに集積化さ
れており、 前記第３偶数回路は少なくとも１個のチップに集積化さ
れていることを特徴とするプラズマディスプレイ装置。 - 【請求項２】 請求項１に記載のプラズマディスプレイ
装置であって、 前記第１の回路の近傍に前記第３奇数回路のチップを配
置し、 前記第２の回路の近傍に前記第３偶数回路のチップを配
置したプラズマディスプレイ装置。 - 【請求項３】 請求項１に記載のプラズマディスプレイ
装置であって、 前記第１の回路及び前記第２の回路はそれぞれ複数設け
られており、複数の第１の回路と第２の回路が交互に配
置されているプラズマディスプレイ装置。 - 【請求項４】 請求項１に記載のプラズマディスプレイ
装置であって、 前記第３奇数回路及び前記第３偶数回路は、それぞれ複
数のチップで構成され、交互に配置された前記複数の第
１の回路と第２の回路に対応して交互に配置されている
プラズマディスプレイ装置。 - 【請求項５】 請求項１に記載のプラズマディスプレイ
装置であって、 前記走査信号に相当する選択電圧と、前記走査信号が印
加される以外の第２の電極に印加する非選択電圧とを供
給する第４の回路を備え、該第４の回路から前記第３奇
数回路と前記第３偶数回路に前記選択電圧と前記非選択
電圧が供給されるプラズマディスプレイ装置。 - 【請求項６】 請求項５に記載のプラズマディスプレイ
装置であって、 前記第４の回路は、前記選択電圧を与える第１のスイッ
チング素子と、該第１のスイッチング素子に接続された
第１と第２のダイオードと、前記非選択電圧を与える第
２のスイッチング素子と、該第２のスイッチング素子に
接続された第３と第４のダイオードとを有し、 前記第１のダイオードを前記第３奇数回路の一端に接続
し、前記第３のダイオードを前記第３奇数回路の他端に
接続し、前記第２のダイオードを前記第３偶数回路の一
端に接続し、前記第４のダイオードを前記第３偶数回路
の他端に接続したプラズマディスプレイ装置。 - 【請求項７】 請求項１に記載のプラズマディスプレイ
装置であって、 前記第１及び第２の回路は、少なくとも維持放電電圧を
供給するスイッチング素子と、前記走査信号の印加時に
前記第２の電極に選択的に印加する電圧を供給するスイ
ッチング素子を備えるプラズマディスプレイ装置。 - 【請求項８】 請求項１に記載のプラズマディスプレイ
装置であって、 前記第１の回路と前記第３奇数回路のチップを一方の面
に配置し、前記第２の回路と前記第３偶数回路のチップ
を他方の面に配置した基板を備えるプラズマディスプレ
イ装置。 - 【請求項９】 請求項１に記載のプラズマディスプレイ
装置であって、 前記第３奇数回路のチップを一方の面に配置し、前記第
３偶数回路のチップを他方の面に配置し、前記第１及び
第２の回路は前記一方の面又は他方の面のいずれかに配
置した基板を備えるプラズマディスプレイ装置。 - 【請求項１０】 請求項８又は９に記載のプラズマディ
スプレイ装置であって、 前記第３奇数回路のチップと前記第３偶数回路のチップ
の前記走査信号を順次出力する出力端子は、一方の面か
ら見て同じ方向に前記走査信号が順次出力されるように
配置されているプラズマディスプレイ装置。 - 【請求項１１】 平行に配置された第１及び第２の電極
と、該第１及び第２の電極に対して直交する形で配置さ
れた第３の電極とを有する表示パネルを備え、前記第２
と第３の電極に印加する走査信号とアドレス信号により
放電セルの選択を行い、前記第１と第２の電極に維持放
電信号を印加して選択したセルで維持放電を行わせるプ
ラズマディスプレイ装置であって、 隣接する前記第１の電極及び隣接する前記第２の電極に
交互に逆相の維持放電信号を印加することにより、前記
第２の電極と前記第１の電極の中の奇数番目の電極で第
１の表示セルが形成され、前記第２の電極と前記第１の
電極の中の偶数番目の電極で第２の表示セルが形成さ
れ、 前記第１の表示セルと前記第２の表示セルで発光表示を
交互に繰り返すインターレース表示が行われるプラズマ
ディスプレイ装置において、 当該プラズマディスプレイ装置の前記第１の電極の駆動
回路は、 前記第１の電極の中の奇数番目の電極に共通に印加する
電圧パルスを出力する第５の駆動回路と、 前記第１の電極の中の偶数番目の電極に共通に印加する
電圧パルスを出力する第６の駆動回路とを備え、 前記第５の回路及び前記第６の回路はそれぞれ複数設け
られており、複数の第５の回路と第６の回路が交互に配
置されていることを特徴とするプラズマディスプレイ装
置。 - 【請求項１２】 請求項１１に記載のプラズマディスプ
レイ装置であって、 前記第５及び第６の回路は、少なくとも維持放電電圧を
供給するスイッチング素子と、前記走査信号の印加時に
前記第１の電極に選択的に印加する電圧を供給するスイ
ッチング素子を備えるプラズマディスプレイ装置。 - 【請求項１３】 請求項１１に記載のプラズマディスプ
レイ装置であって、 前記第５の回路を一方の面に配置し、前記第６の回路を
他方の面に配置した基板を備えるプラズマディスプレイ
装置。
Priority Applications (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13692098A JP3640527B2 (ja) | 1998-05-19 | 1998-05-19 | プラズマディスプレイ装置 |
| US09/160,292 US6603446B1 (en) | 1998-05-19 | 1998-09-25 | Plasma display device |
| EP98307933A EP0959450A1 (en) | 1998-05-19 | 1998-09-30 | Plasma display device |
| KR1019980044311A KR100303925B1 (ko) | 1998-05-19 | 1998-10-22 | 플라즈마디스플레이장치 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13692098A JP3640527B2 (ja) | 1998-05-19 | 1998-05-19 | プラズマディスプレイ装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH11327503A true JPH11327503A (ja) | 1999-11-26 |
| JP3640527B2 JP3640527B2 (ja) | 2005-04-20 |
Family
ID=15186671
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP13692098A Expired - Fee Related JP3640527B2 (ja) | 1998-05-19 | 1998-05-19 | プラズマディスプレイ装置 |
Country Status (4)
| Country | Link |
|---|---|
| US (1) | US6603446B1 (ja) |
| EP (1) | EP0959450A1 (ja) |
| JP (1) | JP3640527B2 (ja) |
| KR (1) | KR100303925B1 (ja) |
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- 1998-09-30 EP EP98307933A patent/EP0959450A1/en not_active Withdrawn
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| US7656367B2 (en) | 2004-11-15 | 2010-02-02 | Samsung Sdi Co., Ltd. | Plasma display device and driving method thereof |
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| WO2008090700A1 (ja) * | 2007-01-24 | 2008-07-31 | Panasonic Corporation | プラズマディスプレイパネル駆動回路およびプラズマディスプレイ装置 |
| US8384622B2 (en) | 2007-01-24 | 2013-02-26 | Panasonic Corporation | Plasma display panel drive circuit and plasma display device |
| WO2009072190A1 (ja) * | 2007-12-04 | 2009-06-11 | Hitachi, Ltd. | プラズマディスプレイパネルの駆動回路装置、及びプラズマディスプレイ装置 |
| WO2009157180A1 (ja) * | 2008-06-26 | 2009-12-30 | パナソニック株式会社 | プラズマディスプレイパネルの駆動回路およびプラズマディスプレイ装置 |
| JP2010044415A (ja) * | 2009-11-13 | 2010-02-25 | Hitachi Plasma Display Ltd | プラズマディスプレイ装置 |
Also Published As
| Publication number | Publication date |
|---|---|
| KR19990086992A (ko) | 1999-12-15 |
| KR100303925B1 (ko) | 2001-11-22 |
| JP3640527B2 (ja) | 2005-04-20 |
| EP0959450A1 (en) | 1999-11-24 |
| US6603446B1 (en) | 2003-08-05 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20040210 |
|
| A02 | Decision of refusal |
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|
| A521 | Written amendment |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20040629 |
|
| A911 | Transfer to examiner for re-examination before appeal (zenchi) |
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| TRDD | Decision of grant or rejection written | ||
| A01 | Written decision to grant a patent or to grant a registration (utility model) |
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| A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20050118 |
|
| R150 | Certificate of patent or registration of utility model |
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|
| S111 | Request for change of ownership or part of ownership |
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|
| R350 | Written notification of registration of transfer |
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|
| S131 | Request for trust registration of transfer of right |
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|
| FPAY | Renewal fee payment (event date is renewal date of database) |
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|
| FPAY | Renewal fee payment (event date is renewal date of database) |
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|
| FPAY | Renewal fee payment (event date is renewal date of database) |
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