JPH1175366A - プログラム可能なコンバータ - Google Patents

プログラム可能なコンバータ

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JPH1175366A
JPH1175366A JP10122084A JP12208498A JPH1175366A JP H1175366 A JPH1175366 A JP H1175366A JP 10122084 A JP10122084 A JP 10122084A JP 12208498 A JP12208498 A JP 12208498A JP H1175366 A JPH1175366 A JP H1175366A
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Abstract

(57)【要約】 【課題】 より低い電圧のマイクロプロセッサに対す
る電源電圧の変更に対応することのできるようにプログ
ラムされるよう設計されたＤＣ−ＤＣコンバータコント
ローラを提供する。 【解決手段】 出力信号を供給する少なくとも１つの
増幅器（１６、１８、２０）と、前記少なくとも１つの
増幅器の出力信号の大きさを制御する制御ユニット（２
４）と、デジタル入力信号に応じて、前記少なくとも１
つの増幅器の前記出力信号の前記大きさを特定する出力
信号を、前記制御ユニットに供給する回路であって、各
々が特定の値の増加分を有する前記大きさの２つの範囲
を特定する前記回路（１４）とを有する。

Description

【発明の詳細な説明】
【０００１】
【発明の属する技術分野】本発明は、プログラム可能な
電源に関し、より詳しくは、プログラム可能なステップ
ダウンＤＣ−ＤＣコンバータコントローラに関する。
【０００２】
【従来の技術】マイクロプロセッサは、メインフレーム
のコンピュータの計算能力に匹敵する簡単な機能のみを
制御する集積化された半導体チップから発展してきた。
この発展は、１つの集積回路上に集積化されるトランジ
スタの個数を増加させてきた。例えば、現在のＩｎｔｅ
ｌ Ｐｅｎｔｉｕｍ（登録商標）マイクロプロセッサチ
ップは、５００億個を優に越える数のトランジスタを備
えている。このような高い密度を達成するために、各ト
ランジスタの寸法がサブミクロンのレベルまで縮小さ
れ、各々の形状が短縮され、そのトランジスタが動作す
るための最大の電圧も、低減されてきた。マイクロプロ
セッサの最大の動作電圧を変更することにより、プログ
ラム可能な電源に対して、そのマイクロプロセッサに必
要とされる電圧を変更する度に、コンピュータシステム
の設計者が、その関連する電源システムを完全に構築せ
ずに済むものでなければならないという要件が生じた。
マイクロプロセッサに対するこの電圧の要件は、およそ
過去５年の間に、３８６及び４８６マイクロプロセッサ
に対する５ボルトから、ペンティアムプロセッサに対す
る３．３ボルトへ減少する傾向にあり、そして現在で
は、ペンティアムプロ（Ｐｅｎｔｉｕｍ Ｐｒｏ（登録
商標））に対する３．５ボルトまで低下している。１９
９７年のマイクロプロセッサに対する動作電圧は、２．
５ボルトの範囲内となるであろう。
【０００３】ＤＣ−ＤＣ（直流−直流）コンバータコン
トローラの前の世代は、一定の出力電圧を提供するか、
又は、外部の抵抗の設定によって出力電圧を調節できる
ものであった。従って、パーソナルコンピュータの生産
環境において、マイクロプロセッサ回路基板（「マザー
ボード」として知られてもいる）は、マイクロプロセッ
サの製造業者によって動作電圧が変更される度に、再設
計されなければならなかった。電圧の要件の変更によっ
て生ずるこの問題を解決するために、インテル社は、適
切な能力を備えたマザーボードによって読み出すことの
できるペンティアムプロへの電圧特定コード（ＶＩＤ）
のプログラムを行ってきた。マザーボードは、ビルトイ
ンタイプのファンクションを有する場合、ＶＩＤによっ
て特定された電圧をマイクロプロセッサに供給する。こ
れによって、マイクロプロセッサの電圧が変更される度
にシステム設計者がマザーボードを再設計する必要が解
消され、その理由は、マイクロプロセッサがそれ自身に
必要とされる電圧を指定し、コントローラが自動的にそ
の必要とされる電圧を供給するからである。
【０００４】将来予測されるより低い電圧のマイクロプ
ロセッサに対する電源電圧の変更に対応することのでき
るようにプログラムされるよう設計されたＤＣ−ＤＣコ
ンバータコントローラが必要とされている。このＤＣ−
ＤＣコンバータコントローラは、マイクロプロセッサ内
にプログラムされたＶＩＤコードを読み出し、このマイ
クロプロセッサのＶＩＤコードによって指定された電圧
を供給することのできるものでなければならない。
【０００５】
【発明が解決しようとする課題】本発明は、将来予測さ
れるより低い電圧のマイクロプロセッサに対する電源電
圧の変更に対応することのできるようにプログラムされ
るよう設計されたＤＣ−ＤＣコンバータコントローラを
提供することを目的とする。
【０００６】
【課題を解決するための手段】上記目的を達成するため
に、本発明では、プログラム可能なコンバータであっ
て、出力信号を供給する少なくとも１つの増幅器と、前
記少なくとも１つの増幅器の出力信号の大きさを制御す
る制御ユニットと、デジタル入力信号に応じて、前記少
なくとも１つの増幅器の前記出力信号の前記大きさを特
定する出力信号を、前記制御ユニットに供給する回路で
あって、各々が特定の値の増加分を有する前記大きさの
２つの範囲を特定する前記回路とを有することを特徴と
するプログラム可能なコンバータが提供される。
【０００７】本発明によれば、プログラム可能なＤＣ−
ＤＣコンバータコントローラが、外部装置（例えばマイ
クロプロセッサ）からのデジタル入力信号（例えばＶＩ
Ｄコード）によって指定された出力電圧を供給する。こ
のコンバータコントローラは、必要な電圧を供給する少
なくとも１つの増幅器と、この増幅器の出力の振幅を制
御する制御ユニットと、デジタル入力に応答する回路と
を含む。この回路は、また、デジタル・アナログコンバ
ータを含み、このデジタル・アナログコンバータは、外
部装置からのデジタル入力信号を受け取る。デジタル・
アナログコンバータは、必要とされる電圧の出力電圧を
提供するための正確な基準信号を用いる。マイクロプロ
セッサに供給される出力電圧は、第１の電圧範囲内の例
えば１００ミリボルトの増加分で、または、第２の差分
的電圧範囲内での例えば５０ミリボルトの増加分で、マ
イクロプロセッサによって選択される。
【０００８】本発明は、以下の詳細な説明によってより
良く理解される。単に１つの例として、本発明の実施例
が例示され説明される。容易に理解されることだが、本
発明は、本発明の技術的視点を逸脱せずに、様々な様相
において他の変形を加えることのできるものである。従
って、図面及び詳細な説明は、例示のためのものであっ
て限定を意図するものではない。
【０００９】
【発明の実施の形態】本件出願の出願人による米国特許
出願第０８／６７２，４８７（１９９６年６月２６日出
願）「Ａ Ｐｒｏｇｒａｍｍａｂｌｅ Ｓｙｎｃｈｒｏ
ｎｏｕｓ Ｓｔｅｐ Ｄｏｗｎ ＤＣ−ＤＣ Ｃｏｎｖ
ｅｒｔｅｒ Ｃｏｎｔｒｏｌｌｅｒ」（Ｓｔｅｐｈｅｎ
Ｗ． Ｂｒｙｓｏ）には、本件出願のコントローラと
多くの点で共通するＤＣ−ＤＣコンバータコントローラ
が開示されている。しかしながら、このコントローラ
は、電圧の値及び電圧の範囲の両方において、単一の増
加分を備えた単一の範囲の出力電圧を供給するものであ
る。
【００１０】本発明のコントローラに基づけば、２つの
異なる電圧範囲が提供される。上側の電圧範囲は、５ビ
ットのデジタル・アナログコンバータ（ＤＡＣ）の最上
位ビットに論理的高信号（１）を与えることによって選
択される。このＤＣ−ＤＣコンバータは、それに応じ
て、５ビットのＤＡＣの残りの４つの下位ビットへ入力
されたＶＩＤコードに基づいて、例えば２．０ボルトか
ら３．５ボルトの範囲内の電圧を出力する。下側の電圧
範囲は、デジタルＤＡＣの最上位ビットを論理的信号
（０）を与えることによってイネーブルされる。この２
つの範囲を用いる方法によって、高められた融通性がも
たらされ、関連するマイクロプロセッサが、その特定の
必要とされる電圧を出力するように電源を自動的に構成
することが可能となる。
【００１１】上側の２．０ボルトから３．５ボルトの範
囲では、１００ミリボルトのステッブが存在し、ＤＡＣ
の最上位ビットは、論理的高信号のレベルに設定されて
いる。ＤＡＣの最上位ビットが論理的低信号のレベルに
設定された場合、ＤＣ−ＤＣコントローラは、より低い
電圧範囲、この場合では１．３ボルトから２．０５ボル
トの、５０ミリボルトのステップを出力する。もちろ
ん、これらの範囲及び各範囲に対するステップは、単な
る例示である。また、本発明に基づいて、２つより多く
の範囲を備えたコンバータも、構成することができる。
【００１２】以下の説明では、説明を明瞭にかつ分かり
やすいものとするために、模式的な図面で描かれている
様々な構成要素の全てについて説明されるわけではな
い。様々な構成要素は、当業者に、本発明の実施をする
ことのできるだけの開示内容を提供するために図面で描
かれたものである。当業者には、特定の構成要素の全て
に関する詳細な説明は、本発明を実施するために必要で
ないことは明らかであろう。従って、本発明に影響を及
ぼす構成要素若しくは本発明を理解するために必要な構
成要素のみが、図面に描かれかつ説明されている。更
に、良く知られた電気回路の構造及び電気回路は、本発
明を分かりにくいものとすることのないようにブロック
形式で描かれている。
【００１３】本発明は、例えば１６アンペアの出力電流
以上の出力電流を供給するように構成することのできる
プログラム可能な同期的電圧コントローラである。負荷
が重い状態では、コントローラは、電流モードのＰＷＭ
（パルス幅変調）のステップダウンレギュレータとして
機能する。負荷が軽い状態では、ＰＭＦ（パルス周波数
変調）で、若しくは、パルススキップモードで機能す
る。このコントローラは、負荷のレベルを検出し、２つ
のモードを自動的に切り換え、全ての負荷条件に対して
その効率を最適なものとする。
【００１４】図１は、本発明のプログラム可能なＤＣ−
ＤＣコンバータコントローラ１０を表している。線１１
内に描かれたコントローラ１０の一部分は（ある実施例
では）、１つの半導体チップ上に形成されている（しか
し、他の実施例ではディスクリートな構成要素からな
る）。コントローラ１０のメイン制御ループを含み、こ
のメイン制御ループは、２つの主な部分、即ち、破線１
２によって区分されたアナログ制御回路と、破線１４に
よって区分されたデジタル制御ブロックとを含む。
【００１５】アナログ制御回路１２は、比較器２２に接
続された信号条件付け増幅器１６、１８、及び２０を含
み、比較器２２は、その出力信号をデジタル制御回路２
４へ供給する。アナログ制御回路１２は、ＩＦＢ（電流
フィードバック）端子２６からの入力信号と、ＶＦＢ
（電圧フィードバック）端子２８からの入力信号とを受
け入れ、電流制御信号パス３０と、電圧制御信号パス３
２とを形成している。抵抗器Ｒ１とインダクタＬ１はＩ
ＦＢノード２６に接続されている。抵抗器Ｒ１は、端子
２６と２８との間に電圧を形成し、この電圧は、端子Ｖ
ｏｕｔへ伝達される出力リード電流に比例する。インダ
クタＬ１は、誘導性記憶素子であって、スイッチ３６が
オフ状態の時に連続的に流れなければならない負荷電流
を保持している。キャパシタＣ１はフィルタである。電
圧制御パス３２は、ＶＦＢ信号を増幅し、このＶＦＢ信
号は信号条件付け増幅器２０へ入力される。信号条件付
け増幅器１６は、ＩＦＢ端子２６の信号と、ＶＦＢ端子
２８の信号との差を求め、この差が信号条件付け増幅器
２０へ入力される。増幅されたＶＦＢ信号と、ＶＦＢ信
号とＩＦＢ信号との間の差信号とが、発振器３４からの
傾き補償入力と合計され、信号条件付け増幅器２０へ供
給される。
【００１６】信号条件付け増幅器２０の出力信号は、比
較器２２へ入力され、この比較器２２は、主ＢＷＭ制御
信号を、デジタル制御回路２４へ供給する。アナログ制
御回路１２内の更に別の比較器（図示されていない）
が、軽負荷時にコントローラ１０がパルススキップモー
ドに入る閾値と、最大電流比較器（図示されていない）
が、外部の電力ＭＯＳＦＥＴ（トランジスタ）３６及び
３８への出力ドライブ信号をディスエーブルするポイン
トとを設定する。デジタル制御回路２４は、比較器２２
の出力信号と、発振器３４からのクロック信号とを受け
取り、外部の電力ＭＯＳＦＥＴ３６のゲート（制御端
子）に接続された出力ライン４０へ適切な出力パルスを
出力する。デジタル制御ブロック１４は、あるバージョ
ンでは、デジタル制御回路２４内の高速トランジスタロ
ジックを用い、これにより、コントローラ１０が１ＭＨ
ｚを越えるクロック速度で動作することが可能となる。
デジタル制御ブロック１４は、また、２つの外部のＭＯ
ＳＦＥＴ３６及び３８が同時には導通状態とならないこ
とを確実にするためのブレークビフォアメイクタイミン
グ（break-before-make timing）を提供する。発振器３
４は、一定電流のキァパシタ充電オシュレータからな
る。外部のキャパシタ３５は、発振器３４の周波数を設
定する最大の融通性をもたらし、例えば用途の必要性に
応じて２００ＫＨｚから１ＭＨｚ以上の設定を可能とす
る。
【００１７】デジタル制御ブロック１４は、２つの等し
い高電流出力トライバ４２及び４４を含み、この２つの
ドライバは、プッシュプル形式で配置された内部の高速
バイポーラトランジスタ（図示されていない）を用いて
いる。各ドライバ４２及び４４は、１００ナノ秒未満の
間で、例えば、１アンペアを流すことのできる能力を有
する。各ドライバの電源及びグランドは、スイッチング
ノイズに対する耐性を提供するために、集積回路チップ
の電源及びグランドから、切り離されている。ドライバ
４０には、フローティングキャパシタ４８から「ブート
ストラップ（boot-strapped）」された電源を有する。
この構成では、キャパシタ４８は、交互に、ショットキ
ーダイオード５０を介して電源ＶCC1から充電され、次
に、ＭＯＳＦＥＴ３６が導通しているときに電圧上昇
（boosted up）される。この方法により、ノード４６の
電圧が２×（ＶCC−Ｖds）（ダイオード５０）に等しく
なり、この値はＶＣＣ１＝５Ｖの時に約９．５ボルトで
ある。この電圧は、低いＲDS 、ON（導通状態におけるド
レイン・ソース間の抵抗）を達成するために必要とされ
る外部のＭＯＳＦＥＴ３６への９ボルトのゲート電圧を
提供するために十分な値である。「低い方の」同期ＭＯ
ＳＦＥＴ３８は、基準電圧としてグランド電位が与えら
れているので、そのゲート駆動電圧は、電圧上昇される
必要はない（他の実施例では、１つのドライバ４２と１
つのＮＯＳＦＥＴ３６のみが用いられている）。ダイオ
ード５１は、スイッチ３６がターンオンしかつスイッチ
３８がターンオフしている間に、若しくはその逆の状態
の間に、電流を吸い込む。
【００１８】図示されているように、２つの電源ＶＣＣ
１（例えば１２ボルト）とＶＣＣ2（例えば５ボルト）
が用いられている。
【００１９】コントローラ１０には、精密バンドギャッ
プ回路を含む以下に詳しく説明される基準電圧回路６４
によって供給される、基準電圧ＶＲＥＦが、基準電圧と
して供給されている。基準電圧回路６４のバンドギャッ
プ回路内の内部抵抗（図示されていない）は、ほとんど
０に近い温度係数（ＴＣ）を達成するように正確に調節
されている。ＶＲＥＦ信号は、５ビットＶＡＣ５４に接
続されていて、更に、５個のデジタル入力信号Ｄ０、Ｄ
１、Ｄ２、Ｄ３、Ｄ４、ＲＳＥＬが、５ビットのＤＡＣ
５４に供給されていて、これらの信号は、ＶOUT５４に
おける必要とされる出力電圧を選択するための電圧範囲
及び電圧の値を決定するものである。例えば、Ｐｅｎｔ
ｉｕｍ Ｐｒｏ仕様ガイドラインは、ＤＣ−ＤＣコンバ
ータの出力が、４ビットの電圧特定（ＶＩＤ）コードＤ
０、Ｄ１、Ｄ２、Ｄ３（以下の表１に例示されている）
によって直接プログラムされることを要件件としてい
る。このコードは、５番目のビットＲＳＥＬと共に、ラ
イン５５のＤＣの出力電圧ＶDACを調節する。表１は、
ＲＳＥＬ（最上位ビット）を論理５レベル（１）に設定
することによって選択される上述された上側電圧範囲を
表していることが理解される。
【００２０】
【表１】
【００２１】表１のＶＩＤコードは以下のように機能す
る。マイクロプロセッサの設計者、例えばペンティアム
プロの設計者は、そのマイクロプロセッサが２．８ボル
トで動作するか否かを判定する。２．８ボルトに対する
５ビットのＶＩＤコード（０１１１１）は、マイクロプ
ロセッサ内にプログラムされ、かつ、コントローラ１０
内のＤＡＣ５４によって入力信号Ｄ0、Ｄ1、Ｄ2、Ｄ4、
及びＲＳＥＬとして読み出される。次に、ＤＡＣ５４
は、ライン５５のアナログ出力信号ＶＤＡＣを供給し、
この信号が増幅器１８に入力されて、この増幅器１８は
上述されたようにアナログ回路１２の１部を構成し、ア
ナログ回路１２の出力信号は、比較器２２によってデジ
タル信号に変換されて、このデジタル信号が、デジタル
制御ブロック２４へ供給され、ドライバ４２と４４のス
イッチングを制御する。こうして、必要とされる電圧
（２．８ボルト）がＶOUT５８に出力される。全ての負
荷状態の元で安定した動作（フィルタリング）を行うた
めに、１０ＫΩのプルアップ抵抗器と０．２マイクロフ
ァラッドのデカップリングキァパシタ（図示されていな
い）がライン５５に接続されても良い。
【００２２】上述されたように、下側の電圧範囲は、Ｒ
ＳＥＬビットの値を論理低（０）に設定することによっ
て選択される。これによって、５０ミリボルトの増加分
の１．３ボルトから２．０５ボルトの範囲の下側の電圧
が形成される。対応するＶＩＤの表は例示されていない
が、その理由は、表１と等しいからである。
【００２３】コントローラ１０は、ある実施例では、Ｖ
ＦＢ端子２８（ＶOUTでもある）における一定の電圧モ
ニタを提供する「電力ＧＯＯＤ」回路６０を含む。電力
ＧＯＯＤ回路６０は、ＶＦＢ端子２８の信号をＶＤＡＣ
信号と比較し、電源電圧（ＶOUT５８での）が、その通
常の値に対する選択された百分率、例えばプラスマイナ
ス７％を越える場合に、ライン「ＰＷＲＧＤ」にアクテ
ィブローのインタラプト信号を出力する。
【００２４】図２は、ＤＡＣ５４の模式図である。図２
のＤＡＣ５４は、本発明に用いることのできるデジタル
・アナログコンバータの１つの例である。入力端子（Ｄ
0、Ｄ1、Ｄ2、Ｄ3）は、表１及び図１に例示された同じ
符号を付けられたコードの値に対応し、かつ対応するマ
イクロプロセッサ等の外部装置から受け取られる。これ
らの入力コード信号は、各々、トランジスタＱ０、Ｑ
３、Ｑ４、及びＱ５をターンオン若しくはターンオフさ
せる。Ｒ−２Ｒ抵抗性ラダーとして知られかつ抵抗器Ｒ
１２からＲ２４を含む抵抗性ラダーは、入力コード
Ｄ0、Ｄ1、Ｄ2、Ｄ3 の値に応じて増加された出力電圧Ｖ
ＤＡＣを供給し、かつ上述されたように、電圧の増加分
はこの例では１００ミリボルトである。
【００２５】図１及び図２を参照すると、５ビットのＤ
ＡＣ５４には、基準電圧回路６４によって出力された基
準電圧ＶＲＥＦが供給されている。回路６４の詳細は、
図３に描かれており、この回路６４は、バンドギャップ
ダイオードを用いた１．２１ボルトの基準電圧を発生す
る通常のバンドギャップ基準回路７８を含んでいる。こ
の１．２１ボルトのバンドギャップ基準電圧は、第１の
ゲイン選択増幅器７２の正の端子に入力され、かつ第２
のゲンイ選択増幅器７４の正の入力端子に入力されてい
る。増幅器７２及び７４の各々の制御端子は、ＲＳＥＬ
コードラインに接続されている。抵抗器Ｒ３０、Ｒ３
２、Ｒ３４及びＲ３６も設けられている。ＲＳＥＬの値
は（デジタル値の１若しくは０であるが）、ＤＡＣ５４
に対する出力電圧ＶＲＥＦが高い電圧範囲若しくは低い
電圧範囲のいずれかにあるかを、各電圧範囲内の最も低
い点の値、例えば１．３ボルト若しくは２．０ボルトを
設定することによって決定する。ＲＳＥＬの値に基づい
て、増幅器７２と７４のうちのいずれかのみがイネーブ
ルされて、１．２１ボルトのバンドギャップ電圧が各範
囲に対する適切な電圧レベルまで増加されるようにな
る。
【００２６】図２のデジタル・アナログコンバータ５４
は、可変（選択可能な）電流源Ｉ２を含み、この電流源
はその詳細が図４に描かれている。電流源Ｉ２は、ＶＩ
Ｄコードの最上位ビットＲＳＥＬの値に応じて、２つの
範囲の各々に対するＤＡＣのステップサイズを選択す
る。ＲＳＥＬビットが論理高（１）に設定されている場
合、上側のコードの範囲は、イネーブルされ、即ちステ
ップサイズが１００ミリボルトとなる。２つの電流源Ｉ
３の出力電流は、トランジスタＱ３２とＱ３４によって
合流され、ノードＩＯＵＴにおけるこのステップ電流が
ＤＡＣ５４に供給される。ＲＳＥＬビットが低い値（論
理０）に設定されたとき、低い電圧範囲がイネーブルさ
れ、即ち、５０ミリボルトのステップサイズとなり、電
流源Ｉ４がターンオフされ、ＤＡＣ５４へのステッブ電
流が半分にされる。
【００２７】各範囲に対する最初の電圧とステップのサ
イズとの両方を制御するためにＲＳＥＬビットを用いる
ことが、図１に描かれており、この図１では、ＲＳＥＬ
入力信号が、基準電圧回路６４と、５ピットのＤＡＣ５
４とに接続されており、図１では、図２及び図４の電流
源Ｉ２がＤＡＣ５４の一部を成していることが理解され
る。
【００２８】図１のデジタル制御回路２４の模式図が、
図５及び図６に描かれている。図示された各構成要素を
説明せずに、回路２４の動作を以下に説明する。基本的
な制御信号（ＣＭＰ１ＩＮ）は、出力ドライバ４２のオ
フのタイミングを制御するデジタル信号である。ドライ
バ４２の開始時刻は、ＯＳＣの立ち上がりエッジによっ
て、ＲＳラッチ８０がリセットされることにより、セッ
トされる。次に、ＣＭＰにＩＮ信号が、アナログブロッ
ク１２によって発生されたフィードバック信号に基づい
て、ある時間だけ遅れてラッチ８０をセットする。
【００２９】下側のドライバ４４は、ドライバ４２の反
対の極性でスレーブされて動作する、即ち、ドライバ４
２がオンの時、ドライバ４４はオフであり、ドライバ４
２がオフの時、ドライバ４４はオンである。ＲＳラッチ
８２と、ＮＯＲゲート８６及び８８とは、ドライバ４２
と４４とが同じ時刻で両方オンしないことを確実にす
る。ＮＯＲゲート９０は、ドライバ４４がオン状態であ
るときに、ドライバ４２がオンとならないようにしてい
る。また、出力が回路をＶｃｃ若しくはグランドに接続
しているときに、入力信号ＳＣＩＮはドライバ４２をデ
ィスエーブルする。図５のその他の入力信号は、比較器
（図示されていない）によって供給される、ＣＭＰＩＮ
３Ｂ、ＣＭＰ２ＩＮＢ、ＳＣＩＮ、及びＳＹＮＣＯＭＰ
Ｂ信号である。信号ＳＣＩＮ及びＣＭＰ２ＩＮＢは、従
って、短絡回路の保護を提供し、ＣＭＰＩＮ３Ｂは、ア
イドル状態を表し、ＳＹＮＣＯＭＰＢは、ラッチ８２を
リセットする。
【００３０】これまでの説明は例示及び説明を目的とす
るものである。これまでの説明は、本発明を全て含むも
のではなく、本発明を開示された形式に限定するもので
もない。これまでの説明の範囲内で様々な変更及び変形
が可能である。開示された実施例は、本発明の基本理念
を最も良く例示するために選択されかつ記述されたもの
であり、従って、その具体的な用途において、当業者
が、様々な実施例において様々な変更を施して本発明を
用いることを可能とする。その様な変形及び変更の全て
は、添付の特許請求の範囲によって定義される本発明の
技術的視点内に含まれる。
【００３１】
【発明の効果】将来予測されるより低い電圧のマイクロ
プロセッサに対する電源電圧の変更に対応することので
きるようにプログラムされるよう設計されたＤＣ−ＤＣ
コンバータコントローラが提供される。
【図面の簡単な説明】
【図１】 本発明に基づくプログラム可能なＤＣ−Ｄ
Ｃコンバータコントローラのブロック図。
【図２】 図１のコントローラで用いられるデジタル
・アナログコンバータの模式的なブロック図。
【図３】 図２のデジタル・アナログコンバータへ２
つの基準電圧のうちの１つを選択的に供給する回路の模
式的なブロック図。
【図４】 図２のデジタル・アナログコンバータへ２
つのレベルの電流のうちの１つを選択的に供給する回路
の模式的なブロック図。
【図５】 図１のコントローラで用いられているデジ
タル制御回路の１部を表す模式図。
【図６】 図１のコントローラで用いられているデジ
タル制御回路の他の部分を表す模式図。
【符号の説明】
１０ プログラム可能なＤＣ−ＤＣコンバータコントロ
ーラ １２ アナログ制御回路 １６、１８、２０ 信号条件付け増幅器 ２２ 比較器 ２４ デジタル制御回路 ２６ ＩＦＢ（電流フィードバック）端子 ２８ ＶＦＢ（電圧フィードバック）端子 ３０ 電流制御信号パス ３２ 電圧制御信号パス ３４ 発振器 ３５ 外部のキャパシタ ３６、３８ 外部の電力ＭＯＳＦＥＴ（トランジスタ） ４０ 出力ライン ４２、４４ 高電流出力トライバ ４６ ノード ４８ フローティングキャパシタ ５０ ダイオード ５１ ダイオード ５４ ＤＡＣ ６４ 基準電圧回路 ７２ 第１のゲイン選択増幅器 ７４ 第２のゲンイ選択増幅器 ８２ ＲＳラッチ ８６、８８ ＮＯＲゲート ９０ ＮＯＲゲート

Claims (10)

    【特許請求の範囲】
  1. 【請求項１】 プログラム可能なコンバータであっ
    て、 出力信号を供給する少なくとも１つの増幅器と、 前記少なくとも１つの増幅器の出力信号の大きさを制御
    する制御ユニットと、 デジタル入力信号に応じて、前記少なくとも１つの増幅
    器の前記出力信号の前記大きさを特定する出力信号を、
    前記制御ユニットに供給する回路であって、各々が特定
    の値の増加分を有する前記大きさの２つの範囲を特定す
    る前記回路とを有することを特徴とするプログラム可能
    なコンバータ。
  2. 【請求項２】 前記回路が、デジタル・アナログ変換
    器を有することを特徴とする請求項１に記載のプログラ
    ム可能なコンバータ。
  3. 【請求項３】 前記デジタル・アナログ変換器が、 外部の装置から、前記外部の装置によって必要とされる
    電圧を特定する５ビットのデジタル入力信号を受け取
    り、前記デジタル入力信号を、アナログ出力信号に変換
    することを特徴とする請求項２に記載のプログラム可能
    なコンバータ。
  4. 【請求項４】 前記アナログ出力信号が、前記少なく
    とも１つの増幅器の前記出力信号の前記大きさを特定す
    る、前記制御ユニットへの前記出力信号からなることを
    特徴とする請求項３に記載のプログラム可能なコンバー
    タ。
  5. 【請求項５】 前記デジタル・アナログ変換器の前記
    アナログ出力信号が、前記制御ユニットに供給されるこ
    とを特徴とする請求項４に記載のプログラム可能なコン
    バータ。
  6. 【請求項６】 前記デジタル入力信号によって特定さ
    れる前記電圧が、特定された電圧の増加分によって乗算
    された前記デジタル入力の値によって決定されることを
    特徴とする請求項３に記載のプログラム可能なコンバー
    タ。
  7. 【請求項７】 前記外部の装置が、特定された値の増
    加分での要求された電圧を特定することを特徴とする請
    求項６に記載のプログラム可能なコンバータ。
  8. 【請求項８】 前記外部の装置が、マイクロプロセッ
    サを有することを特徴とする請求項３に記載のプログラ
    ム可能なコンバータ。
  9. 【請求項９】 前記特定された電圧の増加分が、前記
    ２つの電圧の範囲の各々において、各々、５ｍＶと、１
    ００ｍＶであることを特徴とする請求項６に記載のプロ
    グラム可能なコンバータ。
  10. 【請求項１０】 前記少なくとも１つの増幅器と、前
    記制御ユニットと、前記回路とが、１つの半導体集積回
    路チップに集積化されていることを請求項１に記載のプ
    ログラム可能なコンバータ。
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