JPS5810036B2 - 多周波信号送出方式 - Google Patents
多周波信号送出方式Info
- Publication number
- JPS5810036B2 JPS5810036B2 JP11575878A JP11575878A JPS5810036B2 JP S5810036 B2 JPS5810036 B2 JP S5810036B2 JP 11575878 A JP11575878 A JP 11575878A JP 11575878 A JP11575878 A JP 11575878A JP S5810036 B2 JPS5810036 B2 JP S5810036B2
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- Japan
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- signal
- frequency signal
- frequency
- time slot
- memory
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
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Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04Q—SELECTING
- H04Q1/00—Details of selecting apparatus or arrangements
- H04Q1/18—Electrical details
- H04Q1/30—Signalling arrangements; Manipulation of signalling currents
- H04Q1/44—Signalling arrangements; Manipulation of signalling currents using alternate current
- H04Q1/444—Signalling arrangements; Manipulation of signalling currents using alternate current with voice-band signalling frequencies
- H04Q1/45—Signalling arrangements; Manipulation of signalling currents using alternate current with voice-band signalling frequencies using multi-frequency signalling
- H04Q1/457—Signalling arrangements; Manipulation of signalling currents using alternate current with voice-band signalling frequencies using multi-frequency signalling with conversion of multifrequency signals into digital signals
- H04Q1/4575—Signalling arrangements; Manipulation of signalling currents using alternate current with voice-band signalling frequencies using multi-frequency signalling with conversion of multifrequency signals into digital signals which are transmitted in digital form
Landscapes
- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
Description
【発明の詳細な説明】
本発明は、複数のディジクル化された単周波信号からデ
ィジクル化多周波信号を作成し、伝送路に送出する多周
波信号送出方式に関するものである。
ィジクル化多周波信号を作成し、伝送路に送出する多周
波信号送出方式に関するものである。
第1図は従来性なわれてきたディジタル化多周波信号送
出方式を実現する多周波信号送出装置の1例を示すもの
である、単周波信号を選択するセレクタ1a、1b1選
択された2つの単周波信号を加算する加算器2、加算き
れた多周波信号にレベル信号を乗算する乗算器3、乗算
結果を圧縮する圧縮器4、レベル信号を送出するレジス
フ5、単周波選択信号を記憶するメモリ6、各種タイミ
ングを発生し、各部を制御する制御回路7およびメモリ
6のアドレスを切替えるセレクタ8より構成される。
出方式を実現する多周波信号送出装置の1例を示すもの
である、単周波信号を選択するセレクタ1a、1b1選
択された2つの単周波信号を加算する加算器2、加算き
れた多周波信号にレベル信号を乗算する乗算器3、乗算
結果を圧縮する圧縮器4、レベル信号を送出するレジス
フ5、単周波選択信号を記憶するメモリ6、各種タイミ
ングを発生し、各部を制御する制御回路7およびメモリ
6のアドレスを切替えるセレクタ8より構成される。
第2図は本発明の対象となる多周波信号送出方式の入力
信号と出力信号の関係を示すタイムチャートである。
信号と出力信号の関係を示すタイムチャートである。
入力信号である単周波信号は、各周波数のアナログ信号
を毎秒8000回サンプリングし、サンプリング結果を
16bitでコード化しく通常音声のサンプリング情報
は8bitでコード化されるが、この場合には加算、乗
算等の演算処理が行われるので歪を少なくするため16
ビツトコード化が必要であるとされている。
を毎秒8000回サンプリングし、サンプリング結果を
16bitでコード化しく通常音声のサンプリング情報
は8bitでコード化されるが、この場合には加算、乗
算等の演算処理が行われるので歪を少なくするため16
ビツトコード化が必要であるとされている。
)8.192Mb/sの速度で送られてくる。
8Kb/sのクロックはサンプリング周期を示しており
、同−周期内の単周波信号は同じ信号である。
、同−周期内の単周波信号は同じ信号である。
出力の信号線は8bit単位のタイムスロットがNo、
0=No。
0=No。
127の128あり、又8Kb/sのクロックは、No
、0タイムスロツトのはじめを示す。
、0タイムスロツトのはじめを示す。
以下第1図および第2図を用いて従来技術について説明
する。
する。
外部装置は、送出したい多周波信号の選択信号データを
メモリ6に書込む。
メモリ6に書込む。
なお、この際メモリ6のアドレスとタイムスロット番号
は対応しており、外部装置は送出したいタイムスロット
番号すなわちメモリ6のアドレスをセレクタ8を介して
メモリ6に入力する。
は対応しており、外部装置は送出したいタイムスロット
番号すなわちメモリ6のアドレスをセレクタ8を介して
メモリ6に入力する。
一方制御回路7は外部からもらう第2図に示す8Kb/
sおよび8.192Mb/sのクロックからタイムスロ
ット2つに1回、例えば偶数タイムスロット時のみ、メ
モリ6を読み出し、メモリ6の内容に従い、セレクタ1
aおよび1bで2つの単周波信号を選択し、加算器2で
混合し多数波信号を作成し、その多周波信号にレジスタ
5より送られてくるレベル信号を乗算器3で乗算し、圧
縮器4で15bitの信号を8bitに圧縮し、出力信
号として外部に送出する。
sおよび8.192Mb/sのクロックからタイムスロ
ット2つに1回、例えば偶数タイムスロット時のみ、メ
モリ6を読み出し、メモリ6の内容に従い、セレクタ1
aおよび1bで2つの単周波信号を選択し、加算器2で
混合し多数波信号を作成し、その多周波信号にレジスタ
5より送られてくるレベル信号を乗算器3で乗算し、圧
縮器4で15bitの信号を8bitに圧縮し、出力信
号として外部に送出する。
なお、内部の演算により生じた遅れに従い、8.192
Mb/sおよび8Kb/sリランク信号も遅らせ外部に
送出する。
Mb/sおよび8Kb/sリランク信号も遅らせ外部に
送出する。
以上述べた従来の多周波信号送出方式では、入力信号が
15bitであり、それを演算し、8bitに圧縮して
タイムスロットに入れるため、連続する2つのタイムス
ロットに多周波信号を送出することが出来ないという欠
点があった。
15bitであり、それを演算し、8bitに圧縮して
タイムスロットに入れるため、連続する2つのタイムス
ロットに多周波信号を送出することが出来ないという欠
点があった。
また連続する2つのタイムスロットに多周波信号を送出
するためには、例えば偶数タイムスロット用と偶数タイ
ムスロット用に第1図に示すハードウェアを2つ用意し
なければならず多大なハードウェアとなるという欠点が
あった。
するためには、例えば偶数タイムスロット用と偶数タイ
ムスロット用に第1図に示すハードウェアを2つ用意し
なければならず多大なハードウェアとなるという欠点が
あった。
本発明の目的は、上記従来技術の欠点をなくし、少ない
ハードウェアで連続する2つのタイムスロットに多周波
信号を送出できる多周波信号方式を提供することにある
。
ハードウェアで連続する2つのタイムスロットに多周波
信号を送出できる多周波信号方式を提供することにある
。
本発明の特徴は、タイムスロットとは非同期にあらかじ
め考えられる多周波信号をすべて作成、記憶し、外部よ
り指定されたタイムスロットにあらかじめ作成した多周
波信号から外部より指定された1つを選び送出すること
にある。
め考えられる多周波信号をすべて作成、記憶し、外部よ
り指定されたタイムスロットにあらかじめ作成した多周
波信号から外部より指定された1つを選び送出すること
にある。
以下本発明を第2図および第3図を用いて説明する。
なお、第3図は本発明による多周波信号送出方式を実現
する多周波信号送出装置の1構成例を示すものであり、
単周波信号を選択するセレクタ9a+9b)選択された
2つの単周波信号を加算する加算器10、加算された多
周波信号にレベル信号を乗算する乗算器11、乗算結果
を圧縮する圧縮器12、レベル信号を送出するレジスタ
13、各種タイミングを作成し各部を制御する制御回路
14、外部からの指示を記憶するオーダメモリ16、オ
ーダメモリ16のアドレスを切替えるセレクタ15、多
周波信号を記憶するバッファメモリ18、バッファメモ
リ18のアドレスを切替えるセレクタ17および出力信
号を送出するシフトレジスタ19より構成される。
する多周波信号送出装置の1構成例を示すものであり、
単周波信号を選択するセレクタ9a+9b)選択された
2つの単周波信号を加算する加算器10、加算された多
周波信号にレベル信号を乗算する乗算器11、乗算結果
を圧縮する圧縮器12、レベル信号を送出するレジスタ
13、各種タイミングを作成し各部を制御する制御回路
14、外部からの指示を記憶するオーダメモリ16、オ
ーダメモリ16のアドレスを切替えるセレクタ15、多
周波信号を記憶するバッファメモリ18、バッファメモ
リ18のアドレスを切替えるセレクタ17および出力信
号を送出するシフトレジスタ19より構成される。
外部装置はタイムスロット番号に対応するオーダメモリ
16のアドレスに従いそのタイムスロットに送出したい
多周波信号種別をオーダメモリ16に書込む。
16のアドレスに従いそのタイムスロットに送出したい
多周波信号種別をオーダメモリ16に書込む。
一方、制御回路14は、あらかじめ考えられるすべての
単周波信号の組合せについて、その多周波演算が8K(
zの1周期内に終るように単周波選択信号を順次発生す
る。
単周波信号の組合せについて、その多周波演算が8K(
zの1周期内に終るように単周波選択信号を順次発生す
る。
この信号によりセレクタ9aおよび9bを介して2つの
単周波信号が選択され、加算器10で混合され多周波信
号が作成される。
単周波信号が選択され、加算器10で混合され多周波信
号が作成される。
この多周波信号にレジスタ13から送られてくるレベル
信号を乗算器11で乗算し、圧縮器12で15bit信
号を8bitに圧縮し、バッファメモリ18のその多周
波信号に対応するアドレスに書込む。
信号を乗算器11で乗算し、圧縮器12で15bit信
号を8bitに圧縮し、バッファメモリ18のその多周
波信号に対応するアドレスに書込む。
すなわち、バッファメモリ18は考えられるすべての多
周波信号の数だけのワード数を有し、その内容は8KH
zの1周期の間に1回、すなわち125μSの1回書き
替えられる。
周波信号の数だけのワード数を有し、その内容は8KH
zの1周期の間に1回、すなわち125μSの1回書き
替えられる。
また制御回路14は、タイムスロット毎にセレクタ15
を介し、オーダメモリ16を読み、オーダメモリ16の
内容に従い、そのタイムスロットに送出すべき多周波信
号をバッファメモリ18から読み出し、シフトレジスタ
19にセラ・し、8.192Mb/sの信号でシリアル
に外部に送り出す。
を介し、オーダメモリ16を読み、オーダメモリ16の
内容に従い、そのタイムスロットに送出すべき多周波信
号をバッファメモリ18から読み出し、シフトレジスタ
19にセラ・し、8.192Mb/sの信号でシリアル
に外部に送り出す。
以上述べたように、タイムスロットとは非同期にあらか
じめ考えられる多周波信号をすべて作成記憶し、外部か
ら指定されたタイムスロットにあらかじめ作成した多周
波信号から指定された1つをえらび送出することにより
、ハード量が少なく連続する2つのタイムスロットに多
周波信号を送出できる多周波信号送出方式が実現できる
。
じめ考えられる多周波信号をすべて作成記憶し、外部か
ら指定されたタイムスロットにあらかじめ作成した多周
波信号から指定された1つをえらび送出することにより
、ハード量が少なく連続する2つのタイムスロットに多
周波信号を送出できる多周波信号送出方式が実現できる
。
第1図は従来技術による多周波信号送出方式を実現する
多周波信号送出装置の1例を示すブロック図、第2図は
本発明の対象となる多周波信号送出方式の入力信号と出
力信号の関係を示すタイムチャート、第3図は本発明に
よる多周波信号送出方式を実現する多周波信号送出装置
の1実施例を示す1177図である。 9a、9b・・・・・・セレクタ、10・・・・・・加
算器、11・・・・・・乗算器、12・・・・・・圧縮
器、13・・・・・・レジスタ、14・・・・・・制御
回路、15.17・・・・・・セレクタ、16・・・・
・・オーダメモリ、18・・・・・・バッファメモリ、
19・・・・・・シフトレジスタ。
多周波信号送出装置の1例を示すブロック図、第2図は
本発明の対象となる多周波信号送出方式の入力信号と出
力信号の関係を示すタイムチャート、第3図は本発明に
よる多周波信号送出方式を実現する多周波信号送出装置
の1実施例を示す1177図である。 9a、9b・・・・・・セレクタ、10・・・・・・加
算器、11・・・・・・乗算器、12・・・・・・圧縮
器、13・・・・・・レジスタ、14・・・・・・制御
回路、15.17・・・・・・セレクタ、16・・・・
・・オーダメモリ、18・・・・・・バッファメモリ、
19・・・・・・シフトレジスタ。
Claims (1)
- 1 外部からの指示に従い、複数のディジタル化された
単周波信号のうちから、複数の信号を選択混合すること
によって多周波信号を作成し、指定されたタイムスロッ
トに該多周波信号を送出する多周波信号送出方式におい
て、あらかじめ考えられる多周波の組み合わせ数だけの
ワード数を有するメモリを用意し、送出すべきタイムス
ロットとは非同期に、サンプリング周期ごとに該メモリ
の該当するアドレスに多周波の混合信号データを更新し
ておき、外部から指定されたタイムスロットに送出する
時点で外部から指定された多周波信号を上記あらかじめ
作成した多周波信号の中から選択・送出することを特徴
とする多周波信号送出方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11575878A JPS5810036B2 (ja) | 1978-09-22 | 1978-09-22 | 多周波信号送出方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11575878A JPS5810036B2 (ja) | 1978-09-22 | 1978-09-22 | 多周波信号送出方式 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5542442A JPS5542442A (en) | 1980-03-25 |
| JPS5810036B2 true JPS5810036B2 (ja) | 1983-02-23 |
Family
ID=14670315
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP11575878A Expired JPS5810036B2 (ja) | 1978-09-22 | 1978-09-22 | 多周波信号送出方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5810036B2 (ja) |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS57106002A (en) * | 1980-12-23 | 1982-07-01 | Murata Manufacturing Co | Positive temperature coefficient thermistor |
| JP4888264B2 (ja) * | 2006-07-28 | 2012-02-29 | Tdk株式会社 | 積層型サーミスタ及びその製造方法 |
-
1978
- 1978-09-22 JP JP11575878A patent/JPS5810036B2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5542442A (en) | 1980-03-25 |
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