JPS58103244A - 時分割多重変換装置 - Google Patents
時分割多重変換装置Info
- Publication number
- JPS58103244A JPS58103244A JP56202790A JP20279081A JPS58103244A JP S58103244 A JPS58103244 A JP S58103244A JP 56202790 A JP56202790 A JP 56202790A JP 20279081 A JP20279081 A JP 20279081A JP S58103244 A JPS58103244 A JP S58103244A
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- JP
- Japan
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- time
- signal
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- storage device
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Classifications
-
- G—PHYSICS
- G10—MUSICAL INSTRUMENTS; ACOUSTICS
- G10H—ELECTROPHONIC MUSICAL INSTRUMENTS; INSTRUMENTS IN WHICH THE TONES ARE GENERATED BY ELECTROMECHANICAL MEANS OR ELECTRONIC GENERATORS, OR IN WHICH THE TONES ARE SYNTHESISED FROM A DATA STORE
- G10H1/00—Details of electrophonic musical instruments
- G10H1/18—Selecting circuits
Landscapes
- Physics & Mathematics (AREA)
- Engineering & Computer Science (AREA)
- Acoustics & Sound (AREA)
- Multimedia (AREA)
- Electrophonic Musical Instruments (AREA)
- Time-Division Multiplex Systems (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、時分割多重化された信号の順序を変更するこ
とにより、各々の信号の伝送先を変換するようにして、
各々の信号の処理を変更できるようにした時分割多重変
換装置に関し、とくに電子楽器の効果の選択等に適した
時分割多重変換装置を提供するものである、 最近、電子楽器の楽音信号をディジタル的に発生する場
合、たとえば上鍵盤の楽音信号とを時分割多重化して発
生させることが多い。この場合、上鍵盤の楽音信号にト
レモロ変調をかけ、下鍵盤の楽音信号にビブラート変調
をかけようとすると、時分割多重化された上下鍵盤の各
楽音信号をスイッチで切換え、互に異なる伝送ラインに
挿入されたトレモロ変調器とビブラート変調器に振り分
けて入力するのが通例である。ところが、このようにす
ると、機械的なスイッチを用いても電子的なスイッチを
用いても構造が複雑になるという問題がある。
とにより、各々の信号の伝送先を変換するようにして、
各々の信号の処理を変更できるようにした時分割多重変
換装置に関し、とくに電子楽器の効果の選択等に適した
時分割多重変換装置を提供するものである、 最近、電子楽器の楽音信号をディジタル的に発生する場
合、たとえば上鍵盤の楽音信号とを時分割多重化して発
生させることが多い。この場合、上鍵盤の楽音信号にト
レモロ変調をかけ、下鍵盤の楽音信号にビブラート変調
をかけようとすると、時分割多重化された上下鍵盤の各
楽音信号をスイッチで切換え、互に異なる伝送ラインに
挿入されたトレモロ変調器とビブラート変調器に振り分
けて入力するのが通例である。ところが、このようにす
ると、機械的なスイッチを用いても電子的なスイッチを
用いても構造が複雑になるという問題がある。
本発明はこのような問題を解決するために、時分割多重
化された信号を一旦記憶装置に書き込み、その時分割多
重の順序を入れかえて読み出すことにより、時分割多重
化された各信号に対して互に異なる変調等がかけられる
ようにした時分割多重変換装置を提供するものである。
化された信号を一旦記憶装置に書き込み、その時分割多
重の順序を入れかえて読み出すことにより、時分割多重
化された各信号に対して互に異なる変調等がかけられる
ようにした時分割多重変換装置を提供するものである。
第１図は本発明の一実施例のブロック図である。
１は記憶装置で、ＤＩ端子に時分割多重化された入力信
号が印加され、Ｒ／Ｗ端子に入力されるＲ／Ｗ信号が書
き込み状態Ｎｏ″の立上り時に入力信号が書き込まれ、
′１′のとき、Ｄ６端子より、読み出される。このとき
入力信号が８種類の信号Ｄ１．Ｄ２．Ｄ３．・・・・・
・・・・、Ｄ８より成り、各信号が１６ピントで構成さ
れているものとすると、記憶装置１は、１６ビツトＸ８
＝１２８ビツトの容量を持つようにする。書き込みと読
み出しが行なわれる記憶装置１の内部の位置は、ＡＤ端
子に印加される３ピツトのアドレスコードによって指定
される。一方、３はアドレス発生器で、たとえば、３ビ
ツトのアドレスカウンタで構成され、計数はクロック信
号ＧＫにより行なわれる。ここで時分゛割多重は８個の
入力信号に対して行なわれているから、その第１番の信
号と同時に、クリア信号ＣＬによりカウンタ３をクリア
して計数を開始させれば、カウンタ３の出力コードは、
時分割多重の順序に対応して発生される。これを時分割
多重の順序を示すアドレスコードＡＤ１と呼ぶ。アドレ
スコードＡＤ１は、アドレス変換器４に入力され、別の
アドレスコードＡＤ２に変換される。アドレスコードＡ
Ｄ１とＡＤ２は、セレクタ２に入力され、Ｒ／Ｗ信号に
したがって、いずれか一方が交互に記憶装置１のＡＤ端
子に印加される。
号が印加され、Ｒ／Ｗ端子に入力されるＲ／Ｗ信号が書
き込み状態Ｎｏ″の立上り時に入力信号が書き込まれ、
′１′のとき、Ｄ６端子より、読み出される。このとき
入力信号が８種類の信号Ｄ１．Ｄ２．Ｄ３．・・・・・
・・・・、Ｄ８より成り、各信号が１６ピントで構成さ
れているものとすると、記憶装置１は、１６ビツトＸ８
＝１２８ビツトの容量を持つようにする。書き込みと読
み出しが行なわれる記憶装置１の内部の位置は、ＡＤ端
子に印加される３ピツトのアドレスコードによって指定
される。一方、３はアドレス発生器で、たとえば、３ビ
ツトのアドレスカウンタで構成され、計数はクロック信
号ＧＫにより行なわれる。ここで時分゛割多重は８個の
入力信号に対して行なわれているから、その第１番の信
号と同時に、クリア信号ＣＬによりカウンタ３をクリア
して計数を開始させれば、カウンタ３の出力コードは、
時分割多重の順序に対応して発生される。これを時分割
多重の順序を示すアドレスコードＡＤ１と呼ぶ。アドレ
スコードＡＤ１は、アドレス変換器４に入力され、別の
アドレスコードＡＤ２に変換される。アドレスコードＡ
Ｄ１とＡＤ２は、セレクタ２に入力され、Ｒ／Ｗ信号に
したがって、いずれか一方が交互に記憶装置１のＡＤ端
子に印加される。
第２図は、上記実施例のタイミングチャートの一例であ
る。入力信号り４．Ｄ２．・・・・・・・・・、Ｄ８が
順次入力され、Ｒ／Ｗ信号の立上りで所定のアドレスに
記憶され、Ｒ／Ｗ信号のＮ１＃のとき読み出される。書
き込みアドレスＡＤ１は、まずＯＬ倍信号クリアされて
から順次増加するから、Ｄｌ。
る。入力信号り４．Ｄ２．・・・・・・・・・、Ｄ８が
順次入力され、Ｒ／Ｗ信号の立上りで所定のアドレスに
記憶され、Ｒ／Ｗ信号のＮ１＃のとき読み出される。書
き込みアドレスＡＤ１は、まずＯＬ倍信号クリアされて
から順次増加するから、Ｄｌ。
Ｄ ・・・・・・・・・、Ｄ８の順に書き込まれる。そ
して上Ｉ 記アドレスコードＡＤ１はアドレス変換器４でＡＤ２に
変換される。その関係は、第２図の例では、 ＡＤ１＝［：１．２，３，４，６，６，７．８ 〕に対
し ＡＤ２二〔８，７，６，６，４，３，２，１〕となって
いる。したがって、出力は、Ｄ８．Ｄ７．・・・・・・
・・・、Ｄ２．Ｄｌ と逆の順序で出力される。
して上Ｉ 記アドレスコードＡＤ１はアドレス変換器４でＡＤ２に
変換される。その関係は、第２図の例では、 ＡＤ１＝［：１．２，３，４，６，６，７．８ 〕に対
し ＡＤ２二〔８，７，６，６，４，３，２，１〕となって
いる。したがって、出力は、Ｄ８．Ｄ７．・・・・・・
・・・、Ｄ２．Ｄｌ と逆の順序で出力される。
アドレス変換器４は、入力コードを変換して出力するも
のなら、種々のものが使用できる。たとえば、３ピツト
×８ワードの読み出しメモリ（ＲＯＭ）でもよい。この
ような読み出しメモリを複数個設けて、そのうちから選
択信号により選択切換えて使用するようにすれば、出力
信号の並び方を切換えることができる。
のなら、種々のものが使用できる。たとえば、３ピツト
×８ワードの読み出しメモリ（ＲＯＭ）でもよい。この
ような読み出しメモリを複数個設けて、そのうちから選
択信号により選択切換えて使用するようにすれば、出力
信号の並び方を切換えることができる。
第１図において、６は時分割多重方式の変調装置であっ
て、同一出願人による昭和６”６年１１月１２日付提出
の特許願（４３） ｒディジタル楽音変調装置」に示
したようなものである。
て、同一出願人による昭和６”６年１１月１２日付提出
の特許願（４３） ｒディジタル楽音変調装置」に示
したようなものである。
このような変調装置６に対して入力信号り、。
Ｄ２．・・・・・・・・・、Ｄ８をＤ８． Ｄ７．・・
・・・・・・・、Ｄｌ のように切換えて順次入力す
れば、本来入力信号Ｄ１に対してたとえばトレモロ変調
がかかるものであっても、入力信号Ｄ８に対してトレモ
ロ変調をかけることができる。
・・・・・・・、Ｄｌ のように切換えて順次入力す
れば、本来入力信号Ｄ１に対してたとえばトレモロ変調
がかかるものであっても、入力信号Ｄ８に対してトレモ
ロ変調をかけることができる。
したがってアドレス変換器４の選択信号を電子楽器のト
レモロ変調効果、ビブラート変調効果等の効果の選択に
したがって切換えれば、時分割多重化された複数の信号
に対して所定の効果を付加することができる。
レモロ変調効果、ビブラート変調効果等の効果の選択に
したがって切換えれば、時分割多重化された複数の信号
に対して所定の効果を付加することができる。
もちろん、本発明は効果の選択に限らず、たとえば上下
鍵盤の楽音信号ごとにスピーカを切換える場合等にも応
用できる。
鍵盤の楽音信号ごとにスピーカを切換える場合等にも応
用できる。
以上のように、本発明は時分割多重化された複数の信号
を上記時分割多重の順序を表わすアドレスコードにした
がって一旦記憶装置に書き込んでおき、上記アドレスコ
ードを変換した第２のアドレスコードにしたがって読み
出すことにより時分割多重の順序を変更するようにした
ものであるから、上記第１．第２のアドレスコードの変
換関係を変化させることにより時分割多重の順序を任意
に変化させることができる。したがって上記変換関係を
電子楽器の効果の選択に応じて変化させるようにすれば
、複雑な回路切換えを行なうことなく、時分割多重化さ
れた各信号に対して所定の効果を付与することができる
。
を上記時分割多重の順序を表わすアドレスコードにした
がって一旦記憶装置に書き込んでおき、上記アドレスコ
ードを変換した第２のアドレスコードにしたがって読み
出すことにより時分割多重の順序を変更するようにした
ものであるから、上記第１．第２のアドレスコードの変
換関係を変化させることにより時分割多重の順序を任意
に変化させることができる。したがって上記変換関係を
電子楽器の効果の選択に応じて変化させるようにすれば
、複雑な回路切換えを行なうことなく、時分割多重化さ
れた各信号に対して所定の効果を付与することができる
。
第１図は本発明の一実施例のブロック図、第２図はその
タイミングチャートを示す図である。 １・・・・・・記憶装置、２・・・・・・セレクタ、３
・・・・・・アドレス発生器、４・・・・・・アドレス
変換器、６・・・・・・変調装置。
タイミングチャートを示す図である。 １・・・・・・記憶装置、２・・・・・・セレクタ、３
・・・・・・アドレス発生器、４・・・・・・アドレス
変換器、６・・・・・・変調装置。
Claims (1)
- （１） 時分割多重された複数の入力信号を書き込む
記憶装置と、上記時分割多重の順序を表わす第１のアド
レスコードを発生するアドレス発生器と、上記アドレス
発生器の出力する第１のアドレスコードを第２のアドレ
スコードに変換するアドレス変換器と、上記アドレス変
換器の複数の変換関係のうちの１つを選択する選択信号
発生器とを備え、上記第１のアドレスシードと第２のア
ドレスコードの一方にしたがって上記入力信号を順次上
記記憶装置に書き込み、他方のアドレスコードにしたが
って上記記憶装置から読み出すようにして上記時分割多
重の順序を変更すると共に、上記選択信号発生器の出力
する選択信号を変化させることにより上記変換関係を切
り換えるようにした時分割多重変換装置。 （２、特許請求の範囲第１項の記載において、選択信号
を、電子楽器の効果の選択にした７５玉って切り換える
ようにした時分割多重変換装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56202790A JPS58103244A (ja) | 1981-12-15 | 1981-12-15 | 時分割多重変換装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56202790A JPS58103244A (ja) | 1981-12-15 | 1981-12-15 | 時分割多重変換装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS58103244A true JPS58103244A (ja) | 1983-06-20 |
Family
ID=16463231
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP56202790A Pending JPS58103244A (ja) | 1981-12-15 | 1981-12-15 | 時分割多重変換装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58103244A (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5156106A (ja) * | 1974-11-13 | 1976-05-17 | Fujitsu Ltd | Jibunkatsudeijitarukokankino taimusurotsutoirekaehoshiki |
-
1981
- 1981-12-15 JP JP56202790A patent/JPS58103244A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5156106A (ja) * | 1974-11-13 | 1976-05-17 | Fujitsu Ltd | Jibunkatsudeijitarukokankino taimusurotsutoirekaehoshiki |
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