JPS58127329A - 半導体基板の絶縁保護膜の蝕刻方法 - Google Patents

半導体基板の絶縁保護膜の蝕刻方法

Info

Publication number
JPS58127329A
JPS58127329A JP57010373A JP1037382A JPS58127329A JP S58127329 A JPS58127329 A JP S58127329A JP 57010373 A JP57010373 A JP 57010373A JP 1037382 A JP1037382 A JP 1037382A JP S58127329 A JPS58127329 A JP S58127329A
Authority
JP
Japan
Prior art keywords
semiconductor substrate
film
protection film
window
insulating protection
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP57010373A
Other languages
English (en)
Inventor
Tadahiro Nakamichi
中道 忠弘
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Seiko Epson Corp
Suwa Seikosha KK
Original Assignee
Seiko Epson Corp
Suwa Seikosha KK
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Seiko Epson Corp, Suwa Seikosha KK filed Critical Seiko Epson Corp
Priority to JP57010373A priority Critical patent/JPS58127329A/ja
Publication of JPS58127329A publication Critical patent/JPS58127329A/ja
Pending legal-status Critical Current

Links

Classifications

    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10PGENERIC PROCESSES OR APPARATUS FOR THE MANUFACTURE OR TREATMENT OF DEVICES COVERED BY CLASS H10
    • H10P50/00Etching of wafers, substrates or parts of devices

Landscapes

  • Drying Of Semiconductors (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 本発明は、半導体基板上の8i酸化換をドライエツチン
グ処理によって蝕刻する方法に関する。
半導体集積回路の絶縁膜[11:として、通常、P(リ
ン)拡散された8イ酸化11(P8GIりが広く使用さ
れている。この絶縁膜護膜(P8GI[)に窓をあけた
後、電極や配線材料としてムAllあるいは11合金膜
を蒸着し、絶縁保諷膜下の各素子間の相互接続を行なっ
ている。ζこで、ムjllあるいは11合金膜と、窓あ
けしたところの各素子との接合性が良い(電気的抵抗が
低い)ことが重要である。
ところで、この絶縁II(P8G膜)への窓あ妙は、非
常に微細な加工(2〜4μ愼0)が要求されるため、C
X7!!(フレオン)系統のガスグッズマなど応用し九
ド2イエッチング方法が用いられている。ドライエツチ
ング処理は、微細加工がで自るだけでなく、従来の水浴
i1(例えば7ツ酸水嬉液)利用のエッチ処理に比べ、
廃液の必要性がなく、無公害化、あるい紘作業の自動化
が図れるなど多くの蛎点をもつ。
しかしながら、絶縁保護膜の窓あけをドライエツチング
した場合、絶縁膜護膜を除去した愈の半導体基板上に、
反応ガス中の成分、あるいは反応生成物が付着した夛、
浅く拡散している。この現象は、工Mム分析など行なう
ことで、付着あるいは拡散された成分又は反応生成物を
明らかにできる。分析結果の1例を第111に示す。こ
れらの付着物あるいは拡散され九反応生成物があると、
窓あけしたところのムj膜と半導体基板との接合性〔電
気的抵抗)が悪いことが明らかKされている。
この接合性は、半導体装置そのものの東、不良を求める
]i要な特性である。
こうした欠点を取ル除くえめに、絶縁膜(PaGm)を
ドライエツチング処理で窓あけし先後、0、ガスプラズ
ヤ処理を施すことが、非常に有効である。01プラズマ
M!IKよシ、半導体基板上に付着したガス成分あるい
は反応生成物が、かなシ除去されることがiagされた
。本発明は、このように絶縁膜護膜(PH3膜)をドラ
イエツチング処理にて窓あけし先後、Ωgプラズマ処処
理施すことを特徴とした半導体基板の絶縁膜護膜の蝕刻
方法である。
次に本発明の詳細な説明する。第2図には、絶縁保護膜
(PH3膜)をドライエツチング処理にて慾あけした直
後の半導体基板上の表面分析結果lと、その後0曹グツ
ズマ処理した半導体基板上の表面分析結果2を比較して
示している。第2図において示したように、Olプラズ
マ処理はC(炭素)、IF(7ツ素)* ’ g(マブ
ネシウム)、NG(ナトリウム)などの除去に大変効果
的であることが理解できる。実際、このようKしてOl
プラズマ処理し九ものは、ムAmlあるいはムj合金膜
と窓あけしたところの半導体基板への接合性が良い(電
気的抵抗が低い)ことが確認できた。
以上説明したように、本発明は半導体集積回路の絶縁膜
護膜として用いたP 8 e![t−、ガスプラズマに
よりエツチング処理した後、0雪ガスプラズマを照射す
ることで、半導体基板上の汚染除去を効果的に、かつ簡
単に行なうものである。
なお、絶縁膜S膜としてリンを拡散したPH3膜につい
て説明したが、リン以外の元素を含んだ84駿化膜ある
いは他に何も含まない81酸化膜に′)いても適用でき
ることは云うまでもない。
又、01ガスプ2ズ!単体でなく、0雪ガスを含む何ら
かのガスプラズマを照射することKよυ、汚染除去する
場合においても、本発明の1例と見なすことができる。
【図面の簡単な説明】
第1図には、絶縁膜m1ll(P!iG)をドライエツ
チング処理して窓あけし九直後の表面分析結果の1例を
示す図。第2図にはドライエツチング直後の表面分析結
果1.及びその後01プラズマ処理した半導体基板上の
表面分析結果2を両者比較した図。 以   上 出願人 株式会社諏訪精工舎 代理人 弁理士最 上  務

Claims (1)

  1. 【特許請求の範囲】 1、絶縁膜としての8(酸化膜を形成する工程2、上記
    Sイ酸化膜を覆うフォトレジストの塗布工程及び露光工
    程 3、上記半導体基板をグツズ!ガスによシトライエツチ
    ングする工程 上記工程を含み、第3の工1の後、Ol又は0!を含む
    混合ガスプラズマ照射による、半導体基板上の汚染除去
    を特徴とする半導体基板の絶縁保護膜の蝕刻方法。
JP57010373A 1982-01-26 1982-01-26 半導体基板の絶縁保護膜の蝕刻方法 Pending JPS58127329A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP57010373A JPS58127329A (ja) 1982-01-26 1982-01-26 半導体基板の絶縁保護膜の蝕刻方法

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP57010373A JPS58127329A (ja) 1982-01-26 1982-01-26 半導体基板の絶縁保護膜の蝕刻方法

Publications (1)

Publication Number Publication Date
JPS58127329A true JPS58127329A (ja) 1983-07-29

Family

ID=11748336

Family Applications (1)

Application Number Title Priority Date Filing Date
JP57010373A Pending JPS58127329A (ja) 1982-01-26 1982-01-26 半導体基板の絶縁保護膜の蝕刻方法

Country Status (1)

Country Link
JP (1) JPS58127329A (ja)

Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6127636A (ja) * 1984-07-17 1986-02-07 Nec Corp ドライエツチング方法
JPS6197824A (ja) * 1984-10-18 1986-05-16 Sanyo Electric Co Ltd 半導体装置のコンタクトホ−ル形成方法
JPS61240631A (ja) * 1985-04-18 1986-10-25 Nec Corp 半導体集積回路の製造方法
JPH02219231A (ja) * 1988-12-21 1990-08-31 American Teleph & Telegr Co <Att> 半導体集積回路内の移動性イオン汚染を低減するための方法

Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5687325A (en) * 1979-12-19 1981-07-15 Chiyou Lsi Gijutsu Kenkyu Kumiai Manufacture of semiconductor device

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5687325A (en) * 1979-12-19 1981-07-15 Chiyou Lsi Gijutsu Kenkyu Kumiai Manufacture of semiconductor device

Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6127636A (ja) * 1984-07-17 1986-02-07 Nec Corp ドライエツチング方法
JPS6197824A (ja) * 1984-10-18 1986-05-16 Sanyo Electric Co Ltd 半導体装置のコンタクトホ−ル形成方法
JPS61240631A (ja) * 1985-04-18 1986-10-25 Nec Corp 半導体集積回路の製造方法
JPH02219231A (ja) * 1988-12-21 1990-08-31 American Teleph & Telegr Co <Att> 半導体集積回路内の移動性イオン汚染を低減するための方法

Similar Documents

Publication Publication Date Title
Beck Integrated circuit failure analysis: a guide to preparation techniques
US4428796A (en) Adhesion bond-breaking of lift-off regions on semiconductor structures
JPH08250460A (ja) 半導体基板の表面処理液、この処理液を用いた表面処理方法及び表面処理装置
JP2841627B2 (ja) 半導体ウェーハの洗浄方法
JPH08335563A (ja) 皮膜除去方法および装置
KR930022467A (ko) 알루미늄계 패턴의 형성방법
JPS58127329A (ja) 半導体基板の絶縁保護膜の蝕刻方法
JPH09145564A (ja) ホール内部の汚染分析方法
JPS58127328A (ja) 半導体基板の絶縁保護膜の蝕刻方法
JP2004200653A (ja) 基板の粘着表面の形成方法及び形成装置
TWI236724B (en) Method of wafer defect monitoring
JPH09179085A (ja) 液晶素子の製造方法及び該製造方法に用いられる放電処理装置
JPS6378057A (ja) 不純物分析法
JPS6244995A (ja) 静電気除去装置
JPH04103124A (ja) 半導体基板の汚染除去方法
JPH09266188A (ja) 表面清浄化方法
JPS5866334A (ja) 半導体基板の処理装置
JPH02310922A (ja) 多層配線集積回路のエッチング方法
Phillips et al. Quantification of Silicon Wafer Cleaning Using Secondary Ion Mass Spectroscopy
JP2000098320A (ja) 洗浄方法および洗浄装置
JPS62198125A (ja) ドライエツチング方法
JPH04103130A (ja) 半導体装置の製造方法
JPS59210644A (ja) 半導体装置の製造方法
JPH03211831A (ja) 半導体基板の洗浄方法
JPH04196424A (ja) 半導体装置の洗浄方法