JPS5813050A - パケツト受信蓄積方式 - Google Patents
パケツト受信蓄積方式Info
- Publication number
- JPS5813050A JPS5813050A JP56111806A JP11180681A JPS5813050A JP S5813050 A JPS5813050 A JP S5813050A JP 56111806 A JP56111806 A JP 56111806A JP 11180681 A JP11180681 A JP 11180681A JP S5813050 A JPS5813050 A JP S5813050A
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- cce
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-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L12/00—Data switching networks
- H04L12/54—Store-and-forward switching systems
- H04L12/56—Packet switching systems
Landscapes
- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Data Exchanges In Wide-Area Networks (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明はパケット交換のパケット送受信方式にお−で１
重化され九過信制御装置（ｃｃｍ）円Ｏパケット格納用
メモリ（ＰＭ）および中央地理装置（ＣＰＵ）Ｏ主記憶
装置（ｍ）へのパケット受信蓄積方式に関するものであ
る。
重化され九過信制御装置（ｃｃｍ）円Ｏパケット格納用
メモリ（ＰＭ）および中央地理装置（ＣＰＵ）Ｏ主記憶
装置（ｍ）へのパケット受信蓄積方式に関するものであ
る。
第１ｗＡはＣＣｌ１ｉとＣＩ”Ｕとの構成を示すブ臣ツ
ク図であ為。ＣＰｔＩは中央制御装置（ＣＣ）とＭＭＫ
よシ構虞１れ、ＣＣＩ ａフｕ ７１ 転送１１１ｕ御
１ｌ（ＩＩＴｃ） 、 ＰＭ 。
ク図であ為。ＣＰｔＩは中央制御装置（ＣＣ）とＭＭＫ
よシ構虞１れ、ＣＣＩ ａフｕ ７１ 転送１１１ｕ御
１ｌ（ＩＩＴｃ） 、 ＰＭ 。
回線制御＠ （ＬＣＴ）および本発明を実施す為丸めの
ＰＭ格納制御１！（ＰＷＣ）とによ）構成される。なお
１、 ！ｌ、 Ｌ ４はそれぞれＭＶ−ＣＣ，ＣＣ−１
１’ｒＣ，ＩＩＴＣ−ＰＭ。
ＰＭ格納制御１！（ＰＷＣ）とによ）構成される。なお
１、 ！ｌ、 Ｌ ４はそれぞれＭＶ−ＣＣ，ＣＣ−１
１’ｒＣ，ＩＩＴＣ−ＰＭ。
１’ｒｃ−ＬＣＴ間を接続し、 鋏接続されて−る各構
成要素間の情報を送受転送する線である。以下の説明で
該各構成要素関Ｏ情報送受転送は誼線を介して行なわれ
る。
成要素間の情報を送受転送する線である。以下の説明で
該各構成要素関Ｏ情報送受転送は誼線を介して行なわれ
る。
ＪＩＩ１図においてＣＣＩ ｄｌ線からパケットを受信
すると、七〇一部をＰＭに格納し、他部をｃｐｖへ転送
する。ｃｐｖは受信したパケットを膓（格納し、ルーテ
インダ感理等を実施した後、パケットをＣＣＩＣへ逆転
送する。ｃｃｍはＣＰＵから該転送され九パケットを受
電るとＰＭＰｉＫ格納していた蚊パケットの倫藝と結合
してＣＰＵから指定された回線へ腋パケツＦを送出する
。
すると、七〇一部をＰＭに格納し、他部をｃｐｖへ転送
する。ｃｐｖは受信したパケットを膓（格納し、ルーテ
インダ感理等を実施した後、パケットをＣＣＩＣへ逆転
送する。ｃｃｍはＣＰＵから該転送され九パケットを受
電るとＰＭＰｉＫ格納していた蚊パケットの倫藝と結合
してＣＰＵから指定された回線へ腋パケツＦを送出する
。
通常ＣＣＥは８重化されてお〕、障害が発生すると装置
切替えを実施し、ｗＩＣＣ１ｉ８処理の中断を防止して
いる。しかし装置切替えを実施した場合、切替え後現用
系となったＣＣＥ内ＯＰＭ内にパケットが存在しない場
合には回線へパケットを送出することは不可能となる。
切替えを実施し、ｗＩＣＣ１ｉ８処理の中断を防止して
いる。しかし装置切替えを実施した場合、切替え後現用
系となったＣＣＥ内ＯＰＭ内にパケットが存在しない場
合には回線へパケットを送出することは不可能となる。
このためｃｃｇでパケットを受信し、ＰＭＩＩＣ格納す
る場合嬬倫系（予備系） ｃｃｇ円のＰＭにもパケット
を格納する仁とによ）、装置切替え時のパケットの紛失
を防止している。しかし従来は予備系ｃｃｙｔ： ＯＰ
Ｍへパケットを格納する処理についてはＣＰＵの動作と
は無関係に実施してｉたため、腋処理が終了した後ＣＰ
υへ転送中のパケットが紛失する場合があつ九。
る場合嬬倫系（予備系） ｃｃｇ円のＰＭにもパケット
を格納する仁とによ）、装置切替え時のパケットの紛失
を防止している。しかし従来は予備系ｃｃｙｔ： ＯＰ
Ｍへパケットを格納する処理についてはＣＰＵの動作と
は無関係に実施してｉたため、腋処理が終了した後ＣＰ
υへ転送中のパケットが紛失する場合があつ九。
たとえばＣＣＥが予備系ｃｃｍのＰＭへパケットの一部
を格納し先後、現用系ＣＣＩ Ｋ障害が発生し装置切替
えを行なうと、ＣＣｌ３内−存在するＣＰＵへ未転送の
パケットの他部が紛失することとなる。この場合ＣＰＵ
はパケットを受信したことを検出で龜ず、し九がって回
線への送信も実施しない丸め、ＰＭ円Ｏパケットも永久
に回線へ送信されることなく、ＰＭを無効保留すること
となる。
を格納し先後、現用系ＣＣＩ Ｋ障害が発生し装置切替
えを行なうと、ＣＣｌ３内−存在するＣＰＵへ未転送の
パケットの他部が紛失することとなる。この場合ＣＰＵ
はパケットを受信したことを検出で龜ず、し九がって回
線への送信も実施しない丸め、ＰＭ円Ｏパケットも永久
に回線へ送信されることなく、ＰＭを無効保留すること
となる。
本発明の１的は前述の欠点を改善し、ＰＭの無効保留を
無くすことにある。
無くすことにある。
本発明の実施例をｌ１１面について以下説明する。
第１図においてｃｃｍは回線からパケットを受信すると
、その一部をＰＭに格納するとともに、他部をＣＰＵへ
転送しさもＫ ＣＰＵヘパケットを受信し九ことをパケ
ットを格納したＰＭアドレスとともに報告する。この間
ＰＷＣＨ予備系ＣＣＩ （２） ＰＭのパケットＯｍ納
を行なわない。ＣＰＵはＣＣＥからのパケット受信報告
を受け、鹿にパケットが格納されていることを確認した
後、ＰｗｃＫ対し予備系ＣＣＩ ｏＰＭへのパケット格
納を指示する。ＰＷＣはこの命令を受電ると自装置内Ｏ
ＰＭＫ格納されているパケットを予備系ＣＣＩ ＯＰＭ
へ転送する。 さらにｃｃｉｃ ＨこＯ転送が正常ＫＱ
われたことを確認した後、ＣＰＵへ割込みをかけ±こと
に！ｊ）、ＣＰＵへ予備系ＣＣＥＯＰＭへ０転送“了し
九〇とを報告す６・ ５゜ブト送信時にはＣＰＵは送信
パケットとともに、結合すべ亀パケットが格納されてい
るＰＭアドレスをＣＣＥに転送し、ｃｃｇ内で該両デー
タを結会し先後回線へ送出する。以上示し丸ように本発
明を実施するためのＰＷＣは予備系ＰＭへのパケットの
格納を行う。第冨図にＣＰＵとＣＣＨｊｌｌ Ｏ各命令
シーケンスを例示する。
、その一部をＰＭに格納するとともに、他部をＣＰＵへ
転送しさもＫ ＣＰＵヘパケットを受信し九ことをパケ
ットを格納したＰＭアドレスとともに報告する。この間
ＰＷＣＨ予備系ＣＣＩ （２） ＰＭのパケットＯｍ納
を行なわない。ＣＰＵはＣＣＥからのパケット受信報告
を受け、鹿にパケットが格納されていることを確認した
後、ＰｗｃＫ対し予備系ＣＣＩ ｏＰＭへのパケット格
納を指示する。ＰＷＣはこの命令を受電ると自装置内Ｏ
ＰＭＫ格納されているパケットを予備系ＣＣＩ ＯＰＭ
へ転送する。 さらにｃｃｉｃ ＨこＯ転送が正常ＫＱ
われたことを確認した後、ＣＰＵへ割込みをかけ±こと
に！ｊ）、ＣＰＵへ予備系ＣＣＥＯＰＭへ０転送“了し
九〇とを報告す６・ ５゜ブト送信時にはＣＰＵは送信
パケットとともに、結合すべ亀パケットが格納されてい
るＰＭアドレスをＣＣＥに転送し、ｃｃｇ内で該両デー
タを結会し先後回線へ送出する。以上示し丸ように本発
明を実施するためのＰＷＣは予備系ＰＭへのパケットの
格納を行う。第冨図にＣＰＵとＣＣＨｊｌｌ Ｏ各命令
シーケンスを例示する。
以上説明しえように本発明によるとＣＣＩ ＯＰＭの無
効保留を防止することがで會るた、め、該ＰＭの無効保
留によって該ＰＭの使用率が高＜ｔ’ｐ、パケットの受
信が不当に規制されることを防止することがで自るとい
う利点がある。
効保留を防止することがで會るた、め、該ＰＭの無効保
留によって該ＰＭの使用率が高＜ｔ’ｐ、パケットの受
信が不当に規制されることを防止することがで自るとい
う利点がある。
第１図はＣＰＵとＣＣＩのブロック構成・の−例であり
、第３図は本発明によるＣＰＵと００１間の各命令クー
ケンスの例である。 ｃｐυ・・・中央処理装置、ＣＣ，−中央制御装置、皿
・・・主記憶装置、ＣＣＩｃ・−通信制御装置、ＰＭ−
パケット格納用メモリ、ＢＴＣ−プ四ツク転送制御部、
ｐｗｃ−ＰＭ格納制御部、ＬＣ〒−闘纏制回線、１−・
ＭＭ 、Ｃ０間を接続する線、５−ｃｃ、ｙｔｔｃ間を
接続す：６線、５−ｎｔｃ、ｐＭ間＆接続ｆ ｈ ’ｌ
１ｌｉ、４ ＝ Ｉｌ？Ｃ−ＬＣＴ間を接続する線。 特許出願人 日本電信電話公社
、第３図は本発明によるＣＰＵと００１間の各命令クー
ケンスの例である。 ｃｐυ・・・中央処理装置、ＣＣ，−中央制御装置、皿
・・・主記憶装置、ＣＣＩｃ・−通信制御装置、ＰＭ−
パケット格納用メモリ、ＢＴＣ−プ四ツク転送制御部、
ｐｗｃ−ＰＭ格納制御部、ＬＣ〒−闘纏制回線、１−・
ＭＭ 、Ｃ０間を接続する線、５−ｃｃ、ｙｔｔｃ間を
接続す：６線、５−ｎｔｃ、ｐＭ間＆接続ｆ ｈ ’ｌ
１ｌｉ、４ ＝ Ｉｌ？Ｃ−ＬＣＴ間を接続する線。 特許出願人 日本電信電話公社
Claims (1)
- ８重化された通信制御装置が回線からパケットを受信後
、該パケットの一部を現用・予備両系０パケツト格納用
メ毫すに格納し、他部を中央感層装置に転送し、パケッ
ト送信時には該過信制御装置内で前記両パケットを結合
して回線へ送出すゐパケット送受信方式にお−て、該通
信制御装置が、該中央処理装置ＫｓＩＰｖ′ｈでパケッ
トの受信が＊ｇされ九あと、予備系のパケット格納用メ
毫りに該受信が確認され九パケットを書込む手段および
書込み終了後該中央処履装置に割込みをかけゐ手段とを
＾備し九構成から′Ｉｋることを特徴とするパケット受
信蓄積方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56111806A JPS5813050A (ja) | 1981-07-17 | 1981-07-17 | パケツト受信蓄積方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56111806A JPS5813050A (ja) | 1981-07-17 | 1981-07-17 | パケツト受信蓄積方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5813050A true JPS5813050A (ja) | 1983-01-25 |
Family
ID=14570617
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP56111806A Pending JPS5813050A (ja) | 1981-07-17 | 1981-07-17 | パケツト受信蓄積方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5813050A (ja) |
-
1981
- 1981-07-17 JP JP56111806A patent/JPS5813050A/ja active Pending
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