JPS58144272U - しきい値弁別回路 - Google Patents

しきい値弁別回路

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Publication number
JPS58144272U
JPS58144272U JP4124782U JP4124782U JPS58144272U JP S58144272 U JPS58144272 U JP S58144272U JP 4124782 U JP4124782 U JP 4124782U JP 4124782 U JP4124782 U JP 4124782U JP S58144272 U JPS58144272 U JP S58144272U
Authority
JP
Japan
Prior art keywords
transistor
voltage
input voltage
discrimination circuit
predetermined
Prior art date
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Pending
Application number
JP4124782U
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English (en)
Inventor
杉本 富明
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Toshiba Corp
Original Assignee
Toshiba Corp
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Filing date
Publication date
Application filed by Toshiba Corp filed Critical Toshiba Corp
Priority to JP4124782U priority Critical patent/JPS58144272U/ja
Publication of JPS58144272U publication Critical patent/JPS58144272U/ja
Pending legal-status Critical Current

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第1図は従来のしきい値弁別回路を示す回路図、第2図
は第1図に示す回路の動作を説明する為の信号波形図、
第3図はこの考案に係るしきい値弁別回路の一実施例を
示す回路図、第4図は第3図に示す回路の動作を説明す
る為の信号波形図、第5図はこの考案の他の実施例を示
す回路図である。 Q21〜Q26・・・トランジスタ、R2□〜R,・・
・抵抗、E21〜E22・・・電源、21.22・・:
出力端子。

Claims (1)

    【実用新案登録請求の範囲】
  1. ベースに入力電圧が印加される第1のトランジスタと、
    この第1のトランジスタと差動対を成す第2のトランジ
    スタと、前記第1、第2のトランジスタのエミッタに共
    通接続される定電流源を成す第3のトランジスタと、前
    記入力電圧を前記第3のトランジスタのベースバイアス
    電源とし前記入力電圧の第1の所定電圧を境にして前記
    第3のトランジスタのオン、オフを切り換えるバイアス
    回路と、前記第3のトランジスタがオン状態に於いて前
    記入力電圧の前記第1の所定電圧とは異なる第2の所定
    電圧を境に前記第1、第2のトランジスタのオン、オフ
    が切り換わるように前記第2のトランジスタのベースバ
    イアス電圧を設定するバイアス電源とを具備し、前記第
    1、第2のコレクタ出力電圧を検出子ることにより前記
    入力電圧レベルを前記第1、第2の所定電圧を境にレベ
    ルの異なる3値レベルで弁別することを特徴とするしき
    い値弁別回路。
JP4124782U 1982-03-24 1982-03-24 しきい値弁別回路 Pending JPS58144272U (ja)

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JPS58144272U true JPS58144272U (ja) 1983-09-28

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