JPS58156263A - フアクシミリ装置 - Google Patents
フアクシミリ装置Info
- Publication number
- JPS58156263A JPS58156263A JP57038015A JP3801582A JPS58156263A JP S58156263 A JPS58156263 A JP S58156263A JP 57038015 A JP57038015 A JP 57038015A JP 3801582 A JP3801582 A JP 3801582A JP S58156263 A JPS58156263 A JP S58156263A
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- JP
- Japan
- Prior art keywords
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- black
- recorded
- recording
- driver
- Prior art date
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- Pending
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Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N1/00—Scanning, transmission or reproduction of documents or the like, e.g. facsimile transmission; Details thereof
- H04N1/04—Scanning arrangements, i.e. arrangements for the displacement of active reading or reproducing elements relative to the original or reproducing medium, or vice versa
- H04N1/17—Scanning arrangements, i.e. arrangements for the displacement of active reading or reproducing elements relative to the original or reproducing medium, or vice versa the scanning speed being dependent on content of picture
Landscapes
- Engineering & Computer Science (AREA)
- Multimedia (AREA)
- Signal Processing (AREA)
- Fax Reproducing Arrangements (AREA)
- Facsimile Heads (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明はファクシミリ装置、特にその記録部の構成に関
するものである。
するものである。
ファクシミリ装置は白黒画像を伝送するものであるが、
受信機の記録部で社黒画素の位置にある記録ヘッドを駆
動して、白紙に黒点を表示する。
受信機の記録部で社黒画素の位置にある記録ヘッドを駆
動して、白紙に黒点を表示する。
第１図は、従来の記録ヘッド対応にドライバを設は九、
いわゆるドライバ搭載飄記録ヘッドのドライバ部分を示
したものである。図の１は白黒画像の入力端子、２はド
ライバ４のエネーブル信号、３はシフトレジスタで構成
されるラインメモリを表わす。白黒画像の記録は、ライ
ンメモリ内に１（黒）が記憶されている画素に対応する
ドライバ４をエネーブル信号が１である期間だけ駆動す
ることによって行なわれる。
いわゆるドライバ搭載飄記録ヘッドのドライバ部分を示
したものである。図の１は白黒画像の入力端子、２はド
ライバ４のエネーブル信号、３はシフトレジスタで構成
されるラインメモリを表わす。白黒画像の記録は、ライ
ンメモリ内に１（黒）が記憶されている画素に対応する
ドライバ４をエネーブル信号が１である期間だけ駆動す
ることによって行なわれる。
この構成によれは、ｌ走査線内の画素がすべて１（黒）
である場合、多大の記録電流が必要となり、大容量ｏｔ
ｍを設置することが不可避となる。
である場合、多大の記録電流が必要となり、大容量ｏｔ
ｍを設置することが不可避となる。
この対策として、−走査線を複数個のブロックに分割し
、数回に分けて記録ヘッドを駆動することが考えられる
。第２図は、この方法を用い九場合のドライバ部分の構
成を示したものであシ、図の１．３．４はそれぞれｔｓ
１図の１．３．４と同一の端子あるいは回路を表わす。
、数回に分けて記録ヘッドを駆動することが考えられる
。第２図は、この方法を用い九場合のドライバ部分の構
成を示したものであシ、図の１．３．４はそれぞれｔｓ
１図の１．３．４と同一の端子あるいは回路を表わす。
同図の入力端子群５は、ブロックごとにドライバを駆動
するためのブロック・エネーブル信号の入力端子から成
る。例えば、走査線画シの画素数が２０４８の場合、１
走査線ｔ８ブロツクに分割して、８本のブロック・エネ
ーブル信号を設け、これらｔ順次駆動することによって
、記録に要する電流の最大値を１／８にすることができ
る。この場合、ブロック当りの画素数は２５６である（
第２図では、図を見易くするため、ブロック当シの画素
数を３にしている）、この場合、所要電源容量は減少す
るが、ｌ走査１を８回に分けて記録するため、配録に要
する時間が８倍となる。
するためのブロック・エネーブル信号の入力端子から成
る。例えば、走査線画シの画素数が２０４８の場合、１
走査線ｔ８ブロツクに分割して、８本のブロック・エネ
ーブル信号を設け、これらｔ順次駆動することによって
、記録に要する電流の最大値を１／８にすることができ
る。この場合、ブロック当りの画素数は２５６である（
第２図では、図を見易くするため、ブロック当シの画素
数を３にしている）、この場合、所要電源容量は減少す
るが、ｌ走査１を８回に分けて記録するため、配録に要
する時間が８倍となる。
したがって、本発明の目的は、小容量の電源で高速記録
の可能なファクシミリ装置を提供することにある。
の可能なファクシミリ装置を提供することにある。
本発明は、上記目的を達成するためｌ１ｉｉ素情報に応
じて、同時に記録する黒の画素敷金所定の値以下に制限
することによって、上記目的を達成するものである。
じて、同時に記録する黒の画素敷金所定の値以下に制限
することによって、上記目的を達成するものである。
以下、本発明を実施例によって説明する。
本発明の第１の実施例は画素情報に応じて同時に記録す
る画素数を制限する手段として、−ラインＱｉｉＩｉｉ
Ａ数を第２図のようにブロック化すると共に、１ブロツ
ク内に記録ヘットの駆動を必要があるか否か、すなわち
、ｌブロック内に黒画素があるか否かを判別し、記録部
を上記黒画素のないブロックに対してはブロック・エネ
ーブル信号の送出を省略し、直に次のブロックの記録に
移行するものである。これらの装置の構成はＪＩＥ２図
の構成において、入力端子群５に加えられるブロック・
エネーブル信号を変更することによって容易に実現でき
るので、そのｌｌ！明は省略する。
る画素数を制限する手段として、−ラインＱｉｉＩｉｉ
Ａ数を第２図のようにブロック化すると共に、１ブロツ
ク内に記録ヘットの駆動を必要があるか否か、すなわち
、ｌブロック内に黒画素があるか否かを判別し、記録部
を上記黒画素のないブロックに対してはブロック・エネ
ーブル信号の送出を省略し、直に次のブロックの記録に
移行するものである。これらの装置の構成はＪＩＥ２図
の構成において、入力端子群５に加えられるブロック・
エネーブル信号を変更することによって容易に実現でき
るので、そのｌｌ！明は省略する。
第３図は本発明の他の実施例によるファクシミリ記録部
の動作原理を説明する図で、−走ｆ、線の信号パターン
を示すもので、斜線部が黒画素を他は白１ｉｉｉ＊を示
す。上欄の数字はブロックの番号を示す。
の動作原理を説明する図で、−走ｆ、線の信号パターン
を示すもので、斜線部が黒画素を他は白１ｉｉｉ＊を示
す。上欄の数字はブロックの番号を示す。
一走査Ｉｉめ画素数を、２０４８、同時に記録できる黒
Ｉ！ｉｉ素数の最大値を２５６、記録部の動作はブロッ
ク毎に行なわれる。
Ｉ！ｉｉ素数の最大値を２５６、記録部の動作はブロッ
ク毎に行なわれる。
この実施例は、感画素数が２５６を越えない範囲で、１
個以上のブロックに対して、ブロック・エネーブル信号
を送出し、黒１ＴＩｉｌＡに対応する記録ヘッドを駆動
するものである。第３図に沿って説明すると、左端から
、第２ブロツクの途中で黒−票が２５６を越えるから、
１回目は第０ブロツクおよび第１ブロツクのドライブ回
路のみが駆動される。２回目の駆動のための黒画素数の
計数は第２ブロツクから始められ、第３ブロツク内で黒
画素数が２５６をこえるため、第２ブロツクのドライブ
回路のみが２回目に駆動される。第０ブロツクから第７
ブロツクまでのブロック・エネーブルの値′ｔ−２進表
示すると、 １回目： １１０００ＧＧＧ ２回目： ００１０００００ ３ｇＡ目： ０００１１１０Ｇ ４回目： ００００００１１ となる。上記の駆動パターンの表示には４バイトを必要
とするが、これを１バイトに圧縮することができる。例
えば、奇数回目に駆動されるブロックのブロック・エネ
ーブル信号の論理和である圧縮データ： １１０１１１
００ から復元することができる。
個以上のブロックに対して、ブロック・エネーブル信号
を送出し、黒１ＴＩｉｌＡに対応する記録ヘッドを駆動
するものである。第３図に沿って説明すると、左端から
、第２ブロツクの途中で黒−票が２５６を越えるから、
１回目は第０ブロツクおよび第１ブロツクのドライブ回
路のみが駆動される。２回目の駆動のための黒画素数の
計数は第２ブロツクから始められ、第３ブロツク内で黒
画素数が２５６をこえるため、第２ブロツクのドライブ
回路のみが２回目に駆動される。第０ブロツクから第７
ブロツクまでのブロック・エネーブルの値′ｔ−２進表
示すると、 １回目： １１０００ＧＧＧ ２回目： ００１０００００ ３ｇＡ目： ０００１１１０Ｇ ４回目： ００００００１１ となる。上記の駆動パターンの表示には４バイトを必要
とするが、これを１バイトに圧縮することができる。例
えば、奇数回目に駆動されるブロックのブロック・エネ
ーブル信号の論理和である圧縮データ： １１０１１１
００ から復元することができる。
第４図は、上記のような圧縮データを近似的に作成する
ための回路構成である。図の１０はクロックの入力端子
、１１は初期設定用Ａルスの入力端子、２０は白または
黒の画素が存在するときに“１”となる信号の、２１は
黒画素が存在するときに１となる信号（すなわち、２値
画偉そのもの）の端子である。また、３Ｇ 、３１．８
２は８ビツトのカウンタ、４０は論理積の否定をとるゲ
ート、４１は否定論理ゲート、５０はトリガ・７リツプ
フロツプ、５１は遅延７リツプフロツプ、６０は８ビツ
トのり７トレジスタ、７０は圧縮データの出力端子ｔ−
表わす。
ための回路構成である。図の１０はクロックの入力端子
、１１は初期設定用Ａルスの入力端子、２０は白または
黒の画素が存在するときに“１”となる信号の、２１は
黒画素が存在するときに１となる信号（すなわち、２値
画偉そのもの）の端子である。また、３Ｇ 、３１．８
２は８ビツトのカウンタ、４０は論理積の否定をとるゲ
ート、４１は否定論理ゲート、５０はトリガ・７リツプ
フロツプ、５１は遅延７リツプフロツプ、６０は８ビツ
トのり７トレジスタ、７０は圧縮データの出力端子ｔ−
表わす。
画像情報が入力される以帥に、すなわち、端子２０の入
力が″Ｏ＃のときに、端子１１の入力を一時的にＯ゛に
して、カウンタ３０．３１．３２をクリアし、トリガ・
フリップフロップ５０を１に設定しておく。画像が入力
され始めると、カウンタ３０は歩進され、その値が２５
５になる度に、桁上げ信号が出力される。図のゲート４
０への入力はこの桁上げ信号ｔＸわす。桁上げ信号によ
ってゲート４０の出力が０となると、カウンタ３１はク
リアされ、遅延フリップフロップ５１は負極性のパルス
を送出する。これをクロックとするシフトレジスタ６０
は、カウンタ３０が０にもどる度に１ビツトシフトされ
る。
力が″Ｏ＃のときに、端子１１の入力を一時的にＯ゛に
して、カウンタ３０．３１．３２をクリアし、トリガ・
フリップフロップ５０を１に設定しておく。画像が入力
され始めると、カウンタ３０は歩進され、その値が２５
５になる度に、桁上げ信号が出力される。図のゲート４
０への入力はこの桁上げ信号ｔＸわす。桁上げ信号によ
ってゲート４０の出力が０となると、カウンタ３１はク
リアされ、遅延フリップフロップ５１は負極性のパルス
を送出する。これをクロックとするシフトレジスタ６０
は、カウンタ３０が０にもどる度に１ビツトシフトされ
る。
カウンタ３１およびカウンタ３２は、黒画素の入力によ
って歩進され、カウンタ３２の桁上げ信号はゲー）４１
に入力される。このゲートはカウンタ３１の値をカウン
タ３２に初期設定する丸めのものである。また、カウン
タ３２の桁上げ信号は、トリガ・フリップフロップ５ｏ
の反転にも使用される。
って歩進され、カウンタ３２の桁上げ信号はゲー）４１
に入力される。このゲートはカウンタ３１の値をカウン
タ３２に初期設定する丸めのものである。また、カウン
タ３２の桁上げ信号は、トリガ・フリップフロップ５ｏ
の反転にも使用される。
ｌ走査線内の黒画素数が２５４以下のときは、トリガ・
７リツプフロツプ５ｏは終始１１に保持し、カウンタ３
０の桁上げ信号によって８ビツトに展開されてシフトレ
ジスタ６ｏに格納される。ｌ走査線内の黒画素数が２５
５以上のときは、カウンタ３２の桁上げ信号の数だけト
リガ・クリップ７０ツブの出力が反転され、シフトレジ
スタ６に格納される。（黒画素数２５６で反転するには
、カウンタ３２の桁上げ信号と端子２１の入力の論理積
によって、カウンタ３２への設定と、トリガ・フリップ
フロップの反転を行なえばよいが、必要性は感じられな
い。） シフトレジスタ６０に格納されている圧縮データから前
記のブロック・エネーブル信号を求めるには、例えば続
出し専用メモリを用いればよい。
７リツプフロツプ５ｏは終始１１に保持し、カウンタ３
０の桁上げ信号によって８ビツトに展開されてシフトレ
ジスタ６ｏに格納される。ｌ走査線内の黒画素数が２５
５以上のときは、カウンタ３２の桁上げ信号の数だけト
リガ・クリップ７０ツブの出力が反転され、シフトレジ
スタ６に格納される。（黒画素数２５６で反転するには
、カウンタ３２の桁上げ信号と端子２１の入力の論理積
によって、カウンタ３２への設定と、トリガ・フリップ
フロップの反転を行なえばよいが、必要性は感じられな
い。） シフトレジスタ６０に格納されている圧縮データから前
記のブロック・エネーブル信号を求めるには、例えば続
出し専用メモリを用いればよい。
とくに、ファクシミリの制御回路が蓄積プログラム方式
で実現されている場合は、プログラムを蓄積するための
続出し専用メモリが存在するため、この方法は経済性に
優れている。
で実現されている場合は、プログラムを蓄積するための
続出し専用メモリが存在するため、この方法は経済性に
優れている。
ｊ１５図は、絖出し専用メモリに内蔵される状態遷移ｆ
ｉ、８６図は出力衣の一部を表わしたものである。第１
回目のブロック・エネーブル信号は、出力衣の相対アド
レスが圧縮データ １１０１１１０Ｇ の位置に格納されている。第２回目のブロック・エネー
ブル信号は、出力衣の相対アドレスが００１０００１１ の位置に存在する。このアドレスは状態遷移弐の相対ア
ドレス １１０１１１００ に格納されている。同様に、状態遷移表の相対アドレス ００１０００１１ ０００１１１００ ００００００１１ には、それぞれ次に索表すべき相対アドレス０００１１
１００ ｏｏｏｏｏｏｉｉ ｏｏｏｏｏｏｏ。
ｉ、８６図は出力衣の一部を表わしたものである。第１
回目のブロック・エネーブル信号は、出力衣の相対アド
レスが圧縮データ １１０１１１０Ｇ の位置に格納されている。第２回目のブロック・エネー
ブル信号は、出力衣の相対アドレスが００１０００１１ の位置に存在する。このアドレスは状態遷移弐の相対ア
ドレス １１０１１１００ に格納されている。同様に、状態遷移表の相対アドレス ００１０００１１ ０００１１１００ ００００００１１ には、それぞれ次に索表すべき相対アドレス０００１１
１００ ｏｏｏｏｏｏｉｉ ｏｏｏｏｏｏｏ。
が格納されておシ、相対アドレス
ｏｏｏｏｏｏｏ。
を検出し九時点で１走査線の記録を終了する。
ブロック数が多いときは、各ブロックを小ブロックに分
割して、上記と同様の処理をすればよい。
割して、上記と同様の処理をすればよい。
なお、第４図の回路は、ファクシミリの受信装置だけで
なく、送信装置にも設置することも有効である。これは
送信側でも記録ヘッドが何回駆動されるかを求めいわゆ
るｐｉ １１ビツト（記録の最小伝送時間（確保するた
めの冗長ビット）の挿入の要否を判定しなければなら牛
いからである。送信と受信を同時に行なうことのないト
２ンシーパ減のファクシミリでは、この回路は共用でき
る。
なく、送信装置にも設置することも有効である。これは
送信側でも記録ヘッドが何回駆動されるかを求めいわゆ
るｐｉ １１ビツト（記録の最小伝送時間（確保するた
めの冗長ビット）の挿入の要否を判定しなければなら牛
いからである。送信と受信を同時に行なうことのないト
２ンシーパ減のファクシミリでは、この回路は共用でき
る。
上記実施例では、１走査線の画素がすべて白であっても
記録ヘッドが１回駆動されるが、このような場合には圧
縮データを ｏｏｏｏｏｏｏ。
記録ヘッドが１回駆動されるが、このような場合には圧
縮データを ｏｏｏｏｏｏｏ。
として、記録ヘッドの駆動を止め、次の走査線の記録に
移行させることもできる。
移行させることもできる。
また、ブロック・エネーブル信号を上記のように走査線
の端から順次１とする代シに、その順序を必要に応じて
変えることも容易である。この方法は、複数個の記録ヘ
ッドがドライバを共用する場合（マトリクスを並べ九構
成の場合）に有効である。
の端から順次１とする代シに、その順序を必要に応じて
変えることも容易である。この方法は、複数個の記録ヘ
ッドがドライバを共用する場合（マトリクスを並べ九構
成の場合）に有効である。
上記実施例から明らかなように、本発明によれば、小容
量の電源を用いた場合の黒画素の少ない走査線の記録時
間を大幅に短縮することができる。
量の電源を用いた場合の黒画素の少ない走査線の記録時
間を大幅に短縮することができる。
黒画素の少ない走査線は、概して符号化ビット数も少な
いため（いわゆるｐｉ１１ビットを除去した効率の高い
伝送が可能となる。
いため（いわゆるｐｉ１１ビットを除去した効率の高い
伝送が可能となる。
第１図、第２図は従来の記録ヘッドのドライバ部分の構
成ブロック図、第３図は本発明の一実施例の原理を説明
する丸めの図、第４図は本発明の実施例の主要部分の回
路図、第５図および第６図は本発明の実施例で用いる続
出し専用メモリ内に格納される衆の概念図である。 ３・・・ラインメモリ、４・・・ドライバ、３Ｇ 、３
１ 。 ３２・・・カウンタ、５Ｇ・・・トリガ・フリップフロ
ップ、５１・・・遅延フリップフロップ、６０・・・シ
フトレジスタ。 代理人 弁理士 博田利幸 第 １ 図
成ブロック図、第３図は本発明の一実施例の原理を説明
する丸めの図、第４図は本発明の実施例の主要部分の回
路図、第５図および第６図は本発明の実施例で用いる続
出し専用メモリ内に格納される衆の概念図である。 ３・・・ラインメモリ、４・・・ドライバ、３Ｇ 、３
１ 。 ３２・・・カウンタ、５Ｇ・・・トリガ・フリップフロ
ップ、５１・・・遅延フリップフロップ、６０・・・シ
フトレジスタ。 代理人 弁理士 博田利幸 第 １ 図
Claims (1)
- １、画素情報に応じて同時に記録する画集数を制御する
手段を具備することを特徴とするファクシミリ装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57038015A JPS58156263A (ja) | 1982-03-12 | 1982-03-12 | フアクシミリ装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57038015A JPS58156263A (ja) | 1982-03-12 | 1982-03-12 | フアクシミリ装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS58156263A true JPS58156263A (ja) | 1983-09-17 |
Family
ID=12513744
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57038015A Pending JPS58156263A (ja) | 1982-03-12 | 1982-03-12 | フアクシミリ装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58156263A (ja) |
-
1982
- 1982-03-12 JP JP57038015A patent/JPS58156263A/ja active Pending
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