JPS58162122A - メモリを備えた周波数設定回路 - Google Patents
メモリを備えた周波数設定回路Info
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- JPS58162122A JPS58162122A JP4600282A JP4600282A JPS58162122A JP S58162122 A JPS58162122 A JP S58162122A JP 4600282 A JP4600282 A JP 4600282A JP 4600282 A JP4600282 A JP 4600282A JP S58162122 A JPS58162122 A JP S58162122A
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- JP
- Japan
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- frequency
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- memory
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- Granted
Links
- 238000000034 method Methods 0.000 claims description 2
- 230000015654 memory Effects 0.000 abstract description 20
- 230000003287 optical effect Effects 0.000 abstract 1
- 230000010354 integration Effects 0.000 description 4
- 238000010586 diagram Methods 0.000 description 2
- 241000288105 Grus Species 0.000 description 1
- 230000005540 biological transmission Effects 0.000 description 1
- 238000001514 detection method Methods 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03J—TUNING RESONANT CIRCUITS; SELECTING RESONANT CIRCUITS
- H03J5/00—Discontinuous tuning; Selecting predetermined frequencies; Selecting frequency bands with or without continuous tuning in one or more of the bands, e.g. push-button tuning, turret tuner
- H03J5/02—Discontinuous tuning; Selecting predetermined frequencies; Selecting frequency bands with or without continuous tuning in one or more of the bands, e.g. push-button tuning, turret tuner with variable tuning element having a number of predetermined settings and adjustable to a desired one of these settings
- H03J5/0245—Discontinuous tuning using an electrical variable impedance element, e.g. a voltage variable reactive diode, in which no corresponding analogue value either exists or is preset, i.e. the tuning information is only available in a digital form
- H03J5/0272—Discontinuous tuning using an electrical variable impedance element, e.g. a voltage variable reactive diode, in which no corresponding analogue value either exists or is preset, i.e. the tuning information is only available in a digital form the digital values being used to preset a counter or a frequency divider in a phase locked loop, e.g. frequency synthesizer
- H03J5/0281—Discontinuous tuning using an electrical variable impedance element, e.g. a voltage variable reactive diode, in which no corresponding analogue value either exists or is preset, i.e. the tuning information is only available in a digital form the digital values being used to preset a counter or a frequency divider in a phase locked loop, e.g. frequency synthesizer the digital values being held in an auxiliary non erasable memory
Landscapes
- Engineering & Computer Science (AREA)
- Computer Hardware Design (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Channel Selection Circuits, Automatic Tuning Circuits (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
この発明は複数の運用周波数を、記憶保持する無線通信
機において、運用中以外の任意の記憶周波数を変更し得
る記憶周波数の変更方式を得るのを目的とする。
機において、運用中以外の任意の記憶周波数を変更し得
る記憶周波数の変更方式を得るのを目的とする。
従来の周波数記憶装置を有する無線通信機において、記
憶周波数を変更する際には、ＶＦＯ（ここでは周波数記
憶装置以外の周波数調整手段を総称するものとする）に
より希望の運用周波数に同調した状態で、メモリＣＨ（
チャンネル）スイッチを書込みまたは書画したいメモＩ
Ｊ ＣＨに合わせて書込みスイッチを操作している。こ
れは単に運用周波数をメモＩＪ ＣＨに保持するだめの
動作としては適当（１） であるが、本発明ではさらに一歩を進めて、成る周波数
で運用中に任意のメモＩＪ ＣＨに任意の周波数を書込
むことにより、今後に使用すべき周波数を予め記憶用意
して、機器の効果的な運用を可能とするものである。
憶周波数を変更する際には、ＶＦＯ（ここでは周波数記
憶装置以外の周波数調整手段を総称するものとする）に
より希望の運用周波数に同調した状態で、メモリＣＨ（
チャンネル）スイッチを書込みまたは書画したいメモＩ
Ｊ ＣＨに合わせて書込みスイッチを操作している。こ
れは単に運用周波数をメモＩＪ ＣＨに保持するだめの
動作としては適当（１） であるが、本発明ではさらに一歩を進めて、成る周波数
で運用中に任意のメモＩＪ ＣＨに任意の周波数を書込
むことにより、今後に使用すべき周波数を予め記憶用意
して、機器の効果的な運用を可能とするものである。
図は本発明の実施するに必要々回路構成例を示スフロッ
ク図であって、シャフトエノコーダ等の周波数調整手段
１の発生するパルス１０を・Ｑルス積算カウンタ２に読
み込んで、デジタルデータ１１を出力する。デジタルデ
ータ１１はデジタルメモリ３ａ・・・３ｎに加え、メモ
ＩＪ ＣＨスイッチＳ１ａ の選択するメモリにメモリ
書込みスイッチＳ２の操作により書込み記憶される。メ
モリ出力１２はメモリＣＨス１°ツチＳ、ｂにより選択
されたメモリ内容を出力し、データセレクタ４で積算カ
ウンタ２の出力１１とメモリ出力１２のいづれかを選択
してデータ保持レノスタ５にデータ１３を入力する。デ
ータセレクタ４ Ｕ ＶＦＯ／メモリ（メモリコールと
もいう）スイッチ３ａにより選択動作をするが、他に支
障が無ければ直接にスイッチで切替えても（９） よい。５３ｂｉｄメモリの保護スイッチ・で、メモリ使
用時に８２を誤まって操作してもメモリが書き替えられ
ないようにスイッチ３ａと連動になっている。
ク図であって、シャフトエノコーダ等の周波数調整手段
１の発生するパルス１０を・Ｑルス積算カウンタ２に読
み込んで、デジタルデータ１１を出力する。デジタルデ
ータ１１はデジタルメモリ３ａ・・・３ｎに加え、メモ
ＩＪ ＣＨスイッチＳ１ａ の選択するメモリにメモリ
書込みスイッチＳ２の操作により書込み記憶される。メ
モリ出力１２はメモリＣＨス１°ツチＳ、ｂにより選択
されたメモリ内容を出力し、データセレクタ４で積算カ
ウンタ２の出力１１とメモリ出力１２のいづれかを選択
してデータ保持レノスタ５にデータ１３を入力する。デ
ータセレクタ４ Ｕ ＶＦＯ／メモリ（メモリコールと
もいう）スイッチ３ａにより選択動作をするが、他に支
障が無ければ直接にスイッチで切替えても（９） よい。５３ｂｉｄメモリの保護スイッチ・で、メモリ使
用時に８２を誤まって操作してもメモリが書き替えられ
ないようにスイッチ３ａと連動になっている。
データ保持レノスタ５はデジタルデータを通過または保
持するＩ／ジスタで、スイッチＳ４により動作を選択す
る。通過状態では入力データ１３はそのまま出力データ
１４としてＰＬＬ回路に加えられ運用周波数を設定する
。従って８４が「通過」の状態でメモリを書き込むのに
はＳ３を「■ＦＯ」とし、Ｓｌは希望のＣＨにセットし
てＳ２をＯＮすれば、その時の運用周波数がメモリされ
る。
持するＩ／ジスタで、スイッチＳ４により動作を選択す
る。通過状態では入力データ１３はそのまま出力データ
１４としてＰＬＬ回路に加えられ運用周波数を設定する
。従って８４が「通過」の状態でメモリを書き込むのに
はＳ３を「■ＦＯ」とし、Ｓｌは希望のＣＨにセットし
てＳ２をＯＮすれば、その時の運用周波数がメモリされ
る。
次に８４を「保持」にすると、データ１４はレジスタ５
内に保持されてＰＬＬ回路に供給される。
内に保持されてＰＬＬ回路に供給される。
このようにして運用周波数は前段部の動作とは無関係に
一定に保持されるから、その周波数で運用しているまま
で、周波数調整手段１を動かして希望の周波数に対応す
るデータをメモリに書込ませることができる。その際の
周波数表示はデータセレクタ出力１３で周波数表示を働
かすようにしておけば、メモリされる運用周波数が表示
されることになる。このようにして一定周波数で運用の
まま、任意のメモＩＪ ＣＨに任意の周波数を書込むこ
とが可能である。
一定に保持されるから、その周波数で運用しているまま
で、周波数調整手段１を動かして希望の周波数に対応す
るデータをメモリに書込ませることができる。その際の
周波数表示はデータセレクタ出力１３で周波数表示を働
かすようにしておけば、メモリされる運用周波数が表示
されることになる。このようにして一定周波数で運用の
まま、任意のメモＩＪ ＣＨに任意の周波数を書込むこ
とが可能である。
次に８４を「保持」から「通過」にもどす場合には通常
はデータ１３はデータ１４と異っているから、Ｓ４が「
保持」から「通過」に変わったことを検出回路６で検出
して読込み命令１５を積算カウンタ２に与えてデータ１
４をプリセットに読み込む。これでメモリ書込み開始以
前の状態にもどったことになる。
はデータ１３はデータ１４と異っているから、Ｓ４が「
保持」から「通過」に変わったことを検出回路６で検出
して読込み命令１５を積算カウンタ２に与えてデータ１
４をプリセットに読み込む。これでメモリ書込み開始以
前の状態にもどったことになる。
実際の運用について例示すれば、機器が受信機の場合に
成る周波数を受信しながら、次に受信すべき周波数を空
いたメモＩＪ ＣＨに書込むことにより、必要に応じて
、その周波数に即時に移動することができる。また送受
信機であれば、送信あるいは受信中に次に使用すべき周
波数を空いたメモＩＪＣＨに書込んでおいて、迅速に希
望周波数に移行することによって、交信能率を上げるこ
とができる等の従来の機器に見られない利点は少なくな
い。
成る周波数を受信しながら、次に受信すべき周波数を空
いたメモＩＪ ＣＨに書込むことにより、必要に応じて
、その周波数に即時に移動することができる。また送受
信機であれば、送信あるいは受信中に次に使用すべき周
波数を空いたメモＩＪＣＨに書込んでおいて、迅速に希
望周波数に移行することによって、交信能率を上げるこ
とができる等の従来の機器に見られない利点は少なくな
い。
図は本発明実施例のブロック回路図である。
■・・・周波数調整手段、２・・・・ぐルス積算カウン
タ、３ａ・・・３ｎ・・・デシタルメモリ、４ ・デー
タセレクタ、５・・・レジスタ、Ｓ＋ 、Ｓ２１８３
＋８４・・・スイッチ。 特許出願人 八重洲無線株式会社
タ、３ａ・・・３ｎ・・・デシタルメモリ、４ ・デー
タセレクタ、５・・・レジスタ、Ｓ＋ 、Ｓ２１８３
＋８４・・・スイッチ。 特許出願人 八重洲無線株式会社
Claims (1)
- 複数の運用周波数を記憶保持する無線通信機において、
運用中以外の任意の記憶周波数を変更することを特徴と
する記憶周波数の変更方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4600282A JPS58162122A (ja) | 1982-03-23 | 1982-03-23 | メモリを備えた周波数設定回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4600282A JPS58162122A (ja) | 1982-03-23 | 1982-03-23 | メモリを備えた周波数設定回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS58162122A true JPS58162122A (ja) | 1983-09-26 |
| JPH0351134B2 JPH0351134B2 (ja) | 1991-08-05 |
Family
ID=12734867
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4600282A Granted JPS58162122A (ja) | 1982-03-23 | 1982-03-23 | メモリを備えた周波数設定回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58162122A (ja) |
-
1982
- 1982-03-23 JP JP4600282A patent/JPS58162122A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0351134B2 (ja) | 1991-08-05 |
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