JPS58174704U - プログラムロ−ダ - Google Patents
プログラムロ−ダInfo
- Publication number
- JPS58174704U JPS58174704U JP7292882U JP7292882U JPS58174704U JP S58174704 U JPS58174704 U JP S58174704U JP 7292882 U JP7292882 U JP 7292882U JP 7292882 U JP7292882 U JP 7292882U JP S58174704 U JPS58174704 U JP S58174704U
- Authority
- JP
- Japan
- Prior art keywords
- program loader
- program
- storage area
- loader
- storing
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Programmable Controllers (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
図は、本考案の一実施例を示した構成図である。
１はプログラムローダ、２はプログラムローダ制御回路
、３はメモリ回路、３１はワーキングエリア、３２はメ
インエリア、４は制御装置本体、５はキーボード、６は
補助記憶装置。
、３はメモリ回路、３１はワーキングエリア、３２はメ
インエリア、４は制御装置本体、５はキーボード、６は
補助記憶装置。
Claims (1)
- シーケンス制御装置にプログラムをロードするプログラ
ムローダにおいて、前記プログラムローダに予めコード
化されたパターンを記憶する第１の記憶エリアと、制御
するためのコードを記憶する第２の記憶エリアと、キー
ボードより入力したラベル信号に基づいて第１の記憶エ
リアからコードパターンを選出し、このコードパターン
を第２の記憶エリアに格納するプログラムローダ制御回
路とを備えたことを特徴とするプログラムローダ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7292882U JPS58174704U (ja) | 1982-05-19 | 1982-05-19 | プログラムロ−ダ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7292882U JPS58174704U (ja) | 1982-05-19 | 1982-05-19 | プログラムロ−ダ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS58174704U true JPS58174704U (ja) | 1983-11-22 |
Family
ID=30082462
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7292882U Pending JPS58174704U (ja) | 1982-05-19 | 1982-05-19 | プログラムロ−ダ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58174704U (ja) |
-
1982
- 1982-05-19 JP JP7292882U patent/JPS58174704U/ja active Pending
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